DE2156924B2 - Anordnung zur verringerung des leerlaufs der zentraleinheit in einem echtzeitrechner - Google Patents

Anordnung zur verringerung des leerlaufs der zentraleinheit in einem echtzeitrechner

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DE2156924B2 DE19712156924 DE2156924A DE2156924B2 DE 2156924 B2 DE2156924 B2 DE 2156924B2 DE 19712156924 DE19712156924 DE 19712156924 DE 2156924 A DE2156924 A DE 2156924A DE 2156924 B2 DE2156924 B2 DE 2156924B2
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