DE19856084C2 - Verfahren zur Herstellung einer Metalloxidschicht bzw. einer strukturierten Metalloxidschicht - Google Patents
Verfahren zur Herstellung einer Metalloxidschicht bzw. einer strukturierten MetalloxidschichtInfo
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- 238000000034 method Methods 0.000 title claims description 36
- 229910044991 metal oxide Inorganic materials 0.000 title claims description 29
- 150000004706 metal oxides Chemical class 0.000 title claims description 29
- 230000008569 process Effects 0.000 title description 10
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 34
- 229910052751 metal Inorganic materials 0.000 claims description 19
- 239000002184 metal Substances 0.000 claims description 19
- 235000012239 silicon dioxide Nutrition 0.000 claims description 16
- 239000000377 silicon dioxide Substances 0.000 claims description 16
- 230000004888 barrier function Effects 0.000 claims description 12
- 238000005530 etching Methods 0.000 claims description 10
- 238000004519 manufacturing process Methods 0.000 claims description 9
- 230000003647 oxidation Effects 0.000 claims description 9
- 238000007254 oxidation reaction Methods 0.000 claims description 9
- 230000001590 oxidative effect Effects 0.000 claims description 6
- 229910052715 tantalum Inorganic materials 0.000 claims description 6
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 6
- 239000010936 titanium Substances 0.000 claims description 6
- 229910052719 titanium Inorganic materials 0.000 claims description 6
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 5
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 5
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 5
- 229920005591 polysilicon Polymers 0.000 claims description 5
- 229910052760 oxygen Inorganic materials 0.000 claims description 4
- 239000001301 oxygen Substances 0.000 claims description 4
- 150000002366 halogen compounds Chemical class 0.000 claims description 3
- 229910052782 aluminium Inorganic materials 0.000 claims description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims description 2
- 238000004544 sputter deposition Methods 0.000 claims description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 11
- 229910052710 silicon Inorganic materials 0.000 description 11
- 239000010703 silicon Substances 0.000 description 11
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N Titan oxide Chemical compound O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 4
- 239000000463 material Substances 0.000 description 4
- 239000000758 substrate Substances 0.000 description 4
- YCKRFDGAMUMZLT-UHFFFAOYSA-N Fluorine atom Chemical compound [F] YCKRFDGAMUMZLT-UHFFFAOYSA-N 0.000 description 3
- 229910052731 fluorine Inorganic materials 0.000 description 3
- 239000011737 fluorine Substances 0.000 description 3
- 230000006870 function Effects 0.000 description 3
- 239000007789 gas Substances 0.000 description 3
- OGIDPMRJRNCKJF-UHFFFAOYSA-N titanium oxide Inorganic materials [Ti]=O OGIDPMRJRNCKJF-UHFFFAOYSA-N 0.000 description 3
- 230000008901 benefit Effects 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 2
- 238000011109 contamination Methods 0.000 description 2
- 239000003989 dielectric material Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000005669 field effect Effects 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 230000000750 progressive effect Effects 0.000 description 2
- 229910052814 silicon oxide Inorganic materials 0.000 description 2
- 238000003860 storage Methods 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 229910052681 coesite Inorganic materials 0.000 description 1
- 230000008878 coupling Effects 0.000 description 1
- 238000010168 coupling process Methods 0.000 description 1
- 238000005859 coupling reaction Methods 0.000 description 1
- 229910052906 cristobalite Inorganic materials 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 230000005284 excitation Effects 0.000 description 1
- 229910052736 halogen Inorganic materials 0.000 description 1
- 150000002367 halogens Chemical class 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 125000004430 oxygen atom Chemical group O* 0.000 description 1
- BPUBBGLMJRNUCC-UHFFFAOYSA-N oxygen(2-);tantalum(5+) Chemical compound [O-2].[O-2].[O-2].[O-2].[O-2].[Ta+5].[Ta+5] BPUBBGLMJRNUCC-UHFFFAOYSA-N 0.000 description 1
- 238000012856 packing Methods 0.000 description 1
- 230000008092 positive effect Effects 0.000 description 1
- 238000005036 potential barrier Methods 0.000 description 1
- 108090000623 proteins and genes Proteins 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 229910052682 stishovite Inorganic materials 0.000 description 1
- PBCFLUZVCVVTBY-UHFFFAOYSA-N tantalum pentoxide Inorganic materials O=[Ta](=O)O[Ta](=O)=O PBCFLUZVCVVTBY-UHFFFAOYSA-N 0.000 description 1
- 238000005496 tempering Methods 0.000 description 1
- 150000003608 titanium Chemical class 0.000 description 1
- 229910052905 tridymite Inorganic materials 0.000 description 1
Classifications
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C14/00—Coating by vacuum evaporation, by sputtering or by ion implantation of the coating forming material
- C23C14/58—After-treatment
- C23C14/5846—Reactive treatment
- C23C14/5853—Oxidation
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C28/00—Coating for obtaining at least two superposed coatings either by methods not provided for in a single one of groups C23C2/00 - C23C26/00 or by combinations of methods provided for in subclasses C23C and C25C or C25D
-
- C—CHEMISTRY; METALLURGY
- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C8/00—Solid state diffusion of only non-metal elements into metallic material surfaces; Chemical surface treatment of metallic material by reaction of the surface with a reactive gas, leaving reaction products of surface material in the coating, e.g. conversion coatings, passivation of metals
- C23C8/02—Pretreatment of the material to be coated
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
- H01L21/31116—Etching inorganic layers by chemical means by dry-etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/511—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures
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- Chemical & Material Sciences (AREA)
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- Chemical Kinetics & Catalysis (AREA)
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- Condensed Matter Physics & Semiconductors (AREA)
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- Manufacturing & Machinery (AREA)
- Ceramic Engineering (AREA)
- Inorganic Chemistry (AREA)
- Crystallography & Structural Chemistry (AREA)
- Formation Of Insulating Films (AREA)
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Description
Die Erfindung betrifft ein Verfahren zur Herstellung einer
Metalloxidschicht bzw. einer strukturierten Metalloxid
schicht, insbesondere ein Verfahren zur Herstellung einer Me
talloxidschicht als Gatedielektrikum eines Feldeffekttransi
stors bzw. als sogenanntes "storage node dielektrikum" in ei
ner Speicherzelle.
Zur Erhaltung bzw. Steigerung der internationalen Wettbe
werbsfähigkeit ist es notwendig, die Kosten, die zur Reali
sierung einer bestimmten elektronische Funktion aufzuwenden
sind, ständig zu senken und somit die Produktivität kontinu
ierlich zu steigern. Der Garant für die Produktivitätssteige
rung in den letzten Jahren war und ist dabei die CMOS-
Technologie bzw. die DRAM-Technologie. Die CMOS-Technologie
verdankt ihre herausragende Stellung vor allem dem kleinen
Platzbedarf der MOS-Transistoren selbst sowie der Möglich
keit, die MOS-Transistoren in einer integrierten Schaltung
mit höchster Packungsdichte anzuordnen. Hinzu kommen der ge
ringe Leistungsverbrauch und, mit fortschreitender Struktur
verkleinerung, auch eine hohe Schaltgeschwindigkeit.
Die fortschreitende Strukturverkleinerung der Transistoren
bringt es jedoch mit sich, daß zur wirksamen Ansteurung der
Transistoren immer dünnere dielektrische Schichten als Gate
dielektrika verwendet werden müssen. Wird, wie heute allge
mein üblich, Siliziumdioxid als Gatedielektrikum verwendet,
so müßte die Schichtdicke des Gatedielektrikums in einer 0,1 µm
Technologie weniger als 1,5 nm betragen. Es ist jedoch
sehr schwer, derartig dünne Siliziumdioxidschichten mit aus
reichender Genauigkeit, reproduzierbar herzustellen. Abwei
chungen von nur 0,1 nm bedeuten Schwankungen in der Schichtdicke
in der Größenordnung von 10%. Darüber hinaus kommt es
bei derartig dünnen Siliziumdioxidschichten zu hohen Leck
strömen durch die Siliziumdioxidschicht, da durch den Effekt
des quantenmechanischen Tunnels die Ladungsträger die durch
die Siliziumdioxidschicht erzeugte Potentialbarriere überwin
den können.
Es wurde daher vorgeschlagen, die übliche Siliziumdioxid
schicht durch ein Material mit einer höheren Dielektrizitäts
konstanten zu ersetzen. Mit einem derartigen Material können
vergleichsweise dicke Schichten von mehr als 5 nm als Gate
dielektrika verwendet werden, die jedoch elektrisch einer Si
liziumdioxidschicht von deutlich kleiner als 5 nm entspre
chen. Die Dicke einer derartigen Schicht ist leichter zu kon
trollieren und der Tunnelstrom durch die Schicht ist deutlich
vermindert. Als Materialien für das Gatedielektrikum wurden
beispielsweise Siliziumnitrid, Titanoxid oder Tantalpentoxid
vorgeschlagen.
Zur Herstellung dieser Materialschichten werden bisher CVD-
Prozesse eingesetzt. Die so hergestellten Schichten weisen
jedoch Verunreinigungen auf, die auf die bei den CVD-
Verfahren verwendeten Prozeßgase zurückzuführen sind. Diese
Verunreinigungen führen zu Ladungen und sogenannten "Traps"
in den Schichten, die wiederum die Funktion des Transistors
negativ beeinflussen.
Aus der US 4,495,219 ist bekannt, eine als Dielektrikum die
nende Metalloxidschicht durch Aufbringen des entsprechenden
Metalls auf die blanke Siliziumoberfläche mit nachfolgender
thermischer Oxidation zu bilden. Dabei besteht jedoch die Ge
fahr, daß das Metall in das Silizium diffundiert und dort ak
tive Bereiche in ihren elektrischen Eigenschaften nachteilig
beeinflußt.
Es ist daher Aufgabe der vorliegenden Erfindung, ein Verfah
ren zur Herstellung von Metalloxidschichten anzugeben, das
die genannten Probleme vermeidet oder deutlich vermindert.
Diese Aufgabe wird von dem Verfahren gemäß Patentanspruch 1
gelöst.
Weitere vorteilhafte Ausführungsformen, Ausgestaltungen und
Aspekte der vorliegenden Erfindung ergeben sich aus den Un
teransprüchen der Beschreibung und den beiliegenden Zeichnun
gen.
Erfindungsgemäß wird ein Verfahren zur Herstellung einer Me
talloxidschicht bereitgestellt. Dabei umfaßt das erfindungs
gemäße Verfahren folgende Schritte:
- a) eine Barriereschicht wird gebildet,
- b) auf die Barriereschicht wird eine Metallschicht aufge bracht, und
- c) die Metallschicht wird in einer Sauerstoffatmosphäre ther misch oxidiert, so daß eine Metalloxidschicht (3') erzeugt wird.
Das erfindungsgemäße Verfahren besitzt den Vorteil, daß zur
Erzeugung der eigentliche Metalloxidschicht keine CVD-
Verfahren eingesetzt werden müssen, wodurch sich störende
Verunreinigungen der Metalloxidschicht deutlich reduzieren
lassen. Weiterhin führt das erfindungsgemäße Verfahren zu ei
ner sehr homogenen Grenzflächen des Metalloxides. Die bisher
verwendeten CVD-Abscheidungen ergeben hingegen, wegen unkon
trollierter Kristallbildung zu Beginn der Abscheidung, an der
Substratoberfläche eine inhomogene, rauhe Grenzfläche. Dar
über hinaus läßt sich das erfindungsgemäße Verfahren leicht
in die bereits bestehenden Prozesse zur Herstellung von CMOS-
Transistoren und/oder Speicherkondensatoren integrieren und
ist daher sehr kostengünstig zu realisieren. Die thermische
Oxidation der Metallschicht führt zu einer sehr reinen und
stöchiometrischen Metalloxidschicht.
Darüber hinaus lassen sich derartige Metalloxidschicht nur
sehr schlecht strukturieren. Dies ist insbesondere deshalb
der Fall, weil sich diese Schichten im wesentlichen nur durch
eine physikalischen Ätzkomponente ätzen lassen, die dement
sprechend gegenüber anderen Schichten nur eine geringe bzw.
gar keine Selektivität aufweist. Daher wird in einer bevor
zugten Ausführungsform weiterhin erfindungsgemäß ein Verfah
ren zur Strukturierung der Metalloxidschicht bereitgestellt.
Dabei umfaßt das erfindungsgemäße Verfahren die zusätzlichen
Schritte:
- a) auf die Metalloxidschicht wird eine Maske aufgebracht, und
- b) die Metalloxidschicht wird entsprechend der Maske in einer oxidierenden Atmosphäre bei einer Temperatur größer als 130°C trocken geätzt, wobei die oxidierende Atmosphäre zu mindest eine Halogenverbindung, insbesondere CF4, auf weist.
Das erfindungsgemäße Verfahren besitzt den Vorteil, daß das
Metalloxid chemisch auch ohne physikalische Ätzkomponente
trocken geätzt werden. Dementsprechend weist das erfindungs
gemäße Verfahren eine hohe Selektivität gegenüber anderen Ma
terialien wie beispielsweise Silizium oder Siliziumoxid auf.
Bei dem erfindungsgemäßen Verfahren ist es insbesondere be
vorzugt, wenn als Barriereschicht Siliziumdioxid oder nitri
diertes Siliziumdioxid verwendet wird.
Weiterhin ist es bevorzugt, wenn als Metall Titan, Tantal
oder Aluminium verwendet wird. Ebenso ist es bevorzugt, wenn
das Metall durch Sputtern auf die Barriereschicht aufgebracht
wird.
Weiterhin ist es bevorzugt, wenn die Barriereschicht zwischen
1 und 3 nm dick bzw. die Metallschicht zwischen 5 und 15 nm
dick ist.
Bei dem erfindungsgemäßen Verfahren ist es insbesondere be
vorzugt, wenn die Barriereschicht bei der thermischen Oxida
tion der Metallschicht im wesentlichen entfernt wird.
Bei der Strukturierung der Metalloxidschicht ist es bevor
zugt, wenn die Maske eine Polysiliziummaske ist.
Weiterhin ist es bevorzugt, wenn die Ätztemperatur zwischen
200°C und 300°C, insbesondere etwa 250°C beträgt.
Darüber hinaus ist es bevorzugt, wenn der Anteil der Halogen
verbindung in der oxidierenden Atmosphäre zwischen 1 und 10%
beträgt.
Die Erfindung wird nachfolgend anhand von Figuren der Zeich
nung näher dargestellt. Die Fig. 1 bis 4 zeigen eine sche
matische Darstellung einer Ausführungsform der erfindungsge
mäßen Verfahren.
Fig. 1 zeigt einen Ausschnitt eines Siliziumwafers mit einem
Siliziumsubstrat 1. Der in Fig. 1 gezeigte Zustand eines Si
liziumwafers entspricht beispielsweise dem Zustand, den ein
Siliziumwafer in einem Standard-CMOS Prozeß annimmt, nachdem
die Wannen der CMOS-Transistoren und die Isolation (nicht ge
zeigt) der einzelnen Transistoren bereits erzeugt worden ist.
Auf die Oberfläche des Siliziumsubstrats 1 wird nun eine etwa
2 nm dicke Siliziumdioxidschicht 2 als Barriereschicht aufge
bracht. Diese Oxidschicht 2 kann beispielsweise durch eine
thermische Oxidation erzeugt werden. Wird die thermische Oxi
dation in einer Atmosphäre durchgeführt, die zusätzlich NO-
bzw. N2O-Moleküle
enthält, so läßt sich eine nitridierte Siliziumdioxidschicht
2 herstellen.
Wie bereits in der Einleitung erwähnt ist es schwierig, die
Dicke einer solch dünnen Oxidschicht genau zu kontrollieren.
Da diese Oxidschicht jedoch nur eine Vorstufe zur Erzeugung
des eigentlichen Gatedielektrikums ist, können Schwankungen
in der Schichtdicke der Oxidschicht 2 hingenommen werden, oh
ne daß dies negative Auswirkungen auf die Funktion des noch
zu erzeugenden Transistors hat.
Auf die Oxidschicht 2 wird nachfolgend eine Titanschicht oder
Tantalschicht 3 als Metallschicht aufgebracht. Diese Titan
schicht oder Tantalschicht 3 wird durch eine Sputterprozeß
erzeugt. Die Schichtdicke der Titanschicht oder Tantalschicht
3 beträgt etwa 6 nm. Die sich daraus ergebende Situation ist
in Fig. 2 gezeigt.
Anschließend wird die Titanschicht oder Tantalschicht 3 durch
eine thermische Oxidation in eine Metalloxidschicht 3' umge
wandelt. Die Umwandlung findet einer Sauerstoffatmosphäre bei
etwa 600°C statt. Die thermische Oxidation der Metallschicht
führt zu einer sehr reinen und stöchiometrischen Metalloxid
schicht, die kaum Verunreinigungen aufweist. Außerdem werden
bei der thermischen Oxidation Sauerstoffatome aus der Silizi
umdioxidschicht 2 in die Metallschicht 3 gezogen, so daß die
Siliziumdioxidschicht 2 bei der thermischen Oxidation der Me
tallschicht nahezu vollständig entfernt wird. Auf diese Weise
entsteht eine sehr saubere Grenzfläche zwischen dem Silizium
substrat 1 und der Metalloxidschicht 3', was positiv auf die
Eigenschaften des späteren Feldeffekttransistors auswirkt.
Durch eine nachfolgende Temperung bei etwa 900°C läßt sich
eine Titanoxidschicht 3' in der sogenannten Rutil-Phase er
zeugen. Diese Temperung kann bereits bei der Erzeugung der
Titanoxidschicht erfolgen. Sie kann aber erst in einem späte
ren Prozeßschritt in der Herstellung einer integrierten
Schaltung durchgeführt werden.
Es folgt die Erzeugung einer Polysiliziumschicht 4 auf der
Metalloxidschicht 3'. Die sich daraus ergebende Situation ist
in Fig. 3 gezeigt. Je nach verwendetem Prozeß können auf die
Polysiliziumschicht 4 noch weitere Schichten beispielsweise
eine TEOS-Oxidschicht (nicht gezeigt) abgeschieden werden.
Es folgt eine Phototechnik, bei der die Polysiliziumschicht 4
strukturiert wird, so daß die Gatebahnen 5 erzeugt werden.
Die Gatebahnen 5 bilden wiederum eine Maske zur nachfolgenden
Ätzung der Metalloxidschicht 3'. Als Ätzgas wird eine Mi
schung aus CF4 und O2 verwendet. Die Temperatur der Ätzung
beträgt etwa 250°C. Dabei wird das Ätzgas durch eine HF-
Einkopplung oder eine Mikrowellenanregung zur Bildung eines
Plasmas angeregt. Das Verhältnis von CF4 zu O2 beträgt etwa
2% zu 98%.
Für die Ätzung selbst ist das frei werdende Fluor und die da
mit verbunden Reaktion des Metalloxids mit dem Fluor verant
wortlich. Es bilden sich flüchtige Metall-Fluor-Verbindungen.
Der Sauerstoff übernimmt die Aufgabe als Passivator für das
(Poly) Silizium. Durch Sauerstoff bildet sich SiO2 dessen
Bindungsenergie (ohne den Einsatz von zusätzlicher Ionener
gie) zu hoch ist um durch den geringen Fluoranteil signifi
kant geätzt zu werden. Die Ätzung der Metalloxidschicht er
folgt daher sehr selektiv zu (Poly)Silizium bzw. zu Siliziu
moxid. Die daraus ergebende Situation ist in Fig. 4 gezeigt.
Der Prozeß zur Herstellung des Transistors kann dann gemäß
einem Standard-CMOS Verfahren fortgesetzt werden, um den
vollständigen Transistor zu erzeugen. Diese Schritte sind an
sich bekannt, so daß auf sie nicht weiter eingegangen werden
muß.
Claims (11)
1. Verfahren zur Herstellung einer Metalloxidschicht mit den
Schritten:
- a) eine Barriereschicht (2) wird gebildet.
- b) auf die Barriereschicht (2) wird eine Metallschicht (3) aufgebracht, und
- c) die Metallschicht (3) wird in einer Sauerstoffatmosphäre thermisch oxidiert, so daß eine Metalloxidschicht (3') er zeugt wird.
2. Verfahren nach Anspruch 1,
dadurch gekennzeichnet, daß
als Barriereschicht (2) Siliziumdioxid oder nitridiertes Si
liziumdioxid verwendet wird.
3. Verfahren nach einem der Ansprüche 1 oder 2,
dadurch gekennzeichnet, daß
als Metall Titan, Tantal oder Aluminium verwendet wird.
4. Verfahren nach einem der Ansprüche 1 bis 3,
dadurch gekennzeichnet, daß
das Metall durch Sputtern auf die Barriereschicht (2) aufge
bracht wird.
5. Verfahren nach einem der Ansprüche 1 bis 4,
dadurch gekennzeichnet, daß
die Barriereschicht (2) zwischen 1 und 3 nm dick gebildet wird.
6. Verfahren nach einem der Ansprüche 1 bis 5,
dadurch gekennzeichnet, daß
die Metallschicht zwischen 5 und 15 nm dick aufgebracht wird.
7. Verfahren nach einem der Ansprüche 1 bis 6,
dadurch gekennzeichnet, daß
die Barriereschicht bei der thermischen Oxidation der Metall
schicht entfernt wird.
8. Verfahren nach einem der Ansprüche 1 bis 7,
dadurch gekennzeichnet, daß
- a) auf die Metalloxidschicht (3') eine Maske (5) aufgebracht wird, und
- b) die Metalloxidschicht (3') entsprechend der Maske (5) in einer oxidierenden Atmosphäre bei einer Temperatur größer als 130°C trocken geätzt wird, wobei die oxidierende Atmo sphäre zumindest eine Halogenverbindung, insbesondere CF4, aufweist.
9. Verfahren nach Anspruch 8,
dadurch gekennzeichnet, daß
die Maske (5) eine Polysiliziummaske verwendet wird.
10. Verfahren nach einem der Ansprüche 8 oder 9,
dadurch gekennzeichnet, daß
die Ätztemperatur zwischen 200°C und 300°C, insbesondere etwa
250°C gewählt wird.
11. Verfahren nach einem der Ansprüche 8 bis 10,
dadurch gekennzeichnet, daß
der Anteil der Halogenverbindung in der oxidierenden Atmo
sphäre zwischen 1 und 10% gewählt wird.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE1998156084 DE19856084C2 (de) | 1998-12-04 | 1998-12-04 | Verfahren zur Herstellung einer Metalloxidschicht bzw. einer strukturierten Metalloxidschicht |
TW88120909A TW495554B (en) | 1998-12-04 | 1999-11-30 | Method to manufacture a layer of metal oxide or a structured layer of metal oxide |
PCT/DE1999/003878 WO2000034991A2 (de) | 1998-12-04 | 1999-12-03 | Verfahren zur herstellung einer metalloxidschicht bzw. einer strukturierten metalloxidschicht |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE1998156084 DE19856084C2 (de) | 1998-12-04 | 1998-12-04 | Verfahren zur Herstellung einer Metalloxidschicht bzw. einer strukturierten Metalloxidschicht |
Publications (2)
Publication Number | Publication Date |
---|---|
DE19856084A1 DE19856084A1 (de) | 2000-06-08 |
DE19856084C2 true DE19856084C2 (de) | 2002-07-11 |
Family
ID=7890039
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE1998156084 Expired - Fee Related DE19856084C2 (de) | 1998-12-04 | 1998-12-04 | Verfahren zur Herstellung einer Metalloxidschicht bzw. einer strukturierten Metalloxidschicht |
Country Status (3)
Country | Link |
---|---|
DE (1) | DE19856084C2 (de) |
TW (1) | TW495554B (de) |
WO (1) | WO2000034991A2 (de) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4495219A (en) * | 1981-10-09 | 1985-01-22 | Fujitsu Limited | Process for producing dielectric layers for semiconductor devices |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4574177A (en) * | 1982-02-01 | 1986-03-04 | Texas Instruments Incorporated | Plasma etch method for TiO2 |
JP3160336B2 (ja) * | 1991-12-18 | 2001-04-25 | 株式会社東芝 | 半導体装置の製造方法 |
JP3339730B2 (ja) * | 1992-12-24 | 2002-10-28 | 忠弘 大見 | 半導体装置 |
-
1998
- 1998-12-04 DE DE1998156084 patent/DE19856084C2/de not_active Expired - Fee Related
-
1999
- 1999-11-30 TW TW88120909A patent/TW495554B/zh active
- 1999-12-03 WO PCT/DE1999/003878 patent/WO2000034991A2/de active Application Filing
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
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US4495219A (en) * | 1981-10-09 | 1985-01-22 | Fujitsu Limited | Process for producing dielectric layers for semiconductor devices |
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Title |
---|
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Also Published As
Publication number | Publication date |
---|---|
TW495554B (en) | 2002-07-21 |
WO2000034991A2 (de) | 2000-06-15 |
WO2000034991A3 (de) | 2000-11-16 |
DE19856084A1 (de) | 2000-06-08 |
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