DE19826971A1 - Verfahren zum mechanischen und elektrischen Verbinden, insbesondere integrierter Schaltungen - Google Patents

Verfahren zum mechanischen und elektrischen Verbinden, insbesondere integrierter Schaltungen

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Abstract

Die Erfindung betrifft ein Verfahren zum mechanischen und elektrischen Verbinden insbesondere integrierter Schaltungen (ICs) miteinander oder integrierter Schaltungen und aktiver, passiver elektronischer sowie mechanischer Einzelkomponenten zur Herstellung eines ein komplexes elektronisches, elektrooptisches, elektroakustisches oder elektromechanisches System enthaltenden Moduls durch schichtweise Verfestigung eines flüssigen, lichtaushärtbaren Kunststoffs, wobei während des schichtweisen Aufbaus des Moduls Ausnehmungen zur Aufnahme der Systembauteile sowie Verbindungskanäle zur Aufnahme der elektrisch leitenden Verbindungen zwischen den eingebetteten Systembauteilen generiert werden.

Description

Die vorliegende Erfindung betrifft ein Verfahren zum mechani­ schen und elektrischen Verbinden, insbesondere integrierter Schaltungen (ICS) miteinander oder integrierter Schaltungen und aktiver, passiver elektronischer sowie mechanischer Einzelkom­ ponenten zur Herstellung eines ein komplexes elektronisches, elektrooptisches, elektroakustisches oder elektromechanisches System enthaltenden Moduls.
Derartige komplexe Systeme werden in der Regel durch Auflöten entsprechender Bauelemente auf Platinen hergestellt, die dann anschließend in ein separat hergestelltes Gehäuse eingebaut werden.
Dadurch, daß zur Anordnung der Bauelemente auf der Platine le­ diglich zwei Dimensionen zur Verfügung stehen, ist der Platzbe­ darf derartiger Systeme groß, was darüber hinaus den Nachteil aufweist, daß die elektrischen Verbindungen zwischen den Bau­ elementen entsprechend lang sind.
Weiterhin sind die freiliegenden elektrischen Anschlüsse und Leitungen bei mechanischer Beanspruchung störungs- und defek­ tanfällig.
Der Erfindung liegt daher die Aufgabe zugrunde, ein Verfahren der eingangs genannten Art so zu führen, daß die das System bildenden Bauelemente neben- und übereinander sicher gegenüber äußeren Einflüssen in einem beim Zusammenstellen entstehenden Kunststoffgehäuse eingebettet werden.
Die Erfindung löst diese Aufgabe durch schichtweise Verfesti­ gung eines flüssigen, lichtaushärtbaren Kunststoff, wobei wäh­ rend des schichtweisen Aufbaus des Moduls Ausnehmungen zur Auf­ nahme der Systembauteile sowie Verbindungskanäle zur Aufnahme der elektrisch leitenden Verbindungen zwischen den eingebette­ ten Systembauteilen generiert werden.
Derartige Schichtaufbauverfahren sind aus der Mikrotechnologie bekannt. So beschreibt die DE-PS 44 20 996 ein Verfahren, bei dem zwischen zwei einander parallelen Platten, von denen minde­ stens eine für elektromagnetische Wellen durchlässig ist, eine geringe Menge des flüssigen lichtaushärtenden Kunststoffs auf­ grund der Oberflächenspannung gehalten ist. Die Oberfläche der Kunststoffflüssigkeit unterhalb der für elektromagnetische Wel­ len durchlässigen Platte wird beispielsweise mittels Laser­ strahl durch die durchlässige Platte bestrahlt, wobei der La­ serstrahl nach Maßgabe eines in einem angeschlossenen Rechner gespeicherten 3-D-Schicht-Modells der zu generierenden Struktur über die Oberfläche geführt wird. Schicht für Schicht härtet das Laserlicht die Kunststoffflüssigkeit entsprechend dem 3-D- Schicht-Modell, wobei der Abstand der Platten jeweils um eine Schichtdicke vergrößert wird, so daß frisches Kunststoffmate­ rial allein aufgrund seiner Oberflächenspannung in den entste­ henden Zwischenraum zwischen der ausgehärteten Schicht und der Platte nachfließen kann. Auf diese Weise können Strukturen im Mikrometer-Bereich sehr exakt erzeugt werden.
Diese Technologie macht sich die Erfindung zunutze.
Eine bevorzugte Verfahrensführung ist durch den Anspruch 2 ge­ geben.
Es wird zunächst durch schichtweises Verfestigen des flüssigen, lichtaushärtbaren Kunststoffs ein Basismodul mit einer Ausneh­ mung zur Aufnahme eines ICs erzeugt. Danach wird der IC in die Ausnehmung eingelegt und durch weiteren schichtweisen Aufbau des Basismoduls gemäß dem obengenannten Verfahren wird die Aus­ nehmung verschlossen und der IC eingebettet. Dabei werden gleichzeitig Kanäle von den Anschlußflächen (Bondflächen) des IC zur Oberfläche des Basismoduls generiert. Diese Bondflächen können beliebig auf dem Chip angeordnet sein und haben eine Größe von etwa 20 µm × 20 µm. Bei den bisherigen Technologien befinden sich die Bondflächen fast immer am Rand des Chips. Die Größe dieser Bondflächen ist minimal 70 µm × 70 µm. Ersichtlich führt die Verwendung kleinerer Bondflächen zu einer Reduktion der gesamten Chipfläche. Außerdem läßt sich die Leiterbahnlänge dadurch reduzieren, daß die Bondflächen in unmittelbarer Nähe der ihnen zugeordneten Schaltungsteile angeordnet werden kön­ nen. Dies führt zu reduzierter kapazitiver Belastung der Schal­ tungen und zu verringertem Übersprechen.
In der weiteren Verfahrensführung wird nun die oberste Fläche des bisher generierten Basismoduls mit einem elektrisch leiten­ den Material beschichtet, beispielsweise gemäß Anspruch 4 durch Aufdampfen, wobei ebenfalls die Wandungen der zu den Bondflä­ chen führenden Kanäle beschichtet werden, so daß eine elek­ trisch leitende Verbindung zu den Bondflächen hergestellt wird.
Auf der leitenden Schicht werden sodann von den Kanalmündungen führende Leiterbahnmasken ebenfalls durch schichtweises Verfe­ stigen des flüssigen, lichtaushärtbaren Kunststoffs erzeugt, wonach durch Ätzen die Leiterbahnmasken vollständig und das sie umgebende leitende Material zumindest teilweise entfernt wer­ den. Das leitende Material in der Umgebung der Leiterbahnmasken kann vollständig entfernt werden, es ist jedoch auch denkbar, aus Gründen der Abschirmung einzelner Bauelemente Teilflächen der leitenden Schicht stehen zu lassen. Die Entfernung der Lei­ terbahnmasken und der leitenden Schicht geschieht vorteilhaf­ terweise gemäß Anspruch 3 durch Plasmaätzen.
Im weiteren Verlauf des Verfahrens wird das bisher vorhandene Basismodul weiter schichtweise aufgebaut, wobei wieder minde­ stens eine Ausnehmung für die Aufnahme einer oder mehrerer Kom­ ponenten geschaffen werden, und gleichzeitig die erforderlichen Bondkanäle generiert werden.
Nach Einlegen der entsprechenden Komponenten in die Ausnehmung bzw. Ausnehmungen wird das Modul weiter schichtweise aufgebaut, wodurch die Ausnehmungen verschlossen und die Komponenten ein­ gebettet werden. Hierbei werden wiederum entsprechende Bondkanäle generiert, die entweder die Verbindung zu einer ex­ ternen Stromversorgung bilden oder aber die Verbindung zu wei­ teren Bauteilen beim weiteren schichtweisen Aufbau des Moduls.
Die einzelnen Verfahrensschritte können dabei gemäß Anspruch 6 so oft wiederholt werden, bis alle für das Modul notwendigen Bauelemente und deren elektrische Verbindungen nebeneinander sowie in mehreren Ebenen übereinander in der Kunststoffstruktur eingebettet sind.
Auf diese Weise ist es möglich, auf geringstem Raum komplette Systeme der eingangs genannten Art sicher zu verpacken, wobei dem Modul eine äußere Form gegeben werden kann, die der jewei­ ligen Anwendung angepaßt ist.
Beispielsweise kann mit dem erfindungsgemäßen Verfahren ein im Ohr zu tragendes Hörgerät hergestellt werden, dessen äußere Form dem Gehörgang angepaßt ist.
Eine weitere Möglichkeit besteht in dem Aufbau kleinstbauender Rechner.
Das erfindungsgemäße Verfahren ist naturgemäß nicht auf die beiden Anwendungsfälle beschränkt.
Das erfindungsgemäße Verfahren kann als Bindeglied zwischen den (Sub)µm-Strukturen in der IC-Technologie und den Strukturgrößen der Metallisierung der Leiterplatten (einige 10 µm) angesehen werden, wobei ganz auf Leiterplatten und übliche Gehäuse ver­ zichtet werden kann.
Die Erfindung wird im folgenden anhand von 10 Abbildungen, die die einzelnen Verfahrensschritte darstellen, erläutert.
Abb. 1 zeigt ein Basismodul 1 mit einer darin generierten Ausnehmung 2. In die Ausnehmung 2 wird - wie in Abb. 2 dargestellt - ein IC 3 eingelegt, der auf seiner Oberfläche mehrere Anschlußflächen (Bondflächen) 4 aufweist.
Abb. 3 zeigt den Verfahrensstand, wenn durch weiteren schichtweisen Aufbau des Basismoduls 1 die Ausnehmung 2 ver­ schlossen ist und der IC 3 eingebettet wurde. Beim schichtwei­ sen Aufbau des Basismoduls 1 werden von den Bondflächen 4 aus­ gehend sogenannte Bondkanäle 5 erzeugt.
Abb. 4 zeigt den Verfahrensschritt, bei dem auf die ober­ ste Fläche des Basismoduls 1 eine Aluminiumschicht 6 aufge­ dampft worden ist.
Abb. 5 zeigt den Verfahrensstand, bei dem auf der leiten­ den Schicht 6 durch weiteren schichtweisen Aufbau von den Mün­ dungen der Bondkanäle 5 ausgehende Leiterbahnmasken 7 generiert worden sind. Bei der Struktur gemäß Abb. 6 sind durch Plasmaätzen sowohl die Leiterbahnmasken 7 als auch die sie um­ gebende Aluminiumschicht 6 entfernt worden. Übrig bleiben die Leiterbahnen 8.
Durch weiteren schichtweisen Aufbau entsteht die in Abb. 7 dargestellte Struktur, in der wiederum - wie in Abb. 1 - Ausnehmungen 2 sowie von den Leiterbahnen 8 aufsteigende Bondkanäle 5 erzeugt worden sind.
Nach Einlegen der entsprechenden Bauelemente 3 in die Ausnehmungen 2 (Abb. 8) wird nun gemäß Abb. 9 das Ba­ sismodul 1 weiter schichtweise aufgebaut, wobei ebenfalls wie­ derum entsprechende Bondkanäle generiert werden.
Die so entstandene Oberfläche wird wiederum mit Aluminium be­ dampft, wobei wie beim Verfahrensschritt gemäß Abb. 4 auch die Wandungen der Bondkanäle mit der leitenden Schicht bedampft werden, so daß sich die elektrischen Verbindungen zwischen den Bauteilen ergeben.
Dann wird das erfindungsgemäße Verfahren analog den in den Abb. 5 und 6 dargestellten Verfahrensschritten fortge­ führt, und zwar so weit, bis das gewünschte Modul mit dem kom­ plexen System vollendet ist.

Claims (6)

1. Verfahren zum mechanischen und elektrischen Verbinden, insbesondere integrierter Schaltungen (ICs) miteinander oder integrierter Schaltungen und aktiver, passiver elek­ tronischer sowie mechanischer Einzelkomponenten zur Her­ stellung eines ein komplexes elektronisches, elektroopti­ sches, elektroakustisches oder elektromechanisches System enthaltenden Moduls durch schichtweise Verfestigung eines flüssigen, lichtaushärtbaren Kunststoffs, wobei während des schichtweisen Aufbaus des Moduls Ausnehmungen (2) zur Aufnahme der Systembauteile (3) sowie Verbindungskanäle (5) zur Aufnahme der elektrisch leitenden Verbindungen (5, 8) zwischen den eingebetteten Systembauteilen (3) gene­ riert werden.
2. Verfahren nach Anspruch 1, gekennzeichnet durch folgende Verfahrensschritte:
  • 1. durch schichtweises Verfestigen eines flüssigen, lichtaushärtbaren Kunststoffs wird ein Basismodul (1) mit einer Ausnehmung (2) zur Aufnahme eines ICs (3) erzeugt,
  • 2. der IC (3) wird in die Ausnehmung (2) eingelegt,
  • 3. durch weiteren schichtweisen Aufbau des Basismoduls (1) analog Schritt 1) wird die Ausnehmung (2) ver­ schlossen und der IC (3) eingebettet,
  • 4. hierbei werden Kanäle (5) von den Anschlußflächen (Bondflächen) (4) des ICs (3) zur Oberfläche des Ba­ sismoduls (1) generiert,
  • 5. die Oberfläche des Basismoduls (1) wird mit einem elektrisch leitenden Material (6) beschichtet, wobei ebenfalls die Wandungen der zu den Bondflächen (4) führenden Kanäle (5) beschichtet werden, so daß eine elektrisch leitende Verbindung zu den Bondflächen (4) hergestellt wird,
  • 6. auf der leitenden Schicht (6) werden von den Kanalmündungen führende Leiterbahnmasken (7) analog Schritt 1) generiert,
  • 7. durch Ätzen werden die Leiterbahnmasken (7) vollstän­ dig und das sie umgebende leitende Material zumindest teilweise entfernt,
  • 8. durch weiteren Aufbau des Basismoduls (1) analog Schritt 1) wird mindestens eine weitere Ausnehmung (2) für die Aufnahme einer oder mehrerer Komponenten (3) geschaffen, wobei gleichzeitig die erforderlichen Bondkanäle (5) generiert werden,
  • 9. die Komponenten (3) werden in die Ausnehmungen (2) eingelegt,
  • 10. durch weiteren schichtweisen Aufbau analog Schritt 1) werden die Ausnehmungen (2) verschlossen und die Komponenten (3) eingebettet, und es wird mit den Verfahrensschritten 4) bis 7) fortgefahren.
3. Verfahren nach Anspruch 2, dadurch gekennzeichnet, daß die Entfernung der Leiterbahnmasken (7) und des sie umgebenden leitenden Materials (6) durch Plasmaätzen er­ folgt.
4. Verfahren nach einem der Ansprüche 2 oder 3, dadurch gekennzeichnet, daß das elektrisch leitende Material aufgedampft wird.
5. Verfahren nach einem der Ansprüche 2 bis 4, dadurch gekennzeichnet, daß zum Beschichten als elektrisch leitendes Material Alu­ minium verwendet wird.
6. Verfahren nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, daß Systemkomponenten (3) in mehr als zwei Ebenen überein­ ander im Modul eingebettet und elektrisch miteinander ver­ bunden werden.
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