DE112017004978T5 - Zwischenverbindungsstruktur für ein mikroelektronisches bauelement - Google Patents
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- 238000004377 microelectronic Methods 0.000 title claims abstract description 38
- 239000004065 semiconductor Substances 0.000 claims abstract description 179
- 239000010949 copper Substances 0.000 claims description 36
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 29
- 229910052802 copper Inorganic materials 0.000 claims description 29
- 238000000034 method Methods 0.000 claims description 27
- 230000008878 coupling Effects 0.000 claims description 17
- 238000010168 coupling process Methods 0.000 claims description 17
- 238000005859 coupling reaction Methods 0.000 claims description 17
- 238000003860 storage Methods 0.000 claims description 5
- 239000000463 material Substances 0.000 description 17
- 229910052751 metal Inorganic materials 0.000 description 12
- 239000002184 metal Substances 0.000 description 12
- 230000008569 process Effects 0.000 description 11
- 230000007246 mechanism Effects 0.000 description 9
- 238000005538 encapsulation Methods 0.000 description 8
- 238000004891 communication Methods 0.000 description 6
- 239000010936 titanium Substances 0.000 description 6
- 239000004020 conductor Substances 0.000 description 4
- 238000002161 passivation Methods 0.000 description 4
- 238000007747 plating Methods 0.000 description 4
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 3
- QCEUXSAXTBNJGO-UHFFFAOYSA-N [Ag].[Sn] Chemical compound [Ag].[Sn] QCEUXSAXTBNJGO-UHFFFAOYSA-N 0.000 description 3
- 230000008901 benefit Effects 0.000 description 3
- 238000000465 moulding Methods 0.000 description 3
- 238000001356 surgical procedure Methods 0.000 description 3
- 229910052719 titanium Inorganic materials 0.000 description 3
- MAKDTFFYCIMFQP-UHFFFAOYSA-N titanium tungsten Chemical compound [Ti].[W] MAKDTFFYCIMFQP-UHFFFAOYSA-N 0.000 description 3
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 150000001875 compounds Chemical class 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 210000001654 germ layer Anatomy 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 238000000926 separation method Methods 0.000 description 2
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 1
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical group O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 description 1
- 239000004952 Polyamide Substances 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 229910021529 ammonia Inorganic materials 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 230000000052 comparative effect Effects 0.000 description 1
- 238000013500 data storage Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000009713 electroplating Methods 0.000 description 1
- 239000008393 encapsulating agent Substances 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 238000005429 filling process Methods 0.000 description 1
- 238000009472 formulation Methods 0.000 description 1
- 239000004973 liquid crystal related substance Substances 0.000 description 1
- 229910017604 nitric acid Inorganic materials 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 229920002647 polyamide Polymers 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
- 230000000007 visual effect Effects 0.000 description 1
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- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3121—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
- H01L23/3128—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation the substrate having spherical bumps for external connection
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- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/17—Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
- H01L2224/1701—Structure
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- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
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Abstract
Ein mikroelektronisches Gehäuse mit zwei Halbleiter-Dies, die auf gegenüberliegenden Seiten einer Redistributionsschicht 108 gekoppelt sind und miteinander zumindest teilweise überlappen. Zumindest ein erster der Halbleiter-Dies umfasst zwei Sätzen von Kontakten, wobei die erste Gruppe von Kontakten in einem geringeren Abstand relativ zueinander angeordnet ist als dies eine zweite Gruppe von Kontakten ist. Die erste Gruppe von Kontakten in dem größeren Abstand sind platziert, um Kontakte in einer Redistributionsschicht 108 in Eingriff zu bringen. Die zweite Gruppe von Kontakten in dem geringeren Abstand sind platziert, um jeweilige Kontakte in dem gleichen Abstand auf dem zweiten Halbleiter-Die in Eingriff zu bringen.
Description
- Prioritätsanmeldungen
- Diese Anmeldung beansprucht den Nutzen der Priorität der US-Patentanmeldung, Aktenzeichen 15/282,855, die am 30. September 2016 eingereicht wurde und deren Inhalt hierin durch Bezugnahme in seiner Gesamtheit aufgenommen ist.
- Technisches Gebiet
- Hierin beschriebene Ausführungsbeispiele beziehen sich im Allgemeinen auf Verfahren und Vorrichtungen zum Bereitstellen von Zwischenverbindungen bei mikroelektronischen Bauelementen; und beziehen sich insbesondere auf Verfahren und Vorrichtungen zum Zwischenverbinden von zumindest zwei Halbleiter-Dies miteinander durch Verwendung von Kontakten, die in einer dichteren Beabstandung zueinander platziert sind als Kontakte, die für andere Zwischenverbindungen von zumindest einem der Halbleiter-Dies verwendet werden.
- Hintergrund
- Viele Formen von mikroelektronischen Bauelementen, z. B. IC- (integrierte Schaltung; integrated circuit) Gehäusen, umfassen einen oder mehrere Halbleiter-Dies, die mit einer Redistributionsstruktur gekoppelt sind, die angepasst ist, um Zwischenverbindungen mit anderen Bauelementen (zum Beispiel einer gedruckten Schaltungsplatine (PCB; Printed Circuit Board) wie einer Hauptplatine, oder einer anderen modularen Anordnung) zu ermöglichen. Zum Beispiel kann eine solche Redistributionsstruktur (hierin eine „Redistributionsschicht“ genannt) mit den Kontakten auf einem Halbleiter-Die verbunden sein und elektrische Leiterbahnen bereitstellen, um die elektrischen Pfade von den Die-Kontakten zu anderen Stellen neu zu verteilen (to redistribute). Im Fall von „Fan-Out“- (Ausfächer-) Gehäusen umfasst die Redistributionsschicht elektrische Leiterbahnen, die angeordnet sind, um zumindest einen wesentlichen Abschnitt, oder alle, der Kontakten auf dem Die auf Kontaktstellen außerhalb der lateralen Abmessungen des Halbleiter-Dies selbst (der „Fußabdruck“ des Dies) neu zu verteilen. In vielen Fällen ist die laterale Beabstandung zwischen Kontakten, bekannt als der „Abstand“ („Pitch“) der Kontakte, der erforderlich ist zur Schnittstellenbildung mit einer solchen Redistributionsschicht, viel größer als durch Halbleiterherstellungstechnologie für den Die selbst erreicht werden kann. Es wäre wünschenswert, den erforderlichen Abstand einer Gruppe von Kontakten eines Halbleiter-Dies zu minimieren und eine direkte Verbindung durch solche Kontakte mit einem anderen Halbleiter-Die anstatt mit einer Redistributionsschicht zu ermöglichen.
- Figurenliste
-
-
1A-B stellen in1A einen Querschnitt eines beispielhaften IC-Gehäuses dar, der die hierin beschriebenen Techniken einbezieht; und in1B das beispielhafte IC-Gehäuse von1A , das zusätzliche optionale Strukturen umfasst. -
2A-H stellen aufeinanderfolgende Stufen eines beispielhaften Prozessablaufs zum Bilden eines IC-Gehäuses, z. B. dem von1A , dar. -
3 stellt eine Verarbeitungsstufe eines Halbleiter-Dies dar, um ein anderes Ausführungsbeispiel zu ergeben, das geeignet ist zur Verwendung in einem IC-Gehäuse, z. B. dem von1A . -
4 stellt ein Flussdiagramm eines beispielhaften Prozessablaufs zum Bilden eines IC-Gehäuses, z. B. dem von1A , dar. -
5 stellt ein Systemebenendiagramm dar, das ein mikroelektronisches Bauelement, z. B. das IC-Gehäuse von1A , umfassen kann. - Beschreibung von Ausführungsbeispielen
- Die folgende Beschreibung und die Zeichnungen stellen spezifische Ausführungsbeispiele ausreichend dar, um dem Fachmann deren Ausführung zu ermöglichen. Andere Ausführungsbeispiele können strukturelle, logische, elektrische Prozesse und andere Änderungen umfassen. Abschnitte und Merkmale einiger Ausführungsbeispiele können in jenen von anderen Ausführungsbeispielen umfasst sein oder durch jene von anderen Ausführungsbeispielen ersetzt werden. Die in den Ansprüchen dargelegten Ausführungsbeispielen umfassen alle verfügbaren Entsprechungen dieser Ansprüche.
- Wie vorangehend erwähnt wurde erfordern viele Herstellungsprozesse, dass ein Halbleiter-Die mit einem Kontaktabstand hergestellt wird, der geeignet ist zum Ineingriffbringen mit einer Redistributionsschicht, bei der der Kontaktabstand größer ist als ein Kontaktabstand, dessen Herstellung auf dem Halbleiter-Die technisch machbar wäre. Dies kann dazu führen, dass die Größe eines Halbleiter-Dies teilweise durch den Bereich diktiert wird, der benötigt wird, um die notwendigen externen Kontakte in einem Abstand bereitzustellen, der für ein Ineingriffbringen mit einer Redistributionsschicht geeignet ist. Nach hiesiger Verwendung wird der Begriff „Redistributionsschicht“ im Einklang mit seiner gängigen Terminologie in der Industrie verwendet, um zusammen auf die mehreren Materialebenen (z. B. zwei Dielektrikumsschichten auf gegenüberliegenden Seiten eines Metalls oder einer anderen leitfähigen Materialschicht) Bezug zu nehmen, die zusammen Kontakte und leitfähige Leiterbahnen bilden, die die Kontakte des Halbleiter-Dies auf (gemeinhin) lateral versetzte Stellen neu verteilen. Der Begriff betrachtet Redistributionsstrukturen, die entweder eine einzelne Ebene eines Metalls oder anderen Leiters oder mehrere Ebenen eines Metalls oder anderer Leiter umfassen, die voneinander vertikal versetzt sind, und in vielen Fällen durch Zwischenverbindungen in der Redistributionsschicht selektiv miteinander kommunizieren.
- In einigen Fällen erfordern allerdings nicht alle Kontakte eines Halbleiter-Dies eine solche Redistribution durch eine Redistributionsschicht, und erfordern somit nicht den Kontaktabstand, wie er durch die Anforderungen des Ineingriffbringens einer Redistributionsschicht diktiert sein kann. Ein Beispiel eines solchen mikroelektronischen Bauelements ist eines, bei dem ein erster Halbleiter-Die mit einem zweiten Halbleiter-Die direkt kommuniziert. Viele Beispiele solcher mikroelektronischer Bauelemente kann man sich vorstellen, aber als ein Beispiel kann ein Halbleiter-Die, z. B. der für einen Prozessor, mit einem anderen Die, z. B. einem Speicher, einem Graphikprozessor, einem drahtlosen Schnittstellenbauelement und einem oder mehreren von vielen anderen Die-Typen, direkt kommunizieren. Wie hierin identifiziert, kann ein Gehäuse, das eine direkte Kommunikation zwischen dem ersten und zweiten Die erleichtert, auch ausgebildet sein zum Ermöglichen der direkten Kommunikation zwischen den zwei Dies durch eine jeweilige Gruppe von Kontakten auf jedem Die, die in einem feineren Abstand sind als Kontakte (von einem der Dies), die eine Redistributionsschicht in Eingriff bringen.
- Bezug nehmend auf
1A stellt diese Figur einen vertikalen Querschnitt eines beispielhaften IC-Gehäuses dar, das im Allgemeinen mit 100 angezeigt ist, und das die hierin beschriebenen Techniken umfasst. Das Gehäuse100 umfasst einen ersten Halbleiter-Die102 und einen zweiten Halbleiter-Die104 , der mit dem ersten Halbleiter-Die102 direkt gekoppelt ist (wie nachfolgend ausführlicher beschrieben wird). Bei dem beispielhaften Gehäuse100 ist der erste Halbleiter-Die102 innerhalb einer Formstruktur106 umhüllt, die zusammen mit dem ersten Halbleiter-Die102 eine Redistributionsschicht108 stützt, wobei sich der erste Halbleiter-Die102 auf einer ersten Seite der Redistributionsschicht108 befindet. Wie in der Figur zu sehen ist, ist der zweite Halbleiter-Die104 auf der gegenüberliegenden Seite der Redistributionsschicht108 , was im Stand der Technik manchmal als eine „Hängende-Die“- („hanging die“-) Konfiguration bezeichnet wird. Obwohl bei dem gezeigten beispielhaften Gehäuse100 nur ein einzelner hängender Die dargestellt ist, können mehrere hängende Dies mit dem ersten Halbleiter-Die auf dieselbe Weise gekoppelt sein, wie hierin für den zweiten Halbleiter-Die104 beschrieben ist. Das Gehäuse100 dient nur der Veranschaulichung, und kann irgendeine erwünschte Struktur aufweisen, gemäß der hierin bereitgestellten Beschreibung. Zum Beispiel erstrecken sich viele Gehäuse lateral in einer erheblich größeren Abmessung und stellen mehrere Reihen von Kontaktkugeln114 bereit, sich um das Gehäuse erstrecken. - Bei dem dargestellten beispielhaften Gehäuse
100 ist die Redistributionsschicht108 in der Form einer „Fan-Out-“Schicht, bei der eine erste Gruppe von Kontakten, im Allgemeinen mit110 (siehe eingeklammerter Bereich) angezeigt, auf dem ersten Halbleiter-Die102 durch leitfähige Leiterbahnen112 in der Redistributionsschicht108 neu verteilt sind auf Stellen über die lateralen Abmessungen des ersten Halbleiter-Dies102 hinaus, wie durch die Kontaktkugeln114 (auch bekannt als „Lötkugeln“, ohne ein bestimmtes Material für die Kugeln zu implizieren) angezeigt. Bei dem dargestellten Beispiel sind die Kontaktkugeln114 auf derselben Seite der Redistributionsschicht108 wie der zweite Halbleiter-Die104 . - Wie von dem dargestellten Paar von Kontakten innerhalb der ersten Gruppe
110 ersichtlich ist, sind die benachbarten Kontakte durch eine angegebene Distanz, oder „Abstand“ (Pitch), wie mit116 angezeigt, getrennt. Wie hierin bereits ausgeführt wird, der Abstand116 für diese erste Gruppe von Kontakten110 , die mit der Redistributionsschicht108 gekoppelt werden, typischerweise zumindest teilweise ansprechend auf die minimale Linienbreite und Kontaktbeabstandung für die Redistributionsschicht108 bestimmt. Wie für den Fachmann offensichtlich ist, umfasst bei einigen Beispielen die erste Gruppe von Kontakten110 , die in dem vorliegenden Querschnitt dargestellt ist, mehrere Kontakte, die in einer ausgewählten Struktur (Array) angeordnet sind, die sich in X-Y-Richtungen über einen Abschnitt der Kontaktoberfläche des Halbleiter-Dies102 erstreckt. Bei einigen Beispielen ist, oder umfasst, die Struktur ein rechteckiges Array von Kontakten, die alle in dem ersten Abstand relativ zueinander angeordnet sind. Somit kann die dargestellte erste Gruppe von Kontakten110 , die in einer Reihe in der Ebene des Querschnitts dargestellt ist (z. B. in der X-Richtung entlang des Halbleiter-Dies102 ), bei vielen Beispielen eine zusätzliche Reihe von Kontakten über die Ebene der Seite hinaus und eine zusätzliche Reihe von Kontakten über der Ebene der Seite (dabei sind sie in der Y-Richtung angeordnet, die sich perpendikulär zu der Ebene des Querschnitts erstreckt) entlang des Halbleiter-Dies102 umfassen, die alle in dem ersten Abstand relativ zu anderen Kontakten der ersten Gruppe angeordnet sind. - Der erste Halbleiter-Die
102 umfasst auch eine zweite Gruppe von Kontakten, im Allgemeinen angezeigt mit118 , die ausgebildet ist zum Ineingriffbringen des zweiten Halbleiter-Dies104 . Wie aus der Figur zu sehen ist, befinden sich Kontakte der zweiten Gruppe von Kontakten118 in einem zweiten Abstand120 . Der zweite Abstand120 ist geringer als der erste Abstand116 (und somit ein „feinerer“ Abstand als der erste Abstand116 ). Bei einigen Beispielen ist der zweite Abstand120 nicht mehr als ungefähr 70 % der Abmessung des ersten Abstands116 ; während bei anderen Beispielen der zweite Abstand120 nicht mehr als ungefähr 50 % der Abmessung des ersten Abstands116 ist. Solche Vergleichsabmessungen sind allerdings nicht zwingend erforderlich, da Vorteile erzielt werden können, selbst wenn der zweite Abstand größer, sogar wesentlich größer, ist als ungefähr 70 % der Abmessung des ersten Abstands116 . - Bei einigen Beispielen, wie dargestellt, umfassen Kontakte der zweiten Gruppe
118 metallische Säulen, die sich von dem ersten Halbleiter-Die102 zumindest teilweise durch die Redistributionsschicht108 erstrecken. Bei einigen Beispielen können die Säulen, die die Kontakte der zweiten Gruppe118 bilden, eine Abmessung aufweisen, die sich ausreichend erstreckt, um Kontaktoberflächen im Wesentlichen an der Oberfläche des zweiten Halbleiter-Dies104 in Eingriff zu bringen. Bei anderen Konfigurationen, wie die, die in1A dargestellt sind, umfasst der zweite Halbleiter-Die104 allerdings eine dritte Gruppe von Kontakten, im Allgemeinen mit122 angezeigt, und die Kontakte dieser dritten Gruppe122 umfassen jeweils metallische Säulen, die sich von der Oberfläche des zweiten Halbleiter-Dies104 erstrecken. Die metallischen Säulen der zweiten und dritten Gruppe von Kontakten können zum Beispiel Kupfer- (Cu-) Säulen sein. Bei solchen Beispielen werden solche Kupfersäulen der zweiten und dritten Gruppe von Kontakten miteinander durch eine Zinn-Silber- (Sn-Ag-) Schnittstelle gebondet, die an die Oberfläche der Kontakte von einer der ersten oder zweiten Gruppe von Kontakten (oder beiden),118 und/oder122 , angelegt ist. - Wie bei der ersten Gruppe von Kontakten
110 umfassen auch die zweite und dritte Gruppe von Kontakten118 , die in einer Reihe in der Ebene des Querschnitts dargestellt sind, mehrere Kontakte, die in einer ausgewählten Struktur (Array) angeordnet sind, die sich in X-Y-Richtungen über einen Abschnitt der Kontaktoberfläche des Halbleiter-Dies102 erstreckt. Bei einigen Beispielen wiederum ist, oder umfasst, die Struktur ein rechteckiges Array von Kontakten, die alle in dem zweiten Abstand relativ zueinander angeordnet sind. Somit können jede der dargestellten zweiten Gruppe von Kontakten118 und die dritte Gruppe von Kontakten, die in jeweiligen Reihen in der Ebene des Querschnitts dargestellt ist, bei vielen Beispielen eine oder mehrere zusätzliche Reihen von Kontakten über die Ebene der Seite hinaus und eine oder mehrere zusätzliche Reihen von Kontakten über der Ebene der Seite umfassen, die alle in dem zweiten Abstand relativ zu anderen Kontakten der jeweiligen Gruppe angeordnet sind. Bei einigen Beispielen können die Kontakte der zweiten und/oder dritten Gruppe118 ,122 , zusätzlich dazu, dass sie in dem zweiten kleineren Abstand angeordnet sind, auch jeweils eine kleinere laterale Abmessung (Breite) aufweisen als die Kontakte der ersten Gruppe110 . - Während sich die vorliegende Beschreibung auf die Kontakte der ersten, zweiten und dritten Gruppe konzentriert, können die Halbleiter-Dies auch zusätzliche Kontakte (einzeln oder ein Array) umfassen, die nicht Teil der ersten und zweiten Gruppe sind. Die folgende Diskussion identifiziert, dass der zweite Halbleiter-Die
104 einen oder mehrere zusätzliche Kontakte, wie mit124 angezeigt, umfassen kann, was nicht Teil der dritten Gruppe von Kontakten ist. Auf die gleiche Weise kann der erste Halbleiter-Die102 auch einen oder mehrere Kontakte (umfassend ein Array von Kontakten) umfassen, die nicht Teil der Kontakte von entweder der ersten Gruppe110 oder der zweiten Gruppe118 sind. Zusätzliche Kontakte auf entweder dem Halbleiter-Die102 oder104 können davon unterschieden werden, dass sie Teil von irgendeiner der Kontaktgruppen110 ,118 oder122 (wie jeweils anwendbar) sind, dadurch dass sie von den Kontakten von irgendwelchen dieser Gruppen durch eine Distanz beabstandet sind, die größer ist als der Abstand einer solchen Kontaktgruppe. - Das Gehäuse
100 umfasst einen Mechanismus zum Koppeln von Kontakten der ersten Gruppe von Kontakten110 mit einer ersten Seite der Redistributionsschicht108 . Bei einigen Ausführungsbeispielen, wie dem in1A Dargestellten, umfasst dieser Mechanismus die erste Gruppe von Kontakten mit planaren Metallkontaktanschlussflächen, die zum Beispiel aus Aluminium oder Kupfer gebildet sind. Wie relativ zu2A-H ausführlicher beschrieben umfasst dieser Mechanismus auch in der Redistributionsschicht108 gebildete metallische Leiterbahnen, die sich erstrecken, um jeweilige Kontakte der ersten Gruppe von Kontakten110 elektrisch zu kontaktieren. Bei anderen Ausführungsbeispielen kann der Mechanismus zum Koppeln von Kontakten der ersten Gruppe von Kontakten mit einer ersten Seite der Redistributionsschicht Kontakte der ersten Gruppe von Kontakten110 umfassen, die mit metallischen Säulen oder ähnlichen Erstreckungsstrukturen, z. B. Kupfersäulen, gebildet sind, die sich zu der Oberfläche von irgendeiner Passivierungsschicht, oder über dieselbe hinaus, über dem ersten Halbleiter-Die erstrecken. Die Redistributionsschicht108 kann dann über solchen Säulen der ersten Gruppe von Kontakten110 gebildet werden. - Das Gehäuse
100 umfasst auch einen Mechanismus zum Koppeln von Kontakten der zweiten Gruppe von Kontakten118 mit Kontakten der dritten Gruppe von Kontakten112 auf dem zweiten Halbleiter-Die104 . Aufgrund des feineren Abstands von Kontakten der zweiten Gruppe von Kontakten118 kann eine für einen solchen feineren Abstand geeignete Zwischenverbindungstruktur anstelle anderer Strukturen, z. B. wie für die erste Gruppe von Kontakten110 verwendet werden können, verwendet werden. Da es für die zweite und/oder dritte Gruppe von Kontakten118 ,122 nicht notwendig ist, die Redistributionsschicht108 elektrisch in Eingriff zu bringen, ist die Konfiguration dieser Kontakte offen für strukturelle Optionen, die eine direkte Verbindung miteinander ermöglichen. Bei einigen Beispielen kann der Mechanismus zum Koppeln von Kontakten der zweiten und dritten Gruppe von Kontakten umfassen, dass entweder die zweite oder dritte Gruppe von Kontakten als planare Oberflächen gebildet sind, die Säulen oder andere Erstreckungen der anderen Gruppe von Kontakten in Eingriff bringen. Bei anderen Beispielen, z. B. den Beispielen von1A , kann der Mechanismus umfassen, dass sowohl die zweite als auch die dritte Gruppe von Kontakten Säulen umfassen, die in dem gleichen (zweiten) Abstand platziert sind und die direkt miteinander gebondet sein können. Bei einigen Beispielen (von einer der Konfigurationen) umfasst der Kopplungsmechanismus ein Bondschnittstellenmaterial, um das beschriebene Bonden zu ermöglichen. In den Fällen, in denen die Erstreckungssäulen zum Beispiel Kupfer (Cu) sind, kann eine Schnittstelle aus Zinn-Silber (SnAg) vorteilhaft verwendet werden, um das Bonden zwischen den Kontakten zu ermöglichen. - Das Gehäuse
100 stellt auch die Verwendung eines oder mehrerer zusätzlicher Kontakte124 (bei dem dargestellten Beispiel als ein einzelner Kontakt) außerhalb der dritten Gruppe von Kontakten122 dar. Wenn der zweite Halbleiter-Die104 in nur teilweise überlappender Beziehung mit dem ersten Halbleiter-Die102 ist (wie in dem vorliegenden Beispiel dargestellt), kann der zweite Halbleiter-Die104 (einen) zusätzliche(n) Kontakt(e)124 umfassen, die sich erstrecken, um jeweilige Kontakte126 in Eingriff zu bringen, die in der Redistributionsschicht108 gebildet sind. In den Fällen, in denen der eine oder die mehreren zusätzlichen Kontakte mehrere Kontakte umfassen, können jene Kontakte in einem größeren Abstand als dem zweiten Abstand120 der zweiten und dritten Gruppe von Kontakten sein. Dieser größere Abstand dient wiederum, um irgendwelchen Einschränkungen bei der Beabstandung entgegenzukommen, die durch die Anforderungen der Redistributionsschicht108 auferlegt sind. Bei einigen Beispielen, und wie relativ zu dem Gehäuse100 dargestellt, kontaktieren der eine oder die mehreren zusätzlichen Kontakte124 die Redistributionsschicht108 an einem Kontakt, wie mit126 angezeigt, der sich lateral über die Peripherie oder den Fußabdruck des ersten Halbleiter-Dies102 hinaus befindet. Wie vorangehend erörtert wurde, können (ein) zusätzliche(r) Kontakt(e)124 als nicht zur dritten Gruppe von Kontakten zugehörig identifiziert werden, weil er von der dargestellten dritten Gruppe von Kontakten122 durch eine Distanz beabstandet ist, die größer ist als der zweite Abstand, in dem eine solche dritte Gruppe von Kontakten122 beabstandet ist. - Bei einigen Beispielen stellen der zusätzliche/die zusätzlichen Kontakt(e)
124 eine elektrische Verbindung zwischen dem zweiten Halbleiter-Die104 und elektrischen Leiterbahnen innerhalb der Redistributionsschicht108 dar. Bei anderen Beispielen können der zusätzliche/die zusätzlichen Kontakt(e)124 allerdings nur eine Verbindung mit einem elektrisch isolierten Kontakt herstellen, um eine weitere mechanische Verbindung zwischen dem zweiten Halbleiter-Die104 und der zusätzlichen Struktur des Gehäuses100 bereitzustellen. Somit umfassen die hierin beschriebenen „Kontakt“-Strukturen, sind aber nicht begrenzt auf, Zwischenverbindungen zum Kommunizieren von elektrischen Signalen von einem Bauelement oder Stelle zu einer anderen, und umfassen ausdrücklich Zwischenverbindungen zum Herstellen von ausschließlich mechanischen Verbindungen. - Bei einigen beispielhaften mikroelektronischen Gehäusen, selbst in Fällen, in denen die Redistributionsschicht in einer „Fan-Out“-Konfiguration ist, kann sich der zweite Halbleiter-Die vollständig innerhalb der Peripherie des ersten Halbleiter-Dies erstrecken, oder alle elektrischen Verbindungen des zweiten Halbleiter-Dies können mit der zweiten Gruppe von Kontakten auf dem ersten Halbleiter-Die koppeln. Allerdings ist, wie es aus
1A ersichtlich ist, eine andere wahrscheinliche Konfiguration, dass der zweite Halbleiter-Die104 in nur teilweise überlappendem Verhältnis zu dem ersten Halbleiter-Die102 ist, und somit in Kontakt mit der Redistributionsschicht108 durch einen oder mehrere zusätzliche Kontakte124 , wie oben beschrieben, sein kann. - Ein Vorteil der beschriebenen Struktur ist das Reduzieren der Abmessungsanforderungen eines Halbleiter-Dies durch Ermöglichen von direkten Verbindungen zwischen mehreren Dies unter Verwendung von Kontakten, die in einem feineren Abstand beabstandet sind als Kontakte, die beabstandet sind, um die Redistributionsschicht in Eingriff zu bringen. Zusätzlich stellt die beschriebene Struktur Zwischenverbindungen zwischen den Dies mit einer minimalen Länge bereit, wodurch potenziell negative Effekte von längeren Zwischenverbindungen minimiert werden.
- Bezug nehmend auf
1B stellt die Figur ein modifiziertes Gehäuse130 da, das die Struktur des Gehäuses100 mit zusätzlich, darin gebildeten Strukturen umfasst. Folglich werden die in Bezug auf das Gehäuse100 verwendeten Bezugszeichen hier in Bezug auf das Gehäuse130 wiederholt. Eine erste zusätzliche Struktur findet sich in einem Unterfüllmaterial132 , das zwischen den zweiten Halbleiter-Die104 und die Redistributionsschicht108 platziert ist. Das Unterfüllmaterial132 kann aus verschiedenen Typen sein, die einem Fachmann bekannt sind, und kann durch verschiedene, diesem Fachmann bekannte Mechanismen platziert werden. Zum Beispiel kann das Unterfüllmaterial132 ein Epoxidharz sein, das in vielen Fällen Siliziumoxid (SiO2) enthält, und zum Beispiel durch einen Kapillarunterfüllprozess platziert werden kann. - Das Gehäuse
130 umfasst auch eine Einkapselung, im Allgemeinen mit134 angezeigt, die sich erstreckt, um die äußeren Oberflächen des zweiten Halbleiter-Dies104 zu bedecken und sich vorzugsweise zu der unteren Oberfläche der Redistributionsschicht108 erstreckt (wie dargestellt). Die Einkapselung134 erstreckt sich vorzugsweise zumindest in die Nähe des zweiten Halbleiter-Dies104 . Bei anderen Beispielen kann sich die Einkapselung erstrecken, um einen größeren Abschnitt, oder die Gesamtheit, der dargestellten unteren Oberfläche der Redistributionsschicht108 zu bedecken (mit der Ausnahme, dass sie die Kontaktkugeln114 nicht bedeckt). - Entweder das Unterfüllmaterial
132 oder die Einkapselung134 können eine mechanische Verbindung des zweiten Halbleiter-Dies104 innerhalb des Gehäuses130 verbessern. Das Unterfüllmaterial132 und die Einkapselung134 können unabhängig voneinander verwendet werden. Folglich kann nur eines von dem Unterfüllmaterial132 und der Einkapselung134 vorhanden sein; oder beide oder keines kann verwendet werden. - Bezug nehmend auf
2A-H zeigen diese Figuren aufeinanderfolgende Stufen eines beispielhaften Prozessablaufs zum Bilden eines IC-Gehäuses, wie z. B. das von1A .2A beginnt mit einem Halbleiter-Die200 , der innerhalb einer Formmassenkomponente202 (nur ein Abschnitt derselben ist dargestellt) platziert wird, was eine „Rekonstitution“ eines Wafers repräsentiert. Als ein Beispiel einer solchen „Rekonstitution“ eines Wafers, wie einem Fachmann bekannt ist, werden individuelle vereinzelte Dies auf einen Formträger in beabstandetem Verhältnis zueinander platziert, wobei die Beabstandung ausgewählt ist, um eine beabsichtigte Abmessung bereitzustellen zum Unterbringen einer Redistributionsschicht einer ausgewählten Abmessung, die relativ zu jedem Die gebildet werden soll, und zum Unterbringen einer nachfolgenden Vereinzelung der Redistributionsschichten und stützenden Formstruktur (mit angebrachtem Die). - Bei einem beispielhaften Ablauf wird eine Separationsschicht, z. B. eine Folienschicht, auf einen Formträger laminiert. Individuelle Dies werden auf der Folienschicht in der gewünschten Beabstandung platziert, z. B. durch Verwendung eines Nehmen- und Platzieren-Werkzeugs. Eine Formmasse wird dann in den Formträger platziert und unter entsprechenden Bedingungen geformt, um jeden Die in der erforderlichen Abmessung zu umgeben. Sobald die Formgebung abgeschlossen ist, wird der rekonstituierte Wafer von der Folie gelöst (debonded) und der Rest des Formträgers ist für die weitere Verarbeitung.
-
2A zeigt den Beginn des Prozessablaufs nach einer solchen Rekonstitution des Wafers. Wie dargestellt, umfasst der Halbleiter-Die200 eine Passivierungsschicht204 , die geöffnet wird, um Zugang zu Metallkontaktanschlussflächen206 bereitzustellen. Die Metallkontaktanschlussflächen206 , z. B. Aluminiumkontaktanschlussflächen, bilden eine erste Gruppe von Kontakten208 , die in einem ersten relativen Abstand zueinander angeordnet sind, im Allgemeinen mit210 angezeigt. Der Halbleiter-Die200 umfasst auch eine zweite Gruppe von Kontakten212 , die jeweils eine jeweilige metallische Säule, z. B. eine Kupfersäule214 , umfassen. In dieser zweiten Gruppe von Kontakten212 sind metallische Säulen in einem zweiten Abstand218 angeordnet, der ein feinerer Abstand ist als der Abstand210 der ersten Gruppe von Kontakten208 . Bei einigen Beispielprozessen werden die Passivierungsschicht204 und die Kupfersäulen214 während der Verarbeitung des Halbleiter-Dies gebildet. Bei anderen Prozessen kann die Passivierungsschicht204 nach der Rekonstitution des Wafers, wie in2A dargestellt, gebildet werden, oder falls sie vorher gebildet wurde, kann dieselbe geöffnet werden. Auf ähnliche Weise können bei einigen Prozessabläufen die Kupfersäulen214 nach der Rekonstitution des Wafers gebildet werden. - Bezug nehmend auf
2B wird eine erste dielektrische Schicht216 , die einen Abschnitt einer Redistributionsschicht bildet, über einem Abschnitt des Halbleiter-Dies200 und der Formkomponente202 gebildet. Bei einigen Beispielen umfasst die erste dielektrische Schicht216 eine Polyamidschicht und wird durch Abscheidung über die Oberfläche des rekonstituierten Wafers und eine nachfolgende photolithographische Strukturierung gebildet. Bei dem dargestellten Beispiel wird die dielektrische Schicht216 in der Nähe der zweiten Gruppe von Kontakten212 entfernt. Allerdings ist eine solche Entfernung nicht erforderlich und bei einigen Prozessen kann die dielektrische Schicht216 an Ort und Stelle verbleiben, wobei sie die Kupfersäulen214 umgibt (sich aber nicht über dieselben erstreckt). - Bezug nehmend auf
2C wird eine Keimschicht220 für eine elektrochemische Plattierung von Leiterbahnen in der Redistributionsschicht abgeschieden. Bei Beispielen, bei denen die Leiterbahnen in der Redistributionsschicht Kupfer sind, kann die Keimschicht eine gesputterte metallische Schicht, z. B. Titan-Wolfram (TiW/Cu) oder Titan/Kupfer (Ti/Cu), sein. - Bei einigen Beispielen, z. B. dem in
2C Dargestellten, wird die Keimschicht auf die Oberfläche des rekonstituierten Wafers gesputtert. Bei anderen Beispielen kann die Region neben der zweiten Gruppe von Kontakten212 vor dem Bilden der Keimschicht maskiert werden. - Bezug nehmend auf
2D wird bei dem dargestellten Beispiel ein Plattierungs-Resist222 über der Keimschicht abgeschieden und dann auf herkömmliche Weise strukturiert, um die Kontouren zum Bilden von leitfähigen Leiterbahnen der Redistributionsschicht zu definieren. - Bezug nehmend auf
2E wird dann eine Metallschicht224 , z. B. Kupfer, über den Abschnitten der Keimschicht220 abgeschieden, die durch strukturiertes Plattierungs-Resist222 freigelegt bleiben. Ein Beispielverfahren zum Abscheiden des zusätzlichen Kupfers (oder anderen Metalls) ist Elektroplattierung. - Bezug nehmend auf
2F kann dann, sobald die Metallschicht224 gebildet ist, das strukturierte Plattierungs-Resist222 entfernt werden. Bezug nehmend auf2G , der jetzt freigelegte Abschnitt der Keimschicht220 kann dann geätzt werden. Bei Beispielen, wie z. B. dem Beschriebenen, wobei die Keimschicht entweder Titan-Wolfram/Kupfer (TiW/Cu) oder Titan/Kupfer (Ti/Cu) ist, ist eine beispielhafte geeignete Chemie zum Entfernen des gesputterten Kupfers Salpetersäure (HNO3), und eine beispielhafte geeignete Chemie zum Entfernen des Titans (Ti) oder Titan-Wolframs (TiW) ist Wasserstoffperoxid (H2O2) plus Ammoniak (NH4OH). Die Entfernung des freigelegten Abschnitts der Keimschicht220 isoliert die abgeschiedenen Metall- (Cu-) Leiterbahnen226 für die Redistributionsschicht und isoliert auch die Kupfersäulen214 voneinander. - Bezug nehmend auf
2H wird dann eine zweite dielektrische Schicht228 über der rekonstituierten Waferoberfläche gebildet und strukturiert (geöffnet), um die zweite Gruppe von Kontakten212 freizulegen und auch um Zugang zu Kontaktabschnitten von Metallleiterbahnen226 der Redistributionsschicht durch Öffnungen230 zu ermöglichen. Wie relativ zu dem Gehäuse100 von1A erörtert, erstrecken sich die leitfähigen Leiterbahnen (226 ) über die Formkomponente202 , um die Platzierung von Kontaktkugeln (214 in1A) über die Peripherie (d. h. den Fußabdruck) des Halbleiter-Dies200 hinaus zu ermöglichen, wobei die Redistributionsschicht durch die Formkomponente202 gestützt wird. - Bezug nehmend auf
3 stellt die Figur eine alternative Konfiguration für ein mikroelektronisches Gehäuse300 dar, das sich von den Gehäusen von1A-B und2A-H darin unterscheidet, dass es eine Multi-Ebenen-Redistributionsschicht umfasst, die im Allgemeinen mit302 angezeigt ist. Strukturen von3 sind direkt parallel zu denjenigen, die in2H dargestellt sind, und wurden daher in3 identisch nummeriert. Die Grundstruktur des Gehäuses300 ist ähnlich zu der in2H Dargestellten, aber eine zusätzliche Ebene von leitfähigen Leiterbahnen304 ist über der zweiten dielektrischen Schicht228 angeordnet. Die zusätzliche Ebene von leitfähigen Leiterbahnen304 ist dann durch eine dritte dielektrische Schicht306 bedeckt. Die leitfähigen Leiterbahnen304 erstrecken sich zu Metallleiterbahnen226 , um das Leiten von Signalen von dem Halbleiter-Die200 zu gewünschten Stellen auf die in1A dargestellte Weise weiter zu vereinfachen. Um eine Anbringung eines zweiten Halbleiter-Dies an den Kupfersäulen214 auf die in Bezug auf1A beschriebene Weise zu ermöglichen, kann es wünschenswert sein, Kupfersäulen308 von erhöhter Höhe relativ zu der der Kupfersäulen214 in der Einzelne-Ebene-Redistributionsschicht von2A-H zu bilden. Zusätzlich kann es bei einigen Ausführungsbeispielen wünschenswert sein, die erste dielektrische Schicht216 so zu bilden, dass sie sich um die Kupfersäulen308 (nicht eigens dargestellt) erstreckt. - Bezug nehmend auf
4 stellt die Figur ein Flussdiagramm dar, das Operationen eines Beispielverfahrens400 zum Bilden eines mikroelektronischen Bauelementgehäuses des hierin beschriebenen Typs identifiziert. Zunächst wird Bezug genommen auf Operation402 , wobei eine Trägerstruktur über einem ersten Halbleiter-Die gebildet wird, die erste und zweite Gruppen von Kontakten umfasst, die in unterschiedlichen Abständen voneinander angeordnet sind, und wobei Kontakte der zweiten Gruppe von Kontakten in einem feineren Abstand angeordnet sind als Kontakte der ersten Gruppe. Bei vielen Beispielen ist die Trägerstruktur eine Formstruktur. - Bei Operation
404 wird eine Redistributionsschicht über der aktiven Oberfläche des ersten Halbleiter-Dies und über zumindest einem Abschnitt der Formstruktur gebildet. Wie an anderer Stelle hierin beschrieben umfasst die Redistributionsschicht leitfähige Leiterbahnen, die sich von Kontakten der ersten Gruppe von Kontakten des ersten Halbleiter-Dies zu erwünschten Stellen zum Platzieren von Kontaktkugeln zum Herstellen von elektrischen Verbindungen mit anderen Strukturen erstrecken. Bei einigen Beispielen sind zumindest einige der erwünschten Stellen für Kontaktkugeln über die lateralen Abmessungen des ersten Halbleiter-Dies hinaus, und sind somit in einer Region, in der die Redistributionsschicht durch die über dem ersten Halbleiter-Die gebildete Formstruktur gestützt wird. - Bei Operation
406 erstreckt sich ein zweiter Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die und wird in zumindest teilweise überlappendem Verhältnis zu dem ersten Halbleiter-Die platziert. Der zweite Halbleiter-Die ist mit dem ersten Halbleiter-Die durch dritte Menge von Kontakten gekoppelt, die in dem gleichen Abstand platziert werden wie die Kontakte der zweiten Gruppe von Kontakten auf dem ersten Halbleiter-Die, und jeweilige Kontakte der zweiten und dritten Gruppe von Kontakten sind miteinander gebondet. Bei verschiedenen Beispielen kann die Redistributionsschicht eine einzelne Ebene von leitfähigen Leiterbahnen umfassen, während bei anderen Beispielen die Redistributionsschicht zwei oder mehr Ebenen von leitfähigen Leiterbahnen aufweisen kann. - Bei der optionalen Operation
408 kann der zweite Halbleiter-Die einen oder mehrere zusätzliche Kontakte (wie mit 124 in1A identifiziert) umfassen, getrennt von der dritten Menge von Kontakten, und das Verfahren können ferner ein Bonden des/der zusätzlichen Kontakts/Kontakte mit jeweiligen Kontakten auf der Redistributionsschicht umfassen. Bei einigen Beispielen dieses Verfahrens kann ein oder mehrere der zusätzlichen Kontakte mit einem Kontakt auf der Redistributionsschicht gebondet sein, der über die laterale Abmessung des ersten Halbleiter-Dies hinaus ist. Wie an anderer Stelle hierin angemerkt, können einer oder mehrere zusätzliche Kontakte mit Redistributionsschicht-Kontakten gekoppelt sein, die entweder mit einer elektrischen Leiterbahn gekoppelt sind oder die elektrisch isoliert sind. - Bei der optionalen Operation
410 wird ein Kopplungsmaterial angewandt, um sowohl den zweiten Halbleiter-Die als auch die Redistributionsschicht in Eingriff zu bringen. Bei einigen Bespielen ist das Kopplungsmaterial ein Unterfüllmaterial, das zwischen den zweiten Halbleiter-Die und die Redistributionsschicht platziert wird; während bei anderen Beispielen das Kopplungsmaterial in der Form einer Einkapselung ist, die sich um den zweiten Halbleiter-Die erstreckt. Bei einigen Beispielen umfasst das Kopplungsmaterial sowohl ein Unterfüllmaterial als auch ein Einkapselungsmaterial. - Wie bereits angemerkt können viele Halbleiter-Die-Typen auf die hierin beschriebene Weise vorteilhaft zusammen in einem mikroelektronischen Bauelement gehäust (packaged) werden. Ein Beispiel einer solchen vorteilhaften Kombination wäre ein Prozessor-Die in Kombination mit einem anderen Bauelement-Die, z. B. einem Speicherbauelement, einem Chipsatz, einem Graphikprozessor etc. Das sich ergebende mikroelektronische Bauelementgehäuse kann dann in einer größeren elektronischen Vorrichtung oder System umfasst sein.
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5 stellt ein Systemebenendiagramm gemäß einem Ausführungsbeispiel der Erfindung dar. Zum Beispiel stellt5 ein Beispiel einer elektronischen Vorrichtung (z. B. System) dar, die das mikroelektronische Bauelement umfasst, das wie in der vorliegenden Offenbarung beschrieben gehäust ist.5 zeigt ferner ein Beispiel einer Bauelementanwendung einer höheren Ebene für die vorliegende Erfindung. Bei einem Ausführungsbeispiel umfasst ein System500 , ist aber nicht begrenzt auf, einen Desktop-Computer, einen Laptop-Computer, ein Netbook, ein Tablet, einen Notebook-Computer, einen Personaldigitalassistenten (PDA; Personal Digital Assistant), einen Server, eine Arbeitsstation, ein Mobiltelefon, eine mobile Rechenvorrichtung, ein Smartphone, eine Internet-Gerät oder einen anderen Typ von Rechenvorrichtung. Bei einigen Ausführungsbeispielen ist das System500 ein System-aufeinem-Chip (SOC-; System On a Chip) System. - Bei einem Ausführungsbeispiel umfasst ein Prozessor
510 einen oder mehrere Verarbeitungskerne512 und512N , wobei 512N den N. Verarbeitungskern im Inneren des Prozessors510 repräsentiert, wobei N eine positive Ganzzahl ist. Bei einem Ausführungsbeispiel umfasst das System500 mehrere Prozessoren, umfassend510 und505, wobei der Prozessor505 eine Logik aufweist, die ähnlich oder identisch zu der Logik des Prozessors510 ist. Bei einigen Ausführungsbeispielen umfasst der Verarbeitungskern512 , ist aber nicht begrenzt auf, eine Vorgriffs-Logik (Prefetch-Logik), um Anweisungen zu holen, Decodierungslogik zum Decodieren der Anweisungen, Ausführungslogik zum Ausführen der Anweisungen und Ähnliches. Bei einigen Ausführungsbeispielen umfasst der Prozessor510 einen Cache-Speicher516 , um Anweisungen und/oder Daten für das System500 zu cachen. Der Cache-Speicher516 kann in eine hierarchische Struktur organisiert sein, die eine oder mehrere Cache-Speicher-Ebenen umfasst. - Bei einigen Ausführungsbeispielen umfasst der Prozessor
510 eine Speichersteuerung514 , die wirksam ist, um Funktionen auszuführen, die es dem Prozessor510 ermöglichen, auf einen Speicher530 zuzugreifen und mit demselben zu kommunizieren, der einen flüchtigen Speicher532 und/oder einen nicht-flüchtigen Speicher534 umfasst. Bei einigen Ausführungsbeispielen ist der Prozessor510 mit dem Speicher530 und einem Chipsatz520 gekoppelt. Der Prozessor510 kann auch mit einer drahtlosen Antenne578 gekoppelt sein, um mit irgendeiner Vorrichtung zu kommunizieren, die ausgebildet ist zum Senden und/oder Empfangen von drahtlosen Signalen. Bei einem Ausführungsbeispiel arbeitet die drahtlose Antennenschnittstelle578 gemäß, aber nicht begrenzt auf, dem IEEE 802.11-Standard und seiner zugehörigen Familie, Home Plug AV (HPAV), Ultrabreitband (UWB; Ultra Wide Band), Bluetooth, WiMax oder irgendeiner Form von drahtlosem Kommunikationsprotokoll. - Bei einigen Ausführungsbeispielen umfasst der flüchtige Speicher
532 , ist aber nicht begrenzt auf, einen synchronen dynamischen Direktzugriffsspeicher (SDRAM; Synchronous Dynamic Random Access Memory), einen dynamischen Direktzugriffsspeicher (DRAM; Dynamic Random Access Memory), einen RAMBUS-Dynamisch-Direktzugriffsspeicher (RDRAM; RAMBUS Dynamic Random Access Memory) und/oder irgendeinen anderen Typ von Direktzugriffsspeicher-Vorrichtung. Der nicht-flüchtige Speicher534 umfasst, ist aber nicht begrenzt auf, einen Flash-Speicher, einen Phasenänderungsspeicher (PCM; Phase Change Memory, einen Nurlesespeicher (ROM; Read-Only Memory), einen elektrisch löschbaren programmierbaren Nurlesespeicher (EEPROM; Erasable Programmable Read-Only Memory) oder irgendeinen anderen Typ von nicht-flüchtiger Speichervorrichtung. - Der Speicher
530 speichert Information und Anweisungen, die durch den Prozessor510 auszuführen sind. Bei einem Ausführungsbeispiel kann der Speicher530 auch temporäre Variablen oder andere intermediäre Information speichern, während der Prozessor510 Anweisungen ausführt. Bei dem dargestellten Ausführungsbeispiel verbindet sich der Chipsatz520 mit dem Prozessor510 via Punkt-zu-Punkt- (PtP- oder P-P- (Point-to-Point)) Schnittstellen517 und522 . Der Chipsatz520 ermöglicht es dem Prozessor510 , sich mit anderen Elementen in dem System500 zu verbinden. Bei einigen Ausführungsbeispielen der Erfindung arbeiten die Schnittstellen517 und522 gemäß einem PtP-Kommunikationsprotokoll, z. B. dem Intel® QuickPath Interconnect (QPI) oder Ähnlichem. Bei anderen Ausführungsbeispielen kann eine unterschiedliche Zwischenverbindung verwendet werden. - Bei einigen Ausführungsbeispielen ist der Chipsatz
520 wirksam, um mit dem Prozessor510 ,505N , einer Anzeigevorrichtung540 und anderen Vorrichtungen572 ,576 ,574 ,560 ,562 ,564 ,566 ,577 etc. zu kommunizieren. Der Chipsatz520 kann auch mit einer drahtlosen Antenne578 gekoppelt sein, um mit irgendeiner Vorrichtung zu kommunizieren, die ausgebildet ist zum Senden und/oder Empfangen von drahtlosen Signalen. - Der Chipsatz
520 verbindet sich mit der Anzeigevorrichtung540 via eine Schnittstelle526 . Die Anzeige540 kann zum Beispiel eine Flüssigkristallanzeige (LCD; Liquid Crystal Display), eine Plasmaanzeige, eine Kathodenstrahlröhren- (CRT; Cathode Ray Tube) Anzeige oder irgendeine andere Form von visueller Anzeigevorrichtung sein. Bei einigen Ausführungsbeispielen der Erfindung sind der Prozessor510 und der Chipsatz520 in einem einzelnen SOC vereint. Zusätzlich verbindet sich der Chipsatz520 mit einem oder mehreren Bussen550 und555 , die verschiedene Elemente574 ,560 ,562 ,564 , und566 zwischenverbinden. Die Busse550 und555 können zusammen via eine Bus-Brücke572 zwischenverbunden sein. Bei einem Ausführungsbeispiel koppelt der Chipsatz520 mit einem nicht-flüchtigen Speicher560 , (einer) Massenspeichervorrichtung(en)562 , einer Tastatur/Maus564 und einer Netzwerkschnittstelle566 via eine Schnittstelle524 und/oder504 , einen Smart-TV576 , Verbraucherelektronik577 etc. - Bei einem Ausführungsbeispiel umfasst die Massenspeichervorrichtung
562 , ist aber nicht begrenzt auf, ein Solid-State-Laufwerk, ein Festplattenlaufwerk, ein Flash-Speicher-Laufwerk mit universellem seriellem Bus (Universal Serial Bus) oder irgendeine andere Form von Computerdatenspeichermedium. Bei einem Ausführungsbeispiel ist die Netzwerkschnittstelle566 durch irgendeinen Typ von bekanntem Netzwerkschnittstellenstandard implementiert, umfassend, aber nicht begrenzt auf, eine Ethernet-Schnittstelle, eine Universaler-Serieller-Bus-(USB-) Schnittstelle, eine Peripher-Komponente-Zwischenverbindung (PCI-; Peripheral-Component-Interconnect-) Express-Schnittstelle, eine drahtlose Schnittstelle und/oder irgendeinen anderen geeigneten Schnittstellentyp. Bei einem Ausführungsbeispiel arbeitet die drahtlose Schnittstelle gemäß, aber nicht begrenzt auf, dem IEEE 802.11-Standard und seiner zugehörigen Familie, Home Plug AV (HPAV), Ultrabreitband (UWB), Bluetooth, WiMax oder irgendeiner Form von drahtlosem Kommunikationsprotokoll. - Während die in
5 gezeigten Module als separate Blöcke innerhalb des Systems500 dargestellt sind, können die durch einige dieser Blöcke ausgeführten Funktionen innerhalb einer einzelnen Halbleiterschaltung integriert sein oder können unter Verwendung von zwei oder mehr separaten integrierten Schaltungen implementiert sein. Obwohl der Cache-Speicher516 als ein separater Block innerhalb des Prozessors510 dargestellt ist, kann der Cache-Speicher516 (oder ausgewählte Aspekte von516 ) zum Beispiel in den Verarbeitungskern512 integriert sein. - Zur besseren Veranschaulichung der hierin beschriebenen Verfahren und Vorrichtungen ist im Folgenden eine nicht einschränkende Menge von Ausführungsbeispielen als zahlenmäßig identifizierte Beispiele dargelegt:
- Beispiel 1 ist ein mikroelektronisches Bauelement, umfassend: einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander, wobei der zweite Abstand geringer ist als der erste Abstand; eine Redistributionsschicht mit einer ersten Seite, die mit dem ersten Halbleiter-Die gekoppelt ist; und einen zweiten Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die, wobei das zweite Halbleiterbauelement eine dritte Gruppe von Kontakten in dem zweiten Abstand umfasst, wobei die Kontakte der dritten Gruppe von Kontakten mit jeweiligen Kontakten der zweiten Gruppe von Kontakten gekoppelt sind.
- Bei Beispiel 2 umfasst der Gegenstand von Beispiel 1 optional, dass das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst.
- Bei Beispiel 3 umfasst der Gegenstand von Beispiel 2 optional, dass der zusätzliche Kontakt mit einem Kontakt der Redistributionsschicht gekoppelt ist, der außerhalb eines Fußabdrucks des ersten Halbleiter-Dies ist.
- Bei Beispiel 4 umfasst der Gegenstand von einem oder mehreren der Beispiele 2-3 optional, dass zumindest eine von der ersten und zweiten Gruppe von Kontakten ein Array von Kontakten umfasst, das sich entlang sowohl der X- als auch der Y-Abmessungen des ersten Halbleiter-Dies erstreckt.
- Bei Beispiel 5 umfasst der Gegenstand von einem oder mehreren der Beispiele 1-4 optional, dass die Redistributionsschicht zumindest einige Kontakte der ersten Gruppe von Kontakten mit jeweiligen Stellen außerhalb eines Fußabdrucks des ersten Halbleiter-Dies koppelt.
- Bei Beispiel 6 umfasst der Gegenstand von einem oder mehreren der Beispiele 1-5 optional eine Formstruktur, die die Redistributionsschicht stützt und den ersten Halbleiter-Die kapselt.
- Bei Beispiel 7 umfasst der Gegenstand von einem oder mehreren der Beispiele 1-6 optional, dass die Redistributionsschicht mehrere Ebenen von leitfähigen Leiterbahnen umfasst.
- Beispiel 8 ist ein Gehäuse für ein mikroelektronisches Bauelement, umfassend: einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander sowohl in X- als auch in Y-Richtung, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander sowohl in X- als auch in Y-Richtung, wobei der zweite Abstand geringer ist als der erste Abstand; eine Formstruktur, die sich über den ersten Halbleiter-Die erstreckt; eine Redistributionsschicht mit einer ersten Seite, die mit dem ersten Halbleiter-Die gekoppelt ist und zumindest teilweise durch die Formstruktur gestützt wird; und einen zweiten Halbleiter-Die, der sich auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die erstreckt, wobei der zweite Halbleiter-Die eine dritte Gruppe von Kontakten umfasst, wobei die Kontakte der dritten Gruppe von Kontakten in dem zweiten Abstand sowohl in X- als auch in Y-Richtung angeordnet sind und mit jeweiligen Kontakten der zweiten Gruppe von Kontakten gekoppelt sind.
- Bei Beispiel 9 umfasst der Gegenstand von Beispiel 8 optional, dass die Redistributionsschicht Kontaktkugeln umfasst, und wobei zumindest ein Abschnitt der Kontakte der ersten Gruppe von Kontakten durch die Redistributionsschicht mit jeweiligen Kontaktkugeln lateral über die lateralen Abmessungen des ersten Halbleiter-Dies hinaus verbunden ist.
- Bei Beispiel 10 umfasst der Gegenstand von einem der Beispiele 8-9 optional, dass die Redistributionsschicht Kontaktkugeln umfasst, und wobei zumindest ein Abschnitt der Kontakte der ersten Gruppe von Kontakten durch die Redistributionsschicht mit jeweiligen Kontaktkugeln lateral über die lateralen Abmessungen des ersten Halbleiter-Dies hinaus verbunden ist, und sich die Kontaktkugeln auf der gleichen Seite der Redistributionsschicht befinden wie der zweite Halbleiter-Die.
- Bei Beispiel 11 umfasst der Gegenstand von einem oder mehreren der Beispiele 8-10 optional, dass der zweite Halbleiter-Die zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und wobei der zumindest eine zusätzliche Kontakt mit einem Kontakt in der Redistributionsschicht gekoppelt ist.
- Bei Beispiel 12 umfasst der Gegenstand von Beispiel 11 optional, dass ein zusätzlicher Kontakt gekoppelt ist, um nur eine mechanische Verbindung mit der Redistributionsschicht bereitzustellen.
- Bei Beispiel 13 umfasst der Gegenstand von einem oder mehreren der Beispiele 8-12 optional, dass die Redistributionsschicht mehrere Ebenen von Leitern umfasst.
- Bei Beispiel 14 umfasst der Gegenstand von einem oder mehreren der Beispiele 8-13 optional, dass die Kontakte der zweiten Gruppe von Kontakten mit jeweiligen Kontakten der dritten Gruppe von Kontakten durch Kupfersäulen, die auf jedem von dem ersten und zweiten Halbleiter-Die gebildet sind, gekoppelt sind.
- Bei Beispiel 15 umfasst der Gegenstand von einem oder mehreren der Beispiele 8-14 optional, dass der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 70 % des Abstands der ersten Gruppe von Kontakten.
- Bei Beispiel 16 umfasst der Gegenstand von einem oder mehreren der Beispiele 8-15 optional, dass der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 50 % des Abstands der ersten Gruppe von Kontakten.
- Beispiel 17 ist ein mikroelektronisches Bauelement, umfassend: einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander, wobei der zweite Abstand geringer ist als der erste Abstand; ein Mittel zum Koppeln der ersten Gruppe von Kontakten des ersten Halbleiter-Dies mit einer ersten Seite einer Redistributionsschicht; und ein Mittel zum Koppeln eines zweiten Halbleiter-Dies mit der zweiten Gruppe von Kontakten des ersten Halbleiter-Dies, wobei sich der zweite Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die befindet.
- Bei Beispiel 18 umfasst der Gegenstand von Beispiel 17 optional das Mittel zum Koppeln des zweiten Halbleiter-Dies mit der zweiten Gruppe von Kontakten, umfassend eine dritte Gruppe von Kontakten auf dem zweiten Halbleiter-Die, wobei die dritte Gruppe von Kontakten in dem zweiten Abstand relativ zueinander angeordnet ist; und wobei die Kontakte von zumindest einer von der zweiten und dritten Gruppe von Kontakten metallische Säulen umfassen, die eine elektrische Kommunikation mit der anderen Menge von Kontakten herstellen.
- Bei Beispiel 19 umfasst der Gegenstand von Beispiel 18 optional, dass die Kontakte von sowohl der zweiten als auch der dritten Gruppe von Kontakten Kupfersäulen umfassen.
- Bei Beispiel 20 umfasst der Gegenstand von einem oder mehreren der Beispiele 17-19 optional, dass die Redistributionsschicht Kontaktkugeln umfasst, um eine Trägerstruktur in Eingriff zu bringen, wobei zumindest einige der Kontaktkugeln mit jeweiligen Kontakten der ersten Gruppe von Kontakten elektrisch gekoppelt sind.
- Bei Beispiel 21 umfasst der Gegenstand von einem oder mehreren der Beispiele 19-20 optional, dass die metallischen Säulen sich durch eine Separation in die Redistributionsschicht erstrecken, um mit der anderen Menge von Kontakten in Eingriff zu sein.
- Beispiel 22 ist ein Verfahren zum Bilden eines Gehäuses eines mikroelektronischen Bauelements, umfassend: Bilden einer Formstruktur über einem ersten Halbleiter-Die, wobei der Die eine erste und zweite Gruppe von Kontakten umfasst, wobei die Kontakte von jeder von der ersten und zweiten Gruppe in einem ersten und/oder zweiten Abstand angeordnet sind, und wobei die Kontakte der zweiten Gruppe in einem feineren Abstand sind als die Kontakte der ersten Gruppe; Bilden einer Redistributionsschicht über dem ersten Halbleiter-Die und zumindest einem Abschnitt der Formstruktur; und Koppeln eines zweiten Halbleiter-Dies mit dem ersten Halbleiter-Die, wobei der zweite Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die ist, wobei der zweite Halbleiter-Die eine dritte Gruppe von Kontakten umfasst, die in dem gleichen Abstand angeordnet sind wie die Kontakte der zweiten Gruppe, und wobei der zweite Halbleiter-Die mit dem ersten Halbleiter-Die zumindest teilweise durch Bonden von Kontakten der dritten Gruppe mit jeweiligen Kontakten der zweiten Gruppe gekoppelt ist.
- Bei Beispiel 23 umfasst der Gegenstand von Beispiel 22 optional, dass das Bonden von Kontakten der dritten Gruppe mit jeweiligen Kontakten der zweiten Gruppe ein Zusammenbonden von Kupfersäulen umfasst, die auf sowohl den Kontakten der zweiten Gruppe als auch den Kontakten der dritten Gruppe gebildet sind.
- Bei Beispiel 24 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-23 optional, dass der zweite Halbleiter-Die zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und wobei der zusätzliche Kontakt mit einem Kontakt auf der Redistributionsschicht gebondet ist.
- Bei Beispiel 25 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-24 optional ein Platzieren eines Unterfüllmaterials zwischen den zweiten Halbleiter-Die und die Redistributionsschicht.
- Bei Beispiel 26 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-25 optional ein Bilden einer Einkapselung über dem zweiten Halbleiter-Die.
- Bei Beispiel 27 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-26 optional, dass zumindest eine von der ersten und zweiten Gruppe von Kontakten ein Array von Kontakten umfasst, das sich in sowohl der X- als auch der Y-Richtung auf dem ersten Halbleiter-Die erstreckt.
- Bei Beispiel 28 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-27 optional ein Bilden von Kontaktkugeln auf Kontakten der Redistributionsschicht.
- Bei Beispiel 29 umfasst der Gegenstand von Beispiel 28 optional, dass Kontakte der ersten Gruppe von Kontakten mit jeweiligen Kontaktkugeln durch in der Redistributionsschicht gebildete, leitfähige Pfade gekoppelt sind.
- Bei Beispiel 30 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-29 optional, dass der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 70 % des Abstands der ersten Gruppe von Kontakten.
- Bei Beispiel 31 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-30 optional, dass der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 50 % des Abstands der ersten Gruppe von Kontakten.
- Bei Beispiel 32 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-31 optional, dass das Gehäuse ein Fan-Out-Gehäuse ist.
- Bei Beispiel 33 umfasst der Gegenstand von einem oder mehreren der Beispiele 22-32 optional, dass die Kupfersäulen von der ersten und zweiten Gruppe von Kontakten miteinander durch Verwendung einer Zinn-Silber- (SnAg-) Schicht gebondet sind.
- Bei Beispiel 34 umfasst der Gegenstand von einem oder mehreren der Beispiele 23-33 optional, dass die Kupfersäulen von der zweiten und dritten Menge von Kontakten keine elektrische Verbindung mit der Redistributionsschicht bilden.
- Beispiel 35 ist ein elektronisches System, umfassend: ein mikroelektronisches Bauelement, umfassend: einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander, wobei der zweite Abstand geringer ist als der erste Abstand; eine Redistributionsschicht mit einer ersten Seite, die mit dem ersten Halbleiter-Die gekoppelt ist; und einen zweiten Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die und in teilweise überlappendem Verhältnis zu dem ersten Halbleiter-Die, wobei das zweite Halbleiterbauelement eine dritte Gruppe von Kontakten in dem zweiten Abstand umfasst, wobei die Kontakte der dritten Gruppe von Kontakten mit jeweiligen Kontakten der zweiten Gruppe von Kontakten gekoppelt sind; und zumindest eines von einer Massenspeichervorrichtung und einer Netzwerkschnittstelle, die wirksam mit dem mikroelektronischen Bauelement gekoppelt ist.
- Bei Beispiel 36 umfasst der Gegenstand von Beispiel 35 optional, dass das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst.
- Bei Beispiel 37 umfasst der Gegenstand von einem der Beispiele 34-36 optional, dass das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und der zusätzliche Kontakt mit einem Kontakt in der Redistributionsschicht gekoppelt ist.
- Bei Beispiel 38 umfasst der Gegenstand von Beispiel 37 optional, dass das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und der zusätzliche Kontakt außerhalb eines Fußabdrucks des ersten Halbleiter-Dies ist.
- Die obige detaillierte Beschreibung nimmt Bezug auf die beiliegenden Zeichnungen, die Bestandteil der detaillierten Beschreibung sind. Veranschaulichend zeigen die Zeichnungen spezifische Ausführungsbeispiele, bei denen die Erfindung ausgeführt werden kann. Auf diese Ausführungsbeispiele wird hierin auch als „Beispiele“ Bezug genommen. Solche Beispiele können Elemente zusätzlich zu den Gezeigten und Beschriebenen umfassen. Allerdings betrachten die vorliegenden Erfinder auch Beispiele, bei den nur jene Elemente, die gezeigt oder beschrieben sind, bereitgestellt sind. Ferner betrachten die vorliegenden Erfinder auch Beispiele, die irgendeine Kombination oder Permutation jener gezeigten oder beschriebenen Elemente (oder einen oder mehrere Aspekte derselben) verwenden, entweder im Hinblick auf ein bestimmtes Beispiel (oder einen oder mehrere Aspekte desselben) oder im Hinblick auf andere Beispiele (oder einen oder mehrere Aspekte derselben).
- In diesem Dokument werden die Begriffe „ein, eine“ verwendet, wie in Patentdokumenten üblich, um einen oder mehrere als einen zu umfassen, unabhängig von irgendwelchen anderen Fällen oder Verwendungen von „zumindest ein,e,s“ oder ein,e,s oder mehrere“. In diesem Dokument wird der Begriff „oder“ verwendet, um auf ein nicht-exklusives oder Bezug zu nehmen, derart, dass „A oder B“ „A aber nicht B“, „B aber nicht A“ und „A und B“ umfasst, sofern es nicht anderweitig angegeben ist. In diesem Dokument werden die Begriffe „aufweisend“ und „bei dem,r“ als die einfachen Entsprechungen der jeweiligen Begriffe „umfassend“ und „wobei“ verwendet. In den folgenden Ansprüchen sind ferner die Begriffe „aufweisend“ und „umfassend“ offene Begriffe, d.h. ein System, Bauelement/Vorrichtung (device), Artikel, Zusammensetzung, Formulierung oder Prozess, der Elemente zusätzlich zu jenen umfasst, die nach einem solchen Begriff in einem Anspruch aufgeführt sind, fällt immer noch in den Schutzbereich dieses Anspruchs. Ferner werden in den folgenden Ansprüchen die Begriffe „erste,r,s“ „zweite,r,s“ und „dritte,r,s“ etc. lediglich als Kennzeichnungen verwendet und sollen ihren Objekten keine numerischen Anforderungen auferlegen.
- Die obige Beschreibung soll veranschaulichend und nicht einschränkend sein. Zum Beispiel können die vorstehend beschriebenen Beispiele (oder einer oder mehrere Aspekte derselben) in Kombination miteinander verwendet werden. Andere Ausführungsbeispiele können verwendet werden, wie sie z. B. ein Fachmann nach Prüfung der obigen Beschreibung erkennt. Die Zusammenfassung ist bereitgestellt, um 37 C.F.R. §1.72(b) zu entsprechen, um es dem Leser zu erlauben, das Wesen der technischen Offenbarung schnell zu verstehen. Sie wird mit dem Verständnis eingereicht, dass sie nicht benutzt wird, um den Schutzbereich oder die Bedeutung der Ansprüche zu interpretieren oder einzuschränken. Ferner können in der obigen detaillierten Beschreibung verschiedene Merkmale zu einer Gruppe zusammengefasst werden, um die Offenbarung zu vereinheitlichen. Dies soll nicht so ausgelegt werden, als ob beabsichtigt ist, dass ein nicht beanspruchtes, offenbartes Merkmal für einen Anspruch wesentlich ist. Im Gegenteil, der erfinderische Gegenstand kann in weniger als allen Merkmalen eines bestimmten offenbarten Ausführungsbeispiels liegen. Somit sind die folgenden Ansprüche hiermit in die detaillierte Beschreibung aufgenommen, wobei jeder Anspruch als getrenntes Ausführungsbeispiel für sich steht, und es wird in Erwägung gezogen, dass solche Ausführungsbeispiele miteinander in verschiedenen Kombinationen oder Permutationen kombiniert werden können. Der Schutzbereich der Erfindung sollte Bezug nehmend auf die beigefügten Ansprüche bestimmt werden, zusammen mit dem vollständigen Schutzbereich von Entsprechungen, auf welche solche Ansprüche Anrecht haben.
Claims (25)
- Ein mikroelektronisches Bauelement, umfassend: einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander, wobei der zweite Abstand geringer ist als der erste Abstand; eine Redistributionsschicht mit einer ersten Seite, die mit dem ersten Halbleiter-Die gekoppelt ist; und einen zweiten Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die, wobei das zweite Halbleiterbauelement eine dritte Gruppe von Kontakten in dem zweiten Abstand umfasst, wobei die Kontakte der dritten Gruppe von Kontakten mit jeweiligen Kontakten der zweiten Gruppe von Kontakten gekoppelt sind.
- Das mikroelektronische Bauelement gemäß
Anspruch 1 , wobei das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst. - Das mikroelektronische Bauelement gemäß
Anspruch 2 , wobei der zusätzliche Kontakt mit einem Kontakt der Redistributionsschicht gekoppelt ist, der außerhalb eines Fußabdrucks des ersten Halbleiter-Dies ist. - Das mikroelektronische Bauelement gemäß
Anspruch 1 , wobei zumindest eine von der ersten und zweiten Gruppe von Kontakten ein Array von Kontakten umfasst, das sich entlang sowohl der X- als auch der Y-Abmessungen des ersten Halbleiter-Dies erstreckt. - Das mikroelektronische Bauelement gemäß
Anspruch 1 , wobei die Redistributionsschicht zumindest einige Kontakte der ersten Gruppe von Kontakten mit jeweiligen Stellen außerhalb eines Fußabdrucks des ersten Halbleiter-Dies koppelt. - Das mikroelektronische Bauelement gemäß
Anspruch 1 , ferner umfassend eine Formstruktur, die die Redistributionsschicht stützt und den ersten Halbleiter-Die kapselt. - Das mikroelektronische Bauelement gemäß
Anspruch 1 , wobei die Redistributionsschicht mehrere Ebenen von leitfähigen Leiterbahnen umfasst. - Das mikroelektronische Bauelement gemäß einem der
Ansprüche 1 -7 , wobei die Redistributionsschicht Kontaktkugeln umfasst, und wobei zumindest ein Abschnitt der Kontakte der ersten Gruppe von Kontakten durch die Redistributionsschicht mit jeweiligen Kontaktkugeln lateral über die lateralen Abmessungen des ersten Halbleiter-Dies hinaus verbunden ist. - Das mikroelektronische Bauelement gemäß
Anspruch 8 , wobei die Kontaktkugeln sich auf der gleichen Seite der Redistributionsschicht befinden wie der zweite Halbleiter-Die. - Das mikroelektronische Bauelement gemäß
Anspruch 1 , wobei der zweite Halbleiter-Die zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und wobei der zumindest eine zusätzliche Kontakt mit einem Kontakt in der Redistributionsschicht gekoppelt ist. - Das mikroelektronische Bauelement gemäß einem der
Ansprüche 1 , wobei die Kontakte der zweiten Gruppe von Kontakten mit jeweiligen Kontakten der dritten Gruppe von Kontakten durch Kupfersäulen gekoppelt sind, die auf jedem von dem ersten und zweiten Halbleiter-Die gebildet sind. - Das mikroelektronische Bauelement gemäß einem der
Ansprüche 1 -7 , wobei der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 70 % des Abstands der ersten Gruppe von Kontakten. - Das mikroelektronische Bauelement gemäß einem der
Ansprüche 1 -7 , wobei der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 50 % des Abstands der ersten Gruppe von Kontakten. - Das mikroelektronische Bauelement gemäß einem der
Ansprüche 1 -7 , ferner umfassend ein Mittel zum Koppeln der dritten Gruppe von Kontakten des zweiten Halbleiter-Dies mit jeweiligen Kontakten des zweiten Halbleiter-Dies. - Das mikroelektronische Bauelement gemäß
Anspruch 14 , wobei das Mittel zum Koppeln der dritten Gruppe von Kontakten des zweiten Halbleiter-Dies mit jeweiligen Kontakten des zweiten Halbleiter-Dies Kupfersäulen auf den Kontakten von zumindest einer von der zweiten und dritten Gruppe von Kontakten umfasst. - Das mikroelektronische Bauelement gemäß
Anspruch 15 , wobei Kontakte von sowohl der zweiten als auch der dritten Menge von Kontakten Kupfersäulen umfassen. - Ein Verfahren zum Bilden eines mikroelektronischen Bauelementgehäuses, umfassend: Bilden einer Formstruktur über einem ersten Halbleiter-Die, wobei der Die eine erste und zweite Gruppe von Kontakten umfasst, wobei die Kontakte von jeder von der ersten und zweiten Gruppe von Kontakten entsprechend in ersten oder zweiten Abständen angeordnet sind, und wobei die Kontakte der zweiten Gruppe in einem feineren Abstand sind als die Kontakte der ersten Gruppe; Bilden einer Redistributionsschicht über dem ersten Halbleiter-Die und zumindest einem Abschnitt der Formstruktur; und Koppeln eines zweiten Halbleiter-Dies mit dem ersten Halbleiter-Die, wobei der zweite Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die ist, wobei der zweite Halbleiter-Die eine dritte Gruppe von Kontakten umfasst, die in dem gleichen Abstand angeordnet sind wie die Kontakte der zweiten Gruppe, und wobei der zweite Halbleiter-Die mit dem ersten Halbleiter-Die zumindest teilweise durch Bonden von Kontakten der dritten Gruppe mit jeweiligen Kontakten der zweiten Gruppe gekoppelt ist.
- Das Verfahren gemäß
Anspruch 17 , wobei das Bonden von Kontakten der dritten Gruppe mit jeweiligen Kontakten der zweiten Gruppe ein Zusammenbonden von Kupfersäulen umfasst, die auf sowohl den Kontakten der zweiten Gruppe als auch den Kontakten der dritten Gruppe gebildet sind. - Das Verfahren gemäß
Anspruch 18 , wobei der zweite Halbleiter-Die zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst, und wobei der zusätzliche Kontakt mit einem Kontakt auf der Redistributionsschicht gebondet wird. - Das Verfahren gemäß
Ansprüche 17 , wobei der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 70 % des Abstands der ersten Gruppe von Kontakten. - Das Verfahren gemäß
Ansprüche 17 , wobei der Abstand der zweiten Gruppe von Kontakten nicht mehr ist als ungefähr 50 % des Abstands der ersten Gruppe von Kontakten. - Das Verfahren gemäß
Anspruch 17 , wobei das Gehäuse ein Fan-Out-Gehäuse ist. - Ein elektronisches System, umfassend: ein mikroelektronisches Bauelement, umfassend einen ersten Halbleiter-Die mit einer ersten Gruppe von Kontakten in einem ersten Abstand relativ zueinander, und einer zweiten Gruppe von Kontakten in einem zweiten Abstand relativ zueinander, wobei der zweite Abstand geringer ist als der erste Abstand; eine Redistributionsschicht mit einer ersten Seite, die mit dem ersten Halbleiter-Die gekoppelt ist; und einen zweiten Halbleiter-Die auf der gegenüberliegenden Seite der Redistributionsschicht von dem ersten Halbleiter-Die und in teilweise überlappendem Verhältnis zu dem ersten Halbleiter-Die, wobei das zweite Halbleiterbauelement eine dritte Gruppe von Kontakten in dem zweiten Abstand umfasst, wobei die Kontakte der dritten Gruppe von Kontakten mit jeweiligen Kontakten der zweiten Gruppe von Kontakten gekoppelt sind; und zumindest eines von einer Massenspeichervorrichtung und einer Netzwerkschnittstelle, die wirksam mit dem mikroelektronischen Bauelement gekoppelt.
- Das elektronischen System gemäß
Anspruch 23 , wobei das zweite Halbleiterbauelement ferner zumindest einen zusätzlichen Kontakt außerhalb der dritten Gruppe von Kontakten umfasst. - Das elektronische System gemäß
Anspruch 24 , wobei der zusätzliche Kontakt mit einem Kontakt in der Redistributionsschicht gekoppelt ist.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US15/282,855 | 2016-09-30 | ||
US15/282,855 US10366968B2 (en) | 2016-09-30 | 2016-09-30 | Interconnect structure for a microelectronic device |
PCT/US2017/046027 WO2018063512A1 (en) | 2016-09-30 | 2017-08-09 | Interconnect structure for a microelectronic device |
Publications (1)
Publication Number | Publication Date |
---|---|
DE112017004978T5 true DE112017004978T5 (de) | 2019-06-13 |
Family
ID=61758342
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112017004978.4T Pending DE112017004978T5 (de) | 2016-09-30 | 2017-08-09 | Zwischenverbindungsstruktur für ein mikroelektronisches bauelement |
Country Status (5)
Country | Link |
---|---|
US (2) | US10366968B2 (de) |
KR (1) | KR102617627B1 (de) |
CN (1) | CN109643708A (de) |
DE (1) | DE112017004978T5 (de) |
WO (1) | WO2018063512A1 (de) |
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---|---|---|---|---|
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2016
- 2016-09-30 US US15/282,855 patent/US10366968B2/en active Active
-
2017
- 2017-08-09 CN CN201780053467.4A patent/CN109643708A/zh active Pending
- 2017-08-09 WO PCT/US2017/046027 patent/WO2018063512A1/en active Application Filing
- 2017-08-09 DE DE112017004978.4T patent/DE112017004978T5/de active Pending
- 2017-08-09 KR KR1020197006012A patent/KR102617627B1/ko active IP Right Grant
-
2019
- 2019-07-08 US US16/505,307 patent/US20190333886A1/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
CN109643708A (zh) | 2019-04-16 |
KR20190050777A (ko) | 2019-05-13 |
KR102617627B1 (ko) | 2023-12-27 |
US20190333886A1 (en) | 2019-10-31 |
US10366968B2 (en) | 2019-07-30 |
US20180096970A1 (en) | 2018-04-05 |
WO2018063512A1 (en) | 2018-04-05 |
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