DE10314152B4 - Herstellung von dielektrischen Zwischenschichtfilmen mit einem niedrigen K-Wert unter Verwendung von Si-haltigen Resists - Google Patents
Herstellung von dielektrischen Zwischenschichtfilmen mit einem niedrigen K-Wert unter Verwendung von Si-haltigen Resists Download PDFInfo
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- 239000011229 interlayer Substances 0.000 title claims abstract description 20
- 239000010410 layer Substances 0.000 claims abstract description 65
- 238000000034 method Methods 0.000 claims abstract description 29
- 229910052751 metal Inorganic materials 0.000 claims abstract description 25
- 239000002184 metal Substances 0.000 claims abstract description 25
- 239000006117 anti-reflective coating Substances 0.000 claims abstract description 17
- 239000011248 coating agent Substances 0.000 claims abstract description 16
- 238000000576 coating method Methods 0.000 claims abstract description 16
- 238000000151 deposition Methods 0.000 claims abstract description 13
- 238000000206 photolithography Methods 0.000 claims abstract description 12
- 239000004065 semiconductor Substances 0.000 claims abstract description 11
- 231100000572 poisoning Toxicity 0.000 claims abstract description 9
- 230000000607 poisoning effect Effects 0.000 claims abstract description 9
- 230000000694 effects Effects 0.000 claims abstract description 8
- 238000006884 silylation reaction Methods 0.000 claims abstract description 8
- 230000001590 oxidative effect Effects 0.000 claims abstract description 3
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 claims description 6
- 239000010937 tungsten Substances 0.000 claims description 6
- 229910052721 tungsten Inorganic materials 0.000 claims description 5
- 238000002955 isolation Methods 0.000 claims description 4
- 239000000126 substance Substances 0.000 claims description 4
- 229910052782 aluminium Inorganic materials 0.000 claims description 3
- 229910052802 copper Inorganic materials 0.000 claims description 3
- 239000010949 copper Substances 0.000 claims description 3
- 238000004519 manufacturing process Methods 0.000 claims description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 2
- 239000004642 Polyimide Substances 0.000 claims description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims description 2
- 229920001721 polyimide Polymers 0.000 claims description 2
- FGUUSXIOTUKUDN-IBGZPJMESA-N C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 Chemical compound C1(=CC=CC=C1)N1C2=C(NC([C@H](C1)NC=1OC(=NN=1)C1=CC=CC=C1)=O)C=CC=C2 FGUUSXIOTUKUDN-IBGZPJMESA-N 0.000 claims 2
- 230000003647 oxidation Effects 0.000 claims 2
- 238000007254 oxidation reaction Methods 0.000 claims 2
- 238000010438 heat treatment Methods 0.000 claims 1
- NEXSMEBSBIABKL-UHFFFAOYSA-N hexamethyldisilane Chemical compound C[Si](C)(C)[Si](C)(C)C NEXSMEBSBIABKL-UHFFFAOYSA-N 0.000 claims 1
- 239000000463 material Substances 0.000 description 25
- 229920002120 photoresistant polymer Polymers 0.000 description 12
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 9
- 229910052710 silicon Inorganic materials 0.000 description 9
- 239000010703 silicon Substances 0.000 description 9
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 6
- 239000003989 dielectric material Substances 0.000 description 6
- 125000006850 spacer group Chemical group 0.000 description 6
- 239000000758 substrate Substances 0.000 description 6
- FFUAGWLWBBFQJT-UHFFFAOYSA-N hexamethyldisilazane Chemical compound C[Si](C)(C)N[Si](C)(C)C FFUAGWLWBBFQJT-UHFFFAOYSA-N 0.000 description 5
- 229910004298 SiO 2 Inorganic materials 0.000 description 4
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 239000012212 insulator Substances 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- 238000001465 metallisation Methods 0.000 description 3
- 238000000059 patterning Methods 0.000 description 3
- 229920000642 polymer Polymers 0.000 description 3
- 239000011241 protective layer Substances 0.000 description 3
- 230000005855 radiation Effects 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- 230000004888 barrier function Effects 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000011109 contamination Methods 0.000 description 2
- 238000010894 electron beam technology Methods 0.000 description 2
- 230000009969 flowable effect Effects 0.000 description 2
- 235000012239 silicon dioxide Nutrition 0.000 description 2
- 239000000377 silicon dioxide Substances 0.000 description 2
- 229910052814 silicon oxide Inorganic materials 0.000 description 2
- 206010001513 AIDS related complex Diseases 0.000 description 1
- 229910000838 Al alloy Inorganic materials 0.000 description 1
- 102100022717 Atypical chemokine receptor 1 Human genes 0.000 description 1
- LSNNMFCWUKXFEE-UHFFFAOYSA-M Bisulfite Chemical compound OS([O-])=O LSNNMFCWUKXFEE-UHFFFAOYSA-M 0.000 description 1
- 101000678879 Homo sapiens Atypical chemokine receptor 1 Proteins 0.000 description 1
- 206010034972 Photosensitivity reaction Diseases 0.000 description 1
- 229910001080 W alloy Inorganic materials 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 238000007171 acid catalysis Methods 0.000 description 1
- 210000002945 adventitial reticular cell Anatomy 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000004140 cleaning Methods 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000000609 electron-beam lithography Methods 0.000 description 1
- 238000011049 filling Methods 0.000 description 1
- 238000010304 firing Methods 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 238000003384 imaging method Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 239000012044 organic layer Substances 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 238000006552 photochemical reaction Methods 0.000 description 1
- 230000036211 photosensitivity Effects 0.000 description 1
- 239000002952 polymeric resin Substances 0.000 description 1
- 239000002689 soil Substances 0.000 description 1
- 239000002904 solvent Substances 0.000 description 1
- 229920003002 synthetic resin Polymers 0.000 description 1
- 238000007669 thermal treatment Methods 0.000 description 1
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
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- H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
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- H01L21/02203—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being porous
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- H01L21/02304—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer pre-treatment formation of intermediate layers, e.g. buffer layers, layers to improve adhesion, lattice match or diffusion barriers
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- H01L21/02321—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer
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Abstract
Verfahren
zum Herstellen eines dielektrischen Zwischenschichtfilms mit einem
niedrigen k-Wert in einer Verbindungsstruktur auf einem Halbleiterkörper, um
den Effekt der Vergiftung von Resist zu verhindern, mit den Schritten:
a) Bereitstellen einer ersten Zwischenschichtdielektrikum-Struktur (10) wobei die erste Zwischenschichtdielektrikum-Struktur (10) eine darin eingebettete Metallleitung (11) umfasst;
b) Abscheiden einer Schicht aus Antireflexbeschichtung (12) über der ersten Zwischenschichtdielektrikum-Struktur (10) und der eingebetteten Metallleitung (11);
c) Abscheiden einer Si-haltigen Resistbeschichtung (13) auf der Schicht aus Antireflexbeschichtung (12);
d) anschließend Ausführen einer Photolithographie, um die Si-haltige Resistbeschichtung (13) zu strukturieren und ein Kontaktloch (14) bereitzustellen;
e) Ausführen einer Silylierung der Si-haltigen Resistbeschichtung (13), um durch Erhöhen des Si-Gehalts in der Resistbeschichtung (13) einen strukturierten Si-reichen Film (16) zu erhalten;
f) Oxidieren des strukturierten Si-reichen Films (16), um ihn in ein zweites strukturiertes poröses dielektrisches Zwischenschichtdielektrikum mit einem niedrigen k-Wert (17), zu konvertieren, wobei das zweite Zwischenschichtdielektrikum (17) eine...
a) Bereitstellen einer ersten Zwischenschichtdielektrikum-Struktur (10) wobei die erste Zwischenschichtdielektrikum-Struktur (10) eine darin eingebettete Metallleitung (11) umfasst;
b) Abscheiden einer Schicht aus Antireflexbeschichtung (12) über der ersten Zwischenschichtdielektrikum-Struktur (10) und der eingebetteten Metallleitung (11);
c) Abscheiden einer Si-haltigen Resistbeschichtung (13) auf der Schicht aus Antireflexbeschichtung (12);
d) anschließend Ausführen einer Photolithographie, um die Si-haltige Resistbeschichtung (13) zu strukturieren und ein Kontaktloch (14) bereitzustellen;
e) Ausführen einer Silylierung der Si-haltigen Resistbeschichtung (13), um durch Erhöhen des Si-Gehalts in der Resistbeschichtung (13) einen strukturierten Si-reichen Film (16) zu erhalten;
f) Oxidieren des strukturierten Si-reichen Films (16), um ihn in ein zweites strukturiertes poröses dielektrisches Zwischenschichtdielektrikum mit einem niedrigen k-Wert (17), zu konvertieren, wobei das zweite Zwischenschichtdielektrikum (17) eine...
Description
- HINTERGRUND DER ERFINDUNG
- Erfindungsgebiet
- Die Erfindung betrifft ein Verfahren zur Bereitstellung von abgeschiedenen Filmen aus Dielektrika mit einem niedrigen k-Wert in Kombination mit Photolithographie unter Verwendung von Si-haltigen Resists, um den Effekt von Vergiftung zu vermeiden, der herkömmlicherweise auftritt, wenn Photolithographie bei herkömmlichen Materialien mit einem niedrigen k-Wert verwendet wird.
- Integrierte Schaltungen bestehen aus einer Vielzahl von aktiven und passiven Bauelementen, zu denen Transistoren, Kondensatoren und Widerstände zählen, und diese Bauelemente sind anfangs voneinander getrennt beziehungsweise isoliert und werden später miteinander verbunden, um durch Verbindungsstrukturen funktionelle Schaltungen zu bilden. Die Qualität dieser Verbindungsstrukturen beeinflusst die Leistung und Zuverlässigkeit der Schaltungen wesentlich, und in steigendem Maße bestimmen Verbindungen die Grenzen der Leistung sowie die Dichte von ultrahöchst integrierten Schaltungen (ULSI).
- Bei herkömmlichen Verbindungsstrukturen werden eine oder mehrere Metallschichten verwendet, und jede Metallschicht ist im allgemein aus Wolfram- oder Aluminiumlegierungen hergestellt. Bei diesen Verbindungsstrukturen werden Dielektrika zwischen Ebenen und innerhalb einer Ebene (ILDs), in der Regel Siliziumdioxid (SiO2), dazu verwendet, die aktiven Elemente und verschiedene Verbindungssignalwege elektrisch voneinander zu isolieren. Bei diesen Verbindungsstrukturen werden zudem elektrische Verbindungen zwischen verschiedenen Verbindungsebenen allgemein durch in den ILD-Schichten ausgebildete Verbindungskontakte oder Löcher hergestellt. Diese Verbindungskontakte sind in der Regel mit einem Metall, wie etwa Wolfram, gefüllt.
- Jüngst wurde ein großes Interesse daran gezeigt, bei diesen Verbindungsstrukturen SiO2 durch Materialien mit einer geringen Dielektrizitätskonstante (niedriger k-Wert) als ILD zu ersetzen. Diese Materialien mit einem niedrigen k-Wert dienen in Verbindungsstrukturen von integrierten Schaltungen (IC) als Isolatoren, da sie die Verbindungskapazität reduzieren. Diese einen niedrigen k-Wert aufweisenden Materialien erhöhen als solche in der Regel die Signalausbreitungsgeschwindigkeit und reduzieren dabei gleichzeitig auch das Nebensprechrauschen und die Verlustleistung in der Verbindungsstruktur.
- Dennoch erfordert die Verwendung von Materialien mit einem niedrigen k-Wert als ILD in der Verbindungsstruktur immer noch die Verwendung von Prozessen, bei denen gelegentlich technische Schwierigkeiten auftreten. Beispielsweise bietet die Photolithographie auf herkömmlichen Materialien mit einem niedrigen k-Wert wegen des Effekts von Vergiftungen der Resists oder anderer, die Integrierung betreffender Probleme, immer Herausforderungen.
- Ein chemisch verstärkter Resist für die Elektronenstrahllithographie ist aus der US 6,171,755 B1 bekannt. Beim Prozeß zum Herstellen eines chemisch verstärkten Resists wird ein Substrat, das mit einem Bodenresist im voraus beschichtet sein kann, mit einem chemisch verstärkten Resist beschichtet, der aufweist:
ein Polymer mit lösungsblockierenden Gruppen, die mit Säurekatalyse gespaltet werden können,
eine photoreaktive Verbindung, die bei Bestrahlung mit Elektronen eine Sulfonsäure mit einem pKa-Wert ≤ 2,5 (Photo Acid Generator),
einen elektronenstrahlempfindlichen Sensibilisator, der die Belichtungsempfindlichkeit des Resists verstärkt, wobei der Sensibilisator die Struktur wobei R1 = OH oder OR, R2 = COOR, wobei R = C1- bis C5-Alkyl ist; und
ein Lösungsmittel, getrocknet, mit einem Elektronenstrahl bestrahlt und einer Temperaturbehandlung (PEB) und einer Naßentwicklung unterzogen, gegebenenfalls gefolgt von einer Silylierung und Trockenentwicklung des Bodenresists. - Ein Verfahren zum Verhindern einer Vergiftung eines Photoresist von einer dielektrischen Antireflexbeschichtung bei der Halbleiterherstellung ist aus dem US-Patent 6,103,456 bekannt. Der Prozeß beinhaltet:
Bereitstellen einer dielektrischen Isolationsschicht auf einer Oberfläche eines Halbleitersubstrats mit einer in einem selektiven Gebiet darauf angeordneten ersten leitenden Schicht, so daß die Isolationsschicht über dem Gebiet der ersten leitenden Schicht liegt;
Bereitstellen einer Siliziumoxynitridschicht auf der Isolationsschicht zur Ausbildung einer dielektrischen Antireflexbeschichtung darauf;
Bereitstellen einer reaktiven stickstofffreien dielektrischen Abstandsschicht (Spacerschicht) auf der Antireflexbeschichtungsschicht aus Siliziumoxynitrid, um den Transport reaktiven Stickstoffs dort hindurch von der Siliziumoxynitridschicht aus zu verhindern;
Bereitstellen einer Photoresistschicht auf der dielektrischen Abstandsschicht;
selektives Belichten und Entwickeln der Photoresistschicht, um selektive Strukturteile der darunter liegenden dielektrischen Abstandsschicht freizulegen, wobei die Strukturteile sich in einer übereinander liegenden Beziehung zum Gebiet der ersten leitenden Schicht im Substrat befinden;
Entfernen der freigelegten Strukturteile der dielektrischen Abstandsschicht und entsprechender darunter liegender Teile der Siliziumoxynitridschicht zum Freilegen entsprechender Teile der darunter liegenden Isolationsschicht und
Entfernen der freigelegten Teile der Isolationsschicht, um entsprechende Teile des Gebiets der ersten leitenden Schicht im Substrat freizulegen. - Die US 6,187,672 A offenbart ein Verfahren zum Ausbilden von Verbindungsstrukturen und eines Halbleiterkörpers, das folgendes umfaßt:
- (a) Abscheiden einer ersten Metallschicht auf einem Halbleiterkörper;
- (b) Abscheiden einer Opferschicht auf der ersten Metallschicht, wobei die Opferschicht eine Höhe aufweist;
- (c) Strukturieren der Opferschicht und der ersten Metall schicht, um getrennte Metalleitungen mit einer Opferschichtkappe auf den Metalleitungen auszubilden;
- (d) Abscheiden eines Materials mit einem niedrigen k-Wert, um Lücken zwischen den Metalleitungen zu füllen und die Opferschicht zu bedecken;
- (e) Entfernen des Materials mit einem niedrigen k-Wert bis auf eine Ebene innerhalb der Höhe der Opferschicht;
- (f) Entfernen der Opferschicht;
- (g) Abscheiden einer Schutzschicht, um die Metalleitungen und das Material mit einem niedrigen k-Wert zu bedecken;
- (h) Abscheiden eines Isolators auf der Schutzschicht; Abscheiden und Strukturieren einer Photoresistschicht auf dem Isolator;
- (i) Erzeugen von Verbindungskontakten im Isolator;
- (j) Durchführen einer Photoresistablösung;
- (k) Durchführen einer Reinigung der Anordnung und
- (l) selektives Ätzen der Schutzschicht unter Verwendung einer anisotropen Ätzung, die so konfiguriert ist, daß auf einem vertikalen Teil des Materials mit einem niedrigen k-Wert in den Verbindungskontakten ein Abstandshalter zurückbleibt.
- In der US 5,960,311 A wird beim Ausbilden einer integrierten Schaltung ein Verfahren zum Ausbilden gesteuerter Hohlräume in Zwischenebenendielektrika eingesetzt. Das Verfahren umfaßt:
Ausbilden einer Isolationsschicht über einer Oberfläche einer halbleitenden Oberfläche eines Körpers;
Planarisieren der Isolationsschicht;
Ausbilden einer Metallisierungsschicht über der Isolationsschicht;
Strukturieren der Metallisierungsschicht, um mehrere Metallsignalleitungen auszubilden;
Ausbilden eines ersten konformen Zwischenebenendielektrikums über der Metallisierungsschicht und über der Isolationsschicht, um im ersten konformen Zwischenebenendielektrikum zwischen mindestens einigen benachbarten Metallsignalleitungen abgedichtete Hohlräume auszubilden;
Entfernen eines oberen Teils des ersten konformen Zwischenebenendielektrikums, um eine planare Deckoberfläche zu erzielen, wodurch eine erste Gruppe von Hohlräumen an der planaren Deckoberfläche freigelegt und eine zweite Gruppe von Hohlräumen in einer Tiefe unter der planaren Deckoberfläche beibehalten wird;
Abscheiden eines ersten fließfähigen Dielektrikums auf der planaren Deckoberfläche des ersten konformen Zwischenebenendielektrikums, das die erste Gruppe von Hohlräumen füllt; und Ausbilden eines zweiten konformen Zwischenebenendielektrikums über dem ersten fließfähigen Dielektrikum. - Wenn dielektrische Zwischenschichtmaterialien mit einem niedrigen k-Wert in Kombination mit Photolithographie bereitgestellt werden, besteht eine Notwendigkeit darin, Effekte der Vergiftung des Resist zu verhindern oder wesentlich zu verringern und andere, die Integrierung betreffende Probleme zu vermeiden sowie den Prozeß zu vereinfachen und gleichzeitig geringere Kosten zu erzielen, als wenn herkömmliche Abscheidungsverfahren für Zwischenschichtdielektrika mit einem niedrigen k-Wert verwendet werden.
-
US 6,348,407 B1 beschreibt ein Verfahren zur Bildung einer Struktur mit zwei Zwischenschichten, insbesondere ein Verfahren zur Vermeidung eines Haftproblems an der Grenzfläche zwischen einem Material mit einem niedrigen k-Wert und einer auf TEOS-basierenden Ätzstoppschicht. Ein erstes Material mit einem niedrigen k-Wert ist auf einem Substrat angeordnet, das mehrere isolierende oder leitende Schichten enthalten kann. Auf dem ersten Material wird ein siliziumhaltiger TSI (Top Surface Imaging) Resistfilm abgeschieden. Der Resist wird dann durch Silylierung und einem Sauerstoffplasmaprozess in einen siliziumreichen Siliziumoxidfilm konvertiert, wobei die Silylierung unter Verwendung von HMDS (Hexamethyldisilazan) durchgeführt wird. Anschließend wird ein zweites Material mit einem niedrigen k-Wert auf der siliziumreichen Siliziumoxidhaftschicht abgeschieden. Dann werden Vias ausgebildet, wobei der siliziumreiche Film zur Strukturierung des ersten Materials verwendet wird. -
US 6,107,177 A beschreibt ein Verfahren zur Bildung einer Struktur mit zwei Zwischenschichten. GemäßUS 6,107,177 A wird eine dielektrische Schicht mit einer darauf ausgebildeten Antireflexionsschicht und einer auf der Antireflexionsschicht angeordneten strukturierten Resistschicht vorgesehen. Die Resistschicht wird einer siliziumhaltigen Substanz ausgesetzt, wodurch silylierte Bereiche auf freigelegten Bereichen der Resistschicht entstehen. Die silylierten Bereiche können eine Tiefe von etwa 1 nm bis etwa 100 nm aufweisen. In weiteren Prozessschritten werden die silylierten Bereiche als Ätzmaske zur selektiven Ätzung der Antireflexionsbeschichtung und der dielektrischen Schicht verwendet. - Kurze Darstellung der Erfindung
- Eine Aufgabe der vorliegenden Erfindung besteht in der Bereitstellung eines Prozesses zum Herstellen von abgeschiedenen Filmen aus einem Zwischenschichtdielektrikum mit einem niedrigen k-Wert unter gleichzeitiger Vermeidung einer Verunreinigung oder Vergiftung von Resist, wenn Materialien mit einem niedrigen k-Wert verwendet werden.
- Eine weitere Aufgabe der vorliegenden Erfindung besteht in der Bereitstellung eines Verfahrens zum Herstellen von abgeschiedenen Filmen aus Zwischenschichtdielektrika mit einem niedrigen k-Wert in Kombination mit Photolithographie zum Reduzieren der Verunreinigung von Resist durch Einsatz eines Si-haltigen Resists.
- Die Erfindung wird allgemein erreicht durch ein Verfahren gemäß Patentanspruch 1.
- Kurze Beschreibung der Zeichnungen
-
1 zeigt den Prozeßfluß zum Herstellen eines dielektrischen Zwischenschichtoxidfilms mit einem niedrigen k-Wert unter Verwendung eines Si-haltigen Resists, wobei -
1A ein Zwischenschichtdielektrikum (ILD) mit einer darin eingebetteten oder strukturierten Metalleitung zeigt; -
1B einen Schritt zeigt, bei dem eine ARC-Beschichtung auf der Struktur von1A abgeschieden ist; -
1C den Schritt des Abscheidens einer Si-haltigen Resistbeschichtung auf der Struktur von1B zeigt; -
1D den Schritt zeigt, die Struktur von1C Photolithographie auszusetzen; -
1E den Schritt zeigt, die Struktur von1D einer Silylierung auszusetzen, die naß oder trocken sein kann; -
1F den Schritt des Oxidierens der Struktur von1E zeigt, um einen dielektrischen Oxidfilm mit einem niedrigen k-Wert zu erhalten; und -
1G den Schritt zeigt, die Öffnung der Antireflexbeschichtung auf der Struktur von1F zu bewirken. - AUSFÜHRLICHE BESCHREIBUNG EINER BEVORZUGTEN AUSFÜHRUNGSFORM DER ERFINDUNG
- Die Halbleiterphotolithographie beinhaltet allgemein eine Folge von Prozessen, bei der eine Photoresistschicht auf einen Halbleiterwafer aufgetragen wird, danach die Photore- sistschicht mit Strahlung in einer Struktur belichtet wird, die einer gewünschten Halbleiterverarbeitungsstruktur entspricht. Danach wird der belichtete Photoresist verarbeitet, um einen Strukturbarrierefilm für die nachfolgende Waferverarbeitung zu bilden. Photoresistfilme bestanden in der Vergangenheit aus einem Polymerharz, das zusätzliche optionale Komponenten enthalten konnte. Der Photoresistfilm auf Polymerbasis wurde mit Strahlung bearbeitet, um in lokalisierten Gebieten des Films photochemische Reaktionen zu induzieren, die einer Struktur der Strahlung entsprechen, und diese selektiven Reaktionen ermöglichten einen präzisen optisch basierten Mechanismus zum Erzeugen einer gewünschten Barrierestruktur in einem Photoresistfilm.
- In jüngerer Zeit werden bei verbindungsartigen Strukturen, die eine oder mehrere Metalleitungen oder -schichten verwenden, wobei jede Metalleitung oder -schicht aus Aluminium, Kupfer oder Wolfram hergestellt ist, Zwischenebenendielektrika (ILDs), wie etwa Siliziumdioxid (SiO2) oder Tetraethylorthosilikat (TEOS) dazu verwendet, aktive Elemente und ver- schiedene Verbindungssignalwege elektrisch voneinander zu isolieren. Die elektrischen Verbindungen zwischen verschiedenen Verbindungsebenen erfolgen normalerweise durch in den ILD-Schichten ausgebildete Verbindungskontakte, wonach die Verbindungskontakte dann mit einem Metall, wie etwa Wolfram, gefüllt werden. Das jüngste große Interesse daran, SiO2 als das ILD in der Verbindungsstruktur durch Materialien mit einer niedrigen Dielektrizitätskonstante (niedrigem k-Wert) zu ersetzen, ist in großem Maße auf die Tatsache zurückzuführen, daß diese Materialien mit einem niedrigen k-Wert Isolatoren sind und die Verbindungskapazität reduzieren. Durch das Reduzieren der Verbindungskapazität steigern diese Materialien mit einem niedrigen k-Wert die Signalausbreitungsgeschwindigkeit und reduzieren gleichzeitig das Nebensprechrauschen und die Verlustleistung in der Verbindung.
- Die Photolithographie auf herkömmlichen Materialien mit einem niedrigen k-Wert liefert jedoch aufgrund des Effekts der Vergiftung von Resist sowie anderer, die Integration betreffender Probleme signifikante Herausforderungen.
- Der Erfindungsprozeß kann den Effekt der Vergiftung von Resist sowie andere, die Integration betreffende Probleme überwinden, indem er Si-haltige Resists verwendet.
- In diesem Zusammenhang wird nun auf
1A Bezug genommen, die einen Teil einer Halbleiterstruktur10 darstellt, die eine in die Struktur eingebettete oder strukturierte Metalleitung11 umfaßt. Bei der Metalleitung kann es sich um Al, Cu oder Wolfram handeln. Wie aus1B zu erkennen ist, ist über dem Substrat und der Metalleitung eine Schicht12 aus Antireflexbeschichtung (ARC) abgeschieden, um die Lichtreflexion zurück zum abzuscheidenden Photoresist zu minimieren. Bei der Antireflexbeschichtungsschicht kann es sich um ein Licht absorbierendes Polymer wie etwa Polyimid handeln. Als nächstes wird, wie man aus1C sehen kann, auf der ARC-Schicht12 eine Si-haltige Resistbeschichtung13 abgeschieden, gefolgt von dem Ausführen einer herkömmlichen Photolithographie zur Ausbildung eines Kontaktlochs oder einer Öffnung14 , wie in1D gezeigt, wobei die ARC-Beschichtung als ein Ätzstopp15 dient. - Nach dem Photolithographieprozeß in
1D wird entweder mit nassen Chemikalien, wie H2N-Siloxan-NH2 oder Gasen wie Hexamethyldisilazan (HMDS) eine Silylierung bewirkt, um den Si-Gehalt im Resistfilm zu erhöhen oder um einen optimalen Si-Gehalt im Resistfilm zu erhalten, wie in1F gezeigt. Der Si-reiche Film16 von1E wird durch ein O2-Plasma oder durch Brennen im Ofen in reines Oxid konvertiert, um einen dielektrischen Oxidfilm17 mit einem niedrigen k-Wert zu bilden, wie in1F gezeigt. Die Ausbildung des dielektrischen Oxidfilms mit einem niedrigen k-Wert kann entweder nach der DARC-(Dielektrischer ARC)-Öffnung oder vor der ARC-Öffnung erfolgen. Die Ausbildung der ARC-Öffnung entfernt die Antireflexbeschichtungsschicht12 , um die Länge des Kontaktlochs oder der Öffnung18 zu vergrößern, wie in1G gezeigt. Aufgrund des porösen Charakters des gebildeten Oxids erhält man einen Film mit einem niedrigen k-Wert. - Wenngleich die Erfindung unter Bezugnahme auf dielektrische Zwischenschichtfilme in einer Verbindungsstruktur auf einem Halbleiterkörper beschrieben worden ist, versteht es sich, daß durch diesen Prozeß auch Strukturen gebildet werden können, in denen sich eine organische Schicht ohne ARCs befindet.
Claims (8)
- Verfahren zum Herstellen eines dielektrischen Zwischenschichtfilms mit einem niedrigen k-Wert in einer Verbindungsstruktur auf einem Halbleiterkörper, um den Effekt der Vergiftung von Resist zu verhindern, mit den Schritten: a) Bereitstellen einer ersten Zwischenschichtdielektrikum-Struktur (
10 ) wobei die erste Zwischenschichtdielektrikum-Struktur (10 ) eine darin eingebettete Metallleitung (11 ) umfasst; b) Abscheiden einer Schicht aus Antireflexbeschichtung (12 ) über der ersten Zwischenschichtdielektrikum-Struktur (10 ) und der eingebetteten Metallleitung (11 ); c) Abscheiden einer Si-haltigen Resistbeschichtung (13 ) auf der Schicht aus Antireflexbeschichtung (12 ); d) anschließend Ausführen einer Photolithographie, um die Si-haltige Resistbeschichtung (13 ) zu strukturieren und ein Kontaktloch (14 ) bereitzustellen; e) Ausführen einer Silylierung der Si-haltigen Resistbeschichtung (13 ), um durch Erhöhen des Si-Gehalts in der Resistbeschichtung (13 ) einen strukturierten Si-reichen Film (16 ) zu erhalten; f) Oxidieren des strukturierten Si-reichen Films (16 ), um ihn in ein zweites strukturiertes poröses dielektrisches Zwischenschichtdielektrikum mit einem niedrigen k-Wert (17 ), zu konvertieren, wobei das zweite Zwischenschichtdielektrikum (17 ) eine elektrische Isolation zwischen aktiven Elementen und/oder verschiedenen Verbindungssignalwegen bereitstellt. - Verfahre nach Anspruch 1, wobei das Metall der Metalleitung (
11 ) ausgewählt ist aus der Gruppe bestehend aus Aluminium, Kupfer oder Wolfram. - Verfahren nach Anspruch 1 oder 2 wobei die Antireflexbeschichtung (
12 ) ein Polyimid ist. - Verfahren nach einem der Ansprüche 1 bis 3, wobei im Schritt e) die Silylierung mit einer nassen Chemikalie oder einem Gas bewirkt wird.
- Verfahren nach Anspruch 4, wobei die nasse Chemikalie H2N-Siloxan-NH2 ist.
- Verfahren nach Anspruch 4 oder 5, wobei das Gas Hexamethyldisilan ist.
- Verfahren nach einem der Ansprüche 1 bis 6, wobei im Schritt f) die Oxidation durch ein O2-Plasma erfolgt.
- Verfahren nach einem der Ansprüche 1 bis 6, wobei im Schritt f) die Oxidation durch Erhitzen in einem Ofen erfolgt.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/108,359 | 2002-03-29 | ||
US10/108,359 US6989230B2 (en) | 2002-03-29 | 2002-03-29 | Producing low k inter-layer dielectric films using Si-containing resists |
Publications (2)
Publication Number | Publication Date |
---|---|
DE10314152A1 DE10314152A1 (de) | 2003-11-13 |
DE10314152B4 true DE10314152B4 (de) | 2006-04-13 |
Family
ID=28452848
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE10314152A Expired - Fee Related DE10314152B4 (de) | 2002-03-29 | 2003-03-28 | Herstellung von dielektrischen Zwischenschichtfilmen mit einem niedrigen K-Wert unter Verwendung von Si-haltigen Resists |
Country Status (2)
Country | Link |
---|---|
US (1) | US6989230B2 (de) |
DE (1) | DE10314152B4 (de) |
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CN104869754B (zh) | 2014-02-25 | 2018-06-26 | 财团法人工业技术研究院 | 嵌有导线的软性基板及其制造方法 |
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