DE102005010272A1 - Halbleiterbauelement sowie Verfahren zum Herstellen eines Halbleiterbauelements - Google Patents
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Abstract
Die Erfindung betrifft ein Halbleiterbauelement (4), welches einen auf einem Substrat (2), insbesondere auf einem Chipträger, angeordneten Halbleiterchip (5), und ein Gehäuse (7), welches den Halbleiterchip (5) zumindest teilweise umgibt, aufweist, wobei der Chipträger zumindest teilweise mit einer Schicht (1) aus Polymerschaum versehen ist.
Description
- Die vorliegende Erfindung betrifft ein Halbleiterbauelement sowie ein Verfahren zum Herstellen eines Halbleiterbauelements.
- Gewöhnlich wird ein Halbleiterchip, der auf einem Chipträger oder einem Anschlussrahmen montiert und mit diesem beispielsweise durch Anschlussdrähte elektrisch verbunden bzw. gebondet ist, in einer Formmasse eingekapselt, um ein Halbleitergehäuse zu bilden. Diese Halbleitergehäuse sind meist aus einem Kunststoff hergestellt. Besonders weit verbreitete Verwendung finden hierfür Duroplaste, insbesondere Epoxidharz.
- Jedoch weisen diese Verkapselungsmassen eine unzureichende Haftung zu den Grenz- bzw. Oberflächen des Halbleiterchips oder des Chipträgers auf, welche sie umschließen oder an die sie angrenzen. Dies führt zu erhöhten Ausfall- und Fehlerrisiken beim Halbleiterbauelement und nicht zuletzt zum Nichtbestehen von Bauteilqualifikationen.
- Um eine ausreichende Haftung gemäß den an das Halbleiterbauelement gestellten Anforderungen und den Bauteilqualifikationen zu gewährleisten, wurde im Stand der Technik eine sehr gezielte und aufwändige Auswahl und Evaluierung geeigneter Pressmassen getroffen und die Chipträger-, Leadframe- bzw. Substratoberflächen wurden durch aufwändige mechanische Verfahren behandelt, wie Aufrauhen der zu verbindenden Oberflächen usw. Auch wurden physikalisch-chemische Methoden wie Plasmaätzen, elektrolytische Beschichtung mit haftverbessern den Schichten auf der Basis von anorganischen, metallischen Verbindungen zur Gewährleistung einer ausreichenden Haftung durchgeführt.
- Jedoch entstehen durch die oben genannten mechanischen oder physikalisch-chemischen Verfahren zum Erreichen einer Haftverbesserung zwischen der Pressmasse und einem Substrat sehr hohe Prozesskosten und der Nachteil der Beschränkung der Applikation auf elektrisch leitfähige Oberflächen. Außerdem führten diese Verfahren auch nur teilweise zu der gewünschten bzw. erforderlichen Verbesserung der Pressmassenhaftung.
- Aufgabe der vorliegenden Erfindung ist es, ein Verfahren zur Herstellung eines Halbleiterbauelements sowie ein entsprechendes Halbleiterbauelement zu schaffen, wobei auf einfache und somit auch kostengünstige Art und Weise eine ausreichende Haftung zwischen der Pressmasse, aus welchem das Gehäuse des Halbleiterbauelements hergestellt ist, und einem Substrat bzw. metallischem Leadframe, auf welchem ein Halbleiterchip angeordnet ist, erreicht wird.
- Diese Aufgabe wird durch ein Verfahren zum Herstellen eines Halbleiterbauelements mit den Merkmalen gemäß Anspruch 1 sowie durch ein Halbleiterbauelement mit den Merkmalen gemäß Anspruch 11 gelöst. Vorteilhafte Weiterbildungen sind in den Unteransprüchen definiert.
- Erfindungsgemäß bereitgestellt wird demnach ein Verfahren zum Herstellen eines Halbleiterbauelements, wobei das Verfahren die Schritte aufweist:
- – Aufbringen einer Lösung einer organischen Substanz auf ein Substrat, insbesondere auf einen Chipträger, wobei die organische Substanz Polymere und funktionale Moleküle aufweist, die geeignet sind, zu einer Schicht aus Polymerschaum zu reagieren und vernetzen;
- – Erzeugen des Polymerschaums durch Anwenden von Wärme auf die organische Substanz, wobei die Temperatur unterhalb von 200 °C gehalten wird;
- – Vernetzen des Polymerschaums durch Anwenden von Wärme auf den Polymerschaum, wobei die Temperatur oberhalb von 200 °C gehalten wird;
- – Verkapseln eines auf dem Substrat angeordneten Halbleiterchips mit einem Kunststoffmaterial.
- Beschichtungspolymere besitzen intrinsisch oberflächenaktive Gruppen oder können mit einer Reihe von hochaktiven Gruppen wie Silanen oder Isocyanaten verbunden werden, die auf dem polymeren metallischen oder keramischen Untergrund eine starke Haftung gewährleisten. Der Nachteil solcher hochreaktiven Polymergruppen besteht jedoch darin, dass sie aufgrund ihrer hohen Reaktivität dann meist nicht mehr für eine chemische Reaktion mit der Pressmasse, aus welcher das den Halbleiterchip umgebende Gehäuse gebildet wird, zur Verfügung stehen, wodurch die Anbindung des Verkapselungsmaterials auf einem anderen Weg sichergestellt werden muss. Daher wird das Substrat bzw. der Chipträger oder der Leadframe vor oder nach dem Die-/Wirebonden mit der Lösung der organischen Substanz, welche Polymere und funktionale organische Moleküle aufweist, die nach dem Aufbringen zu einer Polymerschicht reagieren und vernetzen, beschichtet. Die Lösung kann mittels eines Tauch-, Sprüh-, Tropf- oder Schablonendruckverfahrens auf das Substrat aufgebracht werden. Die Polymerbeschichtung führt während dem Aushärten zu einer Abspaltung von CO, CO2 oder anderen sich bei höheren Temperaturen abspaltenden Molekülsegmenten aus der Polymerkette, wodurch eine feste Polymerschaum schicht entsteht. Auch können spezielle Blockcopolymere, bei denen der Schaum durch die thermische Zersetzung einer thermolabilen Co-Komponente, z. B. Polypropylenoxid, entsteht, verwendet werden. Die Polymerschaumschicht weist Poren auf, in welche während der Verkapselung mit der Epoxidharz-Pressmasse die noch geschmolzenen Oligomerketten eindiffundieren können, was neben der erhöhten chemisch-physikalischen Haftung zwischen den Polymeren (Polymerschaum und Pressmasse, z. B. Epoxidharz) aufgrund der größeren Oberfläche und der Poren eines Schaumes, auch eine feste mechanische Verankerung der Pressmasse mit sich bringt. Weiterhin hat der Polymerschaum den Vorteil, dass ein sehr geringer dielektrischer Verlust bei hohen Schaltfrequenzen aufgrund der geringen Dielektrizitätskonstante (ε < 3) und des geringen Verlustfaktors tan δ (< 10–2) des Materials auftritt, insbesondere wenn der Schaum auch als "low κ Dielektrika" auf der Chipoberseite eingesetzt wird.
- Gemäß einer weiteren Ausführungsform wird ein Schritt des Herstellens einer elektrischen Verbindung zwischen dem Chipträger und dem auf dem Chipträger angeordneten Halbleiterchip vor dem Aufbringen der Lösung auf den Chipträger durchgeführt.
- Alternativ hierzu kann ein Schritt des Herstellens der elektrischen Verbindung zwischen dem Chipträger und dem auf dem Chipträger angeordneten Halbleiterchip nach dem Aufbringen der Lösung auf den Chipträger durchgeführt werden.
- Vorzugsweise wird der Schritt des Herstellens der elektrischen Verbindung mittels eines Die-/Wire-Bonden-Prozesses durchgeführt.
- Als organische Substanz kann z. B. ein Polyimid oder ein Hochleistungsthermoplast verwendet werden.
- Alternativ hierzu kann als organische Substanz ein Blockcopolymer verwendet werden, bei welchem der Schaum durch die thermische Zersetzung einer thermolabilen Co-Komponente entsteht. Dies hat den Vorteil, dass die Poren des Schaums besonders fein hergestellt werden können.
- Vorzugsweise ist die thermolabile Co-Komponente Polypropylenoxid.
- In einem weiteren Ausführungsbeispiel der Erfindung wird die Schicht aus Polymerschaum mit Poren in einer Größenordnung hergestellt, welche überwiegend im sub-μm-Bereich liegt.
- Vorzugsweise wird als Kunststoffmaterial zum Verkapseln des Halbleiterchips ein Duroplast, insbesondere Epoxidharz oder ein Silikonharz, verwendet.
- In einem weiteren Ausführungsbeispiel der Erfindung wird das Verkapseln mit einer Epoxidharzpressmasse mittels eines Transferpress- bzw. Spritzpressvorgangs durchgeführt.
- Des weiteren erfindungsgemäß bereitgestellt wird ein Halbleiterbauelement, welches einen auf einem Substrat, insbesondere auf einem Chipträger, angeordneten Halbleiterchip und ein Gehäuse, welches den Halbleiterchip zumindest teilweise umgibt, aufweist, wobei der Chipträger zumindest teilweise mit einer Schicht aus Polymerschaum versehen ist. Durch die auf dem Chipträger, Leadframe oder Substrat vorgesehene Schicht aus Polymerschaum wird auf einfache und kostengünstige Weise eine besonders gute Haftung auf die oben beschriebene Art und Wei se an die Verkapselungsmasse aus Kunststoffmaterial, insbesondere aus einem Duroplast, erzielt, wodurch Fehlerrisiken des Halbleiterbauelements minimiert werden und somit die Qualität des Halbleiterbauelements verbessert wird, auch hinsichtlich spezieller Bauteilqualifikationen.
- Vorzugsweise ist die Schicht aus Polymerschaum auf dem Chipträger an den Grenzoberflächen zu dem Gehäuse vorgesehen, so dass eine ausreichende Haftung des Gehäuses an dem Chipträger sichergestellt werden kann.
- Gemäß einer Ausführungsform der Erfindung ist das Substrat bzw. der Chipträger aus Metall hergestellt.
- Alternativ hierzu kann das Substrat bzw. der Chipträger aus Keramik oder Polymer oder einem Kunststoffsubstrat hergestellt sein. Die Verbesserung der Pressmassenhaftung durch Aufbringen einer Schicht aus Polymerschaum kann an allen Oberflächen, d. h. an Oberflächen jeglicher Materialien, erzielt werden.
- Vorteilhafterweise weist die Schicht aus Polymerschaum eine Dielektrizitätskonstante von ε < 3, insbesondere < 1,5 auf. So werden sehr geringe Energieverluste bei hohen Schaltfrequenzen aufgrund der niedrigen Dielektrizitätskonstante und des geringen Verlustfaktors tan δ (< 10–2) des Materials erzielt.
- Gemäß einer Ausführungsform der Erfindung ist die Schicht aus Polymerschaum aus Polyimid oder einem Hochleistungsthermoplast hergestellt.
- Vorteilhafterweise ist die Schicht aus Polymerschaum aus einem Blockcopolymer hergestellt, bei welchem der Schaum durch die thermische Zersetzung einer thermolabilen Co-Komponente entsteht.
- Weiterhin vorteilhafterweise ist die thermolabile Co-Komponente Polypropylenoxid.
- Vorteilhaft ist es ferner, wenn die Schicht aus Polymerschaum Poren in einer Größenordnung aufweist, welche überwiegend im sub-μm-Bereich liegen. In diese Poren diffundieren während der Verkapselung mit der Epoxidharz-Pressmasse die noch geschmolzenen Oligomerketten hinein, was neben der erhöhten chemisch-physikalischen Haftung zwischen den beiden Polymeren (Polymerschaum und Pressmasse) aufgrund der größeren Oberfläche und der Poren eines Schaums auch eine feste mechanische Verankerung der Pressmasse mit sich bringt.
- Gemäß einer weiteren Ausführungsform der Erfindung ist das Gehäuse aus einem Kunststoffmaterial hergestellt.
- Hierbei ist das Kunststoffmaterial vorteilhafterweise ein Duroplast, insbesondere Epoxidharz.
- Vorteilhaft ist es ferner, wenn das Gehäuse mittels eines Transferpressvorgangs hergestellt ist.
- Vorzugsweise weist die Schicht aus Polymerschaum eine Dicke in einem Bereich zwischen 2 nm – 10 μm in Abhängigkeit des polymeren Systems, der Konzentration der Ausgangslösung und den Verarbeitungsbedingungen wie Beschichtungstechnik, Temperatur, Lösungsmitteltyp, Beschichtungsgeschwindigkeit usw. auf.
- Die Erfindung wird anhand der Zeichnung näher beschrieben. In der Zeichnung zeigt
-
1 zwei perspektivische Schnittansichten durch eine Schicht aus einem Blockcopolymer; -
2 eine molekulare Darstellung eines Polymerschaums; -
3 ein Halbleiterbauelement, welches zumindest teilweise mit einer organischen Substanz beschichtet wurde; -
4 schematisch die Bildung der Schicht aus Polymerschaum in zwei Verfahrensschritten; -
5 eine schematische Schnittansicht durch ein Halbleiterbauelement mit Verkapselung; -
6 zwei schematische Schnittansichten durch die Schicht aus Polymerschaum beim Transferpressvorgang. -
1 zeigt perspektivisch zwei Schnittansichten durch eine Schicht1 aus einem Blockcopolymer. In1a ) ist eine Darstellung der Schicht1 gezeigt, wie sie auf ein Substrat2 (nicht gezeigt) aufgetragen werden kann, bevor eine Temperaturbehandlung zur Bildung eines Schaumes durchgeführt worden ist. Die Schicht1 weist hier noch getrennte Phasen auf, wobei die schwarzen gefüllten Kreise eine thermolabile Co-Komponente darstellen, welche sich unter Temperatureinwirkung zersetzt und so die Poren3 in der Schicht1 bildet, wie es in1b ) dargestellt ist, wobei die in der Schicht1 dargestellten offenen Kreise hier Leerstellen bzw. Luft in dem Material darstellen. -
2 zeigt eine molekulare Darstellung eines Polymerschaums, wie er in Bezug auf die1 beschrieben wurde und wie er für die Herstellung des erfindungsgemäßen Halbleiterbauelements4 (nicht gezeigt) verwendet werden kann. Hier ist (t.Bu-O-CO)2O als thermisch labile Gruppe in die Polymerhauptkette eingebaut worden, die sich unterhalb von Tg des Polymeren zersetzt und so zur Bildung der Poren im Größenbereich von nm führt. -
3 zeigt ein Halbleiterbauelement4 , welches zumindest teilweise mit einer organischen Substanz beschichtet wurde, aus welcher in zwei weiteren Verfahrensschritten die Schicht1 aus Polymerschaum gebildet wird. In diesem Beispiel wurde die Schicht1 auf der Oberfläche des Halbleiterchips5 und der oberen und unteren Oberfläche des Substrats2 bzw. Chipträgers aufgebracht. Auch ist hier der Halbleiterchip5 bereits durch Leitungsdrähte6 mit dem Substrat2 elektrisch verbunden worden. - In
4 ist schematisch die Bildung der Schicht1 aus Polymerschaum in den zwei sich dem in3 dargestellten Verfahrensschritt anschließenden Verfahrensschritten gezeigt. Von oben nach unten betrachtet, ist in dieser Figur die Schicht1 aus einer organischen Substanz, welche Polymere und funktionale organische Moleküle, die nach dem Aufbringen zu einer Polymerschicht reagieren und vernetzen, als durchgehender schwarzer Balken dargestellt, was dem Zustand der in3 dargestellten Beschichtung widerspiegelt. Unter Wärmeeinwirkung, wobei die Temperatur unterhalb von 200 °C gehalten wird, kommt es während dem Aushärten der Schicht1 zu ei ner Abspaltung beispielsweise von CO, CO2 und anderen sich bei höheren Temperaturen abspaltenden Molekülsegmenten oder thermolabilen Gruppen. Diese treiben aus dem Material aus und hinterlassen Poren3 in Form von Hohlräumen im überwiegend sub-μm-Größenbereich. In einem weiteren Verfahrensschritt, welcher unter Einwirkung von Temperaturen oberhalb von 200 °C durchgeführt wird, vernetzt dann der so gebildete Polymerschaum zu einer festen Masse bzw. Schicht1 mit feinsten Poren3 bzw. Hohlräumen. - In
5 ist eine schematische Schnittansicht durch ein Halbleiterbauelement4 mit einer Verkapselung bzw. einem Gehäuse7 dargestellt, welches den Halbleiterchip5 , welcher auf einem Substrat2 bzw. Chipträger angeordnet ist, umgibt. Die Grenzflächen des Substrats2 und des Halbleiterchips5 zu dem Gehäuse7 sind mit einer Schicht1 aus Polymerschaum beschichtet, so dass eine sehr gute Haftung der Pressmasse des Gehäuses7 aus Epoxidharz darauf sichergestellt ist. -
6 zeigt schließlich zwei schematische Schnittansichten durch die Schicht1 aus Polymerschaum beim Transferpressvorgang zur Bildung des Gehäuses7 aus Epoxidharz. In6a ), welche den Beginn des Transferpressvorgangs darstellt, wird die Pressmasse mit Epoxidketten8 auf die Oberfläche der Schicht1 aus Polymerschaum, welche die Poren3 aufweist, aufgebracht. Während dem Fortschreiten des Transferpressvorgangs, d. h. hier auch während dem Verkapselungsprozess des Halbleiterbauelements4 (nicht dargestellt) mit der Epoxidharz-Pressmasse, können die Oligomerketten bzw. Epoxidketten8 in die Poren3 der Schicht1 aus Polymerschaum hineindiffundieren, wie es in6b ) dargestellt ist. Dies erzielt, wie bereits erwähnt, neben der erhöhten physikalischen Haftung zwischen dem Polymerschaum und der Pressmasse auf grund der größeren Oberfläche und der Poren eines Schaums, auch eine feste mechanische Verankerung der Pressmasse. -
- 1
- Schicht
- 2
- Substrat
- 3
- Poren
- 4
- Halbleiterbauelement
- 5
- Halbleiterchip
- 6
- Leitungsdrähte
- 7
- Gehäuse
- 8
- Epoxidketten
Claims (23)
- Verfahren zum Herstellen eines Halbleiterbauelements (
4 ), wobei das Verfahren die Schritte aufweist: – Aufbringen einer Lösung einer organischen Substanz auf ein Substrat (2 ), insbesondere auf einen Chipträger, wobei die organische Substanz Polymere und funktionale Moleküle aufweist, die geeignet sind, zu einer Schicht (1 ) aus Polymerschaum zu reagieren und vernetzen; – Erzeugen des Polymerschaums durch Anwenden von Wärme auf die organische Substanz, wobei die Temperatur unterhalb von 200 °C gehalten wird; – Vernetzen des Polymerschaums durch Anwenden von Wärme auf den Polymerschaum, wobei die Temperatur oberhalb von 200 °C gehalten wird; – Verkapseln eines auf dem Substrat (2 ) angeordneten Halbleiterchips (5 ) mit einem Kunststoffmaterial. - Verfahren nach Anspruch 1, wobei ein Schritt des Herstellens einer elektrischen Verbindung zwischen dem Chipträger und dem auf dem Chipträger angeordneten Halbleiterchip (
5 ) vor dem Aufbringen der Lösung auf den Chipträger durchgeführt wird. - Verfahren nach Anspruch 1, wobei ein Schritt des Herstellens der elektrischen Verbindung zwischen dem Chipträger und dem auf dem Chipträger angeordneten Halbleiterchip (
5 ) nach dem Aufbringen der Lösung auf den Chipträger durchgeführt wird. - Verfahren nach Anspruch 2 oder 3, wobei der Schritt des Herstellens der elektrischen Verbindung mittels eines Die-/Wire-Bonden-Prozesses durchgeführt wird.
- Verfahren nach einem der Ansprüche 1 bis 4, wobei als organische Substanz ein Polyimid oder ein Hochleistungsthermoplast verwendet wird.
- Verfahren nach einem der Ansprüche 1 bis 4, wobei als organische Substanz ein Blockcopolymer verwendet wird, bei welchem der Schaum durch die thermische Zersetzung einer thermolabilen Co-Komponente entsteht.
- Verfahren nach Anspruch 6, wobei die thermolabile Co-Komponente Polypropylenoxid ist.
- Verfahren nach einem der Ansprüche 1 bis 7, wobei die Schicht (
1 ) aus Polymerschaum mit Poren (3 ) in einer Größenordnung hergestellt wird, welche überwiegend im sub-μm-Bereich liegt. - Verfahren nach einem der Ansprüche 1 bis 8, wobei als Kunststoffmaterial zum Verkapseln des Halbleiterchips (
5 ) ein Duroplast, insbesondere Epoxidharz oder ein Silikonharz, verwendet wird. - Verfahren nach Anspruch 9, wobei das Verkapseln mit einer Epoxidharzpressmasse mittels eines Transferpressvorgangs durchgeführt wird.
- Halbleiterbauelement (
4 ), welches einen auf einem Substrat (2 ), insbesondere auf einem Chipträger, angeordneten Halbleiterchip (5 ) und ein Gehäuse (7 ), welches den Halbleiterchip (5 ) zumindest teilweise umgibt, aufweist, dadurch gekennzeichnet, dass der Chipträger zumindest teilweise mit einer Schicht (1 ) aus Polymerschaum versehen ist. - Halbleiterbauelement (
4 ) nach Anspruch 11, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum auf dem Chipträger an den Grenzoberflächen zu dem Gehäuse (7 ) vorgesehen ist. - Halbleiterbauelement (
4 ) nach Anspruch 11 oder 12, dadurch gekennzeichnet, dass der Chipträger aus Metall hergestellt ist. - Halbleiterbauelement (
4 ) nach Anspruch 11 oder 12, dadurch gekennzeichnet, dass der Chipträger aus Keramik oder Polymer hergestellt ist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 14, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum eine Dielektrizitätskonstante von ε < 3, insbesondere < 1,5 aufweist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 15, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum aus Polyimid oder einem Hochleistungsthermoplast hergestellt ist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 15, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum aus einem Blockcopolymer hergestellt ist, bei welchem der Schaum durch die thermische Zersetzung einer thermolabilen Co-Komponente entsteht. - Halbleiterbauelement (
4 ) nach Anspruch 17, dadurch gekennzeichnet, dass die thermolabile Co-Komponente Polypropylenoxid ist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 18, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum Poren (3 ) in einer Größenordnung aufweist, welche überwiegend im sub-μm-Bereich liegt. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 19, dadurch gekennzeichnet, dass das Gehäuse (7 ) aus einem Kunststoffmaterial hergestellt ist. - Halbleiterbauelement (
4 ) nach Anspruch 20, dadurch gekennzeichnet, dass das Kunststoffmaterial ein Duroplast, insbesondere ein Epoxidharz oder ein Silikonharz, ist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 21, dadurch gekennzeichnet, dass das Gehäuse (7 ) mittels eines Transferpressvorgangs hergestellt ist. - Halbleiterbauelement (
4 ) nach einem der Ansprüche 11 bis 22, dadurch gekennzeichnet, dass die Schicht (1 ) aus Polymerschaum eine Dicke in einem Bereich zwischen 2 nm – 10 μm aufweist.
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102005010272A DE102005010272A1 (de) | 2005-03-03 | 2005-03-03 | Halbleiterbauelement sowie Verfahren zum Herstellen eines Halbleiterbauelements |
US11/817,520 US8178390B2 (en) | 2005-03-03 | 2006-02-20 | Semiconductor component and production method |
PCT/DE2006/000308 WO2006092117A1 (de) | 2005-03-03 | 2006-02-20 | Halbleiterbauelement sowie verfahren zum herstellen eines halbleiterbauelements |
US12/178,307 US7781887B2 (en) | 2005-03-03 | 2008-07-23 | Semiconductor device including an interconnect |
US13/461,202 US8440733B2 (en) | 2005-03-03 | 2012-05-01 | Semiconductor component and production method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE102005010272A DE102005010272A1 (de) | 2005-03-03 | 2005-03-03 | Halbleiterbauelement sowie Verfahren zum Herstellen eines Halbleiterbauelements |
Publications (1)
Publication Number | Publication Date |
---|---|
DE102005010272A1 true DE102005010272A1 (de) | 2006-09-14 |
Family
ID=36550619
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102005010272A Withdrawn DE102005010272A1 (de) | 2005-03-03 | 2005-03-03 | Halbleiterbauelement sowie Verfahren zum Herstellen eines Halbleiterbauelements |
Country Status (3)
Country | Link |
---|---|
US (3) | US8178390B2 (de) |
DE (1) | DE102005010272A1 (de) |
WO (1) | WO2006092117A1 (de) |
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-
2006
- 2006-02-20 US US11/817,520 patent/US8178390B2/en not_active Expired - Fee Related
- 2006-02-20 WO PCT/DE2006/000308 patent/WO2006092117A1/de not_active Application Discontinuation
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2008
- 2008-07-23 US US12/178,307 patent/US7781887B2/en not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
US20120223424A1 (en) | 2012-09-06 |
US20080220567A1 (en) | 2008-09-11 |
WO2006092117A1 (de) | 2006-09-08 |
US20080277801A1 (en) | 2008-11-13 |
US8178390B2 (en) | 2012-05-15 |
US7781887B2 (en) | 2010-08-24 |
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Legal Events
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---|---|---|---|
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8139 | Disposal/non-payment of the annual fee |