DE10138882A1 - Großflächige Membranmaske und Verfahren zu ihrer Herstellung - Google Patents
Großflächige Membranmaske und Verfahren zu ihrer HerstellungInfo
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- 239000012528 membrane Substances 0.000 title claims abstract description 114
- 238000000034 method Methods 0.000 title claims description 37
- 238000004519 manufacturing process Methods 0.000 title claims description 12
- 239000000463 material Substances 0.000 claims abstract description 11
- 238000000996 ion projection lithography Methods 0.000 claims abstract description 5
- 238000005530 etching Methods 0.000 claims description 35
- 239000004065 semiconductor Substances 0.000 claims description 24
- 230000000873 masking effect Effects 0.000 claims description 15
- 239000012212 insulator Substances 0.000 claims description 8
- 238000001459 lithography Methods 0.000 claims description 7
- 239000002245 particle Substances 0.000 claims description 5
- 230000005855 radiation Effects 0.000 claims description 5
- 238000009413 insulation Methods 0.000 claims description 4
- 238000001039 wet etching Methods 0.000 claims description 3
- 238000005304 joining Methods 0.000 claims description 2
- 239000007787 solid Substances 0.000 claims description 2
- 235000012431 wafers Nutrition 0.000 description 65
- 239000000758 substrate Substances 0.000 description 11
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 8
- 229910052710 silicon Inorganic materials 0.000 description 8
- 239000010703 silicon Substances 0.000 description 8
- 230000006641 stabilisation Effects 0.000 description 4
- 238000011105 stabilization Methods 0.000 description 4
- 238000001312 dry etching Methods 0.000 description 3
- 230000007935 neutral effect Effects 0.000 description 3
- 238000003860 storage Methods 0.000 description 3
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 2
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- 238000001015 X-ray lithography Methods 0.000 description 2
- 229910052796 boron Inorganic materials 0.000 description 2
- 239000000835 fiber Substances 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 150000002500 ions Chemical class 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- 230000002745 absorbent Effects 0.000 description 1
- 239000002250 absorbent Substances 0.000 description 1
- 239000006096 absorbing agent Substances 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000010894 electron beam technology Methods 0.000 description 1
- 238000000609 electron-beam lithography Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000008020 evaporation Effects 0.000 description 1
- 238000001704 evaporation Methods 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 238000010884 ion-beam technique Methods 0.000 description 1
- 238000013507 mapping Methods 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 238000007665 sagging Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
- 238000003631 wet chemical etching Methods 0.000 description 1
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-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F1/00—Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
- G03F1/20—Masks or mask blanks for imaging by charged particle beam [CPB] radiation, e.g. by electron beam; Preparation thereof
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F1/00—Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
- G03F1/22—Masks or mask blanks for imaging by radiation of 100nm or shorter wavelength, e.g. X-ray masks, extreme ultraviolet [EUV] masks; Preparation thereof
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Abstract
Description
- Die Erfindung betrifft eine großflächige Membranmaske für Lithografieverfahren mit kurzwelliger Strahlung, insbesondere für die Ionen-Projektions-Lithografie, sowie ein Verfahren zur Herstellung einer solchen Membranmaske.
- In der Halbleitertechnologie erfolgt die Strukturierung der Silizium-Wafer heute fast durchweg mit Hilfe der lithografischen Technik, bei der auf dem Wafer in einer strahlungsempfindlichen Resistschicht zunächst ein Resistmuster erzeugt wird, das dann als Maske bei einem darauf folgenden Prozessschritt, z. B. einer Ätzung, dient. Danach wird die Resistmaske wieder entfernt. Das Resistmuster selbst wird ebenfalls mit Hilfe einer für das jeweilige Belichtungsverfahren geeigneten Maske hergestellt. In der konventionellen Photolithografie werden dafür Chrommasken (Retikel) eingesetzt, die aus einer Glasplatte als Träger und einer dünnen strukturierten Chromschicht bestehen. Masken für die Röntgenlithografie erlauben jedoch selbst bei Verwendung von schwach absorbierenden Materialien wie Silizium nur Maskenträgerdicken im Mikrometerbereich. Dies wird durch Membranmasken realisiert, die aus einem zentralen aktiven Bereich, in dem sie zur Membran gedünnt sind, und aus einem Stützrand (Tragring) in der ursprünglichen Dicke des Silizium-Substrats bestehen. Auf der Membranschicht ist bei Röntgenmasken eine geometrisch strukturierte Absorberschicht angebracht.
- Bei der Elektronen- und Ionen-Lithografie werden häufig Membranmasken verwendet, bei denen die Maskenöffnungen nicht auf der Membranschicht, sondern in ihr erzeugt sind. Die Membranschicht, deren Dicke im Mikrometerbereich liegt, enthält Maskenöffnungen bzw. Löcher entsprechend den lithografisch zu erzeugenden Figuren bzw. Mustern. Bei derartigen sogenannten Lochmasken (Stencilmasken) handelt es sich somit, wie bei allen Membranmasken, um mechanisch vergleichsweise instabile Gebilde.
- Für die Elektronen- und Ionen-Projektions-Lithografie sowie neuere Versionen der Röntgenlithografie müssen Membranmasken mit Dicken im Mikrometerbereich und mit Membranflächen bis zu mehr als 100 Quadratzentimeter Größe hergestellt werden. Die nach dem erfindungsgemäßen Verfahren erzeugten Membranmasken können generell für Lithografieverfahren mit geladenen Teilchen und mit Photonen Anwendung finden. Ein Beispiel ist der Einsatz in der 13 nm Lithografie (sog. EUV-Strahlen). Ebenso ist eine Verwendung zur Maskierung gegenüber neutralen Teilchen (Atomlithografie) sowie bei allen Anwendungen mit Aufdampfmaske möglich. Membranmasken als Produkt eines Verfahrens gemäß der vorliegenden Erfindung sind auch generell für Sensoren verwendbar.
- Ausgehend von Siliziumscheiben als typischem Substratmaterial werden zur Herstellung der Membranmasken bisher zwei unterschiedliche technologische Prozessvarianten verfolgt. Sie unterscheiden sich grundsätzlich dadurch, ob die Prozessschritte zur Maskenstrukturierung, also zur Perforierung, vor (Wafer Flow Process) oder nach (Membrane Flow Process) der Membranätzung, also dem Abtrag des Wafers bis auf den verbleibenden Tragring, erfolgen.
- Beim sogenannten Wafer Flow Process, wie er beispielsweise in der PCT-Anmeldung WO 99/49365 dargestellt ist, werden zuerst die Maskenstrukturen auf einem kompakten Siliziumwafer erzeugt und die Herstellung der Membran(fläche) durch Rückseiten-Ätzung des Substrats findet am Ende des Prozesses statt. Diese Prozessvariante ermöglicht einerseits, die Strukturierungsprozesse für die Maskenstrukturen auf stabilen, prozessmäßig besser beherrschbaren Wafern durchzuführen. Andererseits bestehen bei dieser Variante auch sehr hohe Anforderungen an den Membran-Ätzprozess, da die strukturierte Membranseite absolut sicher vor einem Ätzangriff geschützt sein muss. Als Ätzstoptechnik wurde herkömmlicherweise eine Bor- Dotierung der Membranschicht vorgesehen, wodurch sich jedoch oft nicht exakt genug definierte Verhältnisse ergeben.
- Neuerdings werden deshalb auch SOI (Silicon-On-Insulator)- Substrate verwendet, die ebenfalls in der WO 99/49365 beschrieben sind. Dabei dient die vergrabene Oxidschicht im SOI-Wafer als definierter Ätzstop und die Dotierung der Membranschicht kann beliebig nach anderen Gesichtspunkten gewählt werden. Ausgehend von einem Halbleiter-Isolator-Halbleiterträgerschicht-Substrat wird die zukünftige Struktur der Membran in die oberste Halbleiterschicht, also in die zukünftige Membranschicht, übertragen. In einem weiteren Schritt wird die Halbleiterträgerschicht von der Unterseite her bis auf einen äußeren Ring entfernt. Schließlich wird im Zentralbereich auch die freiliegende Isolatorschicht entfernt, so dass die auf dem Tragring aufliegende Halbleiterschicht mit ihrem freiliegenden, vom Tragring aufgespannten Zentralbereich die strukturierte Membranfläche darstellt.
- Für die Position der in die Membran eingebrachten Strukturen, die für die Funktion der Maske entscheidend sind, wird künftig eine Lagegenauigkeit im Bereich weniger Nanometer gefordert. Dabei ist, in Abhängigkeit von der gewollten Eigenspannung der Membranschicht, zunächst eine mehr oder weniger starke homogene Verschiebung der Maskenstrukturen gegenüber der ursprünglichen Lage zu berücksichtigen, die jedoch durch Vorkorrektur ausgleichbar ist. Wesentlich problematischer sind prozess- und lagerungsbedingte Verzeichnungen, die auf Grund der Größe der Membranfläche (Durchmesser typischerweise 126 Millimeter oder größer) und der geringen Steifigkeit der Maske einen großen Einfluss auf die Plaziergenauigkeit haben.
- Spannungen, die zu Verzeichnungen führen können, treten besonders im Zusammenhang mit SOI-Substraten auf, was verschiedene durch deren Aufbau bzw. Herstellungsprozess bedingte Gründe hat. Beispielsweise geht die Herstellung von vergrabenen Oxidschichten mittels Wafer-Bonding in der Praxis oft mit mechanischen Unregelmäßigkeiten einher, die sich in inhomogenen Spannungen in der oberen, dünnen Halbleiterschicht auswirken.
- Zur Stabilisierung der Membranfläche dient bisher der erwähnte Tragring aus Membranmaterial (typischerweise Silizium), der die Membranfläche konzentrisch umgibt und eine wesentlich größere Dicke als die Membran hat. Diese Maskengeometrie wurde üblicherweise mit einem SOI-Wafer realisiert, dessen Dicke auf der Membranfläche auf wenige Mikrometer durch Ätzverfahren reduziert wurde. Der Stabilisierungsring behält die ursprüngliche Waferdicke von einigen 100 Mikrometern. Trotz dieser Stabilisierung ist die Steifigkeit des Gesamtsystems nicht groß genug, um die auftretenden Verzeichnungen auf die geforderte, für den zukünftigen Einsatz unverzichtbare Grössenordnung zu reduzieren.
- Aus der US 6,214,498 B1 ist eine doppelstöckige Membranmaske, die aus zwei perforierten Membranschichten und den zugehörigen Tragringen aufgebaut ist, und ein Verfahren zu ihrer Herstellung bekannt. Ausgangspunkt ist das Problem, dass die beim Belichtungsvorgang in der Maske absorbierte Energie der hochenergetischen Teilchen zu einer Temperaturdehnung führt, wodurch ein Maskenverzug auftritt, der zu nicht tolerierbaren Verzeichnungen bei der Abbildung der Maskenstrukturen führen kann. Zur Beseitigung dieser durch das Belichten selbst ausgelösten Temperatur-Verzeichnungen wird vorgeschlagen, zwei im wesentlichen spiegelsymmetrische Masken aufeinander zu legen und im Bereich der Tragringe ein Zwischenstück vorzusehen, durch das die beiden Masken einerseits mechanisch verbunden, andererseits aber thermisch gegeneinander isoliert sind. Dadurch wird die thermische Energie in der oberen, strahlungsnahen Maske absorbiert, deren Maskenverzug jedoch nicht die Abbildung beeinflusst, da ihre Öffnungen etwas grösser als die der unteren Maske sind, bei der auf Grund ihrer Abschirmung und Isolierung kein Maskenverzug auftritt.
- Die Herstellung dieser bekannten Doppel-Maske erfolgt durch Strukturieren der beiden Masken einschließlich Zwischenstück nebeneinander auf einem konventionellen Silizium-Wafer, der anschließend in die beiden Masken zerteilt wird. Die beiden Masken werden dann mittels einer leitfähigen Schicht spiegelbildlich aneinander befestigt.
- Ziel der vorliegenden Erfindung ist es, eine Membranmaske zu schaffen, die die erwähnte Problematik mit prozess- und lagerungsbedingten Verzeichnungen verringert und außerdem ein Verfahren zu deren Herstellung zu schaffen, das insbesondere bei Verwendung von SOI-Substraten die Herstellung von Membranmasken mit geringen Verzeichnungen erlaubt.
- Diese Aufgabe wird erfindungsgemäß durch eine Membranmaske mit den im Patentanspruch 1 angegebenen Merkmalen gelöst.
- Die Erfindung schafft eine großflächige Membranmaske für Lithografieverfahren mit Teilchen- oder kurzwelliger Strahlung, insbesondere für die Ionen-Projektions-Lithografie,
- - mit einer Membranschicht mit durchgehenden, das Maskenmuster definierenden Öffnungen,
- - mit einem ersten Wafer aus Membranmaterial, auf dessen einer Oberfläche die Membranschicht angeordnet ist, wobei eine wannenförmige Vertiefung sich von der anderen, rückseitigen Waferoberfläche in den Wafer bis hin zur schichttragenden Oberfläche hineinerstreckt, so dass eine Membranfläche und ein die Membranfläche konzentrisch umgebender erster Tragring gebildet ist,
- - und mit einem zweitem Wafer aus Membranmaterial, der in gleicher Weise wie der erste Wafer zu einem zweiten Tragring strukturiert und spiegelbildlich zu dem ersten Wafer an der Membranschicht angebracht ist,
- - so dass die Membranfläche in Richtung senkrecht zur Membranebene zentriert zwischen dem ersten und zweiten Tragring angeordnet ist.
- Der Grundgedanke der Erfindung besteht darin, eine Doppelringgeometrie vorzusehen, durch die gegenüber den bisher bekannten Membranmasken mit einfachem Tragring eine erhebliche zusätzliche Stabilisierung erreicht wird, da die Steifigkeit des Gesamtsystems deutlich erhöht wird. Entscheidend ist dabei die Tatsache, dass in dieser Doppelringgeometrie die Membran in vertikaler Richtung in der Mitte der beiden Trag- bzw. Stabilisierungsringe liegt und somit nahe der "neutralen Faser" verläuft. Durch die vertikale Zentrierung heben sich die vertikalen prozessinduzierten Verzeichnungen, die durch das Freiätzen der Membran entstehen, in der Membranebene auf, da sie oberhalb und unterhalb der Membranfläche die gleiche Größe, aber ein entgegengesetztes Vorzeichen haben. Mit dieser Anordnung der Membran werden außerdem die befestigungsinduzierten Verzeichnungen der Maske auf Grund der geringeren vertikalen Auslenkung deutlich reduziert und im Idealfall vollständig unterdrückt.
- In einer bevorzugten Ausführungsform wird eine Membranmaske dadurch geschaffen,
- - dass ein Halbleiter-Isolator-Halbleiterträgerschicht-Wafer (SOI-Wafer) vorgesehen ist, dessen Halbleiterschicht die Membranschicht und dessen Halbleiterträgerschicht den ersten Wafer bildet,
- - und dass die membranseitige Oberfläche des zweiten, massiven Halbleiter-Wafers eine Ätzstopschicht aufweist.
- Dadurch eröffnet sich erfindungsgemäß die Möglichkeit, ausgehend von einem SOI-Wafer, ein Verfahren zur Herstellung einer derartigen Membranmaske anzugeben, mit folgenden Schritten:
- - Strukturierung und Trenchätzung des Maskenmusters in die Membranschicht des SOI-Wafers bis zur Isolationsschicht,
- - Aufbringung einer Maskierschicht auf die Rückseiten des SOI-Wafers und des zweiten Wafers, die durch lithografische Maskierung und anschließende Ätzung jeweils zu einem Membranfenster strukturiert wird,
- - Zusammenfügung des so vorbereiteten SOI-Wafers und des zweiten Wafers in einem Wafer-Bondingschritt, wobei die mit einer Ätzstopschicht versehene Vorderseite des zweiten Wafers mit der strukturierten Membranschicht des SOI-Wafers in Kontakt gebracht wird,
- - anschließende Membranätzung durch Abtrag der Halbleiterträgerschicht des SOI-Wafers bis zur Isolierschicht und des Halbleitermaterials des zweiten Wafers bis zur Ätzstopschicht in den durch die jeweilige Maskierschicht definierten Membranfenstern,
- - nach der Membranätzung Entfernung der Maskierschichten, und der an der Membranfläche freiliegenden Teile der Isolierschicht und der Ätzstopschicht.
- Eine besonders vorteilhafte Ausgestaltung dieses Verfahrens sieht vor, dass die Membranätzung durch gleichzeitiges, beidseitiges Nassätzen in einer mechanisch gedichteten Ätzzelle erfolgt. Wenn andererseits für die Membranätzung Trockenätzschritte eingesetzt werden sollen, können nicht-gleichzeitige Teilschritte günstiger sein. Entscheidend ist in jedem Fall, dass die Symmetrie und damit die Stabilität der resultierenden Membranmaske gewährleistet ist.
- Die Erfindung wird nachstehend anhand eines Ausführungsbeispieles unter Bezugnahme auf die Zeichnung näher beschrieben. Es zeigt:
- Fig. 1 Aufeinanderfolgende Teilschritte 1A bis 1E der Bearbeitung eines SOI-Wafers innerhalb eines erfindungsgemäßen Verfahrens;
- Fig. 2 Aufeinanderfolgende Teilschritte 2A bis 2C der Bearbeitung eines konventionellen Wafers innerhalb eines erfindungsgemäßen Verfahrens;
- Fig. 3 Weitere Teilschritte 3A bis 3D des erfindungsgemäßen Verfahrens, in denen die beiden gemäß Fig. 1 und 2 vorbereiteten Wafer gemeinsam weiterverarbeitet werden.
- Fig. 1 zeigt als Ausgangspunkt 1A ein fertiges SOI-Substrat 3 mit einer Halbleiterträgerschicht, die als erster Wafer 1 dient und die die obere, dünne Halbleiterschicht, die spätere Membranschicht 5, trägt. Dazwischen befindet sich eine vergrabene Schicht, die später als Ätzstopschicht dienen soll und die im Folgenden nur der üblichen Terminologie ("SOI-Wafer") folgend als "Isolatorschicht" 4 bezeichnet ist.
- Im Teilschritt 1B wird durch ganzflächige Implantation von Ionen, beispielsweise Bor, in die obere Membranschicht 5 die mechanische Vorspannung der späteren Membranfläche 12 eingestellt. Diese an sich bekannte Maßnahme dient primär zur mechanischen Stabilisierung der Membranfläche 12, die bei der fertigen Membranmaske jedoch auch deshalb leicht gespannt sein soll, da ein vertikales Durchhängen sich wiederum ungünstig als Verzeichnung auswirken würde.
- Im nächsten Teilschritt 1C wird auf die Oberseite des SOI- Substrats 3 eine Resistschicht 7 aufgebracht, in der mittels Elektronenlithografie das in der Fig. 1C erkennbare Lochmuster 8 erzeugt wird.
- Im nächsten Teilschritt 1D erfolgt mit Hilfe der zuvor aufgebrachten und strukturierten Resistschicht 7 die (Trench)Ätzung von Gräben 9 in der Membranschicht 5. Diese Gräben 9 sind für die späteren Maskenöffnungen 13 vorgesehen. Anschließend erfolgt die Entfernung der Resistschicht 7.
- In einem weiteren Teilschritt 1E wird auf die Rückseite des SOI-Substrats 3 eine Maskierschicht 10, insbesondere aus Siliziumnitrid, für die späteren Rückseitenprozesse aufgebracht und lithografisch zu einem Membranfenster strukturiert.
- Fig. 2 zeigt als Ausgangspunkt 2A einen konventionellen Siliziumwafer 2. Im Teilschritt 2B wird dessen Vorderseite mit einer Oxidschicht versehen, die nachfolgend, analog zur Isolationsschicht 4, als Ätzstopschicht 6 dienen soll. Gemäß Prozessschritt 2C wird anschließend auf die Rückseite des zweiten Wafers 2 eine Siliziumnitrid-Maskierschicht 11 für die späteren Rückseitenprozesse bei diesem Wafer aufgebracht und ebenfalls lithografisch zu einem Membranfenster strukturiert. Der zweite Wafer 2 bleibt an seiner Vorderseite unstrukturiert, also ohne Öffnungen, da er keine eigenständige Lochmaske bilden soll.
- Fig. 3A zeigt als Ausgangspunkt die Bereitstellung des ersten und zweiten Wafers 1, 2 die in der züvor beschriebenen Weise vorprozessiert wurden. Die Wafer 1 und 2 sind bezüglich der Membranschicht 5, die die Mittelebene bildet, spiegelsymmetrisch angeordnet.
- Im nächsten Teilschritt 3B werden die beiden vorbereiteten Wafer 1, 2 in der dargestellten Konfiguration mittels Wafer- Bonding aneinandergefügt. Dies geschieht beispielsweise in an sich bekannter Weise durch Zusammenfügen der gegenüberliegenden Flächen und anschließendes Aufheizen. Nach dem Aufheizen, bei dem eine unlösbare chemische Bindung zwischen dem zweiten Wafer 2 und der zum SOI-Substrat 3 gehörenden Membranschicht 5 entsteht, wird die Grenzfläche nach einer vorbestimmten Zeitdauer abgekühlt.
- Im folgenden Teilschritt 3C wird das nach dem Wafer-Bonding entstandene Gebilde in eine mechanisch gedichtete Ätzzelle 16 eingesetzt. Durch die Öffnung der Membranfenster gemäß den strukturierten Maskierschichten 10, 11 wird die Größe der zukünftigen Membranfläche 12 von beiden Seiten definiert. Der Ätzprozess kann nun mit den an sich bekannten nasschemischen Ätzmitteln durchgeführt werden, wobei, von der Seite des zweiten Wafers 2 aus die Oxidschicht 6 und von der Seite des SOI-Wafers 3 aus die Isolatorschicht 4, mit guter Selektivität als Ätzstop dienen. Außerdem sind so die empfindlichen Stencilstrukturen während der Membranätzung geschützt. Das Nassätzen erfolgt vorteilhafterweise gleichzeitig von beiden Seiten in der Ätzzelle 16, es kann jedoch ebensogut in getrennten Ätzschritten, also insbesondere zeitlich nacheinander erfolgen. Erfindungsgemäß sind bei der Membranätzung auch Trockenätzschritte möglich.
- Im letzten Teilschritt 3D werden die Maskierschichten 10,11 und die an der Membranfläche 12 freiliegenden Teile der Isolierschicht 4 und der Oxidschicht 6 entfernt, beispielsweise durch Trockenätzschritte. Es resultiert die freie, von der erfindungsgemäßen Doppelring-Konstruktion gestützte Membranfläche 12 mit den Masken-Öffnungen 13.
- Vorteilhafterweise besitzen die beiden Tragringe 14, 15 im wesentlichen die gleiche Dicke von einigen hundert Mikrometern und sind aus dem gleichen Material gefertigt, so dass möglichst symmetrische Verhältnisse gegeben sind.
- Hinsichtlich der freien Membranfläche 12, die die Mittelebene zwischen den beiden Tragringen 14, 15 bildet, herrschen ähnliche Verhältnisse wie bei der bekanntlich relativ wenig biegebelasteten neutralen Faser im Inneren eines Stabes. In vertikaler Richtung, das heißt in Richtung senkrecht zur Membranebene, werden deshalb die prozess- und lagerungsbedingten Auslenkungen und damit die entsprechenden unvorteilhaften Verzeichnungen erfindungsgemäß minimiert. Die erfindungsgemäßen Membranmasken können beispielsweise mit 150 mm oder mit 200 mm Wafern gefertigt und vorzugsweise zur Vollfeldbelichtung in der Halbleiterherstellung eingesetzt werden. Bei der Belichtung beispielsweise mit Elektronen- oder Ionenstrahlen können die Masken-Öffnungen 13 in bekannter Weise das auf eine strahlungsempfindliche Resistschicht zu übertragende Maskenmuster definieren. Bezugszeichenliste 1 erster Wafer
2 zweiter Wafer
3 SOI-Wafer
4 vergrabene Isolatorschicht
5 Membranschicht
6 Ätzstopschicht
7 Resistschicht
8 Lochmuster
9 Gräben
10 Maskierschicht
11 Maskierschicht
12 Membranfläche
13 Maskenöffnungen
14 erster Tragring
15 zweiter Tragring
16 Ätzzelle
Claims (4)
mit einer Membranschicht (5) mit durchgehenden, das Maskenmuster definierenden Öffnungen (13),
mit einem ersten Wafer (1) aus Membranmaterial, auf dessen einer Oberfläche die Membranschicht (5) angeordnet ist, wobei eine wannenförmige Vertiefung sich von der anderen, rückseitigen Waferoberfläche in den Wafer (1) bis hin zur schichttragenden Oberfläche hineinerstreckt, so dass eine Membranfläche (12) und ein die Membranfläche (12) konzentrisch umgebender erster Tragring (14) gebildet ist,
und mit einem zweitem Wafer (2) aus Membranmaterial, der in gleicher Weise wie der erste Wafer (1) zu einem zweiten Tragring (15) strukturiert und spiegelbildlich zu dem ersten Wafer (1) an der Membranschicht (5) angebracht ist,
so dass die Membranfläche (12) in Richtung senkrecht zur Membranebene zentriert zwischen dem ersten und zweiten Tragring (14, 15) angeordnet ist.
dass ein Halbleiter-Isolator (4) -Halbleiterträgerschicht- Wafer (SOI-Wafer) (3) vorgesehen ist, dessen Halbleiterschicht die Membranschicht (5) und dessen Halbleiterträgerschicht den ersten Wafer (1) bildet,
und dass die membranseitige Oberfläche des zweiten, massiven Halbleiter-Wafers (2) eine Ätzstopschicht (6) aufweist.
Strukturierung und Trenchätzung des Maskenmusters in die Membranschicht (5) des SOI-Wafers (3) bis zur Isolationsschicht (4),
Aufbringung einer Maskierschicht (10, 11) auf die Rückseiten des SOI-Wafers (3) und des zweiten Wafers (2), die durch lithografische Maskierung und anschließende Ätzung jeweils zu einem Membranfenster strukturiert wird,
Zusammenfügung des so vorbereiteten SOI-Wafers (3) und des zweiten Wafers (2) in einem Wafer-Bondingschritt, wobei die mit einer Ätzstopschicht versehene Vorderseite des zweiten Wafers (2) mit der strukturierten Membranschicht (5) des SOI-Wafers (3) in Kontakt gebracht wird,
anschließende Membranätzung durch Abtrag der Halbleiterträgerschicht des SOI-Wafers (3) bis zur Isolierschicht (4) und des Halbleitermaterials des zweiten Wafers (2) bis zur Ätzstopschicht (6) in den durch die jeweilige Maskierschicht (10, 11) definierten Membranfenstern,
nach der Membranätzung Entfernung der Maskierschichten (10, 11), und der an der Membranfläche (12) freiliegenden Teile der Isolierschicht (4) und der Ätzstopschicht (6).
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE10138882A DE10138882B4 (de) | 2001-08-08 | 2001-08-08 | Großflächige Membranmaske und Verfahren zu ihrer Herstellung |
JP2002220495A JP4334832B2 (ja) | 2001-08-08 | 2002-07-29 | 広い面積を有するメンブレンマスクおよびこれを作製する方法 |
US10/215,227 US6835508B2 (en) | 2001-08-08 | 2002-08-08 | Large-area membrane mask and method for fabricating the mask |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE10138882A DE10138882B4 (de) | 2001-08-08 | 2001-08-08 | Großflächige Membranmaske und Verfahren zu ihrer Herstellung |
Publications (2)
Publication Number | Publication Date |
---|---|
DE10138882A1 true DE10138882A1 (de) | 2003-03-13 |
DE10138882B4 DE10138882B4 (de) | 2005-09-08 |
Family
ID=7694760
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE10138882A Expired - Fee Related DE10138882B4 (de) | 2001-08-08 | 2001-08-08 | Großflächige Membranmaske und Verfahren zu ihrer Herstellung |
Country Status (3)
Country | Link |
---|---|
US (1) | US6835508B2 (de) |
JP (1) | JP4334832B2 (de) |
DE (1) | DE10138882B4 (de) |
Families Citing this family (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4220229B2 (ja) * | 2002-12-16 | 2009-02-04 | 大日本印刷株式会社 | 荷電粒子線露光用マスクブランクスおよび荷電粒子線露光用マスクの製造方法 |
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JP6903647B2 (ja) * | 2015-11-03 | 2021-07-14 | エーエスエムエル ネザーランズ ビー.ブイ. | 膜アセンブリを製造するための方法 |
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DE102018202421B3 (de) | 2018-02-16 | 2019-07-11 | Carl Zeiss Microscopy Gmbh | Vielstrahl-Teilchenstrahlsystem |
WO2019166331A2 (en) | 2018-02-27 | 2019-09-06 | Carl Zeiss Microscopy Gmbh | Charged particle beam system and method |
US11444244B2 (en) | 2018-04-19 | 2022-09-13 | Ningbo Semiconductor International Corporation | Mask plate and fabrication method thereof |
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CN108624841B (zh) * | 2018-05-03 | 2020-10-13 | 中芯集成电路(宁波)有限公司 | 掩膜版及其制作方法 |
CN108611593B (zh) * | 2018-05-03 | 2020-05-19 | 中芯集成电路(宁波)有限公司 | 掩膜版及其制作方法 |
CN108546912B (zh) * | 2018-05-03 | 2020-09-18 | 中芯集成电路(宁波)有限公司 | 掩膜版及其制作方法 |
US10811215B2 (en) | 2018-05-21 | 2020-10-20 | Carl Zeiss Multisem Gmbh | Charged particle beam system |
DE102018007455B4 (de) | 2018-09-21 | 2020-07-09 | Carl Zeiss Multisem Gmbh | Verfahren zum Detektorabgleich bei der Abbildung von Objekten mittels eines Mehrstrahl-Teilchenmikroskops, System sowie Computerprogrammprodukt |
DE102018007652B4 (de) | 2018-09-27 | 2021-03-25 | Carl Zeiss Multisem Gmbh | Teilchenstrahl-System sowie Verfahren zur Stromregulierung von Einzel-Teilchenstrahlen |
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CN111477530B (zh) | 2019-01-24 | 2023-05-05 | 卡尔蔡司MultiSEM有限责任公司 | 利用多束粒子显微镜对3d样本成像的方法 |
TWI743626B (zh) | 2019-01-24 | 2021-10-21 | 德商卡爾蔡司多重掃描電子顯微鏡有限公司 | 包含多束粒子顯微鏡的系統、對3d樣本逐層成像之方法及電腦程式產品 |
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-
2001
- 2001-08-08 DE DE10138882A patent/DE10138882B4/de not_active Expired - Fee Related
-
2002
- 2002-07-29 JP JP2002220495A patent/JP4334832B2/ja not_active Expired - Fee Related
- 2002-08-08 US US10/215,227 patent/US6835508B2/en not_active Expired - Lifetime
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US6835508B2 (en) | 2004-12-28 |
DE10138882B4 (de) | 2005-09-08 |
JP4334832B2 (ja) | 2009-09-30 |
JP2003068641A (ja) | 2003-03-07 |
US20030031939A1 (en) | 2003-02-13 |
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OP8 | Request for examination as to paragraph 44 patent law | ||
8364 | No opposition during term of opposition | ||
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|
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: G03F0001160000 Ipc: G03F0001200000 |
|
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |