CS271713B1 - Circuit for microcomputer's control bus checking - Google Patents
Circuit for microcomputer's control bus checking Download PDFInfo
- Publication number
- CS271713B1 CS271713B1 CS882480A CS248088A CS271713B1 CS 271713 B1 CS271713 B1 CS 271713B1 CS 882480 A CS882480 A CS 882480A CS 248088 A CS248088 A CS 248088A CS 271713 B1 CS271713 B1 CS 271713B1
- Authority
- CS
- Czechoslovakia
- Prior art keywords
- bus
- output
- microcomputer
- control
- circuit
- Prior art date
Links
Landscapes
- Microcomputers (AREA)
Description
1 CS 271713 B1
Vynález sa týká obvodu pře kontrolu riadiacej zbernice mikropočítača, ktorý umožňujedetekciu mimoriadneho stavu na riadiacej zbernici mikropočítače.
Mimoriadnym stavom na riadiacej zbernici mikropočítača sa rozumie stav, keó sa na ria-diacej zbernici nachádza nesprávná kombinácia riadiacich signálov, alebo ke3 kombináciariadiacich signálov je sice v každom okamihu správná, ale sled týchto signálov je nespráv-ný. Mimoriadny stav může byť příčinou nesprávnej činnosti celého mikropočítače.
Jednoprocesorové mikropočítače, zabezpečené proti poruchám technickými prostriedkamikontrolou zberníc, doteraz zabezpečujú iba kontrolu adresnej a dátovej zbernice. Riadiacazbernica sa zatial nekontroluje. Přitom výskyt mimoriadneho stavu na riadiacej zbernicimůže mať za následok takú nesprávnu činnosť mikropočítače, ako například neželané prepísa-nie obsahu památe, změna obsahu výstupného portu atá., bez toho, že by sa to kontrolouadresnej a dátovej zbernice detekovalo. Pretože sa však nemusí zmeniť tok programu, mimo-riadna událost na riadiacej zbernici v tomto případe nebude detekovaná ani takými meto-dami zabezpečenia proti poruchám, ako sú diagnostické hodiny, kontrola neexistujícej pa-mate, kontrola neplatného operačného kódu a podobné.
Tieto nevýhody odstraňuje obvod pře kontrolu riadiacej zbernice mikropočítače podlávynálezu, ktorého podstatou je, že riadiaca zbernica mikropočítača je připojená na vstupyobvodu overovania signálnych sledov a zároveň na dátové vstupy záchytného registra, kto-rého výstupy sú připojené na prvú výstupní zbernicu a zároveň na vstupy dekodéra kombiná-cie riadiacich signálov. jeho výstup je připojený jednak na zapisovací vstup záchytnéhoregistra, jednak na prvú výstupní svorku a jednak na prvý vstup súčtového člena, ktoréhovýstup je spojený s treťou výstupnou svorkou. Druhý vstup súčtového člena na spojenýs druhou výstupnou svorkou a zároveň s jednobitovým výstupom obvodu overovania signálnychsledov, ktorého ostatně výstupy sú připojené na vstupy dekodéra nesprávných signálnychsledov, ktorého výstupy sú připojené na druhů výstupnú zbernicu. Výhodou obvodu podlá vynálezu je, že v případe nesprávného signálneho sledu alebonesprávnej kombinácie riadiacich signálov obvod pre kontrolu riadiacej zbernice generujesignál o poruche, ktorý může byť použitý na zastavenie kontrolovaného mikropočítača a za-hájenie režimu zotavenia sa z poruchy. Zároveň sa identifikuje, či nastala porucha v sle-de riadiacich signálov alebo v ich kombinácii.
Na priloženom výkrese je znázorněná bloková schéma konkrétného obvodu podlá vynálezu.
Obvod podlá vynálezu pozostáva z troch hlavných častí, ktorými sú dekódovací blok 1.,blok 2/.sledov a blok 2 detekcie. Oekodovací blok 2 j0 tvořený záchytným registrom 11.na ktorého dátové vstupy je připojená riadiaca zbernica 100 kontrolovaného mikropočítačaa ktorého výstupy sú připojené jednak.na prvú výstupnú zbernicu 110 a jednak na vstupy de-kodéra 12 kombinácii riadiacich signálov. jeho jednobitový výstup je připojený jednakna zapisovací vstup záchytného registra 11, jednak na prvý vstup súčtového člena 30 a jed-nak na prvú výstupnú svorku 120. Blok 2 sledov je tvořený z obvodu 21 overovania signál-nych sledov, na ktorého vstupy je připojená riadiaca zbernica 100 kontrolovaného mikro-počítače a ktorého prvý výstup je připojený na druhý vstup súčtového člena 30 a zároveňna druhů výstupnú svorku 211. Ostatně výstupy obvodu 21 overovania signálnych sledovsú připojené na vstupy dekódera 22 nesprávných signálnych sledov, ktorého výstupy súpřipojené na druhů výstupnú zbernicu 220. Blok 2 detekcie jě tvořený súčtovým člehom 30.ktorého výstup je připojený na tretiu výstupnú svorku 300. Činnosť obvodu podlá vynálezu je nasledovná.
Počas běhu programu je neustále sledovaný stav riadiacej zbernice 100 kontrolovanéhomikropočítača dekodérom 12 kombinácii riadiacich signálov a obvodom 21 overovania sig-nálnych sledov. Ak sa na riadiacej zbernici 100 vyskytne nesprávná kombinácia riadiacichsignálov, túto vyhodnotí dekóder 12 kombinácii riadiacich signálov a začne generovatsignál příznaku nesprávnej kombinácie riadiacich signálov. Tento zapříčiní, že na výstupesúčtového člena 30 sa začne generovat signál poruchy. Súčasne sa okamžitý stav riadiacej
Claims (1)
- CS 271713 01 2 zbernice 100, na ktorej se teraz nachádza nesprávná kombinácia riadiacich signálov, zapíšedo záchytného registra 11. Tým sa zabezpečí trvalé generovanie signálu příznaku nesprávnejkombinácie riadiacich signálov, odoberaného z prvej výstupnej svorky 120, signálov iden-tifikácie konkrétnej nesprávnej kombinácie riadiacich signálov odoberaných z prvej vý-stupnej zbernice 110 a signálu poruchy ódoberaného z tretej výstupnej svorky 300. Signálporuchy slúži na zastavenie mikropočítača pri výskyte poruchy na jeho riadiacej zbernici. Ak sa na riadiacej zbernici 100 kontrolovaného mikropočítača vyskytne nesprávný signálnysled, tento je vyhodnotený obvodom 21 overovania signálnych sledov, ktorý začne generovat’příznak nesprávného signálneho sledu, ktorý spftsobí, že na výstupe súčtového člena 30 sazačne generovat’ signál poruchy na tretej výstupnej svorke 300 a indikuje sa nesprávnýsignálny sled na druhej výstupnej svorke 211. Zároveň sa v obvode 21 overenia signálnychsledov generujú stavové signály, ktoré sa dekódujú v dekóderi 22 nesprávných signálnychsledov, z výstupu ktorého sa na druhů výstupnú zbernicu 220 dostane informácia o konkrét-nom nesprávnom signálnom slede. Obvod podl’a vynálezu je možné použit okrem kontroly riadiacej zbernice mikropočítačai na kontrolu správnej činnosti lubovolného číslicového systému, ktorý má generovat’ defi-nované postupnost signálov, pričom niektoré ich kombinácie sú nepřípustné a áalej i nakontrolu správnej činnosti lubovolného synchrónneho sekvenčného obvodu. Ako vstupné signá-ly sa použijú stavové a výstupné premenné kontrolovaného sekvenčného obvodu. PREDMET VYNÁLEZU Obvod pre kontrolu riadiacej zbernice mikropočítače, vyznačujúci sa tým, že riadiacazbernica (100) mikropočítača je připojená na vstupy obvodu (21) overovania signálnych sle-dov a zároveň na dátové vstupy záchytného registra (11), ktorého výstupy sú připojenéna prvú výstupnú.zbernicu (110) a zároveň na vstupy dekodéra (12) kombinácie riadiacichsignálov, ktorého výstup je připojený jednak na zapisovací vstup záchytného registra (11),jednak na prvú výstupnú svorku (120) a jednak na prvý vstup súčtového člena (30), ktoréhovýstup je spojený s trefou výstupnou svorkou (300) a ktorého druhý vstup je spojenýs druhou výstupnou svorkou (211) a zároveň s jednobitovým výstupom obvodu (21) overovaniasignálnych sledov, ktorého ostatné výstupy sú připojené na vstupy dekodéra (22) nesprávnýchsignálnych sledov, ktorého výstupy sú připojené na druhů výstupnú zbernicu (220). 1 výkres
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CS882480A CS271713B1 (en) | 1988-04-12 | 1988-04-12 | Circuit for microcomputer's control bus checking |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CS882480A CS271713B1 (en) | 1988-04-12 | 1988-04-12 | Circuit for microcomputer's control bus checking |
Publications (2)
Publication Number | Publication Date |
---|---|
CS248088A1 CS248088A1 (en) | 1990-03-14 |
CS271713B1 true CS271713B1 (en) | 1990-11-14 |
Family
ID=5362065
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CS882480A CS271713B1 (en) | 1988-04-12 | 1988-04-12 | Circuit for microcomputer's control bus checking |
Country Status (1)
Country | Link |
---|---|
CS (1) | CS271713B1 (cs) |
-
1988
- 1988-04-12 CS CS882480A patent/CS271713B1/cs unknown
Also Published As
Publication number | Publication date |
---|---|
CS248088A1 (en) | 1990-03-14 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4996688A (en) | Fault capture/fault injection system | |
US5748873A (en) | Fault recovering system provided in highly reliable computer system having duplicated processors | |
JPS59114652A (ja) | ウォッチドッグ・タイマ回路 | |
JP3520662B2 (ja) | 電子コントロールユニットの監視装置 | |
US5987585A (en) | One-chip microprocessor with error detection on the chip | |
JPH05225067A (ja) | 重要メモリ情報保護装置 | |
US4456996A (en) | Parallel/series error correction circuit | |
US5258885A (en) | Digital protective relay apparatus | |
CS271713B1 (en) | Circuit for microcomputer's control bus checking | |
JPH05307488A (ja) | データ転送の異常検出装置 | |
JPS5833579B2 (ja) | 情報処理装置 | |
JP3170285B2 (ja) | フォルトトレラント3ポート通信モジュール | |
EP0811194B1 (en) | Diagnostic method and apparatus with pre-assembly fault recording lock-out | |
KR20170042242A (ko) | 불휘발성 기억 장치 | |
SU590833A1 (ru) | Оперативное запоминающее устройство с защитной информации | |
JPS60233743A (ja) | 計算機システムの異常検出回路 | |
EP0382234A2 (en) | Microprocessor having improved functional redundancy monitor mode arrangement | |
JPH07129424A (ja) | Ecc機能回路の1ビット誤り検知通知装置 | |
KR960008142Y1 (ko) | Plc의 프로그램 보호회로 | |
SU1056193A1 (ru) | Устройство дл управлени восстановлением микропрограмм при сбо х | |
JPS5899841A (ja) | 部分実装された制御メモリのアドレス制御方式 | |
JPS6323598B2 (cs) | ||
JPH07160539A (ja) | マイクロコンピュータ | |
JPH02190943A (ja) | 擬似障害発生装置 | |
SU763902A1 (ru) | Микропрограммный процессор с самодиагностикой |