CN204303801U - 双面bump芯片包封后重布线的封装结构 - Google Patents
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Abstract
本实用新型涉及一种双面BUMP芯片包封后重布线封装结构及其制作方法,它包括基板(1)和芯片(2),其特征在于在所述芯片(2)上开设多个通孔(3),且在芯片(2)的正面、背面均设置有凸块(4),所述芯片(2)通过正面的凸块(4)焊接于基板(1)正面,在所述芯片(2)以及芯片(2)正面、背面的凸块(4)外围包封有塑封料(5),所述塑封料(5)的正面与芯片(2)背面的凸块(4)顶部齐平,在所述塑封料(5)的正面设置有金属线路层(6),所述金属线路层(6)与芯片(2)背面的凸块(4)相连。本实用新型提高了顶层芯片装片形式的灵活性,同时降低了产品的高度,缩短了信号传输的路径,从而能提升信号的质量。
Description
技术领域
本实用新型涉及一种双面BUMP(凸块)芯片包封后重布线的封装结构及其制作方法。属电子封装技术领域。
背景技术
目前电子封装中堆叠的产品主要有三种堆叠方式:
第一种是普通堆叠产品,其结构是在芯片上面直接堆叠芯片,然后进行打线,然后再进行包封如图4;
第二种是直接TSV堆叠的产品,其结构是在做过TSV之后的芯片上面采用FC工艺堆叠芯片如图5;
第三种是使用POP技术在塑封体之上堆叠封装如图6。
上述堆叠产品的方式存在以下不足:
第一种是普通堆叠产品,这种结构对顶层芯片有限制,不仅是芯片尺寸,而且只能采用焊线互联芯片;
第二种是直接TSV堆叠的产品,这种方法的顶层芯片倒装位置不能超出底层芯片的尺寸;
第三种是使用POP技术在塑封体之上堆叠封装如图6,这种方式的堆叠由于有顶层封装的基板,因此package整体尺寸会比较厚。
发明内容
本实用新型的目的在于克服上述不足,提供一种双面BUMP芯片包封后重布线的封装结构,提高顶层芯片装片形式的灵活性,同时降低产品的高度,缩短了信号传输的路径,从而能提升信号的质量。
本实用新型的目的是这样实现的:一种双面BUMP芯片包封后重布线封装结构,它包括基板和芯片,在所述芯片上开设多个通孔,且在芯片正面、背面均设置有凸块,所述芯片通过芯片正面的凸块焊接于基板正面,在所述芯片以及芯片正面、背面的凸块外围包封有塑封料,所述塑封料的正面与芯片背面的凸块顶部齐平,在所述塑封料的正面设置有金属线路层,所述金属线路层与芯片背面的凸块相连。
与现有技术相比,本实用新型具有以下有益效果:
1、本实用新型采用双面BUMP的芯片,包封完成后在塑封体上进行走线,引出用于顶层芯片或元器件贴装的焊盘,从而能将芯片或元器件直接贴装在塑封体之上。
2、相比传统堆叠产品,本实用新型由于采用重布线技术,因此顶层芯片装片形式将更加灵活,既可以是普通的焊线工艺的芯片,也可以是FC的芯片,或者甚至可以贴装SMT元器件。
3、相比直接TSV堆叠的产品,本实用新型由于塑封体上可以重新走线,顶层芯片倒装位置可以突破底层芯片尺寸的限制,顶层可以堆叠的芯片尺寸以及I/O位置将更加灵活。
4、相比POP的封装,本实用新型由于省去了顶层堆叠封装的基板,因此能降低产品的高度。同时,由于信号可以直接通过TSV传输,因此也缩短了信号传输的路径,从而能提升信号的质量。
附图说明
图1为本实用新型一种双面BUMP芯片包封后重布线的封装结构的结构示意图。
图2为本实用新型一种双面BUMP芯片包封后重布线的封装结构贴装FC芯片的结构示意图。
图3为本实用新型一种双面BUMP芯片包封后重布线的封装结构用于多装装片方式混合的结构示意图。
图4为采用传统普通堆叠产品的结构示意图。
图5为采用传统直接TSV堆叠产品的结构示意图。
图6为传统使用POP技术在塑封体之上堆叠封装的结构示意图。
其中:
基板1
芯片2
通孔3
凸块4
塑封料5
金属线路层6。
具体实施方式
参见图1,本实用新型涉及一种双面BUMP芯片包封后重布线封装结构,它包括基板1和芯片2,在所述芯片2上通过硅穿孔(TSV)工艺加工多个通孔3,且在芯片2的正面、背面均设置有金属凸块(BUMP)4,所述芯片2通过正面的凸块4焊接于基板1正面,在所述芯片2以及芯片2正面、背面的凸块4外围包封有塑封料5,所述塑封料5的正面与芯片2背面的凸块4顶部齐平,在所述塑封料5的正面设置有金属线路层6,所述金属线路层6与芯片2背面的凸块4相连。
所述金属线路层6实现了包封后重布线,给后续的芯片以及元器件提供电气连接。
参见图2,在上述封装结构的金属线路层6上贴装FC芯片,然后进行二次包封即可完成,参见图3,多种装片方式混合的应用,可以使用wire bond芯片,然后进行球焊,或者直接贴装SMT元器件,从而实现对芯片以及元器件的保护。
Claims (1)
1.一种双面BUMP芯片包封后重布线封装结构,它包括基板(1)和芯片(2),其特征在于在所述芯片(2)上开设多个通孔(3),且在芯片(2)的正面、背面均设置有凸块(4),所述芯片(2)通过正面的凸块(4)焊接于基板(1)正面,在所述芯片(2)以及芯片(2)正面、背面的凸块(4)外围包封有塑封料(5),所述塑封料(5)的正面与芯片(2)背面的凸块(4)顶部齐平,在所述塑封料(5)的正面设置有金属线路层(6),所述金属线路层(6)与芯片(2)背面的凸块(4)相连。
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CN201420750335.0U CN204303801U (zh) | 2014-12-04 | 2014-12-04 | 双面bump芯片包封后重布线的封装结构 |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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CN104409437A (zh) * | 2014-12-04 | 2015-03-11 | 江苏长电科技股份有限公司 | 双面bump芯片包封后重布线的封装结构及其制作方法 |
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2014
- 2014-12-04 CN CN201420750335.0U patent/CN204303801U/zh not_active Expired - Fee Related
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