CN1213220A - 降低因接入输出驱动器带来的干扰的电路设备 - Google Patents

降低因接入输出驱动器带来的干扰的电路设备 Download PDF

Info

Publication number
CN1213220A
CN1213220A CN98119731A CN98119731A CN1213220A CN 1213220 A CN1213220 A CN 1213220A CN 98119731 A CN98119731 A CN 98119731A CN 98119731 A CN98119731 A CN 98119731A CN 1213220 A CN1213220 A CN 1213220A
Authority
CN
China
Prior art keywords
output driver
supply power
power voltage
circuit arrangement
delay
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN98119731A
Other languages
English (en)
Other versions
CN1156081C (zh
Inventor
Z·曼约基
C·斯谢特
R·巴藤施拉格
R·施内德
Original Assignee
Siemens AG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Siemens AG filed Critical Siemens AG
Publication of CN1213220A publication Critical patent/CN1213220A/zh
Application granted granted Critical
Publication of CN1156081C publication Critical patent/CN1156081C/zh
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/16—Modifications for eliminating interference voltages or currents
    • H03K17/161—Modifications for eliminating interference voltages or currents in field-effect transistor switches
    • H03K17/162—Modifications for eliminating interference voltages or currents in field-effect transistor switches without feedback from the output circuit to the control circuit

Landscapes

  • Electronic Switches (AREA)
  • Logic Circuits (AREA)
  • Pulse Circuits (AREA)

Abstract

本发明涉及用延迟节(13)降低因接入一具有多级的输出驱动器(11,12)带来干扰的电路设备。延迟节是这样构成的,即:供电电压越高,则由它对各级提供的接通或断开信号的信号延迟越大。

Description

降低因接入输出驱动器带来的干扰的电路设备
本发明涉及降低因接入输出驱动器带来的干扰的电路设备，其中将在各单级之间具有时间延迟的开关信号，输送给用于接通和断开输出驱动器的各单级，以便逐级接通输出驱动器。这类电路设备由例如DE4200680A1和专业书“Digital MOS IntegratedCircuit Ⅱ”Mohamed Ⅰ.Elmasry 1992,ISBN 0-87942-275-0,p385～392，尤其是p388的图5所公知。
当输出驱动器级同时接到各自的输出级时，在具有大量输出端，例如16或更多的输出端的数字半导体结构器件内，出现供电电压的严重干扰。此外这种现象一般也作为“dI/dt噪声”，“本底脉动噪声”，“同时开关噪声”等公知。在接通和断开高输出电流时干扰最大。
这意味着：供电电压越高，在同时开关多个输出驱动器级时，影响供电电压的干扰越大，因为高供电电压恰好是对开关大输出电流所必需的。
现在为了设法补救，已经有一种电路设备，在该电路设备不再同时接通彼此并行安放的输出驱动器级，而是有时间延迟接通，以便降低受同时接通制约的供电电压的干扰。通过彼此并行安放的单输出驱动器级的这种时间延迟或分级接通，限制因数字半导体结构器件的寄生电感制约的电流变化。
图3给出了具有输出驱动器级1,2的这种电路设备，这些输出驱动器级1,2，经一输入接头3控制，并且并联在输出接头4上。输出驱动器级1,2的控制是这样实现的，首先控制输出驱动器级1，紧接着控制输出驱动器级2，其中这种延迟通过延迟节5实现。这时延迟节5是这样工作的，由延迟节5提供的时间延迟，随供电电压VCC的上升而减少。
各单个输出端驱动器级相互的时间延迟接通，对于降低上述供电电压的干扰显示极大的优点。但是这个优点是通过各单个输出驱动器级的时间延迟接通提高相应的电路设备的总的信号延迟而达到的。此外，当接通单个输出驱动器级之间的时间延迟最长时，即在较低的供电电压条件下，这种不希望的效应最强。其原因在于：在应用普通输出驱动器的传统的电路设备里，具有较低供电电压的信号延迟变长。换句话说，供电电压越高，则单个输出驱动级之间的时间延迟越短。但是这意味着：在较高的供电电压情况下，当本来出现最多干扰时，干扰减小的效果最小。因此，为降低因接通输出驱动器产生的干扰的现行电路设备，特别在高供电电压情况下的工作完全不能令人满意，因为通过输出驱动器级间形成的短时间延迟越来越难避免干扰。
因此本发明的任务是改进本文一开始所述类型的电路设备，使得该电路设备能够在高供电电压情况下也保证有效的降低干扰。
根据本发明在为降低因接通输出驱动器产生干扰的电路设备里，该任务以下方式解决，即：供电电压越高，则接通信号越迟地输送给输出驱动器。换句话说，在本发明的电路设备里，供电电压越高，则接通信号的信号延迟就越大。
于是对本发明的电路设备重要的是：随着供电电压上升在各单个输出驱动器级的接通或断开间的延迟变大。因此，这是只有在实际上必需时，即在变高的供电电压情况下，干扰才被降低。在“最不利的情况下”，当供电电压极高，因而干扰也很大时，延迟最大，这又重新导致干扰最明显的降低。
促使供电电压越高，接通信号或断开信号越慢输送给输出驱动器级的延迟电路能以不同方式实施。一可能的例子在于：提出具有电流源的传统的CMOS变换电路作为延迟电路。这种电流源在这里限制变换电路的所谓的“下拉”(Pull-down)，电流，以致在供电电压上升时，较迟接通或断开串接的输出驱动器级。
本发明依靠附图详细说明如下。即：
图1本发明电路设备的一实施例，
图2延迟电路可能的有利的实施例，
图3具有两个输出驱动器级和一个现行的延迟电路的电路原理图。
图3在本文一开始已经解释，在图中对于彼此相当的构件应用相同的相关符号。
图1给出本发明电路设备的一实施例。由N沟道MOS晶体管构成的输出驱动器级11经过变换电路(Inverter)8,9接到输入接头3，以及也由N沟道MOS晶体管构成的输出驱动器级12经一延迟节13和一变换电路10接到输入接头3上。因此，变换电路8,9和10以及延迟节13处于供电电压VCC和参考电压VSS之间。
与现行的电路设备(参照图3)的延迟节5相反，延迟节13是这样工作的，即随着供电电压上升延迟增加。
抛弃技术现状，本发明的电路设备具有延迟节13，在延迟节13随着供电电压VCC上升延迟增加。这就是说，供电电压VCC越高，输出驱动器级11和12接通或断开之间时间延迟越长。
图2形象化说明延迟节13的一种可能的实施例。在该实施例中延迟节13由一CMOS变换电路6和与其串联的由一晶体管7构成的恒流源组成。恒流源限制CMOS变换电路6的“下拉”电流，以致在这里随着供电电压VCC上升在输入端和输出端之间得到的延时增加。这时晶体管7栅极上的供电电压VB用于调整所希望的延迟。

Claims (4)

1．电路设备，降低因接入一具有多级的输出驱动器(11,12)带来的干扰，其中在各单级之间具有时间延迟的开关信号输送给接通和断开输出驱动器(11,12)的各单级，以便逐级接通输出驱动器级(11,12)，其特征为：供电电压(VCC)越高，开关信号输入给输出驱动器级(11,12)越迟。
2．根据权利要求1所述的电路设备，其特征为：输出驱动器(11,12)的控制输入端之间接入一延迟节(13)。
3．根据权利要求2所述的电路设备，其特征为：延迟节(13)由一CMOS变换电路(6)和与其串联的恒流源组成。
4．根据权要求3所述的电路设备，其特征为：恒流源具有一晶体管(7)。
CNB981197310A 1997-09-30 1998-09-29 降低因接入输出驱动器带来的干扰的电路设备 Expired - Fee Related CN1156081C (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
DE19743284A DE19743284C1 (de) 1997-09-30 1997-09-30 Schaltungsanordnung zur Reduzierung von Störungen infolge des Schaltes eines Ausgangstreibers
DE19743284.0 1997-09-30

Publications (2)

Publication Number Publication Date
CN1213220A true CN1213220A (zh) 1999-04-07
CN1156081C CN1156081C (zh) 2004-06-30

Family

ID=7844213

Family Applications (1)

Application Number Title Priority Date Filing Date
CNB981197310A Expired - Fee Related CN1156081C (zh) 1997-09-30 1998-09-29 降低因接入输出驱动器带来的干扰的电路设备

Country Status (7)

Country Link
US (1) US6069486A (zh)
EP (1) EP0928067B1 (zh)
JP (1) JPH11163700A (zh)
KR (1) KR100361901B1 (zh)
CN (1) CN1156081C (zh)
DE (2) DE19743284C1 (zh)
TW (1) TW425760B (zh)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6906548B1 (en) * 2000-11-02 2005-06-14 Tokyo Electron Limited Capacitance measurement method of micro structures of integrated circuits
JP2005050123A (ja) * 2003-07-28 2005-02-24 Nec Micro Systems Ltd スキュー補正回路
DE10355509A1 (de) 2003-11-27 2005-07-07 Infineon Technologies Ag Schaltung und Verfahren zum verzögerten Einschalten einer elektrischen Last
JP4079923B2 (ja) * 2004-07-26 2008-04-23 エヌイーシーコンピュータテクノ株式会社 ベクトル処理装置、情報処理装置、および、ベクトル処理方法

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0171022A3 (en) * 1984-07-31 1988-02-03 Yamaha Corporation Signal delay device
DE4200680A1 (de) * 1992-01-14 1993-07-15 Bosch Gmbh Robert Treiberschaltung
US5329175A (en) * 1992-11-13 1994-07-12 Advanced Micro Devices, Inc. Reduced noise, low power, high speed output buffer
KR960001791B1 (ko) * 1993-07-23 1996-02-05 현대전자산업주식회사 데이타 출력장치
US5424653A (en) * 1993-10-06 1995-06-13 Advanced Micro Devices, Inc. Gradual on output buffer circuit including a reverse turn-off apparatus
US5428303A (en) * 1994-05-20 1995-06-27 National Semiconductor Corporation Bias generator for low ground bounce output driver
US5781050A (en) * 1996-11-15 1998-07-14 Lsi Logic Corporation Open drain output driver having digital slew rate control

Also Published As

Publication number Publication date
EP0928067B1 (de) 2003-05-14
KR100361901B1 (ko) 2003-01-24
KR19990029916A (ko) 1999-04-26
DE19743284C1 (de) 1999-03-11
DE59808351D1 (de) 2003-06-18
CN1156081C (zh) 2004-06-30
US6069486A (en) 2000-05-30
TW425760B (en) 2001-03-11
JPH11163700A (ja) 1999-06-18
EP0928067A1 (de) 1999-07-07

Similar Documents

Publication Publication Date Title
US5355029A (en) Staged CMOS output buffer
CA1257342A (en) Integrated logic circuit incorporating a module which generates a control signal that cancels switching noise
US20020097071A1 (en) Output buffer with constant switching current
EP1316146A2 (en) Circuit for producing low-voltage differential signals
EP0463854A1 (en) Clocked driver circuit
US6459325B1 (en) Output buffer having a pre-driver transition controller
CN110011521B (zh) 驱动电路、驱动芯片及其驱动方法
US7212033B2 (en) High speed transient immune differential level shifting device
JPH06311020A (ja) 高周波回路の出力ドライバ
CN1156081C (zh) 降低因接入输出驱动器带来的干扰的电路设备
EP0361841B1 (en) Bicmos logic circuit
US6265892B1 (en) Low noise output buffer
CN103618440A (zh) 一种高功率的边缘控制输出缓冲器
CN1288290A (zh) 半导体集成电路的输入缓冲器
US20050116753A1 (en) Circuit and method for switching an electrical load on after a delay
KR100197388B1 (ko) 반도체 집적 회로 및 그 제조 방법
CN107835011A (zh) 一种高可靠性三态输出电路
US5057713A (en) Bipolar MOS logic circuit and semiconductor integrated circuit
US5160857A (en) Integratable transistor switch unit of the ntl logic family
JPH0239621A (ja) Ｔｔｌ出力ドライバゲート構成
US20020177266A1 (en) Selectable output edge rate control
US5442304A (en) CMOS logic gate clamping circuit
JP5015029B2 (ja) 昇圧回路に用いられる電流制御回路
CN1118926C (zh) 用于具有陡沿的输入信号的在一侧关断电流的输入放大器
JPS63240128A (ja) 論理回路

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
C14 Grant of patent or utility model
GR01 Patent grant
ASS Succession or assignment of patent right

Owner name: INFINEON TECHNOLOGIES AG

Free format text: FORMER OWNER: SIEMENS AKTIENGESELLSCHAFT

Effective date: 20130220

C41 Transfer of patent application or patent right or utility model
TR01 Transfer of patent right

Effective date of registration: 20130220

Address after: German Neubiberg

Patentee after: Infineon Technologies AG

Address before: Munich, Germany

Patentee before: Siemens AG

Effective date of registration: 20130220

Address after: Munich, Germany

Patentee after: QIMONDA AG

Address before: German Neubiberg

Patentee before: Infineon Technologies AG

C41 Transfer of patent application or patent right or utility model
TR01 Transfer of patent right

Effective date of registration: 20151228

Address after: German Berg, Laura Ibiza

Patentee after: Infineon Technologies AG

Address before: Munich, Germany

Patentee before: QIMONDA AG

CF01 Termination of patent right due to non-payment of annual fee

Granted publication date: 20040630

Termination date: 20160929

CF01 Termination of patent right due to non-payment of annual fee