CN114744971A - 一种ab类运算放大器 - Google Patents

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Abstract

本发明公开了一种AB类运算放大器，涉及放大器领域，该AB类运算放大器包括：控制信号，用于控制叠加电路偏压供给电路和输出MOS管偏压控制电路的偏压大小；叠加电路偏压供给电路，用于为叠加电路供给偏压；输出MOS管偏压控制电路，用于为输出MOS管供给偏压；叠加电路，用于控制MOS管放大信号；输出MOS管电路，与现有技术相比，本发明的有益效果是：本发明在叠加架构里面新增偏压BIAS3和BIAS4，BIAS3、BIAS4控制输出MOS管的偏压，而原先的BIAS1和BIAS2偏压还是为叠加电路供给偏压，这样使得叠加架构偏压和输出MOS管的偏压可以分别独立调整，来达到节省AB运算放大器的直流电流。

Description

一种AB类运算放大器
技术领域
本发明涉及放大器领域，具体是一种AB类运算放大器。
背景技术
运算放大器（简称“运放”）是具有很高放大倍数的电路单元。在实际电路中，通常结合反馈网络共同组成某种功能模块。它是一种带有特殊耦合电路及反馈的放大器。
一般传统的AB类运算放大器在叠加架构里面的偏压只有BIAS1和BIAS2，请参阅图1，因BIAS1和BIAS2供给叠加电路的偏压和输出MOS管POUT的G极偏压两者共享，无法独立可以调整，又因为AB类运算放大器为了提供大的电流负载给下一级电路，输出MOS管POUT的直流电流较大，所以使得输出MOS管POUT在不提供电流负载时，它的直流电流会比较大，需要改进。
发明内容
本发明的目的在于提供一种AB类运算放大器，以解决上述背景技术中提出的问题。
为实现上述目的，本发明提供如下技术方案：
一种AB类运算放大器，包括：
控制信号，用于控制叠加电路偏压供给电路和输出MOS管偏压控制电路的偏压大小；
叠加电路偏压供给电路，用于为叠加电路供给偏压；
输出MOS管偏压控制电路，用于为输出MOS管供给偏压；
叠加电路，用于控制MOS管放大信号；
输出MOS管电路，用于输出电压给下一级电路；
控制信号连接叠加电路偏压供给电路、输出MOS管偏压控制电路，叠加电路偏压供给电路连接叠加电路，输出MOS管偏压控制电路连接输出MOS管电路。
作为本发明再进一步的方案：控制信号包括供压设备INPUT，供压设备INPUT的第一端连接叠加电路偏压供给电路，供压设备INPUT的第二端连接输出MOS管偏压控制电路。
作为本发明再进一步的方案：叠加电路偏压供给电路包括偏压BIAS1、偏压BIAS2，偏压BIAS1的第一端连接偏压BIAS2的第一端、叠加电路的第一端，偏压BIAS1的第二端连接偏压BIAS2的第二端、叠加电路的第二端。
作为本发明再进一步的方案：输出MOS管偏压看电路包括偏压BIAS3、偏压BIAS4，偏压BIAS3的第一端连接偏压BIAS4的第一端、输出MOS管电路的第一端，偏压BIAS3的第二端连接偏压BIAS4的第二端、输出MOS管电路的第二端。
作为本发明再进一步的方案：叠加电路包括MOS管V1、MOS管V2、MOS管V3、MOS管V4，MOS管V1的第一端连接MOS管V1的第三端、MOS管V2的第三端、MOS管V2的第一端、偏压BIAS1的第一端，MOS管V1的第二端连接MOS管V2的第二端、供电电压VCC，MOS管V3的第一端连接MOS管V3的第三端、MOS管V4的第三端、MOS管V4的第一端、偏压BIAS1的第二端，MOS管V3的第二端接地，MOS管V4的第二端接地。
作为本发明再进一步的方案：输出MOS管电路包括MOS管VA、MOS管VB，MOS管VA的第二端连接偏压BIAS3的第一端，MOS管VB的第二端连接偏压BIAS3的第二端，MOS管VA的第一端连接MOS管VB的第一端、输出电压OUT，MOS管VA的第三端连接供电电压VCC，MOS管VB的第三端接地。
作为本发明再进一步的方案：MOS管VA为输出MOS管POUT，MOS管VB为输出MOS管NOUT。
与现有技术相比，本发明的有益效果是：本发明在叠加架构里面新增偏压BIAS3和BIAS4，BIAS3、BIAS4控制输出MOS管的偏压，而原先的BIAS1和BIAS2偏压还是为叠加电路供给偏压，这样使得叠加架构偏压和输出MOS管的偏压可以分别独立调整，来达到节省AB运算放大器的直流电流。
附图说明
图1为传统AB类运算放大器的电路图。
图2为一种AB类运算放大器的电路图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例，基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
请参阅图2，一种AB类运算放大器，包括：
控制信号，用于控制叠加电路偏压供给电路和输出MOS管偏压控制电路的偏压大小；
叠加电路偏压供给电路，用于为叠加电路供给偏压；
输出MOS管偏压控制电路，用于为输出MOS管供给偏压；
叠加电路，用于控制MOS管放大信号；
输出MOS管电路，用于输出电压给下一级电路；
控制信号连接叠加电路偏压供给电路、输出MOS管偏压控制电路，叠加电路偏压供给电路连接叠加电路，输出MOS管偏压控制电路连接输出MOS管电路。
在本实施例中：请参阅图2，控制信号包括供压设备INPUT，供压设备INPUT的第一端连接叠加电路偏压供给电路，供压设备INPUT的第二端连接输出MOS管偏压控制电路。
供压设备INPUT的输出电压可调，因此，分别输出给叠加电路偏压供给电路和输出MOS管偏压控制电路的电压可调，使得叠加电路和输出MOS管电路的偏压可调。
在本实施例中：请参阅图2，叠加电路偏压供给电路包括偏压BIAS1、偏压BIAS2，偏压BIAS1的第一端连接偏压BIAS2的第一端、叠加电路的第一端，偏压BIAS1的第二端连接偏压BIAS2的第二端、叠加电路的第二端。
偏压BIAS1和偏压BIAS2为叠加电路提供偏压，使叠加电路的MOS管导通。完成电压（电流）放大。
在本实施例中：请参阅图2，输出MOS管偏压看电路包括偏压BIAS3、偏压BIAS4，偏压BIAS3的第一端连接偏压BIAS4的第一端、输出MOS管电路的第一端，偏压BIAS3的第二端连接偏压BIAS4的第二端、输出MOS管电路的第二端。
偏压BIAS3、偏压BIAS4为输出MOS管电路提供偏压，使输出MOS管电路的MOS观导通，完成电压（电流）输出。
偏压BIAS3、偏压BIAS4为MOS管V2、V4提供电压，同时偏压BIAS3、偏压BIAS4从外部的调整机制来调节偏压的大小，以此来调整MOS管VA和VB的G极电压；偏压BIAS3、偏压BIAS4和偏压BIAS1、偏压BIAS2为两组，分别由控制信号INPUT控制。
在本实施例中：请参阅图2，叠加电路包括MOS管V1、MOS管V2、MOS管V3、MOS管V4，MOS管V1的第一端连接MOS管V1的第三端、MOS管V2的第三端、MOS管V2的第一端、偏压BIAS1的第一端，MOS管V1的第二端连接MOS管V2的第二端、供电电压VCC，MOS管V3的第一端连接MOS管V3的第三端、MOS管V4的第三端、MOS管V4的第一端、偏压BIAS1的第二端，MOS管V3的第二端接地，MOS管V4的第二端接地。
获得偏压后，MOS管V1、MOS管V2、MOS管V3、MOS管V4导通，导通后经过偏压BIAS1、BIAS2处的电压增大，又反过来输出给MOS管V1、MOS管V2、MOS管V3、MOS管V4的第三端，导通程度增加，最终使得MOS管V1、MOS管V2、MOS管V3、MOS管V4完全导通。
在本实施例中：请参阅图2，输出MOS管电路包括MOS管VA、MOS管VB，MOS管VA的第二端连接偏压BIAS3的第一端，MOS管VB的第二端连接偏压BIAS3的第二端，MOS管VA的第一端连接MOS管VB的第一端、输出电压OUT，MOS管VA的第三端连接供电电压VCC，MOS管VB的第三端接地。
获得偏压后，MOS管VA、VB导通输出电压OUT，为下一级电路供电。
在本实施例中：请参阅图2，MOS管VA为输出MOS管POUT，MOS管VB为输出MOS管NOUT。
MOS管VA、VB为输出MOS管。
本发明的工作原理是：控制信号控制叠加电路偏压供给电路和输出MOS管偏压控制电路的偏压大小，叠加电路偏压供给电路为叠加电路供给偏压，输出MOS管偏压控制电路为输出MOS管供给偏压，叠加电路控制MOS管放大信号，输出MOS管电路输出电压给下一级电路。
对于本领域技术人员而言，显然本发明不限于上述示范性实施例的细节，而且在不背离本发明的精神或基本特征的情况下，能够以其他的具体形式实现本发明。因此，无论从哪一点来看，均应将实施例看作是示范性的，而且是非限制性的，本发明的范围由所附权利要求而不是上述说明限定，因此旨在将落在权利要求的等同要件的含义和范围内的所有变化囊括在本发明内。不应将权利要求中的任何附图标记视为限制所涉及的权利要求。
此外，应当理解，虽然本说明书按照实施方式加以描述，但并非每个实施方式仅包含一个独立的技术方案，说明书的这种叙述方式仅仅是为清楚起见，本领域技术人员应当将说明书作为一个整体，各实施例中的技术方案也可以经适当组合，形成本领域技术人员可以理解的其他实施方式。

Claims (7)

1.一种AB类运算放大器，其特征在于：
该AB类运算放大器包括：
控制信号，用于控制叠加电路偏压供给电路和输出MOS管偏压控制电路的偏压大小；
叠加电路偏压供给电路，用于为叠加电路供给偏压；
输出MOS管偏压控制电路，用于为输出MOS管供给偏压；
叠加电路，用于控制MOS管放大信号；
输出MOS管电路，用于输出电压给下一级电路；
控制信号连接叠加电路偏压供给电路、输出MOS管偏压控制电路，叠加电路偏压供给电路连接叠加电路，输出MOS管偏压控制电路连接输出MOS管电路。
2.根据权利要求1所述的AB类运算放大器，其特征在于，控制信号包括供压设备INPUT，供压设备INPUT的第一端连接叠加电路偏压供给电路，供压设备INPUT的第二端连接输出MOS管偏压控制电路。
3.根据权利要求1所述的AB类运算放大器，其特征在于，叠加电路偏压供给电路包括偏压BIAS1、偏压BIAS2，偏压BIAS1的第一端连接偏压BIAS2的第一端、叠加电路的第一端，偏压BIAS1的第二端连接偏压BIAS2的第二端、叠加电路的第二端。
4.根据权利要求1所述的AB类运算放大器，其特征在于，输出MOS管偏压看电路包括偏压BIAS3、偏压BIAS4，偏压BIAS3的第一端连接偏压BIAS4的第一端、输出MOS管电路的第一端，偏压BIAS3的第二端连接偏压BIAS4的第二端、输出MOS管电路的第二端。
5.根据权利要求3所述的AB类运算放大器，其特征在于，叠加电路包括MOS管V1、MOS管V2、MOS管V3、MOS管V4，MOS管V1的第一端连接MOS管V1的第三端、MOS管V2的第三端、MOS管V2的第一端、偏压BIAS1的第一端，MOS管V1的第二端连接MOS管V2的第二端、供电电压VCC，MOS管V3的第一端连接MOS管V3的第三端、MOS管V4的第三端、MOS管V4的第一端、偏压BIAS1的第二端，MOS管V3的第二端接地，MOS管V4的第二端接地。
6.根据权利要求4所述的AB类运算放大器，其特征在于，输出MOS管电路包括MOS管VA、MOS管VB，MOS管VA的第二端连接偏压BIAS3的第一端，MOS管VB的第二端连接偏压BIAS3的第二端，MOS管VA的第一端连接MOS管VB的第一端、输出电压OUT，MOS管VA的第三端连接供电电压VCC，MOS管VB的第三端接地。
7.根据权利要求6所述的AB类运算放大器，其特征在于，MOS管VA为输出MOS管POUT，MOS管VB为输出MOS管NOUT。
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