CN112885304A - 像素电路、显示面板和像素电路的驱动方法 - Google Patents

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Abstract

本发明实施例公开了一种像素电路、显示面板和像素电路的驱动方法。像素电路包括：驱动晶体管、存储模块、发光控制模块、第一初始化模块和补偿模块；像素电路还包括耦合模块，耦合模块连接于所述驱动晶体管的栅极和第三开关信号之间；所述耦合模块用于响应第三开关信号的突变，使所述驱动晶体管的栅极电位发生耦合变化。与现有技术相比，本发明实施例提升了显示面板显示的均匀性，优化了像素电路的性能。

Description

像素电路、显示面板和像素电路的驱动方法
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路、显示面板和像素电路的驱动方法。
背景技术
随着显示技术的不断发展，用户对显示屏的显示效果的要求越来越高，业界对显示效果的研究一直保持较高的关注。其中，有源矩阵有机发光二极管(AMOLED)可实现高分辨率和大尺寸面板显示，且具有响应速度快、工作电压低、宽视角和可柔性弯曲等优点。因此，OLED显示面板是继液晶显示面板之后的又一新型平板显示技术。
与液晶显示面板不同的是，OLED显示面板需要稳定的电流来控制发光器件的发光亮度。在现有技术中，OLED显示面板中的像素电路在驱动发光器件稳定发光方面起到了非常重要的作用。然而，现有的像素驱动电路的性能还不够理想，无法保证均匀性显示的要求。
发明内容
本发明实施例提供一种像素电路、显示面板和像素电路的驱动方法，以提升显示面板显示的均匀性，优化像素电路的性能。
为实现上述技术目的，本发明实施例提供了如下技术方案：
一种像素电路，包括：
驱动晶体管，用于向发光器件提供驱动电流；
存储模块，用于存储所述驱动晶体管的栅极和第一极的电位差；
发光控制模块，用于响应发光控制信号，使所述驱动晶体管的第一极和第二极分别接通电压，形成驱动电流通路；
第一初始化模块，用于响应第一开关信号，使第一初始化信号写入所述驱动晶体管的栅极；
补偿模块，用于响应第二开关信号，使数据信号经由所述驱动晶体管的第一极和第二极写入所述驱动晶体管的栅极，完成对所述驱动晶体管的阈值电压补偿；
耦合模块，连接于所述驱动晶体管的栅极和第三开关信号之间；所述耦合模块用于响应所述第三开关信号的突变，使所述驱动晶体管的栅极电位发生耦合变化。
可选地，所述第二开关信号复用为所述第三开关信号，所述耦合模块连接于所述驱动晶体管的栅极和所述第二开关信号之间。
可选地，所述数据信号复用为所述第一初始化信号；
可选地，所述第一初始化模块包括第一晶体管，所述第一晶体管的栅极接入所述第一开关信号，所述第一晶体管的第一极接入所述数据信号，所述第一晶体管的第二极与所述驱动晶体管的栅极电连接。
可选地，所述第一开关信号复用为所述第三开关信号，所述耦合模块连接于所述驱动晶体管的栅极和所述第一开关信号之间。
可选地，所述存储模块包括第一电容，所述第一电容连接于第一电源信号和所述驱动晶体管的栅极之间；
所述耦合模块包括第二电容，所述第二电容连接于所述第三开关信号和所述驱动晶体管的栅极之间。
可选地，所述补偿模块包括第二晶体管和第三晶体管；所述第二晶体管的栅极接入所述第二开关信号，所述第二晶体管的第一极接入所述数据信号，所述第二晶体管的第二极与所述驱动晶体管的第一极电连接；所述第三晶体管的栅极接入所述第二开关信号，所述第三晶体管的第一极与所述驱动晶体管的第二极电连接，所述第三晶体管的第二极与所述驱动晶体管栅极电连接；
可选地，所述发光控制模块包括第四晶体管和第五晶体管，所述第四晶体管的栅极接入所述发光控制信号，所述第四晶体管的第一极接入第一电源信号，所述第四晶体管的第二极与所述驱动晶体管的第一极电连接；所述第五晶体管的栅极接入所述发光控制信号，所述第五晶体管的第一极与所述驱动晶体管的第二极电连接，所述第五晶体管的第二极与所述发光器件的第一极电连接，所述发光器件的第二极接入第二电源信号。
可选地，所述像素电路还包括第二初始化模块，所述第二初始化模块用于响应第四开关信号，使第二初始化信号写入所述发光器件；
可选地，所述第二初始化模块包括第六晶体管，所述第六晶体管的栅极接入所述第四开关信号，所述第六晶体管的第一极接入所述第二初始化信号，所述第六晶体管的第二极与所述发光器件电连接；
可选地，所述第一开关信号或所述第二开关信号复用为所述第四开关信号；
可选地，所述第一初始化信号复用为所述第二初始化信号。
相应地，本发明还提供了一种显示面板，包括：如本发明任意实施例所述像素电路。
相应地，本发明还提供了一种像素电路的驱动方法，其适用于本发明任意实施例所述的像素电路，所述驱动方法包括：初始化阶段、补偿阶段和发光阶段；
在所述初始化阶段，所述第一初始化模块响应第一开关信号，使第一初始化信号写入所述驱动晶体管的栅极；
在所述补偿阶段，所述补偿模块响应第二开关信号，使数据信号经由所述驱动晶体管的第一极和第二极写入所述驱动晶体管的栅极，完成对所述驱动晶体管的阈值电压补偿；同时，所述存储模块存储所述驱动晶体管的栅极电位；
在所述发光阶段，所述发光控制模块响应发光控制信号，使所述驱动晶体管的第一极和第二极分别接通电压，形成驱动电流通路，所述驱动晶体管向发光器件提供驱动电流；
其中，在所述初始化阶段、所述补偿阶段和所述发光阶段中的至少一个阶段，所述第三开关信号的电位突变，经由所述耦合模块使所述驱动晶体管的栅极电位耦合突变，以调整所述驱动晶体管的栅极电位。
可选地，所述第三开关信号在所述初始化阶段为第二电位，在所述补偿阶段突变为第一电位；
或者，所述第三开关信号在所述初始化阶段前为第二电位，在所述初始化阶段突变为第一电位；
或者，所述第三开关信号在所述初始化阶段为第一电位，在所述补偿阶段突变为第二电位。
本发明实施例设置像素电路包括驱动晶体管、存储模块、发光控制模块、第一初始化模块、补偿模块和耦合模块，其中，耦合模块连接于驱动晶体管的栅极和第三开关信号之间；耦合模块用于响应第三开关信号的突变，使驱动晶体管的栅极电位发生耦合变化。本发明实施例在实现阈值电压补偿、提升显示面板的均匀性的基础上，可以有选择地设置第三开关信号的突变节点，从而在耦合模块的耦合作用下，使得驱动晶体管的栅极电位在合适的阶段发生相应的变化，以及，在发光阶段辅助存储模块对驱动晶体管的栅极电压进行存储，实现了提升像素电路的稳定性、提升刷新频率的有益效果，从而进一步优化了像素电路的性能。
附图说明
图1为本发明实施例提供的一种像素电路的结构示意图；
图2为本发明实施例提供的一种像素电路的驱动时序示意图；
图3为本发明实施例提供的另一种像素电路的驱动时序示意图；
图4为本发明实施例提供的另一种像素电路的结构示意图；
图5为本发明实施例提供的又一种像素电路的驱动时序示意图；
图6为本发明实施例提供的又一种像素电路的结构示意图；
图7为本发明实施例提供的又一种像素电路的结构示意图；
图8为本发明实施例提供的又一种像素电路的结构示意图；
图9为本发明实施例提供的又一种像素电路的结构示意图；
图10为本发明实施例提供的又一种像素电路的结构示意图；
图11为本发明实施例提供的又一种像素电路的驱动时序示意图；
图12为本发明实施例提供的又一种像素电路的结构示意图；
图13为本发明实施例提供的又一种像素电路的结构示意图；
图14为本发明实施例提供的又一种像素电路的结构示意图；
图15为本发明实施例提供的一种像素电路的驱动方法的流程示意图；
图16为本发明实施例提供的另一种像素电路的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
正如背景技术所述，现有的显示面板存在无法保证均匀性显示的问题，出现该问题的原因如下：
在现有的像素电路中，驱动晶体管在驱动发光器件发光时工作在饱和区。在饱和区，随着栅源电压的升高，驱动电流逐渐变大。令驱动晶体管的栅极电压为数据信号Vdata，驱动晶体管的源极电压为第一电源信号VDD，则驱动晶体管产生的驱动电流Ioled为：
Figure BDA0002900059870000031
式中，W为沟道宽度，L为沟道长度，μeff为电子迁移率，Cox为单位面积沟道电容，Vth为阈值电压。其中，阈值电压Vth受工艺波动影响较大，相同的栅源电压uGS可能会产生不同的驱动电流Ioled。因此，现有的显示面板随着阈值电压Vth的差异变化，驱动电流Ioled的差异较大，无法保证均匀性显示。
有鉴于此，本发明实施例提供了一种像素电路。图1为本发明实施例提供的一种像素电路的结构示意图。参见图1，像素电路包括：驱动晶体管M7、存储模块100、发光控制模块200、第一初始化模块300、补偿模块400和耦合模块500。驱动晶体管M7用于向发光器件OLED提供驱动电流；存储模块100用于存储驱动晶体管M7的栅极和第一极S的电位差；发光控制模块200用于响应发光控制信号EM，使驱动晶体管M7的第一极和第二极分别接通电压，形成驱动电流通路；第一初始化模块300用于响应第一开关信号S1，使第一初始化信号Vref1写入驱动晶体管M7的栅极；补偿模块400用于响应第二开关信号S2，使数据信号Vdata经由驱动晶体管M7的第一极和第二极写入驱动晶体管M7的栅极，完成对驱动晶体管M7的阈值电压补偿；耦合模块500连接于驱动晶体管M7的栅极和第三开关信号S3之间；耦合模块500用于响应第三开关信号S3的突变，使驱动晶体管M7的栅极电位发生耦合变化。
驱动晶体管M7包括栅极、第一极和第二极，将驱动晶体管M7的栅极命名为像素电路的节点G；驱动晶体管M7的第一极通常称为源极，将其命名为像素电路的节点S；驱动晶体管M7的第二极通常称为漏极，将其命名为像素电路的节点D。由于在显示面板中晶体管的结构对称，因此对驱动晶体管M7的源极和漏极不做区分。
本发明实施例对驱动晶体管M7的沟道类型不做限定，驱动晶体管M7的沟道类型可以是P型，也可以是N型。下面以驱动晶体管M7的沟道类型为P型对像素电路的具体电路结构进行说明。
继续参见图1，可选地，耦合模块500包括第一端501和第二端502，第一端501接入第三开关信号S3，第二端502与节点G电连接。耦合模块500具备电压耦合功能，能够在像素电路的工作阶段(例如，初始化阶段、补偿阶段和/或发光阶段)使得节点G的电压由于耦合作用而适应调整，以满足实际需求。
第一初始化模块300具备开关功能，第一初始化模块300包括第一端301、第二端302和第三端303。其中，第三端303为控制端，接入第一开关信号S1。第一端301接入第一初始化信号Vref1，第二端302与节点G电连接。第一初始化模块300在第一开关信号S1的控制下，改变第一端301和第二端302的开关状态。当第一端301和第二端302导通时，驱动晶体管M7的栅极接通第一初始化信号Vref1，对驱动晶体管M7的栅极进行初始化，确保在下一阶段(补偿阶段)驱动晶体管M7处于导通状态，以便于数据信号Vdata写入驱动晶体管M7的栅极。
补偿模块400具备数据写入和阈值补偿功能，补偿模块400包括第一端401、第二端402、第三端403、第四端404、第五端405和第六端406。其中，第五端405和第六端406为控制端，接入第二开关信号S2。第一端401接入数据信号Vdata，第二端402与节点S电连接，第三端403与节点D电连接，第四端404与节点G电连接。补偿模块400在第二开关信号S2的控制下，改变第一端401和第二端402的开关状态，同时改变第三端403和第四端404的开关状态。当第一端401和第二端402导通、第三端403和第四端404导通时，节点S接收数据信号Vdata，数据信号Vdata通过导通的驱动晶体管M7传输至节点D，继而传输至节点G。由于驱动晶体管M7的导通特性，节点G(同节点D)与节点S存在一阈值电压差，若驱动晶体管M7为P型晶体管，数据信号Vdata和阈值电压Vth均为负值，那么，节点G的电压高于节点S的电压，节点G的电压为Vdata-Vth；若驱动晶体管M7为N型晶体管，数据信号Vdata和阈值电压Vth均为正值，那么，节点G的电压低于数据信号Vdata的电压，节点G的电压为Vdata-Vth。与现有技术中节点G的电压写入数据电压Vdata相比，本发明实施例可以在后续驱动电流的公式中消去阈值电压，实现对驱动晶体管M7的阈值电压补偿。
发光控制模块200具备开关功能，发光控制模块200包括第一端201、第二端202、第三端203、第四端204、第五端205和第六端206。其中，第五端205和第六端206为控制端，接入发光控制信号EM。第一端201接入第一电源信号VDD，第二端202与节点S电连接，第三端203与节点D电连接，第四端204与发光器件OLED的阳极电连接，第五端205和第六端206接入发光控制信号EM。发光控制模块200在发光控制信号EM的控制下，改变第一端201和第二端202的开关状态，同时改变第三端203和第四端204的开关状态。当第一端201和第二端202导通时，驱动晶体管M7的源极接通第一电源电压，第三端203和第四端204导通时，驱动晶体管M7的漏极接通发光器件OLED，进而接通第二电源电压。
存储模块100包括第一端101和第二端102，第一端101接入第一电源信号VDD，第二端102与节点G电连接。存储模块100具备电压存储功能，例如，存储模块100包括电容等器件，能够在发光阶段保持节点G和节点S的压差稳定。
其中，第一开关信号S1、第二开关信号S2和发光控制信号EM均由显示面板的GIP电路提供信号，在像素电路的工作过程中发生高低电平的突变，以此来控制各模块的导通和断开。第三开关信号S3也是一种开关信号，可以由显示面板的GIP电路提供信号，在像素电路的工作过程中发生高低电平的突变。耦合模块500具备耦合功能，与存储模块100类似，耦合模块500也可以包括电容等器件，能够在第三开关信号S3发生突变时，调整驱动晶体管M7的栅极电位，以使像素电路的性能优化。
第三开关信号S3在不同的阶段突变可以产生不同的效果，例如，第三开关信号S3在由初始化阶段切换到补偿阶段时发生突变，可以确保驱动晶体管M7在补偿阶段可靠导通；又如，第三开关信号S3在切换到初始化阶段时发生突变，可以提升充电速度等，下面进行具体说明。
图2为本发明实施例提供的一种像素电路的驱动时序示意图。结合图1和图2，示例性地，第一开关信号S1、第二开关信号S2和发光控制信号EM为高电平时，相应的模块断开，第一开关信号S1、第二开关信号S2和发光控制信号EM为低电平时，相应的模块导通。像素电路的驱动过程包括初始化阶段T1、补偿阶段T2和发光阶段T3。第一开关信号S1在初始化阶段T1为低电平，在补偿阶段T2和发光阶段T3为高电平；第二开关信号S2在补偿阶段T2为低电平，在初始化阶段T1和发光阶段T3为高电平；发光控制信号EM在发光阶段T3为低电平，在初始化阶段T1和补偿阶段T2为高电平。
在一种实施方式中，可选地，第三开关信号S3在初始化阶段T1为高电平，在补偿阶段T2和发光阶段T3为低电平。
具体地，在初始化阶段T1，补偿模块400响应第二开关信号S2的高电平而断开，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的低电平而导通，使第一初始化信号Vref1写入节点G(耦合模块500的第二端502、存储模块100的第二端102)。其中，节点G的电压为第一初始化信号Vref1，即节点G的电压Vg1＝Vref1。第三开关信号S3的电压为VGH，VGH＞0。
在补偿阶段T2，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的高电平而断开。由于第三开关信号S3由高电平突变为低电平，即耦合模块500的第一端501电位被下拉。又由于耦合模块500的耦合作用，节点G的电位也被下拉，即节点G的电压小于Vg1。对于P沟道的驱动晶体管M7，电压越低，打开的越充分，因此，本发明实施例能够在补偿阶段T2确保驱动晶体管M7顺利导通，数据信号Vdata经由导通的驱动晶体管M7写入节点G，节点G的电压逐渐升高，直至节点G与节点S的压差达到Vth，此时，Vg2＝Vdata+Vth。
在发光阶段T3，发光控制模块200响应发光控制信号EM的低电位而导通。可以使驱动晶体管M7的源极接通第一电源信号VDD，驱动晶体管M7的漏极接通发光器件OLED，进而接通第二电源信号VSS。此时，驱动晶体管M7产生的驱动电流Ioled为：
Figure BDA0002900059870000061
由此可见，本发明实施例提供的像素电路产生的驱动电流Ioled与驱动晶体管M7的阈值电压均不相关，仅与数据信号Vdata和第一电源信号VDD相关，从而实现了阈值电压的补偿，有利于避免驱动电流Ioled受到阈值电压的影响，提升了显示面板显示的均匀性，提升了显示画质。另外，本发明实施例设置第三开关信号S3能够在补偿阶段T2确保驱动晶体管M7导通，并在发光阶段T3辅助存储模块100对节点G的电压进行存储，使得驱动电路的性能更加稳定。
图3为本发明实施例提供的另一种像素电路的驱动时序示意图。参见图3，与图2不同的是，图3中限定第三开关信号S3在初始化阶段T1前的阶段(空白阶段)为高电平，在初始化阶段T1、补偿阶段T2和发光阶段T3为低电平。结合图1和图3，对本实施方式中的像素电路的驱动过程进行分析。
具体地，在初始化阶段T1，补偿模块400响应第二开关信号S2的高电平而断开，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的低电平而导通，使第一初始化信号Vref1写入节点G(耦合模块500的第二端502、存储模块100的第二端102)。节点G的电压为第一初始化信号Vref1，Vref1＜0，即节点G的电压逐渐降低，直至Vg1＝Vref1。其中，由于第三开关信号S3由高电平突变为低电平，即耦合模块500的第一端501电位被下拉。又由于耦合模块500的耦合作用，节点G的电位也被下拉，因此，有利于减少栅极复位时间，保证初始化效果，进而有利于提高像素电路的刷新频率。
在补偿阶段T2，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的高电平而断开。补偿模块400响应第二开关信号S2的低电平而导通，数据信号Vdata经由导通的驱动晶体管M7写入节点G，节点G的电压逐渐升高，直至节点G与节点S的压差达到Vth，此时，Vg2＝Vdata+Vth。
在发光阶段T3，发光控制模块200响应发光控制信号EM的低电位而导通。可以使驱动晶体管M7的源极接通第一电源信号VDD，驱动晶体管M7的漏极接通发光器件OLED，进而接通第二电源信号VSS。此时，驱动晶体管M7产生的驱动电流Ioled可以消除阈值电压的影响。
由此可见，本发明实施例提供的像素电路有利于避免驱动电流Ioled受到阈值电压的影响，提升了显示面板显示的均匀性，提升了显示画质。另外，本发明实施例设置第三开关信号S3能够在初始化阶段T1下拉节点G的电位，有利于减少栅极复位的时间，有利于提升刷新频率，并在发光阶段T3辅助存储模块100对节点G的电压进行存储，使得驱动电路的性能更加稳定。
在一种实施方式中，可选地，还可以限定第三开关信号S3在初始化阶段T1为低电平，在补偿阶段T2和发光阶段T3为高电平。这样，在补偿阶段T2，由于第三开关信号S3由低电平突变为高电平，即耦合模块500的第一端501电位被抬高。又由于耦合模块500的耦合作用，节点G的电位也被抬高，使得节点G的电压在补偿阶段T2的开始时刻和结束时刻的压差降低。因此，本实施方式有利于减少补偿阶段T2的时间，有利于在提升刷新频率的基础上，保证数据写入的效果。
由此可见，本发明实施例在实现阈值电压补偿、提升显示面板均匀性的基础上，通过设置耦合模块500连接在第三开关信号S3和节点G之间，可以有选择地设置第三开关信号S3的突变节点，从而在耦合模块500的耦合作用下，使得节点G的电位在合适的阶段发生相应的变化，以及，在发光阶段T3辅助存储模块100对节点G的电压进行存储，实现了提升像素电路的稳定性、提升刷新频率的有益效果，从而进一步优化了像素电路的性能。
在上述各实施例的基础上，第三开关信号S3可以由其他的信号复用，以简化GIP电路和/或控制模块的设置，下面就其中的几种信号复用的设置方式进行说明，但不作为对本发明的限定。
图4为本发明实施例提供的另一种像素电路的结构示意图，图5为本发明实施例提供的又一种像素电路的驱动时序示意图。参见图4和图5，在本发明的一种实施方式中，可选地，第二开关信号S2复用为第三开关信号S3，耦合模块500连接于驱动晶体管M7的栅极和第二开关信号S2之间。
示例性地，在初始化阶段T1，第一开关信号S1为低电平，第二开关信号S2为高电平，发光控制信号EM为高电平；补偿模块400响应第二开关信号S2的高电平而断开，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的低电平而导通，使第一初始化信号Vref1写入驱动晶体管M7的栅极(节点G)。其中，节点G的电压为第一初始化信号Vref1，即节点G的电压Vg1＝Vref1。第二开关信号S2的电压为VGH，那么，耦合模块500的两端电压差为Vref1-VGH，VGH＞0。
在补偿阶段T2，第一开关信号S1为高电平，第二开关信号S2为低电平，发光控制信号EM为高电平；发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的高电平而断开；第一初始化模块300响应第一开关信号S1的低电平而导通。其中，由于第二开关信号S2由高电平突变为低电平，即耦合模块500的第一端501的电位变化量为VGL-VGH，VGL＜0，又由于耦合模块500和存储模块100作用，节点G的电位变化量为▲1＝[C2/(C1+C2)]×(VGL-VGH)＜0，C1为存储模块100的电容，C2为耦合模块500的电容，VGH为开关信号的高电平电压，VGL为开关信号的低电平电压。即节点G的电位被下拉，节点G的电压为：
Vg2＝Vref1+▲1＝Vref1+[C2/(C1+C2)]×(VGL-VGH)＜Vg1
因此，本发明实施例能够在补偿阶段T2确保驱动晶体管M7顺利导通，数据信号Vdata经由导通的驱动晶体管M7写入驱动晶体管M7的栅极(节点G)，使得节点G的电压升高至Vg3＝Vdata+Vth。
在发光阶段T3，第一开关信号S1为高电平，第二开关信号S2为高电平，发光控制信号EM为低电平；发光控制模块200响应发光控制信号EM的低电位而导通。其中，由于第二开关信号S2由低电平突变为高电平，即耦合模块500的第一端501的电位变化量为VGH-VGL，又由于存储模块100和耦合模块500的耦合作用，节点G的电位变化量为▲2＝[C2/(C1+C2)]×(VGH-VGL)＞0，即节点G的电位被上拉，节点G的电压为Vg4＝Vdata+Vth+▲2。并在发光阶段T3保持该电位，以有利于节点G的电位存储，产生稳定的驱动电流。驱动晶体管M7产生的驱动电流Ioled为：
Figure BDA0002900059870000081
其中，驱动电流Ioled与节点G的电位变化量▲2相关，由于变化量▲2为定值，本领域技术人员可以理解，通过在数据信号Vdata中补偿变化量▲2，可以消去变化量▲2。
继续参见图4，可选地，数据信号Vdata复用为第一初始化信号Vref1。在现有技术中，为了确保数据信号Vdata能够可靠写入节点G，需要设置第一初始化信号Vref1的电位低于数据信号Vdata的电位。与现有技术不同的是，本发明实施例能够在补偿阶段T2拉低节点G的电位，因此，本发明实施例采用数据信号Vdata复用为第一初始化信号Vref1，可以在确保对节点G的可靠复位的基础上，减少控制信号线的数量和驱动IC的设计难度。
图6为本发明实施例提供的又一种像素电路的结构示意图。参见图6，在上述各实施例的基础上，可选地，存储模块100包括第一电容C1，第一电容C1连接于第一电源信号VDD和驱动晶体管M7的栅极之间；耦合模块500包括第二电容C2，第二电容C2连接于第三开关信号S3和驱动晶体管M7的栅极之间。本发明实施例设置存储模块100和耦合模块500中均只包括一个电容，使得电路结构简单，易于实现。
图7为本发明实施例提供的又一种像素电路的结构示意图。参见图7，在上述各实施例的基础上，可选地，第一初始化模块300包括第一晶体管M1，第一晶体管M1的栅极接入第一开关信号S1，第一晶体管M1的第一极接入数据信号Vdata，第一晶体管M1的第二极与驱动晶体管M7的栅极电连接。本发明实施例设置第一初始化模块300仅包括一个晶体管，有利于简化电路结构，易于实现。
继续参见图7，可选地，补偿模块400包括第二晶体管M2和第三晶体管M3；第二晶体管M2的栅极接入第二开关信号S2，第二晶体管M2的第一极接入数据信号Vdata，第二晶体管M2的第二极与驱动晶体管M7的第一极电连接；第三晶体管M3的栅极接入第二开关信号S2，第三晶体管M3的第一极与驱动晶体管M7的第二极电连接，第三晶体管M3的第二极与驱动晶体管M7栅极电连接。本发明实施例设置补偿模块400包括第二晶体管M2和第三晶体管M3，有利于简化电路结构，易于实现。
继续参见图7，可选地，发光控制模块200包括第四晶体管M4和第五晶体管M5，第四晶体管M4的栅极接入发光控制信号EM，第四晶体管M4的第一极接入第一电源信号VDD，第四晶体管M4的第二极与驱动晶体管M7的第一极电连接；第五晶体管M5的栅极接入发光控制信号EM，第五晶体管M5的第一极与驱动晶体管M7的第二极电连接，第五晶体管M5的第二极与发光器件OLED的第一极电连接，发光器件OLED的第二极接入第二电源信号VSS。本发明实施例设置发光控制模块200包括第四晶体管M4和第三晶体管M3，有利于简化电路结构，易于实现。
图8为本发明实施例提供的又一种像素电路的结构示意图。参见图8，在上述各实施例的基础上，可选地，像素电路还包括第二初始化模块600，第二初始化模块600用于响应第四开关信号S4，使第二初始化信号Vref2写入发光器件OLED。示例性地，第四开关信号S4可以控制第二初始化模块600在初始化阶段T1和/或补偿阶段T2导通，以对发光器件OLED的阳极进行初始化，确保发光器件OLED的发光效果。
可选地，若第一开关信号S1复用为第四开关信号S4，可以在初始化阶段T1对发光器件OLED的阳极进行初始化；若第二开关信号S2复用为第四开关信号S4，可以在补偿阶段T2对发光器件OLED的阳极进行初始化。本发明实施例通过开关信号的复用，有利于减少信号线的数量，以及简化驱动IC的设计难度。
可选地，第一初始化信号Vref1复用为第二初始化信号Vref2。其中，为了实现对发光器件OLED的阳极初始化的效果，需要将第二初始化信号Vref2设置为负值，以实现对发光器件OLED的初始化；对于P型驱动晶体管M7而言，第一初始化信号Vref1为负值，因此，第一初始化信号Vref1和第二初始化信号Vref2可以复用。
继续参见图8，可选地，第二初始化模块600包括第六晶体管M6，第六晶体管M6的栅极接入第四开关信号S4，第六晶体管M6的第一极接入第二初始化信号Vref2，第六晶体管M6的第二极与发光器件OLED电连接。本发明实施例设置第二初始化模块600包括第六晶体管M6，有利于简化像素电路的结构，易于实现。
继续参见图8，可选地，与驱动晶体管M7为P型晶体管相同，各模块中的各晶体管也为P型晶体管，以简化制作工艺。
图9为本发明实施例提供的又一种像素电路的结构示意图。参见图9，与上述各实施例不同的是，驱动晶体管M7为N型晶体管。对于N沟道型的驱动晶体管M7，定义其与发光器件OLED的阳极连接的一极为源极，定义其与第一电源信号VDD连接的一极为漏极。那么，像素电路各模块之间的连接关系如下：
耦合模块500的第一端501接入第三开关信号S3，第二端502与节点G电连接。第一初始化模块300的第一端301接入第一初始化信号Vref1，第二端302与节点G电连接，第三端303接入第一开关信号S1。补偿模块400的第一端401接入数据信号Vdata，第二端402与节点S电连接，第三端403与节点D电连接，第四端404与节点G电连接，第五端405和第六端406接入第二开关信号S2。发光控制模块200的第一端201接入第一电源信号VDD，第二端202与节点D电连接，第三端203与节点S电连接，第四端204与发光器件OLED的阳极电连接，第五端205和第六端206接入发光控制信号EM。存储模块100的第一端101与发光器件OLED的阳极电连接，第二端102与节点G电连接。存储模块100具备电压存储功能，能够在发光阶段T3保持节点G和节点S的压差稳定。
继续参见图9，可选地，与驱动晶体管M7的沟道类型一致，各模块中的晶体管均设置为N型晶体管，以简化工艺。与驱动晶体管M7为P型晶体管不同，驱动晶体管M7为N型晶体管时，数据信号Vdata为正值，驱动晶体管M7和各模块在高电平的控制下导通，因此，数据信号Vdata和第一初始化信号Vref1均为高电平。第二开关信号S2在补偿阶段T2由低电平突变为高电平，由于耦合模块500的耦合作用，驱动晶体管M7的栅极电位被拉高，确保驱动晶体管M7的导通。
图10为本发明实施例提供的又一种像素电路的结构示意图，图11为本发明实施例提供的又一种像素电路的驱动时序示意图。参见图10和图11，在本发明的一种实施方式中，可选地，第一开关信号S1复用为第三开关信号S3，耦合模块500连接于驱动晶体管M7的栅极和第一开关信号S1之间。
示例性地，在初始化阶段T1，补偿模块400响应第二开关信号S2的高电平而断开，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的低电平而导通，使第一初始化信号Vref1写入节点G(耦合模块500的第二端502、存储模块100的第二端102)。节点G的电压为第一初始化信号Vref1，Vref1＜0，即节点G的电压逐渐降低，直至Vg1＝Vref1。同时，由于第一开关信号S1由高电平突变为低电平，即耦合模块500的第一端501电位被下拉。又由于耦合模块500的耦合作用，节点G的电位也被下拉，因此，有利于减少栅极复位时间，保证初始化效果，有利于提高显示面板的刷新频率。
在补偿阶段T2，发光控制模块200响应发光控制信号EM的高电平而断开；第一初始化模块300响应第一开关信号S1的高电平而断开。补偿模块400响应第二开关信号S2的低电平而导通，数据信号Vdata经由导通的驱动晶体管M7写入节点G，由于第三开关信号S3由低电平突变为高电平，即耦合模块500的第一端501电位被抬高。又由于耦合模块500的耦合作用，节点G的电位也被抬高，即节点G的电压高于Vref1，Vg1＝Vref1+▲3，▲3＝(VGH-VGL)×[C2/(C1+C2)]，使得节点G的电压在补偿阶段T2的开始时刻被抬高，节点G的电压以Vg1为起点逐渐升高，直至节点G与节点S的压差达到Vth，此时，Vg3＝Vdata+Vth。这使得节点G的电压在补偿阶段T2的开始时刻和结束时刻的压差降低。因此，本实施方式有利于减少补偿阶段T2的时间，有利于在提升刷新频率的基础上，保证数据写入的效果。
图12为本发明实施例提供的又一种像素电路的结构示意图。参见图12，在上述各实施例的基础上，可选地，存储模块100包括第一电容C1，第一电容C1连接于第一电源信号VDD和驱动晶体管M7的栅极之间；耦合模块500包括第二电容C2，第二电容C2连接于第三开关信号S3和驱动晶体管M7的栅极之间。本发明实施例设置存储模块100和耦合模块500中均只包括一个电容，使得电路结构简单，易于实现。
图13为本发明实施例提供的又一种像素电路的结构示意图。参见图13，在上述各实施例的基础上，可选地，初始化模块包括第一晶体管M1，第一晶体管M1的栅极接入第一开关信号S1，第一晶体管M1的第一极接入第一初始化信号Vref1，第一晶体管M1的第二极与驱动晶体管M7的栅极电连接。本发明实施例设置初始化模块仅包括一个晶体管，有利于简化电路结构，易于实现。
继续参见图13，可选地，补偿模块400包括第二晶体管M2和第三晶体管M3；第二晶体管M2的栅极接入第二开关信号S2，第二晶体管M2的第一极接入数据信号Vdata，第二晶体管M2的第二极与驱动晶体管M7的第一极电连接；第三晶体管M3的栅极接入第二开关信号S2，第三晶体管M3的第一极与驱动晶体管M7的第二极电连接，第三晶体管M3的第二极与驱动晶体管M7栅极电连接。本发明实施例设置补偿模块400包括第二晶体管M2和第三晶体管M3，有利于简化电路结构，易于实现。
继续参见图13，可选地，发光控制模块200包括第四晶体管M4和第五晶体管M5，第四晶体管M4的栅极接入发光控制信号EM，第四晶体管M4的第一极接入第一电源信号VDD，第四晶体管M4的第二极与驱动晶体管M7的第一极电连接；第五晶体管M5的栅极接入发光控制信号EM，第五晶体管M5的第一极与驱动晶体管M7的第二极电连接，第五晶体管M5的第二极与发光器件OLED的第一极电连接，发光器件OLED的第二极接入第二电源信号VSS。本发明实施例设置发光控制模块200包括第四晶体管M4和第三晶体管M3，有利于简化电路结构，易于实现。
继续参见图13，可选地，像素电路还包括第二初始化模块600，第二初始化模块600用于响应第四开关信号S4，使第二初始化信号Vref2写入发光器件OLED。示例性地，第四开关信号S4可以控制第二初始化模块600在初始化阶段T1和/或补偿阶段T2导通，以对发光器件OLED的阳极进行初始化，确保发光器件OLED的发光效果。
可选地，若第一开关信号S1复用为第四开关信号S4，可以在初始化阶段T1对发光器件OLED的阳极进行初始化；若第二开关信号S2复用为第四开关信号S4，可以在补偿阶段T2对发光器件OLED的阳极进行初始化。本发明实施例通过开关信号的复用，有利于减少信号线的数量，以及简化驱动模块的设置。
继续参见图13，可选地，第二初始化模块600包括第六晶体管M6，第六晶体管M6的栅极接入第四开关信号S4，第六晶体管M6的第一极接入第二初始化信号Vref2，第六晶体管M6的第二极与发光器件OLED电连接。本发明实施例设置第二初始化模块600包括第六晶体管M6，有利于简化像素电路的结构，易于实现。
继续参见图13，可选地，与驱动晶体管M7为P型晶体管相同，各模块中的各晶体管也为P型晶体管，以简化制作工艺。
图14为本发明实施例提供的又一种像素电路的结构示意图。参见图14，与上述各实施例不同的是，驱动晶体管M7为N型晶体管。对于N沟道型的驱动晶体管M7，定义其与发光器件OLED的阳极连接的一极为源极，定义其与第一电源信号VDD连接的一极为漏极。那么，像素电路各模块之间的连接关系如下：
耦合模块500的第一端501接入第三开关信号S3，第二端502与节点G电连接。第一初始化模块300的第一端301接入第一初始化信号Vref1，第二端302与节点G电连接，第三端303接入第一开关信号S1。补偿模块400的第一端401接入数据信号Vdata，第二端402与节点S电连接，第三端403与节点D电连接，第四端404与节点G电连接，第五端405和第六端406接入第二开关信号S2。发光控制模块200的第一端201接入第一电源信号VDD，第二端202与节点D电连接，第三端203与节点S电连接，第四端204与发光器件OLED的阳极电连接，第五端205和第六端206接入发光控制信号EM。存储模块100的第一端101与发光器件OLED的阳极电连接，第二端102与节点G电连接。存储模块100具备电压存储功能，能够在发光阶段T3保持节点G和节点S的压差稳定。
继续参见图14，可选地，与驱动晶体管M7的沟道类型一致，各模块中的晶体管均设置为N型晶体管，以简化工艺。与驱动晶体管M7为P型晶体管不同，驱动晶体管M7为N型晶体管时，数据信号Vdata为正值，驱动晶体管M7和各模块在高电平的控制下导通，因此，数据信号Vdata和第一初始化信号Vref1均为高电平。第一开关信号S1在初始化阶段T1由低电平突变为高电平，由于耦合模块500的耦合作用，驱动晶体管M7的栅极电位被拉高，有利于第一初始化信号Vref1的快速写入。以及，第一开关信号S1在补偿阶段T2由高电平突变为低电平，由于耦合模块500的耦合作用，驱动晶体管M7的栅极电位被拉低，有利于数据信号Vdata的快速写入。
本发明实施例还提供了一种显示面板，该显示面板包括如本发明任意实施例所提供的像素电路，其技术原理和产生的效果类似，不再赘述。
本发明实施例还提供了一种像素电路的驱动方法，该驱动方法适用于本发明任意实施例所提供的像素电路。驱动方法包括：初始化阶段、补偿阶段和发光阶段。
在初始化阶段，第一初始化模块响应第一开关信号，使第一初始化信号写入驱动晶体管的栅极，以确保驱动晶体管在补偿阶段开始时处于导通状态。
在补偿阶段，补偿模块响应第二开关信号，使数据信号经由驱动晶体管的第一极和第二极写入驱动晶体管的栅极，完成对驱动晶体管的阈值电压补偿；同时，存储模块存储驱动晶体管的栅极电位。
其中，数据信号经由导通的驱动晶体管写入驱动晶体管的栅极，驱动晶体管的栅极的电压逐渐变化，直至其电压达到Vdata+Vth。这样，能够在发光阶段，在驱动电流公式中，将阈值电压Vth消除，实现阈值电压补偿。
在发光阶段，发光控制模块响应发光控制信号，使驱动晶体管的第一极和第二极分别接通电压，形成驱动电流通路，驱动晶体管向发光器件提供驱动电流。
其中，在初始化阶段、补偿阶段和发光阶段中的至少一个阶段，第三开关信号的电位突变，经由耦合模块使驱动晶体管的栅极电位耦合突变，以调整驱动晶体管的栅极电位。
本发明实施例提供的像素电路产生的驱动电流与驱动晶体管的阈值电压均不相关，仅与数据信号和第一电源信号相关，从而实现了阈值电压的补偿，有利于避免驱动电流受到阈值电压的影响，提升了显示面板显示的均匀性，提升了显示画质。另外，本发明实施例在实现阈值电压补偿的基础上，通过设置耦合模块连接在第三开关信号和驱动晶体管的栅极之间，可以有选择地设置第三开关信号的突变节点，从而在耦合模块的耦合作用下，使得驱动晶体管的栅极电位在合适的阶段发生相应的变化，以及，在发光阶段辅助存储模块对驱动晶体管的栅极电压进行存储，实现了提升像素电路的稳定性、提升刷新频率的有益效果，从而进一步优化了像素电路的性能。
图15为本发明实施例提供的一种像素电路的驱动方法的流程示意图。参见图15，在本发明的一种实施方式中，可选地，第二开关信号复用为第三开关信号，第三开关信号在初始化阶段为第二电位，在补偿阶段突变为第一电位。驱动方法包括以下步骤：
S110、在初始化阶段，第二开关信号为第二电位；第一开关信号为第一电位，控制第一初始化模块导通，使数据信号写入驱动晶体管的栅极。
S120、在补偿阶段，第一开关信号为第二电位，控制第一初始化模块断开；第二开关信号由第二电位突变为第一电位，驱动晶体管的栅极电位耦合突变，确保驱动晶体管导通，数据信号经由导通的驱动晶体管写入驱动晶体管的栅极。
其中，若驱动晶体管为P型晶体管，数据信号为负值，第一电位为低电平，第二电位为高电平。第二开关信号在补偿阶段由高电平突变为低电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉低，确保驱动晶体管的导通。
若驱动晶体管为N型晶体管，数据信号为正值，第一电位为高电平，第二电位为低电平。第二开关信号在补偿阶段由低电平突变为高电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉高，确保驱动晶体管的导通。
S130、在发光阶段，发光控制信号为第一电位，控制发光控制模块导通；第二开关信号由第一电位突变为第二电位；驱动晶体管的栅极电位耦合突变，驱动晶体管响应其栅极电位和第一极电位产生驱动电流，驱动发光器件发光。
本发明实施例提供的像素电路产生的驱动电流Ioled与驱动晶体管DT的阈值电压均不相关，仅与数据信号DATA和第一电源信号相关，从而实现了阈值电压的补偿，有利于避免驱动电流Ioled受到阈值电压的影响，提升了显示面板显示的均匀性，提升了显示画质。另外，本发明实施例设置第三开关信号能够在补偿阶段确保驱动晶体管导通，并在发光阶段辅助存储模块对节点G的电压进行存储，使得驱动电路的性能更加稳定。
图16为本发明实施例提供的另一种像素电路的驱动方法的流程示意图。参见图16，在本发明的一种实施方式中，可选地，第一开关信号复用为第三开关信号，第三开关信号在初始化阶段前为第二电位，在初始化阶段突变为第一电位，在补偿阶段突变为第二电位。驱动方法包括以下步骤：
S210、在初始化阶段，第一开关信号由第二电位突变为第一电位，在驱动晶体管的栅极电位耦合突变的同时，控制第一初始化模块导通，使第一初始化信号写入驱动晶体管的栅极。
其中，若驱动晶体管为P型晶体管，第一初始化信号和数据信号为负值，第一电位为低电平，第二电位为高电平。第一开关信号在初始化阶段由高电平突变为低电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉低，有利于第一初始化信号的快速写入。
若驱动晶体管为N型晶体管，第一初始化信号和数据信号为正值，第一电位为高电平，第二电位为低电平。第一开关信号在初始化阶段由低电平突变为高电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉高，有利于第一初始化信号的快速写入。
S220、在补偿阶段，第一开关信号由第一电位突变为第二电位，驱动晶体管的栅极电位耦合突变；同时，第二开关信号为第一电位，数据信号经由导通的驱动晶体管写入驱动晶体管的栅极。
其中，若驱动晶体管为P型晶体管，第一初始化信号和数据信号为负值，且第一初始化信号低于数据信号，第一电位为低电平，第二电位为高电平。第一开关信号在补偿阶段由低电平突变为高电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉高，有利于数据信号的快速写入。
若驱动晶体管为N型晶体管，第一初始化信号和数据信号为正值，且第一初始化信号高于数据信号，第一电位为高电平，第二电位为低电平。第一开关信号在补偿阶段由高电平突变为低电平，由于耦合模块的耦合作用，驱动晶体管的栅极电位被拉低，有利于数据信号的快速写入。
S230、在发光阶段，发光控制信号为第一电位，控制发光控制模块导通；驱动晶体管响应其栅极电位和第一极电位产生驱动电流，驱动发光器件发光。
本发明实施例在实现阈值电压补偿的基础上，设置第三开关信号能够在初始化阶段下拉驱动晶体管的栅极电位，在补偿阶段上拉驱动晶体管的栅极电位，有利于减少栅极复位的时间和数据写入的时间，有利于提升刷新频率，并在发光阶段辅助存储模块对驱动晶体管的栅极电压进行存储，使得驱动电路的性能更加稳定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素电路，其特征在于，包括：
驱动晶体管，用于向发光器件提供驱动电流；
存储模块，用于存储所述驱动晶体管的栅极和第一极的电位差；
发光控制模块，用于响应发光控制信号，使所述驱动晶体管的第一极和第二极分别接通电压，形成驱动电流通路；
第一初始化模块，用于响应第一开关信号，使第一初始化信号写入所述驱动晶体管的栅极；
补偿模块，用于响应第二开关信号，使数据信号经由所述驱动晶体管的第一极和第二极写入所述驱动晶体管的栅极，完成对所述驱动晶体管的阈值电压补偿；
耦合模块，连接于所述驱动晶体管的栅极和第三开关信号之间；所述耦合模块用于响应所述第三开关信号的突变，使所述驱动晶体管的栅极电位发生耦合变化。
2.根据权利要求1所述的像素电路，其特征在于，所述第二开关信号复用为所述第三开关信号，所述耦合模块连接于所述驱动晶体管的栅极和所述第二开关信号之间。
3.根据权利要求2所述的像素电路，其特征在于，所述数据信号复用为所述第一初始化信号；
可选地，所述第一初始化模块包括第一晶体管，所述第一晶体管的栅极接入所述第一开关信号，所述第一晶体管的第一极接入所述数据信号，所述第一晶体管的第二极与所述驱动晶体管的栅极电连接。
4.根据权利要求1所述的像素电路，其特征在于，所述第一开关信号复用为所述第三开关信号，所述耦合模块连接于所述驱动晶体管的栅极和所述第一开关信号之间。
5.根据权利要求1-4任一项所述的像素电路，其特征在于，所述存储模块包括第一电容，所述第一电容连接于第一电源信号和所述驱动晶体管的栅极之间；
所述耦合模块包括第二电容，所述第二电容连接于所述第三开关信号和所述驱动晶体管的栅极之间。
6.根据权利要求1所述的像素电路，其特征在于，所述补偿模块包括第二晶体管和第三晶体管；所述第二晶体管的栅极接入所述第二开关信号，所述第二晶体管的第一极接入所述数据信号，所述第二晶体管的第二极与所述驱动晶体管的第一极电连接；所述第三晶体管的栅极接入所述第二开关信号，所述第三晶体管的第一极与所述驱动晶体管的第二极电连接，所述第三晶体管的第二极与所述驱动晶体管栅极电连接；
可选地，所述发光控制模块包括第四晶体管和第五晶体管，所述第四晶体管的栅极接入所述发光控制信号，所述第四晶体管的第一极接入第一电源信号，所述第四晶体管的第二极与所述驱动晶体管的第一极电连接；所述第五晶体管的栅极接入所述发光控制信号，所述第五晶体管的第一极与所述驱动晶体管的第二极电连接，所述第五晶体管的第二极与所述发光器件的第一极电连接，所述发光器件的第二极接入第二电源信号。
7.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括第二初始化模块，所述第二初始化模块用于响应第四开关信号，使第二初始化信号写入所述发光器件；
可选地，所述第二初始化模块包括第六晶体管，所述第六晶体管的栅极接入所述第四开关信号，所述第六晶体管的第一极接入所述第二初始化信号，所述第六晶体管的第二极与所述发光器件电连接；
可选地，所述第一开关信号或所述第二开关信号复用为所述第四开关信号；
可选地，所述第一初始化信号复用为所述第二初始化信号。
8.一种显示面板，其特征在于，包括：如权利要求1-7任一项所述像素电路。
9.一种像素电路的驱动方法，其特征在于，所述像素电路包括驱动晶体管、发光控制模块、第一初始化模块、补偿模块、存储模块和耦合模块，其中，所述耦合模块连接于所述驱动晶体管的栅极和第三开关信号之间；
所述驱动方法包括：初始化阶段、补偿阶段和发光阶段；
在所述初始化阶段，所述第一初始化模块响应第一开关信号，使第一初始化信号写入所述驱动晶体管的栅极；
在所述补偿阶段，所述补偿模块响应第二开关信号，使数据信号经由所述驱动晶体管的第一极和第二极写入所述驱动晶体管的栅极，完成对所述驱动晶体管的阈值电压补偿；同时，所述存储模块存储所述驱动晶体管的栅极电位；
在所述发光阶段，所述发光控制模块响应发光控制信号，使所述驱动晶体管的第一极和第二极分别接通电压，形成驱动电流通路，所述驱动晶体管向发光器件提供驱动电流；
其中，在所述初始化阶段、所述补偿阶段和所述发光阶段中的至少一个阶段，所述第三开关信号的电位突变，经由所述耦合模块使所述驱动晶体管的栅极电位耦合突变，以调整所述驱动晶体管的栅极电位。
10.根据权利要求9所述的像素电路的驱动方法，其特征在于，所述第三开关信号在所述初始化阶段为第二电位，在所述补偿阶段突变为第一电位；
或者，所述第三开关信号在所述初始化阶段前为第二电位，在所述初始化阶段突变为第一电位；
或者，所述第三开关信号在所述初始化阶段为第一电位，在所述补偿阶段突变为第二电位。
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