CN112669746A - 用于驱动显示装置的半导体集成电路 - Google Patents
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Abstract
本发明涉及一种用于驱动显示装置的半导体集成电路,尤其涉及如下的半导体集成电路,其用于驱动显示器以将伽马电压经由连接有多个伽马电压电路的伽马总线供给至各个DAC。
Description
技术领域
本发明涉及用于驱动显示装置的半导体集成电路。
背景技术
随着社会越来越以信息为导向,对需要显示装置的产品的需求已增加。近年来,使用各种显示装置,诸如液晶显示装置、等离子体显示装置或有机发光二极管显示装置等。
因此,正在开发用于改善显示装置的图像质量的各种技术。这些技术其中之一是用于高速驱动显示面板的技术。由于布置在显示面板上的像素的数量增加以提高图像质量,因此需要用于高速驱动显示面板的技术,以在与先前相同的时间段或在比先前更短的时间段驱动所有的众多像素。
显示面板可以由被称为源极驱动器或列驱动器等的数据驱动装置驱动,并且上述高速驱动技术与数据驱动装置有关。数据驱动装置通常接收表示各像素的灰度的图像数据,将该图像数据转换成采用模拟形式的数据电压,并且将该数据电压供给至各像素以驱动显示面板。为了高速驱动显示面板,需要高速执行上述过程。
发明内容
在该背景下,本发明的一方面提供用于高速驱动显示面板的技术。本发明的另一方面提供用于在数据驱动装置中高速处理信号的技术。本发明的又一方面提供用于在以半导体集成电路(IC)的形式实现的数据驱动装置中高速处理信号的技术。
为此,本发明的实施例提供一种半导体集成电路,其包括多个通道电路、伽马总线、以及多个伽马电压电路。
用于显示驱动的半导体集成电路可以由单个半导体封装体或一个集成电路形成。
各通道电路可以包括数模转换器(DAC),所述DAC用于根据像素图像数据来选择多个伽马电压其中之一并生成数据电压,并且各通道电路将所述数据电压供给至与子像素连接的数据线。
所述伽马总线可以提供将所述多个伽马电压发送至各通道电路的DAC所经由的路径。
各伽马电压电路可以通过对参考电压进行分压来生成所述多个伽马电压,并且在分压点处与所述伽马总线连接。
所述多个通道电路可以沿着第一方向布置,并且所述多个伽马电压电路可以沿着所述第一方向以彼此间隔开的方式布置。
各像素可以包括多个子像素,并且所述伽马总线可以包括多个子伽马总线。用于驱动所述多个子像素中的第一子像素的通道电路和用于驱动第二子像素的通道电路可以与第一子伽马总线连接,并且用于驱动第三子像素的通道电路可以与第二子伽马总线连接。这里,与所述第一子伽马总线连接的伽马电压电路的数量可以大于与所述第二子伽马总线连接的伽马电压电路的数量。
各伽马电压电路可以包括:第一电阻串,用于对所述参考电压进行分压;解码器,用于从所述第一电阻串选择多个中间电压;伽马缓冲器,用于缓冲所述中间电压;以及第二电阻串,用于通过对从所述伽马缓冲器输出的电压进行分压来生成所述多个伽马电压。这里,所述解码器可以接收解码信号,并且根据所述解码信号来选择所述多个中间电压。
各子像素可以包括红色(R)、绿色(G)或蓝色(B)有机发光二极管(OLED),并且所述多个伽马电压可以针对各个RGB OLED具有不同的伽马曲线。半导体集成电路可以包括用于各个彩色子像素的单独伽马电压电路,以针对各个RGB OLED形成不同的伽马曲线。
各DAC可以包括包含多个开关的开关阵列,并且通过接通所述多个开关其中之一来选择所述多个伽马电压其中之一。
可以从同一源向所述多个伽马电压电路供给所述参考电压。
另一实施例提供一种半导体集成电路,其包括定时控制电路、多个通道电路、伽马总线、以及多个伽马电压电路。
用于显示驱动的半导体集成电路可以是单个半导体封装体或一个集成电路(IC)。
所述定时控制电路可以将像素图像数据和用于显示时间段的同步信号供给至包括所述多个通道电路的数据驱动电路。
各通道电路可以包括数模转换器(DAC),所述DAC用于根据所述像素图像数据来选择多个伽马电压其中之一并生成数据电压,并且各通道电路将所述数据电压供给至与子像素连接的数据线。
所述伽马总线可以提供将所述多个伽马电压发送至各通道电路的DAC所经由的路径。
各伽马电压电路可以通过对参考电压进行分压来生成所述多个伽马电压,并且在分压点处与所述伽马总线连接。
所述半导体集成电路还可以包括数据总线,所述数据总线用于传送所述像素图像数据。各通道电路还可以包括锁存电路,所述锁存电路用于锁存来自所述数据总线的所述像素图像数据。
所述半导体集成电路还可以包括栅极驱动电路,所述栅极驱动电路用于根据从所述定时控制电路接收到的控制信号,来生成布置在各子像素中的薄膜晶体管(TFT)的栅极驱动信号。
所述半导体集成电路还可以包括分别与数据线连接的多个输出焊盘。所述多个通道电路可以以与所述多个输出焊盘并联的方式布置,并且所述多个伽马电压电路可以按固定的间隔布置在所述多个通道电路之间。
所述多个通道电路可以被所述多个伽马电压电路划分成多个通道电路块。最外侧的通道电路块的大小可以小于内侧的通道电路块的大小。
伽马电压电路可以接收解码信号,并且根据所述解码信号来调整所述多个伽马电压。所述定时控制电路可以将所述解码信号发送至相应的伽马电压电路。
如上所述,根据本发明,可以高速驱动显示面板,并且可以高速处理数据驱动装置中的信号。
附图说明
图1是根据实施例的显示装置的结构图;
图2是根据实施例的数据驱动装置的结构图;
图3是示出根据实施例的伽马电压电路和DAC的配置的图;
图4是示出根据实施例的伽马电压电路和通道电路的配置的图;
图5是各个子像素的伽马电压电路的配置的示例的图;
图6是示出根据实施例的半导体集成电路的配置的图;
图7是根据实施例的伽马电压电路的第一示例的结构图;
图8是根据实施例的伽马电压电路的第二示例的结构图;以及
图9是示出在数据驱动装置中使用伽马电压生成数据电压的处理的图。
具体实施方式
图1是根据实施例的显示装置的结构图。
参考图1,显示装置100可以包括面板110、数据驱动装置120、栅极驱动装置130和定时控制装置140。
在面板110上,可以布置有多个数据线DL和多个栅极线GL,并且可以以矩阵的形式布置有多个子像素。各子像素可以根据经由栅极线GL供给的扫描信号与数据线DL连接。另外,可以根据经由数据线DL供给的数据电压来调整各子像素的亮度。
面板110可以是液晶显示器(LCD)面板、有机发光二极管(OLED)面板或其它类型的面板。如果面板110是OLED面板,则可以在各子像素中布置OLED和与OLED连接的多个晶体管。栅极线GL和数据线DL可以与各子像素的多个晶体管连接。当经由栅极线GL供给表示接通的扫描信号时,多个晶体管中的一个晶体管可以接通,并且数据线DL可以与另一晶体管的栅极连接。根据经由数据线DL供给的数据电压的电平,调整流向上述另一晶体管的电流的电平以调整OLED的亮度。在下文,为了便于说明,将说明面板110是OLED面板的实施例,然而本发明不限于此。
栅极驱动装置130可以经由栅极线GL供给扫描信号,并且数据驱动装置120可以经由数据线DL供给数据电压。栅极驱动装置130和数据驱动装置120可以从定时控制装置140接收控制信号或同步信号,并且根据该控制信号或该同步信号来确定各子像素的驱动定时。
定时控制装置140可以将表示各子像素的灰度的图像数据RGB发送至数据驱动装置120。定时控制装置140可以从外部装置接收图像数据RGB,将该图像数据RGB转换为适合于数据驱动装置120,并且将转换后的图像数据发送至数据驱动装置120。当面板110是OLED面板时,定时控制装置140可以检测OLED面板的各子像素的特性的变化,对图像数据RGB进行转换使得补偿该特性的变化,并且将转换后的图像数据发送至数据驱动装置120。
数据驱动装置120可以从图像数据RGB提取各子像素的像素图像数据,根据该像素图像数据生成数据电压,并且经由与各子像素连接的数据线DL供给所生成的数据电压。
数据驱动装置120可以以半导体集成电路的形式实现。当数据驱动装置120以半导体集成电路的形式实现时,形成数据驱动装置120的电路可以以集成电路的形式实现并且被半导体封装体包围。数据驱动装置120、栅极驱动装置130和定时控制装置140各自均可以以单独的半导体集成电路的形式实现,或者全部都可以以单一半导体集成电路的形式实现。例如,数据驱动装置120、栅极驱动装置130和定时控制装置140全部都可以包括在单个半导体封装体中。
图2是根据实施例的数据驱动装置的结构图。
参考图2,数据驱动装置120可以包括多个通道电路CH、多个伽马电压电路210a、210b、数据总线Dbus、以及伽马总线Gbus。
数据驱动装置120可以从数据处理电路(未示出)接收图像数据,从该图像数据中提取像素图像数据pRGB,并且将该像素图像数据pRGB发送至数据总线Dbus。
作为并行通信总线的数据总线Dbus可以包括与像素图像数据pRGB的位数一样多的总线线路。例如,在像素图像数据pRGB包括P(P是自然数)个位的情况下,数据总线Dbus可以包括P个总线线路。
发送至数据总线Dbus的像素图像数据pRGB可以由移位寄存器顺次地或非顺次地分配至相应的通道电路CH。
通道电路CH可以包括移位寄存器SR、锁存器LT、数模转换器(DAC)和输出缓冲器BR。发送至数据总线Dbus的像素图像数据pRGB可以由移位寄存器SR暂时存储在锁存器LT中,然后可以在DAC中转换成模拟形式的数据电压Vdata。数据电压Vdata可以由输出缓冲器BF输出至数据线。
数据驱动装置120可以包括两个总线。一个总线是发送像素图像数据pRGB所经由的数据总线Dbus,并且另一总线是发送伽马电压所经由的伽马总线Gbus。
可以经由伽马总线Gbus向DAC提供多个伽马电压。然后,DAC可以根据像素图像数据pRGB选择多个伽马电压其中之一并且生成数据电压Vdata。
伽马电压可以由伽马电压电路210a、210b生成。伽马电压电路210a、210b可以生成伽马电压,并且将这些伽马电压经由伽马总线Gbus供给至DAC。
多个伽马电压电路210a、210b可以连接至伽马总线Gbus。在使用仅一个伽马电压电路的情况下,当通道电路位于离伽马电压电路远的位置时,RC延迟增加,并且这可能导致对通道电路的驱动速度的限制。设计者可以增加伽马电压电路的驱动电流或偏置电流以放宽限制,然而,这可能导致伽马电压电路的大小(特别是其高度)增大。
根据实施例,数据驱动装置120可以通过将多个伽马电压电路210a、210b连接至伽马总线Gbus来改善伽马电压供应能力并且使上述RC延迟最小化。
通道电路CH可以经由伽马总线Gbus与伽马电压电路210a、210b连接。这样的实施例具有以下优点:与通道电路以1:1的方式与伽马电压电路连接的情况相比,布线更加简单。
伽马总线Gbus可以包括多个总线线路。伽马总线Gbus可以包括Q(Q是自然数)个总线线路。这里,在像素图像数据pRGB包括P个位的情况下,P和Q(其是伽马总线Gbus的总线线路的数量)之间的关系可以是Q≤2^P。
优选地,多个伽马电压电路210a、210b沿着伽马总线Gbus以彼此间隔开的方式布置。当伽马电压电路210a、210b分别被指派到预定区域以沿着伽马总线Gbus供给伽马电压时,所有的通道电路CH可以被均匀地提供伽马电压。
图3是示出根据实施例的伽马电压电路和DAC的配置的图。
参考图3,多个伽马电压电路310a、310b、...、310n和多个DAC可以连接至伽马总线Gbus。
多个伽马电压电路310a、310b、...、310n可以沿着伽马总线以彼此间隔开的方式布置。这里,两个相邻的伽马电压电路之间的各个距离可以几乎相同。或者,布置在两个相邻的伽马电压电路之间的DAC的各个数量可以几乎相同。
各伽马电压电路可以输出s伽马电压,并且从各个伽马电压电路输出的s伽马电压可以不同。例如,从第一伽马电压电路310a输出的第一s伽马电压sGMAa、从第二伽马电压电路310b输出的第二s伽马电压sGMAb和从第N伽马电压电路310n输出的第N s伽马电压sGMAn可以彼此不同。在两个相邻的DAC所使用的伽马电压大不相同的情况下,在诸如面板上的垂直线等的图像质量方面可能存在缺陷。然而,根据实施例的采用使用伽马总线Gbus的结构的数据驱动装置可以允许降低图像质量的这种缺陷的可能性。
例如,在实施例中,相邻的第一DAC 320a和第二DAC 320b受到伽马电压电路310a、310b、...、310n之间的电压差的影响不大。相邻的第一DAC 320a和第二DAC 320b可能实际会受到伽马总线Gbus中的连接节点n1、n2的电压的影响。然而,如果相邻的第一DAC 320a和第二DAC 320b分别与彼此足够接近的节点n1、n2连接,则各个节点n1、n2的电压之间的差不大,因此节点n1、n2分别接收到的r伽马电压rGMAa、rGMAb之间的差也不大。
图4是示出根据实施例的伽马电压电路和通道电路的配置的图。
参考图4,多个通道电路CH可被划分成多个通道电路块CHBa、CHBb、CHBc、CHBd,并且伽马电压电路410a、410b、410c各自可以布置在两个相邻的通道电路块之间。
多个通道电路CH和多个通道电路块CHBa、CHBb、CHBc、CHBd可以沿着第一方向X(例如,沿着面板的横向方向)布置,并且多个伽马电压电路410a、410b、410c可以沿着第一方向X以彼此间隔开的方式布置。
各个伽马电压电路410a、410b、410c所承载的通道电路的负载可以几乎相等。对于负载的这种均等分配,最外侧的通道电路块CHBa、CHBd的大小可以小于内侧的通道电路块CHBb、CHBc的大小。例如,最外侧的通道电路块CHBa、CHBd的大小可以是内侧的通道电路块CHBb、CHBc的大小的约一半。这里,大小可以是指电路的面积或者通道电路块中所包括的通道电路的数量。
伽马总线Gbus可被布置成沿着第一方向X穿过多个通道电路CH和多个通道电路块CHBa、CHBb、CHBc、CHBd。多个伽马电压电路410a、410b、410c可以布置在由伽马总线Gbus一分为二的平面的一侧。
在面板中,像素可以包括多个子像素。数据驱动装置可以包括各个子像素的伽马电压电路,以将不同的伽马电压供给至各个不同类型的子像素。
图5是各个子像素的伽马电压电路的配置的示例的图。
参考图5,在面板110中,各像素PX可以包括多个子像素(R:红色,G:绿色,B:蓝色,G:绿色)。各个子像素可以具有不同的颜色,但这些子像素中的一些子像素可以具有相同的颜色。例如,像素PX可以包括红色子像素R、绿色子像素G、蓝色子像素B和又一绿色子像素G。又例如,像素PX可以包括红色子像素R、绿色子像素G、蓝色子像素B和白色子像素W。
数据驱动装置可以具有用于像素PX中所包括的各子像素的至少一个伽马电压电路。例如,在像素PX包括四个子像素的情况下,数据驱动装置可以包括用于第一子像素的伽马电压电路、用于第二子像素的伽马电压电路、用于第三子像素的伽马电压电路和用于第四子像素的伽马电压电路。另外,数据驱动装置可以包括用于各子像素的多个伽马电压电路。例如,数据驱动装置可以包括用于第一子像素的多个伽马电压电路和用于第二子像素的多个伽马电压电路。
数据驱动装置可以包括用于各类型的子像素的至少一个伽马电压电路。例如,数据驱动装置可以包括用于向红色子像素供给伽马电压的至少一个R伽马电压电路510a、用于向绿色子像素供给伽马电压的至少一个G伽马电压电路510b、以及用于向蓝色子像素供给伽马电压的至少一个B伽马电压电路510c。
伽马总线可以包括多个子伽马总线GbusR、GbusG、GbusB。各像素PX可以包括多个子像素RGBG。用于驱动多个子像素的第一子像素(例如,绿色子像素)的通道电路和用于驱动第二像素(例如,另一绿色子像素)的通道电路可以与第一子伽马总线GbusG连接。用于驱动第三子像素(例如,红色子像素)的通道电路可以与第二子伽马总线GbusR连接,并且用于驱动第四子像素(例如,蓝色子像素)的通道电路可以与第三子伽马总线GbusB连接。
这里,与第一子伽马总线GbusG连接的伽马电压电路(例如,G伽马电压电路510b)的数量可以大于与第二子伽马总线GbusR连接的伽马电压电路(例如,R伽马电压电路510a)的数量、或者与第三子伽马总线GbusB连接的伽马电压电路(例如,B伽马电压电路510c)的数量。
又例如,用于驱动多个子像素中的第一子像素(例如,绿色子像素)的通道电路和用于驱动第二子像素(例如,另一绿色子像素)的通道电路可以与子伽马总线(未示出)连接,而用于驱动第三子像素(例如,红色子像素)的通道电路和用于驱动第四子像素(例如,蓝色子像素)的通道电路可以与另一子伽马总线(未示出)连接。这里,伽马总线可以包括两个子伽马总线。
图6是示出根据实施例的半导体集成电路的配置的图。
参考图6,在半导体集成电路600上,可以布置有多个通道电路块CHBa、CHBb、CHBc、多个伽马电压电路610、其它电路块620、多个输出焊盘630、以及多个输入焊盘640。
各通道电路块CHBa、CHBb、CHBc可以包括多个通道电路,并且这些通道电路可以分别包括共用伽马总线的DAC。各个伽马电压电路610可以布置在两个相邻的通道电路块CHBa、CHBb、CHBc之间。这里,最外侧的通道电路块CHBa、CHBc的面积可以小于内侧的通道电路块CHBb的面积。
通道电路块CHBa、CHBb、CHBc中所包括的通道电路可以分别与输出焊盘630连接。输出焊盘630可以分别与数据线连接。
多个通道电路可以以与输出焊盘630布置于的方向平行的方式布置,并且多个伽马电压电路610可以沿着输出焊盘630布置于的方向以彼此间隔开的方式布置。
通道电路块CHBa、CHBb、CHBc以及伽马电压电路610可以布置在靠近输出焊盘630的位置,而其它电路块620可以布置在靠近输入焊盘640的位置。
其它电路块620可以包括栅极驱动装置和定时控制装置。栅极驱动装置可以从定时控制装置接收同步信号,生成栅极控制信号,然后将该栅极控制信号发送至面板栅极(GIP)电路。定时控制装置可以从外部装置接收图像数据,对该图像数据进行处理,并且将该图像数据发送至包括通道电路块CHBa、CHBb、CHBc的数据驱动装置。其它电路块620可以还包括随机存取存储器(RAM)、通信电路、DC-DC转换器。
定时控制装置可以将用以控制伽马电压电路610的信号(例如,解码信号)发送至数据驱动装置。伽马电压电路610可以使用这样的信号来调整伽马曲线或进行其它控制。在半导体集成电路600中包括定时控制装置和多个伽马电压电路610的情况下,定时控制装置更容易使用单独的信号来控制各伽马电压电路610。在半导体集成电路中布置有多个伽马电压电路610的情况下,在伽马电压电路610之间可能存在差异。然而,在上述结构中,定时控制装置可以通过单独控制各个伽马电压电路610来使这些差异最小化。
图7是根据实施例的伽马电压电路的第一示例的结构图。
参考图7,伽马电压电路700可以包括第一电阻串710、解码器720、伽马缓冲器730和第二电阻串740。
第一电阻串710可以包括串联连接的多个电阻,并且使用这些电阻来对参考电压VH、VL进行分压。第一电阻串710可以在其一端与参考高电压VH连接,并且在其另一端与参考低电压连接。在构成第一电阻串710的多个电阻中的一些电阻中,可以形成节点并且可以经由这样的节点输出分压电压。这里,构成第一电阻串710的电阻可以具有几乎相同的电阻值。
在数据驱动装置中,可以布置有多个伽马电压电路700,并且可以通过同一源向这多个伽马电压电路700提供参考电压VH、VL。多个伽马电压电路700可以使用同一源来使伽马电压之间的差最小化。
解码器720可以包括多个解码块PDEC,并且使用这多个解码块PDEC来从第一电阻串710选择多个中间电压Vc1~Vc5。例如,各解码块PDEC可以从第一电阻串710接收多个分压电压,选择这多个分压电压其中之一,并且将所选择的电压作为中间电压Vc1~Vc5输出。
解码器720可以接收解码信号SDEC,并且根据该解码信号SDEC来选择多个中间电压Vc1~Vc5。例如,各解码块PDEC可以单独地接收解码信号SDEC,或者解码块PDEC可以共同地接收解码信号SDEC,并且根据由该解码信号SDEC表示的值来选择多个分压电压中的一个,以将选择的电压作为中间电压Vc1~Vc5输出。
这样的处理可被称为可编程解码。根据这样的可编程解码,可以细微地调整伽马曲线,并且使在多个伽马电压电路之间可能存在的差异最小化。
从解码器720输出的中间电压Vc1~Vc5可以被发送至伽马缓冲器730。伽马缓冲器730可以缓冲中间电压Vc1~Vc5,然后将这些中间电压Vc1~Vc5输出至第二电阻串740。
第二电阻串740可以包括串联连接的多个电阻,并且使用这些电阻来对参考电压VH、VL和中间电压Vc1~Vc5进行分压,以生成多个伽马电压Vgm0~Vgm1023。
第二电阻串740可以接收参考电压VH、VL和从伽马缓冲器730输出的电压。参考高电压VH可以连接至第二电阻串740的一端,并且参考低电压VL可以连接至第二电阻串740的另一端。从伽马缓冲器730输出的电压可以连接至在构成第二电阻串740的多个电阻中的一些电阻中形成的节点。
第二电阻串740可以将以这种方式生成的伽马电压Vgm0~Vgm1023输出至伽马总线。
图8是根据实施例的伽马电压电路的第二示例的结构图。
参考图8,伽马电压电路800可以包括第一电阻串810、伽马缓冲器830和第二电阻串840。
第一电阻串810可以包括串联连接的多个电阻,并且使用这些电阻来对参考电压VH、VL进行分压。第一电阻串810可以在一端与参考高电压VH连接,并且在另一端与参考低电压VL连接。在构成第一电阻串810的多个电阻中的一些电阻中,可以形成节点并且可以经由这些节点输出中间电压Vc1~Vc5。这里,构成第一电阻串810的电阻可以具有几乎相同的电阻值。
伽马缓冲器830可以缓冲中间电压Vc1~Vc5,然后将这些中间电压Vc1~Vc5输出至第二电阻串840。
第二电阻串840可以包括串联连接的多个电阻,并且使用这些电阻来对参考电压VH、VL和中间电压Vc1~Vc5进行分压,以生成多个伽马电压Vgm0~Vgm1023。
第二电阻串840可以接收参考电压VH、VL和从伽马缓冲器830输出的电压。参考高电压VH可以连接至第二电阻串840的一端,并且参考低压VL可以连接至第二电阻串840的另一端。从伽马缓冲器830输出的电压可以连接至在构成第二电阻串840的多个电阻中的一些电阻中形成的节点。
第二电阻串840可以将以这种方式生成的伽马电压Vgm0~Vgm1023输出至伽马总线Gbus。
图9是示出在数据驱动装置中使用伽马电压生成数据电压的处理的图。
参考图9,数据驱动装置900可以包括多个通道电路CH,并且各通道电路CH可以包括开关阵列SA和输出缓冲器BF。
伽马总线Gbus可被布置成穿过各个通道电路CH,并且与各个通道电路CH的开关阵列连接。
各开关阵列SA可以包括多个开关。各开关可以与构成伽马总线Gbus的各总线线路连接。经由各个总线线路供给伽马电压Vgm0~Vgm1023,并且开关阵列SA可以选择这些总线线路其中之一,使得可以将所选择的总线线路的伽马电压作为数据电压输出。
输出缓冲器BF可以缓冲数据电压并输出数据电压。
开关阵列SA可以根据像素图像数据pRGB的灰度级来选择多个伽马电压Vgm0~Vgm1023其中之一。开关阵列SA可以包括在上述DAC中。
相关申请的交叉引用
本申请要求2019年10月16日提交的韩国专利申请10-2019-0128479的优先权,其全部内容通过引用而被包含于此。
Claims (15)
1.一种半导体集成电路,用于驱动显示器,所述半导体集成电路包括:
多个通道电路,所述多个通道电路中的各通道电路包括数模转换器即DAC,所述DAC用于根据像素图像数据来选择多个伽马电压其中之一并生成数据电压,并且所述各通道电路经由与子像素连接的数据线供给所述数据电压;
伽马总线,用于提供将所述多个伽马电压发送至相应通道电路的DAC所经由的路径;以及
多个伽马电压电路,用于通过对参考电压进行分压来生成所述多个伽马电压,并且在分压点处与所述伽马总线连接。
2.根据权利要求1所述的半导体集成电路,其中,所述多个通道电路沿着第一方向布置,并且所述多个伽马电压电路沿着所述第一方向以彼此间隔开的方式布置。
3.根据权利要求1所述的半导体集成电路,其中,各像素包括多个子像素,所述伽马总线包括多个子伽马总线,用于驱动所述多个子像素中的第一子像素的通道电路和用于驱动第二子像素的通道电路与第一子伽马总线连接,并且用于驱动第三子像素的通道电路与第二子伽马总线连接,其中,与所述第一子伽马总线连接的伽马电压电路的数量大于与所述第二子伽马总线连接的伽马电压电路的数量。
4.根据权利要求1所述的半导体集成电路,其中,各伽马电压电路包括:第一电阻串,用于对所述参考电压进行分压;解码器,用于从所述第一电阻串选择多个中间电压;伽马缓冲器,用于缓冲所述中间电压;以及第二电阻串,用于对从所述伽马缓冲器输出的电压进行分压,以生成所述多个伽马电压。
5.根据权利要求4所述的半导体集成电路,其中,所述解码器接收解码信号,并且根据所述解码信号来选择所述多个中间电压。
6.根据权利要求1所述的半导体集成电路,其中,各子像素包括红色即R、绿色即G或蓝色即B有机发光二极管即OLED,并且所述多个伽马电压针对各个RGB OLED具有不同的伽马曲线。
7.根据权利要求1所述的半导体集成电路,其中,所述DAC包括包含多个开关的开关阵列,并且通过接通所述多个开关其中之一来选择所述多个伽马电压其中之一。
8.根据权利要求1所述的半导体集成电路,其中,通过同一源向所述多个伽马电压电路提供所述参考电压。
9.一种半导体集成电路,用于驱动显示器,所述半导体集成电路包括:
定时控制电路,用于供给像素图像数据和用于显示时间段的同步信号;
多个通道电路,所述多个通道电路中的各通道电路包括数模转换器即DAC,所述DAC用于根据所述像素图像数据来选择多个伽马电压其中之一并生成数据电压,并且所述各通道电路经由与子像素连接的数据线供给所述数据电压;
伽马总线,用于提供将所述多个伽马电压发送至相应通道电路的DAC所经由的路径;以及
多个伽马电压电路,用于通过对参考电压进行分压来生成所述多个伽马电压,并且在分压点处与所述伽马总线连接。
10.根据权利要求9所述的半导体集成电路,还包括数据总线,所述数据总线用于发送所述像素图像数据,其中,各通道电路还包括锁存电路,所述锁存电路用于锁存来自所述数据总线的所述像素图像数据。
11.根据权利要求9所述的半导体集成电路,还包括栅极驱动电路,所述栅极驱动电路用于根据从所述定时控制电路接收到的控制信号,来生成布置在各子像素中的薄膜晶体管即TFT的栅极驱动信号。
12.根据权利要求9所述的半导体集成电路,还包括分别与数据线连接的多个输出焊盘,其中,所述多个通道电路与所述多个输出焊盘并联布置,并且所述多个伽马电压电路布置在所述多个通道电路之间。
13.根据权利要求12所述的半导体集成电路,其中,所述多个通道电路被所述多个伽马电压电路划分成多个通道电路块,并且最外侧的通道电路块的大小小于内侧的通道电路块的大小。
14.根据权利要求9所述的半导体集成电路,其中,所述伽马电压电路接收解码信号,并且根据所述解码信号来调整所述多个伽马电压。
15.根据权利要求14所述的半导体集成电路,其中,所述定时控制电路将所述解码信号发送至相应的伽马电压电路。
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