CN112599418B - 一种三维折线纳米线阵列垂直场效应晶体管的制备方法 - Google Patents

一种三维折线纳米线阵列垂直场效应晶体管的制备方法 Download PDF

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Abstract

本发明公开一种三维折线纳米线阵列垂直场效应晶体管的制备方法,包括:1)利用刻蚀技术在图形化衬底上刻蚀出三维台阶形状;2)在刻蚀有三维台阶的衬底上沉积质介质薄膜层后再次刻蚀使三维台阶附近异质侧壁暴露,然后利用选择性刻蚀在异质侧壁构造引导沟道;3)在异质侧壁构造的引导沟道内制备纳米级催化金属颗粒;4)在整个结构表面淀积覆盖与所需生长纳米线对应非晶半导体前驱体薄膜层;5)升高温度使纳米级催化金属颗粒引导沟道中由固态转变为液态,前端开始吸收非晶层,后端析出折线形晶态纳米线;6)以折线形晶态纳米线垂直部分为沟道区域,水平部分为源漏电极区域,制备短沟道场效应晶体管。

Description

一种三维折线纳米线阵列垂直场效应晶体管的制备方法
技术领域
本发明涉及一种纳米线三维批量化生长方法,特别是通过在台阶上沉积异质叠层进行刻蚀得到侧壁沟道并采用平面固-液-固(IPSLS)方式生长三维折线形纳米线阵列的方法;属于微电子技术领域。
背景技术
无结晶体管是开发新一代高性能微纳电子逻辑、传感和显示等应用的关键。目前常见的气-液-固(VLS)生长模式所制备的纳米线多为竖直随机阵列,很难直接在目前的平面电子工艺中实现可靠且低成本的定位集成。基于自上而下的电子束直写(EBL)技术制备纳米线直径10~100纳米,沟道长度在十纳米到百纳米量级的晶体管结构,已经验证各种新型纳米线功能器件的优异特性,但由于其制备成本高昂、产量低等因素难以得到规模化、产业化应用。通过纳米金属液滴催化的自下而上的平面固-液-固(IP-SLS)纳米线生长,可以通过光刻大批量制备直径在百纳米以下的晶态硅、锗和各种合金半导体纳米线,制备平面晶体管阵列,但常规光刻工艺自身的工艺限制,沟道长度最低限度较高,无法制备更短沟道的器件。
发明内容
发明目的:针对现有技术中存在的问题与不足,本发明提供技术方案:一种三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,包括如下几个步骤:
1)利用刻蚀技术在图形化衬底上刻蚀出三维台阶形状;
2)在刻蚀有三维台阶的衬底上同质介质材料单层或异质介质材料多层,利用光刻定义位置后刻蚀形成单层或多层引导沟道;
或者,在刻蚀有三维台阶的衬底上沉积介质薄膜层后再次刻蚀使三维台阶附近异质侧壁暴露,然后利用选择性刻蚀在异质侧壁构造引导沟道;
3)在所述单层或者多层引导沟道或异质侧壁构造的引导沟道内制备纳米级催化金属颗粒;
4)在整个结构表面淀积覆盖与所需生长纳米线对应非晶半导体前驱体薄膜层;
5)升高温度使纳米级催化金属颗粒在单层或者多层引导沟道或者异质侧壁构造的引导沟道中由固态转变为液态,前端开始吸收非晶层,后端析出折线形晶态纳米线;
6)以折线形晶态纳米线垂直部分为沟道区域,水平部分为源漏电极区域,制备短沟道场效应晶体管。
本发明进一步限定的技术方案为:在步骤1)中,利用光刻、电子束直写或掩模板技术实现所需的平面图案以定义纳米线台阶的位置,利用电感耦合等离子体刻蚀或者反应离子体刻蚀技术刻蚀出至少一个三维台阶形状。
作为优选,步骤2)包括以下步骤:
a)利用化学气相沉积或等离子体增强化学气相沉积方法在整个衬底上淀积同质介质单层或异质介质多层薄膜叠层,每层异质薄膜叠层的厚度在1~100nm;
b)利用光刻、电子束刻蚀或者掩模板技术,在已构造三维台阶的位置上定义图案;
c)利用电感耦合等离子体或者反应离子体刻蚀技术进行各向异性刻蚀,将覆盖在三维台阶上的叠层侧壁暴露出来,形成折线型结构。
作为优选,在步骤2)中,利用0.5%~40%HF溶液或缓冲氧化物刻蚀液BOE刻蚀SiO2/SiNx叠层,处理时间控制在1~100s。
作为优选,所述介质薄膜层为同质介质单层或者异质介质多层。
作为优选,在步骤3)中,在台阶的一端通过光刻、电子束刻蚀或者掩模板技术,在侧壁定义图案并通过热蒸发、原子层沉积ALD、电子束蒸发EBE或物理气相沉积PVD金属蒸镀技术制备一层厚度在1~500nm的铟、锡或者合金金属催化层;在高于金属熔点的温度,利用还原性气体等离子体在PECVD中处理金属催化层,使之转变成为分离的纳米颗粒,并通过控制其处理时间和功率,将侧壁上的金属颗粒的直径控制在3~500nm。
作为优选,步骤4)中通过PECVD、CVD或者PVD沉积技术,在表面覆盖一层与纳米线成分相对应的非晶前驱体层薄膜;所述前驱体层为非晶硅a-Si、非晶锗a-Ge、非晶碳a-C或者其中的非晶合金层;薄膜覆盖厚度为2~400nm。
作为优选,步骤5)中,在真空或者惰性气体保护的环境中,将温度升高到金属熔点或金属与前驱体的合金共熔点以上,金属颗粒融化为液滴,并开始在纳米线生长的前端不断吸收非晶前驱体,后端界面淀积出晶态的纳米线结构,在侧壁引导和控制作用下,纳米线将在侧壁引导沟道内平面生长,在台阶位置沿台阶竖直生长一段距离爬上台阶后重新变为平面生长。
作为优选,所述衬底为普通硅片、重掺杂n型硅片或有任意介质层覆盖的金属薄膜。
有益效果:与现有技术相比,本发明具有以下优点:
1)本发明利用在三维台阶结构上的异质交替叠层薄膜结构,直接用于引导纳米线生长,获得高密度、形貌可调控的三维纳米线阵列结构;
2)通过此方法获得的纳米线直径由异质叠层结构的层厚决定,不受光刻空间分辨率的限制,实现纳米线直径的高度控制;
3)实现在小投影面积下超短沟道栅结构的高密度排布,从而大幅提高纳米线阵列作为晶体管器件沟道的电流负载和驱动能力;
4)实现晶体管沟道长度的高度可控,突破了光刻0.5~3μm的限制,克服了电子束激光直写、EBL技术成本高昂的困难;
5)由于此垂直栅技术可通过传统薄膜淀积技术得以实现,继承保持了传统薄膜工艺的在大面积工艺特性,具有广泛应用价值。
6)本发明解决了平面固液固(IPSLS)台阶引导生长半导体纳米线制备的平面场效应晶体管的沟道长度较长及其带来的器件应用中驱动电流受限的关键问题;采用台阶上异质介质层薄膜刻蚀形成的折线形沟道,可以对纳米线形貌进行精确调控,纳米线的集成密度大幅提高,并且此技术完全兼容大面积薄膜电子器件的基本工艺,不必引入额外的高精度光刻技术。
7)纳米线可以集成定位于衬底,为开拓新一代的三维集成微纳电子器件提供了一种关键的纳米沟道实现技术,并且实现工艺可扩展、低成本,并可以实现可编程的三维纳米线形貌调控生长能力;由于纳米线生长的坡面角度可以通过刻蚀工艺调控,可以获得非常高的沟道电流驱动能力,这对于实现平板显示所需要的高性能薄膜晶体管(TFT)尤为重要。
8)基于此技术,纳米线沟道阵列有望在更小的TFT器件空间内满足实现新型AMOLED显示所需要的驱动电流。这对于建立新一代平面纳米线TFT平板显示技术,既以高世代非晶硅技术为基础实现高性能(迁移率、稳定特性和开口率等)驱动电流,意义尤其重大。另外,此技术还有望帮助实现集成度更高的大面积逻辑电路,开发或优化新一代显示、传感和信息器件应用。
附图说明
图1是本发明实施例1提供的利用台阶上异质介质叠层引导生长三维折线形纳米线制备垂直栅场效应晶体管的制备流程示意图;其中图1a-图1f示出各步骤中的具体结构。
图2是本发明实施例2中台阶引导生长单层三维折线的结构示意图。
图3为本发明实施例3中台阶引导生长多层三维折线的结构示意图。
图4是本发明实施例1和实施例2中制备的台阶侧壁沟道以及硅纳米线生长范例结构。
具体实施方式
下面结合附图和具体实施例,进一步阐明本发明。
实施例1
如图1所示,本实施例提供一种利用台阶上异质介质叠层引导生长三维折线形纳米线制备垂直栅晶体管阵列的方法,可用于晶硅衬底上制作垂直栅场效应晶体管结构,其制备过程可包括以下几个步骤:
1)、以高掺杂晶硅作为衬底1,用光刻技术定义引导台阶位置,再用ICP刻蚀方法刻蚀衬底表面。刻蚀过程使用C4F8和SF6气体混合3:4深硅刻蚀技术,获得垂直的三维台阶,三维台阶高度为200nm;如图1a所示。
2)、利用等离子体增强PECVD交替淀积非晶氮化硅-氧化硅-氮化硅薄膜,每层薄膜厚度分别为40-60-40nm,利用ICP刻蚀方法刻蚀异质介质叠层,刻蚀过程可以使用C4F8气体,可以适当延长刻蚀时间,保证垂直台阶完全暴露。由于薄膜淀积技术的均匀覆盖性,异质介质叠层,特别是氮化硅-氧化硅-氮化硅结构会均匀包覆在具有三维台阶结构的硅衬底上;利用光刻、电子束直写或掩模板技术定义平面图案,利用电感耦合等离子体ICP刻蚀或者反应离子体刻蚀RIE技术刻蚀,有掩膜覆盖的区域异质介质叠层保留,而其他区域的介质层被去除,由此在侧壁暴露出了氮化硅-氧化硅-氮化硅的侧壁结构,侧视图呈现折线结构,如图1b所示。
3)、利用缓冲氧化物刻蚀液BOE处理样品,由于相邻异质薄膜之间对刻蚀氛围的不同刻蚀速度,以及叠层本身相互掩盖的影响,可形成内嵌深度约为50~120nm的凹槽5,例如图1c所示。
4)、利用光刻定位以及热蒸发技术,在侧壁凹槽一端淀积厚度约为3~40nm的金属铟In催化层2,作为纳米线的生长起点位置。样品装入PECVD腔体,在200~400摄氏度进行氢气等离子体处理,使覆盖在侧壁坡面引导沟道上的催化金属层转变成为分离铟纳米颗粒,直径在100nm左右,如图1d所示。
5)、将温度降低到70~170℃,在PECVD系统中表面覆盖一层非晶硅薄膜20~100nm前驱体层。
6)、当温度提高到250~450℃,使得纳米铟颗粒重新融化,并开始在前端吸收非晶硅,而在后端生长淀积出晶态的硅纳米线结构。借助侧壁上形成的侧壁凹槽结构作为引导沟道,获得严格沿侧壁沟道生长、在台阶位置转变为竖直生长爬上台阶后重新转变为平行于衬底生长的折线形纳米线3,如图1e示意结构。
7)剩余非晶硅前驱体层、异质介质叠层的最上层氮化硅可通过相应的ICP、RIE刻蚀工艺刻蚀掉,由于离子刻蚀的各向异性明显,平面方向的纳米线将暴露出来,在折线形纳米线的横向部分蒸镀源漏电极,其后覆盖栅极介质层,在折线形纳米线的垂直部分蒸镀栅极电极完成垂直场效应晶体管的制备,其沟道长度Lch等由台阶高度Hs决定,如图1f所示;图4(b)为在刻蚀出异质叠层台阶上所形成的侧壁纳米引导沟道扫描电镜(SEM)侧视图。
本实施例利用各种准直性金属真空蒸镀技术如电子束发射EBE、磁控溅射等方法定义金属薄膜,由于台阶结构的自遮蔽效应,台阶侧壁竖直纳米线处没有金属薄膜,台阶的高度定义了垂直栅晶体管的沟道长度。所提供的获得三维折线形纳米线阵列的可靠方法,可对折线形纳米线的垂直部分的高度进行精确控制,可以克服传统自上而下工艺难以克服的光刻极限,具有高度可重复性,可实现批量化实现三维纳米线结构,在进一步制造纳电子器件方面有巨大潜力。
实施例2
本实施例提供一种利用台阶上异质介质叠层引导生长单层三维折线形纳米线的方法,如图2所示,包括以下几个步骤:
1)利用刻蚀技术在图形化衬底上刻蚀出单层三维台阶5形状;
2)在刻蚀有三维台阶的衬底上沉积同质介质层薄膜,利用光刻定义位置后刻蚀形成单层引导沟道;
3)在所述单层引导沟道内制备纳米级催化金属颗粒2;
4)在整个结构表面淀积覆盖与所需生长纳米线对应非晶半导体前驱体薄膜层;
5)升高温度使纳米级催化金属颗粒在单层引导沟道由固态转变为液态,前端开始吸收非晶层,后端析出折线形晶态纳米线3;
6)以折线形晶态纳米线垂直部分为沟道区域,水平部分为源漏电极区域,制备短沟道场效应晶体管。图4(a)为在同质介质坡面台阶上生长的三维硅纳米线SEM侧视图。
实施例3
本实施例提供一种利用台阶上异质介质叠层引导生长多层三维折线形纳米线的方法,如图3所示,包括以下几个步骤:
1)利用刻蚀技术在图形化衬底上刻蚀出多层三维台阶4形状;
2)在刻蚀有三维台阶的衬底上沉积异质介质层薄膜,利用光刻定义位置后刻蚀形成多层引导沟道;
3)在所述多层引导沟道内制备纳米级催化金属颗粒2;
4)在整个结构表面淀积覆盖与所需生长纳米线对应非晶半导体前驱体薄膜层;
5)升高温度使纳米级催化金属颗粒在多层引导沟道中由固态转变为液态,前端开始吸收非晶层,后端析出折线形晶态纳米线3;
6)以折线形晶态纳米线垂直部分为沟道区域,水平部分为源漏电极区域,制备短沟道场效应晶体管。
以上所述仅是本发明的优选实施方式,应当指出,对于本技术领域的普通技术人员来说,在不脱离本发明原理的前提下,还可以作出若干改进,这些改进也应视为本发明的保护范围。

Claims (9)

1.一种三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,包括如下几个步骤:
1)利用刻蚀技术在图形化衬底上刻蚀出三维台阶形状;
2)在刻蚀有三维台阶的衬底上沉积介质薄膜层,利用光刻定义位置后刻蚀形成单层或多层引导沟道;
或者,在刻蚀有三维台阶的衬底上沉积介质薄膜层后再次刻蚀使三维台阶附近异质侧壁暴露,然后利用选择性刻蚀在异质侧壁构造引导沟道;
3)在所述单层或者多层引导沟沟道或异质侧壁构造的引导沟道内制备纳米级催化金属颗粒;
4)在整个结构表面淀积覆盖与所需生长纳米线对应非晶半导体前驱体薄膜层;
5)升高温度使纳米级催化金属颗粒在单层或者多层引导沟道或者异质侧壁构造的引导沟道中由固态转变为液态,前端开始吸收非晶层,后端析出折线形晶态纳米线;
6)以折线形晶态纳米线垂直部分为沟道区域,水平部分为源漏电极区域,制备短沟道场效应晶体管。
2.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,步骤1)中,利用光刻、电子束直写或掩模板技术实现所需的平面图案以定义纳米线台阶的位置,利用电感耦合等离子体刻蚀或者反应离子体刻蚀技术刻蚀出至少一个三维台阶形状。
3.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,所述介质薄膜层为同质介质单层或者异质介质多层。
4.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,步骤2)包括以下步骤:
a)利用化学气相沉积或等离子体增强化学气相沉积方法在整个衬底上淀积同质介质材料单层或异质介质材料多层,每层异质薄膜叠层的厚度在1~100nm;
b)利用光刻、电子束刻蚀或者掩模板技术,在已构造三维台阶的位置上定义图案;
c)利用电感耦合等离子体或者反应离子体刻蚀技术进行各向异性刻蚀,将覆盖在三维台阶上的叠层侧壁暴露出来,形成折线型结构。
5.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,在步骤2)中,介质薄膜层的材料为SiO2/SiN叠层,利用0.5%~40%HF溶液或缓冲氧化物刻蚀液BOE刻蚀SiO2/SiNx叠层,处理时间控制在1~100s。
6.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,所述步骤3)中,在台阶的一端通过光刻、电子束刻蚀或者掩模板技术,在侧壁定义图案并通过热蒸发、原子层沉积ALD、电子束蒸发EBE或物理气相沉积PVD金属蒸镀技术制备一层厚度在1~500nm的铟、锡或者合金金属催化层;在高于金属熔点的温度,利用还原性气体等离子体在PECVD中处理金属催化层,使之转变成为分离的纳米颗粒,并通过控制其处理时间和功率,将侧壁上的金属颗粒的直径控制在3~500nm。
7.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,步骤4)中通过PECVD、CVD或者PVD沉积技术,在表面覆盖一层与纳米线成分相对应的非晶前驱体层薄膜;所述前驱体层为非晶硅a-Si、非晶锗a-Ge、非晶碳a-C或者其中的非晶合金层;薄膜覆盖厚度为2~400nm。
8.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,步骤5)中,在真空或者惰性气体保护的环境中,将温度升高到金属熔点或金属与前驱体的合金共熔点以上,金属颗粒融化为液滴,并开始在纳米线生长的前端不断吸收非晶前驱体,后端界面淀积出晶态的纳米线结构,在侧壁引导和控制作用下,纳米线将在侧壁引导沟道内平面生长,在台阶位置沿台阶竖直生长一段距离爬上台阶后重新变为平面生长。
9.根据权利要求1所述的三维折线纳米线阵列垂直场效应晶体管的制备方法,其特征在于,所述衬底为普通硅片、重掺杂n型硅片或有任意介质层覆盖的金属薄膜。
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3D Sidewall Integration of Ultrahigh-Density Silicon Nanowires for Stacked Channel Electronics;Xiaoxiang Wu et al;《Advanced Electronic Materials》;20190731;第5卷(第7期);第1800627页 *

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