CN111727490A - 用于将图案转移到层的方法 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 171
- 238000005979 thermal decomposition reaction Methods 0.000 claims abstract description 109
- 230000008569 process Effects 0.000 claims abstract description 81
- 239000000758 substrate Substances 0.000 claims abstract description 51
- 238000000059 patterning Methods 0.000 claims abstract description 48
- 238000005530 etching Methods 0.000 claims abstract description 17
- 229920002120 photoresistant polymer Polymers 0.000 claims description 29
- 238000012546 transfer Methods 0.000 claims description 22
- 239000000463 material Substances 0.000 claims description 20
- 238000010438 heat treatment Methods 0.000 claims description 14
- 229920005989 resin Polymers 0.000 claims description 6
- 239000011347 resin Substances 0.000 claims description 6
- 238000007669 thermal treatment Methods 0.000 claims description 5
- 239000010410 layer Substances 0.000 description 284
- 238000012545 processing Methods 0.000 description 15
- 229920002396 Polyurea Polymers 0.000 description 9
- 230000008901 benefit Effects 0.000 description 7
- 239000004065 semiconductor Substances 0.000 description 5
- 238000000206 photolithography Methods 0.000 description 3
- 238000001020 plasma etching Methods 0.000 description 3
- 150000001412 amines Chemical class 0.000 description 2
- 239000006117 anti-reflective coating Substances 0.000 description 2
- 239000011248 coating agent Substances 0.000 description 2
- 238000000576 coating method Methods 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 230000007246 mechanism Effects 0.000 description 2
- XSQUKJJJFZCRTK-UHFFFAOYSA-N Urea Chemical compound NC(N)=O XSQUKJJJFZCRTK-UHFFFAOYSA-N 0.000 description 1
- 230000003667 anti-reflective effect Effects 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000004202 carbamide Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 239000012948 isocyanate Substances 0.000 description 1
- 150000002513 isocyanates Chemical class 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 239000000178 monomer Substances 0.000 description 1
- 238000006116 polymerization reaction Methods 0.000 description 1
- 238000000427 thin-film deposition Methods 0.000 description 1
- 238000007740 vapor deposition Methods 0.000 description 1
- 235000012431 wafers Nutrition 0.000 description 1
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/033—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers
- H01L21/0334—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane
- H01L21/0338—Process specially adapted to improve the resolution of the mask
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- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/0271—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers
- H01L21/0273—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers characterised by the treatment of photoresist layers
- H01L21/0274—Photolithographic processes
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/033—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers
- H01L21/0332—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their composition, e.g. multilayer masks, materials
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- H01L21/02104—Forming layers
- H01L21/02107—Forming insulating materials on a substrate
- H01L21/02225—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
- H01L21/0226—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
- H01L21/02263—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
- H01L21/02269—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by thermal evaporation
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- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/033—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers
- H01L21/0334—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane
- H01L21/0335—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane characterised by their behaviour during the process, e.g. soluble masks, redeposited masks
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- H01L21/033—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers
- H01L21/0334—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane
- H01L21/0337—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane characterised by the process involved to create the mask, e.g. lift-off masks, sidewalls, or to modify the mask, e.g. pre-treatment, post-treatment
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- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
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Abstract
提供了一种工艺,其中,形成了图案化层、中间层以及要根据该图案化层的图案来蚀刻的第一层。该中间层可以是可以通过基于热的去除工艺来去除的热分解层。在蚀刻该第一层之后,使用基于热的去除工艺可以允许在不改变该第一层的情况下从衬底去除该中间层。在一个实施例中,该第一层可以是记忆层,并且该工艺可以是多重图案化工艺。
Description
本申请要求2018年3月2日提交的名称为“Method to Transfer Patterns to aLayer[用于将图案转移到层的方法]”的美国临时专利申请号62/637,743和2018年5月4日提交的名称为“Method to Transfer Patterns to a Layer[用于将图案转移到层的方法]”的美国临时专利申请号62/666,751的优先权;这些美国临时专利申请的披露内容通过引用以其全文明确结合在此。
背景技术
本披露内容涉及衬底处理。特别地,本披露内容提供一种用于图案化衬底的方法。
用于处理衬底的光刻技术的使用早已为人所知。从历史上看,光刻法涉及了在层(例如光刻胶层)中形成图案,并且然后经由蚀刻工艺将该图案转移到另一层。
随着在衬底上形成的特征的临界尺寸继续缩小,已经使用多种图案化技术以使得可以实现小于以一个图案可实现的临界尺寸的临界尺寸。因此,例如双重图案化工艺、三重图案化工艺、四重图案化工艺等的使用现在是已知的。在此类工艺的一个示例中,依次对多个图案进行图案化,并且然后在蚀刻层中蚀刻这些图案,从而在衬底的该蚀刻层中实现最终期望的图案。例如,可以在光刻胶层中形成第一光刻图案,并且然后经由蚀刻工艺将该第一光刻图案转移到衬底的蚀刻层。在一个示例中,蚀刻层可以是多重图案化工艺(例如,双重图案化工艺)的记忆层。然后,可以在光刻胶层中形成第二光刻图案,并且经由另一种蚀刻工艺将该第二光刻图案转移到相同的蚀刻层(例如,记忆层)。以这种方式,可以将两个光刻图案转移到蚀刻层(例如,记忆层),该蚀刻层的临界尺寸小于仅使用一个光刻层可实现的临界尺寸。
然而,已经发现,在将要形成最终图案的蚀刻层(例如,记忆层)上执行多个处理步骤可能会对该蚀刻层造成不想要的损坏。在一个实施例中,作为光刻工艺流程的一部分,可以在光刻胶层与蚀刻层之间形成其他层(包括平坦化层)。在对蚀刻层进行第一次蚀刻之后,可以从衬底去除此类其他层。在一个示例中,其他层可以包括平坦化层。如现有技术中已知的,在蚀刻层中形成第一图案之后,可以从衬底去除第一平坦化层。然后,在用第二光刻胶层涂覆衬底之前,可以在该衬底上形成另一个平坦化层。用于平坦化层的典型材料包括有机平坦化层。
如本文所描述的,已经发现去除第一平坦化层可能对蚀刻层造成不想要的损坏。因此,期望使用一种工艺,其中,可以从蚀刻层去除材料而不会对该蚀刻层造成不想要的变化。
发明内容
提供了一种工艺,其中,形成了图案化层、中间层以及要根据该图案化层的图案来蚀刻的第一层。该中间层可以是可以通过基于热的去除工艺来去除的热分解层。在蚀刻该第一层之后,使用基于热的去除工艺可以允许在不改变该第一层的情况下从衬底去除该中间层。在一个实施例中,该第一层可以是记忆层,并且该工艺可以是多重图案化工艺。
在一个实施例中,提供了一种蚀刻衬底的方法。该方法可以包括:在该衬底上提供第一层;在该衬底上提供具有第一图案的第一图案化层;以及在该第一图案化层与该第一层之间提供一个或多个中间层,至少一个中间层是第一热分解层。该方法进一步包括:蚀刻该第一层以在该第一层中形成该第一图案;以及通过向该第一热分解层施加热能来去除该第一热分解层。
在另一个实施例中,提供了一种图案化衬底的方法。该方法可以包括:向该衬底提供包括光刻胶图案化层、第一热分解层以及记忆层的结构,该光刻胶图案化层的图案包括线、间隔和/或过孔。该方法可以进一步包括:对该图案的间隔和/或过孔进行到该记忆层的图案转移,同时将该图案的线保留在该热分解层上;以及执行第一热处理工艺以去除该第一热分解层的任何剩余部分。
在又另一个实施例中,提供了一种多重图案化衬底的方法。该方法可以包括:向该衬底提供包括第一图案化层的结构,该第一图案化层具有第一图案;以及提供记忆层。该方法进一步包括:在该第一图案化层与该记忆层之间提供第一热分解层,该第一热分解层是第一平坦化层;以及执行第一图案转移以将该第一图案转移到该记忆层。该方法进一步包括:通过向该第一热分解层施加热能来去除该第一热分解层。在去除该第一热分解层之后,该方法包括:提供第二热分解层,其中,该第二热分解层是第二平坦化层。该方法进一步包括:提供第二图案化层,使得该第二热分解层位于该第二图案化层与该记忆层之间,其中,该第二图案化层具有第二图案。该方法还包括:执行第二图案转移以将该第二图案转移到该记忆层;以及通过向该第二热分解层施加热能来去除该第二热分解层。
附图说明
通过参考以下结合附图的描述,可以获取对本发明及其优点的更透彻的理解,其中,相似的附图标记指示相似的特征。然而,应当注意的是,这些附图仅展示了所披露的概念的示例性实施例,并且因此不被认为限制了范围,因为所披露的概念可以承认其他同等有效的实施例。
图1A至图1C展示了使用热分解层的工艺流程。
图2B至图2C展示了将第二图案化工艺的使用添加至图1A至图1C的工艺流程的工艺流程。
图3A至图3C展示了将第三图案化工艺的使用添加至图2A至图2C的工艺流程的工艺流程。
图4展示了作为图案化工艺的一部分的使用热分解层的示例性工艺流程。
图5展示了作为图案化工艺的一部分的使用热分解层的另一示例性工艺流程。
图6展示了作为图案化工艺的一部分的使用热分解层的又另一示例性工艺流程。
具体实施方式
提供了一种工艺,其中,形成了图案化层、中间层以及要根据该图案化层的图案来蚀刻的第一层。该中间层可以是可以通过基于热的去除工艺来去除的热分解层。在蚀刻该第一层之后,使用基于热的去除工艺可以允许在不改变该第一层的情况下从衬底去除该中间层。在一个实施例中,该第一层可以是记忆层,并且该工艺可以是多重图案化工艺。
在实施例中,该工艺可以用作多重图案化工艺的一部分。然而,将认识到的是,期望可以在各种不同的衬底处理步骤中使用在不损坏蚀刻层的情况下去除中间层的优点,并且本文所描述的技术不限于使用多重图案化工艺。在使用本文所描述的技术的一个示例性实施例中,蚀刻层可以是记忆层,然而这些技术不限于与记忆层一起使用。在一个示例性实施例中,中间层可以是用于在使用光刻胶层涂覆衬底之前平坦化衬底的平坦化层。在另一个示例性实施例中,图案转移工艺可以是多重图案化工艺,中间层可以是平坦化层,并且蚀刻层可以是记忆层。
用于去除中间层的基于热的去除工艺不限于特定的基于热的去除机制。例如,在一个实施例中,可以通过向中间层周围的环境提供热能来向该中间层提供能量热能。在另一个实施例中,可以使用电磁能量来向中间层提供热能,例如,在一个实施例中,可以使用激光来加热该中间层,或者在另一实施例中,可以使用微波能量。将认识到的是,可以使用其他方法来加热中间层,以实现基于热的去除机制。
在一个实施例中,中间层是热分解材料。如本文所使用的,这种材料可以至少部分地通过向材料施加热能来分解,使得可以经由施加热能从衬底去除该材料。可以以各种方式将热能施加至热分解材料。例如,加热分解材料周围的环境是施加热能的一种方式。在另一个示例中,可以使用激光、微波或其他电磁能量在热分解材料中产生热能。
本文提供的附图展示了在不损坏底层的蚀刻层的情况下去除中间层的技术的使用。如图所示,该工艺的示例性使用是多重图案化工艺。然而,如上文所述,本文所描述的技术不限于多重图案化工艺。图1A至图3C中示出了使用本文所描述的热分解技术的工艺集成流程的一个实施例。如图1A所示,提供了结构100。结构100包括衬底105。衬底105可以是期望使用图案化特征的任何衬底。例如,在一个实施例中,衬底105可以是其上形成有一个或多个半导体处理层的半导体衬底。在一个实施例中,衬底105可以是已经经受了多个半导体处理步骤的衬底,该多个半导体处理步骤产生了各种各样的结构和层,所有这些结构和层都是在衬底处理领域中已知的。在一个示例性实施例中,结构100可以用作三重图案化技术的一部分,该三重图案化技术在用于处理半导体晶片的后段制程(BEOL)处理步骤或前段制程(FEOL)处理步骤中使用。
还提供了作为多重图案化工艺的一部分要蚀刻的层。在该示例中,要蚀刻的层是记忆层110。还可以在记忆层110上方形成并图案化光刻胶层125。如图1A所示,光刻胶层125可以被形成为具有线、间隔和/或过孔的图案。在光刻胶层125与记忆层110之间,可以设置有一个或多个中间层。在所示出的示例性工艺中,可以使用两个中间层。将认识到的是,中间层可以是各种各样的层中的任何一种,例如,抗反射涂覆层、硬掩模层、平坦化层等。如图1A的示例所示,中间层之一是平坦化层。在现有技术中,平坦化层可以是有机平坦化层,因而这可能需要使用反应离子蚀刻来去除该有机平坦化层。相比而言,在图1A的实施例中,中间层包括热分解层115,在此实施例中,该热分解层形成平坦化层。接下来,如图1A所示。还提供了附加层120。附加层120可以是硬掩模层、抗反射涂覆层或图案化工艺中使用的任何其他层中的一个或多个。尽管未示出,但也可以在热分解层115与记忆层110之间使用附加层。例如,可以在热分解层115与记忆层110之间使用底部抗反射层或其他层。因此,将认识到的是,图1A中所示的特定的叠层仅仅是示例性的,并且可以使用层的许多其他变体,同时仍然获得使用如本文所描述的热分解材料的益处。
在图案化和蚀刻工艺期间,期望将光刻胶层125的图案转移到期望通过多个图案蚀刻的层(即,记忆层110)。图1B展示了光刻胶层125的图案到记忆层110的转移。这样的图案转移可以经由等离子体蚀刻工艺来实现,但也可以使用其他技术来实现。如图所示,光刻胶层125和附加层120已经被去除。这样的去除可能是本领域已知的标准光刻-蚀刻-剥离工艺技术的结果。如所示出的,热分解层115保留在衬底105上。接下来,如图1C所示,可以通过施加热能来去除热分解层115。如上文所述,这样的对热能的施加可以通过各种方式来实现,包括但不限于通过使用激光、微波等来加热热分解层周围的环境。由于热去除工艺的性质,热分解层115的去除可以在不对记忆层110造成损坏的情况下实现。例如,与通过诸如反应离子蚀刻等蚀刻来去除中间平坦化层时可能导致的对记忆层110的损坏相比,这可以使记忆层110的轮廓变化最小化。
在一个示例性实施例中,可以通过使热分解层115经历小于400°摄氏度(C)的加热过程来去除该层。在另一个实施例中,加热过程可以在100℃到350℃的范围内,并且在又另一个实施例中,加热过程可以在200℃到260℃之间。在一个实施例中,可以通过施加热量五分钟来进行热分解层去除工艺。然而,将认识到的是可以使用其他温度和时间。
上述工艺可以在用于衬底工艺流程的各种处理步骤中单独使用。在一个示例性实施例中,上述工艺可以是多重图案化工艺的一部分(然而,如上所述,本文所描述的技术不限于多重图案化工艺)。以下关于图2A至图2C以及图3A至图3C示出了可以在上述图1A至图1C的步骤之后使用的工艺步骤在多重图案化工艺中的使用。更具体地,图2A至图2C示出了第二图案化步骤的使用,并且图3A至图3C示出了第三图案化步骤的使用。复制上文针对图1所描述的工艺,使得在记忆层中形成第二图案和第三图案,如图2A至图2C以及图3A至图3C所示。更具体地,如图2A所示,结构200可以包括第二光刻胶层225、第二附加层220以及第二热分解层215,这些层设置在由图1C产生的记忆层110的上方。如图2B所示,然后可以根据第二光刻胶层225的图案蚀刻第二热分解层215和记忆层110。接下来,如图2C所示,可以通过如以上所讨论的热工艺来去除第二热分解层215。如此,如图2C所示,光刻胶层125和第二光刻胶层225的图案被转移到记忆层110,并且第二热分解层通过第二热处理工艺被去除。
如图3A至图3C所示,可以再一次复制图2A至图2C的工艺。更具体地,如图3A所示,结构300可以包括第三光刻胶层325、第三附加层320以及第三热分解层315,这些层设置在由图2C产生的记忆层110的上方。在所示的示例中,第三热分解层315用作第三平坦化层。如图3B所示,然后可以根据第三光刻胶层325的图案蚀刻第三热分解层315和记忆层110。接下来,如图3C所示,可以通过如上所讨论的热工艺来去除第三热分解层315。如此,如图3C所示,光刻胶层125、第二光刻胶层225以及第三光刻胶层325的图案被转移到记忆层110。以这种方式,记忆层110的重复蚀刻在记忆层中提供了最终的图案。在所示的示例中,通过使用第三图案化层(第三光刻胶层325)将第三图案添加到记忆层。
图2A至图2C以及图3A至图3C示出了使用附加热分解层充当光刻胶层与记忆层之间的平坦化层。如所示出的,两个附加层均充当平坦化层,尽管将认识到的是,热分解层不限于平坦化层。与图1A至图1C一样,可以经由施加热能、以使对记忆层的损坏最小化的方式来去除热分解层。以这种方式,可以实现需要去除三个平坦化层的三重图案化工艺,而不会由于去除三个平坦化层而损坏记忆层。进一步地,如图1A至图1C所示,第一热分解层通过施加热量来解聚。进一步地,在包括图1A至图2C的实施例中,第一热分解层和第二热分解层均通过热处理来解聚,每个后续的热分解层(诸如图3A至图3C中的)也是如此。然而,将认识到的是,与在所有多重图案化步骤中都使用本文所描述的技术相比,仅在多重图案化步骤中的一些步骤中使用这些技术仍然可以获得这些技术的益处。
在一个实施例中,热分解层可以由诸如尿素键合树脂、特别是聚脲等材料组成,该材料具有解聚性,并且具有可以通过小于400℃的热处理(并且在另一个实施例中通过小于300℃的热处理)来去除的特性。因此,通过施加热能来解聚该层。通过使用此类热分解材料,与标准的有机平坦化层相比,消除了在有机平坦化层去除时记忆层暴露于蚀刻工艺的风险。因为可以通过热处理去除热分解层,所以可以消除去除工艺对记忆层的影响。因此,即使在多重光刻和蚀刻工艺之后,也可以保持记忆层的形状。因此,通过使平坦化层为热分解材料,不必使用反应离子蚀刻工艺来去除平坦化层,并且可以抑制记忆层的形状变化。因此,即使进行了多次图案化,也可以抑制记忆层的形状劣化。
本文所描述的技术不限于特定的热分解材料,因为可以在使用各种材料的同时仍然获得使用热去除工艺而使得不会损坏记忆层的益处。然而,如上所讨论的,在一个实施例中,可以使用尿素键合树脂。这种尿素键合树脂的一个具体实施例是可以经由薄膜沉积形成的聚脲。Yatsuda等人2017年7月19日提交的名称为“Method of FabricatingSemiconductor Device,Vacuum Processing Apparatus and Substrate ProcessingApparatus[制造半导体器件的方法、真空处理装置以及衬底处理装置]”的美国专利申请号15/654,307中更详细地描述了用于形成聚脲以及通过解聚工艺来去除这种聚脲以热分解聚脲的示例性技术,该美国专利申请的披露内容通过引用以其全文明确结合在此。美国专利申请号15/654,307中描述的技术包括但不限于将异氰酸盐和胺作为原料单体共聚以形成脲键,并且如所描述的,可以使用示例性气相沉积聚合工艺。如美国专利申请号15/654,307中所描述的,也可以使用液体工艺来形成聚脲。进一步地,如所描述的,随后可以通过施加热处理将聚脲解聚为胺并蒸发。然而,将认识到的是,可以使用其他形成工艺和其他去除工艺,同时仍然获得如本文所描述的使用热分解层和对这种层进行热去除的益处。进一步地,将认识到的是,本文所描述的技术不限于聚脲,并且可以使用其他材料和/或聚脲与其他材料的组合或变体。
将认识到的是,上述工艺流程仅仅是示例性的,并且许多其他工艺和应用也可以有利地使用本文所披露的技术。图4至图6展示了用于使用本文所描述的处理技术的示例性方法。将认识到的是,图4至图6的实施例仅仅是示例性的,并且其他方法也可以使用本文所描述的技术。进一步地,可以将附加的处理步骤添加到图4至图6所示的方法中,因为所描述的步骤并非旨在是排他的。此外,步骤的顺序不限于图中所示的顺序,因为可能出现不同的顺序和/或可以组合地或同时地执行各种步骤。
在图4中,示出了一种蚀刻衬底的方法。该方法包括步骤405,在衬底上提供第一层;以及步骤410,在衬底上提供具有第一图案的第一图案化层。该方法进一步包括步骤415,在第一图案化层与第一层之间提供一个或多个中间层,至少一个中间层是第一热分解层。该方法还包括步骤420,蚀刻第一层以在第一层中形成第一图案。该方法进一步包括步骤425,通过向第一热分解层施加热能来去除第一热分解层。
在图5中,示出了一种图案化衬底的方法。该方法包括步骤505,向衬底提供包括光刻胶图案化层、第一热分解层以及记忆层的结构,该光刻胶图案化层的图案包括线、间隔和/或过孔。该方法还包括步骤510,对图案的间隔和/或过孔进行到记忆层的图案转移,同时将图案的线保留在热分解层上。该方法进一步包括步骤515,执行第一热处理工艺以去除第一热分解层的任何剩余部分。
在图6中,示出了一种多重图案化衬底的方法。该方法可以包括步骤605,向衬底提供包括第一图案化层的结构,第一图案化层具有第一图案。该方法还包括步骤610,提供记忆层。该方法包括步骤615,在第一图案化层与记忆层之间提供第一热分解层,该第一热分解层是第一平坦化层。该方法包括步骤620,执行第一图案转移以将第一图案转移到记忆层;以及步骤625,通过向第一热分解层施加热能来去除第一热分解层。在去除第一热分解层之后,该方法包括步骤630,提供第二热分解层,其中,该第二热分解层是第二平坦化层。该方法进一步包括步骤635,提供第二图案化层,使得第二热分解层位于该第二图案化层与记忆层之间,其中,该第二图案化层具有第二图案。该方法还包括步骤640,执行第二图案转移以将第二图案转移到记忆层;以及步骤645,通过向该第二热分解层施加热能来去除第二热分解层。
鉴于该描述,本发明的进一步修改和替代性实施例对于本领域技术人员将是显而易见的。因此,该描述将被解释为仅是说明性的,并且是为了教导本领域技术人员实施本发明的方式。应当理解的是,在本文示出和描述的本发明的形式和方法将被视为目前的优选实施例。等效的技术可以代替本文展示和描述的技术,并且可以独立于其他特征的使用来使用本发明的某些特征,所有这些对于受益于本发明的描述的本领域技术人员而言都是显而易见的。
Claims (20)
1.一种蚀刻衬底的方法,该方法包括:
在该衬底上提供第一层;
在该衬底上提供具有第一图案的第一图案化层;
在该第一图案化层与该第一层之间提供一个或多个中间层,至少一个中间层是第一热分解层;
蚀刻该第一层以在该第一层中形成该第一图案;以及
通过向该第一热分解层施加热能来去除该第一热分解层,
其中,蚀刻该衬底的方法是多重图案化工艺,该多重图案化工艺包括重复蚀刻该第一层以在该第一层中形成多个图案。
2.如权利要求1所述的方法,其中,该第一热分解层是通过施加热能来解聚的材料。
3.如权利要求1所述的方法,其中,该第一热分解层通过400℃或更低的热处理来解聚。
4.如权利要求3所述的方法,其中,该第一热分解层通过260℃或更低的热处理来解聚。
5.如权利要求1所述的方法,其中,该第一热分解层由尿素键合树脂组成。
6.如权利要求1所述的方法,其中,该方法包括形成第二热分解层并通过向该第二热分解层施加热能来去除该第二热分解层。
7.如权利要求6所述的方法,其中,该第一层是记忆层。
8.一种图案化衬底的方法,该方法包括:
向该衬底提供包括光刻胶图案化层、第一热分解层以及记忆层的结构,该光刻胶图案化层的图案包括线、间隔和/或过孔;
对该图案的间隔和/或过孔进行到该记忆层的图案转移,同时将该图案的线保留在该第一热分解层上;以及
执行第一热处理工艺以去除该第一热分解层的任何剩余部分。
9.如权利要求8所述的方法,其中,该第一热分解层是通过施加热能来解聚的材料。
10.如权利要求8所述的方法,其中,该第一热分解层由尿素键合树脂组成。
11.如权利要求8所述的方法,其中,图案化该衬底的方法是多重图案化工艺,该多重图案化工艺包括将多于一个的图案转移到该记忆层。
12.如权利要求11所述的方法,其中,该方法包括形成第二热分解层并通过使用第二热处理工艺来去除该第二热分解层。
13.如权利要求12所述的方法,其中,该第一热分解层和该第二热分解层均是平坦化层。
14.如权利要求8所述的方法,其中,该第一热分解层是平坦化层。
15.一种多重图案化衬底的方法,该方法包括:
向该衬底提供包括第一图案化层的结构,该第一图案化层具有第一图案;
提供记忆层;
在该第一图案化层与该记忆层之间提供第一热分解层,该第一热分解层是第一平坦化层;
执行第一图案转移以将该第一图案转移到该记忆层;
通过向该第一热分解层施加热能来去除该第一热分解层;
在去除该第一热分解层之后,提供第二热分解层,其中,该第二热分解层是第二平坦化层;
提供第二图案化层,使得该第二热分解层位于该第二图案化层与该记忆层之间,其中,该第二图案化层具有第二图案;
执行第二图案转移以将该第二图案转移到该记忆层;以及
通过向该第二热分解层施加热能来去除该第二热分解层。
16.如权利要求15所述的方法,其中,该第一热分解层和该第二热分解层均包括通过施加热能来解聚的材料。
17.如权利要求16所述的方法,其中,该第一热分解层和该第二热分解层均通过300℃或更低的热处理来解聚。
18.如权利要求17所述的方法,其中,该第一热分解层和该第二热分解层均由尿素键合树脂组成。
19.如权利要求18所述的方法,进一步包括:
在去除该第二热分解层之后,提供第三热分解层,其中,该第三热分解层是第三平坦化层;
提供第三图案化层,使得该第三热分解层位于该第三图案化层与该记忆层之间,其中,该第三图案化层具有第三图案;
执行第三图案转移以将该第三图案转移到该记忆层;以及
通过向该第二热分解层施加热能来去除该第三热分解层。
20.如权利要求18所述的方法,其中,该对热能的施加包括通过使用激光或通过使用微波来加热该热分解层周围的环境。
Applications Claiming Priority (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201862637743P | 2018-03-02 | 2018-03-02 | |
US62/637,743 | 2018-03-02 | ||
US201862666751P | 2018-05-04 | 2018-05-04 | |
US62/666,751 | 2018-05-04 | ||
PCT/US2019/020031 WO2019169122A1 (en) | 2018-03-02 | 2019-02-28 | Method to transfer patterns to a layer |
Publications (2)
Publication Number | Publication Date |
---|---|
CN111727490A true CN111727490A (zh) | 2020-09-29 |
CN111727490B CN111727490B (zh) | 2024-07-09 |
Family
ID=67805926
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201980013826.2A Active CN111727490B (zh) | 2018-03-02 | 2019-02-28 | 用于将图案转移到层的方法 |
Country Status (6)
Country | Link |
---|---|
US (1) | US10916428B2 (zh) |
JP (1) | JP7164773B2 (zh) |
KR (1) | KR102401711B1 (zh) |
CN (1) | CN111727490B (zh) |
TW (1) | TWI783128B (zh) |
WO (1) | WO2019169122A1 (zh) |
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- 2019-02-28 JP JP2020545635A patent/JP7164773B2/ja active Active
- 2019-02-28 KR KR1020207027547A patent/KR102401711B1/ko active IP Right Grant
- 2019-02-28 CN CN201980013826.2A patent/CN111727490B/zh active Active
- 2019-03-01 US US16/290,580 patent/US10916428B2/en active Active
- 2019-03-04 TW TW108107038A patent/TWI783128B/zh active
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JP7164773B2 (ja) | 2022-11-02 |
CN111727490B (zh) | 2024-07-09 |
KR20200118212A (ko) | 2020-10-14 |
KR102401711B1 (ko) | 2022-05-26 |
US10916428B2 (en) | 2021-02-09 |
JP2021515402A (ja) | 2021-06-17 |
US20200020534A1 (en) | 2020-01-16 |
TWI783128B (zh) | 2022-11-11 |
WO2019169122A1 (en) | 2019-09-06 |
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