CN111522385A - Pmos输出功率管的低压差稳压器 - Google Patents

Pmos输出功率管的低压差稳压器 Download PDF

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Abstract

本发明提供了一种PMOS输出功率管的低压差稳压器，包括低压差稳压单元和电流检测单元，电流检测单元包括第二PMOS管、第三PMOS管和检测放大器，所述第二PMOS管的栅极与所述误差放大电路的输出端和所述第一PMOS管的栅极连接，所述第二PMOS管的源极接输入电压，所述第二PMOS管的漏极与所述第三PMOS管的源极和所述检测放大器的第一输入端连接，所述第三PMOS管的栅极与所述检测放大器的输出端连接，所述检测放大器的第二输入端与所述第一PMOS管的漏极连接。所述PMOS输出功率管的低压差稳压器中，能够检测出低压差稳压单元的输出电流大小，根据输出电流的大小，改善低压差稳压单元的负载调整率。

Description

PMOS输出功率管的低压差稳压器
技术领域
本发明涉及低压差稳压器技术领域，尤其涉及一种PMOS输出功率管的低压差稳压器。
背景技术
低压差稳压器包括输出功率期间、反馈网络和误差放大器，其输出电流随着负载情况轻重导致变化范围很大，从而影响到电路的稳定性、工作温度、输出电压的稳定性等。
其中，输出电流的变化而引起电源输出变化，可以用负载调整率(LoadRegulation)指标描述，用公式可以表述为：Load Regulation＝|Vfl-Vml|/Vhlx100％，Vfl和Vml分别是低压差稳压器满载时和最小负载时的输出电压，Vhl是半载时的输出电压。负载增加，输出电压降低，相反负载减少，输出电压升高，因此，负载调整率越小说明低压差稳压器抑制负载干扰的能力越强。但现有技术中，缺乏针对PMOS输出功率管的低压差稳压器的电流检测电路以及负载调整电路。
因此，有必要提供一种新型的PMOS输出功率管的低压差稳压器以解决现有技术中存在的上述问题。
发明内容
本发明的目的在于提供一种PMOS输出功率管的低压差稳压器，检测输出电流的大小，从而改善低压差稳压器的负载调整率。
为实现上述目的，本发明的所述PMOS输出功率管的低压差稳压器，包括：
低压差稳压单元，包括误差放大电路、第一PMOS管和反馈网络，所述误差放大电路的输出端与所述第一PMOS管的栅极连接，所述误差放大电路的输入端与所述反馈网络的输出端连接，所述第一PMOS管的源极接输入电压，所述第一PMOS管的漏极与所述反馈网络的输入端连接，所述反馈网络的接地端接地；
电流检测单元，包括第二PMOS管、第三PMOS管和检测放大器，所述第二PMOS管的栅极与所述误差放大电路的输出端和所述第一PMOS管的栅极连接，所述第二PMOS管的源极接输入电压，所述第二PMOS管的漏极与所述第三PMOS管的源极和所述检测放大器的第一输入端连接，所述第三PMOS管的栅极与所述检测放大器的输出端连接，所述检测放大器的第二输入端与所述第一PMOS管的漏极连接；
其中，所述误差放大电路包括误差放大器或误差放大调整电路中的一种，
当所述误差放大电路为所述误差放大器时，所述第三PMOS管的漏极与所述反馈网络的输出端连接；
当所述误差放大电路为所述误差放大器时，所述PMOS输出功率管的低压差稳压器还包括参考电压调整电路，所述参考电压调整电路的输出端与所述误差放大器的输入端连接，所述参考电压调整电路的输入端与所述第三PMOS管的漏极连接；
当所述误差放大电路为误差放大调整电路时，所述第三PMOS管的漏极与所述误差放大调整电路的输入端连接。
本发明的有益效果在于：电流检测单元包括第二PMOS管、第三PMOS管和检测放大器，所述第二PMOS管的栅极与所述误差放大电路的输出端和所述第一PMOS管的栅极连接，所述第二PMOS管的源极接输入电压，所述第二PMOS管的漏极与所述第三PMOS管的源极和所述检测放大器的第一输入端连接，所述第三PMOS管的栅极与所述检测放大器的输出端连接，所述检测放大器的第二输入端与所述第一PMOS管的漏极连接，从而能够检测出所述低压差稳压单元的输出电流大小，从而根据输出电流的大小，改善所述低压差稳压单元的负载调整率。
优选地，所述参考电压调整电路包括第三电阻和第四电阻，所述第三电阻的一端与输入电压和所述误差放大器的输入端连接，所述第三电阻的另一端与所述第四电阻的一端和所述第三PMOS管的漏极连接，所述第四电阻的另一端接地。其有益效果在于：所述参考电压调整电路能够根据所述电流检测单元检测到的输出电流的大小调整所述误差放大器的参考电压，从而改善所述低压差稳压单元的负载调整率。
优选地，所述误差放大调整电路包括第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第一NMOS管和第二NMOS管，所述第四PMOS管的源极和所述第五PMOS管的源极连接，所述第四PMOS管的栅极接参考电压，所述第四PMOS管的漏极通过第一线与所述第三PMOS管的漏极连接，所述第五PMOS管的源极接输入电压，所述第五PMOS管的栅极与所述反馈网络的输出端连接，所述第五PMOS管的漏极与所述第二NMOS管的源极连接，所述第二NMOS管的源极接地，所述第二NMOS管的栅极与所述第一NMOS管的栅极连接，所述第一NMOS管的源极与所述第一线连接后接地，所述第二NMOS管的漏极与第七PMOS管的漏极和第一PMOS管的栅极连接，所述第七PMOS管的源极接输入电压，所述第七PMOS管的栅极与所述第六PMOS管的栅极连接，所述第六PMOS管的源极接输入电压，所述第六PMOS管的漏极接所述第一NMOS管的漏极，所述第六PMOS管的栅极和漏极短接。其有益效果在于：所述误差放大调整电路能够根据所述电流检测单元检测到的输出电流的大小进行调整，代替了现有技术中的误差放大器，从而能够改善所述低压差稳压单元的负载调整率。
优选地，所述误差放大调整电路包括第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第一NMOS管、第二NMOS管、第三NMOS管、第四NMOS管、第五NMOS管和第六NMOS管，所述第四PMOS管的源极和所述第五PMOS管的源极连接，所述第五PMOS管的栅极接参考电压，所述第四PMOS管的漏极与所述第四NMOS管的漏极连接，所述第四NMOS管的漏极与栅极短接，所述第四NMOS管的栅极与所述第五NMOS管的栅极连接，所述第五NMOS管的漏极与所述第一NMOS管的源极连接，所述第一NMOS管的栅极与所述第二NMOS管的栅极连接，所述第一NMOS管的漏极与所述第六PMOS管的漏极连接，所述第六PMOS管的源极接输入电压，所述第六PMOS管的漏极和栅极短接，所述第六PMOS管的栅极与所述第七PMOS管的栅极连接，所述第七PMOS管的源极接输入电压，所述第七PMOS管的漏极与第一PMOS管的栅极和所述第二NMOS管的漏极连接，所述第二NMOS管的源极与所述第三PMOS管的漏极和所述第六NMOS管的漏极连接，所述第六NMOS管的栅极与所述第三NMOS管的栅极连接，所述第三NMOS管的漏极和栅极短接，所述第三NMOS管的漏极与所述第五PMOS管的漏极连接，所述第五PMOS管的栅极与所述反馈网络的输出端连接，所述第三NMOS管、所述第四NMOS管、所述第五NMOS管和所述第六NMOS管的源极均接地。其有益效果在于：所述误差放大调整电路能够根据所述电流检测单元检测到的输出电流的大小进行调整，代替了现有技术中的误差放大器，从而能够改善所述低压差稳压单元的负载调整率。
附图说明
图1为本发明低压差稳压单元的电路示意图；
图2为本发明一些实施例中PMOS输出功率管的低压差稳压器的电路示意图；
图3为本发明又一些实施例中PMOS输出功率管的低压差稳压器的电路示意图；
图4为本发明再一些实施例中PMOS输出功率管的低压差稳压器的电路示意图；
图5为本发明一些优选实施例中一些实施例中PMOS输出功率管的低压差稳压器的电路示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面将结合本发明的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明的一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。除非另外定义，此处使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本文中使用的“包括”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。
针对现有技术存在的问题，本发明的实施例提供了一种PMOS输出功率管的低压差稳压器，参照图1至图5，所述PMOS输出功率管的低压差稳压器包括低压差稳压单元10和电流检测单元20，所述低压差稳压单元10包括误差放大电路11、第一PMOS管12和反馈网络13，所述误差放大电路11的输出端与所述第一PMOS管12的栅极连接，所述误差放大电路11的输入端与所述反馈网络13的输出端连接，所述第一PMOS管12的源极接输入电压，所述第一PMOS管12的漏极与所述反馈网络13的输入端连接，所述反馈网络13的接地端接地。具体地，所述反馈网络13包括第一电阻131和第二电阻132，所述第一电阻131的一端与所述第一PMOS管12的漏极连接，所述第一电阻131的另一端与所述第二电阻132连接，所述第二电阻132的另一端接地。
一些实施中，参照图2和图3，所述误差放大电路为所述误差放大器14，所述误差放大器14的输出端与所述第一PMOS管12的栅极连接，所述误差放大器14的负相输入端接参考电压，所述误差放大器14的正相输入端与所述第一电阻131和所述第二电阻132的一端连接。
一些实施例中，所述电流检测单元包括第二PMOS管、第三PMOS管和检测放大器，所述第二PMOS管的栅极与所述误差放大电路的输出端和所述第一PMOS管的栅极连接，所述第二PMOS管的源极接输入电压，所述第二PMOS管的漏极与所述第三PMOS管的源极和所述检测放大器的第一输入端连接，所述第三PMOS管的栅极与所述检测放大器的输出端连接，所述检测放大器的第二输入端与所述第一PMOS管的漏极连接，所述第三PMOS管的漏极与所述反馈网络的输出端连接。
具体地，参照图2，所述电流检测单元20包括第二PMOS管21、第三PMOS管22和检测放大器23，所述第二PMOS管21的栅极与所述误差放大器14的输出端和所述第一PMOS管12的栅极连接，所述第二PMOS管21的源极接输入电压，所述第二PMOS管21的漏极与所述第三PMOS管22的源极和所述检测放大器23的负相输入端连接，所述第三PMOS管22的栅极与所述检测放大器的输出端连接，所述检测放大器23的正相输入端与所述第一PMOS管的漏极连接，所述第三PMOS管22的漏极与所述第一电阻131和所述第二电阻132的一端连接。
一些实施例中，所述误差放大电路为所述误差放大器，所述PMOS输出功率管的低压差稳压器还包括参考电压调整电路，所述参考电压调整电路的输出端与所述误差放大器的输入端连接，所述参考电压调整电路的输入端与所述第三PMOS管的漏极连接。
具体地，参照图3，所述参考电压调整电路30包括第三电阻31和第四电阻32，所述第三电阻31的一端与输入电压和所述误差放大器14的输入端连接，所述第三电阻31的另一端与所述第四电阻32的一端和所述第三PMOS管22的漏极连接，所述第四电阻32的另一端接地。具体地，所述第三电阻31的一端与输入电压和所述误差放大器14的负相输入端连接，所述误差放大器14的正相输入端与所述第一电阻131和所述第二电阻132的一端连接。
一些实施例中，所述误差放大电路为误差放大调整电路，所述第三PMOS管的漏极与所述误差放大调整电路的输入端连接。
一些具体实施例中，参照图4，所述误差放大调整电路15包括第四PMOS管151、第五PMOS管152、第六PMOS管153、第七PMOS管154、第一NMOS管155和第二NMOS管156，所述第四PMOS管151的源极和所述第五PMOS管152的源极连接，所述第四PMOS管151的栅极接参考电压，所述第四PMOS管151的漏极通过第一线1511与所述第三PMOS管22的漏极连接，所述第五PMOS管152的源极接输入电压，所述第五PMOS管152的栅极与所述反馈网络13的输出端连接，所述第五PMOS管152的漏极与所述第二NMOS管156的源极连接，所述第二NMOS管156的源极接地，所述第二NMOS管156的栅极与所述第一NMOS管155的栅极连接，所述第一NMOS管155的源极与所述第一线1511连接后接地，所述第二NMOS管156的漏极与第七PMOS管154的漏极和第一PMOS管12的栅极连接，所述第七PMOS管154的源极接输入电压，所述第七PMOS管154的栅极与所述第六PMOS管153的栅极连接，所述第六PMOS管153的源极接输入电压，所述第六PMOS管153的漏极接所述第一NMOS管155的漏极，所述第六PMOS管153的栅极和漏极短接。更具体具体地，所述第五PMOS管152的栅极与所述第一电阻131和所述第二电阻132的一端连接。
又一些具体实施例中，参照图5，所述误差放大调整电路15包括第四PMOS管151、第五PMOS管152、第六PMOS管153、第七PMOS管154、第一NMOS管155、第二NMOS管156、第三NMOS管157、第四NMOS管158、第五NMOS管159和第六NMOS管160，所述第四PMOS管151的源极和所述第五PMOS管152的源极连接，所述第五PMOS管152的栅极接参考电压，所述第四PMOS管151的漏极与所述第四NMOS管158的漏极连接，所述第四NMOS管158的漏极与栅极短接，所述第四NMOS管158的栅极与所述第五NMOS管159的栅极连接，所述第五NMOS管159的漏极与所述第一NMOS管155的源极连接，所述第一NMOS管155的栅极与所述第二NMOS管156的栅极连接，所述第一NMOS管155的漏极与所述第六PMOS管153的漏极连接，所述第六PMOS管153的源极接输入电压，所述第六PMOS管153的漏极和栅极短接，所述第六PMOS管153的栅极与所述第七PMOS管154的栅极连接，所述第七PMOS管154的源极接输入电压，所述第七PMOS管154的漏极与第一PMOS管12的栅极和所述第二NMOS管156的漏极连接，所述第二NMOS管156的源极与所述第三PMOS管22的漏极和所述第六NMOS管160的漏极连接，所述第六NMOS管160的栅极与所述第三NMOS管157的栅极连接，所述第三NMOS管157的漏极和栅极短接，所述第三NMOS管157的漏极与所述第五PMOS管152的漏极连接，所述第五PMOS管152的栅极与所述反馈网络13的输出端连接，所述第三NMOS管157、所述第四NMOS管158、所述第五NMOS管159和所述第六NMOS管160的源极均接地。更具体地，所述第五PMOS管152的栅极与所述第一电阻131和所述第二电阻132的一端连接。
虽然在上文中详细说明了本发明的实施方式，但是对于本领域的技术人员来说显而易见的是，能够对这些实施方式进行各种修改和变化。但是，应理解，这种修改和变化都属于权利要求书中所述的本发明的范围和精神之内。而且，在此说明的本发明可有其它的实施方式，并且可通过多种方式实施或实现。

Claims (4)

1.一种PMOS输出功率管的低压差稳压器，其特征在于，包括：
低压差稳压单元，包括误差放大电路、第一PMOS管和反馈网络，所述误差放大电路的输出端与所述第一PMOS管的栅极连接，所述误差放大电路的输入端与所述反馈网络的输出端连接，所述第一PMOS管的源极接输入电压，所述第一PMOS管的漏极与所述反馈网络的输入端连接，所述反馈网络的接地端接地；
电流检测单元，包括第二PMOS管、第三PMOS管和检测放大器，所述第二PMOS管的栅极与所述误差放大电路的输出端和所述第一PMOS管的栅极连接，所述第二PMOS管的源极接输入电压，所述第二PMOS管的漏极与所述第三PMOS管的源极和所述检测放大器的第一输入端连接，所述第三PMOS管的栅极与所述检测放大器的输出端连接，所述检测放大器的第二输入端与所述第一PMOS管的漏极连接；
其中，所述误差放大电路包括误差放大器或误差放大调整电路中的一种，
当所述误差放大电路为所述误差放大器时，所述第三PMOS管的漏极与所述反馈网络的输出端连接；
当所述误差放大电路为所述误差放大器时，所述PMOS输出功率管的低压差稳压器还包括参考电压调整电路，所述参考电压调整电路的输出端与所述误差放大器的输入端连接，所述参考电压调整电路的输入端与所述第三PMOS管的漏极连接；
当所述误差放大电路为误差放大调整电路时，所述第三PMOS管的漏极与所述误差放大调整电路的输入端连接。
2.根据权利要求1所述的PMOS输出功率管的低压差稳压器，其特征在于，所述参考电压调整电路包括第三电阻和第四电阻，所述第三电阻的一端与输入电压和所述误差放大器的输入端连接，所述第三电阻的另一端与所述第四电阻的一端和所述第三PMOS管的漏极连接，所述第四电阻的另一端接地。
3.根据权利要求1所述的PMOS输出功率管的低压差稳压器，其特征在于，所述误差放大调整电路包括第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第一NMOS管和第二NMOS管，所述第四PMOS管的源极和所述第五PMOS管的源极连接，所述第四PMOS管的栅极接参考电压，所述第四PMOS管的漏极通过第一线与所述第三PMOS管的漏极连接，所述第五PMOS管的源极接输入电压，所述第五PMOS管的栅极与所述反馈网络的输出端连接，所述第五PMOS管的漏极与所述第二NMOS管的源极连接，所述第二NMOS管的源极接地，所述第二NMOS管的栅极与所述第一NMOS管的栅极连接，所述第一NMOS管的源极与所述第一线连接后接地，所述第二NMOS管的漏极与第七PMOS管的漏极和第一PMOS管的栅极连接，所述第七PMOS管的源极接输入电压，所述第七PMOS管的栅极与所述第六PMOS管的栅极连接，所述第六PMOS管的源极接输入电压，所述第六PMOS管的漏极接所述第一NMOS管的漏极，所述第六PMOS管的栅极和漏极短接。
4.根据权利要求1所述的PMOS输出功率管的低压差稳压器，其特征在于，所述误差放大调整电路包括第四PMOS管、第五PMOS管、第六PMOS管、第七PMOS管、第一NMOS管、第二NMOS管、第三NMOS管、第四NMOS管、第五NMOS管和第六NMOS管，所述第四PMOS管的源极和所述第五PMOS管的源极连接，所述第五PMOS管的栅极接参考电压，所述第四PMOS管的漏极与所述第四NMOS管的漏极连接，所述第四NMOS管的漏极与栅极短接，所述第四NMOS管的栅极与所述第五NMOS管的栅极连接，所述第五NMOS管的漏极与所述第一NMOS管的源极连接，所述第一NMOS管的栅极与所述第二NMOS管的栅极连接，所述第一NMOS管的漏极与所述第六PMOS管的漏极连接，所述第六PMOS管的源极接输入电压，所述第六PMOS管的漏极和栅极短接，所述第六PMOS管的栅极与所述第七PMOS管的栅极连接，所述第七PMOS管的源极接输入电压，所述第七PMOS管的漏极与第一PMOS管的栅极和所述第二NMOS管的漏极连接，所述第二NMOS管的源极与所述第三PMOS管的漏极和所述第六NMOS管的漏极连接，所述第六NMOS管的栅极与所述第三NMOS管的栅极连接，所述第三NMOS管的漏极和栅极短接，所述第三NMOS管的漏极与所述第五PMOS管的漏极连接，所述第五PMOS管的栅极与所述反馈网络的输出端连接，所述第三NMOS管、所述第四NMOS管、所述第五NMOS管和所述第六NMOS管的源极均接地。
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