CN111312158A - 一种像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本申请公开了一种像素电路及其驱动方法、显示装置，该像素电路包括电流控制子电路、组合发光子电路、第一发光元件至第N发光元件，N为大于1的自然数，其中：电流控制子电路用于接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度；组合发光子电路用于接收驱动电流以及第一发光数据信号至第N发光数据信号，根据第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。本申请通过组合发光子电路驱动第一发光元件至第N发光元件中的一个或多个发光，实现不同面积的发光元件芯片的组合发光，从而提高了显示装置在高低灰阶下的显示效果。

Description

一种像素电路及其驱动方法、显示装置
技术领域
本申请涉及但不限于显示技术领域，尤其涉及一种像素电路及其驱动方法、显示装置。
背景技术
微发光二极管(Micro Light Emitting Diode，Micro LED)技术是通过在一个芯片上高密度地集成微小尺寸的LED阵列，以实现LED的薄膜化、微小化和矩阵化，其像素间的距离能够达到微米级别，而且每一个像素都能定址、单独发光。Micro LED显示面板因其低驱动电压、长寿命、耐宽温等特点，逐渐向消费者终端机所用的显示面板发展。
通常通过像素电路与Micro LED电连接，以驱动Micro LED发光。在相关的像素电路中，通常通过电流和发光时间来共同调节灰阶，但是，通过电流来调节灰阶，会使得低灰阶对应低电流密度，其效率就会降低，并且随着电流密度的变化，Micro LED的色坐标会发生变化，即Micro LED在灰阶变化时会发生色偏；而依靠减小发光时间来调节灰阶，容易造成画面闪烁，进而影响显示面板的显示效果。
发明内容
本申请提供了一种像素电路及其驱动方法、显示装置，能够提高显示面板的显示效果。
本申请实施例提供了一种像素电路，包括：电流控制子电路、组合发光子电路、第一发光元件至第N发光元件，N为大于1的自然数，其中：所述电流控制子电路，用于接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度；所述组合发光子电路，用于接收驱动电流以及第一发光数据信号至第N发光数据信号，根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。
在一些实施例中，所述组合发光子电路包括第一发光子电路和第二发光子电路，所述驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，其中：所述第一发光子电路，分别与复位控制信号端、第一发光数据信号端和第一发光元件连接，用于接收第一驱动电流，在复位控制信号端和第一发光数据信号端的控制下，驱动第一发光元件发光或控制第一发光元件不发光；所述第二发光子电路，分别与第一扫描信号端、第二发光数据信号端和第二发光元件连接，用于接收第二驱动电流，在第一扫描信号端和第二发光数据信号端的控制下，驱动第二发光元件发光或控制第二发光元件不发光。
在一些实施例中，所述第一发光子电路包括第一晶体管、第二晶体管和第一电容，所述第二发光子电路包括第三晶体管、第四晶体管和第二电容，其中：所述第一晶体管的控制极和第二节点连接，所述第一晶体管的第一极和第一节点连接，所述第一晶体管的第二极与第一发光元件连接；所述第二晶体管的控制极和复位控制信号端连接，所述第二晶体管的第一极和第一发光数据信号端连接，所述第二晶体管的第二极与第二节点连接；所述第一电容的一端与所述第二节点连接，所述第一电容的另一端与公共电压端连接；所述第三晶体管的控制极和第三节点连接，所述第三晶体管的第一极和第一节点连接，所述第三晶体管的第二极与第二发光元件连接；所述第四晶体管的控制极和第一扫描信号端连接，所述第四晶体管的第一极和第二发光数据信号端连接，所述第四晶体管的第二极与第三节点连接；所述第二电容的一端与所述第三节点连接，所述第二电容的另一端与公共电压端连接。
在一些实施例中，所述电流控制子电路还用于，根据发光控制信号控制产生的驱动电流的时长；所述组合发光子电路还用于，根据产生的驱动电流的时长，控制第一发光元件至第N发光元件的发光时长。
在一些实施例中，所述组合发光子电路包括第三发光子电路和第四发光子电路，所述驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，其中：所述第三发光子电路，分别与第二扫描信号端、第一发光数据信号端和第一发光元件连接，用于接收第一驱动电流，在第二扫描信号端和第一发光数据信号端的控制下，驱动第一发光元件发光并根据第一驱动电流的时长，控制第一发光元件的发光时长，或控制第一发光元件不发光；所述第四发光子电路，分别与第三扫描信号端、第二发光数据信号端和第二发光元件连接，用于接收第二驱动电流，在第三扫描信号端和第二发光数据信号端的控制下，驱动第二发光元件发光并根据第二驱动电流的时长，控制第二发光元件的发光时长，或控制第二发光元件不发光。
在一些实施例中，所述第三发光子电路包括第一晶体管、第五晶体管和第一电容，所述第四发光子电路包括第三晶体管、第六晶体管和第二电容，其中：所述第一晶体管的控制极和第二节点连接，所述第一晶体管的第一极和第一节点连接，所述第一晶体管的第二极与第一发光元件连接；所述第五晶体管的控制极和第二扫描信号端连接，所述第五晶体管的第一极和第一发光数据信号端连接，所述第五晶体管的第二极与第二节点连接；所述第一电容的一端与所述第二节点连接，所述第一电容的另一端与公共电压端连接；所述第三晶体管的控制极和第三节点连接，所述第三晶体管的第一极和第一节点连接，所述第三晶体管的第二极与第二发光元件连接；所述第六晶体管的控制极和第三扫描信号端连接，所述第六晶体管的第一极和第二发光数据信号端连接，所述第六晶体管的第二极与第三节点连接；所述第二电容的一端与所述第三节点连接，所述第二电容的另一端与公共电压端连接。
在一些实施例中，所述电流控制子电路包括：驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路，其中：所述驱动子电路，分别与第四节点、第五节点和第六节点连接，用于在第四节点和第五节点的信号的控制下，向第六节点提供驱动电流；所述写入子电路，分别与第一扫描信号端、显示数据信号端以及第五节点连接，用于在第一扫描信号端的信号的控制下，将显示数据信号端的信号写入第五节点；所述补偿子电路，分别与第一电压端、第一扫描信号端、第四节点以及第六节点连接，用于在第一扫描信号端的信号和第一电压端的信号的控制下，对第四节点进行补偿；所述复位子电路分别与复位控制信号端、初始电压端以及第四节点连接，用于在复位控制信号端的信号的控制下，将初始电压端的信号写入第四节点；所述发光控制子电路，分别与第一电压端、发光控制信号端、第一节点、第五节点和第六节点连接，用于在发光控制信号端的信号的控制下，向第五节点提供第一电压端的信号，并在第六节点和第一节点之间允许驱动电流通过。
在一些实施例中，所述驱动子电路包括第七晶体管，所述补偿子电路包括第八晶体管和第三电容，所述复位子电路包括第九晶体管，所述写入子电路包括第十晶体管，所述发光控制子电路包括第十一晶体管和第十二晶体管，其中：所述第七晶体管的控制极和第四节点连接，所述第七晶体管的第一极和第五节点连接，所述第七晶体管的第二极与第六节点连接；所述第八晶体管的控制极和第一扫描信号端连接，所述第八晶体管的第一极和第四节点连接，所述第八晶体管的第二极与第六节点连接；所述第三电容的一端与所述第四节点连接，所述第三电容的另一端与所述第一电压端连接；所述第九晶体管的控制极和复位控制信号端连接，所述第九晶体管的第一极和初始电压端连接，所述第九晶体管的第二极与第四节点连接；所述第十晶体管的控制极和第一扫描信号端连接，所述第十晶体管的第一极和显示数据信号端连接，所述第十晶体管的第二极与第五节点连接；所述第十一晶体管的控制极和发光控制信号端连接，所述第十一晶体管的第一极和第一电压端连接，所述第十一晶体管的第二极与第五节点连接；所述第十二晶体管的控制极和发光控制信号端连接，所述第十二晶体管的第一极和第六节点连接，所述第十二晶体管的第二极与第一节点连接。
本申请实施例还提供了一种显示装置，包括：如上所述的像素电路。
本申请实施例还提供了一种像素电路的驱动方法，用于驱动如上所述的像素电路，所述像素电路具有多个扫描周期，在一个扫描周期内，所述驱动方法包括：电流控制子电路接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度；组合发光子电路接收驱动电流以及第一发光数据信号至第N发光数据信号，根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。
在一些实施例中，所述驱动方法还包括：所述电流控制子电路根据发光控制信号控制产生的驱动电流的时长；所述组合发光子电路根据产生的驱动电流的时长，控制第一发光元件至第N发光元件的发光时长。
与相关技术相比，本申请的像素电路及其驱动方法、显示装置，通过组合发光子电路根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光，实现不同面积的发光元件芯片的组合发光，从而提高了显示装置在高低灰阶下的显示效果。
本申请的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变得显而易见，或者通过实施本申请而了解。本申请的其他优点可通过在说明书以及附图中所描述的方案来实现和获得。
附图说明
附图用来提供对本申请技术方案的理解，并且构成说明书的一部分，与本申请的实施例一起用于解释本申请的技术方案，并不构成对本申请技术方案的限制。
图1为本申请实施例提供的像素电路的结构示意图之一；
图2为本申请实施例提供的像素电路的结构示意图之二；
图3为本申请实施例提供的组合发光子电路的等效电路图之一；
图4为本申请实施例提供的电流控制子电路的结构示意图；
图5为本申请实施例提供的电流控制子电路的等效电路图；
图6为本申请实施例提供的像素电路的等效电路图之一；
图7为图6所示像素电路在一个扫描周期内的工作时序图；
图8为本申请实施例提供的像素电路的结构示意图之三；
图9为本申请实施例提供的组合发光子电路的等效电路图之二；
图10为本申请实施例提供的像素电路的等效电路图之二；
图11为图10所示像素电路在一个扫描周期内的工作时序图；
图12为本申请实施例提供的像素电路的驱动方法的流程图之一；
图13为本申请实施例提供的像素电路的驱动方法的流程图之二。
附图标记说明：
EM—发光控制信号端； DataI—显示数据信号端；
VDD—第一电压端； VSS—第二电压端；
DataS(i)—第i发光数据信号端； Reset—复位控制信号端；
N1～N6—节点； C1～C3—电容；
GateA、GateB(1)、GateB(2)—扫描信号端； T1～T12—晶体管；
EL1～ELN—发光元件； Vinit—初始电压端；
VCOM—公共电压端。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚明白，下文中将结合附图对本发明的实施例进行详细说明。需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互任意组合。
除非另外定义，本申请实施例公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本申请实施例中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语一直出该词前面的元件或误检涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者误检。
本领域技术人员可以理解，本申请所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件。优选地，本申请实施例中使用的薄膜晶体管可以是氧化物半导体晶体管。由于这里采用的晶体管的源极、漏极是对称的，所以其源极、漏极可以互换。在本申请实施例中，为区分晶体管除栅极之外的两极，将其中一个电极称为第一极，另一电极称为第二极，第一极可以为源极或者漏极，第二极可以为漏极或源极。
本申请实施例提供一种像素电路，图1为本申请实施例的像素电路的结构示意图，如图1所示，本申请实施例提供的像素电路包括：电流控制子电路、组合发光子电路以及第一发光元件EL1至第N发光元件ELN，其中，N为大于1的自然数。
具体的，电流控制子电路分别与第一电压端VDD、显示数据信号端DataI、发光控制信号端EM和第一节点N1连接，用于接收显示数据信号端DataI的显示数据信号和发光控制信号端EM的发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度。
组合发光子电路分别与第一节点N1、第一发光数据信号端DataS(1)至第N发光数据信号端DataS(N)、第一发光元件EL1至第N发光元件ELN连接，用于接收电流控制子电路的驱动电流以及第一发光数据信号端DataS(1)的第一发光数据信号至第N发光数据信号端DataS(N)的第N发光数据信号，根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件EL1至第N发光元件ELN中的一个或多个发光。
在本实施例中，第一发光数据信号可以用于控制第一发光元件EL1是否发光，第二发光数据信号可以用于控制第二发光元件EL2是否发光，……，第N发光数据信号可以用于控制第N发光元件ELN是否发光。例如，当第i发光数据信号为低电平时，第i发光元件ELi发光，i为1至N之间的自然数。
本申请实施例提供的像素电路，通过组合发光子电路根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件EL1至第N发光元件ELN中的一个或多个发光，实现不同面积的发光元件芯片的组合发光，从而提高了显示装置在高低灰阶下的显示效果。
本申请实施例的像素电路，可以通过多种方案实现。下面通过具体实施例详细说明本申请实施例的技术方案。
第一实施例
本实施例以N＝2为例进行说明，即该像素电路中包括两个发光元件，该两个发光元件的发光面积可以相同，也可以不同，示例性的，第一发光元件EL1的发光面积可以小于第二发光元件EL2的发光面积，以实现不同面积的组合发光效果。需要说明的是，本实施例提供的像素电路的结构同样适用于N为其他值时的情况。当N为3或3个以上时，可以选择N个发光元件中的M个发光元件所在的发光子电路和复位控制信号端Reset连接，N个发光元件中的(N-M)个发光元件所在的发光子电路和第一扫描信号端GateA连接，M为1至N-1之间的自然数。
图2为本申请第一实施例的像素电路的结构示意图。如图2所示，该组合发光子电路包括第一发光子电路和第二发光子电路，驱动电流分为用于驱动第一发光元件EL1的第一驱动电流和用于驱动第二发光元件EL2的第二驱动电流。
具体的，第一发光子电路分别与第一节点N1、复位控制信号端Reset、第一发光数据信号端DataS(1)和第一发光元件EL1连接，用于接收第一驱动电流，在复位控制信号端Reset的复位信号和第一发光数据信号端DataS(1)的第一发光数据信号的控制下，驱动第一发光元件EL1发光或控制第一发光元件EL1不发光。
第二发光子电路分别与第一节点N1、第一扫描信号端GateA、第二发光数据信号端DataS(2)和第二发光元件EL2连接，用于接收第二驱动电流，在第一扫描信号端GateA的第一扫描信号和第二发光数据信号端DataS(2)的第二发光数据信号的控制下，驱动第二发光元件EL2发光或控制第二发光元件EL2不发光。
需要说明的是，当第一发光元件EL1和第二发光元件EL2中只有一个发光时，对应不发光的发光元件支路的驱动电流为零，例如，当第一发光元件EL1发光、第二发光元件EL2不发光时，第二驱动电流的电流值为零，第一驱动电流的电流值等于驱动电流的电流值。
在一些实施例中，如图3所示，本申请实施例提供的第一发光子电路包括第一晶体管T1、第二晶体管T2和第一电容C1，第二发光子电路包括第三晶体管T3、第四晶体管T4和第二电容C2。
具体的，第一晶体管T1的控制极和第二节点N2连接，第一晶体管T1的第一极和第一节点N1连接，第一晶体管T1的第二极与第一发光元件EL1的阳极连接，第一发光元件EL1的阴极与第二电压端VSS连接；第二晶体管T2的控制极和复位控制信号端Reset连接，第二晶体管T2的第一极和第一发光数据信号端DataS(1)连接，第二晶体管T2的第二极与第二节点N2连接；第一电容C1的一端与第二节点N2连接，第一电容C1的另一端与公共电压端VCOM连接；第三晶体管T3的控制极和第三节点N3连接，第三晶体管T3的第一极和第一节点N1连接，第三晶体管T3的第二极与第二发光元件EL2的阳极连接，第二发光元件EL2的阴极与第二电压端VSS连接；第四晶体管T4的控制极和第一扫描信号端GateA连接，第四晶体管T4的第一极和第二发光数据信号端DataS(2)连接，第四晶体管T4的第二极与第三节点N3连接；第二电容C2的一端与第三节点N3连接，第二电容C2的另一端与公共电压端VCOM连接。
图3中具体示出了第一发光子电路和第二发光子电路的一种示例性结构。本领域技术人员容易理解是，第一发光子电路和第二发光子电路的实现方式不限于此，只要能够实现其各自的功能即可。
在一些实施例中，如图4所示，本申请实施例提供的电流控制子电路包括：驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路。
具体的，驱动子电路分别与第四节点N4、第五节点N5和第六节点N6连接，用于在第四节点N4和第五节点N5的信号的控制下，向第六节点N6提供驱动电流；写入子电路分别与第一扫描信号端GateA、显示数据信号端DataI以及第五节点N5连接，用于在第一扫描信号端GateA的第一扫描信号的控制下，将显示数据信号端DataI的显示数据信号写入第五节点N5；补偿子电路分别与第一电压端VDD、第一扫描信号端GateA、第四节点N4以及第六节点N6连接，用于在第一扫描信号端GateA的第一扫描信号和第一电压端VDD的第一电压信号的控制下，对第四节点N4进行补偿；复位子电路分别与复位控制信号端Reset、初始电压端Vinit以及第四节点N4连接，用于在复位控制信号端Reset的复位控制信号的控制下，将初始电压端Vinit的初始电压信号写入第四节点N4；发光控制子电路分别与第一电压端VDD、发光控制信号端EM、第一节点N1、第五节点N5和第六节点N6连接，用于在发光控制信号端EM的发光控制信号的控制下，向第五节点N5提供第一电压端VDD的第一电压信号，并在第六节点N6和第一节点N1之间允许驱动电流通过。
在一些实施例中，如图5所示，驱动子电路包括第七晶体管T7，补偿子电路包括第八晶体管T8和第三电容C3，复位子电路包括第九晶体管T9，写入子电路包括第十晶体管T10，发光控制子电路包括第十一晶体管T11和第十二晶体管T12。
具体的，第七晶体管T7的控制极和第四节点N4连接，第七晶体管T7的第一极和第五节点N5连接，第七晶体管T7的第二极与第六节点N6连接；第八晶体管T8的控制极和第一扫描信号端GateA连接，第八晶体管T8的第一极和第四节点N4连接，第八晶体管T8的第二极与第六节点N6连接；第三电容C3的一端与第四节点N4连接，第三电容C3的另一端与第一电压端VDD连接；第九晶体管T9的控制极和复位控制信号端Reset连接，第九晶体管T9的第一极和初始电压端Vinit连接，第九晶体管T9的第二极与第四节点N4连接；第十晶体管T10的控制极和第一扫描信号端GateA连接，第十晶体管T10的第一极和显示数据信号端DataI连接，第十晶体管T10的第二极与第五节点N5连接；第十一晶体管T11的控制极和发光控制信号端EM连接，第十一晶体管T11的第一极和第一电压端VDD连接，第十一晶体管T11的第二极与第五节点N5连接；第十二晶体管T12的控制极和发光控制信号端EM连接，第十二晶体管T12的第一极和第六节点N6连接，第十二晶体管T12的第二极与第一节点N1连接。
图5中具体示出了驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路的一种示例性结构。本领域技术人员容易理解是，驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路的实现方式不限于此，只要能够实现其各自的功能即可。
图6为本申请实施例提供的像素电路的等效电路图，如图6所示，本申请实施例提供的像素电路中，组合发光子电路包括第一发光子电路和第二发光子电路，电流控制子电路包括：驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路，第一发光子电路包括第一晶体管T1、第二晶体管T2和第一电容C1，第二发光子电路包括第三晶体管T3、第四晶体管T4和第二电容C2，驱动子电路包括第七晶体管T7，补偿子电路包括第八晶体管T8和第三电容C3，复位子电路包括第九晶体管T9，写入子电路包括第十晶体管T10，发光控制子电路包括第十一晶体管T11和第十二晶体管T12。
具体的，第一晶体管T1的控制极和第二节点N2连接，第一晶体管T1的第一极和第一节点N1连接，第一晶体管T1的第二极与第一发光元件EL1的阳极端连接，第一发光元件EL1的阴极端与第二电压端VSS连接；第二晶体管T2的控制极和复位控制信号端Reset连接，第二晶体管T2的第一极和第一发光数据信号端DataS(1)连接，第二晶体管T2的第二极与第二节点N2连接；第一电容C1的一端与第二节点N2连接，第一电容C1的另一端与公共电压端VCOM连接；第三晶体管T3的控制极和第三节点N3连接，第三晶体管T3的第一极和第一节点N1连接，第三晶体管T3的第二极与第二发光元件EL2的阳极端连接，第二发光元件EL2的阴极端与第二电压端VSS连接；第四晶体管T4的控制极和第一扫描信号端GateA连接，第四晶体管T4的第一极和第二发光数据信号端DataS(2)连接，第四晶体管T4的第二极与第三节点N3连接；第二电容C2的一端与第三节点N3连接，第二电容C2的另一端与公共电压端VCOM连接；第七晶体管T7的控制极和第四节点N4连接，第七晶体管T7的第一极和第五节点N5连接，第七晶体管T7的第二极与第六节点N6连接；第八晶体管T8的控制极和第一扫描信号端GateA连接，第八晶体管T8的第一极和第四节点N4连接，第八晶体管T8的第二极与第六节点N6连接；第三电容C3的一端与第四节点N4连接，第三电容C3的另一端与第一电压端VDD连接；第九晶体管T9的控制极和复位控制信号端Reset连接，第九晶体管T9的第一极和初始电压端Vinit连接，第九晶体管T9的第二极与第四节点N4连接；第十晶体管T10的控制极和第一扫描信号端GateA连接，第十晶体管T10的第一极和显示数据信号端DataI连接，第十晶体管T10的第二极与第五节点N5连接；第十一晶体管T11的控制极和发光控制信号端EM连接，第十一晶体管T11的第一极和第一电压端VDD连接，第十一晶体管T11的第二极与第五节点N5连接；第十二晶体管T12的控制极和发光控制信号端EM连接，第十二晶体管T12的第一极和第六节点N6连接，第十二晶体管T12的第二极与第一节点N1连接。
图6中具体示出了组合发光子电路和电流控制子电路的示例性结构。本领域技术人员容易理解是，以上各子电路的实现方式不限于此，只要能够实现其各自的功能即可。
在本实施例中，发光元件EL(包括第一发光元件EL1至第N发光元件ELN)可以为微发光二极管，也可以为次毫米发光二极管(Mini LED)、有机发光二极管(Organic LightEmitting Diode，OLED)等其他类型的发光二极管。在实际应用中，发光元件EL的具体结构需要根据实际应用环境来设计确定，在此不作限定。以下均以发光元件EL为微发光二极管为例进行说明。
在本实施例中，第一晶体管T1～第四晶体管T4以及第七晶体管T7至第十二晶体管T12均可以为N型薄膜晶体管或P型薄膜晶体管，可以统一工艺流程，减少工艺制程，有助于提高产品的良率。此外，考虑到低温多晶硅薄膜晶体管的漏电流较小，因此，本发明实施例优选所有晶体管为低温多晶硅薄膜晶体管，薄膜晶体管具体可以选择底栅结构的薄膜晶体管或者顶栅结构的薄膜晶体管，只要能够实现开关功能即可。
需要说明的是，第一电容C1至第三电容C3可以是由像素电极与公共电极构成的液晶电容，也可以是由像素电极与公共电极构成的液晶电容以及存储电容构成的等效电容，本申请对此不作限定。
图7为本实施例的像素电路的工作时序图，在电流控制子电路完成阈值电压补偿的同时，组合发光子电路通过时序调控将第一发光元件EL1、第二发光元件EL2的发光数据信号DataS(1)和DataS(2)传递到第一电容C1和第二电容C2，在一时间内完成第一发光元件EL1和第二发光元件EL2的组合发光，其中，第一发光数据信号DataS(1)和第二发光数据信号DataS(2)的信号值可以为高电平或低电平，通过第一发光数据信号DataS(1)和第二发光数据信号DataS(2)控制第一晶体管T1和第三晶体管T3的通断。下面通过像素电路的工作过程进一步说明本发明实施例的技术方案。需要说明的是，下面是以第一级像素电路的工作过程为例进行说明的。
下面以本申请实施例提供的像素电路中第一晶体管T1～第四晶体管T4以及第七晶体管T7至第十二晶体管T12均为P型薄膜晶体管为例，结合图6所示的像素电路和图7所示的工作时序图，对一个像素电路在一帧周期内的工作过程进行具体的描述。如图6所示，本申请实施例提供的像素电路包括10个晶体管单元(T1～T4、T7～T12)、3个电容单元(C1～C3)和三个电压端(VDD、VSS、VCOM)，其中，第一电压端VDD持续提供高电平信号，第二电压端VSS持续提供低电平信号，公共电压端VCOM接地。
其工作过程包括：
第一阶段t1，即复位阶段，复位控制信号端Reset拉低，第九晶体管T9导通，将第七晶体管T7的栅极及第三电容C3的一端(即第四节点N4)复位为初始电压端Vinit的初始电压；同时，第二晶体管T2导通，第一发光数据信号端DataS(1)的第一发光数据信号传递到第一电容C1的一端和第一晶体管T1的栅极，控制第一晶体管T1的开关；
第二阶段t2，即阈值电压补偿及显示数据读取阶段，此时，第一扫描信号端GateA电压拉低，第十晶体管T10、第七晶体管T7和第八晶体管T8导通，显示数据信号端DataI的显示数据信号输入，并且将显示数据信号和阈值电压(VdataI+Vth)储存在第三电容C3上；同时，第四晶体管T4导通，第二发光数据信号端DataS(2)的第二发光数据信号传递到第二电容C2和第三晶体管T3的栅极，控制第三晶体管T3的开关；
第三阶段t3，即发光阶段，发光控制信号端EM给低电平，第十一晶体管T11和第十二晶体管T12处于导通状态，根据第一晶体管T1和第三晶体管T3的开关状态，决定第一发光元件EL1和EL2的工作状态，例如，当第一发光数据信号端DataS(1)为低电平时，第一晶体管T1导通，第一发光元件EL1处于工作状态。
根据显示需要，当某子像素显示低灰阶画面时，第一发光数据信号端DataS(1)为低电平，第二发光数据信号端DataS(2)为高电平，此时，小面积的Micro LED芯片EL1工作，大面积的Micro LED芯片EL2断开；当某子像素显示低灰阶画面时，第一发光数据信号端DataS(1)为低电平，第二发光数据信号端DataS(2)为低电平，此时，Micro LED芯片EL1和EL2均处于工作状态。
第二实施例
在第一实施例中，通过选择不同面积的发光元件的组合发光，来实现增强灰阶显示效果，第二实施例在第一实施例的基础上，通过引入独立的两组扫描信号GOA：GateA和GateB(其中，GateB包括GateB(1)和GateB(2))，实现在一帧显示中既可以选择不同面积的芯片组合工作，又可以选择芯片不同的发光时间段。
在本实施例中，电流控制子电路还用于，根据发光控制信号控制产生的驱动电流的时长；组合发光子电路还用于，根据产生的驱动电流的时长，控制第一发光元件EL1至第N发光元件ELN的发光时长。
本申请实施例提供的像素电路，通过组合发光子电路根据产生的驱动电流的时长以及接收的第一发光数据信号至第N发光数据信号，驱动第一发光元件EL1至第N发光元件ELN中的一个或多个发光及其发光时长，实现不同面积以及不同发光时长的发光元件芯片的组合发光，进一步提高了显示装置在高低灰阶下的显示效果。
本实施例同样以N＝2为例进行说明，即该像素电路中包括两个发光元件，该两个发光元件的发光面积可以相同，也可以不同，示例性的，第一发光元件EL1的发光面积可以小于第二发光元件EL2的发光面积，以实现不同面积的组合发光效果。需要说明的是，本实施例提供的像素电路的结构同样适用于N为其他值时的情况。当N为3或3个以上时，第i发光元件所在的发光子电路和第(i+1)扫描信号端GateB(i)、第i发光数据信号端DataS(i)连接，i为1至N之间的自然数。
图8为本申请第二实施例的像素电路的结构示意图。如图8所示，该组合发光子电路包括第三发光子电路和第四发光子电路，驱动电流分为用于驱动第一发光元件EL1的第一驱动电流和用于驱动第二发光元件EL2的第二驱动电流。
具体的，第三发光子电路分别与第一节点N1、第二扫描信号端GateB(1)、第一发光数据信号端DataS(1)和第一发光元件EL1连接，用于接收第一驱动电流，在第二扫描信号端GateB(1)的第二扫描信号和第一发光数据信号端DataS(1)的第一发光数据信号的控制下，驱动第一发光元件EL1发光并根据第一驱动电流的时长，控制第一发光元件EL1的发光时长，或控制第一发光元件EL1不发光。
第四发光子电路分别与第一节点N1、第三扫描信号端GateB(2)、第二发光数据信号端DataS(2)和第二发光元件EL2连接，用于接收第二驱动电流，在第三扫描信号端GateB(2)的第三扫描信号和第二发光数据信号端DataS(2)的第二发光数据信号的控制下，驱动第二发光元件EL2发光，并根据第二驱动电流的时长，控制第二发光元件EL2的发光时长，或控制第二发光元件EL2不发光。
需要说明的是，当第一发光元件EL1和第二发光元件EL2中只有一个发光时，对应不发光的发光元件支路的驱动电流为零，例如，当第一发光元件EL1发光、第二发光元件EL2不发光时，第二驱动电流的电流值为零，第一驱动电流的电流值等于驱动电流的电流值。
在一些实施例中，如图9所示，本申请实施例提供的第三发光子电路包括第一晶体管T1、第五晶体管T5和第一电容C1，第二发光子电路包括第三晶体管T3、第六晶体管T6和第二电容C2。
具体的，第一晶体管T1的控制极和第二节点N2连接，第一晶体管T1的第一极和第一节点N1连接，第一晶体管T1的第二极与第一发光元件EL1的阳极端连接，第一发光元件EL1的阴极端与第二电压端VSS连接；第五晶体管T5的控制极和第二扫描信号端GateB(1)连接，第五晶体管T5的第一极和第一发光数据信号端DataS(1)连接，第五晶体管T5的第二极与第二节点N2连接；第一电容C1的一端与第二节点N2连接，第一电容C1的另一端与公共电压端VCOM连接；第三晶体管T3的控制极和第三节点N3连接，第三晶体管T3的第一极和第一节点N1连接，第三晶体管T3的第二极与第二发光元件EL2的阳极端连接，第二发光元件EL2的阴极端与第二电压端VSS连接；第六晶体管T6的控制极和第三扫描信号端GateB(2)连接，第六晶体管T6的第一极和第二发光数据信号端DataS(2)连接，第六晶体管T6的第二极与第三节点N3连接；第二电容C2的一端与第三节点N3连接，第二电容C2的另一端与公共电压端VCOM连接。
图9中具体示出了第三发光子电路和第四发光子电路的一种示例性结构。本领域技术人员容易理解是，第三发光子电路和第四发光子电路的实现方式不限于此，只要能够实现其各自的功能即可。
本实施例的电流控制子电路可以采用与第一实施例的电流控制子电路相同的结构，此处不再赘述。
图10为本申请实施例提供的像素电路的等效电路图，如图10所示，本申请实施例提供的像素电路中，组合发光子电路包括第一发光子电路和第二发光子电路，电流控制子电路包括：驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路，第一发光子电路包括第一晶体管T1、第五晶体管T5和第一电容C1，第二发光子电路包括第三晶体管T3、第六晶体管T6和第二电容C2，驱动子电路包括第七晶体管T7，补偿子电路包括第八晶体管T8和第三电容C3，复位子电路包括第九晶体管T9，写入子电路包括第十晶体管T10，发光控制子电路包括第十一晶体管T11和第十二晶体管T12。
具体的，第一晶体管T1的控制极和第二节点N2连接，第一晶体管T1的第一极和第一节点N1连接，第一晶体管T1的第二极与第一发光元件EL1的阳极端连接，第一发光元件EL1的阴极端与第二电压端VSS连接；第五晶体管T5的控制极和第二扫描信号端GateB(1)连接，第五晶体管T5的第一极和第一发光数据信号端DataS(1)连接，第五晶体管T5的第二极与第二节点N2连接；第一电容C1的一端与第二节点N2连接，第一电容C1的另一端与公共电压端VCOM连接；第三晶体管T3的控制极和第三节点N3连接，第三晶体管T3的第一极和第一节点N1连接，第三晶体管T3的第二极与第二发光元件EL2的阳极端连接，第二发光元件EL2的阴极端与第二电压端VSS连接；第六晶体管T6的控制极和第三扫描信号端GateB(2)连接，第六晶体管T6的第一极和第二发光数据信号端DataS(2)连接，第六晶体管T6的第二极与第三节点N3连接；第二电容C2的一端与第三节点N3连接，第二电容C2的另一端与公共电压端VCOM连接；第七晶体管T7的控制极和第四节点N4连接，第七晶体管T7的第一极和第五节点N5连接，第七晶体管T7的第二极与第六节点N6连接；第八晶体管T8的控制极和第一扫描信号端GateA连接，第八晶体管T8的第一极和第四节点N4连接，第八晶体管T8的第二极与第六节点N6连接；第三电容C3的一端与第四节点N4连接，第三电容C3的另一端与第一电压端VDD连接；第九晶体管T9的控制极和复位控制信号端Reset连接，第九晶体管T9的第一极和初始电压端Vinit连接，第九晶体管T9的第二极与第四节点N4连接；第十晶体管T10的控制极和第一扫描信号端GateA连接，第十晶体管T10的第一极和显示数据信号端DataI连接，第十晶体管T10的第二极与第五节点N5连接；第十一晶体管T11的控制极和发光控制信号端EM连接，第十一晶体管T11的第一极和第一电压端VDD连接，第十一晶体管T11的第二极与第五节点N5连接；第十二晶体管T12的控制极和发光控制信号端EM连接，第十二晶体管T12的第一极和第六节点N6连接，第十二晶体管T12的第二极与第一节点N1连接。
图10中具体示出了组合发光子电路和电流控制子电路的示例性结构。本领域技术人员容易理解是，以上各子电路的实现方式不限于此，只要能够实现其各自的功能即可。
在本实施例中，发光元件EL(包括第一发光元件EL1至第N发光元件ELN)可以为微发光二极管，也可以为次毫米发光二极管、有机发光二极管等其他类型的发光二极管。在实际应用中，发光元件EL的具体结构需要根据实际应用环境来设计确定，在此不作限定。以下均以发光元件EL为微发光二极管为例进行说明。
在本实施例中，第一晶体管T1、第三晶体管T3、第五晶体管T5～第十二晶体管T12均可以为N型薄膜晶体管或P型薄膜晶体管，可以统一工艺流程，减少工艺制程，有助于提高产品的良率。此外，考虑到低温多晶硅薄膜晶体管的漏电流较小，因此，本发明实施例优选所有晶体管为低温多晶硅薄膜晶体管，薄膜晶体管具体可以选择底栅结构的薄膜晶体管或者顶栅结构的薄膜晶体管，只要能够实现开关功能即可。
需要说明的是，第一电容C1至第三电容C3可以是由像素电极与公共电极构成的液晶电容，也可以是由像素电极与公共电极构成的液晶电容以及存储电容构成的等效电容，本申请对此不作限定。
下面通过像素电路的工作过程进一步说明本发明实施例的技术方案。需要说明的是，下面是以第一级像素电路的工作过程为例进行说明的。
下面以本申请实施例提供的像素电路中第一晶体管T1、第三晶体管T3、第五晶体管T5～第十二晶体管T12均为P型薄膜晶体管为例，结合图10所示的像素电路和图11所示的工作时序图，对一个像素电路在一帧周期内的工作过程进行具体的描述。如图10所示，本申请实施例提供的像素电路包括10个晶体管单元(T1、T3、T5～T12)、3个电容单元(C1～C3)和3个电压端(VDD、VSS、VCOM)，其中，第一电压端VDD持续提供高电平信号，第二电压端VSS持续提供低电平信号，公共电压端VCOM接地。其工作过程包括：
第一阶段t1，即复位阶段，复位控制信号端Reset拉低，第九晶体管T9导通，将第七晶体管T7的栅极及第三电容C3的一端(即第四节点N4)复位为初始电压端Vinit的初始电压；同时，第二扫描信号端GateB(1)为低电平，第二晶体管T2导通，第一发光数据信号端DataS(1)的第一发光数据信号传递到第一电容C1的一端和第一晶体管T1的栅极，控制第一晶体管T1的开关；
第二阶段t2，即阈值电压补偿及显示数据读取阶段，此时第一扫描信号端GateA电压拉低，第十晶体管T10、第七晶体管T7和第八晶体管T8导通，显示数据信号端DataI的显示数据信号输入，并且将显示数据信号和阈值电压(VdataI+Vth)储存在第三电容C3上；同时，第三扫描信号端GateB(2)为低电平，第四晶体管T4导通，第二发光数据信号端DataS(2)的第二发光数据信号传递到第二电容C2和第三晶体管T3的栅极，控制第三晶体管T3的开关；
第三阶段t3，即第一发光子阶段，发光控制信号端EM给低电平时间time1，其余(t3-time1)时间内，发光控制信号端EM为高电平，当发光控制信号端EM在时间time1内为低电平时，第十一晶体管T11和第十二晶体管T12处于导通状态，根据第一晶体管T1和第三晶体管T3的开关状态，决定第一发光元件EL1和EL2的发光状态，例如，当第一发光数据信号端DataS(1)为低电平时，第一晶体管T1导通，第一发光元件EL1处于发光状态，且发光时长为time1。
第四阶段t4，即第一发光数据输入阶段，第二扫描信号端GateB(1)为低电平，第二晶体管T2导通，第一发光数据信号端DataS(1)的第一发光数据信号传递到第一电容C1的一端和第一晶体管T1的栅极，控制第一晶体管T1的开关；
第五阶段t5，即第二发光数据输入阶段，第三扫描信号端GateB(2)为低电平，第四晶体管T4导通，第二发光数据信号端DataS(2)的第二发光数据信号传递到第二电容C2和第三晶体管T3的栅极，控制第三晶体管T3的开关；
第六阶段t6，即第二发光子阶段，发光控制信号端EM给低电平时间time2，其余(t6-time2)时间内，发光控制信号端EM为高电平，当发光控制信号端EM在时间time2内为低电平时，第十一晶体管T11和第十二晶体管T12处于导通状态，根据第一晶体管T1和第三晶体管T3的开关状态，决定第一发光元件EL1和EL2的发光状态，例如，当第二发光数据信号端DataS(2)为低电平，第三晶体管T3导通，第二发光元件EL2处于发光状态，且发光时长为time2。
第七阶段t7的工作过程同第四阶段t4，第八阶段t8的工作过程同第五阶段t5，第九阶段t9的工作过程同第六阶段t6。
综合以上步骤，在显示子像素显示低灰阶时可在一帧时间内采用小面积第一发光元件EL1发光time1时间；高灰阶采用第一发光元件EL1和第二发光元件EL2同时发光(time1+time2+time3)时间。
第三实施例
基于前述实施例的发明构思，本申请实施例还提供了一种显示装置，包括前述任一实施例所述的像素电路。本申请实施例的显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
第四实施例
基于前述实施例的发明构思，本申请实施例还提供了一种像素电路的驱动方法，用于驱动如前第一实施例所述的像素电路，所述像素电路具有多个扫描周期，在一个扫描周期内，如图12所示，所述驱动方法包括步骤100至步骤200。
具体的，步骤100包括：电流控制子电路接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度。
在本实施例中，步骤100具体包括：
复位子电路在复位信号的控制下，对第三电容进行放电；
写入子电路和补偿子电路在第一扫描信号的控制下，将显示数据信号和阈值电压储存在第三电容上；
发光控制子电路在发光控制信号的控制下开启，驱动子电路产生的驱动电流经由发光控制子电路提供给组合发光子电路。
步骤200包括：组合发光子电路接收驱动电流以及第一发光数据信号至第N发光数据信号，根据第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。
在本实施例中，组合发光子电路包括第一发光子电路和第二发光子电路，驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，步骤200具体包括：
第一发光子电路接收第一驱动电流与第一发光数据信号，在复位信号和第一发光数据信号的控制下，驱动第一发光元件发光或控制第一发光元件不发光；
第二发光子电路接收第二驱动电流与第二发光数据信号，在第一扫描信号和第二发光数据信号的控制下，驱动第二发光元件发光或控制第二发光元件不发光。
第五实施例
基于前述实施例的发明构思，本申请实施例还提供了一种像素电路的驱动方法，用于驱动如前第二实施例所述的像素电路，所述像素电路具有多个扫描周期，在一个扫描周期内，如图13所示，所述驱动方法包括步骤300至步骤400。
具体的，步骤300包括：电流控制子电路接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流以及产生的驱动电流的时长，根据显示数据信号控制产生的驱动电流的电流强度。
在本实施例中，步骤300具体包括：
复位子电路在复位信号的控制下，对第三电容进行放电；
写入子电路和补偿子电路在第一扫描信号的控制下，将显示数据信号和阈值电压储存在第三电容上；
发光控制子电路在发光控制信号的控制下开启，驱动子电路产生的驱动电流经由发光控制子电路提供给组合发光子电路，并由发光控制子电路控制驱动电流的通过时长。
步骤400包括：组合发光子电路接收驱动电流以及第一发光数据信号至第N发光数据信号，根据第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光，并根据产生的驱动电流的时长，控制第一发光元件至第N发光元件的发光时长。
在本实施例中，组合发光子电路包括第一发光子电路和第二发光子电路，驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，步骤400具体包括：
第三发光子电路接收第一驱动电流，在第二扫描信号端和第一发光数据信号端的控制下，驱动第一发光元件发光并根据第一驱动电流的时长，控制第一发光元件的发光时长，或控制第一发光元件不发光；
第四发光子电路接收第二驱动电流，在第三扫描信号端和第二发光数据信号端的控制下，驱动第二发光元件发光并根据第二驱动电流的时长，控制第二发光元件的发光时长，或控制第二发光元件不发光。
本申请的像素电路及其驱动方法、显示装置，通过组合发光子电路根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光，实现不同面积的发光元件芯片的组合发光，从而提高了显示装置在高低灰阶下的显示效果。
有以下几点需要说明：
本申请实施例附图只涉及本申请实施例涉及到的结构，其他结构可参考通常设计。
在不冲突的情况下，本发明的实施例即实施例中的特征可以相互组合以得到新的实施例。
虽然本发明所揭露的实施方式如上，但所述的内容仅为便于理解本发明而采用的实施方式，并非用以限定本发明。任何本发明所属领域内的技术人员，在不脱离本发明所揭露的精神和范围的前提下，可以在实施的形式及细节上进行任何的修改与变化，但本发明的专利保护范围，仍须以所附的权利要求书所界定的范围为准。

Claims (11)

1.一种像素电路，其特征在于，包括：电流控制子电路、组合发光子电路、第一发光元件至第N发光元件，N为大于1的自然数，其中：
所述电流控制子电路，用于接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度；
所述组合发光子电路，用于接收驱动电流以及第一发光数据信号至第N发光数据信号，根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。
2.根据权利要求1所述的像素电路，其特征在于，所述组合发光子电路包括第一发光子电路和第二发光子电路，所述驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，其中：
所述第一发光子电路，分别与复位控制信号端、第一发光数据信号端和第一发光元件连接，用于接收第一驱动电流，在复位控制信号端和第一发光数据信号端的控制下，驱动第一发光元件发光或控制第一发光元件不发光；
所述第二发光子电路，分别与第一扫描信号端、第二发光数据信号端和第二发光元件连接，用于接收第二驱动电流，在第一扫描信号端和第二发光数据信号端的控制下，驱动第二发光元件发光或控制第二发光元件不发光。
3.根据权利要求2所述的像素电路，其特征在于，所述第一发光子电路包括第一晶体管、第二晶体管和第一电容，所述第二发光子电路包括第三晶体管、第四晶体管和第二电容，其中：
所述第一晶体管的控制极和第二节点连接，所述第一晶体管的第一极和第一节点连接，所述第一晶体管的第二极与第一发光元件连接；
所述第二晶体管的控制极和复位控制信号端连接，所述第二晶体管的第一极和第一发光数据信号端连接，所述第二晶体管的第二极与第二节点连接；
所述第一电容的一端与所述第二节点连接，所述第一电容的另一端与公共电压端连接；
所述第三晶体管的控制极和第三节点连接，所述第三晶体管的第一极和第一节点连接，所述第三晶体管的第二极与第二发光元件连接；
所述第四晶体管的控制极和第一扫描信号端连接，所述第四晶体管的第一极和第二发光数据信号端连接，所述第四晶体管的第二极与第三节点连接；
所述第二电容的一端与所述第三节点连接，所述第二电容的另一端与公共电压端连接。
4.根据权利要求1所述的像素电路，其特征在于，所述电流控制子电路还用于，根据发光控制信号控制产生的驱动电流的时长；所述组合发光子电路还用于，根据产生的驱动电流的时长，控制第一发光元件至第N发光元件的发光时长。
5.根据权利要求4所述的像素电路，其特征在于，所述组合发光子电路包括第三发光子电路和第四发光子电路，所述驱动电流分为用于驱动第一发光元件的第一驱动电流和用于驱动第二发光元件的第二驱动电流，其中：
所述第三发光子电路，分别与第二扫描信号端、第一发光数据信号端和第一发光元件连接，用于接收第一驱动电流，在第二扫描信号端和第一发光数据信号端的控制下，驱动第一发光元件发光并根据第一驱动电流的时长，控制第一发光元件的发光时长，或控制第一发光元件不发光；
所述第四发光子电路，分别与第三扫描信号端、第二发光数据信号端和第二发光元件连接，用于接收第二驱动电流，在第三扫描信号端和第二发光数据信号端的控制下，驱动第二发光元件发光并根据第二驱动电流的时长，控制第二发光元件的发光时长，或控制第二发光元件不发光。
6.根据权利要求5所述的像素电路，其特征在于，所述第三发光子电路包括第一晶体管、第五晶体管和第一电容，所述第四发光子电路包括第三晶体管、第六晶体管和第二电容，其中：
所述第一晶体管的控制极和第二节点连接，所述第一晶体管的第一极和第一节点连接，所述第一晶体管的第二极与第一发光元件连接；
所述第五晶体管的控制极和第二扫描信号端连接，所述第五晶体管的第一极和第一发光数据信号端连接，所述第五晶体管的第二极与第二节点连接；
所述第一电容的一端与所述第二节点连接，所述第一电容的另一端与公共电压端连接；
所述第三晶体管的控制极和第三节点连接，所述第三晶体管的第一极和第一节点连接，所述第三晶体管的第二极与第二发光元件连接；
所述第六晶体管的控制极和第三扫描信号端连接，所述第六晶体管的第一极和第二发光数据信号端连接，所述第六晶体管的第二极与第三节点连接；
所述第二电容的一端与所述第三节点连接，所述第二电容的另一端与公共电压端连接。
7.根据权利要求1所述的像素电路，其特征在于，所述电流控制子电路包括：驱动子电路、写入子电路、补偿子电路、复位子电路和发光控制子电路，其中：
所述驱动子电路，分别与第四节点、第五节点和第六节点连接，用于在第四节点和第五节点的信号的控制下，向第六节点提供驱动电流；
所述写入子电路，分别与第一扫描信号端、显示数据信号端以及第五节点连接，用于在第一扫描信号端的信号的控制下，将显示数据信号端的信号写入第五节点；
所述补偿子电路，分别与第一电压端、第一扫描信号端、第四节点以及第六节点连接，用于在第一扫描信号端的信号和第一电压端的信号的控制下，对第四节点进行补偿；
所述复位子电路分别与复位控制信号端、初始电压端以及第四节点连接，用于在复位控制信号端的信号的控制下，将初始电压端的信号写入第四节点；
所述发光控制子电路，分别与第一电压端、发光控制信号端、第一节点、第五节点和第六节点连接，用于在发光控制信号端的信号的控制下，向第五节点提供第一电压端的信号，并在第六节点和第一节点之间允许驱动电流通过。
8.根据权利要求7所述的像素电路，其特征在于，所述驱动子电路包括第七晶体管，所述补偿子电路包括第八晶体管和第三电容，所述复位子电路包括第九晶体管，所述写入子电路包括第十晶体管，所述发光控制子电路包括第十一晶体管和第十二晶体管，其中：
所述第七晶体管的控制极和第四节点连接，所述第七晶体管的第一极和第五节点连接，所述第七晶体管的第二极与第六节点连接；
所述第八晶体管的控制极和第一扫描信号端连接，所述第八晶体管的第一极和第四节点连接，所述第八晶体管的第二极与第六节点连接；
所述第三电容的一端与所述第四节点连接，所述第三电容的另一端与所述第一电压端连接；
所述第九晶体管的控制极和复位控制信号端连接，所述第九晶体管的第一极和初始电压端连接，所述第九晶体管的第二极与第四节点连接；
所述第十晶体管的控制极和第一扫描信号端连接，所述第十晶体管的第一极和显示数据信号端连接，所述第十晶体管的第二极与第五节点连接；
所述第十一晶体管的控制极和发光控制信号端连接，所述第十一晶体管的第一极和第一电压端连接，所述第十一晶体管的第二极与第五节点连接；
所述第十二晶体管的控制极和发光控制信号端连接，所述第十二晶体管的第一极和第六节点连接，所述第十二晶体管的第二极与第一节点连接。
9.一种显示装置，其特征在于，包括如权利要求1-8任一所述的像素电路。
10.一种像素电路的驱动方法，其特征在于，用于驱动如权利要求1-8任一所述的像素电路，所述像素电路具有多个扫描周期，在一个扫描周期内，所述驱动方法包括：
电流控制子电路接收显示数据信号和发光控制信号，根据发光控制信号控制是否产生驱动电流，根据显示数据信号控制产生的驱动电流的电流强度；
组合发光子电路接收驱动电流以及第一发光数据信号至第N发光数据信号，根据接收的驱动电流、第一发光数据信号至第N发光数据信号，驱动第一发光元件至第N发光元件中的一个或多个发光。
11.根据权利要求10所述的像素电路的驱动方法，其特征在于，所述驱动方法还包括：
所述电流控制子电路根据发光控制信号控制产生的驱动电流的时长；
所述组合发光子电路根据产生的驱动电流的时长，控制第一发光元件至第N发光元件的发光时长。
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