CN112017589A - 多灰阶像素驱动电路及显示面板 - Google Patents

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Abstract

本申请提供一种多灰阶像素驱动电路及显示面板，该多灰阶像素驱动电路在第一电位和第二电位之间串联设置驱动模块、发光模块和发光控制模块，利用驱动模块和发光控制模块依照预设时序控制发光模块的发光情况，使得发光模块能够实现低灰阶或高灰阶的多灰阶显示，大大提高了可以进行显示的灰阶数。将该多灰阶像素驱动电路用于显示面板中，能实现更多灰阶数的显示。

Description

多灰阶像素驱动电路及显示面板
技术领域
本申请涉及显示技术领域，尤其涉及一种多灰阶像素驱动电路及显示面板。
背景技术
目前，显示面板的每个像素单元仅包括有限数量的发光器件，例如每个像素单元包括红色、绿色、蓝色三个子像素电路，而每种颜色的子像素电路仅利用一个LED作为发光器件进行显示。并且，这有限数量的发光器件一般不能通过控制模块进行调节，因此现有的像素单元能实现的灰阶数较少，仅仅适用于低灰阶的显示，无法满足高灰阶的显示。
发明内容
为了解决上述问题，本申请提供一种多灰阶像素驱动电路，该多灰阶像素驱动电路包括：串联设置于第一电位和第二电位之间的驱动模块、发光模块和发光控制模块；其中，所述驱动模块和所述发光控制模块依照预设时序控制所述发光模块的发光情况，以实现低于灰阶阈值或高于所述灰阶阈值的多灰阶显示。
在一些实施例中，所述发光模块包括多个并联设置的发光单元，每个所述发光单元包括若干个串联和/或并联的发光器件。
在一些实施例中，所述多灰阶像素驱动电路还包括写入模块，所述写入模块的控制端接入扫描信号，所述写入模块的输入端接入数据信号，所述写入模块的输出端与所述驱动模块的控制端连接。
在一些实施例中，所述多灰阶像素驱动电路还包括存储模块，所述写入模块的输出端和所述驱动模块的输出端分别与所述存储模块的第一端连接，所述存储模块的第二端接地。
在一些实施例中，所述发光控制模块包括多个控制薄膜晶体管，每个所述控制薄膜晶体管的栅极接入所述发光控制模块接收到的对应的一个发光信号，每个所述控制薄膜晶体管的源极接入第二电位，每个所述控制薄膜晶体管的漏极与对应的一个所述发光单元的输入端连接。
在一些实施例中，所述驱动模块包括第二薄膜晶体管，所述第二薄膜晶体管的漏极接入所述第一电位，所述第二薄膜晶体管的源极与对应的一个所述发光单元的输出端连接。
在一些实施例中，所述写入模块包括第三薄膜晶体管，所述第三薄膜晶体管的栅极接入扫描信号，所述第三薄膜晶体管的源极接入数据信号，第三薄膜晶体管的漏极与所述第二薄膜晶体管的栅极连接。
在一些实施例中，所述存储模块包括存储电容，所述存储电容的第一端分别与所述第二薄膜晶体管的栅极和所述第三薄膜晶体管的漏极连接，所述存储电容的第二端接地。
另外，本申请还提供一种显示面板，该显示面板包括如上所述的多灰阶像素驱动电路。
本申请提供的多灰阶像素驱动电路及显示面板中，该多灰阶像素驱动电路在第一电位和第二电位之间串联设置驱动模块、发光模块和发光控制模块，利用驱动模块和发光控制模块依照预设时序控制发光模块的发光情况，使得发光模块能够实现低灰阶或高灰阶的多灰阶显示，与现有技术仅能实现低灰阶的显示相比，大大提高了可以进行显示的灰阶数。将该多灰阶像素驱动电路用于显示面板中，能实现更多灰阶数的显示。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的多灰阶像素驱动电路的第一种结构示意图。
图2为本申请实施例提供的多灰阶像素驱动电路的第二种结构示意图。
图3为本申请实施例提供的多灰阶像素驱动电路的第三种结构示意图。
图4为本申请实施例提供的多灰阶像素驱动电路的具体结构示意图。
图5(a)为本申请实施例提供的多灰阶像素驱动电路的低灰阶时序示意图。
图5(b)为本申请实施例提供的多灰阶像素驱动电路的高灰阶时序示意图。
图6本申请实施例提供的显示面板的结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请所有实施例为区分晶体管处栅极之外的两极，将其中一极称为源极，另一极称为漏极。由于晶体管的源极和漏极是对称的，因此其源极和漏极是可以互换的。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、信号输出端为漏极。此外，本申请所有实施例采用的晶体管可以包括P型和/或N型晶体管两种，其中，P型晶体管在栅极为低电位时打开，在栅极为高电位时关闭；N型晶体管在栅极为高电位时打开，在栅极为低电位时关闭。
图1为本申请实施例提供的多灰阶像素驱动电路的第一种结构示意图，图2为本申请实施例提供的多灰阶像素驱动电路的第二种结构示意图。如图1或图2所示，本申请提供一种多灰阶像素驱动电路，该多灰阶像素驱动电路包括：串联设置于第一电位V1和第二电位V2之间的驱动模块10、发光模块20和发光控制模块30；其中，驱动模块10和发光控制模块依照预设时序控制发光模块的发光情况，以实现低于灰阶阈值或高于灰阶阈值的多灰阶显示。
具体地，驱动模块10用于控制流经第一电位V1和第二电位V2之间的电流大小，发光控制模块30用于控制发光模块20中发光器件的发光情况，驱动模块10和发光控制模块30共同依照预设时序互相配合，使得发光模块20实现低于灰阶阈值或高于灰阶阈值的多灰阶显示。
需要说明的是，灰阶阈值可以根据实际情况选取0～255之间的灰阶值。例如选择灰阶阈值为50，则低于50的灰阶值为低灰阶，不低于50的灰阶值为高灰阶。
可以理解的是，驱动模块10、发光模块20和发光控制模块30在第一电位V1和第二电位V2之间的串联顺序并不限制。图1和图2为驱动模块10、发光模块20和发光控制模块30在第一电位V1和第二电位V2之间两种不同的串联关系的举例：在图1中，从第一电位V1到第二电位V2，驱动模块10、发光模块20和发光控制模块30依次串联；在图2中，从第一电位V1到第二电位V2，发光控制模块30、发光模块20和驱动模块10依次串联。以下实施例均以图1为基础进行扩展，但是以图2为基础进行扩展的实施例，均为本申请所保护的范围。
本申请提供的多灰阶像素驱动电路，在第一电位V1和第二电位V2之间串联设置驱动模块10、发光模块20和发光控制模块30，利用驱动模块10和发光控制模块30依照预设时序控制发光模块20的发光情况，使得发光模块实现低灰阶或高灰阶的多灰阶显示，大大提高了可以进行显示的灰阶数。
图3为本申请实施例提供的多灰阶像素驱动电路的第三种结构示意图。如图3所示，多灰阶像素驱动电路还包括写入模块40，写入模块40的控制端接入扫描信号SS，写入模块40的输入端接入数据信号DS，写入模块40的输出端与驱动模块10的控制端连接。
如图3所示，多灰阶像素驱动电路还包括存储模块50，写入模块40的输出端和驱动模块10的输出端分别与存储模块50的第一端连接，存储模块50的第二端接地。
进一步地，发光模块20包括多个并联设置的发光单元，每个发光单元包括若干个串联和/或并联的发光器件LED。
图4为本申请实施例提供的多灰阶像素驱动电路的具体结构示意图，图4为发光模块20包括2个并联设置的第一发光单元21和第二发光单元22，且第一发光单元21仅包括一个发光器件LED1，第二发光单元22仅包括一个发光器件LED2的示例。
需要说明的是，每个发光单元实际上可以包括若干个串联和/或并联的LED，即每个发光单元中的若干个LED可根据实际需要任意串联或并联组合，以实现不同的显示效果。
进一步地，发光控制模块30包括多个控制薄膜晶体管T1(图中未示出)，每个控制薄膜晶体管T1的栅极接入发光控制模块30接收到的对应的一个发光信号EM，每个控制薄膜晶体管T1的源极接入第二电位V2，每个控制薄膜晶体管T1的漏极与对应的一个发光单元的输入端连接。由此，每个控制薄膜晶体管T1根据发光控制模块30的一个发光信号EM来控制发光模块20中对应的一个发光单元的开关。
可以理解的是，在高灰阶显示或者低灰阶显示中，可以使部分发光单元保持常亮，即这部分发光单元连接的控制薄膜晶体管T1收到的发光信号EM保持恒定电位，使得这部分发光单元与第二电位V2之间的控制薄膜晶体管T1保持常开。或者，去掉这部分发光单元连接的控制薄膜晶体管T1，使这部分发光单元直接与第二电位V2连接，而无需经过对应的控制薄膜晶体管T1与第二电位V2连接，简化了电路结构。
如图4所示，发光控制模块30包括2个控制薄膜晶体管T1(第一控制薄膜晶体管T11和第二控制薄膜晶体管T12)，其中，第一控制薄膜晶体管T11根据第一发光信号EM1控制第一发光单元21的开关，第二控制薄膜晶体管T12根据第二发光信号EM2控制第二发光单元22的开关。
结合图3和图4，驱动模块10包括第二薄膜晶体管T2，第二薄膜晶体管T2的漏极接入第一电位V1，第二薄膜晶体管T2的源极与对应的一个发光单元的输出端连接。
结合图3和图4，写入模块40包括第三薄膜晶体管T3，第三薄膜晶体管T3的栅极接入扫描信号SS，第三薄膜晶体管T3的源极接入数据信号DS，第三薄膜晶体管T3的漏极与控制薄膜晶体管的栅极连接。
结合图3和图4，存储模块50包括存储电容CS，存储电容CS的第一端分别与第二薄膜晶体管T2的栅极和第三薄膜晶体管T3的漏极连接，存储电容CS的第二端接地。
以图4为例，假设图4中的所有薄膜晶体管均为N型薄膜晶体管，则本申请提供的多灰阶像素驱动电路的一种工作流程为：
图5(a)为本申请实施例提供的多灰阶像素驱动电路的低灰阶时序示意图。结合图4和图5(a)，扫描信号SS处于高电位时，第三薄膜晶体管T3打开，高电位的数据信号DS写入存储电容CS并使得第二薄膜晶体管T2打开，此时第一发光信号EM1为高电位使第一控制薄膜晶体管T11打开，第一发光单元21的LED1发光，同时第二发光信号EM2为低电位使第二控制薄膜晶体管T12关闭，第二发光单元22的LED2不发光，从而实现低灰阶的显示。
图5(b)为本申请实施例提供的多灰阶像素驱动电路的高灰阶时序示意图，结合图4和图5(b)，扫描信号SS处于高电位时，第三薄膜晶体管T3打开，高电位的数据信号DS写入存储电容CS并使得第二薄膜晶体管T2打开，此时第一发光信号EM1为高电位使第一控制薄膜晶体管T11打开，第一发光单元21的LED1发光，同时第二发光信号EM2为低电位使第二控制薄膜晶体管T12打开，第二发光单元22的LED2发光，从而实现高灰阶的显示。
由此，通过第一控制薄膜晶体管T11在第一发光信号EM1的控制下，以及第二控制薄膜晶体管T12在第二发光信号EM2的控制下，在仅LED1发光时实现低灰阶的显示，在LED1和LED2同时发光时实现高灰阶的显示，从而与现有技术只能实现LED1发光相比，提高了灰阶数。其中，LED1在低灰阶和高灰阶时均保持常亮，因此，可以去掉第一控制薄膜晶体管T11，使LED1直接与第二电位V2连接，以简化电路结构。
需要说明的是，在图4的基础上，将发光模块20和发光控制模块30进行上述实施例的变形实施例，均为本申请所保护的范围。
图6为本申请实施例提供的显示面板的结构示意图。如图6所示，本申请实施例还提供一种显示面板1，该显示面板1包括上述实施例所述的多灰阶像素驱动电路2，多个多灰阶像素驱动电路2在显示面板中呈阵列排布。该显示面板1具有与该多灰阶像素电路2相同的结构和有益效果，由于上述实施例已经对多灰阶像素驱动电路2的结构和有益效果进行了详细的描述，此处不再赘述。
可以理解的是，每个多灰阶像素驱动电路作为一个子像素电路，每三个多灰阶像素驱动电路组成一个像素单元，且这三个多灰阶像素电路中的LED分别能够发出红、绿、蓝三种颜色的光，以实现红、绿、蓝三种颜色中每种颜色的多灰阶显示，从而实现每个像素单元的多灰阶显示。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (9)

1.一种多灰阶像素驱动电路，其特征在于，包括：串联设置于第一电位和第二电位之间的驱动模块、发光模块和发光控制模块；
其中，所述驱动模块和所述发光控制模块依照预设时序控制所述发光模块的发光情况，以实现低于灰阶阈值或高于所述灰阶阈值的多灰阶显示。
2.如权利要求1所述的多灰阶像素驱动电路，其特征在于，所述发光模块包括多个并联设置的发光单元，每个所述发光单元包括若干个串联和/或并联的发光器件。
3.如权利要求2所述的多灰阶像素驱动电路，其特征在于，所述多灰阶像素驱动电路还包括写入模块，所述写入模块的控制端接入扫描信号，所述写入模块的输入端接入数据信号，所述写入模块的输出端与所述驱动模块的控制端连接。
4.如权利要求3所述的多灰阶像素驱动电路，其特征在于，所述多灰阶像素驱动电路还包括存储模块，所述写入模块的输出端和所述驱动模块的输出端分别与所述存储模块的第一端连接，所述存储模块的第二端接地。
5.如权利要求2所述的多灰阶像素驱动电路，其特征在于，所述发光控制模块包括多个控制薄膜晶体管，每个所述控制薄膜晶体管的栅极接入所述发光控制模块接收到的对应的一个发光信号，每个所述控制薄膜晶体管的源极接入第二电位，每个所述控制薄膜晶体管的漏极与对应的一个所述发光单元的输入端连接。
6.如权利要求4所述的多灰阶像素驱动电路，其特征在于，所述驱动模块包括第二薄膜晶体管，所述第二薄膜晶体管的漏极接入所述第一电位，所述第二薄膜晶体管的源极与对应的一个所述发光单元的输出端连接。
7.如权利要求6所述的多灰阶像素驱动电路，其特征在于，所述写入模块包括第三薄膜晶体管，所述第三薄膜晶体管的栅极接入扫描信号，所述第三薄膜晶体管的源极接入数据信号，第三薄膜晶体管的漏极与所述第二薄膜晶体管的栅极连接。
8.如权利要求7所述的多灰阶像素驱动电路，其特征在于，所述存储模块包括存储电容，所述存储电容的第一端分别与所述第二薄膜晶体管的栅极和所述第三薄膜晶体管的漏极连接，所述存储电容的第二端接地。
9.一种显示面板，其特征在于，包括如权利要求1～8任一项所述的多灰阶像素驱动电路。
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