CN110288950B - 像素阵列、阵列基板及显示装置 - Google Patents

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Abstract

本发明提供一种像素阵列、阵列基板及显示装置，属于显示技术领域，其可解决现有技术中刷新频率较低的问题。本发明的像素阵列包括：多行像素单元；每行像素单元由多条扫描线控制，每个像素单元由一条数据线提供数据电压；每个像素单元包括多个开关晶体管和显示模块；各个开关晶体管的第一极均连接数据线，第二极均连接显示模块，控制极与控制该行像素单元的扫描线一一对应连接。

Description

像素阵列、阵列基板及显示装置
技术领域
本发明属于显示技术领域，具体涉及一种像素阵列、阵列基板及显示装置。
背景技术
随着显示技术的不断发展，对于显示面板的刷新频率要求越来越高。目前，传统的显示方式中主要通过整面扫描的方式实现，其刷新频率有限，一般为60赫兹(Hz)或90Hz。
发明人发现现有技术中至少存在如下问题：在某些应用场景中，例如旋转立体显示、虚拟现实(virtual reality，VR)和增强现实(augmented reality，AR)，需要具有超高的刷新频率，然而，传统的显示方式及显示面板已经不能满足对于高刷新频率的要求。
发明内容
本发明旨在至少解决现有技术中存在的技术问题之一，提供一种像素阵列、阵列基板及显示装置。
解决本发明技术问题所采用的技术方案是一种像素阵列，该像素阵列包括：多行像素单元；
每行所述像素单元由多条扫描线控制，每个所述像素单元由一条数据线提供数据电压；
每个所述像素单元包括多个开关晶体管和显示模块；各个所述开关晶体管的第一极均连接所述数据线，第二极均连接所述显示模块，控制极与控制该行所述像素单元的所述扫描线一一对应连接。
可选地，该像素阵列还包括：多个栅极驱动电路，每个所述栅极驱动电路控制一行所述像素单元，且不同行所述像素单元由不同的所述栅极驱动电路控制；
所述栅极驱动电路的信号输出端和用于控制与之对应的所述像素单元的多条所述扫描线一一对应连接。
可选地，位于同一列的所述像素单元中，每间隔N行的所述像素单元由同一数据线提供数据电压；其中，N为大于等于1的整数。
可选地，该像素阵列还包括：多个栅极驱动电路，每相邻的多行所述像素单元由一个所述栅极驱动电路控制；
所述栅极驱动电路的信号输出端和用于控制与之对应的所述像素单元的多条所述扫描线一一对应连接。
可选地，位于同一列的所述像素单元中，由不同所述栅极驱动电路控制的各像素单元由同一条数据线提供数据电压。
可选地，该像素阵列还包括：一个栅极驱动电路，
所述栅极驱动电路的信号输出端和用于控制每行所述像素单元的多条所述扫描线一一对应连接。
可选地，所述像素单元与所述数据线一一对应设置。
可选地，该像素阵列还包括：时钟时序控制单元；
所述时钟时序控制单元与所述栅极驱动电路连接，用于为所述栅极驱动电路提供时钟时序信号。
可选地，该像素阵列还包括：数据信号控制单元和数据时序控制单元；
所述数据信号控制单元与所述像素单元连接，用于为所述像素单元提供数据电压；
所述数据时序控制单元与所述数据信号控制单元连接，用于为所述数据信号控制单元提供数据时序信号。
可选地，所述显示模块包括：驱动晶体管、存储电容和发光器件；其中，
所述驱动晶体管的第一极连接第一电源端，第二极连接所述存储电容的第二端和所述发光器件的第一极，控制极连接所述存储电容的第一端和各个所述开关晶体管的第二极；
所述存储电容的第一端连接各个所述开关晶体管的第二极和所述驱动晶体管的控制极，第二端连接所述驱动晶体管的第二极和所述发光器件的第一极；
所述发光器件的第一极连接所述驱动晶体管的第二极和所述存储电容的第二端，第二极连接第二电源端。
可选地，所述像素单元包括：红色子像素单元、绿色子像素单元和蓝色子像素单元。
解决本发明技术问题所采用的技术方案是一种阵列基板，该阵列基板包括上述提供的像素阵列。
解决本发明技术问题所采用的技术方案是一种显示装置，该显示装置包括如上述提供的阵列基板。
附图说明
图1、图3-图5为本发明提供的一种像素阵列的结构示意图；
图2为发明实施例提供的一种像素单元的结构示意图。
其中附图标记为：
101-像素单元、102-扫描线、103-数据线、104-栅极驱动电路、1011-开关晶体管、1012-驱动晶体管、1013-存储电容、1014-发光器件、1021-第一扫描线、1022-第二扫描线、Vdd-第一电源端、Vss-第二电源端、及201-显示模块。
具体实施方式
本发明实施例中的所采用的晶体管可以为薄膜晶体管或场效应管或其他特性的相同器件，由于采用的晶体管的源极和漏极在一定条件下是可以互换的，所以其源极、漏极从连接关系的描述上是没有区别的。在本发明实施例中，为区分晶体管的源极和漏极，将其中一极称为第一极，另一极称为第二极，栅极称为控制极。此外按照晶体管的特性区分可以将晶体管分为N型晶体管和P型晶体管，以下实施例中是以各个开关晶体管和驱动晶体管均为N型晶体管进行说明的。对于N型晶体管，第一极为N型晶体管的源极，第二极为N型晶体管的漏极，栅极输入高电平时，源漏极导通，P型晶体管相反。为使本领域技术人员更好地理解本发明的技术方案，下面以像素单元为有机发光二极管(organic light-emitting diode,OLED)最基础的电路以及像素单元中的薄膜晶体管为N型晶体管为例，结合附图和具体实施方式对本发明提供的像素阵列、阵列基板及显示装置作进一步详细描述。
图1为本发明实施例提供的一种像素阵列的结构示意图，如图1所示，本发明实施例提供的一种像素阵列包括：多行像素单元101。每行像素单元101由多条扫描线102控制，每个像素单元101由一条数据线103提供数据电压。由于图1提供的像素阵列的结构示意图中，各个像素单元101的具体结构较为紧密，为了便于展示各个像素单元101的具体结构，现对像素阵列中的一像素单元101进行单独展示。图2为本发明实施例提供的一种像素单元的结构示意图，该像素单元101中各个元器件及连接结构如图2所示，该像素单元101包括多个开关晶体管1011和显示模块201；各个开关晶体管1011的第一极均连接数据线103，第二极均连接显示模块201，控制极与控制该行像素单元101的扫描线102一一对应连接。
需要说明的是，本发明实施例提供的像素阵列中的像素单元101可以为多行，控制每行像素单元101的扫描线102可以为多条，在本发明中为了便于描述，以控制每行像素单元101的扫描线102的数量为两条，且像素单元101的行数为4行为例进行说明。由于控制每行像素单元101的扫描线的数量为两条，因此对应的每个像素单元102中的开关晶体管1011的数量为两个。将控制第一行像素单元101的两条扫描线102分别标记为第一扫描线1021和第二扫描线1022；对应的，每一个像素单元101中的与第一扫描线1021连接的开关晶体管1011标记为第一开关晶体管，与第二扫描线1022连接的开关晶体管1011标记为第二开关晶体管。
本发明实施例提供的像素阵列中，首先，控制第一行像素单元101和第二行像素单元101的第一扫描线1021同时输入高电平信号，与第一扫描线1021连接的两行像素单元101中的第一开关晶体管开启，此时，分别为第一行各个像素单元101和第二行各个像素单元101提供数据电压的数据线103上同时输入数据电压信号，给第一行像素单元101和第二行像素单元101中的显示模块201进行充电，并使得显示模块201按照数据线103输入的数据电压进行显示。按照同样的方式，第三行像素单元101和第四行像素单元101的第一扫描线1021同时输入高电平信号，第三行像素单元101和第四行像素单元101中的显示模块201按照数据线103输入的数据电压进行显示。然后，控制第一行像素单元101和第二行像素单元101的第二扫描线1022同时输入高电平信号，与第一扫描线1021连接的两行像素单元101中的第二开关晶体管开启，此时，分别为第一行各个像素单元101和第二行各个像素单元101提供数据电压的数据线103上同时输入数据电压信号，给第一行像素单元101和第二行像素单元101中的显示模块201进行充电，并使得显示模块201按照数据线103输入的数据电压再次进行显示。按照同样的方式，第三行像素单元101和第四行像素单元101的第二扫描线1022同时输入高电平信号，第三行像素单元101和第四行像素单元101中的显示模块201按照数据线103输入的数据电压再次进行显示。从而完成整个像素阵列显示画面的显示与刷新。
可以看出，本发明实施例提供的像素阵列中的每行像素单元101可以由两条扫描线102控制，可以同时为相邻两行的像素单元101输入高电平信号，同时扫描相邻两行像素单元101，实现两行像素单元101的同时显示，从而实现整个像素阵列中的各行像素单元101的显示与刷新。与现有技术中通过对各行像素单元101逐行扫描并进行显示与刷新的方式相比，至少可以节省整个像素阵列一半的扫描时间，因此可以成倍提高像素阵列的刷新频率，从而满足高频率刷新的要求，提高显示效果。
可以理解的是，每行像素单元101由M条扫描线控制时，M为大于2的整数，可以同时对M行像素单元同时输入高电平信号，同时扫描相邻的多行像素单元101，实现多行像素单元101的同时显示，从而实现整个像素阵列中的各个像素单元101的显示与刷新，因此可以节省更多的扫描时间，从而可以提升整个像素阵列的刷新频率，满足高频率刷新的要求。
可选地，如图3所示，该像素阵列除了上述多行像素单元101，还包括多个栅极驱动电路104，每个栅极驱动电路104控制一行像素单元101，且不同行像素单元101由不同的栅极驱动电路104控制；栅极驱动电路104的信号输出端和用于控制与之对应的像素单元101的多条扫描线102一一对应连接。
需要说明的是，本发明实施例提供的像素阵列中每一个栅极驱动电路104分别控制一行像素单元101，并且每个栅极驱动电路104的信号输出端与控制该行的像素单元101的多条扫描线102一一对应连接。在本发明实施例中控制每一行像素单元101的扫描线102的数量为两条，分别记为第一扫描线1021和第二扫描线1022，相应的，栅极驱动电路104同样具有两个信号输出端，分别记为第一信号输出端和第二信号输出端，其中，栅极驱动电路104的第一信号输出端与控制该行像素单元101的第一扫描线1021连接，第二信号输出端与控制该行像素单元101的第二扫描线1022连接。同样的，其他的栅极驱动电路104也采用同样的连接方式。在本发明实施例中，相邻两个栅极驱动电路可以同时工作，每个栅极驱动电路104可以通过相应的信号输出端为与之相连的扫描线输入高电平信号，同时扫描相邻的两行像素单元101，实现两行像素单元101的同时显示，并实现整个像素阵列中的各个像素单元101的显示与刷新，因此可以节省整个像素阵列的扫描时间，从而提高刷新频率，满足高刷新频率的要求。
在发明实施例中，控制每行像素单元101的扫描线102的数量为两条，且像素单元101的行数为4行，在同一列的像素单元101中，每间隔一行的像素单元101可以由同一数据线103提供数据电压。
需要说明的是，在本发明实施例中控制第一行像素单元101的栅极驱动电路104和控制第二行像素单元101的栅极驱动电路可以同时对相应的扫描线输入高电平信号，从而同时扫描第一行像素单元101和第二行像素单元101。当控制第一行像素单元101的栅极驱动电路对相应的扫描线输入高电平信号时，控制第三行像素单元101的栅极驱动电路104可以不对第三行像素单元101进行扫描，则相应的数据线可以不必同时对同一列中第三行像素单元101提供数据电压，因此位于同一列的像素单元101中，每间隔一行的像素单元101可以由同一数据线103提供数据电压。通过各个像素单元101中的开关晶体管1011及驱动晶体管1012控制发光器件1014是否进行数据电压写入，实现各个像素单元101的显示与刷新。这样，可以减少数据线103数量，从而降低数据线103的布线难度。
可选地，如图4所示，该像素阵列除了上述多行像素单元101，还包括多个栅极驱动电路104，每相邻的多行像素单元101由一个栅极驱动电路104控制；栅极驱动电路104的信号输出端和用于控制与之对应的像素单元101的多条扫描线102一一对应连接。
需要说明的是，本发明实施例提供的像素阵列中每一个栅极驱动电路104可以控制相邻的多行像素单元101，并且每个栅极驱动电路104的信号输出端与控制多行的像素单元101的多条扫描线102一一对应连接。在本发明实施例中，一个栅极驱动电路104可以控制两行的像素单元101，控制每行像素单元101的扫描线102的数量为两条，分别记为第一扫描线1021和第二扫描线1022，相应的，栅极驱动电路104同样具有两个信号输出端，分别记为第一信号输出端和第二信号输出端，其中，栅极驱动电路104的第一信号输出端与控制第一行像素单元101的第一扫描线1021和控制第二行像素单元101的第一扫描线1021连接，栅极驱动电路104的第二信号输出端与控制第一行像素单元101的第二扫描线1022和控制第二行像素单元101的第二扫描线1022连接。同样的，其他的栅极驱动电路104也采用同样的连接方式。本发明实施例中，一个栅极驱动电路104控制相邻的多行像素单元101，可以减少栅极驱动电路104的数量，从而降低工艺难度，进而节约制作成本。
可选地，位于同一列的像素单元101中，由不同栅极驱动电路104控制的各像素单元101由同一条数据线103提供数据电压。
需要说明的是，在本发明实施例中，控制相邻两行像素单元101的栅极驱动电路可以通过第一信号输出端同时为其控制的相邻两行的像素单元101的第一扫描线1021同时输入高电平信号，然后再同时向相邻两行的像素单元101的第二扫描线1022同时输入高电平信号，可以同时扫描相邻的两行像素单元101。不同的栅极驱动电路104可以不同时工作，那么，通过相应扫描线102与之连接的像素单元101则可以不同时工作，同一列中不同时工作的像素单元101可以由同一数据线103提供数据电压，通过各个像素单元101中的开关晶体管1011及驱动晶体管1012控制数据电压的输入其中的发光器件1014是否进行数据电压写入，实现各个像素单元101的显示与刷新。这样，可以减少数据线103数量，从而降低数据线103的布线难度。
可选地，如图5所示该像素阵列除了上述多行像素单元101，还包括一个栅极驱动电路104，栅极驱动电路104的信号输出端和用于控制每行像素单元101的多条扫描线102一一对应连接。
需要说明的是，本发明实施例提供的像素阵列中一个栅极驱动电路104可以控制所有行的像素单元101，并且该栅极驱动电路104的信号输出端与控制每行的像素单元101的扫描线102一一对应连接。在本发明实施例控制每行像素单元101的扫描线102的数量为两条，分别记为第一扫描线1021和第二扫描线1022，相应的，栅极驱动电路104具有两个信号输出端，分别记为第一信号输出端和第二信号输出端。控制每一行像素单元101的第一条扫描线102，即四条第一扫描线1021相互连接后，接入栅极驱动电路104的第一信号输出端，控制每一行像素单元101的第二扫描线1022102，即四条第二扫描线1022相互连接后，接入栅极驱动电路104的第二信号输出端。一个栅极驱动电路104可以通过第一信号输出端同时为各行像素单元的第一扫描线1021输入高电平信号，然后，该栅极驱动电路104可以通过第二信号输出端同时为各行像素单元的第二扫描线1022再次输入高电平信号，因此可以同时扫描整个像素阵列中各行的像素单元，从而降低整个像素阵列的扫描时间，进而提高刷新频率。在本发明实施例中，一个栅极驱动电路104控制所有的多行像素单元101，可以减少栅极驱动电路104的数量，从而降低工艺难度，进而节约制作成本。
可选地，像素单元101与数据线103一一对应设置。
需要说明的是，本发明实施例提供的像素阵列中的每个像素单元101可以分别由独立的一条数据线103提供数据电压，可以精确为各个像素单元101输入独立的数据电压，避免同一列像素单元101之间的相互影响。同时为各个像素单元101写入数据电压信号，不必逐行像素单元101依次写入数据电压信号，节省数据电压信号写入时间，从而可以提高刷新频率。
可选地，本发明实施例提供的像素阵列，除了上述的多行像素单元101以及栅极驱动电路104，还包括时钟时序控制单元、数据信号控制单元和数据时序控制单元。时钟时序控制单元与栅极驱动电路104连接，用于为栅极驱动电路104提供时钟时序信号。数据信号控制单元与像素单元101连接，用于为像素单元101提供数据电压。数据时序控制单元与数据信号控制单元连接，用于为数据信号控制单元提供数据时序信号。
需要说明的是，时钟时序控制单元、数据信号控制单元和数据时序控制单元可以集成与同一驱动芯片中，并通过上述的连接方式与多行像素单元101以及栅极驱动电路104连接，时钟时序控制单元可以控制栅极驱动电路104输出栅极驱动信号的时序，使得多条扫描线102输出不同的栅极驱动信号。数据信号控制单元可以为像素单元提供数据电压，实现各个像素单元101的画面显示，同时，数据时序控制单元可以控制数据控制单元提供的数据电压的时序，实现显示面板的高频率显示与刷新。
可选地，如图2所示，本发明实施例提供的像素阵列中像素单元101中的显示模块201可以包括：驱动晶体管1012、存储电容1013和发光器件1014；其中，各个开关晶体管1011的源极均连接数据线103，漏极均连接存储电容1013的第一端和驱动晶体管1012的栅极，栅极与控制该行像素单元101的扫描线102一一对应连接；驱动晶体管1012的源极连接第一电源端Vdd，漏极连接存储电1013容的第二端和发光器件1014的源极，栅极连接存储电容1013的第一端和各个开关晶体管1011的漏极；存储电容1013的第一端连接各个开关晶体管1011的漏极和驱动晶体管1012的栅极，第二端连接驱动晶体管1012的漏极和发光器件1014的第一极；发光器件1014的第一极连接驱动晶体管1012的漏极和存储电容1013的第二端，第二极连接第二电源端Vss。
具体地，本发明实施例提供的像素阵列中，首先，控制第一行像素单元101和第二行像素单元101的第一扫描线1021同时输入高电平信号，与第一扫描线1021连接的两行像素单元101中的第一开关晶体管开启，此时，分别为第一行各个像素单元101和第二行各个像素单元101提供数据电压的数据线103上同时输入数据电压信号，给第一行像素单元101和第二行像素单元101中的存储电容1013进行充电，当充电至驱动晶体管1012的栅源电压Vgs大于其阈值电压Vth时，驱动晶体管1012开启，此时，第一行像素单元101和第二像素单元101中的发光器件1014被点亮。按照同样的方式，第三行像素单元101和第四行像素单元101的第一扫描线1021同时输入高电平信号，第三行像素单元101和第四行像素单元101中的发光器件被点亮。然后，控制第一行像素单元101和第二行像素单元101的第二扫描线1022同时输入高电平信号，与第一扫描线1021连接的两行像素单元101中的第二开关晶体管开启，此时，分别为第一行各个像素单元101和第二行各个像素单元101提供数据电压的数据线103上同时输入数据电压信号，给第一行像素单元101和第二行像素单元101中的存储电容1013再次进行充电，当充电至驱动晶体管1012的栅源电压Vgs大于其阈值电压Vth时，驱动晶体管1012开启，此时，第一行像素单元101和第二像素单元101中的发光器件1014再次被点亮。按照同样的方式，第三行像素单元101和第四行像素单元101的第二扫描线1022同时输入高电平信号，第三行像素单元101和第四行像素单元101中的发光器件再次被点亮。从而完成整个像素阵列显示画面的显示与刷新。
可选地，像素单元101包括：红色子像素单元、绿色子像素单元和蓝色子像素单元。
需要说明的是，像素单元101可以包括红色子像素单元、绿色子像素单元和蓝色子像素单元，也可以包括：红色子像素单元、绿色子像素单元、蓝色子像素单元和白色子像素单元，或者像素单元中101的各个子像素单元均为白色子像素单元。各个像素单元101可以通过输入不同的数据电压，调节各个子像素单元的灰阶值，可以实现多种颜色或者单一颜色的显示与刷新。
基于同一发明构思，本发明实施例提供了一种阵列基板，该阵列基板包括如上述实施例提供的像素阵列。其实现原理与上述实施例提供的像素阵列的实现原理相同，在此不再赘述。
基于同一发明构思，本发明实施例提供了一种显示装置，该显示装置包括如上述实施例提供的阵列基板。其实现原理与上述实施例提供的像素阵列的实现原理相同，在此不再赘述。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (13)

1.一种像素阵列，其特征在于，包括：多行像素单元；
每行所述像素单元由多条扫描线控制，每个所述像素单元由一条数据线提供数据电压；多行所述像素单元划分为多个像素单元组，在同一所述像素单元组中，控制不同行所述像素单元的多条所述扫描线同时输入工作电平信号，控制同一行所述像素单元的多条所述扫描线依次输入工作电平信号；在不同所述像素单元组中，控制不同所述像素单元组中同一行所述像素单元的每条所述扫描线依次输入工作电平信号；待各个所述像素单元组中的控制同一行所述像素单元的所述扫描线均输入工作电平信号后，相邻的控制所述同一行所述像素单元的所述扫描线输入工作电平信号；
每个所述像素单元包括多个开关晶体管和显示模块；各个所述开关晶体管的第一极均连接所述数据线，第二极均连接所述显示模块，控制极与控制该行所述像素单元的所述扫描线一一对应连接。
2.根据权利要求1所述的像素阵列，其特征在于，还包括：多个栅极驱动电路，每个所述栅极驱动电路控制一行所述像素单元，且不同行所述像素单元由不同的所述栅极驱动电路控制；
所述栅极驱动电路的信号输出端和用于控制与之对应的所述像素单元的多条所述扫描线一一对应连接。
3.根据权利要求2所述的像素阵列，其特征在于，位于同一列的所述像素单元中，每间隔N行的所述像素单元由同一数据线提供数据电压；其中，N为大于等于1的整数。
4.根据权利要求1所述的像素阵列，其特征在于，还包括：多个栅极驱动电路，每相邻的多行所述像素单元由一个所述栅极驱动电路控制；
所述栅极驱动电路的信号输出端和用于控制与之对应的所述像素单元的多条所述扫描线一一对应连接。
5.根据权利要求4所述的像素阵列，其特征在于，位于同一列的所述像素单元中，由不同所述栅极驱动电路控制的各像素单元由同一条数据线提供数据电压。
6.根据权利要求1所述的像素阵列，其特征在于，还包括：一个栅极驱动电路，
所述栅极驱动电路的信号输出端和用于控制每行所述像素单元的多条所述扫描线一一对应连接。
7.根据权利要求1、2、4、6任一项所述的像素阵列，其特征在于，所述像素单元与所述数据线一一对应设置。
8.根据权利要求2-6中任一项所述的像素阵列，其特征在于，还包括：时钟时序控制单元；
所述时钟时序控制单元与所述栅极驱动电路连接，用于为所述栅极驱动电路提供时钟时序信号。
9.根据权利要求8所述的像素阵列，其特征在于，还包括：数据信号控制单元和数据时序控制单元；
所述数据信号控制单元与所述像素单元连接，用于为所述像素单元提供数据电压；
所述数据时序控制单元与所述数据信号控制单元连接，用于为所述数据信号控制单元提供数据时序信号。
10.根据权利要求1所述的像素阵列，其特征在于，所述显示模块包括：驱动晶体管、存储电容和发光器件；其中，
所述驱动晶体管的第一极连接第一电源端，第二极连接所述存储电容的第二端和所述发光器件的第一极，控制极连接所述存储电容的第一端和各个所述开关晶体管的第二极；
所述存储电容的第一端连接各个所述开关晶体管的第二极和所述驱动晶体管的控制极，第二端连接所述驱动晶体管的第二极和所述发光器件的第一极；
所述发光器件的第一极连接所述驱动晶体管的第二极和所述存储电容的第二端，第二极连接第二电源端。
11.根据权利要求1所述的像素阵列，其特征在于，所述像素单元包括：红色子像素单元、绿色子像素单元和蓝色子像素单元。
12.一种阵列基板，其特征在于，包括如权利要求1-11任一项所述的像素阵列。
13.一种显示装置，其特征在于，包括如权利要求12所述的阵列基板。
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