CN109785799B - 显示装置及其像素补偿电路和驱动方法 - Google Patents

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Abstract

本申请提出一种显示装置及其像素补偿电路和驱动方法，像素补偿电路，包括：初始化模块根据第一控制信号的控制向驱动晶体管的栅极和源极写入初始信号；第一数据写入模块根据第二控制信号的控制向存储模块的第二端写入数据信号；第二数据写入模块根据第二写入控制信号的控制改变存储模块的第二端的电位，使得存储模块的第一端的电位与数据信号相关；补偿模块根据补偿控制信号的控制给存储模块的第一端充电，使存储模块的第一端的电位与驱动晶体管的阈值电压相关；发光控制模块在发光控制信号的控制下，形成流经发光元件的电流通路，能够使驱动模块能够由固定偏压状态开始进行资料写入与补偿，大大改善了因磁滞效应产生的短期残像问题。

Description

显示装置及其像素补偿电路和驱动方法
技术领域
本发明涉及显示技术领域，尤其涉及一种显示装置及其像素补偿电路和驱动方法。
背景技术
如图1所示，由于DTFT的磁滞效应，现有的有机发光二极管(Organic Light-Emitting Diode，简称OLED)产品在点亮黑白画面一段时间后切换到灰阶画面时,会发现残像，并且在经过一段时间后残像现象会消失，此现象为短期残像。因此，如何改善因磁滞效应产生的短期残像问题是OLED产品急需解决的问题。
发明内容
本发明旨在至少在一定程度上解决相关技术中的技术问题之一。为此，本发明的第一个目的在于提出一种像素补偿电路，以实现能够使驱动晶体管能够由固定偏压状态开始进行资料写入与补偿，大大改善了因磁滞效应产生的短期残像问题，有效提高用户体验。
本发明的第二个目的在于提出一种显示装置。
本发明的第三个目的在于提出一种像素补偿电路的驱动方法。
为达上述目的，本发明第一方面实施例提出了一种像素补偿电路，包括：驱动晶体管；初始化模块，所述初始化模块根据第一控制信号的控制向所述驱动晶体管的栅极和源极写入初始信号；存储模块，所述存储模块的第一端和所述驱动晶体管的控制端连接；第一数据写入模块，所述第一数据写入模块根据第二控制信号的控制向所述存储模块的第二端写入数据信号；第二数据写入模块，所述第二数据写入模块根据第二写入控制信号的控制改变所述存储模块的第二端的电位，使得所述存储模块的第一端的电位与所述数据信号相关；补偿模块，所述补偿模块根据补偿控制信号的控制给所述存储模块的第一端充电，使所述存储模块的第一端的电位与所述驱动晶体管的阈值电压相关；发光控制模块，所述发光控制模块在发光控制信号的控制下，形成流经发光元件的电流通路。
根据本发明的一个实施例，所述发光控制模块具有第一端至第四端、第一控制端和第二控制端，所述发光控制模块的第一端与第一电源连接，所述发光控制模块的第二端与所述驱动晶体管的第一端连接，所述发光控制模块的第三端与所述驱动晶体管的第二端连接，所述发光控制模块的第四端与所述发光元件连接，所述发光控制模块的第一控制端与第一发光控制端连接，所述发光控制模块的第二控制端与第二发光控制端连接，所述发光控制模块根据所述第一发光控制信号控制所述发光控制模块的第一端与第二端导通，还根据所述第二发光控制信号控制所述发光控制模块的第三端与第四端导通。
根据本发明的一个实施例，所述初始化模块包括：第一晶体管，所述第一晶体管的第一极与所述初始信号端连接，所述第一晶体管的第二极与所述发光控制模块的第四端连接，所述第一晶体管的控制极与所述第一控制端连接；第二晶体管，所述第二晶体管的第一极与驱动晶体管的控制端连接，所述第二晶体管的第二极与所述发光控制模块的第三端连接，所述第二晶体管的控制极与所述第一控制端连接；第五晶体管，所述第五晶体管的第一极与所述驱动晶体管的第二端连接，所述第五晶体管的第二极与所述发光元件连接，所述第五晶体管的控制极与所述第二发光控制端连接。
根据本发明的一个实施例，所述补偿模块与所述初始化模块复用所述第二晶体管，所述补偿模块还包括：第三晶体管，所述第三晶体管的第一极与所述第一电源连接，所述第三晶体管的第二极与所述驱动模块的第一端连接，所述第三晶体管的控制极作为所述发光控制模块的第一发光控制端。
根据本发明的一个实施例，所述发光控制模块与所述初始化模块复用所述第五晶体管，所述发光控制模块与所述补偿模块复用所述第三晶体管。
根据本发明的一个实施例，所述第一数据写入模块包括第六晶体管，所述第六晶体管的第一极与所述数据信号端连接，所述第六晶体管的第二极与所述存储模块的第二端连接，所述第六晶体管的控制极与所述第二控制端连接。
根据本发明的一个实施例，所述第二数据写入模块包括第四晶体管，所述第四晶体管的第一极与第二电源连接，所述第四晶体管的第二极与所述存储模块的第二端连接，所述第四晶体管的控制极与所述第二发光控制端连接
根据本发明的一个实施例，所述存储模块包括存储电容，所述存储电容的一端作为所述存储模块的第一端，所述存储电容的另一端作为所述存储模块的第二端。
根据本发明实施例的像素补偿电路，在写入数据信号之前初始化模块根据第一控制信号导通，以使初始信号端向驱动晶体管的栅极写入初始信号，以及在写入数据信号之后，根据补偿控制信号使存储模块的第一端的电位与驱动晶体管的阈值电压相关。由此，本发明实例的像素补偿电路能够使驱动模块能够由固定偏压状态开始进行资料写入与补偿，大大改善了因磁滞效应产生的短期残像问题，有效提高用户体验。
为达上述目的，本发明第二方面实施例提出了一种显示装置，包括所述的像素补偿电路。
为达上述目的，本发明第三方面实施例提出了一种像素补偿电路的驱动方法，包括以下步骤：在第一阶段，根据第一控制信号的控制向驱动晶体管的栅极和源极写入初始信号；在第二阶段，根据第二控制信号的控制向存储模块的第二端写入数据信号，并根据第二写入控制信号的控制改变所述存储模块的第二端的电位，使得所述存储模块的第一端的电为与所述数据信号相关，以及根据补偿控制信号的控制给所述存储模块的第一端充电，使所述存储模块的第一端的电位与所述驱动晶体管的阈值电压相关；在第三阶段，在发光控制信号的控制下，形成流经发光元件的电流通路。
本发明附加的方面和优点将在下面的描述中部分给出，部分将从下面的描述中变得明显，或通过本发明的实践了解到。
附图说明
本发明上述的和/或附加的方面和优点从下面结合附图对实施例的描述中将变得明显和容易理解，其中：
图1是磁滞效应的展示示意图；
图2是磁滞效应的原理示意图；
图3为本发明一个实施例的像素补偿电路的电路原理图；
图4为本发明一个实施例的操作时序示意图；
图5为本发明另一个实施例的像素补偿电路的电路原理图；
图6为本发明实施例的显示装置的方框示意图；
图7为本发明实施例的像素补偿电路的驱动方法的流程图。
具体实施方式
下面详细描述本发明的实施例，所述实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，旨在用于解释本发明，而不能理解为对本发明的限制。
下面参考附图描述本发明实施例的显示装置及其像素补偿电路和驱动方法。
在介绍本发明实施例的显示面板及发光二极管的像素驱动电路之前，先介绍下磁滞效应，以及造成短期残像的原因。
具体而言，如图2所示，在画面由白到灰(如箭头1和箭头2)时，发生正偏(HoleDeTrapping)，或者画面由黑到灰(如箭头3和箭头4)时，发生负偏(Hole trapping)，磁滞效应主要是因为由于Hole DeTrapping/Hole trapping(或者残留的可移动离子)产生的Vth的偏移造成。由图2(a)当Vgs越小，ACT/GI介面捕捉的电荷越多，因此，Vth会产生负偏(HoleTrapping)；当Vgs越大，则被ACT/GI介面捕捉的电荷会被释放出来，因此，Vth会产生正偏(Hole Detrapping)。目前使用的补偿电路中，由于不同画面切换下，其初始化阶段的Vgs均不相同，所以Hole的Trapping/Detrapping状态不同，从而造成短期残像，另外，图2(b)分别为Hole Trapping mode和Hole Detrapping mode的示意图。
本发明正是基于上述问题，而提出的一种显示面板及发光二极管的像素驱动电路。
图3为本发明一个实施例的像素补偿电路的电路原理图。如图3所示，本发明实施例的像素补偿电路100，包括：驱动晶体管M7、初始化模块10、存储模块C1、第一数据写入模块40、第二数据写入模块50、补偿模块20和发光控制模块30。
其中，初始化模块10根据第一控制信号的控制向驱动晶体管M7的栅极和源极写入初始信号；存储模块C1的第一端和驱动晶体管M7的栅极连接；第一数据写入模块40根据第二控制信号的控制向存储模块C1的第二端写入数据信号；第二数据写入模块50根据第二写入控制信号的控制改变存储模块C1的第二端的电位，使得存储模块C1的第一端的电位与数据信号相关；补偿模块20根据补偿控制信号的控制给存储模块C1的第一端充电，使存储模块C1的第一端的电位与驱动晶体管M7的阈值电压相关；发光控制模块30在发光控制信号的控制下，形成流经发光元件D1的电流通路。
进一步地，如图3所示，发光控制模块30具有第一端至第四端、第一控制端和第二控制端，发光控制模块30的第一端与第一电源连接，发光控制模块30的第二端与驱动晶体管M7的第一端连接，发光控制模块30的第三端与驱动晶体管M7的第二端连接，发光控制模块30的第四端与发光元件D1连接，发光控制模块30的第一控制端与第一发光控制端EM_Ⅰ连接，发光控制模块30的第二控制端与第二发光控制端EM_Ⅱ连接，发光控制模块30根据第一发光控制信号控制发光控制模块30的第一端与第二端导通，还根据第二发光控制信号控制发光控制模块30的第三端与第四端。
进一步地，如图3所示，初始化模块10包括第一晶体管M1、第二晶体管M2和第五晶体管M5。
其中，第一晶体管M1的第一极与初始信号端Vinitial连接，第一晶体管M1的第二极与发光控制模块30的第四端连接，第一晶体管M1的控制极与第一控制端Gate_Ⅰ连接；第二晶体管M2的第一极与驱动晶体管M7的控制端连接，第二晶体管M2的第二极与发光控制模块30的第三端连接，第二晶体管M2的控制极与第一控制端Gate_Ⅰ连接；第五晶体管M5的第一极与驱动晶体管M7的第二端连接，第五晶体管M5的第二极与发光元件D1连接，第五晶体管M5的控制极与第二发光控制端Gate_Ⅱ连接。
补偿模块20与初始化模块10复用第二晶体管M2，补偿模块20还包括：第三晶体管M3的第一极与第一电源连接，第三晶体管M3的第二极与驱动晶体管M7的第一端连接，第三晶体管M3的控制极作为发光控制模块30的第一发光控制端。发光控制模块30与初始化模块10复用第五晶体管M5，发光控制模块30与补偿模块20复用第三晶体管M3。
第二数据写入模块50，包括：第四晶体管M4。
其中，第四晶体管M4的第一极与第二电源连接，第四晶体管M4的第二极与存储模块C1的第二端连接，第四晶体管M4的控制极与第二发光控制端EM_Ⅱ连接。应当理解的是，第二写入控制信号可与第二发光控制信号为相同的控制信号，因此，第四晶体管M4的控制极可直接与第二发光控制端EM_Ⅱ连接。
第一数据写入模块40包括第六晶体管M6，第六晶体管M6的第一极与数据信号端Data连接，第六晶体管M6的第二极与存储模块C1的第二端连接，第六晶体管M6的控制极与第二控制端Gate_Ⅱ连接。
进一步地，存储模块C1包括存储电容，存储电容的一端作为存储模块C1的第一端，存储电容的另一端作为存储模块C1的第二端。
需要说明的是，在本发明实施例中，第一控制信号可包括如图3-5中所示的第一控制端Gate_Ⅰ提供的信号和第二发光控制端EM_Ⅱ提供的信号，即言，第一控制信号包括Gate_Ⅰ和EM_Ⅱ，以在第一控制信号的控制下，初始化模块10中的第一晶体管M1和第二晶体管M2在Gate_Ⅰ的控制下开通，第五晶体管M5在EM_Ⅱ的控制下开通，实现将初始信号写入与第二晶体管M2和第五晶体管M5分别相连的驱动晶体管的栅极和源极。
同理，由于补偿模块20与初始模块10和发光控制模块30之间存在复用的晶体管，使得补偿控制信号可包括第一控制端Gate_Ⅰ提供的信号和第一发光控制端EM_Ⅰ提供的信号，即言，补偿控制信号包括Gate_Ⅰ和EM_Ⅰ，以在补偿控制信号的控制下，补偿模块20中的第二晶体管M2在Gate_Ⅰ的控制下开通，第三晶体管M3在EM_Ⅰ的控制下开通，实现通过与补偿模块20相连的第一电源为存储模块C1的第一端充电的效果。
还应当理解的是，第一电源可为ELVDD或ELVDD’等，第二电源也可为ELVDD或ELVDD’等，即，第一电源和第二电源可输入相同的电源信号也可输入不同的电源信号，当第一电源和第二电源输入的电源信号相同时，可将发光控制模块30的第一端和第二数据写入模块50中第四晶体管M4的第二极连接后与第一电源或第二电源相连，如图5所示，当第一电源和第二电源输入的电源信号不同时，可将发光控制模块30的第一端和第二数据写入模块50中第四晶体管M4的第二极分别与第一电源和第二电源连接，如图3所示。其中，在图5所示的实施例中，第一电源和第二电源均为ELVDD，在图3所示的实施例中，第一电源为ELVDD，第二电源为ELVDD’。
进一步地，在如图3和图5所示的实施例中，初始化模块10、发光控制模块30、第一数据写入模块40、第二数据写入模块50和补偿模块20中的晶体管均为P型晶体管。还应当理解的是，初始化模块10、发光控制模块30、第一数据写入模块40、第二数据写入模块50和补偿模块20中的晶体管还可均为N型晶体管，具体以实际情况为准。
下面以图5所示的电路中的晶体管均为P型晶体管、第一电源与第二电源输入信号相同且第一电源为ELVDD的情况为例对本发明实施例的补偿电路的工作原理进行进一步说明，其中，本发明实施例的发光二极管D1的像素补偿电路的操作时序可以如图4所示。其中，根据本发明的一个实施例，发光元件D1可以为有机发光二极管OLED。
可以理解的是，在第一阶段即初始化阶段，其操作时序可以如图4所示中①段所示，第一控制端Gate_Ⅰ和第二发光控制端EM_Ⅱ输入第一电平信号，第二控制端Gate_Ⅱ和第一发光控制端EM_Ⅰ输入第二电平信号，此时，第一晶体管M1、第二晶体管M2、第四晶体管M4和第五晶体管M5均处于开启状态，初始信号端Vinitial的初始电平驱动晶体管M7的栅极，使得驱动晶体管M7的栅极电压初始化，形成固定偏压起始点，从而改善磁滞效应导致的短期残像。同时，该阶段初始信号还对发光元件D1的阳极电压进行复位。
在第二阶段，其操作时序可以如图4所示中②段所示，第一控制端Gate_Ⅰ、第二控制端Gate_Ⅱ和第一发光控制端EM_Ⅰ为第一电平信号，第二发光控制端EM_Ⅱ为第二电平信号，此时，在第二控制端Gate_Ⅱ的作用下，第六晶体管M6处于开启状态，数据信号端Data的数据信号写入存储模块C1的第二端。在第一控制端Gate_Ⅰ和第一发光控制端EM_Ⅰ的作用下，发光控制模块30的第三晶体管M3、驱动晶体管M7和补偿电路20的第二晶体管M2处于开启状态，使得第一电源ELVDD能够为存储模块C1的第一端进行充电，直至存储模块C1的第一端的电压为ELVDD+Vth，即将驱动晶体管M7的阈值电压写入存储模块C1的第一端，以对驱动模块的阈值电压进行补偿。同时，该阶段初始信号仍然持续对发光元件D1的阳极电压进行复位。
在第三阶段，其操作时序可以如图4所示中③段所示，第一控制端Gate_Ⅰ和第二控制端Gate_Ⅱ为第二电平信号，第一发光控制端EM_Ⅰ和第二发光控制端EM_Ⅱ为第一电平信号，此时，第四晶体管M4处于开启状态，存储模块C1的第二端的电压变为ELVDD，受其影响，存储模块C1的第一端的电压变为ELVDD+Vth+(ELVDD-Vdata)＝2ELVDD+Vth-Vdata。因此，此时驱动晶体管M7的Vgs＝ELVDD+Vth-Vdata。第三晶体管M3、驱动晶体管M7和第四晶体管M4均开启，第一电源ELVDD与发光元件D1之间形成通路，发光元件D1发光。
其中，在本发明实施例中，OLED为电流驱动器件，电流公式为I＝1/2K(Vgs-Vth)2＝1/2K(ELVDD-Vdata)2，其中K为系数，可见，该像素补偿电路可以实现Vth补偿。
相应地，在如图3所示的实施例中，在第三阶段时，驱动晶体管M7栅极电位会耦合变成ELVDD+Vth+(ELVDD’-Vdata)。因此，此时驱动晶体管M7的Vgs＝ELVDD’+Vth-Vdata。电流公式为I＝1/2K(Vgs-Vth)2＝1/2K(ELVDD’-Vdata)2。其中，在初始模块10、发光控制模块30、第一数据写入模块40、第二数据写入模块50和补偿模块20中的晶体管均为P型晶体管时，第一电平信号为低电平信号，且第二电平信号为高电平信号；在初始模块10、发光控制模块30、第二数据写入模块40、第二数据写入模块50和补偿模块20中的晶体管均为N型晶体管时，第一电平信号为高电平信号，且第二电平为低电平信号。
综上所述，本发明实施例的像素补偿电路，在写入数据信号之前初始化模块根据第一控制信号导通，以使初始信号端向驱动晶体管的栅极写入初始信号，以及在写入数据信号之后，根据补偿控制信号使存储模块的第一端的电位与驱动晶体管的阈值电压相关。由此，本发明实例的像素补偿电路能够使驱动模块能够由固定偏压状态开始进行资料写入与补偿，大大改善了因磁滞效应产生的短期残像问题，有效提高用户体验。
图6为本发明实施例的显示装置的方框示意图。如图6所示，本发明实施例的显示装置200包括像素补偿电路100。
图7为本发明实施例的像素补偿电路的驱动方法的流程图。如图7所示，本发明实施例的像素补偿电路的驱动方法，包括以下步骤：
S101：在第一阶段，根据第一控制信号的控制向驱动晶体管的栅极和源极写入初始信号。
S102：在第二阶段，根据第二控制信号的控制向存储模块的第二端写入数据信号，并根据补偿控制信号的控制给存储模块的第一端充电，使存储模块的第一端的电位与驱动晶体管的阈值电压相关。
S103：在第三阶段，根据第二写入控制信号的控制改变存储模块的第二端的电位，使得存储模块的第一端的电位与数据信号相关，并在发光控制信号的控制下，使发光元件发光。
需要说明的是，前述对像素补偿电路的驱动方法实施例的解释说明也适用于该实施例的像素补偿电路，此处不再赘述。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本发明的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
流程图中或在此以其他方式描述的任何过程或方法描述可以被理解为，表示包括一个或更多个用于实现定制逻辑功能或过程的步骤的可执行指令的代码的模块、片段或部分，并且本发明的优选实施方式的范围包括另外的实现，其中可以不按所示出或讨论的顺序，包括根据所涉及的功能按基本同时的方式或按相反的顺序，来执行功能，这应被本发明的实施例所属技术领域的技术人员所理解。
在流程图中表示或在此以其他方式描述的逻辑和/或步骤，例如，可以被认为是用于实现逻辑功能的可执行指令的定序列表，可以具体实现在任何计算机可读介质中，以供指令执行系统、装置或设备(如基于计算机的系统、包括处理器的系统或其他可以从指令执行系统、装置或设备取指令并执行指令的系统)使用，或结合这些指令执行系统、装置或设备而使用。就本说明书而言，"计算机可读介质"可以是任何可以包含、存储、通信、传播或传输程序以供指令执行系统、装置或设备或结合这些指令执行系统、装置或设备而使用的装置。计算机可读介质的更具体的示例(非穷尽性列表)包括以下：具有一个或多个布线的电连接部(电子装置)，便携式计算机盘盒(磁装置)，随机存取存储器(RAM)，只读存储器(ROM)，可擦除可编辑只读存储器(EPROM或闪速存储器)，光纤装置，以及便携式光盘只读存储器(CDROM)。另外，计算机可读介质甚至可以是可在其上打印所述程序的纸或其他合适的介质，因为可以例如通过对纸或其他介质进行光学扫描，接着进行编辑、解译或必要时以其他合适方式进行处理来以电子方式获得所述程序，然后将其存储在计算机存储器中。
应当理解，本发明的各部分可以用硬件、软件、固件或它们的组合来实现。在上述实施方式中，多个步骤或方法可以用存储在存储器中且由合适的指令执行系统执行的软件或固件来实现。如，如果用硬件来实现和在另一实施方式中一样，可用本领域公知的下列技术中的任一项或他们的组合来实现：具有用于对数据信号实现逻辑功能的逻辑门电路的离散逻辑电路，具有合适的组合逻辑门电路的专用集成电路，可编程门阵列(PGA)，现场可编程门阵列(FPGA)等。
本技术领域的普通技术人员可以理解实现上述实施例方法携带的全部或部分步骤是可以通过程序来指令相关的硬件完成，所述的程序可以存储于一种计算机可读存储介质中，该程序在执行时，包括方法实施例的步骤之一或其组合。
此外，在本发明各个实施例中的各功能单元可以集成在一个处理模块中，也可以是各个单元单独物理存在，也可以两个或两个以上单元集成在一个模块中。上述集成的模块既可以采用硬件的形式实现，也可以采用软件功能模块的形式实现。所述集成的模块如果以软件功能模块的形式实现并作为独立的产品销售或使用时，也可以存储在一个计算机可读取存储介质中。
上述提到的存储介质可以是只读存储器，磁盘或光盘等。尽管上面已经示出和描述了本发明的实施例，可以理解的是，上述实施例是示例性的，不能理解为对本发明的限制，本领域的普通技术人员在本发明的范围内可以对上述实施例进行变化、修改、替换和变型。

Claims (9)

1.一种像素补偿电路，其特征在于，包括：
驱动晶体管；
初始化模块，所述初始化模块根据第一控制信号的控制向所述驱动晶体管的栅极和源极写入初始信号；
存储模块，所述存储模块的第一端和所述驱动晶体管的栅极连接；
第一数据写入模块，所述第一数据写入模块根据第二控制信号的控制向所述存储模块的第二端写入数据信号；
第二数据写入模块，所述第二数据写入模块根据第二写入控制信号的控制改变所述存储模块的第二端的电位，使得所述存储模块的第一端的电位与所述数据信号相关；
补偿模块，所述补偿模块根据补偿控制信号的控制给所述存储模块的第一端充电，使所述存储模块的第一端的电位与所述驱动晶体管的阈值电压相关；
发光控制模块，所述发光控制模块在发光控制信号的控制下，形成流经发光元件的电流通路；
其中，所述初始信号还用于在初始化阶段，对所述发光元件的阳极电压进行复位；
所述第二数据写入模块配置为在所述初始化阶段为所述存储模块的第二端写入第一电源的电位；
所述发光控制模块具有第一端至第四端、第一控制端和第二控制端，所述发光控制模块的第一端与第一电源连接，所述发光控制模块的第二端与所述驱动晶体管的第一端连接，所述发光控制模块的第三端与所述驱动晶体管的第二端连接，所述发光控制模块的第四端与所述发光元件连接，所述发光控制模块的第一控制端与第一发光控制端连接，所述发光控制模块的第二控制端与第二发光控制端连接，所述发光控制模块根据所述第一发光控制信号控制所述发光控制模块的第一端与第二端导通，还根据所述第二发光控制信号控制所述发光控制模块的第三端与第四端导通。
2.根据权利要求1所述的像素补偿电路，其特征在于，所述初始化模块包括：
第一晶体管，所述第一晶体管的第一极与所述初始信号端连接，所述第一晶体管的第二极与所述发光控制模块的第四端连接，所述第一晶体管的控制极与所述第一控制端连接；
第二晶体管，所述第二晶体管的第一极与驱动晶体管的栅极连接，所述第二晶体管的第二极与所述发光控制模块的第三端连接，所述第二晶体管的控制极与所述第一控制端连接；
第五晶体管，所述第五晶体管的第一极与所述驱动晶体管的第二端连接，所述第五晶体管的第二极与所述发光元件连接，所述第五晶体管的控制极与所述第二发光控制端连接。
3.根据权利要求2所述的像素补偿电路，其特征在于，所述补偿模块与所述初始化模块复用所述第二晶体管，所述补偿模块还包括：
第三晶体管，所述第三晶体管的第一极与所述第一电源连接，所述第三晶体管的第二极与所述驱动晶体管的第一端连接，所述第三晶体管的控制极作为所述发光控制模块的第一发光控制端。
4.根据权利要求3所述的像素补偿电路，其特征在于，所述发光控制模块与所述初始化模块复用所述第五晶体管，所述发光控制模块与所述补偿模块复用所述第三晶体管。
5.根据权利要求1所述的像素补偿电路，其特征在于，所述第一数据写入模块包括第六晶体管，所述第六晶体管的第一极与所述数据信号端连接，所述第六晶体管的第二极与所述存储模块的第二端连接，所述第六晶体管的控制极与所述第二控制端连接。
6.根据权利要求1所述的像素补偿电路，其特征在于，所述第二数据写入模块包括第四晶体管，所述第四晶体管的第一极与第二电源连接，所述第四晶体管的第二极与所述存储模块的第二端连接，所述第四晶体管的控制极与所述第二发光控制端连接。
7.根据权利要求1所述的像素补偿电路，其特征在于，
所述存储模块包括存储电容，所述存储电容的一端作为所述存储模块的第一端，所述存储电容的另一端作为所述存储模块的第二端。
8.一种显示装置，其特征在于，包括如权利要求1-7中任一项所述的像素补偿电路。
9.一种像素补偿电路的驱动方法，其特征在于，包括以下步骤：
在第一阶段，根据第一控制信号的控制向驱动晶体管的栅极和源极写入初始信号；
在第二阶段，根据第二控制信号的控制向存储模块的第二端写入数据信号，并根据补偿控制信号的控制给所述存储模块的第一端充电，使所述存储模块的第一端的电位与所述驱动晶体管的阈值电压相关；
在第三阶段，根据第二写入控制信号的控制改变存储模块的第二端的电位，使得所述存储模块的第一端的电位与所述数据信号相关，并使得发光控制模块在发光控制信号的控制下，使发光元件发光；
其中，所述初始信号还用于在所述第一阶段，对所述发光元件的阳极电压进行复位；
在所述第一阶段向所述存储模块的第二端写入第一电源的电位；
所述发光控制模块具有第一端至第四端、第一控制端和第二控制端，所述发光控制模块的第一端与第一电源连接，所述发光控制模块的第二端与所述驱动晶体管的第一端连接，所述发光控制模块的第三端与所述驱动晶体管的第二端连接，所述发光控制模块的第四端与所述发光元件连接，所述发光控制模块的第一控制端与第一发光控制端连接，所述发光控制模块的第二控制端与第二发光控制端连接，所述发光控制模块根据所述第一发光控制信号控制所述发光控制模块的第一端与第二端导通，还根据所述第二发光控制信号控制所述发光控制模块的第三端与第四端导通。
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