CN115035845A - 显示装置、像素驱动电路及其驱动方法 - Google Patents
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Abstract
本公开提供一种显示装置、像素驱动电路及其驱动方法。该像素驱动电路包括：驱动晶体管，所述驱动晶体管的控制极连接于所述第一节点，所述驱动晶体管的第一极连接于第一电源端；发光控制子电路，与发光控制信号端、所述驱动晶体管的第二极以及所述发光元件的第一极连接，用于在所述发光控制信号端的控制下控制所述驱动晶体管的第二极与所述发光元件的第一极连通；消磁滞子电路，与第二电源端以及所述驱动晶体管的第二极连接，用于控制所述第二电源端与所述驱动晶体管的第二极连通。本公开能够提高显示效果。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种显示装置、像素驱动电路及其驱动方法。
背景技术
电致发光显示器是继液晶显示器之后的新一代显示产品，由于其较佳的色彩饱和度，快的响应速度，可折叠化，轻薄等性能，使其正在逐渐成为显示领域的主流及引领者。
电致发光显示器包括发光元件以及与发光元件连接的像素驱动电路。像素驱动电路均包括驱动晶体管，用于向发光元件输出驱动电流。由于驱动电流的大小与驱动晶体管的阈值电压相关，因此当驱动晶体管的阈值电压发生正偏或负偏时，会导致输出发光元件的驱动电流出现异常，降低了显示效果。
发明内容
本公开的目的在于提供一种显示装置、像素驱动电路及其驱动方法，能够提高显示效果。
根据本公开的一个方面，提供一种像素驱动电路，包括：
驱动晶体管，所述驱动晶体管的控制极连接于所述第一节点，所述驱动晶体管的第一极连接于第一电源端；
发光控制子电路，与发光控制信号端、所述驱动晶体管的第二极以及所述发光元件的第一极连接，用于在所述发光控制信号端的控制下控制所述驱动晶体管的第二极与所述发光元件的第一极连通；
消磁滞子电路，与第二电源端以及所述驱动晶体管的第二极连接，用于控制所述第二电源端与所述驱动晶体管的第二极连通。
进一步地，所述像素驱动电路包括：
第一复位子电路，与第一复位信号端、初始化信号端以及第一节点连接，用于在所述第一复位信号端的控制下控制所述初始化信号端与所述第一节点连通；
补偿子电路，与补偿信号端、所述第一节点以及所述驱动晶体管的第二极连接，用于在所述补偿信号端的控制下控制所述第一节点与所述驱动晶体管的第二极连通；
其中，所述第一复位子电路和所述补偿子电路构成所述消磁滞子电路，所述初始化信号端与所述第二电源端为同一信号端，所述消磁滞子电路用于在所述第一复位信号端以及所述补偿信号端的控制下控制所述初始化信号端与所述驱动晶体管的第二极连通。
进一步地，所述第一复位子电路包括第一复位晶体管，所述第一复位晶体管的控制极与所述第一复位信号端连接，所述第一复位晶体管的第一极与所述初始化信号端连接，所述第一复位晶体管的第二极与所述第一节点连接；和/或
所述补偿子电路包括补偿晶体管，所述补偿晶体管的控制极与所述补偿信号端连接，所述补偿晶体管的第一极与所述驱动晶体管的第二极连接，所述补偿晶体管的第二极与所述第一节点连接。
进一步地，所述第一复位晶体管为N型晶体管。
进一步地，所述像素驱动电路还包括：
第一复位晶体管，所述第一复位晶体管的控制极与第一复位信号端连接，所述第一复位晶体管的第一极与初始化信号端连接；
防漏电晶体管，所述防漏电晶体管的控制极与所述发光控制信号端连接，所述防漏电晶体管的第一极与所述第一复位晶体管的第二极的连接，所述防漏电晶体管的第二极与所述第一节点连接；所述防漏电晶体管和所述第一复位晶体管中一个为P型晶体管，另一个为N型晶体管；
补偿晶体管，所述补偿晶体管的控制极与补偿信号端连接，所述补偿晶体管的第一极与所述驱动晶体管的第二极连接，所述补偿晶体管的第二极与所述第一节点连接。
进一步地，所述像素驱动电路还包括：
数据写入子电路，与数据信号端、数据写入信号端以及第二节点连接，用于在所述数据写入信号端的控制下控制所述数据信号端与所述第二节点连通；
第一电容，连接于所述第一节点与所述第二节点之间；
节点控制子电路，用于控制所述第二节点的电位。
进一步地，所述节点控制子电路包括：
第一控制子电路，与所述第二节点、第一控制信号端以及第三电源端连接，用于在所述第一控制信号端的控制下控制所述第二节点与所述第三电源端连通；
第二控制子电路，与所述第二节点、第二控制信号端以及第四电源端连接，用于在所述第二控制信号端的控制下控制所述第二节点与所述第四电源端连通。
进一步地，所述像素驱动电路还包括：
第二复位子电路，与第二复位信号端、初始化信号端以及所述发光元件的第一极连接，用于在第二复位信号端的控制下控制所述初始化信号端与所述发光元件的第一极连通；
其中，所述初始化信号端与所述第三电源端为同一信号端；和/或，所述第二复位信号端与所述第一控制信号端为同一信号端。
进一步地，所述第二控制信号端与所述发光控制信号端为同一信号端。
进一步地，所述第一控制子电路包括第一控制晶体管，所述第一控制晶体管的控制极与所述第一控制信号端连接，所述第一控制晶体管的第一极与所述初始化信号端连接，所述第一控制晶体管的第二极与所述第二节点连接；和/或
所述第二控制子电路包括第二控制晶体管，所述第二控制晶体管的控制极与所述发光控制信号端连接，所述第二控制晶体管的第一极与所述第四电源端连接，所述第二控制晶体管的第二极与所述第二节点连接；和/或
所述第二复位子电路包括第二复位晶体管，所述第二复位晶体管的控制极与所述第二复位信号端连接，所述第二控制晶体管的第一极与所述初始化信号端连接，所述第二控制晶体管的第二极与所述发光元件的第一极连接；和/或
所述数据写入子电路包括数据写入晶体管，所述数据写入晶体管的控制极与所述数据写入信号端连接，所述数据写入晶体管的第一极与所述数据信号端连接，所述数据写入晶体管的第二极与所述第二节点连接。
进一步地，所述像素驱动电路还包括：
第二电容，所述第二电容的第一极与所述第一电源端连接，所述第二电容的第二极与所述第一节点或所述第二节点连接。
根据本公开的一个方面，提供一种像素驱动电路的驱动方法，所述驱动方法用于驱动所述的像素驱动电路，所述驱动方法包括：
使所述消磁滞子电路控制所述第二电源端与所述驱动晶体管的第二极连通；
使所述发光控制子电路在所述发光控制信号端的控制下控制所述驱动晶体管的第二极与所述发光元件的第一极连通。
根据本公开的一个方面，提供一种显示装置，包括：
所述的像素驱动电路；
发光元件，所述发光元件的第一极连接于所述发光控制子电路，所述发光元件的第二极连接固定电源端。
本公开的显示装置、像素驱动电路及像素驱动电路的驱动方法，通过消磁滞子电路可以使第一电源端与第二电源端之间形成通路，电流从第一电源端流向第二电源端，可以减小驱动晶体管的磁滞，避免驱动晶体管的阈值电压漂移，解决了由于驱动晶体管的阈值电压漂移所导致的显示亮度降低的问题，提高了显示效果。
附图说明
图1是相关技术中的高刷新频率与第刷新频率的示意图。
图2-图4是本公开实施方式的像素驱动电路的示意图。
图5是图4所示像素驱动电路的工作时序图。
图6-10示意性示出本公开实施方式中像素驱动电路在不同阶段的等效电路图。
图11是本公开实施方式的像素驱动电路的另一示意图。
图12是图11所示像素驱动电路的工作时序图。
图13是本公开实施方式的像素驱动电路的又一示意图。
图14是本公开实施方式的像素驱动电路的再一示意图。
附图标记说明：1、发光控制子电路；2、补偿子电路；3、第一复位子电路；4、数据写入子电路；5、节点控制子电路；501、第一控制子电路；502、第二控制子电路；6、第二复位子电路；7、消磁滞子电路；T1、驱动晶体管；
T2、发光控制晶体管；T3、第一复位晶体管；T4、补偿晶体管；T5、数据写入晶体管；T6、第二复位晶体管；T7、第一控制晶体管；T8、第二控制晶体管；T9、防漏电晶体管；L0、发光元件；EM、发光控制信号端；VINI、初始化信号端；Re、第一复位信号端；VDATA、数据信号端；GATE、数据写入信号端；Pb、第二复位信号端；VREF、第四电源端；Vx、第二电源端。
具体实施方式
这里将详细地对示例性实施方式进行说明，其示例表示在附图中。下面的描述涉及附图时，除非另有表示，不同附图中的相同数字表示相同或相似的要素。以下示例性实施方式中所描述的实施方式并不代表与本发明相一致的所有实施方式。相反，它们仅是与如所附权利要求书中所详述的、本发明的一些方面相一致的装置的例子。
在本发明使用的术语是仅仅出于描述特定实施方式的目的，而非旨在限制本发明。除非另作定义，本发明使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本发明说明书以及权利要求书中使用的“第一”“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。同样，“一个”或者“一”等类似词语也不表示数量限制，而是表示存在至少一个。“多个”或者“若干”表示两个及两个以上。“包括”或者“包含”等类似词语意指出现在“包括”或者“包含”前面的元件或者物件涵盖出现在“包括”或者“包含”后面列举的元件或者物件及其等同，并不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而且可以包括电性的连接，不管是直接的还是间接的。在本发明说明书和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。还应当理解，本文中使用的术语“和/或”是指并包含一个或多个相关联的列出项目的任何或所有可能组合。
本公开中采用的晶体管均可以为三极管、薄膜晶体管或场效应管或其他特性相同的器件。在本公开实施例中，为区分晶体管除控制极之外的两极，将其中一极称为第一极，另一极称为第二极。
在实际操作时，当所述晶体管为三极管时，所述控制极可以为基极，所述第一极可以为集电极，所述第二极可以发射极；或者，所述控制极可以为基极，所述第一极可以为发射极，所述第二极可以集电极。
在实际操作时，当所述晶体管为薄膜晶体管或场效应管时，所述控制极可以为栅极，所述第一极可以为漏极，所述第二极可以为源极；或者，所述控制极可以为栅极，所述第一极可以为源极，所述第二极可以为漏极。
相关技术中，为了提高显示效果，降低显示功耗，低频技术被应用到AMOLED显示中。其中，功耗降低的主要方法是降低刷新频率。如图1所示，常规驱动下刷新频率为60HZ，1秒内有60个数据写入补偿时间段D和发光时间段E；以低刷新频率为1HZ为例，一秒内数据写入补偿时间段D的数量小于发光时间段E的数量，图1中仅有1个数据写入补偿时间段D，对于后续的多个发光时间段E，不进行数据信号的写入，利用第一个数据写入补偿时间段D中写入的数据信号继续使发光元件发光。在此驱动模式下，一帧图画需要保持较长的时间，使得驱动晶体管长期处于一种状态，电子被俘获在陷阱中，造成磁滞，进而导致驱动晶体管的阈值电压Vth漂移，导致显示面板的亮度下降，造成人眼可识别的亮度衰减。
本公开实施方式提供一种像素驱动电路。如图2所示，该像素驱动电路可以包括驱动晶体管T1、发光控制子电路1以及消磁滞子电路7，其中：
该驱动晶体管T1的控制极连接于第一节点N1。该驱动晶体管T1的第一极连接于第一电源端VDD。该发光控制子电路1可以与发光控制信号端EM、驱动晶体管T1的第二极以及发光元件L0的第一极连接，用于在发光控制信号端EM的控制下控制驱动晶体管T1的第二极与发光元件L0的第一极连通。该消磁滞子电路7与第二电源端Vx以及驱动晶体管T1的第二极连接，用于控制第二电源端Vx与驱动晶体管T1的第二极连通。
本公开实施方式的像素驱动电路，通过消磁滞子电路7可以使第一电源端VDD与第二电源端Vx之间形成通路，电流从第一电源端VDD流向第二电源端Vx，可以减小驱动晶体管T1的磁滞，避免驱动晶体管T1的阈值电压漂移，解决了由于驱动晶体管T1的阈值电压漂移所导致的显示亮度降低的问题，提高了显示效果。
下面对本公开实施方式的像素驱动电路的各部分进行详细说明：
如图4所示，该驱动晶体管T1的第一极可以连接第一电源端VDD。该驱动晶体管T1可以为P型晶体管，当然，该驱动晶体管T1也可以为N型晶体管。
如图4所示，该发光控制子电路1可以与发光控制信号端EM、驱动晶体管T1的第二极以及发光元件L0的第一极连接，用于在发光控制信号端EM的控制下控制驱动晶体管T1的第二极与发光元件L0的第一极连通。举例而言，该发光控制子电路1可以包括发光控制晶体管T2。该发光控制晶体管T2的控制极与发光控制信号端EM连接，发光控制晶体管T2的第一极与驱动晶体管T1的第二极连接，发光控制晶体管T2的第二极与发光元件L0的第一极连接。该发光元件L0的第二极可以连接固定电源端VSS。其中，该发光元件L0可以为微型无机发光二极管，即miniLED或者microLED，当然，该发光元件L0也可以为OLED等。该发光控制晶体管T2可以为P型晶体管，当然，也可以为N型晶体管。
如图2-图4所示，该消磁滞子电路7与第二电源端Vx以及驱动晶体管T1的第二极连接，用于控制第二电源端Vx与驱动晶体管T1的第二极连通。本公开实施方式的像素驱动电路可以包括第一复位子电路3。该第一复位子电路3与第一复位信号端Re、初始化信号端VINI以及第一节点N1连接，用于在第一复位信号端Re的控制下控制初始化信号端VINI与第一节点N1连通。举例而言，该第一复位子电路3可以包括第一复位晶体管T3。该第一复位晶体管T3的控制极与第一复位信号端Re连接，第一复位晶体管T3的第一极与初始化信号端VINI连接，第一复位晶体管T3的第二极与第一节点N1连接。该第一复位晶体管T3可以为P型晶体管，当然，也可以为N型晶体管(见图11)。其中，该第一复位晶体管T3可以为氧化物晶体管(Oxide TFT)。
如图3和图4所示，本公开实施方式的像素驱动电路可以包括补偿子电路2。该补偿子电路2与补偿信号端、第一节点N1以及驱动晶体管T1的第二极连接，用于在补偿信号端的控制下控制第一节点N1与驱动晶体管T1的第二极连通。举例而言，该补偿子电路2包括补偿晶体管T4，补偿晶体管T4的控制极与补偿信号端连接，补偿晶体管T4的第一极与驱动晶体管T1的第二极连接，补偿晶体管T4的第二极与第一节点N1连接。该补偿晶体管T4可以为P型晶体管，当然，也可以为N型晶体管。该补偿信号端可以与数据写入信号端GATE为同一信号端。
上述的第一复位子电路3和补偿子电路2可以构成上述的消磁滞子电路7。该初始化信号端VINI与第二电源端Vx为同一信号端。该消磁滞子电路7用于在第一复位信号端Re以及补偿信号端的控制下控制初始化信号端VINI与驱动晶体管T1的第二极连通。
如图3和图4所示，本公开实施方式的像素驱动电路可以包括数据写入子电路4、第一电容C1以及节点控制子电路5。该数据写入子电路4与数据信号端VDATA、数据写入信号端GATE以及第二节点N2连接，用于在所述数据写入信号端GATE的控制下控制数据信号端VDATA与第二节点N2连通。举例而言，该数据写入子电路4可以包括数据写入晶体管T5，数据写入晶体管T5的控制极与数据写入信号端GATE连接，数据写入晶体管T5的第一极与数据信号端VDATA连接，数据写入晶体管T5的第二极与第二节点N2连接。该数据写入晶体管T5可以为P型晶体管，当然，也可以为N型晶体管。该第一电容C1连接于第一节点N1与第二节点N2之间。
如图3和图4所示，本公开实施方式的像素驱动电路可以包括第二复位子电路6。该第二复位子电路6与第二复位信号端Pb、初始化信号端VINI以及发光元件L0的第一极连接，用于在第二复位信号端Pb的控制下控制初始化信号端VINI与发光元件L0的第一极连通，以对发光元件L0的第一极进行复位，如此设置，可以减少残存电压的影响，避免造成写入帧和保持帧的亮度差异。举例而言，该第二复位子电路6可以包括第二复位晶体管T6。该第二复位晶体管T6的控制极与第二复位信号端Pb连接，第二复位晶体管T6的第一极与初始化信号端VINI连接，第二复位晶体管T6的第二极与发光元件L0的第一极连接。该第二复位晶体管T6可以为P型晶体管，当然，也可以为N型晶体管。此外，由于第二复位信号端Pb单独处理信号，可以进行PWM调节。
如图3和图4所示，该节点控制子电路5用于控制第二节点N2的电位。该节点控制子电路5包括第一控制子电路501和第二控制子电路502。该第一控制子电路501与第二节点N2、第一控制信号端以及第三电源端连接，用于在第一控制信号端的控制下控制第二节点N2与第三电源端连通。该第三电源端可以与上述的初始化信号端VINI为同一信号端。该第一控制信号端可以与上述的第二复位信号端Pb为同一信号端。举例而言，该第一控制子电路501包括第一控制晶体管T7，第一控制晶体管T7的控制极与第一控制信号端连接，第一控制晶体管T7的第一极与初始化信号端VINI连接，第一控制晶体管T7的第二极与第二节点N2连接。该第一控制晶体管T7可以为P型晶体管，当然，也可以为N型晶体管。
如图3和图4所示，该第二控制子电路502与第二节点N2、第二控制信号端以及第四电源端VREF连接，用于在第二控制信号端的控制下控制第二节点N2与第四电源端VREF连通。该第二控制信号端与发光控制信号端EM可以为同一信号端。举例而言，该第二控制子电路502包括第二控制晶体管T8，第二控制晶体管T8的控制极与发光控制信号端EM连接，第二控制晶体管T8的第一极与第四电源端VREF连接，第二控制晶体管T8的第二极与第二节点N2连接。该第二控制晶体管T8可以为P型晶体管，当然，也可以为N型晶体管。
如图3和图4所示，本公开实施方式的像素驱动电路还可以包括第二电容C2。在一实施方式中，该第二电容C2的第一极与第一电源端VDD连接，第二电容C2的第二极与第二节点N2连接。在本公开另一实施方式中，如图14所示，该第二电容C2的第一极与第一电源端VDD连接，第二电容C2的第二极与第一节点N1连接。
如图13所示，在本公开另一实施方式中，该像素驱动电路还可以包括防漏电晶体管T9。该防漏电晶体管T9的控制极与发光控制信号端EM连接，防漏电晶体管T9的第一极与第一复位晶体管T3的第二极的连接，防漏电晶体管T9的第二极与所述第一节点N1连接。该防漏电晶体管T9和第一复位晶体管T3中一个为P型晶体管，另一个为N型晶体管。具体地，该防漏电晶体管T9为N型晶体管，第一复位晶体管T3为P型晶体管。
图5所示时序图为图4所示像素驱动电路的工作时序图。下面结合图5所示的像素驱动电路的工作时序图对图4中的像素驱动电路的工作过程加以详细的说明，以上述所有晶体管均为P型薄膜晶体管为例，所有晶体管的导通电平均为低电平。
如图5和图6所示，在第一阶段t1，第一复位信号端Re输出低电平，数据写入信号端GATE输出高电平，第二复位信号端Pb输出高电平，发光控制信号端EM输出高电平，第一复位晶体管T3打开，其余晶体管关断，初始化信号端VINI与第一节点N1连通，向第一节点N1写入信号Vini；驱动晶体管T1的Vgs＝Vini-Vdd，通过预先设置Vini的值，可以使得驱动晶体管T1的Vgs小于驱动晶体管T1的阈值电压Vth，使得驱动晶体管T1打开。
如图5和图7所示，在第二阶段t2(消磁滞阶段)，第一复位信号端Re输出低电平，数据写入信号端GATE输出低电平，第二复位信号端Pb输出高电平，发光控制信号端EM输出高电平，第一复位晶体管T3以及补偿晶体管T4打开，由于驱动晶体管T1的Vgs小于驱动晶体管T1的阈值电压Vth，驱动晶体管T1也处于打开状态，从而使第一电源端VDD与初始化信号端VINI之间形成通路，电流从第一电源端VDD流向初始化信号端VINI，可以减小驱动晶体管T1的磁滞。其中，在驱动晶体管T1长期处于一种状态时，电子被俘获在陷阱中，造成磁滞，当有电流通过时，电子容易从陷阱中逃脱，可以减小驱动晶体管T1的磁滞。数据写入晶体管T5打开，数据信号端VDATA与第二节点N2连通，数据信号端VDATA向第二节点N2写入信号Vdata。
如图5和图8所示，在第三阶段t3，第一复位信号端Re输出高电平，数据写入信号端GATE输出低电平，第二复位信号端Pb输出高电平，发光控制信号端EM输出高电平，补偿晶体管T4打开，同时由于驱动晶体管T1也打开，第一电源端VDD对第一节点N1充电，第一节点N1的电位不断增加，在第一节点N1的电位变为(Vdd+Vth)时，驱动晶体管T1的Vgs＝Vth，驱动晶体管T1关断；由于数据写入晶体管T5也打开，第二节点N2的电位维持为Vdata，此时第一电容C1两端的压差为(Vdd+Vth-Vdata)。
如图5和图9所示，在第四阶段t4，第一复位信号端Re输出高电平，数据写入信号端GATE输出高电平，第二复位信号端Pb输出低电平，发光控制信号端EM输出高电平，第一控制晶体管T7以及第二复位晶体管T6打开，初始化信号端VINI与发光元件L0的第一极连通；第二节点N2的电位由Vdata变为Vini，由于第一电容C1的电容值不变，所以第一节点N1的电位变为(Vini+Vdd+Vth-Vdata)，驱动晶体管T1打开。
如图5和图10所示，在第五阶段t5，第一复位信号端Re输出高电平，数据写入信号端GATE输出高电平，第二复位信号端Pb输出高电平，发光控制信号端EM输出低电平，第二控制晶体管T8导通，第四电源端VREF向第二节点N2写入信号Vref，第一电容C1的电容值不变，所以第一节点N1电位变为(Vref+Vdd+Vth-Vdata)，驱动晶体管T1的Vgs＝Vref+Vdd+Vth-Vdata-Vdd＝Vref+Vth-Vdata，同时，发光控制晶体管T2打开，发光元件L0发光，电流I＝1/2k(Vgs-Vth)2＝1/2k(Vref-Vdata)2。可知，电流公式中没有Vdd和Vth，电路在阈值电压补偿的同时，也去除了Vdd的影响，兼具IR drop补偿的功能。此外，由于第二控制晶体管T8的打开，导致第一节点N1的电位发生变化，可以进一步的改变驱动晶体管T1的开启状态，进一步改善驱动晶体管T1的磁滞问题。对于本公开的像素驱动电路，在低刷新频率状态下，在时序图的后面阶段中，第一复位信号端Re持续输出高电平，数据写入信号端GATE持续输出高电平，数据信号端VDATA与第二节点N2不连通，不进行数据信号的写入，仅重复第四阶段t4以及第五阶段t5。其中，上述各个阶段的第一节点N1、第二节点N2、驱动晶体管T1的第二极电位、驱动晶体管T1的Vgs以及驱动晶体管T1的电流I如表1所示。
表1
图11所示的像素驱动电路中第一复位晶体管T3为N型晶体管，其时序图如图12所示。对于图11所示的像素驱动电路的工作过程，除了第一复位晶体管T3是在高电平下导通外，其余晶体管的工作过程与图4所示的像素驱动电路相同，且图11所示的像素驱动电路的工作过程中各个阶段的第一节点N1、第二节点N2、驱动晶体管T1的第二极电位、驱动晶体管T1的Vgs以及驱动晶体管T1的电流I如表1所示。
图13和图14所示的像素驱动电路的时序图同图4所示的像素驱动电路的时序图相同。对于图13所示的像素驱动电路，除了防漏电晶体管T9外，其余晶体管的工作过程与图4所示的像素驱动电路相同，且图13所示的像素驱动电路的工作过程中各个阶段的第一节点N1、第二节点N2、驱动晶体管T1的第二极电位、驱动晶体管T1的Vgs以及驱动晶体管T1的电流I如表1所示。
对于图14所示的像素驱动电路，工作过程中各个阶段的第一节点N1、第二节点N2、驱动晶体管T1的第二极电位、驱动晶体管T1的Vgs以及驱动晶体管T1的电流I如表2所示。此外，对于图14所示的像素驱动电路，第二节点N2电容变化引起第一节点N1电容变化会产生分压，可以增加驱动晶体管T1的驱动范围，细化灰阶划分。当灰阶划分足够细化时，在低亮度下，亮度划分足够明显，可以人眼识别。
表2
本公开实施方式还提供了一种像素驱动电路的驱动方法，用于驱动上述实施方式所述的像素驱动电路。该像素驱动电路的驱动方法可以包括：使消磁滞子电路7控制第二电源端Vx与驱动晶体管T1的第二极连通；使发光控制子电路1在发光控制信号端EM的控制下控制驱动晶体管T1的第二极与所述发光元件L0的第一极连通。由于本公开实施方式的驱动方法所驱动的像素驱动电路同上述实施方式中的像素驱动电路相同，因此，其具有相同的有益效果，在此不再赘述。
本公开实施方式还提供一种显示装置。该显示装置可以包括发光元件L0和上述任一项所述的像素驱动电路。该发光元件L0的第一极可以连接于发光控制子电路1，该发光元件L0的第二极可以连接固定电源端VSS。该显示装置可以为手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于本公开实施方式的显示装置中的像素驱动电路同上述实施方式中的像素驱动电路相同，因此，其具有相同的有益效果，在此不再赘述。
以上所述仅是本发明的较佳实施方式而已，并非对本发明做任何形式上的限制，虽然本发明已以较佳实施方式揭露如上，然而并非用以限定本发明，任何熟悉本专业的技术人员，在不脱离本发明技术方案的范围内，当可利用上述揭示的技术内容做出些许更动或修饰为等同变化的等效实施方式，但凡是未脱离本发明技术方案的内容，依据本发明的技术实质对以上实施方式所作的任何简单修改、等同变化与修饰，均仍属于本发明技术方案的范围内。
Claims (13)
1.一种像素驱动电路，其特征在于，包括：
驱动晶体管，所述驱动晶体管的控制极连接于第一节点，所述驱动晶体管的第一极连接于第一电源端；
发光控制子电路，与发光控制信号端、所述驱动晶体管的第二极以及所述发光元件的第一极连接，用于在所述发光控制信号端的控制下控制所述驱动晶体管的第二极与所述发光元件的第一极连通；
消磁滞子电路，与第二电源端以及所述驱动晶体管的第二极连接，用于控制所述第二电源端与所述驱动晶体管的第二极连通。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路包括：
第一复位子电路，与第一复位信号端、初始化信号端以及第一节点连接，用于在所述第一复位信号端的控制下控制所述初始化信号端与所述第一节点连通；
补偿子电路，与补偿信号端、所述第一节点以及所述驱动晶体管的第二极连接，用于在所述补偿信号端的控制下控制所述第一节点与所述驱动晶体管的第二极连通；
其中，所述第一复位子电路和所述补偿子电路构成所述消磁滞子电路，所述初始化信号端与所述第二电源端为同一信号端，所述消磁滞子电路用于在所述第一复位信号端以及所述补偿信号端的控制下控制所述初始化信号端与所述驱动晶体管的第二极连通。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述第一复位子电路包括第一复位晶体管，所述第一复位晶体管的控制极与所述第一复位信号端连接，所述第一复位晶体管的第一极与所述初始化信号端连接，所述第一复位晶体管的第二极与所述第一节点连接；和/或
所述补偿子电路包括补偿晶体管，所述补偿晶体管的控制极与所述补偿信号端连接，所述补偿晶体管的第一极与所述驱动晶体管的第二极连接，所述补偿晶体管的第二极与所述第一节点连接。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述第一复位晶体管为N型晶体管。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第一复位晶体管，所述第一复位晶体管的控制极与第一复位信号端连接，所述第一复位晶体管的第一极与初始化信号端连接；
防漏电晶体管，所述防漏电晶体管的控制极与所述发光控制信号端连接，所述防漏电晶体管的第一极与所述第一复位晶体管的第二极的连接，所述防漏电晶体管的第二极与所述第一节点连接；所述防漏电晶体管和所述第一复位晶体管中一个为P型晶体管，另一个为N型晶体管；
补偿晶体管，所述补偿晶体管的控制极与补偿信号端连接，所述补偿晶体管的第一极与所述驱动晶体管的第二极连接，所述补偿晶体管的第二极与所述第一节点连接。
6.根据权利要求1-5任一项所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
数据写入子电路，与数据信号端、数据写入信号端以及第二节点连接，用于在所述数据写入信号端的控制下控制所述数据信号端与所述第二节点连通；
第一电容，连接于所述第一节点与所述第二节点之间；
节点控制子电路，用于控制所述第二节点的电位。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述节点控制子电路包括：
第一控制子电路，与所述第二节点、第一控制信号端以及第三电源端连接，用于在所述第一控制信号端的控制下控制所述第二节点与所述第三电源端连通；
第二控制子电路，与所述第二节点、第二控制信号端以及第四电源端连接，用于在所述第二控制信号端的控制下控制所述第二节点与所述第四电源端连通。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位子电路，与第二复位信号端、初始化信号端以及所述发光元件的第一极连接，用于在第二复位信号端的控制下控制所述初始化信号端与所述发光元件的第一极连通；
其中，所述初始化信号端与所述第三电源端为同一信号端；和/或，所述第二复位信号端与所述第一控制信号端为同一信号端。
9.根据权利要求7所述的像素驱动电路，其特征在于，所述第二控制信号端与所述发光控制信号端为同一信号端。
10.根据权利要求8所述的像素驱动电路，其特征在于，所述第一控制子电路包括第一控制晶体管，所述第一控制晶体管的控制极与所述第一控制信号端连接，所述第一控制晶体管的第一极与所述初始化信号端连接，所述第一控制晶体管的第二极与所述第二节点连接；和/或
所述第二控制子电路包括第二控制晶体管，所述第二控制晶体管的控制极与所述发光控制信号端连接，所述第二控制晶体管的第一极与所述第四电源端连接，所述第二控制晶体管的第二极与所述第二节点连接；和/或
所述第二复位子电路包括第二复位晶体管，所述第二复位晶体管的控制极与所述第二复位信号端连接，所述第二控制晶体管的第一极与所述初始化信号端连接，所述第二控制晶体管的第二极与所述发光元件的第一极连接；和/或
所述数据写入子电路包括数据写入晶体管，所述数据写入晶体管的控制极与所述数据写入信号端连接，所述数据写入晶体管的第一极与所述数据信号端连接，所述数据写入晶体管的第二极与所述第二节点连接。
11.根据权利要求6所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二电容，所述第二电容的第一极与所述第一电源端连接，所述第二电容的第二极与所述第一节点或所述第二节点连接。
12.一种像素驱动电路的驱动方法，其特征在于，所述驱动方法用于驱动权利要求1-11任一项所述的像素驱动电路，所述驱动方法包括：
使所述消磁滞子电路控制所述第二电源端与所述驱动晶体管的第二极连通；
使所述发光控制子电路在所述发光控制信号端的控制下控制所述驱动晶体管的第二极与所述发光元件的第一极连通。
13.一种显示装置，其特征在于，包括：
权利要求1-11任一项所述的像素驱动电路；
发光元件，所述发光元件的第一极连接于所述发光控制子电路，所述发光元件的第二极连接固定电源端。
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