CN112102778A - 像素电路及其驱动方法、显示基板和显示装置 - Google Patents

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Abstract

本申请提供了一种像素电路及其驱动方法、显示基板和显示装置。该像素电路包括：发光器件、电压提供模块、电压写入模块和驱动模块。电压提供模块分别连接第一电源电压端、初始电压端、复位信号端、发光控制端、电压写入模块和驱动模块，用于在复位信号端的控制下，向驱动模块提供第一电源电压端的电压和初始电压端的电压，以使驱动模块导通；以及，在发光控制端的控制下，向驱动模块提供第一电源电压端的电压。驱动模块导通后，驱动模块包括的所有驱动晶体管均有电流通过，电流大小随时长变动，驱动晶体管不会长期处于某一状态，能够减小磁滞影响，且能够减小驱动晶体管的阈值电压漂移，进而减小低频切换操作时造成的人眼可识别的亮度差异。

Description

像素电路及其驱动方法、显示基板和显示装置
技术领域
本申请涉及显示技术领域，具体为一种像素电路及其驱动方法、显示基板和显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)显示面板近几年来逐渐占据市场的绝大部分份额。OLED显示面板以其轻薄，优异显示效果，高对比度，广色域，柔性等一系列的优点受到人们的广泛关注，被认为是有望取代液晶的下一代显示器方案。
随着对屏幕显示多样化需求的增加，提高屏幕利用率成为了新的发展需求，目前主要通过降低屏幕的刷新的频率以满足在某些显示下的需求来降低功耗，但是，申请人发现，现有的像素电路的驱动方式切换低频时，数据写入次数减少，相应的数据保持时间增长。因此，薄膜晶体管的特性会因为长时间处于某一状态，而造成薄膜晶体管的阈值电压漂移，造成写入帧和保持帧亮度不同，而造成人眼可识别的亮度差异。
发明内容
有鉴于此，本申请提供一种像素电路及其驱动方法、显示基板和显示装置，用于解决由于薄膜晶体管的特性会因为长时间处于某一状态，而造成薄膜晶体管的阈值电压漂移，写入帧和保持帧亮度不同，从而造成人眼可识别的亮度差异的技术问题。
为了解决上述问题，本申请实施例主要提供如下技术方案：
在第一方面中，本申请实施例公开了一种像素电路，包括：发光器件、电压提供模块、电压写入模块和驱动模块；
所述电压提供模块分别连接第一电源电压端、初始电压端、复位信号端、发光控制端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述第一电源电压端的电压和所述初始电压端的电压，以使所述驱动模块导通；以及，在所述发光控制端的控制下，向所述驱动模块提供所述第一电源电压端的电压；
所述电压写入模块分别连接信号端、数据输入端、初始电压端、所述电压提供模块、所述驱动模块和所述发光器件，用于在所述信号端的控制下，为所述驱动模块写入数据电压；
所述驱动模块分别连接所述电压提供模块和所述电压写入模块，用于向所述发光器件提供驱动电流。
可选地，所述电压提供模块包括复位模块和电压供给模块；
所述复位模块分别连接所述复位信号端、所述初始电压端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述初始电压端的电压；
所述电压供给模块分别连接所述复位信号端、所述发光控制端、所述第一电源电压端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述第一电源电压端的电压；以及，在所述发光控制端的控制下，向所述驱动模块提供所述第一电源电压端的电压。
可选地，所述复位模块包括第一晶体管；
所述第一晶体管的控制端连接所述复位信号端，第一端分别连接所述初始电压端和所述电压写入模块，第二端分别连接所述电压写入模块和所述驱动模块。
可选地，所述电压供给模块包括第二晶体管和第三晶体管；
所述第二晶体管的控制端连接所述复位信号端，第一端连接所述第一电源电压端，第二端分别连接所述电压写入模块和所述驱动模块；
所述第三晶体管的控制端连接所述发光控制端，第一端连接所述第二晶体管的第一端，第二端连接所述第二晶体管的第二端。
可选地，所述驱动模块包括第四晶体管；
所述第四晶体管的控制端分别连接所述复位模块和所述电压写入模块，第一端分别连接所述电压供给模块和所述电压写入模块，第二端连接所述电压写入模块。
可选地，所述驱动模块包括第五晶体管和第六晶体管；
所述第五晶体管的控制端分别连接所述复位模块和所述电压写入模块，第一端分别连接所述电压供给模块和所述电压写入模块，第二端连接所述电压写入模块；
所述第六晶体管的控制端连接预设电位，第一端连接所述第五晶体管的第一端，第二端连接所述第五晶体管的第二端。
可选地，所述电压写入模块包括：第七晶体管、第八晶体管和第九晶体管；
所述第七晶体管的控制端连接所述信号端，第一端分别连接所述电压供给模块和所述驱动模块，第二端连接所述数据输入端；
所述第八晶体管的控制端连接所述信号端，第一端分别连接所述复位模块和所述驱动模块，第二端连接所述驱动模块；
所述第九晶体管的控制端连接所述信号端，第一端分别连接所述复位模块和所述初始电压端，第二端连接所述发光器件。
可选地，所述像素电路包括发光控制模块；
所述发光控制模块分别连接所述发光控制端、所述电压写入模块、所述驱动模块和所述发光器件，用于在所述发光控制端的控制下，控制所述发光器件发光；
所述发光器件与第二电源电压端连接。
可选地，所述发光控制模块包括第十晶体管，
所述第十晶体管的控制端连接所述发光控制端，第一端分别连接所述电压写入模块和所述发光器件，第二端分别连接所述电压写入模块和所述驱动模块。
可选地，所述像素电路包括电压保持模块；
所述电压保持模块分别连接所述第一电源电压端、所述第四晶体管的控制端、所述电压写入模块和所述复位模块，用于维持所述第四晶体管的控制端的电压。
可选地，所述电压保持模块包括电容；
所述电容的一端连接所述第一电源电压端，另一端分别连接所述第四晶体管的控制端、所述电压写入模块和所述复位模块。
在第二方面中，本申请实施例公开了一种显示基板，包括阵列设置的若干像素单元，每一所述像素单元均包括第一方面所述的像素电路。
在第三方面中，本申请实施例公开了一种显示装置，包括第二方面所述的显示基板。
在第四方面中，本申请实施例公开了一种第一方面所述的像素电路的驱动方法，包括：
在所述复位信号端的控制下，接收所述初始电压端和所述第一电源电压端输出的电压，以使所述驱动模块导通；
在所述信号端的控制下，初始化所述发光器件的阳极，以及接收所述数据输入端输出的数据电压，并将数据电压写入所述驱动模块；
在所述发光控制端的控制下，接收所述第一电源电压端的电压，并将该电压输入所述驱动模块，所述驱动模块向所述发光器件提供驱动电流。
借由上述技术方案，本申请实施例提供的技术方案至少具有下列优点：
由于本申请实施例的电压提供模块能够在复位信号端的控制下，向驱动模块提供第一电源电压端的电压和初始电压端的电压，以使驱动模块导通；驱动模块导通后，驱动模块包括的所有驱动晶体管均有电流通过，电流大小随时长变动，驱动晶体管不会长期处于某一状态，能够减小磁滞影响，且能够减小驱动晶体管的阈值电压漂移，进而减小低频切换操作时造成的人眼可识别的亮度差异；且本申请实施例的像素电路使得在重置阶段中，所有驱动晶体管在切换不同的帧时都能够处于同一基准，可以控制驱动晶体管发光特性的均一性。
上述说明仅是本申请实施例技术方案的概述，为了能够更清楚了解本申请实施例的技术手段，而可依照说明书的内容予以实施，并且为了让本申请实施例的上述和其它目的、特征和优点能够更明显易懂，以下特举本申请实施例的具体实施方式。
附图说明
通过阅读下文可选实施方式的详细描述，各种其他的优点和益处对于本领域普通技术人员将变得清楚明了。附图仅用于示出可选实施方式的目的，而并不认为是对本申请实施例的限制。而且在整个附图中，用相同的参考符号表示相同的部件。在附图中：
图1为传统像素电路在低频下工作时的模式示意图；
图2为传统像素电路的时序图；
图3为传统薄膜晶体管受长时间特定电压的特性漂移的曲线图；
图4为本申请实施例的像素电路的结构框图；
图5为本申请实施例的像素电路的另一结构框图；
图6为本申请实施例的像素电路的具体电路结构示意图；
图7为图6的像素电路的时序图；
图8为本申请实施例当从A画面切换到B画面时，通过算法对数据电压调整时的流程图；
图9为本申请实施例的显示基板的部分膜层结构示意图；
图10为本申请实施例的像素电路的驱动方法的流程图。
附图标记介绍如下：
1-像素电路；2-发光器件；3-电压提供模块；31-复位模块；32-电压供给模块；4-电压写入模块；5-驱动模块；6-电压保持模块；61-电容；7-发光控制模块；20-显示基板；22-基底；23-遮光层；24-有源层；25-第一栅极层；26-源漏极层；27-第二栅极层。
具体实施方式
下面将参照附图更详细地描述本公开的示例性实施例。虽然附图中显示了本公开的示例性实施例，然而应当理解，可以以各种形式实现本公开而不应被这里阐述的实施例所限制。相反，提供这些实施例是为了能够更透彻地理解本公开，并且能够将本公开的范围完整的传达给本领域的技术人员。
本技术领域技术人员可以理解，除非特意声明，这里使用的单数形式“一”、“一个”、“所述”和“该”也可包括复数形式。应该进一步理解的是，本申请的说明书中使用的措辞“包括”是指存在所述特征、整数、步骤、操作、元件和/或组件，但是并不排除存在或添加一个或多个其他特征、整数、步骤、操作、元件、组件和/或它们的组。应该理解，这里使用的措辞“和/或”包括一个或更多个相关联的列出项的全部或任一单元和全部组合。
本技术领域技术人员可以理解，除非另外定义，这里使用的所有术语(包括技术术语和科学术语)，具有与本申请所属领域中的普通技术人员的一般理解相同的意义。还应该理解的是，诸如通用字典中定义的那些术语，应该被理解为具有与现有技术的上下文中的意义一致的意义，并且除非像这里一样被特定定义，否则不会用理想化或过于正式的含义来解释。
图1示出了传统像素电路在低频下工作时的模式。如图1所示，传统像素电路的常规驱动下刷新频率为60HZ，分为60帧，一秒有60个数据写入补偿时间段D和发光时间段E。低频下降低刷新频率，以1HZ为例，一秒刷新一帧(一帧仅有一个D和一个E)。
具体地，如图2所示，在第一帧里，数据正常写入，在剩余的59帧中，不进行数据写入，利用上一帧写入的数据继续使OLED发光。在此驱动模式下，一帧图画需要保持较长的时间，而长时间保持同一画面，阈值电压会偏移影响薄膜晶体管的特性，使得保持帧亮度下降，造成人眼可识别的亮度衰减。
图3示出了薄膜晶体管受长时间特定电压的特性漂移曲线。其中，曲线L1为正常48灰阶曲线，曲线L2为白色255灰阶，曲线L3为0灰阶曲线。当显示画面长期处于白色255灰阶(即高灰阶)时，驱动晶体管栅极点电位过低，Vgs绝对值过大，驱动晶体管负偏严重，高灰度切换到低灰度时，会造成更灰。具体地，当从255灰阶跳到48灰阶时，G48应该处于曲线L1上，但由于磁滞的原因，特性曲线仍然处于曲线L2，造成电流变小，亮度降低，磁滞影响大的话，低频下画面切换时，容易造成写入帧和保持帧的亮度差异，差异过大人眼可识别，就会有闪烁的现象。另外，当画面处于低灰阶时，VTH负偏相对较小，切换高灰度时，亮度较亮。而当显示面板处于低频时，画面长时间处于同一状态，负偏逐渐加重，亮度保持时，不同帧会造成亮度衰减，造成闪烁。其中，尤其以低灰阶切换高灰阶更为明显。
为了解决现有技术存在的上述低频时，由于画面长时间处于同一状态，造成人眼可识别的亮度衰减，进而造成闪烁问题，本申请实施例提供一种新的像素电路。
下面结合附图详细介绍本申请实施例提供的像素电路。
在第一方面中，图4示出了本申请实施例的像素电路1。如图4所示，像素电路1包括：发光器件2、电压提供模块3、电压写入模块4和驱动模块5。电压提供模块3分别连接第一电源电压端Vdd、初始电压端Vinit、复位信号端Reset、发光控制端EM、电压写入模块4和驱动模块5，用于在复位信号端Reset的控制下，向驱动模块5提供第一电源电压端Vdd的电压和初始电压端Vinit的电压，以使驱动模块5导通；以及，在发光控制端EM的控制下，向驱动模块5提供第一电源电压端Vdd的电压。电压写入模块4分别连接信号端Gate、数据输入端data、初始电压端Vinit、电压提供模块3、驱动模块5和发光器件2，用于在信号端Gate的控制下，为驱动模块5写入数据电压。驱动模块5分别连接电压提供模块3和电压写入模块4，用于向发光器件2提供驱动电流。
由于本申请实施例的电压提供模块3能够在复位信号端Reset的控制下，向驱动模块5提供第一电源电压端Vdd的电压和初始电压端Vinit的电压，以使驱动模块5导通；驱动模块5导通后，驱动模块5包括的所有驱动晶体管均有电流通过，电流大小随时长变动，驱动晶体管不会长期处于某一状态，能够减小磁滞影响，且能够减小驱动晶体管的阈值电压漂移，进而减小低频切换操作时造成的人眼可识别的亮度差异；且本申请实施例的像素电路1使得在重置阶段中，所有驱动晶体管在切换不同的帧时都能够处于同一基准，可以控制驱动晶体管发光特性的均一性。
可选地，如图5所示，电压提供模块3包括复位模块31和电压供给模块32。复位模块31分别连接复位信号端Reset、初始电压端Vinit、电压写入模块4和驱动模块5，用于在复位信号端Reset的控制下，向驱动模块5提供初始电压端Vinit的电压。电压供给模块32分别连接复位信号端Reset、发光控制端EM、第一电源电压端Vdd、电压写入模块4和驱动模块5，用于在复位信号端Reset的控制下，向驱动模块5提供第一电源电压端Vdd的电压；以及，在发光控制端EM的控制下，向驱动模块5提供第一电源电压端Vdd的电压。
因此，在本申请实施例中，通过复位模块31在复位信号端Reset的控制下，向驱动模块5提供初始电压端Vinit的电压。同时，通过电压供给模块32向驱动模块5提供第一电源电压端Vdd的电压，使得在像素电路1的重置阶段(即复位阶段或初始化阶段)中，像素电路1中的所有驱动晶体管在切换不同的帧时都能够处于同一基准，可以控制驱动薄膜晶体管发光特性的均一性。
以下通过图6-图8对本申请实施例的像素电路进行详细地描述：
可选地，参考图6，复位模块31包括第一晶体管T1。第一晶体管T1的控制端连接复位信号端Reset，第一端分别连接初始电压端Vinit和电压写入模块4，第二端分别连接电压写入模块4和驱动模块5。
可选地，继续参考图6，电压供给模块32包括第二晶体管T2和第三晶体管T3。第二晶体管T2的控制端连接复位信号端Reset，第一端连接第一电源电压端Vdd，第二端分别连接电压写入模块4和驱动模块5。第三晶体管T3的控制端连接发光控制端EM，第一端连接第二晶体管T2的第一端，第二端连接第二晶体管T2的第二端。
可选地，继续参考图6，在一个具体实施例中，驱动模块5包括第四晶体管T4。第四晶体管T4的控制端分别连接复位模块31和电压写入模块4，第一端分别连接电压供给模块32和电压写入模块4，第二端连接电压写入模块4。
可选地，在另一个具体实施例中，驱动模块5包括第五晶体管T5和第六晶体管T6(图6中未示出，在该实施例中，采用第五晶体管T5和第六晶体管T6取代图6中的第四晶体管T4)。第五晶体管T5的控制端分别连接复位模块31和电压写入模块4，第一端分别连接电压供给模块32和电压写入模块4，第二端连接电压写入模块4。第六晶体管T6的控制端连接预设电位，第一端连接第五晶体管T5的第一端，第二端连接第五晶体管T5的第二端。这里的预设电位可以为正电压，也可以为负电压，实际设计时，根据需要接对应的电位，如接高电平电位VDD，当驱动模块5包括第五晶体管T5和第六晶体管T6时，能够平衡栅极点对栅极绝缘层电荷的影响，相当于增加了一个牵制电位，进而能够进一步降低磁滞影响，减小低频切换操作时造成的人眼可识别的亮度差异。
可选地，继续参考图6，电压写入模块4包括：第七晶体管T7、第八晶体管T8和第九晶体管T9。第七晶体管T7的控制端连接信号端Gate，第一端分别连接电压供给模块32和驱动模块5，第二端连接数据输入端data。第八晶体管T8的控制端连接信号端Gate，第一端分别连接复位模块31和驱动模块5，第二端连接驱动模块5。第九晶体管T9的控制端连接信号端Gate，第一端分别连接复位模块31和初始电压端Vinit，第二端连接发光器件2。
可选地，继续参考图6，像素电路1还包括发光控制模块7。发光控制模块7分别连接发光控制端EM、电压写入模块4、驱动模块5和发光器件2，用于在发光控制端EM的控制下，控制发光器件2发光。发光器件2与第二电源电压端Vss连接。
可选地，继续参考图6，发光控制模块包括第十晶体管T10。第十晶体管T10的控制端连接发光控制端EM，第一端分别连接电压写入模块4和发光器件2，第二端分别连接电压写入模块4和驱动模块5。
可选地，继续参考图6，像素电路1包括电压保持模块6。电压保持模块6分别连接第一电源电压端Vdd、第四晶体管T4的控制端、电压写入模块4和复位模块31，用于维持第四晶体管T4的控制端的电压。
可选地，进一步地，继续参考图6，电压保持模块6包括电容61。电容61的一端连接第一电源电压端Vdd，另一端分别连接第四晶体管T4的控制端、电压写入模块4和复位模块31。
在一个具体实施例中，如图6所示，本申请实施例中的像素电路1包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第七晶体管T7、第八晶体管T8、第九晶体管T9、第十晶体管T10、电容61和发光器件2，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第七晶体管T7、第八晶体管T8、第九晶体管T9和第十晶体管T10均为P型薄膜晶体管。
具体地，第一晶体管T1的控制端连接复位信号端Reset，第一端分别连接初始电压端Vinit和第九晶体管T9的第一端，第二端分别连接第八晶体管T8的第一端和第四晶体管T4的控制端。
第二晶体管T2的控制端连接复位信号端Reset，第一端连接第一电源电压端Vdd，第二端分别连接第七晶体管T7的第一端和第四晶体管T4的第一端。
第三晶体管T3的控制端连接发光控制端EM，第一端连接第二晶体管T2的第一端，第二端连接第二晶体管T2的第二端。
第四晶体管T4的控制端分别连接第一晶体管T1的第二端、第八晶体管T8的第一端和电容61的一端，第一端分别连接第二晶体管T2的第二端和第七晶体管T7的第一端，第二端连接第八晶体管T8的第二端和第十晶体管T10的第二端。
第七晶体管T7的控制端连接信号端Gate，第一端分别连接第二晶体管T2的第二端和第四晶体管T4的第一端，第二端连接数据输入端data。
第八晶体管T8的控制端连接信号端Gate，第一端分别连接第一晶体管T1的第二端和第四晶体管T4的控制端，第二端连接第四晶体管T4的第二端。
第九晶体管T9的控制端连接信号端Gate，第一端分别连接第一晶体管T1的第一端和初始电压端Vinit，第二端连接发光器件2和第十晶体管T10的第一端。
第十晶体管T10的控制端连接发光控制端EM，第一端分别连接第九晶体管T9的第二端和发光器件2，第二端分别连接第八晶体管T8的第二端和第四晶体管T4的第二端。
需要说明的是，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第七晶体管T7、第八晶体管T8、第九晶体管T9和第十晶体管T10的第一端可以为源极，也可以为漏极；第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第七晶体管T7、第八晶体管T8、第九晶体管T9和第十晶体管T10的第二端可以为漏极，也可以为源极，实际设计时，源极和漏极的位置可以互换。
下面结合图6和图7，详细介绍一下本申请实施例提供的像素电路1的具体工作过程，具体工作时，该像素电路1包括3个工作阶段，即，重置阶段t1、补偿阶段t2和发光阶段t3。
在重置阶段t1中，如图7所示，复位信号端Reset输出低电平信号，信号端Gate和发光控制端EM输出高电平信号，第一晶体管T1和第三晶体管T3导通，第二晶体管T2、第七晶体管T7、第八晶体管T8、第九晶体管T9和第十晶体管T10关闭。此时初始电压端Vinit输出的初始化电位Vinit通过第一晶体管T1写入第一节点N1，第一节点N1的电位等于初始化电位Vinit；同时，第一电源电压端Vdd输出的高电平电压VDD通过第三晶体管T3写入第二节点N2。此时，对于第四晶体管T4而言，栅源电压Vgs＝Vinit-VDD，第四晶体管T4导通偏置。一般情况下，Vinit的电压是-3V，VDD的电压是4.5V，第四晶体管T4的阈值电压是-2V左右，第四晶体管T4导通偏置使得所有驱动晶体管均有电流通过，而不至于长时间处于同一栅源电压Vgs，能够减小驱动晶体管的磁滞影响。
本申请实施例提供的像素电路相较于传统像素电路，重置阶段t1过程中，能够确定驱动晶体管的状态及磁滞状况，通过提供第四晶体管T4固定的偏置电压，使所有驱动晶体管在切换不同的帧时都处于同一基准，可以控制驱动晶体管发光特性的均一性。
另外，如图8所示，本申请实施例当从A画面切换到B画面时，可以预测B画面的第一帧数据负偏的现象，进而通过算法对数据相应的增加或减少设计，以调整亮度。例如，当处于低频状态下是，B画面的第一帧可以进行算法计算，判断B画面的第一帧的数据电压Vdata与VDD的差值是否大于Vinit与VDD的差值，如果大于，则B画面的第一帧的数据电压调输出Vdata-a，否则输出Vdata+b，以提前弥补阈值电压造成的漂移，预防与后续保持帧亮度差异过大。这里的a与b可以通过算法查表得到，具体的算法过程不涉及本申请的改进点，这里不再赘述。
接着，在补偿阶段t2，如图7所示，信号端Gate输出低电平信号，复位信号端Reset和发光控制端EM输出高电平信号，第七晶体管T7、第八晶体管T8和第九晶体管T9导通，第一晶体管T1、第二晶体管T2、第三晶体管T3和第十晶体管T10关闭。此时初始电压端Vinit输出的初始化电位Vinit通过第九晶体管T9写入发光器件2的阳极，将初始化电位Vinit写入发光器件2的阳极能够防止发光器件2在数据写入的过程中发光。同时，数据输入端data输出的数据电压Vdata通过第七晶体管T7写入第二节点N2，此时第四晶体管T4和第八晶体管T8开启，数据电压Vdata向N1点充电，当第四晶体管T4的Vgs＝Vth时，不再向N1充电，第四晶体管T4关闭，最后N1的电位变为VN1＝Vdata+VTH，N1的电位为发光阶段第四晶体管T4的栅极电位。
最后，在发光阶段t3中，如图7所示，发光控制端EM输出低电平信号，信号端Gate和复位信号端Reset输出高电平信号，第二晶体管T2和第十晶体管T10导通，第一晶体管T1、第三晶体管T3、第七晶体管T7、第八晶体管T8和第九晶体管T9关闭，此时第四晶体管T4驱动发光器件2发光，满足实际显示需求。
具体地，发光器件2的电流公式具体为：
Ioled＝K(Vgs-VTH)2＝K(Vdata+VTH-VDD-VTH)2
由此可见，发光器件2的电流实际上与第四晶体管T4的阈值电压Vth无关，消除了阈值电压的影响。
基于同一发明构思，在第二方面中，图9示出了本申请实施例的显示基板20。如图9所示，该显示基板20包括阵列设置的若干像素单元，每一像素单元均包括第一方面的像素电路1。由于第二方面的显示基板包括了第一方面的像素电路1，使得第二方面的显示基板具有与第一方面的像素电路1相同的有益效果。因此，第二方面的显示基板的有益效果不再重复赘述。
可选地，如图9所示，显示基板20包括：基底22、依次层叠设置在基底22一侧的遮光层23、有源层24、第一栅极层25、源漏极层26和第二栅极层27；显示基板20的具体膜层设置方式与现有技术类似，这里不再赘述。
当电压供给模块32包括第二晶体管T2和第三晶体管T3时(对应图9中左侧的薄膜晶体管)，第二晶体管T2的栅极与遮光层23同层设置，第三晶体管T3的栅极与第一栅极层25同层设置，且第二晶体管T2和第三晶体管T3共用源极和漏极。图9中左侧的薄膜晶体管的第一栅极层25连接发光控制端EM，遮光层23连接复位信号端Reset。由于第二晶体管T2的栅极与遮光层23同层设置，因此，本申请实施例不需要增加额外的工艺制作第二晶体管T2的栅极，能够节约生产成本；且由于第二晶体管T2和第三晶体管T3共用源极和漏极，能够进一步降低生产成本。
当驱动模块5包括第五晶体管T5和第六晶体管T6时(对应图9中右侧的薄膜晶体管)，第五晶体管T5的栅极与遮光层23同层设置，第六晶体管T6的栅极与第一栅极层25同层设置，且第五晶体管T5和第六晶体管T6共用源极和漏极。图9中右侧的薄膜晶体管的遮光层23连接预设电位，第二栅极层27位于第一栅极层25上方，第二栅极层27可作为电容的一个极板。同样地，由于第五晶体管T5的栅极与遮光层23同层设置，因此，本申请实施例不需要增加额外的工艺制作第五晶体管T5的栅极，能够节约生产成本；且由于第五晶体管T5和第六晶体管T6共用源极和漏极，能够进一步降低生产成本。
基于同一发明构思，在第三方面中，本申请实施例公开了一种显示装置，包括第二方面的显示基板20。由于第三方面的显示装置包括了第二方面的显示基板20，使得第三方面的显示装置具有与第二方面的显示基板20相同的有益效果。因此，第三方面的显示装置的有益效果不再重复赘述。
基于同一发明构思，在第四方面中，图10示出了本申请实施例的像素电路1的驱动方法。如图10所示，该方法包括：
S101：在复位信号端Reset的控制下，接收初始电压端Vinit和第一电源电压端Vdd输出的电压，以使驱动模块5导通。
S102：在信号端Gate的控制下，初始化发光器件2的阳极，以及接收数据输入端data输出的数据电压，并将数据电压写入驱动模块5。
S103：在发光控制端EM的控制下，接收第一电源电压端Vdd的电压，并将该电压输入驱动模块5，驱动模块5向发光器件2提供驱动电流。
在该驱动方法中，由于在复位信号端Reset的控制下，接收初始电压端Vinit和第一电源电压端Vdd输出的电压，以使驱动模块5导通。并且，在信号端Gate的控制下，接收数据输入端data输出的数据电压，并将数据电压写入驱动模块5。这使得在像素电路1的重置阶段中，像素电路1中的所有薄膜晶体管在切换不同的帧时都能够处于同一基准，可以控制驱动薄膜晶体管发光特性的均一性。同时，还能够通过预设算法，提前弥补阈值电压而造成的漂移，减少后续保持帧亮度的差异。
在S103中，发光控制端EM输出低电平信号，此时，导通第二晶体管T2和第十晶体管T10，通过驱动模块5向发光器件2提供驱动电流，使得发光器件2发光。另外，该像素电路1的具体工作原理在上面第一方面的部分已经进行了介绍，这里不再赘述。
应用本申请实施例所获得的有益效果包括：
1、由于本申请实施例的电压提供模块3能够在复位信号端Reset的控制下，向驱动模块5提供第一电源电压端Vdd的电压和初始电压端Vinit的电压，以使驱动模块5导通；驱动模块5导通后，驱动模块5包括的所有驱动晶体管均有电流通过，电流大小随时长变动，驱动晶体管不会长期处于某一状态，能够减小磁滞影响，且能够减小驱动晶体管的阈值电压漂移，进而减小低频切换操作时造成的人眼可识别的亮度差异；且本申请实施例的像素电路1使得在重置阶段中，所有驱动晶体管在切换不同的帧时都能够处于同一基准，可以控制驱动晶体管发光特性的均一性。
2、本申请实施例当驱动模块5包括第五晶体管T5和第六晶体管T6时，能够平衡栅极点对栅极绝缘层电荷的影响，相当于增加了一个牵制电位，进而能够进一步降低磁滞影响，减小低频切换操作时造成的人眼可识别的亮度差异。
本技术领域技术人员可以理解，本申请中已经讨论过的各种操作、方法、流程中的步骤、措施、方案可以被交替、更改、组合或删除。进一步地，具有本申请中已经讨论过的各种操作、方法、流程中的其他步骤、措施、方案也可以被交替、更改、重排、分解、组合或删除。进一步地，现有技术中的具有与本申请中公开的各种操作、方法、流程中的步骤、措施、方案也可以被交替、更改、重排、分解、组合或删除。
在本申请的描述中，需要理解的是，术语“中心”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。
术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本申请的描述中，除非另有说明，“多个”的含义是两个或两个以上。
以上所述仅是本申请的部分实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本申请原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本申请的保护范围。

Claims (14)

1.一种像素电路，其特征在于，包括：发光器件、电压提供模块、电压写入模块和驱动模块；
所述电压提供模块分别连接第一电源电压端、初始电压端、复位信号端、发光控制端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述第一电源电压端的电压和所述初始电压端的电压，以使所述驱动模块导通；以及，在所述发光控制端的控制下，向所述驱动模块提供所述第一电源电压端的电压；
所述电压写入模块分别连接信号端、数据输入端、初始电压端、所述电压提供模块、所述驱动模块和所述发光器件，用于在所述信号端的控制下，为所述驱动模块写入数据电压；
所述驱动模块分别连接所述电压提供模块和所述电压写入模块，用于向所述发光器件提供驱动电流。
2.根据权利要求1所述的像素电路，其特征在于，所述电压提供模块包括复位模块和电压供给模块；
所述复位模块分别连接所述复位信号端、所述初始电压端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述初始电压端的电压；
所述电压供给模块分别连接所述复位信号端、所述发光控制端、所述第一电源电压端、所述电压写入模块和所述驱动模块，用于在所述复位信号端的控制下，向所述驱动模块提供所述第一电源电压端的电压；以及，在所述发光控制端的控制下，向所述驱动模块提供所述第一电源电压端的电压。
3.根据权利要求2所述的像素电路，其特征在于，所述复位模块包括第一晶体管；
所述第一晶体管的控制端连接所述复位信号端，第一端分别连接所述初始电压端和所述电压写入模块，第二端分别连接所述电压写入模块和所述驱动模块。
4.根据权利要求2所述的像素电路，其特征在于，所述电压供给模块包括第二晶体管和第三晶体管；
所述第二晶体管的控制端连接所述复位信号端，第一端连接所述第一电源电压端，第二端分别连接所述电压写入模块和所述驱动模块；
所述第三晶体管的控制端连接所述发光控制端，第一端连接所述第二晶体管的第一端，第二端连接所述第二晶体管的第二端。
5.根据权利要求2所述的像素电路，其特征在于，所述驱动模块包括第四晶体管；
所述第四晶体管的控制端分别连接所述复位模块和所述电压写入模块，第一端分别连接所述电压供给模块和所述电压写入模块，第二端连接所述电压写入模块。
6.根据权利要求2所述的像素电路，其特征在于，所述驱动模块包括第五晶体管和第六晶体管；
所述第五晶体管的控制端分别连接所述复位模块和所述电压写入模块，第一端分别连接所述电压供给模块和所述电压写入模块，第二端连接所述电压写入模块；
所述第六晶体管的控制端连接预设电位，第一端连接所述第五晶体管的第一端，第二端连接所述第五晶体管的第二端。
7.根据权利要求2所述的像素电路，其特征在于，所述电压写入模块包括：第七晶体管、第八晶体管和第九晶体管；
所述第七晶体管的控制端连接所述信号端，第一端分别连接所述电压供给模块和所述驱动模块，第二端连接所述数据输入端；
所述第八晶体管的控制端连接所述信号端，第一端分别连接所述复位模块和所述驱动模块，第二端连接所述驱动模块；
所述第九晶体管的控制端连接所述信号端，第一端分别连接所述复位模块和所述初始电压端，第二端连接所述发光器件。
8.根据权利要求1所述的像素电路，其特征在于，所述像素电路包括发光控制模块；
所述发光控制模块分别连接所述发光控制端、所述电压写入模块、所述驱动模块和所述发光器件，用于在所述发光控制端的控制下，控制所述发光器件发光；
所述发光器件与第二电源电压端连接。
9.根据权利要求8所述的像素电路，其特征在于，所述发光控制模块包括第十晶体管，
所述第十晶体管的控制端连接所述发光控制端，第一端分别连接所述电压写入模块和所述发光器件，第二端分别连接所述电压写入模块和所述驱动模块。
10.根据权利要求5所述的像素电路，其特征在于，所述像素电路包括电压保持模块；
所述电压保持模块分别连接所述第一电源电压端、所述第四晶体管的控制端、所述电压写入模块和所述复位模块，用于维持所述第四晶体管的控制端的电压。
11.根据权利要求10所述的像素电路，其特征在于，所述电压保持模块包括电容；
所述电容的一端连接所述第一电源电压端，另一端分别连接所述第四晶体管的控制端、所述电压写入模块和所述复位模块。
12.一种显示基板，其特征在于，包括阵列设置的若干像素单元，每一所述像素单元均包括如权利要求1-11中任一项所述的像素电路。
13.一种显示装置，其特征在于，包括如权利要求12所述的显示基板。
14.一种如权利要求1-11中任一项所述的像素电路的驱动方法，其特征在于，包括：
在所述复位信号端的控制下，接收所述初始电压端和所述第一电源电压端输出的电压，以使所述驱动模块导通；
在所述信号端的控制下，初始化所述发光器件的阳极，以及接收所述数据输入端输出的数据电压，并将数据电压写入所述驱动模块；
在所述发光控制端的控制下，接收所述第一电源电压端的电压，并将该电压输入所述驱动模块，所述驱动模块向所述发光器件提供驱动电流。
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