CN1095837A - 显示数据写控制装置 - Google Patents

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Abstract

电子装置中的一系统存储器具有一显示数据存 储区，当CPU直接访问该系统存储器时，一液晶显 示控制部监视地址数据是否指向该显示数据存储 区。如果是，该液晶显示控制部将显示数据和地址数 据传送给显示驱动电路。该显示驱动电路包含一图 象存储器，其中，根据该地址数据，该显示数据被存储 在一存储位置，并且其存储的数据被显示在液晶显示 器上。

Description

本发明涉及一种用于在存储器中写显示数据的控制装置，其使用于例如具有液晶显示部的电子装置。
图5是用于说明一个在系统存储器中具有一显示图象存储器（VRAM）的传统显示控制装置的结构的方框图。系统存储器13经由数据和地址总线12连接至中央处理单元（CPU）11，点阵液晶显示器（LCD）14的段显示驱动器（D/DSEG）15a和15b也连接至该CPU11。
该CPU11包括一液晶显示控制部（LCDC）11a，来自该LCDC的控制信号被送至系统存储器13、D/DSEG15a和15b以及一公用显示驱动器（D/DCOM）16。
在该图5所示的传统显示控制装置中，VRAM13a设于系统存储器13中，且为了写/读欲被显示的数据，该VRAM13a直接被CPU11访问。因此，软件的负担可被减轻。但是，当数据被显示在LCD14上时，该VRAM13a中的显示数据必须不断地被传送至D/DSEG15a和15b，这样当显示象素的数量增多时，数据的传送量，即，向VRAM13a的数据存取次数将相应增加，结果耗费大量的电流。
图6是用于说明在一显示驱动器芯片中包含有一显示图象存储器（VRAM）的另一种传统显示控制装置的方框图。如该图所示，一系统存储器23，一液晶显示部（LCD）24及段显示驱动器（D/DSEG）25a和25b被经由数据和地址总线22连接至CPU21。
用于分别设置在D/DSEG25a和25b中的VRAM26a和26b的显示数据和写控制信号从CPU21送至D/DSEG25a和25b，且来自设于D/DSEG25a中的一液晶控制部（LCDC）27的一显示定时信号被送至D/DSEG25b和一D/Dcom（公用显示驱动器）28。
更具体地，在示于图6的传统的显示控制装置中，当数据被显示在LCD24上时，LCD24的一段被直接由写在D/DSEG25a和25b的VRAM26a和26b中的位图数据驱动，因此即使有很多的显示象素，对于CPU21来说，数据存取的次数仍能保持较少。另外，由于可以用一多位输出存储器作为用于显示的存储器，可使消耗的电流很小。
然而，当为了缩小装置的尺寸而在设计时减少从CPU21至D/DSEG25a和25b的系统总线的数量时，CPU21按照命令处理、地址和显示的顺序到D/DSEG25a、25b的访问必须由软件控制执行。其结果，与示于图5的在系统存储器中包含VRAM的传统显示控制装置相比，该显示控制装置有繁重的软件设计负担的问题。
总之，一种传统的显示控制装置由于对系统存储器中的VRAM13a的数据存取而具有大电流消耗的问题，而另一种则由于涉及CPU21的数据存取而有繁重的软件负担的问题。
本发明即针对上述问题而提出，其目的在于提供一种显示控制装置，其使得为了向显示存储器存储由CPU输出的显示数据的软件设计负担能够被减轻。
根据本发明，提供了一种电子装置，包括：一点阵型显示屏幕;一用于驱动该显示屏幕的显示驱动电路;一用于控制该电子装置工作的处理单元;一系统存储器，其具有一可由所述处理单元直接指定地址的存储区并且包含一显示存储区;以及一显示数据写控制电路，其包含在该处理单元中，用于检测从该处理单元写入所述系统存储器的显示存储区的显示数据并将该显示数据传送到所述显示驱动电路。
本发明的其它目的和优点将在后面的描述中给出且部分可从该描述中非常清楚或可通过实践本发明而理解。本发明的目的和优点可通过在所述权利要求中指出的装置及其组合更好地认识和达到。
作为说明书的一部分的附图示出了本发明目前较佳的实施例，其与上面的一般描述和后面的详细描述一起用来说明本发明的原理。
图1是显示根据本发明的一个实施例的一显示控制装置的结构的方框图;
图2是显示示于图1的一液晶显示控制装置的细节的方框图;
图3是显示于图2的一多路调制器的细节的方框图;
图4A是显示示于图1的一系统存储器的VRAM的结构的示意图;
图4B是显示示于图1的一显示驱动的VRAM的结构的示意图;
图5和图6各是显示一种传统电路的方框图。
下面将参照附图描述本发明的一个实施例。
图1是显示根据本发明的一个实施例的一显示控制装置的结构的方框图。
一中央处理单元（CPU）31用于产生送往一液晶点阵显示部（LCD）32的显示数据并且控制装置各部分的工作。一系统存储器34经由包括数据总线和地址总线的系统总线33连接至CPU31。
系统存储器34包括一图象存储器（VRAM）35，其中存储由CPU31传送来的显示数据，而该数据欲被显示在LCD32上。
该在CPU31内部设有一连接至系统总线33的液晶显示控制部（LCDC）36。从LCDC36输出的显示数据和其地址数据被经由一液晶显示总线（LCDBUS）37传送至段显示驱动器（D/DSEG）38a和38b，而从LCDC36输出的一显示控制信号被送给该D/DSEG38a和38b以及一公用显示驱动器（D/DCOM）39。
D/DSEG38a和38b分别包括显示VRAM40a及40b，且LCD32根据作为位图写入该显示VRAM40a及40b显示数据被驱动。
图2显示了该显示控制装置中涉及LCDC36的一部分。来自CPU31的一存储器接口部31a的地址总线33a、数据总线33b以及一读/写（R/W）控制信号线41以类似的方式连接至系统存储器34和LCDC36。
LCDC36工作以使当数据被从CPU31写向系统存储器34时该显示数据和地址数据被取入多路调制器36a中，并且根据该地址数据判断该数据是否是要被写入系统存储器34的VRAM35的。当该显示数据是要被写入VRAM35的时，该被取入多路调制器36的显示数据及其地址数据被以时分方式经LCDBUS37顺序传送至D/DSEG38a及38b。
图3显示了该多路调制器36a的细节。
该多路调制器36a包括一具有用于暂时保存来自地址总线33a的地址数据的锁存器-A51的地址计算电路52，以及一用于暂时保存来自数据总线33b的显示数据的锁存器-D53。
在该实施例中，该地址总线33a由20位类型的总线制成，而该数据总线33b由8位类型的总线制成。
该地址总线33a连接至一解码器54。该解码器54用于解码地址数据的高4位并且当该地址数据是访问系统存储器34的VRAM35的时输出一信号S。
一接到该信号S，一选择器55以时分方式向LCDBUS37输出地址和显示数据。该LCDBUS37由8位总线构成，而地址总线的低16位被分为低1字节数据“AX”和高1字节数据“AY”。
应该注意到该地址数据的划分点决定了如图4A所示的系统存储器34的VRAM35的存储区的X方向的划分点（在X方向上字节的数量）;并且，对“AX”的有效位数不一定是8位。
一DXA寄存器56和一DYA寄存器57分别用于存储“DXA”和“DYA”，该“DXA”和“DYA”各为一个由从存储在锁存器-A51中的地址数据中加或减得到的位移量。
下面将描述LCD32与VRAM40a、40b间的关系。
该LCD32具有一显示屏幕，该屏幕由设置为在竖直（Y）方向有160点及在水平（X）方向有256点的显示象素构成。
分别设于段驱动器38a和38b中的各VRAM40a及40b具有160×128点的存储容量，用于以二维的方式存储欲被显示在屏幕上的显示数据。
前述地址数据的低字节数据“AX”用于指定两个段驱动器38a，38b的选择及VRAM在X方向的地址，而该高字节数据“AY”用于指定在Y方向的地址。
系统存储器34的VRAM区35具有大于段驱动器的VRAM40a和40b的总容量和的容量，并且包括对应于段驱动器的VRAM40a、40b的显示数据存储区。
该LCDC36包括一个直接存储器存取电路（DMA）58、一显示定时控制部36b以及用作数据碰撞避免控制部的读/写控制部36d。
当起始地址（s）、在X方向的字节数（x）和在Y方向的字节数（y）被CPU31设定时，该DMA58自动地从系统存储器34的VRAM区35读取以起始地址s作为起始点的x·y的矩形区域的数据，并将该数据写入段驱动器38a或38b的VRAM40a或40b中。
该显示定时控制部36b用于向各段驱动器38a和38b以及公用驱动器39输出一个驱动LCD32所需的显示定时信号。响应于该定时信号，该公用驱动器39输出一个公用信号，而各段驱动器38a和38b输出一个根据存储在VRAM40a及40b中的显示位图数据的段信号。
读/写控制部36c起数据碰撞避免控制部的作用，用于避免用于段驱动器38a和38b的VRAM40a及40b的数据写定时与用于在LCD32上显示的数据读定时重叠，并且根据由显示定时控制部36b为LCD32的定时控制动作和由CPU31输出的写控制信号输出一个碰撞避免控制信号。
以下将描述该实施例的工作。
在CPU31向系统存储器34的VRAM35写欲被在LCD32上显示的显示数据时，一写信号被输出到读/写信号线41，而地址和显示数据则分别被输出至地址和数据总33a和33b。接着，该显示数据根据该地址数据被写入该系统存储器34。
在LCDC36，该地址数据被存入锁存器-A51，而该显示数据被存入锁存器-D53。同时，在解码器54，判断该地址数据是否是指向系统存储器34的VRAM区35。
当断定该地址数据是指向系统存储器34的VRAM35时，该显示数据和该地址数据被时分地输出至LCDBUS37。更具体地，该选择器55有选择地将存储在锁存器-A51中的该地址数据的低字节“AX”、高字节“AY”以及存储在锁存器-D53中的显示数据“DD”顺序输出至LCDBUS37。该显示段驱动器38a、38b接收这些数据并将该显示数据写入一指定的VRAM40a或40b。
该写入在段驱动器38a和38b的VRAM40a和40b中的显示数据根据输出自LCDC36的显示定时控制部36b的显示定时信号被读出并被送至LCD32中的段电极。该显示数据即与由公用驱动器39输出的公用信号同步，由此LCD32被驱动。
下面将描述在LCD32的显示屏幕上打开一个窗口以在背景显示数据的一个部分中显示其它显示数据的情形。
让我们假设该情形例如如图4B所示，其中，该窗口数据被从地址由相对于段驱动器的VRAM存储区的起始地址（图4B的屏幕的左上角）在X方向为“bX”及在Y方向为“bY”定位的点写起，该VRAM存储区对应于LCD32。
窗口显示数据被CPU31写在系统存储器34的VRAM35的整个区内存储当前被显示的显示数据的区域之外的一存储区内。图4A以形象化的方式显示了存储在VRAM35中的数据，且由虚线限定的区域代表用于显示数据的存储区。假定窗口显示数据被写在图4A的阴影区，并且其写开始地址设定在“aX”及“aY”。则CPU31如此决定“DXA”的值以使满足下式：
aX+DXA＝bX
aY+DYA＝bY
并且将该决定的值分别设置给DXA寄存器56和DYA寄存器57。接着，该地址计算电路52通过将该“DXA”加上存储在锁存器-A51的地址数据的低字节计算出“AX”数据，及通过将该“DYA”加上该高字节计算出“AY”数据，并且将该得到的“AX”和“AY”数据经由选择器55输出至段驱动器38a、38b。该段驱动器38a或38b根据接收到的地址数据将该显示数据存入VRAM40a或40b。
所以，当窗口数据通过在系统存储器34的VRAM35中指定某一区域被写入时，该地址数据和显示数据经由LCDC36被传送至段驱动器38a和38b，且一窗口被自动地显示在LCD32的指定位置。
在此一工作过程中，如图4A所示，该用于背景图象的显示数据及用于窗口的显示数据被存入系统VRAM35的不同区域，因此，即使一窗口被加在当前图象的一部分之上，也不需要存储对应于该窗口位置的区域的背景图象数据。
另外，通过利用DMA58的功能，该写在系统存储器34的VRAM35的窗口显示数据和隐藏在该窗口后的部分背景图象数据可被写在段驱动器38a或38b的VRAM40a或40b中，由此简化窗口的显示及背景图象的恢复操作。在该显示数据直接被CPU31读取的情形中，该数据直接被从系统存储器34中读出且LCDC36不工作。
使用具有上述结构的本发明，软件开发者对于显示数据写过程只需考虑向系统存储器中的VRAM的直接存取，因此可减轻软件设计负担。
本发明并不限于上述的实施例，不脱离本发明的范围可做出各种变形的形式。

Claims (18)

1、一种电子装置，包括：
一点阵型显示屏幕；
一用于驱动所述显示屏幕的显示驱动电路；
一用于控制所述电子装置工作的处理单元；
一由所述处理单元直接寻址且包含一显示存储区的系统存储器；以及
一显示数据写控制电路，包括在所述处理单元中，用于检测从所述处理单元写向所述系统存储器的所述显示存储区的显示数据，并且将该显示数据送至所述显示驱动电路。
2、如权利要求1的电子装置，其特征在于，所述显示驱动电路具有一对应所述显示屏幕的图象存储器。
3、如权利要求2的电子装置，其特征在于，所述显示数据写控制电路包括通过解码送至所述系统存储器的地址数据判断该地址数据是否是寻址所述显示区装置的。
4、如权利要求3的电子装置，其特征在于，所述显示数据写控制电路包括用于将所述显示数据和所述地址数据传送至所述显示驱动电路的传送装置。
5、如权利要求4的电子装置，其特征在于，所述显示屏幕包括一液晶显示装置，而所述显示驱动电路包括一具有所述图象存储器的段驱动电路和一公用信号发生电路。
6、如权利要求5的电子装置，其特征在于，所述显示数据写控制电路包括一直接存储器存取控制电路，用于将所述系统存储器的所述显示存储区中的数据传送至所述图象存储器。
7、如权利要求5的电子装置，其特征在于，所述显示数据写控制电路包括以预定位移量改变所述地址数据并将该改变过的地址数据传送至所述显示驱动电路的装置。
8、一种显示装置，包括：
显示装置，具有一显示屏幕，用于显示显示数据;
第一存储装置，用于存储显示在所述显示屏幕上的显示数据;
第二存储装置，具有一存储区，而该存储区的预定部分被定作一显示数据存储区;
写装置，用于将所述显示数据写入所述第二存储装置;
检测装置，用于检测由所述写装置向所述第二存储装置的显示数据存储区的数据写操作;以及
写控制装置，用于当所述数据写操作被所述检测装置检测到时控制在所述第一存储装置中的所述显示数据的写。
9、如权利要求8的显示装置，其特征在于，所述写装置还包括用于提供所述地址数据和所述显示数据在所述第二存储装置中的，而所述检测装置还包括用于判断所述地址数据是否是指向对应于所述显示数据存储区的一定范围的。
10、如权利要求9的显示装置，其特征在于，所述第一存储装置包括于一显示驱动电路。
11、如权利要求10的显示装置，其特征在于，所述显示装置的显示屏幕包括一液晶显示屏幕，而所述显示驱动电路具有一用于所述液晶显示屏幕的段驱动器。
12、如权利要求10的显示装置，其特征在于，所述写控制装置还包括用于将所述显示数据和所述地址数据传送至所述显示驱动电路的传送装置，而所述显示驱动电路包括用于根据由所述传送装置所传送的所述地址数据将所述所传送的显示数据写入所述第一存储装置的装置。
13、如权利要求12的显示装置，其特征在于，所述写控制装置还包括用于向或从所述地址数据加上或减去一预定值的运算装置。
14、一种显示存储器控制装置，包括：
一显示屏幕;
一用于驱动所述显示屏幕的显示驱动电路;
第一存储装置，包括在所述显示驱动电路中并由关于X方向和Y方向的两类地址数据寻址，用于存储对应于所述显示屏幕的显示数据;
第二存储装置，直接由一CPU寻址，该第二存储装置具有一不小于所述第一存储装置的存储区，用于存储所述显示数据;
第三存储装置，用于存储一位移量值;
地址数据处理装置，用于当所述CPU执行一个向所述第二存储装置的写操作时向或从所述地址数据加上或减去存储在所述第三存储装置中的所述位移量值;以及
控制装置，用于向所述第一存储装置输出由所述地址数据处理装置处理过的该地址数据。
15、如权利要求14的显示存储器控制装置，其特征在于，还包括判断装置，用于判断所述第二存储装置用于存储显示数据的所述存储区是否被访问。
16、如权利15的显示存储器控制装置，其特征在于，所述地址数据包含指示一X寻址方向的高位数据和指示Y寻址方向的低位数据，且所述第三存储装置包括用于存储所述该X和Y方向分量中每个的所述位移量值的装置。
17、如权利要求14的显示存储器控制装置，其特征在于，所述第二存储装置的所述显示数据存储区的一第一存储区的一个地址对应于所述第一存储装置的一第二存储区的一个地址，并且所述显示存储器控制装置还包括用于寻址所述第二存储装置的该显示数据存储区之外的一个区域以存储窗口数据的装置，用于向所述第三存储装置设定一位移量值以向所述第一存储装置的一预定存储位置写窗口显示数据的装置，以及用于根据该窗口显示数据显示一个窗口的装置。
18、如权利要求14的显示存储器控制装置，其特征在于，所述显示屏幕包括一液晶显示装置而所述第一存储装置包含在一段驱动器芯片内。
CN94102151A 1993-02-22 1994-02-22 显示数据写控制装置 Expired - Lifetime CN1118759C (zh)

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