CN107592942B - 具有焊球的封装结构及封装结构的制造方法 - Google Patents
具有焊球的封装结构及封装结构的制造方法 Download PDFInfo
- Publication number
- CN107592942B CN107592942B CN201680025157.7A CN201680025157A CN107592942B CN 107592942 B CN107592942 B CN 107592942B CN 201680025157 A CN201680025157 A CN 201680025157A CN 107592942 B CN107592942 B CN 107592942B
- Authority
- CN
- China
- Prior art keywords
- manufacturing
- pad
- solder balls
- reinforcing structure
- bonding pad
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/06—Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L24/14—Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L24/46—Structure, shape, material or disposition of the wire connectors prior to the connecting process of a plurality of wire connectors
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Electric Connection Of Electric Components To Printed Circuits (AREA)
- Wire Bonding (AREA)
Abstract
一种具有焊球的封装结构及其制造方法,其中所述封装结构包括封装主体(10)、焊盘(20)、补强结构(30)及焊球(40),所述焊盘(20)设置于所述封装主体(10)的表面,所述焊球(40)固定于所述焊盘(20),所述补强结构(30)连接至焊盘(20)且内埋于所述焊球(40)中,以增强所述焊球(40)与所述焊盘(20)之间的连接强度。所述封装结构能够提升焊球与封装主体之间的连接强度,保证封装结构的可靠性。
Description
技术领域
本申请涉及具有焊球的封装结构及封装结构的制造方法。
背景技术
现有技术中封装结构设有焊球阵列,通过焊过实现封装结构与其它元件(例如电路板或芯片)之间的固定。举例而言,BGA(Ball Grid Array,焊球阵列封装)大量应用于电子产品。随着电子产品的功能越来越多,体积小型化发展趋势,焊球直径和焊球间距的越来越小,进而电子产品的可靠性也越来越受到挑战,主要表现在抗跌落强度、抗温度循环及温度冲击强度上。也就是说,现有技术中的封装结构中,由于焊球直径的小型化设计,使得焊球的强度也下降了,焊球与芯片或者焊球与基板之间的连接强度较差,焊点的可靠性低,焊点处容易断裂失效,从而影响封装结构的可靠性,降低使用寿命。
发明内容
本申请实施例所要解决的技术问题在于,解决了焊球强度差的问题,能够保证电子产品封装结构的可靠性,提升使用寿命。
第一方面,本申请公开一种具有焊球的封装结构,包括封装主体、焊盘、补强结构及焊球,所述焊盘设置于所述封装主体的表面,所述焊球固定于所述焊盘,所述补强结构连接至所述焊盘且内埋于所述焊球中,以增强所述焊球与所述焊盘之间的连接强度。
本申请通过补强结构内埋在焊球中的结构,使得焊球与封装主体之间的连接强度得到提升,保证封装结构的可靠性,当焊球发生开裂时,补强结构的大部分面积还是能够和焊球保持连接。因此本申请解决了现有技术中焊球开裂后导致封装结构失效的情况,能够保持封装结构和主板焊盘的导通。而且,本申请不需要增加焊盘的尺寸,就可以提升焊盘的强度,在高可靠性产品的应用上,既满足小型化高密的设计,又可以满足可靠性运行环境要求。
结合第一方面,在第一种可能的实施方式中,所述补强结构为金属线结构,所述补强结构通过半导体键合金线的工艺形成在所述焊盘的表面,并在所述焊球内蜿蜒弯折。本实施方式中的金属线可以为金线,即通过打金线的工艺在焊盘表面形成补强结构,金线不但强度好,也能保证电连接和电信传输的可靠性。
结合第一方面,在第二种可能的实施方式中,所述补强结构为柱状结构。本实施方式中,补强结构可以通过将所述焊盘局部增厚的方法或者采用激光焊打凸点的技术实现。通常所述焊盘设置在封装主体的基板(或称之为电路板)上,在基板或电路板制作的过程中,形成焊盘的同时就将焊盘的局部增厚,以形成突出设置在焊盘表面的补强结构。具体而言,本实施方式中的补强结构可以设置在焊盘的中心位置处。
结合第一方面及上述任意一种可能的实施方式,在第三种可能的实施方式中,所述补强结构的数量为至少两个,所述至少两个补强结构彼此间隔地设置在所述焊球内。补强结构的数量增加有使得封装结构的可靠性得到提升。
结合第一方面及上述任意一种可能的实施方式,在第四种可能的实施方式中,所述补强结构与所述焊盘的材料相同,且所述补强结构与所述焊盘为一体式的结构。也就是说,补强结构与焊盘在同一个工艺过程中形成,不但节约了制作工序,也有利于降低封装主体的成本。
第二方面,本申请这提供一种封装结构的制造方法,包括如下步骤:
在封装主体的表面制作焊盘;
在焊盘的表面制作补强结构;及
在所述焊盘的表面植球,以形成焊球,且使得所述补强结构内埋于所述焊球内。
结合第二方面,在第一种可能的实施方式中,通过半导体键合金线的工艺在所述焊盘的表面制作所述补强结构,完成所述植球步骤后,所述补强结构在所述焊球内蜿蜒弯折。
结合第二方面或第二方面之第一种可能的实施方式,在第二种可能的实施方式中,使用激光植球的方式,将所述焊球包裹在所述补强结构外部。
结合第二方面或第二方面之上述任意一种可能的实施方式,在第三种可能的实施方式中,在焊盘的表面制作补强结构的过程中,制作至少两个所述补强结构,且使得所述至少两个所述补强结构彼此间隔。
结合第二方面或第二方面之上述任意一种可能的实施方式,在第四种可能的实施方式中,所述补强结构为金线,所述金线的长度范围为0.2~0.3mm。
结合第二方面,在第五种可能的实施方式中,采用将所述焊盘局部增厚的方法在所述焊盘的表面制作所述补强结构。
结合第二方面,在第六种可能的实施方式中,采用激光焊打凸点的技术在所述焊盘的表面制作所述补强结构。
结合第二方面之第五种或第六种可能的实施方式,在第七种可能的实施方式中,所述补强结构为柱状结构。
结合第二方面之第五种或第六种或第七种可能的实施方式,在第八种可能的实施方式中,在焊盘的表面制作补强结构的过程中,制作至少两个所述补强结构,且使得所述至少两个所述补强结构彼此间隔。
附图说明
为了更清楚地说明本申请实施例或现有技术中的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1是本申请一种实施方式提供的具有焊球的封装结构的示意图。
图2是本申请另一种实施方式提供的具有焊球的封装结构的示意图。
图3是将本申请所提供的具有焊球的封装结构安装在主板上,焊球断裂状态的示意图。
具体实施方式
下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
本申请涉及具有焊球的封装结构,请参阅图1和图2,具有焊球的封装结构包括封装主体10、焊盘20、补强结构30及焊球40。封装主体10可以为BGA封装芯片或其它类型的芯片。所述焊盘20设置于所述封装主体10的表面,可以理解为,封装主体10包括基板或电路板,焊盘20设于基板或电路板的表面,焊盘20可以突出设置在基板或电路板的表面,也可以在基板或电路板上设置凹槽,将焊盘20设置在凹槽中,本实施方式中,焊盘20的表面与基板或电路板的表面齐平。补强结构30设于焊盘20的表面,所述焊球40固定于所述焊盘20,因此,所述补强结构30连接至所述焊盘20且内埋于所述焊球40中,以增强所述焊球40与所述焊盘20之间的连接强度。具体而言,通过在在焊盘20的表面设置补强结构30,补强结构30可以为金属材质或者具有导电性能的导电材料,补强结构30的强度和硬度均大于焊球40的强度。
本申请通过补强结构30内埋在焊球40中的结构,使得焊球40与封装主体10之间的连接强度得到提升,保证封装结构的可靠性,当焊球40发生开裂时,补强结构30的大部分面积还是能够和焊球40保持连接接触。因此本申请解决了现有技术中焊球40开裂后导致封装结构失效的情况,能够保持封装结构和主板上的焊盘的导通。而且,本申请不需要增加焊盘20的尺寸,就可以提升焊盘20的强度,在高可靠性产品的应用上,既满足小型化高密的设计,又可以满足可靠性运行环境要求。
一种实施方式中,如图1所示,所述补强结构30为金属线结构,所述补强结构30通过半导体键合金线的工艺形成在所述焊盘20的表面,并在所述焊球40内蜿蜒弯折。本实施方式中的金属线可以为金线,即通过打金线的工艺在焊盘20表面形成补强结构30,金线不但强度好,也能保证电连接和电信传输的可靠性。
另一种实施方式中,如图2所示,所述补强结构30为柱状结构,具体可以为方形柱状或圆柱状等。本实施方式中,补强结构30可以通过将所述焊盘20局部增厚的方法或者采用激光焊打凸点的技术实现。通常所述焊盘20设置在封装主体10的基板(或称之为电路板)上,在基板或电路板制作的过程中,形成焊盘20的同时就将焊盘20的局部增厚,以形成突出设置在焊盘20表面的补强结构30。具体而言,本实施方式中的补强结构30可以设置在焊盘20的中心位置处。
一种实施方式中,所述补强结构30的数量为至少两个,所述至少两个补强结构30彼此间隔地设置在所述焊球40内。补强结构30的数量增加有使得封装结构的可靠性得到提升。
一种实施方式中,所述补强结构30与所述焊盘20的材料相同,且所述补强结构30与所述焊盘20为一体式的结构。也就是说,补强结构30与焊盘20在同一个工艺过程中形成,不但节约了制作工序,也有利于降低封装主体10的成本。
本申请还提供一种封装结构的制造方法,参照图1和图2的结构对本申请提供的制造方法进行描述。本申请封装结构的制造方法包括如下步骤:
在封装主体10的表面制作焊盘20;
在焊盘20的表面制作补强结构30,一种实施方式中,在焊盘20的表面制作补强结构30的过程中,制作至少两个所述补强结构30,且使得所述至少两个所述补强结构30彼此间隔;及
在所述焊盘20的表面植球,以形成焊球40,且使得所述补强结构30内埋于所述焊球40内。
一种实施方式中,本申请通过半导体键合金线的工艺在所述焊盘20的表面制作所述补强结构30,完成所述植球步骤后,所述补强结构30在所述焊球40内蜿蜒弯折。本实施方式中,所述补强结构30为金线,所述金线的长度范围为0.2~0.3mm。
进一步而言,本申请使用激光植球的方式,将所述焊球40包裹在所述补强结构30外部。
另一种实施方式中,本申请采用将所述焊盘20局部增厚的方法在所述焊盘20的表面制作所述补强结构30,或者采用激光焊打凸点的技术在所述焊盘20的表面制作所述补强结构30。
请参阅图3,图3所示为将本申请具有焊球的封装结构安装至主板50上的示意图,焊球40贴装在主板50的表面,可以理解的是,在主板50的表面设置焊盘(未图示),将本申请具有焊球的封装结构倒装在主板50表面上,并通过焊球40与主板50上的焊盘连接,形成主板与封装主体10之间的电连接。当本申请具有焊球的封装结构遇到破坏性的冲击(例如跌落)时,由于内埋了补强结构30,当焊球40发生开裂时,图中焊球40用黑色表示,焊球中白色断层就是断裂区域A,补强结构30大部分面积还是能够和焊球40保持连接,而焊球40底部(即焊球40与封装主体10连接处)完全开裂的情况较少。因此本申请改善了焊球40开裂对封装主体10与主板50之间电连接的影响,能保持封装主体10与主板50之间的导通。
最后应说明的是:以上实施例仅用以说明本申请的技术方案,而非对其限制;尽管参照前述实施例对本申请进行了详细的说明,本领域的普通技术人员应当理解:本申请的保护范围并不局限于此,任何熟悉本技术领域的技术人员在本申请揭露的技术范围内,可轻易想到的变化或替换,都应涵盖在本申请的保护范围之内。因此,本申请的保护范围应以权利要求的保护范围为准。
Claims (5)
1.一种封装结构的制造方法,其特征在于,包括
在封装主体的表面制作焊盘;
采用将所述焊盘局部增厚的方法在焊盘的表面制作补强结构,以形成由同种材料构成的包括所述焊盘和补强结构的一体式结构;及
在所述焊盘的表面植球,以形成焊球,且使得所述补强结构内埋于所述焊球内。
2.如权利要求1所述的封装结构的制造方法,其特征在于,使用激光植球的方式,将所述焊球包裹在所述补强结构外部。
3.如权利要求1-2任意一项所述的封装结构的制造方法,其特征在于,在焊盘的表面制作补强结构的过程中,制作至少两个所述补强结构,且使得所述至少两个所述补强结构彼此间隔。
4.如权利要求1所述的封装结构的制造方法,其特征在于,所述补强结构为柱状结构。
5.如权利要求4所述的封装结构的制造方法,其特征在于,在焊盘的表面制作补强结构的过程中,制作至少两个所述补强结构,且使得所述至少两个所述补强结构彼此间隔。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/CN2016/081286 WO2017190347A1 (zh) | 2016-05-06 | 2016-05-06 | 具有焊球的封装结构及封装结构的制造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN107592942A CN107592942A (zh) | 2018-01-16 |
CN107592942B true CN107592942B (zh) | 2021-01-12 |
Family
ID=60202701
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201680025157.7A Active CN107592942B (zh) | 2016-05-06 | 2016-05-06 | 具有焊球的封装结构及封装结构的制造方法 |
Country Status (4)
Country | Link |
---|---|
JP (1) | JP6723389B2 (zh) |
KR (1) | KR20180111972A (zh) |
CN (1) | CN107592942B (zh) |
WO (1) | WO2017190347A1 (zh) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112091346B (zh) * | 2020-09-07 | 2022-08-19 | 昆山联滔电子有限公司 | 一种激光喷射焊球的焊接方法 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20060092687A (ko) * | 2005-02-18 | 2006-08-23 | 엘지전자 주식회사 | 비지에이 반도체 패키지 및 그 실장 구조 |
US20070085220A1 (en) * | 2005-10-19 | 2007-04-19 | Hortaleza Edgardo R | Re-enforced ball-grid array packages for semiconductor products |
CN101409273B (zh) * | 2007-10-08 | 2010-12-08 | 全懋精密科技股份有限公司 | 封装基板的植球侧表面结构及其制法 |
CN102612262A (zh) * | 2011-01-18 | 2012-07-25 | 三星半导体(中国)研究开发有限公司 | 焊盘结构及其制造方法 |
US9165875B2 (en) * | 2012-04-25 | 2015-10-20 | Taiwan Semiconductor Manufacturing Company, Ltd. | Low profile interposer with stud structure |
US9768137B2 (en) * | 2012-04-30 | 2017-09-19 | Taiwan Semiconductor Manufacturing Company, Ltd. | Stud bump structure for semiconductor package assemblies |
CN103794583A (zh) * | 2012-10-30 | 2014-05-14 | 中国科学院上海微系统与信息技术研究所 | 一种增强焊球与ubm粘附性的方法及封装结构 |
CN102931110B (zh) * | 2012-11-08 | 2015-07-08 | 南通富士通微电子股份有限公司 | 半导体器件的封装方法 |
TWI533771B (zh) * | 2014-07-17 | 2016-05-11 | 矽品精密工業股份有限公司 | 無核心層封裝基板及其製法 |
-
2016
- 2016-05-06 KR KR1020187026040A patent/KR20180111972A/ko not_active Application Discontinuation
- 2016-05-06 CN CN201680025157.7A patent/CN107592942B/zh active Active
- 2016-05-06 WO PCT/CN2016/081286 patent/WO2017190347A1/zh active Application Filing
- 2016-05-06 JP JP2018566623A patent/JP6723389B2/ja active Active
Non-Patent Citations (2)
Title |
---|
振动条件下的CQFP器件高可靠组装工艺;张伟等;《电子工艺技术》;20120518(第03期);160-164 * |
高可靠性计算机中BGA芯片的可制造性设计;李渭荣等;《电子技术与软件工程》;20130615(第12期);109-110 * |
Also Published As
Publication number | Publication date |
---|---|
JP2019508908A (ja) | 2019-03-28 |
JP6723389B2 (ja) | 2020-07-15 |
KR20180111972A (ko) | 2018-10-11 |
WO2017190347A1 (zh) | 2017-11-09 |
CN107592942A (zh) | 2018-01-16 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US9136211B2 (en) | Protected solder ball joints in wafer level chip-scale packaging | |
US8525333B2 (en) | Electronic device and manufacturing method therefor | |
US6586830B2 (en) | Semiconductor device with an interposer | |
US10490515B2 (en) | Semiconductor substrate having stress-absorbing surface layer | |
KR101772284B1 (ko) | 반도체 디바이스 및 그 제조 방법 | |
KR101376264B1 (ko) | 적층형 패키지 및 그 제조 방법 | |
CA2687424C (en) | A contact pad and method of forming a contact pad for an integrated circuit | |
KR20020035774A (ko) | 전자 부품, 반도체 장치의 실장 방법 및 반도체 장치의실장 구조 | |
US20130334684A1 (en) | Substrate structure and package structure | |
JP2009043793A (ja) | 半導体装置、およびその半導体装置の製造方法 | |
JP2007157958A (ja) | 電子装置 | |
CN107592942B (zh) | 具有焊球的封装结构及封装结构的制造方法 | |
US7355286B2 (en) | Flip chip bonded package applicable to fine pitch technology | |
JP2013030748A (ja) | 電子部品 | |
US8315063B2 (en) | Solder pad structure with high bondability to solder ball | |
US20140097542A1 (en) | Flip packaging device | |
US20080029897A1 (en) | Side connectors for rfid chip | |
KR101698431B1 (ko) | 반도체 파워 모듈 패키지 및 그의 제조방법 | |
KR101534849B1 (ko) | 플립칩 패키지 및 그 제조방법 | |
JP2007088220A (ja) | 半導体装置の製造方法 | |
US20100190333A1 (en) | Method of forming connection terminal | |
JP2005294482A (ja) | 電子部品及び電子装置 | |
US7663218B2 (en) | Integrated circuit component with a surface-mount housing | |
JP2010267743A (ja) | 半導体装置と配線基板の接続構造 | |
JP2005340678A (ja) | 半導体装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |