CN106684145A - 具有漂移区的高压无结场效应器件及其形成方法 - Google Patents

具有漂移区的高压无结场效应器件及其形成方法 Download PDF

Info

Publication number
CN106684145A
CN106684145A CN201510765530.XA CN201510765530A CN106684145A CN 106684145 A CN106684145 A CN 106684145A CN 201510765530 A CN201510765530 A CN 201510765530A CN 106684145 A CN106684145 A CN 106684145A
Authority
CN
China
Prior art keywords
drift region
field effect
effect device
high pressure
fin structure
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN201510765530.XA
Other languages
English (en)
Other versions
CN106684145B (zh
Inventor
肖德元
张汝京
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Zing Semiconductor Corp
Original Assignee
Zing Semiconductor Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Zing Semiconductor Corp filed Critical Zing Semiconductor Corp
Priority to CN201510765530.XA priority Critical patent/CN106684145B/zh
Priority to US15/012,864 priority patent/US9818844B2/en
Priority to TW105107437A priority patent/TWI588944B/zh
Publication of CN106684145A publication Critical patent/CN106684145A/zh
Application granted granted Critical
Publication of CN106684145B publication Critical patent/CN106684145B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66477Unipolar field-effect transistors with an insulated gate, i.e. MISFET
    • H01L29/66674DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
    • H01L29/66712Vertical DMOS transistors, i.e. VDMOS transistors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/2003Nitride compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66477Unipolar field-effect transistors with an insulated gate, i.e. MISFET
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66477Unipolar field-effect transistors with an insulated gate, i.e. MISFET
    • H01L29/66666Vertical transistors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7801DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
    • H01L29/7802Vertical DMOS transistors, i.e. VDMOS transistors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7827Vertical transistors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7827Vertical transistors
    • H01L29/7828Vertical transistors without inversion channel, e.g. vertical ACCUFETs, normally-on vertical MISFETs

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Ceramic Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)

Abstract

本发明提出了一种具有漂移区的高压无结场效应器件及其形成方法,在半导体沟道层上和介质层之间形成有漂移区,能够使形成的高压无结场效应器件具有较高的击穿电压,此外,形成的高压无结场效应器件具有高迁移率,具有较好的性能及可靠性。

Description

具有漂移区的高压无结场效应器件及其形成方法
技术领域
本发明涉及半导体制造领域,尤其涉及一种具有漂移区的高压无结场效应器件及其形成方法。
背景技术
作为第三代半导体材料的典型代表宽禁带半导体,氮化镓(GaN)具有许多硅(Si)材料所不具备的优异性能,GaN是高频、高压、高温和大功率应用的优良半导体材料,在民用和军事领域具有广阔的应用前景。随着GaN技术的进步,特别是大直径硅基GaN外延技术的逐步成熟并商用化GaN功率半导体技术有望成为高性能低功耗技术解决方案,从而GaN的功率器件受到国际著名半导体厂商和研究单位的关注。
与传统的MOSFET不同,无结场效应晶体管(Junctionless Transistor,JLT)由源区、沟道、漏区,栅氧化层及栅极组成,从源区至沟道和漏区,其杂质掺杂类型相同,没有PN结,属于多数载流子导电的器件。通过栅极偏置电压使器件沟道内的多数载流子累积或耗尽,从而可以调制沟道电导进而控制沟道电流。当栅极偏置电压大到将沟道靠近漏极某一截面处的载流子耗尽掉,在这种情况下,器件沟道电阻变成准无限大,器件处于关闭状态。由于避开了不完整的栅氧化层与半导体沟道界面,载流子受到界面散射影响有限,提高了载流子迁移率。此外,无结场效应晶体管属于多数载流子导电器件,器件响应速度快,且沿沟道方向,靠近漏极的电场强度比常规反型沟道的MOS晶体管要来得低,因此,器件的性能及可靠性得以大大提高。
发明内容
本发明的目的在于提供一种具有漂移区的高压无结场效应器件及其形成方法,能够获得具有高迁移率的高压无结场效应器件。
为了实现上述目的,本发明提出了一种具有漂移区的高压无结场效应器件的形成方法,包括步骤:
提供衬底,在所述衬底的表面形成具有鳍状结构的缓冲层;
在所述缓冲层及鳍状结构表面上依次沉积半导体沟道层;
在所述鳍状结构两侧的半导体沟道层上形成漂移区;
在所述漂移区及暴露出的半导体沟道层上形成介质层;
在所述鳍状结构两侧的介质层表面形成金属栅极,所述金属栅极高度低于所述鳍状结构的高度;
在鳍状结构两侧暴露出的介质层表面及金属栅极的两侧形成侧墙;
依次刻蚀位于鳍状结构及缓冲层表面暴露出的介质层和漂移区,暴露出源漏区域的所述半导体沟道层;
在暴露出的源漏区域的半导体沟道层内进行掺杂,形成源极和漏极;
在所述源极和漏极上形成源漏电极。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述具有鳍状结构的缓冲层的形成步骤包括:
在所述衬底上形成所述缓冲层;
在所述缓冲层表面形成图案化的光阻;
以所述图案化的光阻作为掩膜,干法刻蚀所述缓冲层,形成鳍状结构。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述缓冲层的材质为AlN。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述缓冲层采用MOCVD、ALD或者MBE工艺形成。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述半导体沟道层的材质为N-型GaN。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述半导体沟道层采用外延生长工艺形成。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述漂移区的材质为氧化硅或者氮化硅。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述漂移区的形成步骤包括:
在所述半导体沟道层表面形成一层薄膜层;
采用化学机械研磨及回刻蚀工艺处理所述薄膜层,保留位于所述鳍状结构两侧的半导体沟道层表面的薄膜层,形成漂移区。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述薄膜层采用ALD、CVD、MOCVD或PVD工艺形成。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述介质层的材质为二氧化硅、氧化铝、氧化锆或氧化铪。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述介质层采用CVD、MOCVD、ALD、PVD或MBE工艺形成。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述金属栅极的材质为NiAu或CrAu。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述金属层采用CVD、PVD、MOCVD、ALD或MBE工艺形成。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,所述侧墙的材质为氮化硅。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,采用选择性刻蚀工艺依次刻蚀位于鳍状结构及缓冲层表面暴露出的介质层,暴露出源漏区域的所述半导体沟道层。
进一步的,在所述的具有漂移区的高压无结场效应器件的形成方法中,采用离子注入或离子扩散工艺对所述半导体沟道层进行N+离子注入,形成源极和漏极。
在本发明中,还提出了一种具有漂移区的高压无结场效应器件,采用如上文所述的任一项具有漂移区的高压无结场效应器件的形成方法形成,包括:衬底、设有鳍状结构的缓冲层、半导体沟道层、漂移区、介质层、金属栅极、侧墙、源极、漏极及源漏极电极,其中,所述设有鳍状结构的缓冲层形成在所述衬底上,所述半导体沟道层形成在所述缓冲层表面,所述漂移区形成在位于所述鳍状结构两侧的所述半导体沟道层上,所述介质层形成在所述漂移区及鳍状结构表面的半导体沟道层上,暴露出鳍状结构顶部暴露出的半导体沟道层,所述金属栅极形成在位于鳍状结构两侧的介质层上,所述侧墙形成在鳍状结构两侧暴露出的介质层表面及金属栅极的两侧,所述源极形成在所述半导体沟道层内并位于金属栅极的两侧,所述漏极形成在鳍状结构顶部的半导体沟道层内,所述源漏极电极形成在所述源极和漏极上。
与现有技术相比,本发明的有益效果主要体现在:提出了一种具有漂移区的高压无结场效应器件的形成方法,在半导体沟道层上和介质层之间形成有漂移区,能够使形成的高压无结场效应器件具有较高的击穿电压,此外,形成的高压无结场效应器件具有高迁移率,具有较好的性能及可靠性。
附图说明
图1为本发明一实施例中具有漂移区的高压无结场效应器件的形成方法的流程图;
图2至图10为本发明一实施例中形成具有漂移区的高压无结场效应器件过程中的剖面示意图。
具体实施方式
下面将结合示意图对本发明的具有漂移区的高压无结场效应器件及其形成方法进行更详细的描述,其中表示了本发明的优选实施例,应该理解本领域技术人员可以修改在此描述的本发明,而仍然实现本发明的有利效果。因此,下列描述应当被理解为对于本领域技术人员的广泛知道,而并不作为对本发明的限制。
为了清楚,不描述实际实施例的全部特征。在下列描述中,不详细描述公知的功能和结构,因为它们会使本发明由于不必要的细节而混乱。应当认为在任何实际实施例的开发中,必须做出大量实施细节以实现开发者的特定目标,例如按照有关系统或有关商业的限制,由一个实施例改变为另一个实施例。另外,应当认为这种开发工作可能是复杂和耗费时间的,但是对于本领域技术人员来说仅仅是常规工作。
在下列段落中参照附图以举例方式更具体地描述本发明。根据下面说明和权利要求书,本发明的优点和特征将更清楚。需说明的是,附图均采用非常简化的形式且均使用非精准的比例,仅用以方便、明晰地辅助说明本发明实施例的目的。
请参考图1,在本发明中,提出了一种具有漂移区的高压无结场效应器件的形成方法,包括步骤:
S100:提供衬底,在所述衬底的表面形成具有鳍状结构的缓冲层;
S200:在所述缓冲层及鳍状结构表面上依次沉积半导体沟道层;
S300:在所述鳍状结构两侧的半导体沟道层上形成漂移区;
S400:在所述漂移区及暴露出的半导体沟道层上形成介质层;
S500:在所述鳍状结构两侧的介质层表面形成金属栅极,所述金属栅极高度低于所述鳍状结构的高度;
S600:在鳍状结构两侧暴露出的介质层表面及金属栅极的两侧形成侧墙;
S700:依次刻蚀位于鳍状结构及缓冲层表面暴露出的介质层和漂移区,暴露出源漏区域的所述半导体沟道层;
S800:在暴露出的源漏区域的半导体沟道层内进行掺杂,形成源极和漏极;
S900:在所述源极和漏极上形成源漏电极。
具体的,请参考图2,在步骤S100中,所述衬底100可以为硅衬底、蓝宝石衬底或者SiC衬底等,其还可以是设有Σ型凹槽等图形的衬底。
在所述衬底100表面形成缓冲层200;所述缓冲层200材质为AlN,其厚度范围是100nm~5000nm,例如是3000nm。所述缓冲层200可以采用MOCVD(Metal-organic Chemical Vapor Deposition,金属有机化合物化学气相沉淀)、ALD(Atomic layer deposition,原子层沉积)或者MBE(Molecular Beam Epitaxy,分子束外延)工艺等形成。
接着,在所述缓冲层200上形成鳍形结构210,其形成步骤包括:
在所述衬底上形成所述缓冲层;
在所述缓冲层表面形成图案化的光阻;
以所述图案化的光阻作为掩膜,干法刻蚀所述缓冲层,形成鳍状结构(Fin)210。
接着,请参考图3,在所述缓冲层200及鳍状结构210表面上沉积半导体沟道层300,其中,所述半导体沟道层300材质为N-型GaN,在本实施例中,其厚度范围是1nm~100nm,例如是50nm。所述半导体沟道层300采用外延生长工艺形成。
请继续参考图3,在所述半导体沟道层300上形成薄膜层400,采用化学机械研磨(CMP)及回刻蚀(Etch back)工艺处理所述薄膜层400,保留位于所述鳍状结构210两侧的半导体沟道层300表面的薄膜层400,形成漂移区410,如图4所示,所述薄膜层400采用ALD、CVD、MOCVD或PVD(Physical VaporDeposition,物理气相沉积)工艺形成,所述薄膜层400的材质可以为氮化硅或者氧化硅,其厚度可以根据具体的需要来决定,在此不作限定。
接着,请参考图5,在所述漂移区410及暴露出的半导体沟道层300表面形成介质层500,所述介质层500的材质为二氧化硅、氧化铝、氧化锆或氧化铪,其厚度范围是1nm~5nm,例如是3nm。所述介质层500可以采用CVD、MOCVD、ALD或MBE等工艺形成。
接着,请参考图6,在所述鳍状结构两侧的介质层500表面形成金属栅极600,所述金属栅极600高度低于所述鳍状结构210的高度;其中,所述金属栅极600的材质为NiAu或CrAu等,其可以采用PVD、MOCVD、ALD或MBE工艺形成。
请参考图7,在鳍状结构210两侧暴露出的介质层500表面及金属栅极600的两侧形成侧墙700;所述侧墙700的材质为氮化硅。
接着,请参考图8,刻蚀位于鳍状结构210及缓冲层200表面暴露出的介质层500及漂移区410,暴露出源漏区域的所述半导体沟道层300;其中,采用选择性刻蚀工艺进行刻蚀,去除所述部分介质层500,暴露出位于鳍状结构210顶部的半导体沟道层300,后续作为漏极,以及位于金属栅极600两侧缓冲层200上的半导体沟道层300,后续作为源极。
接着,请参考图9,采用离子注入或离子扩散工艺对所述半导体沟道层300进行N+离子注入,形成源极310和漏极320。
接着,请参考图10,在所述源极310和漏极320上形成源漏电极800。
在本实施例的另一方面还提出了一种具有漂移区的高压无结场效应器件,采用如上文所述的具有漂移区的高压无结场效应器件的形成方法形成,包括:衬底100、设有鳍状结构210的缓冲层200、半导体沟道层300、漂移区410、介质层500、金属栅极600、侧墙700、源极310、漏极320及源漏极电极800,其中,所述设有鳍状结构的缓冲层200形成在所述衬底100上,所述半导体沟道层300形成在所述缓冲层200表面,所述漂移区410形成在位于所述鳍状结构210两侧的所述半导体沟道层300上,所述介质层500形成在所述漂移区410及鳍状结构210表面的半导体沟道层300上,暴露出鳍状结构210顶部暴露出的半导体沟道层300,所述金属栅极600形成在位于鳍状结构210两侧的介质层500上,所述侧墙700形成在鳍状结构210两侧暴露出的介质层500表面及金属栅极600的两侧,所述源极310形成在所述半导体沟道层300内并位于金属栅极600的两侧,所述漏极320形成在鳍状结构210顶部的半导体沟道层300内,所述源漏极电极800形成在所述源极310和漏极320上。
综上,在本发明实施例提供的具有漂移区的高压无结场效应器件及其形成方法中,提出了一种具有漂移区的高压无结场效应器件的形成方法,在半导体沟道层上和介质层之间形成有漂移区,能够使形成的高压无结场效应器件具有较高的击穿电压,此外,形成的高压无结场效应器件具有高迁移率,具有较好的性能及可靠性。
上述仅为本发明的优选实施例而已,并不对本发明起到任何限制作用。任何所属技术领域的技术人员,在不脱离本发明的技术方案的范围内,对本发明揭露的技术方案和技术内容做任何形式的等同替换或修改等变动,均属未脱离本发明的技术方案的内容,仍属于本发明的保护范围之内。

Claims (17)

1.一种具有漂移区的高压无结场效应器件的形成方法,其特征在于,包括步骤:
提供衬底,在所述衬底的表面形成具有鳍状结构的缓冲层;
在所述缓冲层及鳍状结构表面上依次沉积半导体沟道层;
在所述鳍状结构两侧的半导体沟道层上形成漂移区;
在所述漂移区及暴露出的半导体沟道层上形成介质层;
在所述鳍状结构两侧的介质层表面形成金属栅极,所述金属栅极高度低于所述鳍状结构的高度;
在鳍状结构两侧暴露出的介质层表面及金属栅极的两侧形成侧墙;
依次刻蚀位于鳍状结构及缓冲层表面暴露出的介质层和漂移区,暴露出源漏区域的所述半导体沟道层;
在暴露出的源漏区域的半导体沟道层内进行掺杂,形成源极和漏极;
在所述源极和漏极上形成源漏电极。
2.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述具有鳍状结构的缓冲层的形成步骤包括:
在所述衬底上形成所述缓冲层;
在所述缓冲层表面形成图案化的光阻;
以所述图案化的光阻作为掩膜,干法刻蚀所述缓冲层,形成鳍状结构。
3.如权利要求2所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述缓冲层的材质为AlN。
4.如权利要求2所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述缓冲层采用MOCVD、ALD或者MBE工艺形成。
5.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述半导体沟道层的材质为N-型GaN。
6.如权利要求5所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述半导体沟道层采用外延生长工艺形成。
7.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述漂移区的材质为氧化硅或者氮化硅。
8.如权利要求7所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述漂移区的形成步骤包括:
在所述半导体沟道层表面形成一层薄膜层;
采用化学机械研磨及回刻蚀工艺处理所述薄膜层,保留位于所述鳍状结构两侧的半导体沟道层表面的薄膜层,形成漂移区。
9.如权利要求8所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述薄膜层采用ALD、CVD、MOCVD或PVD工艺形成。
10.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述介质层的材质为二氧化硅、氧化铝、氧化锆或氧化铪。
11.如权利要求10所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述介质层采用CVD、MOCVD、ALD、PVD或MBE工艺形成。
12.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述金属栅极的材质为NiAu或CrAu。
13.如权利要求12所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述金属层采用CVD、PVD、MOCVD、ALD或MBE工艺形成。
14.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,所述侧墙的材质为氮化硅。
15.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,采用选择性刻蚀工艺依次刻蚀位于鳍状结构及缓冲层表面暴露出的介质层,暴露出源漏区域的所述半导体沟道层。
16.如权利要求1所述的具有漂移区的高压无结场效应器件的形成方法,其特征在于,采用离子注入或离子扩散工艺对所述半导体沟道层进行N+离子注入,形成源极和漏极。
17.一种具有漂移区的高压无结场效应器件,采用如权利要求1至16中任一种所述的具有漂移区的高压无结场效应器件的形成方法形成,其特征在于,包括:衬底、设有鳍状结构的缓冲层、半导体沟道层、漂移区、介质层、金属栅极、侧墙、源极、漏极及源漏极电极,其中,所述设有鳍状结构的缓冲层形成在所述衬底上,所述半导体沟道层形成在所述缓冲层表面,所述漂移区形成在位于所述鳍状结构两侧的所述半导体沟道层上,所述介质层形成在所述漂移区及鳍状结构表面的半导体沟道层上,暴露出鳍状结构顶部暴露出的半导体沟道层,所述金属栅极形成在位于鳍状结构两侧的介质层上,所述侧墙形成在鳍状结构两侧暴露出的介质层表面及金属栅极的两侧,所述源极形成在所述半导体沟道层内并位于金属栅极的两侧,所述漏极形成在鳍状结构顶部的半导体沟道层内,所述源漏极电极形成在所述源极和漏极上。
CN201510765530.XA 2015-11-11 2015-11-11 具有漂移区的高压无结场效应器件及其形成方法 Active CN106684145B (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN201510765530.XA CN106684145B (zh) 2015-11-11 2015-11-11 具有漂移区的高压无结场效应器件及其形成方法
US15/012,864 US9818844B2 (en) 2015-11-11 2016-02-02 High-voltage junctionless device with drift region and the method for making the same
TW105107437A TWI588944B (zh) 2015-11-11 2016-03-10 具有漂移區的高壓無接面場效元件及其製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201510765530.XA CN106684145B (zh) 2015-11-11 2015-11-11 具有漂移区的高压无结场效应器件及其形成方法

Publications (2)

Publication Number Publication Date
CN106684145A true CN106684145A (zh) 2017-05-17
CN106684145B CN106684145B (zh) 2019-09-17

Family

ID=58664280

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201510765530.XA Active CN106684145B (zh) 2015-11-11 2015-11-11 具有漂移区的高压无结场效应器件及其形成方法

Country Status (3)

Country Link
US (1) US9818844B2 (zh)
CN (1) CN106684145B (zh)
TW (1) TWI588944B (zh)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114267715A (zh) * 2021-06-02 2022-04-01 青岛昇瑞光电科技有限公司 具有漂移区的高压无结FinFET器件及其制备方法
CN114284334A (zh) * 2021-06-02 2022-04-05 青岛昇瑞光电科技有限公司 具有超结结构的高压无结FinFET器件及其制备方法

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10608114B2 (en) * 2018-06-15 2020-03-31 International Business Machines Corporation Vertical nano-wire complimentary metal-oxide-semiconductor transistor with cylindrical III-V compound and germanium channel

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103311249A (zh) * 2012-03-12 2013-09-18 爱思开海力士有限公司 具有无结垂直栅晶体管的半导体器件及其制造方法
US20140335665A1 (en) * 2013-05-08 2014-11-13 International Business Machines Corporation Low extension resistance iii-v compound fin field effect transistor
CN104425591A (zh) * 2013-08-20 2015-03-18 中芯国际集成电路制造(上海)有限公司 晶体管及其形成方法

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002237591A (ja) * 2000-12-31 2002-08-23 Texas Instruments Inc Dmosトランジスタ・ソース構造とその製法
US8674403B2 (en) * 2009-04-30 2014-03-18 Maxpower Semiconductor, Inc. Lateral devices containing permanent charge
US8803233B2 (en) * 2011-09-23 2014-08-12 International Business Machines Corporation Junctionless transistor
CN103943498B (zh) * 2013-01-22 2016-08-10 中芯国际集成电路制造(上海)有限公司 三维量子阱晶体管及其形成方法
TWI540650B (zh) * 2014-08-06 2016-07-01 聯華電子股份有限公司 鰭狀場效電晶體元件製造方法
US9558946B2 (en) * 2014-10-03 2017-01-31 Taiwan Semiconductor Manufacturing Company, Ltd. FinFETs and methods of forming FinFETs
US9515188B2 (en) * 2014-12-22 2016-12-06 Taiwan Semiconductor Manufacturing Company, Ltd. Fin field effect transistors having conformal oxide layers and methods of forming same
US9362278B1 (en) * 2014-12-29 2016-06-07 Taiwan Semiconductor Manufacturing Company, Ltd. FinFET with multiple dislocation planes and method for forming the same
US9324713B1 (en) * 2015-03-16 2016-04-26 Globalfoundries Inc. Eliminating field oxide loss prior to FinFET source/drain epitaxial growth
US9305974B1 (en) * 2015-04-16 2016-04-05 Stmicroelectronics, Inc. High density resistive random access memory (RRAM)

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103311249A (zh) * 2012-03-12 2013-09-18 爱思开海力士有限公司 具有无结垂直栅晶体管的半导体器件及其制造方法
US20140335665A1 (en) * 2013-05-08 2014-11-13 International Business Machines Corporation Low extension resistance iii-v compound fin field effect transistor
CN104425591A (zh) * 2013-08-20 2015-03-18 中芯国际集成电路制造(上海)有限公司 晶体管及其形成方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114267715A (zh) * 2021-06-02 2022-04-01 青岛昇瑞光电科技有限公司 具有漂移区的高压无结FinFET器件及其制备方法
CN114284334A (zh) * 2021-06-02 2022-04-05 青岛昇瑞光电科技有限公司 具有超结结构的高压无结FinFET器件及其制备方法

Also Published As

Publication number Publication date
US9818844B2 (en) 2017-11-14
US20170133488A1 (en) 2017-05-11
CN106684145B (zh) 2019-09-17
TW201717324A (zh) 2017-05-16
TWI588944B (zh) 2017-06-21

Similar Documents

Publication Publication Date Title
US10727330B2 (en) Semiconductor device with diode region
US9653605B2 (en) Fin field effect transistor (FinFET) device and method for forming the same
US9870949B2 (en) Semiconductor device and formation thereof
CN104576383B (zh) 一种FinFET结构及其制造方法
CN108886052A (zh) 用于iii-n晶体管的单块集成的半导体结构与蚀刻技术
US20130154016A1 (en) Tin doped iii-v material contacts
CN102468333B (zh) 一种石墨烯器件及其制造方法
CN103915345A (zh) 半导体器件及其制造方法
US9640660B2 (en) Asymmetrical FinFET structure and method of manufacturing same
CN104752211B (zh) 鳍式场效应晶体管及其形成方法
CN106611781A (zh) 量子阱器件及其形成方法
CN109216454A (zh) 纳米线晶体管及其形成方法
CN106910713B (zh) 半导体装置及其制造方法
US20160268384A1 (en) Method for preparing a nano-scale field-effect transistor
CN104157686B (zh) 一种环栅场效应晶体管及其制备方法
CN106611780A (zh) 量子阱器件及其形成方法
CN106684145A (zh) 具有漂移区的高压无结场效应器件及其形成方法
JP2010027833A (ja) 炭化珪素半導体装置およびその製造方法
US10361196B2 (en) Method and device for FinFET with graphene nanoribbon
CN106876447A (zh) 具有渐变沟道的高压无结场效应器件及其形成方法
CN106684123A (zh) 高压无结场效应器件及其形成方法
CN105244375B (zh) 具有突变隧穿结的pnin/npip型ssoi tfet及制备方法
CN106684138A (zh) 高压无结场效应器件及其形成方法
CN106803517A (zh) 双沟道FinFET器件及其制造方法
CN108511344A (zh) 垂直纳米线晶体管与其制作方法

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant