CN105976778A - 液晶显示面板的数据驱动系统 - Google Patents

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Abstract

本发明提供一种液晶显示面板的数据驱动系统，包括：时序控制芯片；多个数据驱动芯片；多个第一信号线，用于将预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片，其中，每个第一信号线设置在所述时序控制芯片与一个数据驱动芯片之间，以用于将预定数据信号从所述时序控制芯片传输至所述一个数据驱动芯片；多个第一传输门，其中，每个第一传输门设置在一个第一信号线上。所述数据驱动系统通过传输门的导通和截止控制时序控制芯片提供的信号是否向数据驱动芯片传输，进而实现分时逐个开启数据驱动芯片，使时序控制芯片提供的信号依次在数据驱动芯片中传递，从而显著提高数据驱动芯片接收信号的质量，且有效避免信号接收错误。

Description

液晶显示面板的数据驱动系统
技术领域
本发明总体说来涉及液晶显示领域，更具体地讲，涉及一种液晶显示面板的数据驱动系统。
背景技术
液晶显示器(Liquid Crystal Display，LCD)的数据驱动系统是利用输出不同的电压来改变液晶分子的排列方向，再透过每个像素不同的透光程度来构成画面不同的灰阶，故新一代显示器在分辨率、亮度与反应时间不断优化的同时，数据驱动系统也需要更高频与更高电压才能满足高扫描频率与快速更新的需求，因此，数据驱动系统的芯片数量也将依据需求而提高。
在现有的液晶显示器的X-电路板(X board)和控制板(Control board)分离的面板驱动架构中，X-电路板的作用是将控制板的信号传递到设于液晶显示面板上的数据驱动芯片(source driver IC)内部。随着数据驱动芯片数量的增加，X-电路板的尺寸越来越长，导致远端的数据驱动芯片与近端的数据驱动芯片距离过远，进而引起阻抗不连续，使数据驱动芯片接收的信号变得越来越差。
目前，通常采用在传输线终端设置终端电阻的方式，提高接收信号的质量。另外，控制板上的时序控制芯片(Timing control IC，TCON IC)与数据驱动芯片之间采用mini-LVDS的差分信号方式进行通信，时序控制芯片内部的发射端(TX)传输的是数据信号(data signal)，该数据信号是一种电流信号，设置在数据驱动芯片内部的终端电阻可以将电流信号转换为电压信号。为了避免差分信号(例如数据电流信号)在传输时，由于信号在传输线传输在终端形成反射波，干扰原信号，每个数据驱动芯片的内部均需设置一个终端电阻。然而，由于现有的数据驱动系统包括多个数据驱动芯片，输入数据驱动系统的差分电流信号会流向多个数据驱动芯片，因此，每个数据驱动芯片接收到的差分信号的电流将减小，这样就会导致输出的数据驱动电压降低，从而导致画面显示异常。
因此，亟需开发一种新型的液晶显示面板的数据驱动系统，以解决上述存在的问题。
发明内容
本发明的目的在于提供一种液晶显示面板的数据驱动系统，可以显著提高数据驱动芯片接收信号的质量，且有效避免信号接收错误。
为实现上述发明目的，本发明提供一种液晶显示面板的数据驱动系统，包括：时序控制芯片；多个数据驱动芯片；多个第一信号线，用于将预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片，其中，每个第一信号线设置在所述时序控制芯片与一个数据驱动芯片之间，以用于将所述预定数据信号从所述时序控制芯片传输至所述一个数据驱动芯片；多个第一传输门，其中，每个第一传输门设置在一个第一信号线上。
在将所述预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片的过程中，所述多个第一传输门不同时导通。
在将所述预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片的过程中，所述多个第一传输门依次导通，并且在每个第一传输门导通时，其他第一传输门截止。
所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第一信号线上的第一传输门导通，从而接收所述预定数据信号。
接收到预定数据信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止，并将控制信号输出到未接收到预定数据信号的数据驱动芯片中的一个或多个数据驱动芯片；接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。
所述数据驱动系统还包括：多个第二信号线，用于将时钟控制信号从所述时序控制芯片传输至所述多个数据驱动芯片，其中，每个第二信号线设置在所述时序控制芯片与一个数据驱动芯片之间，以用于将所述时钟控制信号传输至所述一个数据驱动芯片；多个第二传输门，其中，每个第二传输门设置在一个第二信号线上。
连接到任意一个数据驱动芯片的第一信号线上的第一传输门与连接到所述任意一个数据驱动芯片的第二信号线上的第二传输门同时导通或截止。
每当一个数据驱动芯片在完成第N个时钟周期的时钟控制信号的接收时，控制自己连接的第一信号线上的第一传输门截止，其中，N为大于0的整数。
接收到时钟控制信号的数据驱动芯片在完成第M个时钟周期的时钟控制信号的接收时，将控制信号输出到未接收到时钟控制信号的数据驱动芯片中的一个或多个数据驱动芯片，其中，M为小于N的正整数；接收到控制信号的数据驱动芯片控制自己连接的第二信号线上的第二传输门延迟N-M个时钟周期导通，从而当接收到时钟控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止时，接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。
所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第二信号线上的第二传输门导通。
所述时钟控制信号和所述预定数据信号分别以差分信号的方式来传输。
本发明提供一种液晶显示面板的数据驱动系统，通过传输门的导通和截止控制时序控制芯片提供的信号是否向数据驱动芯片传输，进而实现分时开启多个数据驱动芯片，使时序控制芯片提供的信号依次在数据驱动芯片中传递，避免由于时序控制芯片提供的数据信号流向多个数据驱动芯片而导致的每个数据驱动芯片接收到的数据信号的电流减小、转换后的电压降低的问题，显著提高数据驱动芯片接收信号的质量，且有效避免信号接收错误。
附图说明
图1示出本发明实施例的液晶显示面板的数据驱动系统的示意图。
图2示出图1的液晶显示面板的数据驱动系统的时序图。
具体实施方式
下面参照图1和图2描述根据本发明的实施例的液晶显示面板的数据驱动系统。
图1示出根据本发明实施例的液晶显示面板的数据驱动系统的示意图。参照图1，本发明的实施例中提出的液晶显示面板的数据驱动系统包括：时序控制芯片100、多个数据驱动芯片SD1、SD2、……、SDi、多个第一信号线L11、L21、……、Li1、多个第一传输门TG11、TG21、……、TGi1。其中，i为正整数。
这里，时序控制芯片100制作于控制板(Control board)上，用于提供液晶显示面板显示影像所需的预定数据信号和时钟控制信号(clock signal)。优选地，所述预定数据信号和时钟控制信号分别以差分信号的方式来传输，应当理解，在此情况下，传输差分信号的信号线分别包括正极线和负极线。
所述多个第一信号线用于将预定数据信号从时序控制芯片100传输至所述多个数据驱动芯片。每个第一信号线设置在时序控制芯片100与一个数据驱动芯片之间，以用于将所述预定数据信号传输至所述一个数据驱动芯片。例如，第一信号线L11设置在时序控制芯片100与第一数据驱动芯片SD1之间，以用于将所述预定数据信号传输至所述第一数据驱动芯片SD1。
每个第一传输门设置在一个第一信号线上。这里，每个第一传输门控制自己所在的第一信号线是否将预定数据信号传输至该第一信号线所连接的数据驱动芯片。例如，第一传输门TG11设置在第一信号线L11上，当第一传输门TG11导通时，该第一信号线L11将预定数据信号传输至第一信号线L11所连接的第一数据驱动芯片SD1；当第一传输门截止TG11时，该第一信号线L11不能将预定数据信号传输至第一信号线L11所连接的第一数据驱动芯片SD1。
优选地，第一传输门为CMOS传输门，该CMOS传输门的两个控制端连接至数据驱动芯片的内部电路，CMOS传输门的输入端和输出端连接在第一信号线上。应当理解，本实施例中的第一传输门仅是示例性的，还可通过其他的传输门来实现。
在将所述预定数据信号从时序控制芯片100传输至所述多个数据驱动芯片的过程中，所述多个第一传输门依次导通，并且在每个第一传输门导通时，其他第一传输门截止。换言之，仅有一个第一传输门导通，从而该第一传输门所在的第一信号线将预定数据信号传输至自己所连接的数据驱动芯片，在此情况下，仅有该数据驱动芯片接收时序控制芯片100提供的预定数据信号，那么，所述预定数据信号全部流向该数据驱动芯片，显著提高数据驱动芯片接收信号的质量。应当理解，在多个第一传输门依次导通的过程中，每个数据驱动芯片接收的预定数据信号为时序控制芯片100提供的同一数据信号。
然而，本发明不限于此，应当理解，在将所述预定数据信号从时序控制芯片100传输至所述多个数据驱动芯片的过程中，所述多个第一传输门可以不同时导通。换言之，在将所述预定数据信号从时序控制芯片100传输至所述多个数据驱动芯片的过程中，仅部分第一传输门导通，即，不是所有的第一传输门都导通，从而不是所有的数据驱动芯片都接收时序控制芯片100提供的预定数据信号，可以避免该预定数据信号流向全部数据驱动芯片而导致的每个数据驱动芯片接收到的预定数据信号的电流减小、转换后的电压降低的问题。应当理解，当所述多个第一传输门不同时导通时，部分数据驱动芯片接收的预定数据信号为时序控制芯片100提供的同一数据信号。
在本实施例中，所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第一信号线上的第一传输门导通，从而接收所述预定数据信号。优选地，所述预定信号为直流电压DC。换言之，接收到预定信号的数据驱动芯片最先接收时序控制芯片提供的预定数据信号。
接收到预定数据信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止，并将控制信号输出到未接收到预定数据信号的数据驱动芯片中的一个数据驱动芯片；接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。依次如此进行，直至最后一个数据驱动芯片接收到预定数据信号。
例如，第一数据驱动芯片SD1响应于接收到预定信号，控制自己连接的第一信号线L11上的第一传输门TG11导通，从而接收所述预定数据信号；第一数据驱动芯片SD1控制自己连接的第一信号线L11上的第一传输门TG11截止，并将控制信号P1输出到未接收到预定数据信号的第二数据驱动芯片SD2，第二数据驱动芯片SD2控制自己连接的第一信号线L21上的第一传输门TG21导通，以接收预定数据信号；第二数据驱动芯片SD2控制自己连接的第一信号线L21上的第一传输门TG21截止，并将控制信号P2输出到未接收到预定数据信号的第三数据驱动芯片(未示出)；第三数据驱动芯片控制自己连接的第一信号线(未示出)上的第一传输门(未示出)导通，以接收预定数据信号。依次如此进行，直至最后一个数据驱动芯片(即第i数据驱动芯片SDi)控制自己连接的第一信号线Li1上的第一传输门TGi1导通，从而接收到预定数据信号。应当理解，本实施例提供的多个数据驱动芯片之间的信号传递过程仅是示例性的，本发明不限于此。
然而，本发明不限于此，应当理解，接收到预定数据信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止，还可以将控制信号输出到未接收到预定数据信号的数据驱动芯片中的多个数据驱动芯片；接收到控制信号的多个数据驱动芯片均控制自己连接的第一信号线上的第一传输门导通。依次如此进行，直至全部数据驱动芯片均接收到预定数据信号。换言之，接收到预定数据信号的数据驱动芯片将控制信号输出到未接收到预定数据信号的数据驱动芯片中的部分数据驱动芯片，该部分驱动芯片控制自己连接的第一信号线上的第一传输门导通，从而将所述预定数据信号从时序控制芯片100传输至部分数据驱动芯片。依次如此进行，通过控制信号实现接收到预定数据信号的部分数据驱动芯片与未接收到预定数据信号的多个数据驱动芯片中的部分数据驱动芯片依次导通，直至全部数据驱动芯片均接收到预定数据信号。
例如，接收到预定数据信号的第一数据驱动芯片SD1和第二数据驱动芯片SD2分别将第一控制信号P1和第二控制信号P2输出至未接收到预定数据信号的第三数据驱动芯片SD3(未示出)和第四数据驱动芯片SD4(未示出)，第三数据驱动芯片SD3和第四数据驱动芯片SD4分别控制自己连接的第一信号线上的第一传输门同时导通，从而接收时序控制芯片100提供的所述预定数据信号。第三数据驱动芯片SD3和第四数据驱动芯片SD4分别控制自己连接的第一信号线上的第一传输门同时截止，并分别将第三控制信号P3(未示出)和第四控制信号P4(未示出)输出到未接收到预定数据信号的第五数据驱动芯片SD5(未示出)和第六数据驱动芯片SD6(未示出)，第五数据驱动芯片SD5和第六数据驱动芯片SD6分别控制自己连接的第一信号线上的第一传输门同时导通，从而接收时序控制芯片100提供的所述预定数据信号。依次如此进行，直至全部数据驱动芯片均接收到预定数据信号。应当理解，本实施例提供的依次同时导通两个数据驱动芯片的信号传递过程仅是示例性的，本发明不限于此。
下面详细描述本发明提供的数据驱动系统中分时逐个开启数据驱动芯片以接收时序控制芯片提供的信号的具体过程。
在本实施例中，所述数据驱动系统还包括：多个第二信号线L12、L22、……、Li2和多个第二传输门TG12、TG22、……、TGi2。其中，i为正整数。
所述多个第二信号线用于将时钟控制信号从时序控制芯片100传输至所述多个数据驱动芯片。每个第二信号线设置在时序控制芯片与一个数据驱动芯片之间，以用于将所述时钟控制信号传输至所述一个数据驱动芯片。例如，第二信号线L12设置在时序控制芯片与第一数据驱动芯片SD1之间，以用于将所述时钟控制信号传输至所述第一数据驱动芯片SD1。
每个第二传输门设置在一个第二信号线上。这里，每个第二传输门控制自己所在的第二信号线是否将时钟控制信号传输至该第二信号线所连接的数据驱动芯片。例如，第二传输门TG12设置在第二信号线L12上，当第二传输门TG12导通时，该第二信号线L12将时钟控制信号传输至第二信号线L12所连接的第一数据驱动芯片SD1；当第二传输门截止TG12时，该第二信号线L12不能将时钟控制信号传输至第二信号线L12所连接的第一数据驱动芯片SD1。
优选地，第二传输门为CMOS传输门，该CMOS传输门的两个控制端连接至数据驱动芯片的内部电路，CMOS传输门的输入端和输出端连接在第二信号线上。应当理解，本实施例中的第二传输门仅是示例性的，还可通过其他的传输门来实现。
在本实施例中，连接到任意一个数据驱动芯片的第一信号线上的第一传输门与连接到所述任意一个数据驱动芯片的第二信号线上的第二传输门同时导通或截止。换言之，任意一个数据驱动芯片控制自己连接的第一信号线上的第一传输门和第二信号线上的第二传输门同时导通或截止，从而接收时序控制芯片100提供的预定数据信号和N个时钟周期的时钟控制信号，其中，N为大于0的整数。
所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第二信号线上的第二传输门导通。换言之，接收到预定信号的数据驱动芯片最先接收时序控制芯片100提供的预定数据信号和时钟控制信号。
每当一个数据驱动芯片在完成第N个时钟周期的时钟控制信号的接收时，控制自己连接的第一信号线上的第一传输门截止。换言之，时序控制芯片100提供时钟控制信号，该时钟控制信号的N个时钟周期对应的时间为接收该N个时钟周期的时钟控制信号的数据驱动芯片开启的时间，当完成第N个时钟周期的时钟控制信号的接收时，该数据驱动芯片关闭。
在本实施例中，接收到时钟控制信号的数据驱动芯片在完成第M个时钟周期的时钟控制信号的接收时，将控制信号输出到未接收到时钟控制信号的数据驱动芯片中的一个数据驱动芯片，其中，M为小于N的正整数；接收到控制信号的数据驱动芯片控制自己连接的第二信号线上的第二传输门延迟N-M个时钟周期导通，从而当接收到时钟控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止时，接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。依次如此进行，直至最后一个数据驱动芯片接收到预定数据信号和时钟控制信号。换言之，当一个接收预定数据信号的数据驱动芯片关闭时，另一个未接收预定数据信号的数据驱动芯片立即开启，从而实现多个数据驱动芯片的分时逐个依次开启，并且，当一个数据驱动芯片开启时，其他数据驱动芯片均关闭。
然而，本发明不限于此，应当理解，接收到时钟控制信号的数据驱动芯片在完成第M个时钟周期的时钟控制信号的接收时，可以将控制信号输出到未接收到时钟控制信号的数据驱动芯片中的多个数据驱动芯片，其中，M为小于N的正整数；接收到控制信号的多个数据驱动芯片均控制自己连接的第二信号线上的第二传输门延迟N-M个时钟周期导通，从而当接收到时钟控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止时，接收到控制信号的多个数据驱动芯片均控制自己连接的第一信号线上的第一传输门导通。依次如此进行，直至全部数据驱动芯片均接收到预定数据信号和时钟控制信号。换言之，接收到时钟控制信号的数据驱动芯片在完成第M个时钟周期的时钟控制信号的接收时，将控制信号输出到未接收到时钟控制信号的数据驱动芯片中的部分数据驱动芯片，该部分驱动芯片控制自己连接的第二信号线上的第二传输门延迟N-M个时钟周期导通。依次如此进行，通过控制信号实现当接收到时钟控制信号的部分数据驱动芯片关闭时，未接收到时钟控制信号的部分数据驱动芯片开启，直至全部数据驱动芯片均接收到预定数据信号和时钟控制信号。
图2示出图1的液晶显示面板的数据驱动系统的时序图。
参照图2，第一数据驱动芯片SD1响应于接收到直流电压DC，控制自己连接的第一信号线L11上的第一传输门TG11和第二信号线L12上的第二传输门TG12同时导通，从而接收所述预定数据信号和N个时钟周期的时钟控制信号CLK，并在完成第N个时钟周期的时钟控制信号的接收时，控制自己连接的第一信号线L11上的第一传输门TG11截止。第一数据驱动芯片SD1在完成第M个时钟周期的时钟控制信号的接收时(此时，还有N-M个时钟周期的时钟控制信号未接收，该N-M个时钟周期记为T1)，将控制信号P1输出到未接收到时钟控制信号的第二数据驱动芯片SD2；第二数据驱动芯片SD2控制自己连接的第二信号线L22上的第二传输门TG22延迟N-M个时钟周期导通(延迟的N-M个周期记为T2，且T1＝T2)，从而当第一数据驱动芯片完成第N个时钟周期的时钟控制信号的接收时(即第一数据驱动芯片SD1控制自己连接的第一信号线L11上的第一传输门TG11截止时)，接收到控制信号P1的第二数据驱动芯片SD2控制自己连接的第一信号线L21上的第一传输门TG21导通，从而接收所述预定数据信号和N个时钟周期的时钟控制信号CLK，并在完成第N个时钟周期的时钟控制信号的接收时，第二数据驱动芯片SD2控制自己连接的第一信号线L21上的第一传输门TG21截止，并将控制信号P2输出到未接收到预定数据信号的第三数据驱动芯片(未示出)；第三数据驱动芯片控制自己连接的第一信号线(未示出)上的第一传输门(未示出)导通。应当理解，每个数据驱动芯片同时接收预定数据信号和时钟控制信号。
依次如此进行，直至最后一个数据驱动芯片SDi接收到预定数据信号和时钟控制信号，进而实现分时逐个开启数据驱动芯片，以显著提高数据驱动芯片接收信号的质量，且有效避免信号接收错误。
采用上述根据本发明实施例的液晶显示面板的数据驱动系统，通过传输门的导通和截止控制时序控制芯片提供的信号是否向数据驱动芯片传输，进而实现分时开启多个数据驱动芯片，使时序控制芯片提供的信号依次在数据驱动芯片中传递，避免由于时序控制芯片提供的数据信号流向多个数据驱动芯片而导致的每个数据驱动芯片接收到的数据信号的电流减小、转换后的电压降低的问题，显著提高数据驱动芯片接收信号的质量，且有效避免信号接收错误。
上面已经结合具体实施例描述了本发明，但是本发明的实施不限于此。在本发明的精神和范围内，本领域技术人员可以进行各种修改和变型，这些修改和变型将落入权利要求限定的保护范围之内。

Claims (11)

1.一种液晶显示面板的数据驱动系统，其特征在于，包括：
时序控制芯片；
多个数据驱动芯片；
多个第一信号线，用于将预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片，其中，每个第一信号线设置在所述时序控制芯片与一个数据驱动芯片之间，以用于将所述预定数据信号从所述时序控制芯片传输至所述一个数据驱动芯片；
多个第一传输门，其中，每个第一传输门设置在一个第一信号线上。
2.如权利要求1所述的液晶显示面板的数据驱动系统，其特征在于，在将所述预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片的过程中，所述多个第一传输门不同时导通。
3.如权利要求2所述的液晶显示面板的数据驱动系统，其特征在于，在将所述预定数据信号从所述时序控制芯片传输至所述多个数据驱动芯片的过程中，所述多个第一传输门依次导通，并且在每个第一传输门导通时，其他第一传输门截止。
4.如权利要求3所述的液晶显示面板的数据驱动系统，其特征在于，所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第一信号线上的第一传输门导通，从而接收所述预定数据信号。
5.如权利要求1-3中的任意一项所述的液晶显示面板的数据驱动系统，其特征在于，接收到预定数据信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止，并将控制信号输出到未接收到预定数据信号的数据驱动芯片中的一个或多个数据驱动芯片，
接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。
6.如权利要求5所述的液晶显示面板的数据驱动系统，其特征在于，所述数据驱动系统还包括：
多个第二信号线，用于将时钟控制信号从所述时序控制芯片传输至所述多个数据驱动芯片，其中，每个第二信号线设置在所述时序控制芯片与一个数据驱动芯片之间，以用于将所述时钟控制信号传输至所述一个数据驱动芯片；
多个第二传输门，其中，每个第二传输门设置在一个第二信号线上。
7.如权利要求6所述的液晶显示面板的数据驱动系统，其特征在于，连接到任意一个数据驱动芯片的第一信号线上的第一传输门与连接到所述任意一个数据驱动芯片的第二信号线上的第二传输门同时导通或截止。
8.如权利要求7所述的液晶显示面板的数据驱动系统，其特征在于，每当一个数据驱动芯片在完成第N个时钟周期的时钟控制信号的接收时，控制自己连接的第一信号线上的第一传输门截止，其中，N为大于0的整数。
9.如权利要求8所述的液晶显示面板的数据驱动系统，其特征在于，接收到时钟控制信号的数据驱动芯片在完成第M个时钟周期的时钟控制信号的接收时，将控制信号输出到未接收到时钟控制信号的数据驱动芯片中的一个或多个数据驱动芯片，其中，M为小于N的正整数，
接收到控制信号的数据驱动芯片控制自己连接的第二信号线上的第二传输门延迟N-M个时钟周期导通，从而当接收到时钟控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门截止时，接收到控制信号的数据驱动芯片控制自己连接的第一信号线上的第一传输门导通。
10.如权利要求9所述的液晶显示面板的数据驱动系统，其特征在于，所述多个数据驱动芯片中的一个数据驱动芯片响应于接收到预定信号，控制自己连接的第二信号线上的第二传输门导通。
11.如权利要求6所述的液晶显示面板的数据驱动系统，其特征在于，所述时钟控制信号和所述预定数据信号分别以差分信号的方式来传输。
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