CN103531169A - 一种显示驱动电路及其驱动方法、显示装置 - Google Patents
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Abstract
本发明实施例提供一种显示驱动电路及其驱动方法、显示装置,涉及显示技术领域,可以消除显示驱动信号的延时误差,避免显示图像失真现象的产生。该显示驱动电路包括时序控制单元以及与时序控制单元相连接的至少一个信号驱动单元。其中,该时序控制单元包括接收模块、处理模块以及发送模块。接收模块接收信号驱动单元向时序控制单元输入的反馈信号,处理模块根据反馈信号经过对比每一个信号驱动单元的信号延时时间得到最大延时时间,发送模块根据最大延时时间向信号驱动单元发送第二时钟信号,以使得每一个信号驱动单元同时接收到第二时钟信号。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种显示驱动电路及其驱动方法、显示装置。
背景技术
TFT-LCD(Thin Film Transistor Liquid Crystal Display,薄膜晶体管-液晶显示器)作为一种平板显示装置,因其具有体积小、功耗低、无辐射以及制作成本相对较低等特点,而越来越多地被应用于高性能显示领域当中。
现有技术中,液晶显示器的结构如图1所示,包括:显示面板100以及驱动单元。其中该驱动单元又包括:数据驱动电路110、栅极驱动电路120以及时序控制器130。时序控制器130向数据驱动电路110输入时钟信号,该数据驱动电路110将时钟信号及显示数据转换成模拟信号(D1、D2…Dn),再输入到显示面板100的数据线上,栅级驱动电路120则可以将由时序控制器130输入的时钟信号转换成用于控制显示面板100中的像素开启/关断的电压信号(G1、G2…Gm),并逐行施加到显示面板100的栅级线上。液晶显示器在进行显示时,以时钟信号为基准,栅线输入控制信号逐行打开像素,显示面板100通过数据线上的数据信号进行显示。
目前,可以通过接口技术将显示面板和驱动单元相连接。现有的接口技术包括Mini-LVDS(Mini-low Voltage Differential Signaling,微型低压差分信号)接口技术以及P2P(Point To Point,点对点)接口技术。
然而随着显示技术的急速发展,为了进一步提高显示器的显示效果,显示面板的尺寸也越来越大,这样一来,对于显示面板上的驱动单元而言,存在这样的问题,如图2所示,以Mini-LVDS接口技术为例,显示面板上驱动单元的各个列驱动器(Source Driver IC,简称S-IC)到TCON10(Time Controller,时序控制器)的距离差异很大,离TCON10较近的S-IC会先接收到TCON10发出的时钟信号CLK,因此该TCON10发出的时钟信号CLK到达每个S-IC的时间不同。例如,如图2所示,S-IC2到TCON10的距离相对于S-IC1到TCON10的距离近,所以如图3所示,例如在T1阶段,到达S-IC1的时钟信号CLK1相对到达S-IC2的时钟信号CLK2有所延时。这样一来,会导致S-IC2输出的数据信号D2与S-IC1输出的数据信号D1会出现延时误差。同理,在T2阶段,到达S-ICn的时钟信号CLKn相对到达S-ICn-1的始终信号CLKn-1也会有所延时,这样一来,会导致S-ICn输出的数据信号Dn与S-ICn-1输出的数据信号Dn-1会出现延时误差。因此,由于每个S-IC到TCON10的距离不一样,接收到的时钟信号CLK的延时也不一样,从而导致列驱动器输出的数据信号出现延时误差,使得显示图像出现失真等不良显示现象,严重影响了显示器的显示效果,降低产品质量。
发明内容
本发明的实施例提供一种显示驱动电路及其驱动方法、显示装置,可以消除显示驱动信号的延时误差,避免显示图像失真现象的产生。
为达到上述目的,本发明的实施例采用如下技术方案:
本发明实施例的一方面提供一种显示驱动电路,包括:时序控制单元以及与所述时序控制单元相连接的至少一个信号驱动单元,所述时序控制单元包括:
接收模块,所述接收模块连接所述信号驱动单元,用于在所述信号驱动单元接收到第一时钟信号后,接收所述信号驱动单元向所述时序控制单元输入的反馈信号;
处理模块,用于根据所述反馈信号得出所述信号驱动单元的信号延时时间;根据每一个所述信号驱动单元的信号延时时间得到最大延时时间;
发送模块,用于根据所述最大延时时间向所述信号驱动单元发送第二时钟信号,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
本发明实施例的另一方面提供一种显示装置,包括如上所述的显示驱动电路。
本发明实施例的又一方面提供一种显示驱动电路的驱动方法,所述显示驱动电路包括:时序控制单元以及与所述时序控制单元相连接的至少一个信号驱动单元,所述方法包括:
在所述信号驱动单元接收到第一时钟信号后,接收所述信号驱动单元向所述时序控制单元输入的反馈信号;
根据所述反馈信号得出所述信号驱动单元的信号延时时间,根据每一个所述信号驱动单元的信号延时时间得到最大延时时间;
根据所述最大延时时间向所述信号驱动单元发送第二时钟信号,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
本发明实施例提供一种显示驱动电路及其驱动方法、显示装置,该显示驱动电路包括时序控制单元以及与时序控制单元相连接的至少一个信号驱动单元。其中,该时序控制单元包括接收模块、处理模块以及发送模块。这样一来,通过接收模块接收信号驱动单元向时序控制单元输入的反馈信号;再通过处理模块根据反馈信号经过对比每一个信号驱动单元的信号延时时间得到最大延时时间,最后通过发送模块根据最大延时时间向信号驱动单元发送第二时钟信号,以使得每一个信号驱动单元同时接收到第二时钟信号。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为现有技术提供的一种液晶显示器的结构示意图;
图2为现有技术提供的一种接口结构示意图;
图3为现有技术提供的一种显示驱动电路的时序控制图;
图4为本发明实施实例提供的一种显示驱动电路的结构示意图;
图5为本发明实施实例提供的另一种显示驱动电路的结构示意图;
图6为本发明实施实例提供的另一种显示驱动电路的结构示意图;
图7为本发明实施实例提供的又一种显示驱动电路的结构示意图;
图8为本发明实施例提供的一种显示驱动电路驱动方法流程图。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
本发明实施例提供一种显示驱动电路,如图4所示,可以包括:时序控制单元20以及与时序控制单元20相连接的至少一个信号驱动单元30,时序控制单元20可以包括:
接收模块201,接收模块201连接信号驱动单元30,用于在信号驱动单元30接收到第一时钟信号CLK1后,接收信号驱动单元30向时序控制单元20输入的反馈信号FB。
处理模块202,用于根据反馈信号FB得出信号驱动单元30的信号延时时间T;根据每一个信号驱动单元30的信号延时时间T得到最大延时时间Tmax。
发送模块203,用于根据最大延时时间Tmax向信号驱动单元30发送第二时钟信号CLK2,以使得每一个信号驱动单元30同时接收到第二时钟信号CLK2。
需要说明的是,处理模块201根据每一个信号驱动单元30的信号延时时间T得到最大延时时间Tmax具体可以是:
处理模块201可以将每一个信号驱动单元30的信号延时时间T依次与预设定的基准时间Tn进行对比,得出最大延时时间Tmax。其中该预设定的基准时间Tn可以是时序控制单元20向所有信号驱动单元30发送第一时钟信号CLK1的时间。
或者,
处理模块201将任意两个信号驱动单元30的信号延时时间T进行对比,得出较大的延时时间,然后将该较大的延时时间再与其它未经对比信号驱动单元30的信号延时时间T进行对比,重复上述步骤直至将所有的信号驱动单元30的信号延时时间T都进行了对比,从而得出最大延时时间。具体的可以以图5为例采用P2P接口技术为例进行说明,时序控制单元20分别与第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304相连接。各个信号驱动单元到时序控制单元20的距离由近到远依次为:第二信号驱动单元302、第三信号驱动单元303、第一信号驱动单元301、第四信号驱动单元304。因此,各个信号驱动单元接收时序控制单元20向其输入信号的延时时间从小到大依次为第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3、第一信号驱动单元301延时时间T1、第四信号驱动单元304延时时间T4。
时序控制单元20中的处理模块201可以先将第一信号驱动单元301的信号延时时间T1与第二信号驱动单元302的信号延时时间T2进行对比,得出第一信号驱动单元301的信号延时时间T1较大,然后将该第一信号驱动单元301的信号延时时间T1再与第三信号驱动单元303的信号延时时间T3进行对比,得出第一信号驱动单元301的信号延时时间T1较大,最后将第一信号驱动单元301的信号延时时间T1与第四信号驱动单元304的信号延时时间T4进行对比,得出最大延时时间Tmax为第四信号驱动单元304的信号延时时间T4。
需要说明的是,该最大延时时间Tmax也可以是人为设定的数值,该数值大于所有信号驱动单元30的信号延时时间T。当然以上仅仅是对得出最大延时时间Tmax方案的举例说明,其它能够得出最大延时时间Tmax的方案在此不再一一举例,但都应当落入本发明的保护范围。
本发明实施例提供一种显示驱动电路,该显示驱动电路包括时序控制单元以及与时序控制单元相连接的至少一个信号驱动单元。其中,该时序控制单元包括接收模块、处理模块以及发送模块。这样一来,通过接收模块接收信号驱动单元向时序控制单元输入的反馈信号;再通过处理模块根据反馈信号经过对比每一个信号驱动单元的信号延时时间得到最大延时时间,最后通过发送模块根据最大延时时间向信号驱动单元发送第二时钟信号,以使得每一个信号驱动单元同时接收到第二时钟信号。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
进一步地,在信号驱动单元30接收到第一时钟信号CLK1后,
接收模块201用于接收信号驱动单元30向时序控制单元20输入的第一时钟信号CLK1。即信号驱动单元30接收到第一时钟信号CLK1后又将该第一时钟信号CLK1作为反馈信号FB反馈给接收模块201。这样一来,可以无需使得信号驱动单元30再向时序控制单元20输入用于反馈该信号驱动单元30接受第一时钟信号CLK1延时时间信息的信号。从而简化该显示驱动电路的结构和控制方法。
或者,
接收模块201用于接收记录信号驱动单元30接收到第一时钟信号CLK1的接收时刻。即信号驱动单元30接收到第一时钟信号CLK1后将记录该信号驱动单元30接收到第一时钟信号CLK1的接收时刻作为反馈信号FB反馈给接收模块201。这样一来,时序控制单元20直接可以得到该第一时钟信号CLK1被信号驱动单元30接收的时刻,然后处理单元202可以直接将每个信号驱动单元30接收到第一时钟信号CLK1的时刻进行对比分析得出最大延时时间Tmax。
进一步地,接收模块201可以包括:
一个信号输入端,该信号输入端连接每一个信号驱动单元。如图5所示,该信号输入端可以是位于时序控制单元20的时序控制芯片上的反馈引脚204。图中第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304的反馈信号FB通过一个反馈引脚204反馈至时序控制单元20。这样一来,可以通过减少反馈引脚的数量,从而简化显示驱动电路的结构,降低生产成本。
具体的,当接收模块201包括一个信号输入端时,即如图5所示,第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304的反馈信号FB通过一个反馈引脚204反馈至时序控制单元20。接收模块201可以分时段接收每一个信号驱动单元向时序控制单元20输入的反馈信号FB。例如,接收模块201在第一时刻接收第一信号驱动单元301通过该反馈引脚204向时序控制单元20输入的反馈信号FB1,在第二时刻接收第二信号驱动单元302通过该反馈引脚204向时序控制单元20输入的反馈信号FB2,在第三时刻接收第三信号驱动单元303通过该反馈引脚204向时序控制单元20输入的反馈信号FB3,在第四时刻接收第四信号驱动单元304通过该反馈引脚204向时序控制单元20输入的反馈信号FB4。
或者,接收模块201可以包括:
多个信号输入端,一个信号输入端对应连接一个信号驱动单元。如图6所示以采用Mini-LVDS接口技术为例进行说明,该信号输入端可以是位于时序控制单元20的时序控制芯片上的反馈引脚204。每个信号驱动单元对应一个反馈引脚204,如图中第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304的反馈信号FB分别通过四个反馈引脚204反馈至时序控制单元20。这样一来,接收模块201可以通过各个反馈引脚204接收与之对应的信号驱动单元向时序控制单元20输入的反馈信号FB。
进一步地,发送模块203包括延时处理子模块,用于当信号驱动单元30的信号延时时间T小于最大延时时间Tmax时,将向信号驱动单元30发送的第二时钟信号CLK2延时至最大延时时间Tmax后再发送,以使得每一个信号驱动单元30同时接收到第二时钟信号CLK2。
具体的如图5所示,由于各个信号驱动单元到时序控制单元20的距离由近到远依次为:第二信号驱动单元302、第三信号驱动单元303、第一信号驱动单元301、第四信号驱动单元304。时序控制单元20在基准时间Tn内向各个信号驱动单元发出第一时钟信号CLK1。因此,与该基准时间Tn相比较各个信号驱动单元接收第一时钟信号CLK1的延时时间从小到大依次为第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3、第一信号驱动单元301延时时间T1、第四信号驱动单元304延时时间T4。则该最大延时时间Tmax为第四信号驱动单元304延时时间T4。这时第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3以及第一信号驱动单元301延时时间T1均小于最大延时时间Tmax。所以,发送模块203向第二信号驱动单元302发送的第二时钟信号CLK2延时至最大延时时间Tmax后再发送,即发送模块203在延长时间差T4-T2后向第二信号驱动单元302发送第二时钟信号CLK2;同理,发送模块203在延长时间差T4-T3后向第三信号驱动单元303发送第二时钟信号CLK2;发送模块203在延长时间差T4-T1向第一信号驱动单元301发送第二时钟信号CLK2,而发送模块203无需延时直接向第四信号驱动单元304发送第二时钟信号CLK2。这样一来,可以使得第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304同时接收到发送模块203发送的第二时钟信号CLK2。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
进一步地,信号驱动单元30可以包括:
列驱动器(Source Driver IC,简称S-IC),与数据线相连接,用于驱动所述数据线;和/或,
行驱动器,与栅线相连接,用于驱动所述栅线。
需要说明的是,液晶显示器一般可以由显示面板和通过接口技术与该显示面板相连接的驱动显示电路构成。而显示面板由阵列基板和彩膜基板构成,在阵列基板和彩膜基板中充入液晶。该阵列基板包括横纵交叉的栅线和数据线,以及由栅线和数据线交叉界定的多个呈矩阵形式排列的像素单元。液晶显示器在进行显示时,以时序控制单元20输入的时钟信号为基准,行驱动器驱动栅线输入控制信号逐行打开像素,列驱动器驱动数据线输入数据信号使得显示面板进行显示。
本发明实施例提供的信号驱动单元30可以包括列驱动器和/或,行驱动器。这样一来,可以使得该列驱动器和行驱动器同时接收到由时序控制单元20输入的时钟信号,从而可以同步列驱动器向数据线输入的数据信号和行驱动器向栅线输入的控制信号,进而消除各个显示驱动信号之间的延时误差,避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
具体的,如图7所示,以Mini-LVDS接口为例,时序控制单元20的接收模块201可以在只有一个反馈引脚204的前提下对各个列驱动器S-IC1…S-ICn的反馈信号FB进行分时接收处理。从而可以在实现接收反馈信号的同时,减少物理引脚,简化电路结构。这里仅仅是以列驱动器的电路结构为例进行举例说明,其它以行驱动器为例的电路结构在这里不再一一赘述,但都应当属于本发明的保护范围。
本发明实施例提供一种显示装置,包括上所述的任意一种显示驱动电路。所述显示装置可以为:液晶面板、电子纸、OLED面板、液晶电视、液晶显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件。具有与本发明前述实施例提供的显示驱动电路相同的有益效果,由于显示驱动电路在前述实施例中已经进行了详细说明,此处不再赘述。
本发明实施例提供一种显示装置,该显示装置包括显示驱动电路,该显示驱动电路包括时序控制单元以及与时序控制单元相连接的至少一个信号驱动单元。其中,该时序控制单元包括接收模块、处理模块以及发送模块。这样一来,通过接收模块接收信号驱动单元向时序控制单元输入的反馈信号;再通过处理模块根据反馈信号经过对比每一个信号驱动单元的信号延时时间得到最大延时时间,最后通过发送模块根据最大延时时间向信号驱动单元发送第二时钟信号,以使得每一个信号驱动单元同时接收到第二时钟信号。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
本发明实施例提供一种显示驱动电路的驱动方法,该显示驱动电路包括:时序控制单元20以及与时序控制单元20相连接的至少一个信号驱动单元30,如图8所示,该驱动方法包括:
S101、接收模块201在信号驱动单元30接收到第一时钟信号CLK1后,接收信号驱动单元30向时序控制单元20输入的反馈信号FB。
S102、处理模块202根据反馈信号FB得出信号驱动单元30的信号延时时间T,根据每一个信号驱动单元30的信号延时时间T得到最大延时时间Tmax。
S103、发送模块203根据最大延时时间Tmax向信号驱动单元30发送第二时钟信号CLK2,以使得每一个信号驱动单元30同时接收到第二时钟信号CLK2。
需要说明的是,处理模块201根据每一个信号驱动单元30的信号延时时间T得到最大延时时间Tmax具体可以是:
处理模块201可以将每一个信号驱动单元30的信号延时时间T依次与预设定的基准时间Tn进行对比,得出最大延时时间Tmax。其中该预设定的基准时间Tn可以是时序控制单元20向所有信号驱动单元30发送第一时钟信号CLK1的时间。
或者,
处理模块201将任意两个信号驱动单元30的信号延时时间T进行对比,得出较大的延时时间,然后将该较大的延时时间再与其它未经对比信号驱动单元30的信号延时时间T都进行对比,重复上述步骤直至将所有的信号驱动单元30的信号延时时间T进行了对比,从而得出最大延时时间。具体的可以以图5为例采用P2P接口技术为例进行说明,时序控制单元20分别与第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304相连接。各个信号驱动单元到时序控制单元20的距离由近到远依次为:第二信号驱动单元302、第三信号驱动单元303、第一信号驱动单元301、第四信号驱动单元304。因此,各个信号驱动单元接收时序控制单元20向其输入信号的延时时间从小到大依次为第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3、第一信号驱动单元301延时时间T1、第四信号驱动单元304延时时间T4。
时序控制单元20中的处理模块201可以先将第一信号驱动单元301的信号延时时间T1与第二信号驱动单元302的信号延时时间T2进行对比,得出第一信号驱动单元301的信号延时时间T1较大,然后将该第一信号驱动单元301的信号延时时间T1再与第三信号驱动单元303的信号延时时间T3进行对比,得出第一信号驱动单元301的信号延时时间T1较大,最后将第一信号驱动单元301的信号延时时间T1与第四信号驱动单元304的信号延时时间T4进行对比,得出最大延时时间Tmax为第四信号驱动单元304的信号延时时间T4。
需要说明的是,该最大延时时间Tmax也可以是人为设定的数值,该数值大于所有信号驱动单元30的信号延时时间T。当然以上仅仅是对得出最大延时时间Tmax方案的举例说明,其它能够得出最大延时时间Tmax的方案在此不再一一举例,但都应当属于本发明的保护范围。
本发明实施例提供一种显示驱动电路的驱动方法,该显示驱动电路包括时序控制单元以及与时序控制单元相连接的至少一个信号驱动单元。其中,该时序控制单元包括接收模块、处理模块以及发送模块。这样一来,通过接收模块接收信号驱动单元向时序控制单元输入的反馈信号;再通过处理模块根据反馈信号经过对比每一个信号驱动单元的信号延时时间得到最大延时时间,最后通过发送模块根据最大延时时间向信号驱动单元发送第二时钟信号,以使得每一个信号驱动单元同时接收到第二时钟信号。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
进一步地,在信号驱动单元30接收到第一时钟信号CLK1后,
将信号驱动单元30向时序控制单元20输入的第一时钟信号CLK1作为反馈信号FB。即信号驱动单元30接收到第一时钟信号CLK1后又将该第一时钟信号CLK1作为反馈信号FB反馈给接收模块201。这样一来,可以无需使得信号驱动单元30再向时序控制单元20输入用于反馈该信号驱动单元30接受第一时钟信号CLK1延时时间信息的信号。从而简化该显示驱动电路的结构和控制方法。
或者,
将记录信号驱动单元30接收到第一时钟信号CLK1的接收时刻作为反馈信号FB。即信号驱动单元30接收到第一时钟信号CLK1后将记录该信号驱动单元30接收到第一时钟信号CLK1的接收时刻作为反馈信号FB反馈给接收模块201。这样一来,时序控制单元20直接可以得到该第一时钟信号CLK1被信号驱动单元30接收的时刻,然后处理单元202可以直接将每个信号驱动单元30接收到第一时钟信号CLK1的时刻进行对比分析得出最大延时时间Tmax。
进一步地,当时序控制单元20通过一个信号输入端连接每一个信号驱动单元30时,每一个信号驱动单元30分时段向时序控制单元20输入反馈信号FB。如图5所示,该信号输入端可以是位于时序控制单元20的时序控制芯片上的反馈引脚204。图中第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304的反馈信号FB通过一个反馈引脚204反馈至时序控制单元20。这样一来,可以通过减少反馈引脚的数量,从而简化显示驱动电路的结构,降低生产成本。具体的,接收模块201可以分时段接收每一个信号驱动单元向时序控制单元20输入的反馈信号FB。例如,接收模块201在第一时刻接收第一信号驱动单元301通过该反馈引脚204向时序控制单元20输入的反馈信号FB1,在第二时刻接收第二信号驱动单元302通过该反馈引脚204向时序控制单元20输入的反馈信号FB2,在第三时刻接收第三信号驱动单元303通过该反馈引脚204向时序控制单元20输入的反馈信号FB3,在第四时刻接收第四信号驱动单元304通过该反馈引脚204向时序控制单元20输入的反馈信号FB4。
进一步地,根据最大延时时间Tmax向信号驱动单元20发送第二时钟信号CLK2具体可以包括:
当信号驱动单元30的信号延时时间T小于最大延时时间Tmax时,发送模块203的延时处理子模块将向信号驱动单元30发送的第二时钟信号CLK2延时至最大延时时间后Tmax再发送,以使得每一个信号驱动单元30同时接收到第二时钟信号CLK2。
具体的如图5所示,由于各个信号驱动单元到时序控制单元20的距离由近到远依次为:第二信号驱动单元302、第三信号驱动单元303、第一信号驱动单元301、第四信号驱动单元304。时序控制单元20在基准时间Tn内向各个信号驱动单元发出第一时钟信号CLK1。因此,与该基准时间Tn相比较各个信号驱动单元接收第一时钟信号CLK1的延时时间从小到大依次为第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3、第一信号驱动单元301延时时间T1、第四信号驱动单元304延时时间T4。则该最大延时时间Tmax为第四信号驱动单元304延时时间T4。这时第二信号驱动单元302延时时间T2、第三信号驱动单元303延时时间T3以及第一信号驱动单元301延时时间T1均小于最大延时时间Tmax。所以,发送模块203向第二信号驱动单元302发送的第二时钟信号CLK2延时至最大延时时间Tmax后再发送,即发送模块203在延长时间差T4-T2后向第二信号驱动单元302发送第二时钟信号CLK2;同理,发送模块203在延长时间差T4-T3后向第三信号驱动单元303发送第二时钟信号CLK2;发送模块203在延长时间差T4-T1向第一信号驱动单元301发送第二时钟信号CLK2,而发送模块203无需延时直接向第四信号驱动单元304发送第二时钟信号CLK2。这样一来,可以使得第一信号驱动单元301、第二信号驱动单元302、第三信号驱动单元303以及第四信号驱动单元304同时接收到发送模块203发送的第二时钟信号CLK2。从而可以同步各个信号驱动单元输出的显示驱动信号,进而避免了显示图像出现失真等不良显示现象,提升显示效果,提高产品质量。
本领域普通技术人员可以理解:实现上述方法实施例的全部或部分步骤可以通过程序指令相关的硬件来完成,前述的程序可以存储于一计算机可读取存储介质中,该程序在执行时,执行包括上述方法实施例的步骤;而前述的存储介质包括:ROM、RAM、磁碟或者光盘等各种可以存储程序代码的介质。
以上所述,仅为本发明的具体实施方式,但本发明的保护范围并不局限于此,任何熟悉本技术领域的技术人员在本发明揭露的技术范围内,可轻易想到变化或替换,都应涵盖在本发明的保护范围之内。因此,本发明的保护范围应以所述权利要求的保护范围为准。
Claims (11)
1.一种显示驱动电路,包括:时序控制单元以及与所述时序控制单元相连接的至少一个信号驱动单元,其特征在于,所述时序控制单元包括:
接收模块,所述接收模块连接所述信号驱动单元,用于在所述信号驱动单元接收到第一时钟信号后,接收所述信号驱动单元向所述时序控制单元输入的反馈信号;
处理模块,用于根据所述反馈信号得出所述信号驱动单元的信号延时时间;根据每一个所述信号驱动单元的信号延时时间得到最大延时时间;
发送模块,用于根据所述最大延时时间向所述信号驱动单元发送第二时钟信号,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
2.根据权利要求1所述的显示驱动电路,其特征在于,所述在所述信号驱动单元接收到第一时钟信号后,
所述接收模块用于接收所述信号驱动单元向所述时序控制单元输入的所述第一时钟信号;或,
所述接收模块用于接收记录所述信号驱动单元接收到所述第一时钟信号的接收时刻。
3.根据权利要求1或2所述的显示驱动电路,其特征在于,所述接收模块包括:
一个信号输入端,所述信号输入端连接每一个所述信号驱动单元;或,
多个信号输入端,其中一个信号输入端对应连接一个所述信号驱动单元。
4.根据权利要求3所述的显示驱动电路,其特征在于,当所述接收模块包括一个信号输入端时,所述接收模块用于分时段接收每一个所述信号驱动单元向所述时序控制单元输入的所述反馈信号。
5.根据权利要求1所述的显示驱动电路,其特征在于,所述发送模块包括延时处理子模块,用于当所述信号驱动单元的信号延时时间小于所述最大延时时间时,将向所述信号驱动单元发送的所述第二时钟信号延时至最大延时时间后再发送,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
6.根据权利要求1所述的显示驱动电路,其特征在于,所述信号驱动单元包括:
列驱动器,与数据线相连接,用于驱动所述数据线;和/或,
行驱动器,与栅线相连接,用于驱动所述栅线。
7.一种显示装置,其特征在于,包括如权利要求1-7任一项所述的显示驱动电路。
8.一种显示驱动电路的驱动方法,所述显示驱动电路包括:时序控制单元以及与所述时序控制单元相连接的至少一个信号驱动单元,其特征在于,所述方法包括:
在所述信号驱动单元接收到第一时钟信号后,接收所述信号驱动单元向所述时序控制单元输入的反馈信号;
根据所述反馈信号得出所述信号驱动单元的信号延时时间,根据每一个所述信号驱动单元的信号延时时间得到最大延时时间;
根据所述最大延时时间向所述信号驱动单元发送第二时钟信号,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
9.根据权利要求8所述的驱动方法,其特征在于,所述在所述信号驱动单元接收到第一时钟信号后,
将所述信号驱动单元向所述时序控制单元输入的所述第一时钟信号作为所述反馈信号;或,
将记录所述信号驱动单元接收到所述第一时钟信号的接收时刻作为所述反馈信号。
10.根据权利要求8所述的驱动方法,其特征在于,当所述时序控制单元通过一个信号输入端连接每一个所述信号驱动单元时,每一个所述信号驱动单元分时段向所述时序控制单元输入所述反馈信号。
11.根据权利要求8所述的驱动方法,其特征在于,所述根据所述最大延时时间向所述信号驱动单元发送第二时钟信号包括:
当所述信号驱动单元的信号延时时间小于所述最大延时时间时,将向所述信号驱动单元发送的所述第二时钟信号延时至最大延时时间后再发送,以使得每一个所述信号驱动单元同时接收到所述第二时钟信号。
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---|---|---|---|
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PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant |