CN104658905A - 一种刻蚀方法及基板 - Google Patents

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Abstract

本发明公开了一种刻蚀方法及基板,其中刻蚀方法包括:湿刻蚀步骤,将涂有光阻层的待刻蚀基板放入刻蚀溶液中,对待刻蚀基板中的金属层进行刻蚀,得到第一基板;反应离子刻蚀步骤,利用反应离子刻蚀工艺对第一基板中的第一绝缘层进行刻蚀,刻蚀后去除光阻层,得到第二绝缘层未被刻蚀的基板。本方法有效避免了因采用ICP刻蚀工艺而对基板造成的过刻蚀,保证了刻蚀后所得到的基板的均匀性和可靠性,使得基板的电器迁移率、电阻和电容等参数都接近于规格值。

Description

一种刻蚀方法及基板
技术领域
本发明涉及半导体技术领域,具体地说,涉及一种刻蚀方法及基板。
背景技术
液晶显示器具有高画质、体积小、重量轻、低电压驱动以及低功率消耗等优点,其现已被广泛地应用于各种IT数码产品中,例如汽车导向系统、工程工作站、监视器、便携式信息终端、电子终端、电子书刊、笔记本计算机以及大型直视式平板电视机等。
作为液晶显示器最为重要的组成部分之一,液晶基板的制作过程可以分为阵列工程、成盒工程和模块工程三个阶段。其中,阵列工程的目的是在玻璃基板上形成TFT回路,该工程又可以分为洗净、成膜、光刻、刻蚀以及检查等步骤。
现有的LTPS工艺中所广泛采用的刻蚀工艺为ICP刻蚀。ICP刻蚀工艺在刻蚀过程中存在十分复杂的化学过程和物理过程。其中化学过程主要包括两部分:其一是刻蚀气体通过电感耦合的方式辉光放电,产生活性游离基、亚稳态粒子、原子,以及这些粒子之间的相互化学作用;其二是刻蚀气体辉光放点所产生的这些活性粒子与基板表面的相互作用。物理过程主要是离子对基板表面的轰击。
ICP刻蚀具有各向异性、刻蚀速率高、工艺可控等优点。然而由于ICP刻蚀的功率密度较大,实际生产过程中ICP刻蚀会造成GI-SiOx的损耗,从而影响基板的均匀性。
发明内容
本发明所要解决的技术问题是为了克服现有的基板刻蚀方法因采用ICP刻蚀工艺而造成的金属氧化硅绝缘层过刻蚀现象。为了解决上述问题,本发明的实施例首先提供了一种刻蚀方法,所述方法包括:
湿刻蚀步骤,将涂有光阻层的待刻蚀基板放入刻蚀溶液中,对所述待刻蚀基板中的金属层进行刻蚀,得到第一基板;
反应离子刻蚀步骤,利用反应离子刻蚀工艺对所述第一基板中的第一绝缘层进行刻蚀,刻蚀后去除所述光阻层,得到第二绝缘层未被刻蚀的基板。
根据本发明的一个实施例,在所述湿刻蚀步骤中,在对所述待刻蚀基板中的金属层进行刻蚀后,还对基板进行漂洗和/或干燥处理。
根据本发明的一个实施例,在所述湿刻蚀步骤中,还对所述刻蚀溶液进行搅拌。
根据本发明的一个实施例,在所述湿刻蚀步骤中,还对所述刻蚀溶液进行脱气处理。
根据本发明的一个实施例,所述刻蚀溶液包括硫酸、硝酸和/或醋酸。
根据本发明的一个实施例,所述刻蚀溶液中,硫酸、硝酸和醋酸的比例为1.8%:67%:17%。
根据本发明的一个实施例,对所述第一基板中的第一绝缘层进行刻蚀时,所利用的刻蚀气体为混合气体,在所述反应离子刻蚀步骤中,通过调整所述刻蚀气体中各种气体成分的比例来调整刻蚀的选择比。
根据本发明的一个实施例,所述刻蚀气体包括氯气和氟化硫。
根据本发明的一个实施例,在所述反应离子刻蚀步骤中,还通过调整刻蚀气体的流量来调整刻蚀速率。
本发明还提供了一种基板,所述基板采用如上任一项所述的刻蚀方法制备得到。
本发明提供的刻蚀方法通过采用湿蚀刻工艺与RIE刻蚀工艺的方式,有效避免了现有刻蚀方法因采用ICP刻蚀工艺而对第二绝缘层(即金属氧化硅绝缘层)造成的过刻蚀,这也就保证了刻蚀后所得到的基板的均匀性和可靠性,使得基板的电子迁移率、电阻和电容等参数都接近于或等于规格值,从而保证了基板的成品率。
此外,相较于现有刻蚀方法所采用的ICP刻蚀设备,本发明采用的湿刻蚀设备和RIE刻蚀设备具有更低的价格。所以利用本方法对基板进行刻蚀还有助于降低基板的生产成本,提高基板的生产效率。
本发明的其它特征和优点将在随后的说明书中阐述,并且,部分地从说明书中变得显而易见,或者通过实施本发明而了解。本发明的目的和其他优点可通过在说明书、权利要求书以及附图中所特别指出的结构来实现和获得。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要的附图做简单的介绍:
图1是ICP刻蚀设备的结构示意图;
图2是利用ICP刻蚀设备对基板进行刻蚀的效果图;
图3a~图3d分别是垂直方向电子迁移率、水平方向电子迁移率、电阻和电容随过刻蚀量变化的箱线图;
图4是根据本发明一个实施例的刻蚀方法的流程图;
图5是根据本发明一个实施例的对基板进行刻蚀的效果图;
图6是根据本发明一个实施例的RIE刻蚀设备的结构示意图。
具体实施方式
以下将结合附图及实施例来详细说明本发明的实施方式,借此对本发明如何应用技术手段来解决技术问题,并达成技术效果的实现过程能充分理解并据以实施。需要说明的是,只要不构成冲突,本发明中的各个实施例以及各实施例中的各个特征可以相互结合,所形成的技术方案均在本发明的保护范围之内。
同时,在以下说明中,出于解释的目的而阐述了许多具体细节,以提供对本发明实施例的彻底理解。然而,对本领域的技术人员来说显而易见的是,本发明可以不用这里的具体细节或者所描述的特定方式来实施。
图1示出了现有的ICP刻蚀设备的结构示意图。如图1所示,ICP刻蚀设备的反应腔101中设置有第一电极102和含有有电感线圈的第二电极104。第一电极102和第二电极104分别与第一射频源U1、第二射频源U2以及相应的匹配网络连接。
在对放置在第一电极102上的基板103进行刻蚀时,刻蚀气体通过进气口106进入反应腔101。第二电极104通过电感耦合的方式使得刻蚀气体辉光放电,产生高密度的等离子气体。等离子气体在第一电极102的作用下对基板103进行刻蚀。
ICP刻蚀过程中存在十分复杂的化学过程和物理过程。其中化学过程主要包括两部分:其一是刻蚀气体通过电感耦合的方式辉光放电,产生活性游离基、亚稳态粒子、原子,以及这些活性粒子之间的相互化学作用;其二是由刻蚀气体辉光放电所产生的这些活性粒子与基板表面的相互作用。物理过程主要是离子对基板表面的轰击。
图2示出了利用ICP刻蚀工艺对基板进行刻蚀的效果图。
本实施例所提供的待刻蚀的基板包括光阻层201、金属层202、第一绝缘层203和第二绝缘层204。其中,第一绝缘层为键能较弱的氮化硅材料,第二绝缘层为键能较强的氧化硅材料。
从图2中可以看出,在对涂有光阻层201的基板进行主刻蚀的过程中,刻蚀气体(由氟化硫气体和氧气组成)中的氧气使得光阻层边缘向中心后退,从而使得相应的金属层裸露出来。此时未被光阻层遮挡的金属层202沿等离子轰击方向被刻蚀掉,同时,未被光阻层201遮挡的第一绝缘层203(即氮化硅材料层)沿等离子轰击方向也被刻蚀掉一部分。
随后在对主刻蚀刻蚀得到的基板进行辅刻蚀的过程中,金属层202在新的刻蚀气体(由氯气和氧气组成)的作用下形成了所需要的梯形结构。但是,由于ICP刻蚀工艺中反应腔内的等离子密度很高,在辅蚀刻的过程中,不仅未被光阻层201遮挡的剩余第一绝缘层203被刻蚀掉,同时未被光阻层201遮挡的第二绝缘层(即氧化硅绝缘层)沿等离子轰击方向也被刻蚀掉一部分,从而造成氧化硅绝缘层的过刻蚀。
然而,如图3a~图3d分别示出的基板的垂直方向电子迁移率、水平方向电子迁移率、电阻和电容随过刻蚀变化的箱线图可以看出,氧化硅绝缘层的过刻蚀会使得所得到的基板的垂直方向电子迁移率、水平方向电子迁移率、电阻和电容都偏离于正常值,从而使得基板的性能降低。
针对现有刻蚀方法因采用ICP刻蚀工艺而引起的上述问题,本实施例提供了一种新的刻蚀方法,图4和图5分别示出了该方法的流程图和效果图。
如图4所示,本实施例所提供的刻蚀方法首先在步骤S401中将涂有光阻层的待刻蚀基板放入刻蚀溶液中,利用刻蚀溶液来刻蚀基板中的金属层。步骤S401的目的是对待刻蚀基板中需要刻蚀掉的金属层进行分解,并转化为可溶的化合物,从而达到去除多余金属的目的。这种刻蚀技术主要是借助刻蚀液与基板的金属层材料的化学反应,因此在刻蚀时也就可以通过刻蚀液的选取、配比以及温度控制来达到合适的刻蚀速率和良好的选择比。
从图5中可以看出,与图2所示的待刻蚀基板类似,本实施例所提供的待刻蚀基板同样包括光阻层201、金属层202、第一绝缘层203和第二绝缘层204。其中,第一绝缘层203为氮化硅材料,第二绝缘层204为氧化硅材料,金属层中的金属为钼。当然,在本发明的其他实施例中,第一绝缘层、第二绝缘层以及金属层的组成材料也可以为其他合理材料,本发明不限于此。
为了达到分解基板中需要刻蚀的金属层的目的,这就要求刻蚀溶液需要能够与金属层反应,但却不能与第一绝缘层的氮化硅材料和第二绝缘层的氧化硅材料反应。因此,本实施例中采用铝酸溶液作为刻蚀溶液,该铝酸溶液由硝酸、硫酸、醋酸以及复合添加剂混合而成。其中,铝酸溶液中硝酸的含量可以为1.5%~2.0%,硫酸的含量可以为65%~70%,醋酸的含量可以为15%~20%。本实施例中,为了达到更高的刻蚀速率和选择比,优选地,铝酸溶液中硝酸、硫酸和醋酸的含量分别为为1.8%、67%、17%。当然,在实际生产过程中,根据不同的而需要,铝酸溶液的比例也可以为其他合理值。
需要说明的是,在本发明的其他实施例中,对于不同的金属层材料,也可以采用其他合理的溶液作为刻蚀液,例如仅由硝酸、硫酸和醋酸中的一项或两项所构成的溶液,本发明不限于此。
为了能够及时、准确地判断出反应结束时间,从而避免对金属层造成过刻蚀,将待刻蚀基板放入刻蚀液来对金属层进行刻蚀的过程中,本实施例所提供的刻蚀方法还在步骤S402中监测是否完成对金属层的刻蚀。如果完成对金属层的刻蚀,则在步骤S403中对刻蚀后的基板进行漂洗;否则继续对金属层进行刻蚀。
本实施例中,采用有机系剥离液来对基板进行漂洗。当然,在本发明的其他实施例中,还可以采用其他合理方式来对基板进行漂洗,例如采用含有有机物的水系剥离液来对基板进行漂洗等,本发明不限于此。
刻蚀溶液的浓度越高或反应温度越高,那么对金属层的刻蚀速率也就越快。而金属层与刻蚀溶液的化学反应是一个放热反应,这也就会造成在进行湿刻蚀的过程中,刻蚀溶液中靠近金属层位置处的温度要明显高于其他位置的温度。而刻蚀溶液温度分布的不均匀性会导致无法准确控制湿刻蚀的反应温度,从而造成金属层的过刻蚀或刻蚀不够的现象。
为了解决这一问题,本实施例所提供的刻蚀方法在对金属层进行湿刻蚀的过程中,还通过搅刻蚀拌溶液的方式来确保刻蚀溶液温度分布的均匀性,从而消除了因刻蚀溶液温度分布不均匀而给反应控制所造成的不利影响。
此外,一些金属与刻蚀溶液的反应还会产生气体,从而在刻蚀溶液中形成气泡。而刻蚀溶液中的气泡则可能造成部分金属层与刻蚀溶液相隔绝,从而使得刻蚀溶液与金属层的化学反应停止。
为了解决这一问题,本实施例所提供的刻蚀方法在刻蚀的过程中还会对刻蚀溶液进行去泡、脱气处理,从而去除刻蚀溶液中的气泡,使得刻蚀溶液与金属层相应面充分接触。具体地,本实施例利用超声波来对刻蚀溶液进行去泡、脱气处理。当然,在本发明的其他实施例中,也可以采用其他合理方式来对刻蚀溶液进行脱气处理,本发明不限于此。
在步骤S404中,对漂洗完后的基板进行干燥,从而得到第一基板。图5示出了本实施例中经过湿刻蚀所得到的基板(即第一基板)的示意图。从图中可以看出,本实施例所提供的刻蚀方法对涂有光阻层的待刻蚀基板进行湿刻蚀后,所得到的第一基板中金属层形成了所需要的梯形结构,达到了对金属层的刻蚀要求,而第一绝缘层和第二绝缘层则完好地保存了下来。
如图4所示,完成对金属层的刻蚀后,本实施例所提供的刻蚀方法在步骤S405中利用反应离子刻蚀(Reactive Ion Etching,简称为RIE)工艺来对基板中的第一绝缘层进行刻蚀,从而达到去除未被光阻层遮挡的第一绝缘层的目的。在可利用RIE刻蚀工艺对基板进行刻蚀的过程中,还在步骤S406中监测第一绝缘层是否刻蚀完成。如果第一绝缘层刻蚀完成,则在步骤S407中去除光阻层,从而得到所需要的基板;否则继续对基板的第一绝缘层进行刻蚀。
RIE工艺是一种物理作用和化学作用共存的刻蚀工艺,图6示出了RIE设备的结构示意图。如图6所示,RIE设备包括反应腔601、电极602、极板604、射频源U3和匹配网络605。在刻蚀的过程中,刻蚀气体由反应腔601上的进气口606进入反应腔601。由射频源U3供能的磁场使得反应腔601内的刻蚀气体辉光放电,刻蚀气体被击穿从而产生等离子体。该等离子体中包含离子、游离基和自由电子,这些粒子可与刻蚀样品表面发生化学反应。同时离子在电场的作用下射向放置在电极602上的基板603,并对基板603表面进行物理轰击。刻蚀产生的气体由出气口607排出反应腔601.
相较于ICP刻蚀设备,RIE刻蚀设备减少了一个射频源,这也就使得RIE刻蚀设备的反应腔内等离子的密度要比ICP刻蚀设备的反应腔内等离子的密度低很多,刻蚀气体辉光放电所产生的等离子种类也要少很多。这也就导致采用RIE刻蚀工艺对基板的第一绝缘层和第二绝缘层进行刻蚀时,所产生的等离子只能将键能较小的第一绝缘层材料(例如氮化硅)刻蚀掉,而无法将键能较大的第二绝缘层材料(例如氧化硅)刻蚀掉。
本实施例中,通过调整刻蚀气体中各种气体的比例以及流量来调整刻蚀选择比。选择比是RIE刻蚀工艺的重要参数,是指被刻蚀材料的刻蚀速率与其他不希望被刻蚀的材料的刻蚀速率的比值。近年来,随着光刻技术的飞速发展,所制作的线条也越来越细。为了获得较高的图像分辨率,抗蚀剂涂层(即光阻层)越薄越好,这也就使得对选择比的要求越来越高。要获取满意的选择比,主要在于气体放电时应能产生合适的化学活性物质。所以本实施例中通过调整调整刻蚀气体中各种气体成分的浓度来调整选择比。当然,在本发明的其他实施例中,也可以采用其他合理方式来获取满意的选择比,例如引入新的催化气体(例如氧气)等,本发明不限于此。
此外,反应离子的刻蚀速率与刻蚀气体的流量有着明显关系。随着刻蚀气体流量的增加,刻蚀速率先是上升,达到最大值后,在较大的气体流量下刻蚀速率反而略有下降。因为在低流量情况下,刻蚀速率主要受到活性物质供应不足的限制,而在高流量情况下则主要受活性物质被抽走的影响。所以本实施例所提供的刻蚀方法还通过控制刻蚀气体的流量来控制刻蚀速率。
需要说明的是,在本发明的其他实施例中,也可以采用其他合理的方式来控制刻蚀速率,例如通过调整射频功率等,本发明不限于此。
本实施例中,所采用的刻蚀气体包括氯气和氟化硫气体。当然,在本发明的其他实施例中,也可以采用其他合理的气体(例如由氟化硫和氧气混合而成的气体等)来作为刻蚀气体,本发明不限于此。
本实施例还提供了一种采用如上所述刻蚀方法制备得到的基板,该基板的第二绝缘层未被刻蚀。
如图5所示的RIE刻蚀结果示意图可以看出,本实施例所提供的刻蚀方法通过采用RIE刻蚀工艺,有效避免了因采用ICP刻蚀工艺而对第二绝缘层造成的刻蚀(即过刻蚀)现象,也就保证了刻蚀后所得到的基板的均匀性和可靠性,使得基板的电器迁移率、电阻和电容等参数都接近于规格值,从而保证了基板的成品率。
此外,相较于现有刻蚀方法所采用的ICP刻蚀设备,本实施例采用的湿刻蚀设备和RIE刻蚀设备具有更低的价格,所以利用本方法对基板进行刻蚀还有助于降低基板的生产成本,提高基板的生产效率。
应该理解的是,本发明所公开的实施例不限于这里所公开的特定结构、处理步骤或材料,而应当延伸到相关领域的普通技术人员所理解的这些特征的等同替代。还应当理解的是,在此使用的术语仅用于描述特定实施例的目的,而并不意味着限制。
说明书中提到的“一个实施例”或“实施例”意指结合实施例描述的特定特征、结构或特性包括在本发明的至少一个实施例中。因此,说明书通篇各个地方出现的短语“一个实施例”或“实施例”并不一定均指同一个实施例。
为了方便,在此使用的多个项目、结构单元、组成单元和/或材料可出现在共同列表中。然而,这些列表应解释为该列表中的每个元素分别识别为单独唯一的成员。因此,在没有反面说明的情况下,该列表中没有一个成员可仅基于它们出现在共同列表中便被解释为相同列表的任何其它成员的实际等同物。另外,在此还可以连同针对各元件的替代一起来参照本发明的各种实施例和示例。应当理解的是,这些实施例、示例和替代并不解释为彼此的等同物,而被认为是本发明的单独自主的代表。
此外,所描述的特征、结构或特性可以任何其他合适的方式结合到一个或多个实施例中。在上面的描述中,提供一些具体的细节,例如长度、宽度、形状等,以提供对本发明的实施例的全面理解。然而,相关领域的技术人员将明白,本发明无需上述一个或多个具体的细节便可实现,或者也可采用其它方法、组件、材料等实现。在其它示例中,周知的结构、材料或操作并未详细示出或描述以免模糊本发明的各个方面。
虽然上述示例用于说明本发明在一个或多个应用中的原理,但对于本领域的技术人员来说,在不背离本发明的原理和思想的情况下,明显可以在形式上、用法及实施的细节上作各种修改而不用付出创造性劳动。因此,本发明由所附的权利要求书来限定。

Claims (10)

1.一种刻蚀方法,其特征在于,所述方法包括:
湿刻蚀步骤,将涂有光阻层的待刻蚀基板放入刻蚀溶液中,对所述待刻蚀基板中的金属层进行刻蚀,得到第一基板;
反应离子刻蚀步骤,利用反应离子刻蚀工艺对所述第一基板中的第一绝缘层进行刻蚀,刻蚀后去除所述光阻层,得到第二绝缘层未被刻蚀的基板。
2.如权利要求1所述的方法,其特征在于,在所述湿刻蚀步骤中,在对所述待刻蚀基板中的金属层进行刻蚀后,还对基板进行漂洗和/或干燥处理。
3.如权利要求1所述的方法,其特征在于,在所述湿刻蚀步骤中,还对所述刻蚀溶液进行搅拌。
4.如权利要求1~3中任一项所述的方法,其特征在于,在所述湿刻蚀步骤中,还对所述刻蚀溶液进行脱气处理。
5.如权利要求1所述的方法,其特征在于,所述刻蚀溶液包括硫酸、硝酸和/或醋酸。
6.如权利要求5所述的方法,其特征在于,所述刻蚀溶液中,硫酸、硝酸和醋酸的比例为1.8%:67%:17%。
7.如权利要求1所述的方法,其特征在于,对所述第一基板中的第一绝缘层进行刻蚀时,所利用的刻蚀气体为混合气体,在所述反应离子刻蚀步骤中,通过调整所述刻蚀气体中各种气体成分的比例来调整刻蚀的选择比。
8.如权利要求7所述的方法,其特征在于,所述刻蚀气体包括氯气和氟化硫。
9.如权利要求1所述的方法,其特征在于,在所述反应离子刻蚀步骤中,还通过调整刻蚀气体的流量来调整刻蚀速率。
10.一种基板,其特征在于,所述基板采用如权利要求1~9中任一项所述的刻蚀方法制备得到。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN107833827A (zh) * 2017-10-25 2018-03-23 武汉华星光电技术有限公司 一种阵列基板的刻蚀方法
WO2020042230A1 (zh) * 2018-08-31 2020-03-05 深圳市华星光电技术有限公司 一种高寿命铜钼蚀刻液及蚀刻方法

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111285362A (zh) * 2018-12-06 2020-06-16 清华大学 石墨烯胶膜的制备方法以及石墨烯的转移方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1270415A (zh) * 1998-09-15 2000-10-18 西门子公司 用于减少金属线刻蚀后腐蚀的敷金属层刻蚀技术
CN1553517A (zh) * 2003-05-29 2004-12-08 统宝光电股份有限公司 薄膜晶体管及其制造方法
US20050101062A1 (en) * 2003-11-12 2005-05-12 Chun-Gi You Thin film transistor array panel and manufacturing method thereof
KR100670039B1 (ko) * 1998-03-31 2007-07-09 삼성전자주식회사 엘디디 영역을 가지는 다결정 규소 박막 트랜지스터의 제조 방법

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3474604B2 (ja) * 1993-05-25 2003-12-08 三菱電機株式会社 薄膜トランジスタおよびその製法
JP2004137519A (ja) * 2002-10-15 2004-05-13 Nagase & Co Ltd エッチング液管理方法およびエッチング液管理装置
KR101687311B1 (ko) * 2009-10-07 2016-12-16 삼성디스플레이 주식회사 표시 장치 및 이의 제조 방법

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100670039B1 (ko) * 1998-03-31 2007-07-09 삼성전자주식회사 엘디디 영역을 가지는 다결정 규소 박막 트랜지스터의 제조 방법
CN1270415A (zh) * 1998-09-15 2000-10-18 西门子公司 用于减少金属线刻蚀后腐蚀的敷金属层刻蚀技术
CN1553517A (zh) * 2003-05-29 2004-12-08 统宝光电股份有限公司 薄膜晶体管及其制造方法
US20050101062A1 (en) * 2003-11-12 2005-05-12 Chun-Gi You Thin film transistor array panel and manufacturing method thereof

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN107833827A (zh) * 2017-10-25 2018-03-23 武汉华星光电技术有限公司 一种阵列基板的刻蚀方法
CN107833827B (zh) * 2017-10-25 2020-07-31 武汉华星光电技术有限公司 一种阵列基板的刻蚀方法
WO2020042230A1 (zh) * 2018-08-31 2020-03-05 深圳市华星光电技术有限公司 一种高寿命铜钼蚀刻液及蚀刻方法

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