CN103489761A - 一种肖特基芯片专用外延片的生长方法 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 16
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims abstract description 16
- 229910052710 silicon Inorganic materials 0.000 claims abstract description 16
- 239000010703 silicon Substances 0.000 claims abstract description 16
- 230000007704 transition Effects 0.000 claims abstract description 5
- 230000008021 deposition Effects 0.000 claims description 4
- 230000001105 regulatory effect Effects 0.000 claims description 4
- 230000001276 controlling effect Effects 0.000 claims description 2
- 238000007781 pre-processing Methods 0.000 abstract 1
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000007812 deficiency Effects 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000005303 weighing Methods 0.000 description 1
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/22—Diffusion of impurity materials, e.g. doping materials, electrode materials, into or out of a semiconductor body, or between semiconductor regions; Interactions between two or more impurities; Redistribution of impurities
- H01L21/2205—Diffusion of impurity materials, e.g. doping materials, electrode materials, into or out of a semiconductor body, or between semiconductor regions; Interactions between two or more impurities; Redistribution of impurities from the substrate during epitaxy, e.g. autodoping; Preventing or using autodoping
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Abstract
本发明公开了一种肖特基芯片专用的外延片生长方法,包括如下步骤:在高温环境下,先采用H2+HCL对硅片进行预处理;然后在硅片表面淀积一定厚度的不掺杂的纯硅;接着,按照一定的比例调整掺杂量,使得外延片的过渡层的电阻率呈线性变化,并且具有一定的斜率。本发明的肖特基芯片专用的外延片生长方法制造的外延片来生产肖特基芯片,可以使得芯片的正向(Vf)参数及抗ESD能力都非常优良。
Description
技术领域
本发明涉及半导体技术领域,特别是涉及一种肖特基芯片专用外延片生长方法。
背景技术
目前市场对肖特基芯片的正向压降(Vf)及抗ESD能力的要求越来越高,已经成为衡量芯片性能优劣的两项非常重要的指标。但是目前采用常规外延片生产加工的肖特基芯片难以做到正向(Vf)参数及抗ESD能力都兼顾。而在高端市场中对肖特基芯片的正向(Vf)参数及抗ESD能力都有相当严格的要求,因此常规的肖特基芯片在高端市场中的应用将会受到较大的影响。
发明内容
为了克服上述现有技术的不足,本发明提供了一种肖特基芯片专用的外延片生长方法,包括如下步骤:在高温环境下,先采用H2+HCL对硅片进行预处理;然后在硅片表面淀积一定厚度的不掺杂的纯硅;接着,按照一定的比例调整掺杂量,使得外延片的过渡层的电阻率呈线性变化,并且具有一定的斜率。
进一步的,通过调节掺杂量及硅沉积速率来控制电阻率曲线的斜率。
进一步的,所述线性变化为线性增大。
进一步的,达到外延片需要的电阻率值后,再进行稳定浓度的掺杂。
进一步的,掺杂浓度变化和外延片电阻率变化呈对应关系。
进一步的,不同斜率的外延片用于不同规格的肖特基芯片。
本发明的肖特基芯片专用的外延片生长方法制造的外延片来生产肖特基芯片,可以使得芯片的正向(Vf)参数及抗ESD能力都非常优良。
附图说明
图1为外延片掺杂浓度曲线图;
图2为外延片电阻率变化曲线图。
具体实施方式
下面结合附图对本发明作进一步说明。
本发明的肖特基芯片专用外延片生长方法,采用如下步骤进行:
如图1和2所示,在1150℃左右的高温环境下,先采用H2+HCL对硅片进行预处理。然后在抛光片表面淀积一定厚度的(一般为0.2um)不掺杂的纯硅,用来抑制抛光片中的杂质溢出。接下来按照一定的比例调整掺杂量,使得外延片的过渡层的电阻率曲线呈线性变化,并且具有一定的斜率。达到外延片需要的电阻率值后,再进行稳定浓度的掺杂。通过调节掺杂量及硅沉积速率,可以调节电阻率曲线的斜率。
用本方法加工的外延片作为基础材料来生产肖特基芯片,可以使得芯片具有低的正向导通电阻及高的抗静电(ESD)能力。
Claims (6)
1.一种肖特基芯片专用的外延片生长方法,包括如下步骤:在高温环境下,先采用H2+HCL对硅片进行预处理;然后在硅片表面淀积一定厚度的不掺杂的纯硅;接着,按照一定的比例调整掺杂量,使得外延片的过渡层的电阻率呈线性变化,并且具有一定的斜率。
2.根据权利要求1所述的肖特基芯片专用的外延片生长方法,其特征在于:通过调节掺杂量及硅沉积速率来控制电阻率曲线的斜率。
3.根据权利要求1所述的肖特基芯片专用的外延片生长方法,其特征在于:所述线性变化为线性增大。
4.根据权利要求1所述的肖特基芯片专用的外延片生长方法,其特征在于:达到外延片需要的电阻率值后,再进行稳定浓度的掺杂。
5.根据权利要求1所述的肖特基芯片专用的外延片生长方法,其特征在于:掺杂浓度变化和外延片电阻率变化呈对应关系。
6.根据权利要求2所述的肖特基芯片专用的外延片生长方法,其特征在于:不同斜率的外延片用于不同规格的肖特基芯片。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201310423509.2A CN103489761A (zh) | 2013-09-17 | 2013-09-17 | 一种肖特基芯片专用外延片的生长方法 |
Applications Claiming Priority (1)
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---|---|---|---|
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---|---|---|---|
CN201310423509.2A Pending CN103489761A (zh) | 2013-09-17 | 2013-09-17 | 一种肖特基芯片专用外延片的生长方法 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN103489761A (zh) |
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