CN103199187A - 一种发光二极管封装基板与封装结构及其制作方法 - Google Patents

一种发光二极管封装基板与封装结构及其制作方法 Download PDF

Info

Publication number
CN103199187A
CN103199187A CN201310137420XA CN201310137420A CN103199187A CN 103199187 A CN103199187 A CN 103199187A CN 201310137420X A CN201310137420X A CN 201310137420XA CN 201310137420 A CN201310137420 A CN 201310137420A CN 103199187 A CN103199187 A CN 103199187A
Authority
CN
China
Prior art keywords
groove structure
led
electrode
area
conductive layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN201310137420XA
Other languages
English (en)
Other versions
CN103199187B (zh
Inventor
夏德玲
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Anhui Sanan Optoelectronics Co Ltd
Original Assignee
Anhui Sanan Optoelectronics Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Anhui Sanan Optoelectronics Co Ltd filed Critical Anhui Sanan Optoelectronics Co Ltd
Priority to CN201310137420.XA priority Critical patent/CN103199187B/zh
Publication of CN103199187A publication Critical patent/CN103199187A/zh
Priority to PCT/CN2014/071051 priority patent/WO2014169721A1/zh
Priority to US14/748,393 priority patent/US20150295148A1/en
Application granted granted Critical
Publication of CN103199187B publication Critical patent/CN103199187B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/52—Encapsulations
    • H01L33/54—Encapsulations having a particular shape
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/005—Processes
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/02—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies
    • H01L33/20—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies with a particular shape, e.g. curved or truncated substrate
    • H01L33/22—Roughened surfaces, e.g. at the interface between epitaxial layers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/36—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the electrodes
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/483—Containers
    • H01L33/486—Containers adapted for surface mounting
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/52—Encapsulations
    • H01L33/56—Materials, e.g. epoxy or silicone resin
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48—Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/62—Arrangements for conducting electric current to or from the semiconductor body, e.g. lead-frames, wire-bonds or solder balls
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10—Bump connectors; Manufacturing methods related thereto
    • H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161—Disposition
    • H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73201—Location after the connecting process on the same surface
    • H01L2224/73203—Bump and layer connectors
    • H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/1015—Shape
    • H01L2924/10155—Shape being other than a cuboid
    • H01L2924/10158—Shape being other than a cuboid at the passive surface
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2933/00—Details relating to devices covered by the group H01L33/00 but not provided for in its subgroups
    • H01L2933/0008—Processes
    • H01L2933/0016—Processes relating to electrodes
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2933/00—Details relating to devices covered by the group H01L33/00 but not provided for in its subgroups
    • H01L2933/0008—Processes
    • H01L2933/0033—Processes relating to semiconductor body packages
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2933/00—Details relating to devices covered by the group H01L33/00 but not provided for in its subgroups
    • H01L2933/0008—Processes
    • H01L2933/0033—Processes relating to semiconductor body packages
    • H01L2933/005—Processes relating to semiconductor body packages relating to encapsulations
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2933/00—Details relating to devices covered by the group H01L33/00 but not provided for in its subgroups
    • H01L2933/0008—Processes
    • H01L2933/0033—Processes relating to semiconductor body packages
    • H01L2933/0066—Processes relating to semiconductor body packages relating to arrangements for conducting electric current to or from the semiconductor body

Abstract

本发明公开了一种适用于共晶接合制程之覆晶式发光二极管之封装基板，其至少包含：基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；凹槽结构，介于两个区域之间，其顶部开口宽度小于所述待封装芯粒的宽度。其可解决原本共晶制程覆晶型发光二极管因芯片与基板间距离过小而无法进行底层填充胶材（under-fill）制程而导致后续基板移除及表面粗化制程无法进行的问题。

Description

一种发光二极管封装基板与封装结构及其制作方法
技术领域
本发明属发光二极管之封装领域，具体涉及一种封装基板与封装结构及其制作方法。
背景技术
覆晶式（英文为Flip-chip，简称FC）封装于发光二极管的应用随着其优越的散热特性及较佳的组件机械强度逐渐被证实与量产，覆晶式封装技术于发光二极管的应用即为重要课题之一。覆晶式封装应用于发光二极管的应用主要分为两种封装方式：第一种为金凸块键合制程（英文为Au-stub bumping process），系先将金凸块种至封装基板上，其金凸块于板材上的相对位置与芯片上的电极相同，而后藉由超音波压合，使芯片上的电极与封装基板上的金凸块接合完成电性连接，此法对封装基板要求度低，制程弹性大，但其金凸块成本高，且芯片对位需要较高之精准度，因此机台昂贵，生产速度慢，导致整个生产成本过高；第二种为共晶接合制程（英文为Eutectic bonding process），以蒸镀或溅镀将选定之共晶金属制作于芯片上，藉由低温助焊剂将芯片预贴合至封装基板上，在高于共晶金属之熔点下回焊，使芯片与封装基板形成接合，金属成本低，生产速度快，对机台精度要求低，但是该制程对封装基板平整度以及其制程精度要求高。此外，为了增加发光二极管之发光效率，进一步将发光二极管之生长基板移除，此为一有效增加覆晶式发光二极管发光效率的方法，但覆晶式封装于芯片与封装基板间留下的空隙，严重影响生长基板移除的良率。
发明内容
本发明提供适用于共晶接合制程之覆晶式发光二极管之封装基板与封装结构及其制作方，解决原本共晶制程覆晶型发光二极管因芯片与基板间距离过小而无法进行底层填充胶材（under-fill）制程而导致后续基板移除及表面粗化制程无法进行的问题。
本发明提供一种适用于共晶接合制程之覆晶式发光二极管之封装基板，包含：基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；凹槽结构，介于两个区域之间，其顶部开口宽度小于所述待封装芯粒的宽度。
在本发明的一些实施例中，所述凹槽结构至少具有一侧开口位于基板本体的侧壁。
在本发明的一些实施例中，所述凹槽结构的截面形状为矩形或者倒梯形或者倒三角形或者弧形。
在本发明的一些实施例中，所述凹槽结构的高度差介于50微米至300微米之间。
在本发明的一些实施例中，所述凹槽结构的顶部开口宽度介于100微米至1000微米之间。
在本发明的一些实施例中，所述凹槽结构为矩形或倒梯形时，定义封装基板具有第一表面，第二表面以及第三表面，其中第二表面在相对高度上位于第一表面之下且第二表面位于两个第一表面间，第三表面与第一表面及第二表面相连，则容易理解，两个第二表面与第三表面构成凹槽结构。
在本发明的一些实施例中，所述凹槽结构为矩形或倒梯形时，第二表面与第三表面相交角度介于45度至90度之间。 
在本发明的一些实施例中，所述基板本体可为Si，AlN，Al2O3，环氧树脂模塑料（英文为Epoxy Molding Compound，缩写为EMC）等材料。
本发明还提供一种适用于共晶接合制程之覆晶式发光二极管之封装结构，包括：基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；凹槽结构，介于两个区域之间，其顶部开口宽度小于所述待封装芯粒的宽度，且凹槽结构至少具有一侧开口位于基板本体的侧壁；第一导电层，位于第一区域之上；第二导电层，位于第二区域之上；发光二极管芯片，具有第一电极和第二电极，两个电极之间存有间隙；第一导电层与第一电极，第二导电层与第二电极两两对位并固晶连接；胶材，填入至第一电极与第二电极之间的间隙及凹槽结构。
本发明再提供一种覆晶式发光二极管之封装结构制作方法，包含：提供基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；在基板本体第一表面上形成开口，在两个区域之间形成凹槽结构，且顶部开口宽度小于所述待封装芯粒的宽度，凹槽结构至少具有一侧开口位于基板本体的侧壁，制得封装基板；在第一区域之上制作第一导电层；在第二区域之上制作第二导电层；提供发光二极管，具有第一电极和第二电极，两个电极之间存有间隙；将第一导电层与第一电极，第二导电层与第二电极两两对位，采用覆晶封装制程使得发光二极管固晶连接于所述封装基板上；将胶材填入至第一电极与第二电极之间的间隙及凹槽结构，如此构成发光二极管封装结构。
在本发明的一些实施例中，于封装基板本体第一表面上形成顶部开口的方式，可以通过钻石刀或者经黄光光罩、干/湿法蚀刻制作而成。
在本发明的一些实施例中，经覆晶封装至封装基板上之发光二极管，可进一步利用激光剥离移除其生长基板。
在本发明的一些实施例中，移除生长基板后裸露之表面，可进一步做表面粗化处理。
本发明的封装基板可应用于覆晶式发光二极管，藉由第一表面及第二表面的高度差，可有效避免芯片固晶时产生接触不良造成组件失效。同时，可利用胶材填入至第一电极与第二电极之间的间隙及凹槽结构，可避免后续激光剥离生长基板时对芯片造成的损伤，最后藉由外延层表面粗化处理，增加发光二极管之出光效率。
本发明的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变得显而易见，或者通过实施本发明而了解。本发明的目的和其他优点可通过在说明书、权利要求书以及附图中所特别指出的结构来实现和获得。
附图说明
附图用来提供对本发明的进一步理解，并且构成说明书的一部分，与本发明的实施例一起用于解释本发明，并不构成对本发明的限制。此外，附图数据是描述概要，不是按比例绘制。
图1A系本发明第一实施例之封装基板的剖面图。
图1B系图1A之封装基板的俯视图。
图2A系本发明第二实施例之封装基板的剖面图。
图2B系图2A之封装基板的俯视图。
图3~图6系根据本发明实施的一种覆晶式发光二极管制造方法之部分步骤剖面图。
图中各标号表示：
100：封装基板
100’：封装基板
101：基板本体
102：第一表面
103：第二表面
104：第三表面
105A：第一导电层
105B：第二导电层
106：凹槽
 107：胶材
201：发光二极管
202：生长基板
203：磊晶层
204：粗糙化表面
205A：第一电极
205B：第二电极
W1：与第二表面相邻的两个第一表面的宽度
W2：第二表面的宽度
d：第一表面与第二表面之高度差
θ：第二表面与第三表面相交角度。
具体实施方式
为了能彻底地了解本发明，将在下列的描述中提出详尽的步骤及其组成，另外，众所周知的组成或步骤并未描述于细节中，以避免造成本发明不必要之限制。本发明的较佳实施例会详细描述如下，然而除了这些详细描述之外，本发明还可以广泛地施行在其它的实施例中，且本发明的范围不受限定，以专利权利要求范围为准。
为解决习知之封装基板于覆晶式发光二极管在共晶制程所面临到的缺点，本发明提出一适用于共晶接合制程之覆晶式发光二极管之封装基板及相关制造方法，同时解决后续生长基板移除制程中可能对芯片造成的损伤，下面实施例将配合图示说明本发明之封装基板及其应用方法。
请参考图1A~图1B。图1A系本发明第一实施例之封装基板的剖面图，图1B系图1A之封装基板的俯视图。封装基板100，包括：基板本体101，具有第一表面102，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域。如图1A所示，凹槽结构的截面形状为矩形，介于两个区域之间，其顶部开口宽度W1小于所述待封装芯粒的宽度。如图1B所示，凹槽结构的两侧位于基板本体的侧壁。
在本实施例中，凹槽结构的截面形状为矩形。第一导电层105A位于第一区域之上，第二导电层105B，位于第二区域之上。基板本体上包含第二表面 103，其相对高度上位于第一表面之下且第二表面位于两个第一表面间；第三表面104分别与第一表面及第二表面间相连，其中，第一表面102，第二表面103，以及第三表面104形成凹槽106。
在本实施例中，第一表面102与第二表面103非共平面，其高度差d介于50微米至300微米之间，但不以此为限，此高度差可以有效解决习知之共晶制程因基板平整度不佳所造成共晶失效的问题。其中，凹槽106的顶部开口宽度W1介于100微米至1000微米之间。凹槽106的底部开口宽度W2等于凹槽106的顶部开口宽度W1。第二表面与第三表面相交角度θ为90度，但不以此为限。此外，基材本体101可为AlN基材，但亦不以此为限。
请参考图2A~图2B。图2A系本发明第二实施例之封装基板的剖面图，图2B系图2A之封装基板的俯视图。封装基板100’，包括：基板本体101，具有第一表面102，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域。如图2A所示，凹槽结构的截面形状为矩形，介于两个区域之间，其顶部开口宽度W1小于所述待封装芯粒的宽度。如图2B所示，凹槽结构的一侧开口位于基板本体的侧壁。
在本实施例中，凹槽结构的截面形状为倒梯形。第一导电层105A，位于第一区域之上，第二导电层105B，位于第二区域之上。基板本体上包含第二表面 103，其相对高度上位于第一表面之下且第二表面位于两个第一表面间；第三表面104分别与第一表面及第二表面间相连，其中，第一表面102，第二表面103，以及第三表面104形成凹槽106。
在本实施例中，在本实施例中，第一表面102与第二表面103非共平面，其高度差d介于50微米至300微米之间，但不以此为限。其中，凹槽106的顶部开口宽度W1介于100微米至1000微米之间。凹槽106的底部开口宽度W2小于凹槽106的顶部开口宽度W1。第二表面与第三表面相交角度θ介于45度至90度之间，但不以此为限。
请参考图3~图6，系根据本发明实施的一种覆晶式发光二极管封装结构制造方法之部分步骤剖面图。在图3中，提供蓝宝石（Al2O3）基板本体100’，具有第一表面102，第二表面103以及第三表面104，所述第三表面与第一表面及第二表面相连；于基板本体第一表面上通过钻石刀形成一个开口，使得第二表面与第三表面构成凹槽结构；制作第一导电层，位于所述第一表面之上；分别在第一区域、第二区域之上制作第一导电层105A、第二导电层105B。提供发光二极管芯片201，包括：生长基板202、磊晶层203以及第一电极205A和第二电极205B，两个电极之间存有间隙；将第一导电层105A与第一电极205A，第二导电层105B与第二电极205B两两对位，以覆晶封装制程使得发光二极管固晶于所述封装基板100’上。
在图4中，将胶材107填充至第一电极与第二电极之间的间隙及凹槽结构，胶材选用硅胶。在图5中，使用激光剥离制程去除发光二极管芯片201之生长基板202，使发光二极管芯片201的磊晶层203表面裸露。藉由凹槽106的形成以及胶材107的填充固型，可有效避免发光二极管芯片201于激光剥离生长基板202时因应力的改变对磊晶层203所造成的损伤。在图6中，去除生长基板202后，利用化学蚀刻制程处理裸露的磊晶层203之出光面，使其形成粗糙化表面204，如此可进一步增加发光二极管之效率。
由上述本发明实施方式可知，应用本发明的发光二极管封装基板与封装结构，可解决习知覆晶制程因基板平整度不佳所造成之共晶失效的问题，进一步可藉由封装基板凹槽结构，在发光二极管覆晶固晶至封装基板后，利用胶材填入此凹槽，可解决后续激光剥离生长基板制程可能对芯片造成的损伤，最后藉由表面粗化制程的处理进而增加发光二极管之发光效率。

Claims (11)

1.一种发光二极管封装基板，包含：
基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；
凹槽结构，介于两个区域之间，其顶部开口宽度小于所述待封装芯粒的宽度。
2.根据权利要求1所述的一种发光二极管封装基板，其特征在于：所述凹槽结构至少具有一侧开口位于基板本体的侧壁。
3.根据权利要求1所述的一种发光二极管封装基板，其特征在于：所述凹槽结构的截面形状为矩形或者倒梯形或者倒三角形或者弧形。
4.根据权利要求1所述的一种发光二极管封装基板，其特征在于：所述凹槽结构的高度差介于50微米至300微米之间。
5.根据权利要求1所述的一种发光二极管封装基板，其特征在于：所述凹槽结构的顶部开口宽度介于100微米至1000微米之间。
6.一种发光二极管封装结构，包含：
基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；
凹槽结构，介于两个区域之间，其顶部开口宽度小于所述待封装芯粒的宽度，且凹槽结构至少具有一侧位于基板本体的侧壁；
第一导电层，位于第一区域之上；
第二导电层，位于第二区域之上；
发光二极管芯片，具有第一电极和第二电极，两个电极之间存有间隙；
将第一导电层与第一电极，第二导电层与第二电极两两对位并固晶连接；
胶材，填入至第一电极与第二电极之间的间隙及凹槽结构。
7.一种发光二极管封装结构的制作方法，包含：
提供基板本体，具有第一表面，其上分布有至少一个单元，所述每个单元对应一个发光二极管芯粒，其具有彼此相互电隔离的第一区域和第二区域；
在基板本体第一表面上形成开口，在两个区域之间形成凹槽结构，且顶部开口宽度小于所述待封装芯粒的宽度，凹槽结构至少具有一侧位于基板本体的侧壁，制得封装基板；
在第一区域之上制作第一导电层；
在第二区域之上制作第二导电层；
提供发光二极管，具有生长基板、磊晶层、第一电极和第二电极，两个电极之间存有间隙；
将第一导电层与第一电极，第二导电层与第二电极两两对位，以覆晶封装制程使得发光二极管固晶于所述封装基板上；
将胶材填入至第一电极与第二电极之间的间隙及凹槽结构，如此构成发光二极管封装结构。
8.根据权利要求7所述的一种发光二极管封装结构的制作方法，其特征在于：所述胶材为环氧树脂或硅胶或前述组合。
9.根据权利要求7所述的一种发光二极管封装结构的制作方法，其特征在于：其特征在于：利用胶材填充至第一电极与第二电极之间的间隙及凹槽结构后，还包含采用剥离制程，去除发光二极管芯片的生长基板，使其磊晶层表面裸露。
10.根据权利要求7所述的一种发光二极管封装结构的制作方法，其特征在于：所述凹槽结构的高度差介于50微米至300微米之间。
11.根据权利要求7所述的一种发光二极管封装结构的制作方法，其特征在于：所述凹槽结构的顶部开口宽度介于100微米至1000微米之间。
CN201310137420.XA 2013-04-19 2013-04-19 一种发光二极管封装基板与封装结构及其制作方法 Active CN103199187B (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN201310137420.XA CN103199187B (zh) 2013-04-19 2013-04-19 一种发光二极管封装基板与封装结构及其制作方法
PCT/CN2014/071051 WO2014169721A1 (zh) 2013-04-19 2014-01-22 一种发光二极管封装基板与封装结构及其制作方法
US14/748,393 US20150295148A1 (en) 2013-04-19 2015-06-24 Package Substrate and Package Structure of Light Emitting Diode and Fabrication Thereof

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201310137420.XA CN103199187B (zh) 2013-04-19 2013-04-19 一种发光二极管封装基板与封装结构及其制作方法

Publications (2)

Publication Number Publication Date
CN103199187A true CN103199187A (zh) 2013-07-10
CN103199187B CN103199187B (zh) 2015-11-25

Family

ID=48721621

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201310137420.XA Active CN103199187B (zh) 2013-04-19 2013-04-19 一种发光二极管封装基板与封装结构及其制作方法

Country Status (3)

Country Link
US (1) US20150295148A1 (zh)
CN (1) CN103199187B (zh)
WO (1) WO2014169721A1 (zh)

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2014169721A1 (zh) * 2013-04-19 2014-10-23 厦门市三安光电科技有限公司 一种发光二极管封装基板与封装结构及其制作方法
CN104141904A (zh) * 2014-07-22 2014-11-12 上海博恩世通光电股份有限公司 一种插入式双面固晶全周发光led功率型灯丝模组
CN104638090A (zh) * 2014-12-18 2015-05-20 上海大学 倒装led封装模组
CN107134511A (zh) * 2016-02-26 2017-09-05 上海博恩世通光电股份有限公司 一种在封装过程中提升倒装led芯片性能的方法
CN109461752A (zh) * 2017-09-06 2019-03-12 优显科技股份有限公司 具微半导体结构的目标基板
CN111293199A (zh) * 2017-01-20 2020-06-16 光宝光电(常州)有限公司 发光二极管封装结构、发光二极管封装模块
CN111326609A (zh) * 2018-12-14 2020-06-23 昆山工研院新型平板显示技术中心有限公司 发光器件、发光器件的制作方法及显示装置
CN113964260A (zh) * 2021-10-09 2022-01-21 深圳市美丽微半导体有限公司 一种节能高效的二极管封装方法及二极管

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR102356216B1 (ko) * 2017-05-30 2022-01-28 쑤저우 레킨 세미컨덕터 컴퍼니 리미티드 발광소자 패키지 및 광원 장치
JP7239823B2 (ja) * 2019-04-05 2023-03-15 日亜化学工業株式会社 発光装置の製造方法及び発光装置

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6599768B1 (en) * 2002-08-20 2003-07-29 United Epitaxy Co., Ltd. Surface mounting method for high power light emitting diode
KR100878327B1 (ko) * 2007-07-06 2009-01-14 한국광기술원 웨이퍼레벨 패키징된 발광다이오드 및 그의 제조 방법
CN101471407B (zh) * 2007-12-24 2012-02-29 亿光电子工业股份有限公司 薄型发光二极管装置的封装方法
WO2009096619A1 (en) * 2008-02-01 2009-08-06 Ytel Photonics Inc. Optical device package and method for manufacturing thereof
KR101867106B1 (ko) * 2010-03-30 2018-06-12 다이니폰 인사츠 가부시키가이샤 Led용 수지 부착 리드 프레임, 반도체 장치, 반도체 장치의 제조 방법 및 led용 수지 부착 리드 프레임의 제조 방법
US20120043639A1 (en) * 2010-08-19 2012-02-23 MOS Art Pack Corporation Fabricating method and structure of submount
JP2013033910A (ja) * 2011-06-29 2013-02-14 Hitachi Cable Ltd 発光素子搭載用基板、ｌｅｄパッケージ、及びｌｅｄパッケージの製造方法
CN102569287A (zh) * 2012-01-19 2012-07-11 日月光半导体制造股份有限公司 半导体光源模块及其制造方法
JP6225910B2 (ja) * 2012-09-26 2017-11-08 日亜化学工業株式会社 発光装置
TWI483434B (zh) * 2013-02-18 2015-05-01 Lextar Electronics Corp 發光二極體的轉置基材與使用該轉置基材的發光裝置製造方法
CN103199187B (zh) * 2013-04-19 2015-11-25 安徽三安光电有限公司 一种发光二极管封装基板与封装结构及其制作方法

Cited By (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2014169721A1 (zh) * 2013-04-19 2014-10-23 厦门市三安光电科技有限公司 一种发光二极管封装基板与封装结构及其制作方法
CN104141904A (zh) * 2014-07-22 2014-11-12 上海博恩世通光电股份有限公司 一种插入式双面固晶全周发光led功率型灯丝模组
CN104638090A (zh) * 2014-12-18 2015-05-20 上海大学 倒装led封装模组
CN107134511A (zh) * 2016-02-26 2017-09-05 上海博恩世通光电股份有限公司 一种在封装过程中提升倒装led芯片性能的方法
CN111293199A (zh) * 2017-01-20 2020-06-16 光宝光电(常州)有限公司 发光二极管封装结构、发光二极管封装模块
CN109461752A (zh) * 2017-09-06 2019-03-12 优显科技股份有限公司 具微半导体结构的目标基板
CN109461752B (zh) * 2017-09-06 2023-10-10 乐金显示有限公司 具微半导体结构的目标基板
CN111326609A (zh) * 2018-12-14 2020-06-23 昆山工研院新型平板显示技术中心有限公司 发光器件、发光器件的制作方法及显示装置
CN111326609B (zh) * 2018-12-14 2021-05-25 成都辰显光电有限公司 发光器件、发光器件的制作方法及显示装置
US11495712B2 (en) 2018-12-14 2022-11-08 Chengdu Vistar Optoelectronics Co., Ltd. Light emitting device, method for making the same and display apparatus
CN113964260A (zh) * 2021-10-09 2022-01-21 深圳市美丽微半导体有限公司 一种节能高效的二极管封装方法及二极管
CN113964260B (zh) * 2021-10-09 2022-07-29 深圳市美丽微半导体有限公司 一种二极管封装方法

Also Published As

Publication number Publication date
US20150295148A1 (en) 2015-10-15
CN103199187B (zh) 2015-11-25
WO2014169721A1 (zh) 2014-10-23

Similar Documents

Publication Publication Date Title
CN103199187A (zh) 一种发光二极管封装基板与封装结构及其制作方法
US9269873B2 (en) Semiconductor light emitting device and method for manufacturing same
KR101761834B1 (ko) 웨이퍼 레벨 발광 다이오드 패키지 및 그것을 제조하는 방법
JP4529319B2 (ja) 半導体チップとその製造方法
US9559278B2 (en) Light emitting device package
TWI436458B (zh) 晶圓級封裝結構及其製作方法
JP6545981B2 (ja) 半導体発光装置
US20100327465A1 (en) Package process and package structure
US20140120641A1 (en) Flip chip light emitting device package and manufacturing method thereof
KR101092063B1 (ko) 발광소자 패키지 및 그 제조방법
JP6126752B2 (ja) 半導体装置及びその製造方法
JP6325536B2 (ja) 透明スペーサによってｌｅｄから離隔された蛍光体
JP5294902B2 (ja) 表面実装型発光素子の製造方法
US20130161670A1 (en) Light emitting diode packages and methods of making
JP2011187941A (ja) ウエハレベルパッケージの製造方法
TWI236747B (en) Manufacturing process and structure for a flip-chip package
CN115084337B (zh) 一种微型发光二极管芯片的巨量转移方法
EP3491678B1 (en) Light emitting device package with reflective side coating
US11189769B2 (en) Light emitting device package with reflective side coating
KR20160037471A (ko) 발광 소자 패키지
KR102634323B1 (ko) Uv 엘이디 패키지 및 제조방법
US20150303179A1 (en) Light Emitting Diode Assembly With Integrated Circuit Element
TW201403888A (zh) 發光二極體的製造方法
WO2019127264A1 (zh) 一种三维芯片堆叠芯片尺寸封装结构及制造方法
WO2019015683A1 (zh) 一种发光装置及其制作方法以及发光模组

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
C14 Grant of patent or utility model
GR01 Patent grant