基准电压产生电路
技术领域
本发明涉及基准电压产生电路,特别涉及在低电压下动作,制造偏差小的基准电压产生电路。
背景技术
图1是表示输出没有温度依赖性的基准电压的现有带隙基准电压产生电路(也称为“Band-Gap-Referenced Biasing Circuit”)的构成的一个例子的图。关于这种电路,可参照非专利文献1等的记载。此基准电压产生电路具备PNP型的双极结晶体管(简称「BJT」)Q1、Q2、差动放大器A1、电阻R1、R2。基极和集电极与地电位连接的BJT Q1的发射极上连接有一端与差动放大器A1的输出连接的电阻R1的另一端,基极和集电极与地电位连接的BJT Q2的发射极与电阻R2的一端连接,电阻R2的另一端上连接有一端与差动放大器A1的输出连接的电阻R1的另一端,电阻R1和BJT Q1的发射极的连接点的节点N1、电阻R1和R2的连接点的节点N2与差动放大器A1的非反相输入端子、反相输入端子连接。另外,在N-阱工艺中,N-阱中的P+区域成为发射极,N-阱成为基极,P型基板成为集电极,该集电极与地电位连接,作为PNP型双极结晶体管而动作(参照非专利文献1)。
BJT Q1、Q2的发射极尺寸的比为AE(Q1)∶AE(Q2)=1∶N。此电路的输出电压VREF如下求得。
通过差动放大器A1的负反馈,节点N1和N2的电位就会相等。因此,流过2个R1的电流就会相等,流过BJT Q1和Q2的电流(集电极电流)也会相等。
此处,BJT Q1和Q2的发射极面积是Q2一方大,因而Q2的基极-发射极间电压VBE2低,与Q1的基极-发射极间电压VBE1的差电压ΔVBE加在电阻R2上。此电位差ΔVBE=VBE1-VBE2由下式(1)给出。
先简单地说明式(1)的导出,BJT Q1、Q2的集电极电流I1、I2分别由I1=ISexp(qVBE1/(kT))、I2=ISexp(qVBE2/(kT))给出(其中,IS是饱和电流,k是波尔茨曼常数,T是绝对温度,q是电子的电荷(单位电荷)),所以Q1、Q2的基极-发射极间电压表示为VBE1=(kT/q)ln(I1/IS)、VBE2=(kT/q)ln(I2/IS)。因而成为,
ΔVBE=VBE1-VBE2=(kT/q)ln(I1/IS)-(kT/q)ln(I2/(NIS))
=(kT/q)ln(NI1/I2)
I1=I2时,导出上式(1)。
流过电阻R2的电流I2由下式(2)给出。
因而,差动放大器A1的输出电压VREF表示为下式(3)。
上式(3)中,
第1项VBE1具有负的温度依赖性(温度系数为负,随着温度变高而电压下降),
第2项的(R1/R2)(kT/q)lnN与绝对温度T成比例,具有正的温度依赖性。
因而,适当调整电阻R1和电阻R2比,就能消除输出电压VREF的温度依赖性。
并且,此时的电压称为「带隙电压」,在Si的BJT中为1.2~1.3V。还有,电流I1、I2与绝对温度T成比例,所以称为Proportional To AbsoluteTemperature电流,简称「PTAT电流」。
这种电路大致可分为PTAT电流产生部和基准电压产生部。在图1中,电阻R1、R2、BJT Q1、Q2对应PTAT电流产生部,电阻R1和BJTQ1对应基准电压产生部。BJT Q1在PTAT电流产生部和基准电压产生部中共用。
一般而言,BJT的基极-发射极间电压VBE的工艺偏差小。因此,在差动放大器为理想的放大器的场合,能实现偏差极小的基准电压。
然而,一般接近的MOS晶体管的阈值电压VT的偏差从数mV起大到数10mV。因此,在采用了MOS晶体管的差动放大器中,其所涉及的偏置电压会产生。
对此偏置电压以电路整体来补足,将其换算成放大器的输入电压所得的东西是所谓的输入换算偏置电压。图1的VOS表示输入换算偏置电压。
图6表示采用了MOS晶体管的差动放大器的典型例子。差动放大器具备:源极共连,栅极上分别输入电压VIN-、VIN+,构成差动对的N沟道MOS晶体管M1、M2;连接在电源VEXT和N沟道MOS晶体管M1、M2的漏极间,构成差动对的有源负载,电流镜构成的P沟道MOS晶体管M3、M4;连接在N沟道MOS晶体管M1、M2的共用源极和地间,构成恒流源的N沟道MOS晶体管M5;连接在电源VEXT和输出端子VOUT间,栅极与晶体管M4、M2的漏极们的连接点连接的P沟道MOS晶体管M6;以及连接在输出端子VOUT和地间,构成恒流源的N沟道MOS晶体管M7,N沟道MOS晶体管M5、M7的栅极上被供给偏压电压VBIAS。
在此差动放大器中,特别对输入换算偏置有影响的是输入级的差动对晶体管M1、M2。
此偏置电压VOS和输出电压VREF的关系由下式(4)表示。
此处,上式(4)可以通过对以下2个方程式分别以VOS进行微分来求得。式(5)对应于图1中电阻R2的端子间电压与BJT Q1、Q2的基极-发射极间电压的差电压ΔVBE和偏置电压VOS的和相等这一点。还有,式(6)对应于节点N1、N2的电压的差成为偏置电压VOS这一点。
I1R1-VOS=I2R1
(6)
根据上式(4),在图1的电路构成的场合,偏置电压VOS为10倍以上,表现为差动放大器A1的输出。
这是在通常的应用中也不能忽视的量。因此,需要用激光、电熔化(電気ヒュ一ズ)等来修整电阻R1或R2。
还有,在图1的电路构成的场合,输出电压VREF是1.2V~1.3V。因此,如图7所示,作为电源电压VEXT,至少需要1.3V以上。另外,图7是对于现有电路和后述的本发明,对比表示输出电压VOUT(VREF)(纵轴)和电源电压VFXT(横轴)的关系的图。
图2是表示专利文献1(特开平8-320730号公报)披露的电路构成的图。参照图2,NPN型Q1的发射极直接与地电位连接(接地),NPN型BJT Q2的发射极通过电阻R2而与地电位连接,BJT Q1、Q2的集电极分别与差动放大器A1的非反相输入端子(+)、反相输入端子连接。3个电阻R0、R0、R1的一端与差动放大器A1的输出端子共连,电阻R0、R0的另一端分别与BJT Q1、Q2的集电极连接,电阻R1的另一端与NPN型BJT Q3的集电极和基极连接。BJT Q3的基极与BJT Q1、Q2的基极连接。BJT Q1的基极和BJT Q2的基极之间连接有电阻R3。BJT Q1、Q2的发射极尺寸比设为1:N(其中,N为给定的正整数)。在此构成中,用NPN型的BJT把ΔVBE产生用电阻R2与发射极连接起来,向差动放大器A1的反馈从它们的集电极端子进行。
在图2的基准电压产生电路中,产生PTAT电流的PTAT电流产生部由电阻R0、R2、R3、BJT Q1、Q2组成。生成温度系数为负的电压的基准电压产生部由电阻R1和BJT Q3组成。
BJT Q1、Q2、Q3的集电极电流I1、I2、I3,从后述的式(8)、(9)、(10)可以看出,具有比例关系,都成为PTAT电流。此电路的输出电压VREF为晶体管Q3的基极-发射极间电压VBE3和电阻R1的端子间电压R1·I1的和,由下式(7)表示。
VREF=VBE3+R1I3
(7)
晶体管Q3的基极-发射极间电压VBE3具有负的温度依赖性(温度系数为负),电流I3具有正的温度依赖性(温度系数为正),所以适当调整电阻R1,与图1电路同样,就能得到温度依赖性被消除了的带隙电压。
专利文献1:特开平8-320730号公报
非专利文献1:Behzad Razavi著,黑田忠广译,“ァナログC MO S集積回路の設計”,第470-471页,图11.11,丸善株式会社
发明内容
发明打算解决的课题
根据图2的构成,能大幅度降低差动放大器的MOS的偏置所涉及的输出误差。这一点,专利文献1没有记载,是本申请的发明者等完全独自发现的特性。以下,基于本申请的发明者等所做的分析结果进行说明。
图2中的偏置电压VOS和输出电压VREF的关系由下式(8)表示。
R0I1-R0I2=VOS
(8)
还有,把BJT Q2的基极-发射极间电压设为VBE2,把发射极电流设为I2′的话,基极电压由VBE2+R2·I2′给出。还有,把BJT Q2的基极接地电流放大率设为α(I2=αI2′)的话,Q2的基极电流IB由(1-α)I2/α给出。在图2中,BJT Q2的基极电压,把Q1的基极-发射极间电压设为VBE1的话,就成为VBE1+R3·IB,根据VBE2+R2·I2′=VBE1+R3·(1-α)I2/α、R3=2R2,导出下式(9)。
还有,流过电阻R1的电流I3是BJT Q3的集电极电流I1和3个BJTQ1、Q2、Q3的基极电流IB的和,因而下式(10)成立。
因而,输出电压VREF由下式(11)表示。
此处,对式(8)、(9)分别以偏置电压VOS进行微分,再使用式(10)、(11),求得dVREF/dVOS的VOS→0的话,就得到下式(12)。
α是BJT Q1、Q2的基极接地电流放大率(α<1)。计算式(12)的话,作为dVREF/dVOS,得到1~2的值。因此,在图2的电路构成中,偏置电压VOS会以1~2倍出现在输出电压中。
此值与图1的构成(偏置电压VOS以10倍以上作为输出出现)相比,是充分小的。可以定性地说,这是因为BJT Q1、Q2和2个电阻R0所涉及的放大作用。
即,输出电压VREF变化的话,该变化的量通过电阻R1表现为BJTQ3的基极和集电极电位的变化。
并且,BJT Q3的基极电位的变化成为BJT Q1、Q2的基极电流的变化。此电流变化由BJT Q1、Q2和2个电阻R0放大,在各自的集电极(节点N1、N2)上出现,成为差动放大器A1的输入。按此放大的量,与图1的构成的场合相比,以较小的输出电压VRFF的变化,就能补正VOS所涉及的节点N1、N2间的失衡。
如上所述,差动放大器的偏置电压为数mV~数10mV,所以此误差的大小,在作为存储器、逻辑电路的内部电源的应用中基本上可以忽略。即,不用修整。
然而,在图2的电路构成中,其输出电压,与图1的电路构成相同,是1.2V~1.3V。因此,电源电压需要1.3V以上。
近几年,在1.5V以下动作的LSI增多,因此,基准电压要有富余,要到1V的程度都能动作。
如上所述,在图1的电路构成中,在基准电压产生电路的构成要素中使用了MOS晶体管的场合,输出电压的偏差大,这是存在的问题。
还有,作为解决此问题的构成,在图2所示的基准电压产生电路中,输出电压设为1.2V的程度,所以为了使此基准电压产生电路动作就需要1.3V以上的电源电压,这是存在的问题。
因此,本发明是鉴于上述问题点而提出的,其目的在于提供偏差小、动作开始电压低的基准电压产生电路。
用于解决课题的方案
本申请所披露的发明,为了解决上述课题大致为以下构成。
本发明的1个方面所涉及的基准电压产生电路,具备:生成温度系数为正的第1电流的电流产生部;生成温度系数为负的电压的电压产生部;在电阻中流过温度系数为正的电流,从而生成把在上述电阻的端子间出现的温度系数为正的电压和上述温度系数为负的电压合成所得的电压的合成部,其特征在于,还具备生成温度系数为正的第2电流的补偿电流产生部,在上述电阻中流过把上述第1电流和上述第2电流合成(重叠)所得的电流,上述合成部生成把上述第1电流和上述第2电流的合成电流所涉及的上述电阻的端子电压和上述温度系数为负的电压合成所得的电压,将其作为基准电压来输出。在上述电阻中流过上述第1电流和上述第2电流的电流和。
在本发明中,优选的是,上述补偿电流产生部把与从被输出的上述基准电压中减去温度系数为负的电压所得的差电压成比例的电流作为上述第2电流来输出。在本发明中,上述第2电流与上述第1电流相比,温度系数可以大些。
在本发明中,上述合成部由差动放大器组成,上述电流产生部也可以构成为具备:一端与上述差动放大器的输出端子连接的第1电阻;集电极与上述第1电阻的另一端连接,发射极与地电位连接的第1晶体管;一端与上述差动放大器的输出端子连接的第2电阻;以及集电极与上述第2电阻的另一端连接,发射极通过第3电阻而与地电位连接的第2晶体管。上述电压产生部也可以构成为具备:一端与上述差动放大器的输出端子连接的第4电阻;以及集电极和基极与上述第4电阻的另一端连接,发射极与地电位连接的第3晶体管。上述第2晶体管的基极与上述第1晶体管的基极通过第5电阻而连接,而且,上述第3晶体管的集电极及基极与上述第1晶体管的基极连接,上述第1及第2晶体管的集电极分别与上述差动放大器的非反相输入端子及反相输入端子连接。上述补偿电流产生部也可以构成为具备:一端与上述差动放大器的输出端子连接的第6电阻;集电极与上述第4电阻的另一端连接,发射极与地电位连接的第4晶体管;以及发射极与地电位连接,集电极和基极与上述第6电阻的另一端共连,集电极和基极与上述第4晶体管的基极连接的第5晶体管。
本发明的另一方面所涉及的基准电压产生电路,具备:生成温度系数为正的第1电流的电流产生部;生成温度系数为负的电压的电压产生部;对由上述电压产生部生成了的温度系数为负的电压进行分压的分压电路;以及生成输出把在电阻中流过上述第1电流而获得的端子电压和由上述分压电路对上述温度系数为负的电压进行分压所得的电压进行合成所得的电压的合成部。
在本发明中,上述合成部由差动放大器组成。上述电流产生部也可以构成为具备:一端与上述差动放大器的输出端子连接的第1电阻;集电极与上述第1电阻的另一端连接,发射极与地电位连接的第1晶体管;一端与上述差动放大器的输出端子连接的第2电阻;以及集电极与上述第2电阻的另一端连接,发射极通过第3电阻而与地电位连接的第2晶体管。上述电压产生部也可以构成为具备:一端与上述差动放大器的输出端子连接的第4电阻;集电极与上述第4电阻的另一端连接,发射极与地电位连接的第3晶体管。具备非反相输入端子及反相输入端子分别与上述第1及第2电阻和上述第1及第2晶体管的集电极的连接点连接,输出端子与上述第3晶体管的基极连接的别的差动放大器,还具备上述第1至第3晶体管的基极共连后在上述第1至第3晶体管的共连的基极节点和地间以串联方式连接的多个电阻所组成的分压电路。也可以构成为,上述分压电路所涉及的分压输出电压被输入到上述差动放大器的非反相输入端子,上述第4电阻和上述第3晶体管的集电极的连接点与上述差动放大器的反相输入端子连接。
在本发明中,在上述电流产生部中,上述第1、第2晶体管的发射极尺寸的比设为1∶N(N为比1大的整数)。还有,上述温度系数为负的电压相当于双极晶体管的基极-发射极间电压。
在本发明中,上述温度系数为正的第1电流是与热电压(=kT/q,其中,k是波尔茨曼常数,T是绝对温度,q是电子的电荷)成比例的电流。
本发明的1个方面所涉及的电路,具备
包含第1、第2、第3电阻、第1差动放大器、第1、第2、第3双极结晶体管,
上述第1及第2双极结晶体管的集电极分别与上述第1差动放大器的第1及第2输入端子连接,
上述第1、第2、第3电阻的一端与上述第1差动放大器的输出端子共连,
上述第1电阻的另一端与上述第1双极结晶体管的集电极连接,
上述第2电阻的另一端与上述第2双极结晶体管的集电极连接,
上述第3电阻的另一端与上述第3双极结晶体管的集电极和基极连接,
上述第3双极结晶体管的基极与上述第1及上述第2双极结晶体管的基极连接,
第1和第2双极结晶体管的发射极尺寸比设定为1∶N(其中,N是比1大的整数),
生成具有比上述第1双极结晶体管或上述第2双极结晶体管的集电极电流大的正的温度系数的电流
的补偿电流产生电路,
在上述第3电阻中重叠流过与上述第1双极结晶体管或上述第2双极结晶体管的集电极电流相等电流和具有比与上述集电极电流相等的电流大的正的温度系数的电流,
由上述第1差动放大器输出把上述第3电阻的端子间电压和上述第3双极结晶体管的基极-发射极间电压相加所得的电压。
在本发明中,上述补偿电流产生电路具备:
发射极与地电位连接,集电极通过第4电阻而与上述第1差动放大器的输出端子连接,基极与集电极连接的第4晶体管;以及
发射极与地电位连接,集电极与上述第3晶体管的集电极连接,基极与上述第4晶体管的基极连接的第5晶体管。
在本发明中,上述第1及第2双极结晶体管的发射极尺寸的比设定为1∶N(N是比1大的整数)。
本发明的1个方面所涉及的电路,优选的是,至少具有第1、第2、第3电阻、第1差动放大器、第1、第2、第3晶体管(双极结晶体管),该第1晶体管的集电极端子与该第1差动放大器的第1输入端子连接,第2晶体管的集电极端子与该第1差动放大器的第2输入端子连接,该第1、第2、第3电阻的一端与差动放大器的输出连接,第1电阻的另一端与第1晶体管的集电极连接,第2电阻的另一端与第2晶体管的集电极连接,第3电阻的另一端与该第3晶体管的集电极及基极连接,而且该第3晶体管的基极与该第1及该第2晶体管的基极连接,第1和第2晶体管的发射极尺寸比设定为1∶N,在该第3电阻中重叠流过与该第1晶体管或该第2晶体管的集电极电流大体上相等的电流和具有比其大的正的温度系数的电流,输出在该第3电阻两端产生了的电压和该第3晶体管的基极-发射极间电压相加所得的电压即可。
本发明的另一方面所涉及的电路,优选的是,至少具有第1电阻、第1差动放大器、第1、第2、第3晶体管(双极结晶体管),该第1晶体管的集电极端子与该第1差动放大器的第1输入端子连接,该第2晶体管的集电极端子与该第1差动放大器的第2输入端子连接,该第1及第2晶体管的基极与该第1差动放大器的输出连接,该第1和第2晶体管的发射极尺寸比设定为1∶N,输出对该第1晶体管的基极-发射极间电压进行分压所得的电压和通过在该第1电阻中流过与该第1晶体管或该第2晶体管的集电极电流相等电流而获得的电压相加所得的电压即可。
本发明的别的方面所涉及的基准电压产生电路,具备:第1端子与地电位连接,控制端子和第2端子连接的第1晶体管;第1端子通过第1电阻而与地电位连接,控制端子与上述第1晶体管的第2端子和控制端子共连的第2晶体管;差动输入对分别与上述第1晶体管的第2端子和上述第2晶体管的第2端子连接的差动放大器;以及一端分别与上述第1及第2晶体管的第2端子连接,另一端与上述差动放大器的输出端子共连的第2及第3电阻。
本发明的又另一方面所涉及的电路,优选的是,具有第1、第2、第3电阻、沟道宽度比为1∶N的第1、第2MOS晶体管、第1差动放大器,该第1、第2电阻的一端与该差动放大器的输出连接,该第1电阻的另一端与该第1MOS晶体管的漏极及栅极和该第1差动放大器的第1输入端子连接,该第2电阻的另一端与该第2MOS晶体管的漏极和该第1差动放大器的第2输入端子连接,该第3电阻的一端与该第2MOS晶体管的源极连接,该第3电阻的另一端与地电位连接,并且,把该第1及该第2MOS晶体管的栅极域值电压设定得比BJT的基极-发射极间电压低,从该第1差动放大器的输出端子输出即可。
发明效果
根据本发明,能在减小了该第1差动放大器的偏置电压依赖性的情况下,在比1.2V低的电压下消除温度依赖性,因而偏差小,能实现温度依赖性小的基准电压产生电路。
附图说明
图1是表示现有基准电压电路的构成的一个例子的图。
图2是表示现有基准电压电路的构成的别的例子的图。
图3是表示本发明的第1实施例的构成的图。
图4是表示本发明的第2实施例的构成的图。
图5是表示本发明的第3实施例的构成的图。
图6是本发明中使用的差动放大器的实施例。
图7是表示本发明和现有基准电压电路的输出电压和外部电压的关系的图表。
图8是表示本发明的第4实施例的构成的图。
图9是表示本发明的参考例的构成的图。
标号说明
VEXT 外部电源电压
VREF基准电压
A1、A2差动放大器
R0~R4电阻
Q1~Q5双极结晶体管
M1~M7MOS晶体管
VIN+差动放大器的正输入端子
VIN-差动放大器的负输入端子
VOUT差动放大器的输出端子
VOS 差动放大器的输入换算偏置电压
具体实施方式
为更加详细述说上述本发明,以下参照附图来说明。本发明,参照图3,具备:生成温度系数为正的第1电流(I1)的PTAT电流产生部(BJTQ1、Q2、电阻R0、R0、R2、R4);生成温度系数为负的电压(VBE3)的基准电压产生部(BJT Q3、电阻R1);以及生成把电阻(R1)的端子电压和上述温度系数为负的电压(VBE3)合成所得的电压的合成部(差动放大器A1),还具备生成温度系数为正的第2电流的补偿电流产生部(Q4、Q5、电阻R3)。PTAT电流产生部的BJT Q1、Q2的发射极尺寸比设定为1∶N。作为流过电阻(R1)的电流而流过把第2电流(I4)与第1电流(I1)重叠所得的合成电流(和电流)(I3),合成部(A1)把第1电流(I1)和第2电流(I4)的合成电流所涉及的电阻(R1)的端子电压和上述温度系数为负的电压(VBE3)合成所得的电压作为基准电压(VREF)来输出。补偿电流产生部由把与从合成部(A1)输出的电压(VREF)中减去温度系数为负的电压(Q5的基极-发射极间电压VBE)所得的差电压成比例的电流作为第2电流(I4)来输出的电流镜构成。
根据本发明,在电阻(R1)中重叠流过与晶体管(Q1或Q2)的集电极电流(I1或I2)大体上相等电流和具有比其大的正的温度系数的电流(I4),向其输出把电阻(R1)的端子间电压和晶体管(Q3)的基极-发射极间电压(VBE3)相加所得的电压。
根据这种构成,能在减小了差动放大器(A1)的偏置电压依赖性的情况下,在比1.2V低的电压下消除温度依赖性,因而偏差小,能实现温度依赖性小的基准电压产生电路。
还有,作为本发明的别的实施方式,参照图4,具备:生成温度系数为正的第1电流的PTAT电流产生部(BJT Q1、Q2、电阻R1、R1、R2);生成温度系数为负的电压的基准电压产生部(BJT Q3、电阻R0);对由上述基准电压产生部生成了的温度系数为负的电压进行分压的分压电路(R3、R4);以及生成输出把在电阻中流过上述第1电流而获得的端子电压和对上述温度系数为负的电压(VBE)由分压电路(R3、R4)进行分压所得的电压合成所得的电压的合成部(差动放大器A2)。PTAT电流产生部的BJT Q1、Q2的发射极尺寸比设定为1∶N。还具备非反相输入端子与PTAT电流产生部的BJT Q1的集电极和电阻R1的连接点连接,反相输入端子与BJT Q1的集电极和电阻R1的连接点连接,输出端子与BJT Q3的基极连接的差动放大器(A2)。BJT Q1、Q2、Q3的基极共连。差动放大器(A2)的非反相输入端子与分压电路(R3、R4)的输出端子连接,反相输入端子与BJT Q3和电阻R0的连接点连接。通过输出对BJT Q1基极-发射极间电压(=VBE)进行分压所得的电压(={R4/(R3+R4)}VBE)和在电阻(R0)中流过与BJT Q1、Q2的集电极电流(I1或I2)大体上相等电流而获得的电压相加所得的电压,就能在减小了该差动放大器(A1)的偏置电压依赖性的情况下,在比1.2V低的电压下消除温度依赖性。因此,根据本发明的别的实施方式,偏差小,能实现温度依赖性小的基准电压产生电路。
根据本发明的又一别的实施方式,参照图5,具备:第1端子与地电位连接,控制端子和第2端子连接的第1晶体管(M1);第1端子通过第1电阻(R2)而与地电位连接,控制端子与上述第1晶体管的第2端子和控制端子共连的第2晶体管(M2);差动输入对分别与上述第1晶体管的第2端子和上述第2晶体管的第2端子连接的差动放大器(A1);以及一端分别与上述第1及第2晶体管(M1、M2)的第2端子连接,另一端与上述差动放大器(A1)的输出端共连的第2及第3电阻(R1、R1)。以MOS晶体管构成第1、第2晶体管(M1、M2),沟道宽度(W)的比设定为1∶N。把第1及该第2MOS晶体管的栅极域值电压设定得比BJT的基极-发射极间电压低,从该第1差动放大器的输出端子输出,从而能在减小了该第1差动放大器的偏置电压依赖性的情况下,在比1.2V低的电压下消除温度依赖性,因而偏差小,能实现温度依赖性小的基准电压产生电路。另外,在此实施方式中,第1、第2晶体管也可以是发射极尺寸的比为1∶N的BJT。以下就实施例进行说明。
实施例
图3是表示本发明第一实施例的构成的图。本实施例构成为,对于图2所示的电路,对电阻R1,使得输出电压VREF<带隙电压而减小其电阻值。并且,新设置用于产生具有比PTAT电流大的正的温度系数的电流的补偿电流产生部,把由补偿电流产生部生成了的电流与PTAT电流合成,使其流过电阻R1。
更详细而言,参照图3,在本实施例的基准电压产生电路中,补偿电流产生部具备:集电极与电阻R1、晶体管Q3的基极和集电极的连接点连接,发射极与地电位连接的BJT Q4;以及发射极与地电位连接,集电极和基极通过电阻R3而与差动放大器A1的输出连接的BJT Q5,BJT Q4、Q5的基极共连,构成电流镜。
参照图3,在本实施例中,PTAT电流产生部,与图2的构成同样,具备:一端与差动放大器A1的输出连接的电阻R0;集电极与此电阻R0的另一端连接,发射极与地电位连接的BJT Q1;一端与差动放大器A1的输出连接的电阻R0;以及集电极与此电阻R0的另一端连接,发射极通过电阻R2而与地电位连接的BJT Q2,BJT Q1、Q2的发射极尺寸比设为1∶N。
还有,基准电压产生部具备:一端与差动放大器A1的输出连接的电阻R1;以及集电极和基极与电阻R1的另一端连接,发射极与地电位连接的BJT Q3。BJT Q2的基极通过电阻R4而与BJT Q1的基极连接,BJT Q3的基极和集电极与BJT Q1的基极连接。
根据这种构成,能在减小了差动放大器的偏置电压依赖性(VOS依赖性)的情况下,在比现有技术的带隙电压(1.2V)低的电压下消除温度依赖性。图7对比表示本发明和现有技术中的输出电压和外部电压的关系。另外,在图7中,纵轴的输出电压(VOUT)对应于输出基准电压VREF。例如输出电压,现有技术是1.26V,而根据本发明,能消除输出电压(VOUT)的温度依赖性,减小差动放大器的偏置电压依赖性而输出比现有技术低的输出电压。
具有比PTAT电流大的正的温度系数的电流I5由电阻R3和BJT Q5生成。电阻R3的一端与差动放大器A1的输出端子连接,电阻R3的另一端连接于发射极与地电位连接的BJT Q5的基极和集电极。
还有,把BJT Q4的集电极与BJT Q3的集电极和电阻R1的连接节点连接,把其基极与BJT Q5的集电极和基极连接,从而构成电流镜,在电阻R1中流过与电流I5成比例的电流I4(=I5)。
此处,电流镜电路(Q4、Q5)的输入电流I5(BJT Q5的集电极电流)由下式(13)表示。
对于输出电压(基准电压)VREF,温度依赖性被抵消,温度系数成为零的话,电流I5的温度依赖性就由晶体管Q5的基极-发射极间电压的负极性-VBE来决定。
另一方面,用于产生PTAT电流的BJT Q1和Q2的基极-发射极间电压VBE的差ΔVBE由上式(1)表示。
VBE的温度依赖性为-2mV/℃
ΔVBE在N=10时为+0.2mV/℃
VBE一方的温度依赖性大达10倍的程度。
补偿电流产生部的输出电流I4的温度系数(正特性)就比基于Q1、Q2的基极-发射极间电压的差电压的PTAT电流I1的温度系数大。
因而,使得电阻R1中也中流过补偿电流产生部的输出电流I4,电阻R1就能以比图2的构成的场合小的电阻值来消除输出电压的温度依赖性。关于电阻R1的端子间电压,流过该电阻R1的电流I3的温度依赖性相当于把PTAT电流I1和补偿电流产生部的输出电流I4重叠所得的电流(和电流)(在实效上温度系数的值变大)。
此处,输出电压VREF根据式(7)由下式(14)给出。
VREF=R1·I3+VBE3
(14)
根据式(14),通过减小电阻R1的电阻值,由差动放大器A1输出的基准电压VREF就会更低。即,能输出1.2V以下的基准电压VREF。
其次,说明本发明的第2实施例。图4是表示本发明的第2实施例的构成的图。在本实施例中,把2个BJT Q1、Q2(发射极尺寸比1∶N)的集电极端子和差动放大器A1的差动输入端子分别连接,把BJT Q1、Q2的基极和差动放大器A1的输出连接而作成反馈环,BJT Q2的发射极连接于一端与地电位连接的电阻R2,使得BJT Q1、Q2的基极及集电极中流过PTAT电流,把对BJT Q1的基极-发射极间电压VBE进行分压所得的电压和在电阻值比电阻R1小的电阻R0中流过PTAT电流时的电压合成,从而就能在减小了VOS依赖性的情况下,以比现有带隙电压(1.2V)低的电压来消除温度依赖性。
此处,以下证明BJT Q1、Q2的集电极电流I1、I2为PTAT电流。
其中,α是BJT Q2的电流放大率(I2=αI2′)。
在上述式(3)中,在对BJT Q1的基极-发射极间电压VBE1和电阻R1共同乘以系数m(0<m<1)的场合,输出电压变小为m×VRFF,而没有温度依赖性这样的特性则原样被保持,这很明显。
在本实施例中基于此原理。即,通过电阻R3和R4来产生基极-发射极间电压VBE的分压电压。
另一方面,新设置BJT Q3,把BJT Q3的基极与BJT Q1、Q2的基极连接而构成电流镜。根据这种构成,在BJT Q3中就会流过PTAT电流I3。
在本实施例中,如图4所示,差动放大器A2被追加,把非反相输入端子(+)与电阻R3和R4的连接点连接,输入基极-发射极间电压VBE的分压电压(VBE×R4/(R3+R4)),把其输出通过电阻R0而与BJT Q3的集电极连接。根据要这样的构成,BJT Q3的集电极(与差动放大器A2的反相输入端子连接)为基极-发射极间电压VBE的分压电压。
BJT Q3的集电极中流过PTAT电流I3,所以电阻R0中也流过PTAT电流I3。此处,把电阻R0电阻值设为,对于不对基极-发射极间电压VBE进行分压就能消除温度依赖性的大小,乘以与基极-发射极间电压VBE的分压比(={R4/与(R3+R4)})相同的系数所得的值的话,就能获得没有温度依赖性,比现有电路低的电压的基准电压VREF。
差动放大器A2的输出端子还与PTAT电流产生电路的电阻R1的一端连接。差动放大器A2的输出电压不依赖于外部电压、温度,因而能获得稳定的PTAT电流。
其次,说明本发明的第3实施例。图5是表示本发明的第3实施例的构成的图。在本实施例中,为了PTAT电流的产生和基准电压的产生,采用了MOS晶体管。
MOS晶体管的阈值电压VT可以比BJT的基极-发射极间电压VBE低。因此,根据本实施例,与采用了BJT的场合的构成相比,能获得更低电平的输出电压VREF。
参照图5,本实施例由3个电阻(R1为2个,R2为1个)和沟道宽度比设定为1∶N的MOS晶体管M1、M2以及差动放大器A1构成。
N沟道MOS晶体管M1连接成二极管,其漏极端子和栅极端子与差动放大器A1的非反相输入端子(+)连接。N沟道MOS晶体管M2的漏极端子与差动放大器A1的反相输入端子(-)连接,MOS晶体管M2的栅极与MOS晶体管M1的漏极及栅极连接,MOS晶体管M2的源极与电阻R2的一端连接。电阻R2的另一端与地电位连接。MOS晶体管M1、M2的漏极分别连接于一端与差动放大器A1的输出端子共连的2个电阻R1、R1的另一端。
MOS晶体管在弱反转区域(或亚域值区域)动作时,与BJT的基极-发射极间电压和集电极电流的关系同样,在栅极-源极电压和漏极电流之间,下式(16)成立。
此处,n是依赖于工艺的常数,通常取1~2的值。
因此,采用图5那样的构成,与使用了BJT的场合相同,在电阻R1中流过PTAT电流I1(=I2)。即,MOS晶体管M1、M2的栅极·源极间电压的差电压ΔVGS=VGS1-VGS2由下式(17)表示。此处,设为n=1。因此,I1(=I2)由下式(18)表示。
另一方面,MOS晶体管的域值电压VT也具有与BJT的基极-发射极间电压VBE大体上相同的温度依赖性。
因此,使得MOS晶体管的域值电压VT低于BJT的基极-发射极间电压VBE,与采用了BJT的场合相比,就能以低的输出电压VREF来消除温度依赖性。这一点在本实施例的电路中从次式(19)成立可以看出。
VREF=VT(M1)+I1R1
(19)
根据式(19)可以看出,第1项具有负的,第2项具有正的温度依赖性,所以适当调整电阻R1,就能消除温度依赖性。
此处,在本实施例中,输出电压(输出基准电压)VREF的差动放大器的输入偏置电压依赖性是与参照图3、图4说明了的上述第1、第2实施例大体上相同的程度。
这是因为与上述第1、第2实施例同样,通过MOS晶体管M2的放大作用,输出电压VREF的微小变化(VOS的程度)使得M2的漏极电流变化,R1使其漏极电压很大地变化。
在本实施例的电路构成中,与工艺偏差伴随的MOS晶体管的阈值电压VT的绝对值偏差(50mV~100mV)会原样出现在输出电压(输出基准电压)VREF上,因而也可以说不是面向特别要求高精度的用途。然而,元件数少,没有N阱、P阱等面积大的结合部,所以漏泄电流少,例如,可以面向需要1uA或其以下的低消耗电流化的用途。
其次,说明本发明的第4实施例。图8是表示本发明的第4实施例的构成的图。在本实施例中,用BJT置换了图5的N沟道MOS晶体管。
在本实施例中,输出电压VREF与图2所示的构成大体上相同,不过,元件数少,相应降低了布置面积,这是其优点。
另一方面,必须通过电阻R1来供给BJT Q1和Q2的基极电流,因而有时BJT Q1和Q2的电流密度比会偏离1∶N,不能输出正确的带隙电压。因此,需要某种程度的精度,不过,可以面向想降低面积的用途。
其次,说明本发明的参考例。图9是表示本发明的参考例的构成的图。参照图9,此参考例在图1所示的构成中追加了参照图3说明了的本发明的补偿电流产生部。另外,在图9中,晶体管Q1、Q2设为NPN型BJT,当然也可以如图1那样设为PNP型BJT。
如图9所示,补偿电流产生部具备:一端与差动放大器A1的输出端连接的电阻R3;发射极接地,基极和集电极与电阻R3的另一端连接的BJT Q3;发射极接地,集电极与BJT Q1的集电极一起与节点N1连接,基极与BJTQ3的基极连接的BJT Q4。还具备发射极接地,集电极与BJT Q2的集电极一起与节点N2连接,基极与BJT Q3的基极连接的BJT Q5。电流I3设为(VREF-VBE3)/R3,如上所述,具有正的温度系数。在BJT Q1的集电极电流(PTAT电流)I1上重叠I3的镜像电流I4而成的合成电流(和电流)流过连接在节点N1和差动放大器A1的输出端子之间的电阻R1,在BJT Q2的集电极电流(PTAT电流)I2上重叠镜像电流I4而成的合成电流(和电流)流过连接在节点N2和差动放大器A1的输出端子之间的电阻R1。
根据图9的参考例的电路,使得在PTAT电流I1(或I2)上重叠由补偿电流产生部生成了的温度系数为正的电流I4而成的电流流过电阻R1,从而减小电阻R1的电阻值,使得输出电压(输出基准电压)VREF成为比图1的现有技术低的电压。另外,在由MOS晶体管构成了差动放大器A1的场合,如上所述,偏置VOS会以10倍的程度出现在输出上,不过,在此场合,如上所述,通过用激光、电熔化等修整电阻R1或R2等,或是对差动放大器附加偏置调整功能等,就能输出例如比1.26V低的基准电压VREF。
以上就各种实施例说明了的本发明可适用于例如在电源电压1.5V以下的低电源电压下动作的存储器、逻辑、模拟集成电路等广泛的集成电路。
以上就上述实施例说明了本发明,当然,本发明不限于上述实施例的构成,而是还包括在本发明的范围内本领域技术人员能做的各种变形、修正。