CN100350737C - 二点调制相位锁定回路电路的修正方法及修正电路 - Google Patents

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Abstract

在基于二点调制原理运作的相位锁定回路电路的修正方法的情况中，该相位锁定回路电路没有施加任何调制而被锁定，随后一模拟和一数字调制信号被施加至锁定的相位锁定回路电路。表示该相位锁定回路控制误差的信号从该相位锁定回路电路被抽出，且于该模拟调制信号中的调制摆动被改变，因此表示该特征信号具有与该模拟及数字调制信号被施加之前的相同值。

Description

二点调制相位锁定回路电路的修正方法及修正电路
技术领域
本发明涉及以二点调制为基础而运作的相位锁定回路(PLL)电路的修正方法，以及涉及此种用以外加一模拟及一数字调制信号的PLL电路。
背景技术
在移动射频系统中的传接器用的低复杂度实施的传输器设计已由传输器提供，其中一PLL(Phase Locked Loop，相位锁定回路)电路被以当成一频率合成器，并用以提供射频信号的频率调制及相位调制。
该被调制的信号一般使用设置于该PLL回路的反馈路径的分频器被输入该PLL电路。这包括一数字调制信号的使用，其用以持续重新写入数字分频器的程序。此调制的型态，其亦被称为“单点调制”，是属于已知技术，并且于例如，美国专利US4,695,531，6,008,073以及6,044,124中有描述。
为达成PLL电路中的低噪声，此电路的频宽被设计成远比传输被调制数据所需要的频宽低。为此理由，除了单纯的数字调制，模拟信号也被使用以便补偿受限的频宽。同时施加一数字及一模拟调制信号至一PLL电路被称为“二点调制”。
代表最接近的已知技术的德国公开说明书DE199 29 167 A1描述一种二点调制方法以及使用PLL电路的二点相位或频率调制的方法。此外，用以程序化该频率调制器的数字调制信号借助数字模拟转换被转换为模拟调制信号，然后于位于一适合位置的一加总点被输入该PLL电路。该二调制信号在PLL输出被互相重叠，且于此方式获得PLL电路用的频率独立的转换响应。
二点调制的困难在于，基于同相位(inphase)同步，需要所使用的二调制信号的振幅之间的同时发生的一高准位。然而，由于模拟调制的组件中的制造误差，在模拟调制坡度及调制的振幅准位中总是产生变化。为此，在PLL电路的制造之后需要执行模拟及数字调制之间的振幅修正。
如果另外还需要考虑温度的干扰，此种修正需要在每一传输运作之前再次被执行。
一种已知的PLL电路的修正方法包括，在锁定状态于电路上施加二点调制，并使用一外部测试接收器以接收被传输的信号，对它解调制并基于解调制的结果修正数字及模拟信号。考虑PLL电路中关于控制电压为频率的函数的产生振荡的组件(这是一个压控振荡器或VOC)的非线性响应，此修正需要为每一频道执行。然而，当有大数量的频道存在时，这表示相对长的测试周期。此外，此修正信息需要被储存于一内存中，且因此另一缺点在于温度改变的干扰在此方法中未被列入考虑。
另一种操作是使用传接器的接收部接收并解调制由PLL产生的信号。然而，这将需要接收器中的一个完整的第二PLL电路，这大大增加电路的复杂度。
发明内容
本发明是基于指定一种以允许低复杂度的快速振幅调整的二点调制的原理为基础而运作的PLL电路的目的，尤其是，允许温度干扰被列入考虑。本发明的目的亦为指定一种具有能够以低复杂度实施并允许调制信号振幅的快速修正并不具任何问题的修正单元的PLL电路。
本发明的目的基于借助以下技术方案的特征而达成。
根据本发明的一种基于二点调制原理运作的相位锁定回路电路的一模拟和一数字调制信号之间的振幅修正方法，其中该模拟调制信号经由一加总点在一压控振荡器的输入侧被注入该相位锁定回路电路，且该数字调制信号被施加于设置在该相位锁定回路电路的反馈路径中的一分频器，具有以下步骤：该相位锁定回路电路没有施加任何调制而被锁定在一期望的载波频率；一模拟和一数字调制信号被施加至锁定的相位锁定回路电路，其产生一相位锁定回路电路控制误差；表示该相位锁定回路电路控制误差的一信号从该相位锁定回路电路被抽出；以及，改变该模拟调制信号中的调制摆动，由此表示该相位锁定回路电路控制误差的该信号具有与该模拟及数字调制信号被施加之前的相同值。
根据本发明的一种相位锁定回路电路，用以基于二点调制原理施加一模拟和一数字调制信号，具有：压控振荡器，其输入侧具有一加总点连接至其上游，用以将该模拟调制信号注入该相位锁定回路电路；以及，分频器，设置在该相位锁定回路电路的反馈回路且于其上施加该数字调制信号，该相位锁定回路电路具有一相关的修正电路，其包括：用以当从该相位锁定回路电路施加该模拟和数字调制信号时抽取该相位锁定回路电路控制误差特征的信号的装置；用以评估该特征信号的装置；以及，用以基于该评估结果改变该模拟调制中的调制摆动的装置。
依据本发明，PLL电路开始运作，亦即被锁定于一想要的频率，而没有被施加任何的调制。接着，一模拟及一数字调制信号被施加于该锁定的PLL电路。假设这些信号没有相等的振幅(于此情况中，此调制摆动已经被修正)，这造成一个PLL控制误差。一个具有该PLL控制误差的信号随后从PLL电路被抽出。模拟信号中的摆动随后被改变，因此具有PLL控制误差的信号具有与模拟及数字信号被施加之前的相同值。
以此型态的修正，由PLL电路产生的输出信号未被解调制，因为修正包含返回代表PLL电路中控制误差的特征的信号。因此，不需要提供内部或外部解调器，其维持降低的电路复杂度并达成本发明修正方法的高度可行性。
本发明方法的有益的例示实施例的特征在于具有PLL电路的控制误差特征的信号是一电压信号，其经由一电荷泵(pump)及一低通滤波器(lowpass filter)从该PLL电路被抽出。借助这些组件的适当设计，可以达成修正方法的足够高度的敏感度。
为改变模拟调制信号中的调制摆动，最好实施以下的步骤：表示控制误差的特征的信号与具有一固定值的参考信号比较，因此产生一比较信号。该比较信号在施加模拟及数字调制之前及之后被评估。模拟调制信号中的调制摆动基于该评估结果而被改变。
本发明方法的一有益的例示实施例的特征在于该参考信号是借助在未激励状态(deactivated)调整(亦即程序化)该PLL电路至一想要的频道中央频率而被提供。
驱动该PLL电路并因此将其锁定，并于锁定期间从PLL电路中的代表控制误差的信号产生该参考信号。于此实施例中，修正所需的该参考信号是使用该PLL电路本身而到达一特定程度。
另一例示实施例，其亦为有益的，的特征在于从外部提供一规定的参考信号。该规定的参考信号对所有频道中央频率可皆为相同，或其亦可提供一个依想要的频道中央频率而定的参考信号。
本发明的PLL电路具有一相关的修正单元，其包括一装置用以从PLL电路抽取代表该PLL控制误差特征的一信号，以及一装置用以评估代表该PLL控制误差特征的信号，同时具有一装置用以基于该评估结果改变该模拟调制信号中的调制摆动。
一种，使用简单的电路，从PLL电路中抽取代表该PLL控制误差特征的一信号的装置的不昂贵实施包括一电荷泵以及连接该电荷泵的下游的一低通滤波器。评估该特征信号的装置最好包括用以比较代表该控制误差特征的信号与具有一固定值的一参考信号的装置，因此产生一比较信号，以及用以在施加该模拟及数字信号之前及之后评估该比较信号的装置。于此情况中，该参考信号应该被选择，因此该比较装置(比较器)在最大敏感度范围中操作。
本发明还包括其它有益的改善。
附图说明
本发明使用二实施例参照所附图式被说明如下：
图1表示依据本发明以二点调制原理为基础并具有一修正单元的PLL电路设计；
图2表示图1所示的修正电路的第一实施例；
图3表示图1所示的修正单元的第二实施例；
图4表示用于修正单元中的电荷泵的电路图；以及
图5表示用于修正电路的低通滤波器的电路图。
具体实施方式
图1表示以二点调制原理为基础而运作的PLL电路10，其被连接至一修正单元30。
依据一般设计，PLL电路10的信号路径具有一相位检则器PFD(PhaseFrequency Detector，相位频率检测器)12，一电荷泵CP 24，一回路滤波器LF 14，一加总点15以及一压控振荡器VCO 16。
VCO 16产生PLL电路10的振荡并从PLL电路10传递一频率信号Fout做为输出信号。
PLL控制回护10由一反馈路径封闭，其将来自VCO 16的输出信号经由一可程序化的分频器DIV 18送回频率检测器12。
PLL电路做为二点调制的频率合成器的行为为已知。二点调制包括被施加于PLL电路10的一数字及一模拟信号。图1表示一调制电路11的例，其用以调节二调制信号并将其提供给PLL电路10。此处例示的调制电路11包括一程序装置20以及一数字-模拟转换器ADC 22一调制信号在加总点19被加至一承载信号，形成PLL频率合成的基础，且所产生的加总信号21被提供给程序装置20。此外，此调制信号也被提供给数字-模拟转换器22。
此程序装置20，其可为例如包含一sigma-delta调制器的一程序装置，产生提供给该可程序化分频器18的一控制信号23。该控制信号23是一数字信号，其指定一分割比例1∶N。N为整数且因为调制信号而被改变，因此可程序化分频器18持续被重新程序化。分频器18的重新程序化施加数位调制至PLL电路10。
分频器18可以是，例如，一“N份分频器”。N份分频器也允许非整数的频率分割(“频率合成技术”)。频率合成技术是有益的，因为可避免在整数分割的情况中由于输出信号频谱中的边线所产生的干扰。
使用数字-模拟转换器22及加总点15执行模拟调制。该数字-模拟转换器22产生一模拟输出，其借助加总点15与VCO 16的控制信号重叠。
将指出的是调制电路11也可以其它方式被实施。例如，当模拟调制信号被使用时，数字-模拟转换器22可被免除且对应的信号转换可于数字调制路径中被执行。本发明的重点在于，对于二点调制，调制信号的一者是模拟信号，而另一者是数字信号。
PLL电路在锁定状态中工作的方式是已知，并简要说明如下：
分频器DIV 18输出一频率分割信号13，其从PLL电路10的输出信号以已经描述的方式借助分频器产生。相位检测器PFD 12比较所获得的信号的相位并产生对应所获得的二信号之间的不同相位的一控制信号17。控制信号17用以驱动电荷泵24。以控制信号17为基础在电荷泵24中产生的电流被用以对回路滤波器LF 14充电。因为回路滤波器LF 14是一低通滤波器，相当高频的信号成份在此方式中被去除。回路滤波器LF 14的输出随后被使用，在加总点15的模拟调制之后，以控制振荡器16。
因为模拟信号受到漂移及偏差，不像数字调制信号23，因为其不连续天性而不具有偏差，需要使二调制信号的振幅更相似。为此目的，PLL电路10被耦合至一修正单元30，其操作及设计将于下文进一步描述。修正单元30输出一控制信号31，其被提供给一装置32用以干扰模拟调制信号的振幅。
为给予较佳的了解，将简要说明二点调制技术的动作原理：在操作期间，施加调制至PLL回路12，24，14，16，18不必要包括任何由封闭控制回路的调制的响应。这借助在加总点15被一分频器18中的分割因子中的对应相反改变所补偿而以模拟形式被施加的模拟调制，以数字调制激励，而达成。因此，如果模拟调制增加来自VCO的输出频率Fout，则分割因子同时需要被增加至相同的程度(借助数字调制)，因此来在分频器18的输出频率(分频器信号13)由调制维持不变。同样地，如果输出频率Fout被降低，分割因子因此也需要被降低。也就是说，如果模拟及数字调制摆动同时准确发生，封闭回路的行为如同开回路。
如果调制摆动不同时发生，则PLL回路校正此误差。调制摆动的不相同的测量是当加上调制时出现在回路滤波器LF 14的输出的电压改变。然而，此电压改变通常是很小的(数个mV)。本发明是基于使用一平行路径至相同的效果以使此电压改变存在于可轻易评估的等级(例如数个100mV)的想法，于该行况中适用：在PLL控制回路中没有控制行为表示在相位检测器PFD 12上没有行动，且因此在平行路径的输出上没有电压改变。
图2表示本发明修正单元30的第一例示实施例。修正单元30包括一第二电荷泵CP2 33以及一第二低通滤波器LF2 34，其连接至第二电荷泵CP2的下游。第二电荷泵CP2及第二低通滤波器LF2 34产生以上所述的平行路径。低通滤波器LF2 34的输出被提供给比较器35的一输入。比较器35的另一输入连接至缓冲器36的输出。电容37位于第二表较器输入与地之间。比较器35的一输出被提供至产生控制信号31的一评估电路28。
本发明修正单元30以下列方式被用以修正调制振幅：
首先，PLL电路10在传输运作之前被程序化至想要的频道中央频率。这仅借助调整分频器18上的适合的分割因子N或数字频道代表(例如一频道字符，当使用N份sigma-delta程序器20时)。
当想要的频道中央频率已被设定，PLL电路10被开启并锁定于该频道中央频率。
当PLL电路10被锁定时，第二低通滤波器LF2 34经由第二电荷泵CP233被充电。在锁定期间为关闭的开关39被用以提供来自LF2 34的输出信号至缓冲器36。这包括设置于被充电的缓冲器36的输出的电容37。
电容37的充电用以产生一参考信号。当PLL电路10已被锁定时，开关39开启。其结果为借助电容37充电的电压现在被施加至比较器35的第二输入做为一固定参考电压Vref。
接着，固定的调制(亦即，“DC电压测试调制”)以模拟及数字形式被施加一特定期间。由于前述模拟调制中的振幅误差(亦即，由于和数字调制摆动比较的模拟调制摆动的误差)，由第二低通滤波器LF2输出的电压现在将因此改变。第二低通滤波器LF2的输出的电压与在比较器35中与参考电压比较，而比较的结果持续被传输至评估电路38。评估电路38评估从比较器35获得的比较信号，且因此检测由第二低通滤波器LF2输出的电压中的改变(亦即，评估电路38比较PLL锁定之后但在模拟及数字调制施加之前获得的比较器比较信号与在模拟及数字调制已被施加所获得的比较器比较信号)。由评估电路38所产生的控制信号31随后使用装置32以激励模拟调制摆动或模拟调制的振幅的改变，因此在第二低通滤波器LF234的输出出现的电压差异相对于之前步骤(无调制)中所获得的电压被消除。
由比较器35输出的信号可在评估电路38中使用，例如，一叠代处理而被评估，亦即，此模拟调制震幅以控制信号31的交替更新以及来自比较器35的产生的，改变的输出信号的评估一步接一步地被近似修正。当低通滤波器LF2的输出的电压改变已被消除，当加上模拟及数字调制所发生的电压改变，数字及模拟调制摆动可被对齐。
图3表示修正单元30的第二实施例。相同的组件或具有相同功能的组件使用同图2的标号被指出。修正单元30又包括一第二电荷泵CP2 33，一第二低通滤波器LF2 34，一比较器35以及一评估电路38。相对于这些组件，第二实施例的电路设计与图2所示的第一实施例的电路设计相同。此外，此电路具有一点40，经由该点施加一规定的外部固定参考电压Vref至第二比较器输入。该外部参考电压Vref也可以经由开关39’被施加至第二低通滤波器LF2 34。
图3所示的电路与图2所示的电路实质的不同仅在于比较器35的参考电压于此例中并未从PLL的锁定处理中导出，而是从外部产生。此调制摆动以下列方式被修正：
在PLL电路10被开启之前或当PLL电路10已被开启并已锁定，第二电荷泵CP2 33被去除激励且开关39’被关闭。其结果在于第二低通滤波器LF 34仅使用参考电压Vref而被充电(预充电)，因为第二电荷泵CP2 33在去除激励状态具有高阻抗。评估电路30因此在此状态中不与PLL电路10耦合。
在低通滤波器LF2 34的充电，PLL电路10的频道中央频率的设定及锁定处理之后，其于此情况中使修正单元30不作用，开关39’打开。这固定施加至比较器35的第二输入的参考电压(至少在后续修正期间)。接着，第二电荷泵CP2 33被驱动。其它对应此方法的程续已经参照图2解释(施加固定的模拟及数字调制，使用评估电路38以及用以干扰模拟调制信号的振幅用的装置32修正在此处理中于低通滤波器34的输出产生的电压差异)。
二实施例皆允许第二比较器输入所需的固定参考电压以小复杂度及节省功率的方式被产生。在第二例示实施例中，所使用的参考电压可以是例如，任何方式呈现的供应或频带间隙电压。于此情况中此参考电压应该在比较器35的尽可能的最大敏感度范围中。
图4表示第二电荷泵CP2 33一种可能的实施。第二电荷泵CP2 33包括二可控制的电流源33.1及33.2，其串连于一操作电压及地之间。此二可控制的电流源33.1，33,2通常是单一晶体管或多重晶体管电路电流源33.1，33.2借助一输入信号，于本例中为PLL电路中由控制误差提供的控制信号17，而为可控制的。此电荷泵也可借助提供直接由适当设计的相位检测器输出的二控制信号(上及下信号)而被驱动。此例中所示的第二电荷泵33的输出在二电流源33.1及33.2之间的连接分叉。
图5表示第二低通滤波器LF2 34的电路范例。如同图4所示的电路范例，可以使用多样化的其它电路。
低通滤波器34包括三个电容34.1，34.2及34.3，其-在经由一电阻34.4的情况中-可经由滤波器输入被充电。此信号路径包括一电阻34.5。
综言的，可以说明二实施例在提供参考电压Vrfe的特征上是可比较的，且其共同的行为是基于，在二调制之间的振幅差异的结果，相位检测器PF 12建立由修正单元30拾取的控制误差，以适合的方式被调节，并用于振幅修正。

Claims (9)

1.一种基于二点调制原理运作的相位锁定回路电路(10)的一模拟和一数字调制信号之间的振幅修正方法，其中该模拟调制信号经由一加总点(15)在一压控振荡器(16)的输入侧被注入该相位锁定回路电路(10)，且该数字调制信号被施加于设置在该相位锁定回路电路(10)的反馈路径中的一分频器(18)，具有以下步骤：
该相位锁定回路电路(10)没有施加任何调制而被锁定在一期望的载波频率；
一模拟和一数字调制信号被施加至锁定的相位锁定回路电路(10)，其产生一相位锁定回路电路控制误差；
表示该相位锁定回路电路控制误差的一信号从该相位锁定回路电路(10)被抽出；以及
改变该模拟调制信号中的调制摆动，由此表示该相位锁定回路电路控制误差的该信号具有与该模拟及数字调制信号被施加之前的相同值。
2.如权利要求1所述的基于二点调制原理运作的相位锁定回路电路(10)的一模拟和一数字调制信号之间的振幅修正方法，其特征在于，
表示该相位锁定回路电路(10)中的该相位锁定回路电路控制误差的信号是一电压信号，其经由一电荷泵(33)和一低通滤波器(34)从该相位锁定回路电路(10)被抽出。
3.如权利要求1所述的基于二点调制原理运作的相位锁定回路电路(10)的一模拟和一数字调制信号之间的振幅修正方法，其特征在于以下步骤：
该表示该相位锁定回路电路控制误差的信号与具有固定值的一参考信号比较，因此产生一比较信号；
该比较信号在该模拟及数字调制被施加之前和之后被评估；以及
基于该评估结果而改变该模拟调制信号中的调制摆动。
4.如权利要求3所述的基于二点调制原理运作的相位锁定回路电路(10)的一模拟和一数字调制信号之间的振幅修正方法，其特征在于，
该参考电压由以下步骤提供：
在未激励状态中调整该相位锁定回路电路(10)至一期望的频道中央频率；
驱动该相位锁定回路电路(10)且由此将其锁定；以及
在该锁定处理期间从该表示该相位锁定回路电路(10)中的该相位锁定回路电路控制误差的信号产生该参考信号(VREF)。
5.如权利要求3所述的基于二点调制原理运作的相位锁定回路电路(10)的一模拟和一数字调制信号之间的振幅修正方法，其特征在于，
提供一规定的外部参考信号(VREF)。
6.一种相位锁定回路电路，用以基于二点调制原理施加一模拟和一数字调制信号，具有：
压控振荡器(16)，其输入侧具有一加总点(15)连接至其上游，用以将该模拟调制信号注入该相位锁定回路电路(10)；以及
分频器(18)，设置在该相位锁定回路电路(10)的反馈回路且于其上施加该数字调制信号，该相位锁定回路电路(10)具有一相关的修正电路(30，32)，其包括：
用以当从该相位锁定回路电路(10)施加该模拟和数字调制信号时抽取该相位锁定回路电路控制误差特征的信号的装置(33，34)；
用以评估该特征信号的装置(35，38)；以及
用以基于该评估结果改变该模拟调制中的调制摆动的装置(32)。
7.如权利要求6所述的相位锁定回路电路，其特征在于，
所述从相位锁定回路电路(10)抽取该相位锁定回路电路控制误差特征的信号的装置(33，34)包括一电荷泵(33)以及连接于该电荷泵下游的一低通滤波器(34)。
8.如权利要求6或7所述的相位锁定回路电路，其特征在于，
所述评估特征信号的装置(35，38)包括：
用以将该控制误差的特征的信号与具有一固定值的参考信号(VREF)相比较的装置(35)，以产生一比较信号；以及
用以评估该模拟及数字调制被施加之前和之后的该比较信号的装置(38)。
9.如权利要求8项所述的相位锁定回路电路，其特征在于，
设置一开关装置(39)，由此所述用以抽取该相位锁定回路电路控制误差特征的信号的装置(33，34)可用以在该相位锁定回路电路(10)锁定期间产生该参考信号(VREF)。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102647186A (zh) * 2011-02-17 2012-08-22 联发科技股份有限公司 信号产生电路、增益估测装置与信号产生方法

Families Citing this family (40)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE10147963A1 (de) * 2001-09-28 2003-04-30 Infineon Technologies Ag Abgleichverfahren für eine nach dem Zwei-Punkt-Prinzip arbeitende PLL-Schaltung und PLL-Schaltung mit einer Abgleichvorrichtung
DE10207544A1 (de) * 2002-02-22 2003-09-18 Infineon Technologies Ag Verfahren zum Abgleichen eines Zwei-Punkt-Modulators und Zwei-Punkt-Modulator mit einer Abgleichvorrichtung
EP1535390B1 (en) * 2002-09-06 2006-04-19 Telefonaktiebolaget LM Ericsson (publ) Trimming of a two point phase modulator
US7158603B2 (en) * 2002-12-26 2007-01-02 Freescale Semiconductor, Inc. Method and apparatus for compensating deviation variances in a 2-level FSK FM transmitter
DE10330822A1 (de) * 2003-07-08 2005-02-10 Infineon Technologies Ag Zwei-Punkt-Modulator-Anordnung sowie deren Verwendung in einer Sende- und in einer Empfangsanordnung
JP3934585B2 (ja) * 2003-08-22 2007-06-20 松下電器産業株式会社 広帯域変調ｐｌｌ、広帯域変調ｐｌｌのタイミング誤差補正システム、変調タイミング誤差補正方法および広帯域変調ｐｌｌを備えた無線通信装置の調整方法
WO2005042543A1 (en) * 2003-10-30 2005-05-12 Cj Corporation Processes for the preparation of cephem derivatives
DE602004007095T2 (de) * 2004-01-30 2007-10-11 Freescale Semiconductor, Inc., Austin Doppelzugriffsmodulator mit einem Frequenzsynthetisierer
US7333582B2 (en) * 2004-03-02 2008-02-19 Matsushita Electric Industrial Co., Ltd. Two-point frequency modulation apparatus, wireless transmitting apparatus, and wireless receiving apparatus
DE102004010365B4 (de) * 2004-03-03 2006-11-09 Infineon Technologies Ag Phasenregelskreis, Verfahren zur Frequenzumschaltung in einem Phasenregelkreis und Verwendung des Phasenregelkreises
US7157985B2 (en) * 2004-03-15 2007-01-02 Matsushita Electric Industrial Co., Ltd. PLL modulation circuit and polar modulation apparatus
JP4327666B2 (ja) * 2004-06-23 2009-09-09 株式会社ルネサステクノロジ 無線送信回路及びそれを用いた送受信機
DE102004041656B4 (de) * 2004-08-27 2007-11-08 Infineon Technologies Ag Phasenregelkreis und Verfahren zum Abgleichen eines Schleifenfilters
US7312663B2 (en) * 2005-06-16 2007-12-25 Lsi Corporation Phase-locked loop having a bandwidth related to its input frequency
US7482885B2 (en) * 2005-12-29 2009-01-27 Orca Systems, Inc. Method of frequency synthesis for fast switching
JP2007221773A (ja) * 2006-01-19 2007-08-30 Matsushita Electric Ind Co Ltd Ｐｌｌ変調回路、無線送信装置及び無線通信装置
US7519349B2 (en) * 2006-02-17 2009-04-14 Orca Systems, Inc. Transceiver development in VHF/UHF/GSM/GPS/bluetooth/cordless telephones
US20080007365A1 (en) * 2006-06-15 2008-01-10 Jeff Venuti Continuous gain compensation and fast band selection in a multi-standard, multi-frequency synthesizer
US7714666B2 (en) * 2006-06-15 2010-05-11 Mediatek Inc. Phase locked loop frequency synthesizer and method for modulating the same
DE102006038835B4 (de) * 2006-08-18 2011-03-03 Infineon Technologies Ag Anordnung und Verfahren zur Bestimmung eines Steilheitsfaktors eines digital gesteuerten Oszillators sowie Phasenregelkreis
FI20075478A0 (fi) * 2007-06-21 2007-06-21 Nokia Corp Vaihelukitun silmukan hallinta
DE102007042979B4 (de) 2007-09-10 2017-07-20 Intel Deutschland Gmbh Integrierte Schaltung für Mobilfunk-Sendeempfänger
EP2045911A1 (fr) * 2007-10-05 2009-04-08 The Swatch Group Research and Development Ltd. Procédé d'auto-calibrage d'un synthétiseur de fréquence à modulation FSK à deux points
JP5102603B2 (ja) * 2007-12-21 2012-12-19 ルネサスエレクトロニクス株式会社 半導体集積回路
US8428212B2 (en) * 2008-01-30 2013-04-23 Intel Mobile Communications GmbH Frequency synthesis using upconversion PLL processes
EP2144364A1 (en) * 2008-05-19 2010-01-13 Nxp B.V. Feedback system
KR101544994B1 (ko) * 2008-09-16 2015-08-17 삼성전자주식회사 2점 위상 변조기 및 이 장치의 변환 이득 교정 방법
CN101741451B (zh) * 2008-11-24 2013-04-24 财团法人工业技术研究院 极化发射器,相位调变器以及相位调变方法
US8878041B2 (en) * 2009-05-27 2014-11-04 Microsoft Corporation Detecting beat information using a diverse set of correlations
US8339165B2 (en) 2009-12-07 2012-12-25 Qualcomm Incorporated Configurable digital-analog phase locked loop
US8446191B2 (en) * 2009-12-07 2013-05-21 Qualcomm Incorporated Phase locked loop with digital compensation for analog integration
EP2333972B1 (en) * 2009-12-10 2012-08-29 Nxp B.V. Electronic circuit frequency generation
US8634512B2 (en) * 2011-02-08 2014-01-21 Qualcomm Incorporated Two point modulation digital phase locked loop
FR2978000B1 (fr) * 2011-07-13 2013-08-02 St Microelectronics Grenoble 2 Modulateur deux points a etalonnage de gain precis et rapide
TWI630798B (zh) * 2014-02-07 2018-07-21 美商線性科技股份有限公司 任意相位軌道的頻率合成器
DE102014105909A1 (de) * 2014-04-28 2015-10-29 Phoenix Contact Gmbh & Co. Kg Energieversorgungsgerät
US10623008B2 (en) * 2015-04-30 2020-04-14 Xilinx, Inc. Reconfigurable fractional-N frequency generation for a phase-locked loop
US9634877B2 (en) * 2015-07-01 2017-04-25 Sunrise Micro Devices, Inc. Trim for dual-port frequency modulation
EP3168983B1 (fr) * 2015-11-13 2018-10-17 The Swatch Group Research and Development Ltd. Procédé de calibration d'un synthétiseur de fréquence à modulation fsk à deux points
CN107026615B (zh) * 2017-03-07 2020-05-19 四川海格恒通专网科技有限公司 一种两点调制电路及其工作方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5207491A (en) * 1991-01-31 1993-05-04 Motorola Inc. Fast-switching frequency synthesizer
US5483203A (en) * 1994-11-01 1996-01-09 Motorola, Inc. Frequency synthesizer having modulation deviation correction via presteering stimulus
EP0961412A1 (en) * 1998-05-29 1999-12-01 Motorola Semiconducteurs S.A. Frequency synthesiser

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4965531A (en) 1989-11-22 1990-10-23 Carleton University Frequency synthesizers having dividing ratio controlled by sigma-delta modulator
US5151665A (en) 1991-02-07 1992-09-29 Uniden America Corporation Phase-lock-loop system with variable bandwidth and charge pump parameters
US6008703A (en) 1997-01-31 1999-12-28 Massachusetts Institute Of Technology Digital compensation for wideband modulation of a phase locked loop frequency synthesizer
US5983077A (en) * 1997-07-31 1999-11-09 Ericsson Inc. Systems and methods for automatic deviation setting and control in radio transmitters
US6044124A (en) 1997-08-22 2000-03-28 Silicon Systems Design Ltd. Delta sigma PLL with low jitter
US6034573A (en) * 1997-10-30 2000-03-07 Uniden San Diego Research & Development Center, Inc. Method and apparatus for calibrating modulation sensitivity
US6157271A (en) * 1998-11-23 2000-12-05 Motorola, Inc. Rapid tuning, low distortion digital direct modulation phase locked loop and method therefor
DE19929167A1 (de) * 1999-06-25 2000-12-28 Siemens Ag Modulator und Verfahren zur Phasen- oder Frequenzmodulation mit einer PLL-Schaltung
FR2798019B1 (fr) * 1999-08-26 2002-08-16 Cit Alcatel Synthetiseur de frequences a boucle de phase
CA2281522C (en) * 1999-09-10 2004-12-07 Philsar Electronics Inc. Delta-sigma based two-point angle modulation scheme

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5207491A (en) * 1991-01-31 1993-05-04 Motorola Inc. Fast-switching frequency synthesizer
US5483203A (en) * 1994-11-01 1996-01-09 Motorola, Inc. Frequency synthesizer having modulation deviation correction via presteering stimulus
EP0961412A1 (en) * 1998-05-29 1999-12-01 Motorola Semiconducteurs S.A. Frequency synthesiser

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102647186A (zh) * 2011-02-17 2012-08-22 联发科技股份有限公司 信号产生电路、增益估测装置与信号产生方法
CN102647186B (zh) * 2011-02-17 2014-12-03 联发科技股份有限公司 信号产生电路、增益估测装置与信号产生方法

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