JP4327666B2 - 無線送信回路及びそれを用いた送受信機 - Google Patents
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Description
fRF=fVCO/(2*m)…(2)
fIF=fVCO/(4*N)…(3)
ここで、DCS,PCSの場合は、m=1、GSM850,900の場合は、m=2であり、Nは可変分周数である。
fRF=fIF*2N/m …(4)
fTX=fIF*(2N/m−1)…(5)
式(4)と式(5)は、仮に送信周波数fTXを動かしても常に、送信周波数fTXとIF周波数fIFとが、そしてRF局部発振周波数fRFとIF周波数fIFとが、それぞれ整数比にある事を示しており、IF信号に起因する高調波スプリアスは、大信号を発生している送信周波数帯と一致するため、スプリアスの問題は顕在化しない。
ステップS2では、初期IF分周比設定レジスタINI_DIVのデータ設定を行う。
ステップS3では、初期周波数設定レジスタFS_REGの設定データと第1の切り替え周波数レジスタFSW1とのデータの比較を行い、真ならステップS6を、偽ならステップS4を実行する。
続いてステップS5に進み、初期IF分周比設定レジスタINI_DIVのデータを、IF分周比設定レジスタDIV_REGに格納して動作を終了する。
次に、ステップS8では、IF分周比設定レジスタDIV_REGに、初期IF分周比設定レジスタINI_DIVのデータと、第1の切り替え値設定レジスタDDIV1のデータとの和を格納して動作を終了する。
ステップS10では、IF分周比設定レジスタDIV_REGに、初期IF分周比設定レジスタINI_DIVのデータと、第2の切り替え値設定レジスタDDIV2のデータとの和を格納して動作を終了する。
Claims (9)
- 第1の周波数発生回路と、
第1の周波数変換回路と、
前記第1の周波数変換回路の出力が入力される第2の周波数変換回路と、
第1の分周回路部と
を具備し、
前記第1の周波数発生回路の出力が、前記第1の分周回路部を介して前記第1の周波数変換回路の局部発振信号として供給され、
前記第1の周波数発生回路の出力が、直接または第2の分周回路部を介して前記第2の周波数変換回路の局部発振信号として供給され、
前記第1の周波数発生回路に入力されるリファレンス信号の周波数であるリファレンス周波数の高調波周波数と前記第2の周波数変換回路の局部発振信号の周波数である第2局部発振周波数とが近接しないように、前記第1の分周回路部の分周数が可変に設定され、
前記高調波周波数と前記第2局部発振周波数とが近接することにより生じるスプリアスを、前記高調波周波数と前記第2局部発振周波数とが近接しないように前記分周数が設定されることにより抑圧する
ことを特徴とする無線送信回路。 - 請求項1記載の無線送信回路において、
前記第1の周波数変換回路は直交変調器であり、
前記第1の分周回路部の分周数が偶数に設定されることによって前記直交変調器に入力される90度位相の異なる2つの局部発振信号が発生される
ことを特徴とする無線送信回路。 - 請求項2記載の無線送信回路において、
前記第2の周波数変換回路は、
第1および第2の入力端子を有する第1の位相比較回路と、
前記第1の位相比較回路の出力が入力される第1のループフィルタ回路と、
前記第1のループフィルタ回路の出力が電圧制御端子に接続される第1の電圧制御発振器と、
前記第1の電圧制御発振器の出力が入力される第1のミキサ回路と
を具備し、
前記第1のループフィルタ回路の入力には前記第1の位相比較回路の出力が接続され、
前記第1の位相比較回路の前記第2の入力端子には前記第1のミキサ回路の出力が接続されて成り、
前記第2の周波数変換回路の入力は前記第1の位相比較回路の第1の入力端子である
ことを特徴とする無線送信回路。 - 請求項1乃至3のいずれか記載の無線送信回路において、
前記第1の周波数発生回路は、第2の電圧制御発振器と、第2の可変分周器と、第2の位相比較回路と、チャージポンプ回路と、第2のループフィルタ回路とを含む位相同期ループ回路で構成されて成り、
前記第2の可変分周器の分周数が時変であるフラクショナル型位相同期ループ発振回路である
ことを特徴とする無線送信回路。 - 請求項4記載の無線送信回路において、
前記第1の周波数発生回路は、
前記第2の電圧制御発振器の電圧制御入力に固定電位を与えるバイアス部と、
前記第2の電圧制御発振器の共振周波数を切り替える切り替え部と、
第1の基準信号路で駆動される第1のカウンタ回路と、
前記第2の可変分周器の出力に設けられた第2のカウンタ回路と、
前記第1および第2のカウンタ回路間のカウント時間の差に応じて前記共振周波数の切り替え部の選択を決定する回路部と、
前記第2の可変分周器の分周数を制御する第1のシグマデルタ変調器と、
前記第1のシグマデルタ変調器よりも次数の小さい第2のシグマデルタ変調器とを更に具備し、
前記第1の周波数発生回路が位相同期ループ動作の時には、前記第1のシグマデルタ変調器が用いられ、
前記第1の周波数発生回路がキャリブレーション動作の時には、前記第2のシグマデルタ変調器が用いられる
ことを特徴とする無線送信回路。 - 請求項4記載の無線送信回路において、
前記位相同期ループ回路内の前記第2の可変分周器の分周比の設定は、
第1のシグマデルタ変調器と、
第1の加算器と、
第2の加算器と、
第1の周波数条件記憶部と、
第2の周波数条件記憶部と、
第1の疑似乱数発生回路とを具備する回路により行われ、
前記第1の加算器の出力が前記第2の可変分周器の分周比設定端子に接続され、
前記第1の加算器の、第1の入力端子が前記第1のシグマデルタ変調器の出力に、第2の入力端子が前記第1の周波数条件記憶部の所定の上位ビット列出力にそれぞれ接続され、
前記第1のシグマデルタ変調器の入力が前記第2の加算器の出力に接続され、
前記第2の加算器の第1の入力端子が前記第2の周波数条件記憶部の所定の下位ビット列出力に接続され、
前記第2の加算器の第2の入力端子が前記第1の疑似乱数発生回路に接続されて成り、
前記疑似乱数発生回路の出力が直流成分を発生しない
ことを特徴とする無線送信回路。 - 請求項4記載の送信回路において、
前記第2の可変分周器の分周比を設定するための回路は、
第1のシグマデルタ変調器と、
第1の加算器と、
第1の周波数条件記憶部と、
第2の周波数条件記憶部と、
第1の疑似乱数発生回路と、
第1および第2の微分器と
を含んで成り、
前記第1の加算器の出力が前記第2の可変分周器の分周比設定端子に接続され、
前記第1の加算器の、第1の入力端子が前記第1のシグマデルタ変調器の出力に、第2の入力端子が前記第1の周波数条件記憶部の所定の上位ビット列出力にそれぞれ接続され、
前記第1のシグマデルタ変調器の入力が前記第2の周波数条件記憶部の所定の下位ビット列出力に接続され、
前記第1のシグマデルタ変調器が、入力端子、出力端子、誤差出力端子をそれぞれ持つ第1、第2、第3の1次のシグマデルタ変調器を具備して成り、
前記第1の1次のシグマデルタ変調器の誤差出力が前記第2の1次シグマデルタ変調器の入力に接続され、
前記第2の1次シグマデルタ変調器の出力が前記第1の微分器を介して前記第1の1次のシグマデルタ変調器の出力に接続され、
前記第2の1次のシグマデルタ変調器の誤差出力が前記第3の1次シグマデルタ変調器の入力に接続され、
前記第3の1次シグマデルタ変調器の出力が前記第2の微分器を介して前記第2の1次のシグマデルタ変調器の出力に接続され、
前記第1の疑似乱数発生回路の出力が前記第1の1次のシグマデルタ変調器の誤差出力に加算されて前記第2の1次シグマデルタ変調器に入力される構成である
ことを特徴とする無線送信回路。 - 請求項4記載の送信回路において、
前記第2のループフィルタが、少なくとも第1の容量と第1の抵抗で構成される第1の直列接続回路と第2の容量との並列接続で構成される第1のラグリードフィルタと、1次以上の第1の低域通過フィルタとで構成され、
前記チャージポンプ回路の出力は前記第1のラグリードフィルタの第1の端子と前記第1の低域通過フィルタの入力端子とに接続され、
前記第1のラグリードフィルタの第2の端子が前記チャージポンプ回路の接地端子に接続され、
前記第1の低域通過フィルタの出力端子が前記第2の電圧制御発振器の電圧制御端子に、接地端子が前記第2の電圧制御発振器の接地端子にそれぞれ接続される
ことを特徴とする無線送信回路。 - ベースバンド処理部からの送信信号をアンテナを介して送信する無線送信回路部と、
アンテナで受信した信号を妨害波を除去するフィルタ回路を介して低雑音増幅器により増幅した後、ベースバンド信号に周波数変換してベースバンド部へ送る受信回路部とを備えた送受信機であって、
前記無線送信回路部に、請求項1に記載の無線送信回路が用いられる
ことを特徴とする送受信機。
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