CH625066A5 - Circuit arrangement for preventing sequence errors in a data processing system. - Google Patents

Circuit arrangement for preventing sequence errors in a data processing system. Download PDF

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CH625066A5
CH625066A5 CH1564077A CH1564077A CH625066A5 CH 625066 A5 CH625066 A5 CH 625066A5 CH 1564077 A CH1564077 A CH 1564077A CH 1564077 A CH1564077 A CH 1564077A CH 625066 A5 CH625066 A5 CH 625066A5
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CH
Switzerland
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error
data processing
input
clock
generator
Prior art date
Application number
CH1564077A
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German (de)
English (en)
Inventor
Rudolf Dipl Ing Kern
Original Assignee
Siemens Ag
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
    • G06F11/0766Error or fault reporting or storing
    • G06F11/0772Means for error signaling, e.g. using interrupts, exception flags, dedicated error registers
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
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    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
    • G06F11/0706Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment
    • G06F11/0721Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment within a central processing unit [CPU]

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CH1564077A 1977-08-17 1977-12-20 Circuit arrangement for preventing sequence errors in a data processing system. CH625066A5 (en)

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DE2737133A DE2737133C2 (de) 1977-08-17 1977-08-17 Schaltungsanordnung zum Verhindern von Doppelfehlern in einer Datenverarbeitungsanlage

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Publication Number Publication Date
CH625066A5 true CH625066A5 (en) 1981-08-31

Family

ID=6016643

Family Applications (1)

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CH1564077A CH625066A5 (en) 1977-08-17 1977-12-20 Circuit arrangement for preventing sequence errors in a data processing system.

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AT (1) AT372531B (fr)
BE (1) BE869812A (fr)
CH (1) CH625066A5 (fr)
DE (1) DE2737133C2 (fr)
FR (1) FR2400730A1 (fr)
GB (1) GB1597198A (fr)
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NL (1) NL7806709A (fr)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3036926C2 (de) * 1980-09-30 1984-07-26 Siemens AG, 1000 Berlin und 8000 München Verfahren und Anordnung zur Steuerung des Arbeitsablaufes in Datenverarbeitungsanlagen mit Mikroprogrammsteuerung
DE3853476T2 (de) * 1988-05-20 1995-10-12 Ibm Einrichtung für die Fehlerkorrektur in einem selbstbewachten Datenverarbeitungssystem.

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AT372531B (de) 1983-10-25
IT1098095B (it) 1985-08-31
GB1597198A (en) 1981-09-03
ATA516778A (de) 1983-02-15
NL7806709A (nl) 1979-02-20
DE2737133C2 (de) 1979-07-26
IT7826706A0 (it) 1978-08-11
DE2737133B1 (de) 1978-11-30
BE869812A (fr) 1979-02-19
FR2400730A1 (fr) 1979-03-16

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