WO2020009021A1 - 層状物質積層構造およびその作製方法 - Google Patents

層状物質積層構造およびその作製方法 Download PDF

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赤坂 哲也
廣木 正伸
淳一 西中
熊倉 一英
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Definitions

  • the present invention relates to a layered substance laminated structure in which a layered substance is laminated on a nitride semiconductor and a method for manufacturing the same.
  • a technique has been proposed in which a transition metal dichalcogenide layered material is oriented and crystal-grown on the (111) plane of a III-V compound semiconductor having a zinc blend structure (see Non-Patent Document 1).
  • group V elements such as As, Sb, and P on the surface of the compound semiconductor are replaced with group VI elements, S, Se, and Te, and the substrate surface is chemically inertized.
  • a transition metal dichalcogenide layered material bonded by van der Waals force is grown on the surface thus formed.
  • layered materials such as transition metal dichalcogenides, which become semiconductors, have a band gap distributed within a range of 2.5 eV or less, and have a band gap exceeding that of a III-V compound semiconductor serving as a substrate.
  • the lap is big. For this reason, when producing a light emitting device or an electronic device, it is difficult to exhibit the original characteristics due to the influence of band alignment with the substrate.
  • the above-described problem of the band gap can be solved.
  • the (000-1) plane which is the nitrogen plane of the nitride semiconductor having a hexagonal structure, has difficulty in crystal growth and is rarely used.
  • Patent Document 1 by using a flow rate modulation epitaxy method (see Patent Document 1), it is possible to modulate the ratio of group V to group III on the surface during crystal growth to obtain a very flat nitrogen surface of the nitride semiconductor.
  • a proposed technique has been proposed (see Non-Patent Document 2).
  • nitrogen which is a Group V element on the nitrogen surface of GaN or AlN
  • the bond between nitrogen and gallium or between nitrogen and aluminum is extremely strong.
  • arsenic or phosphorus in a GaAs or InP substrate having a zinc blend structure it is considered that it is extremely difficult to desorb nitrogen and it is difficult to substitute a group VI element.
  • a nitride semiconductor can reduce the band gap overlap with a layered material, as described above, there is a problem that it is difficult to form a layered material on a nitride semiconductor. is there.
  • the present invention has been made to solve the above problems, and an object of the present invention is to enable a layered material to be formed on a nitride semiconductor.
  • the method for manufacturing a layered material laminated structure includes a first step of forming a semiconductor layer composed of a nitride semiconductor and having a main surface having a V-group polar face, and converting nitrogen atoms on the surface of the semiconductor layer to oxygen, A second step of substituting a group VI element of sulfur, selenium, or tellurium, and forming a layered substance layer by epitaxially growing a layered substance on the surface of the semiconductor layer in which nitrogen atoms on the surface have been substituted with a group VI element And a third step of performing the following.
  • a semiconductor layer is formed and a surface layer made of one molecular layer of InN is formed on the surface of the semiconductor layer, and the main surface is formed as a group V polar surface.
  • a nitrogen atom on the surface of the semiconductor layer may be replaced with a Group VI element of oxygen, sulfur, selenium, or tellurium.
  • the method for manufacturing a layered material laminated structure may include a fourth step of laminating a heterogeneous material layer including at least one of a semiconductor layer and a metal layer on the layered material layer.
  • a layered material layered structure according to the present invention includes a semiconductor layer formed of a nitride semiconductor and having a main surface having a group V polar surface, and a layered material layer formed of a layered material formed on the semiconductor layer.
  • the surface of the layer is formed by bonding any group VI element of oxygen, sulfur, selenium, or tellurium instead of nitrogen, and the layered material layer is formed on the surface of the semiconductor layer by bonding by van der Waals force. I have.
  • a surface layer composed of any of Group VI elements of oxygen, sulfur, selenium, and tellurium and In be formed on the surface of the semiconductor layer.
  • a heterogeneous material layer formed on the layered material layer and composed of at least one of a semiconductor layer and a metal layer may be provided.
  • the nitrogen atoms on the outermost surface of the semiconductor layer of the nitride semiconductor having the main surface as a V-group polar surface are replaced with any one of VI-group elements of oxygen, sulfur, selenium, and tellurium. Because of the substitution, an excellent effect that a layered material can be more easily formed on the nitride semiconductor can be obtained.
  • FIG. 1 is a flowchart for explaining a method for manufacturing a layered material laminated structure according to the first embodiment of the present invention.
  • FIG. 2 is a cross-sectional view illustrating a configuration of the layered material laminated structure according to Embodiment 1 of the present invention.
  • FIG. 3 is a flowchart for explaining a method for manufacturing a layered material laminated structure according to Embodiment 2 of the present invention.
  • FIG. 4 is a cross-sectional view showing a configuration of a layered material laminated structure according to Embodiment 2 of the present invention.
  • FIG. 5 is a cross-sectional view showing a configuration of another layered material laminated structure according to the embodiment of the present invention.
  • FIG. 6 is a cross-sectional view showing a configuration of another layered substance laminated structure according to the embodiment of the present invention.
  • FIG. 7 is a cross-sectional view showing the configuration of another layered material laminated structure according to the embodiment of the present invention.
  • Embodiment 1 First, a method for manufacturing a layered material layered structure in Embodiment 1 of the present invention will be described with reference to FIGS.
  • a semiconductor layer composed of a nitride semiconductor and having a main surface having a V-group polar face is formed.
  • the semiconductor layer for example, using a sapphire substrate, the surface is nitrided, and a nitride semiconductor such as GaN or AlN is epitaxially grown on the surface of the nitrided sapphire substrate by a well-known metal organic chemical vapor deposition method.
  • a semiconductor layer having a main surface having a group V polar surface can be obtained.
  • the oxygen atoms on the main surface of the sapphire substrate are replaced with nitrogen to form AlN, and the main surface is made to have a group V polarity (N polarity).
  • a sapphire substrate is carried into a growth furnace of a predetermined metalorganic vapor phase epitaxy apparatus or a molecular beam epitaxy apparatus, an ammonia gas is supplied into the growth furnace, and the sapphire substrate is heated to a predetermined temperature, the main sapphire substrate is heated.
  • the surface can be nitrided.
  • GaN is crystal-grown along the c-axis on a sapphire substrate having a main surface having a group V polarity, a semiconductor layer made of GaN with a main surface having a group V polarity plane can be obtained.
  • the nitrogen atoms on the surface of the semiconductor layer are replaced with any of Group VI elements of oxygen, sulfur, selenium, and tellurium.
  • any of Group VI elements of oxygen, sulfur, selenium, and tellurium for example, by heating to 1000 ° C., nitrogen atoms on the surface of the semiconductor layer are desorbed, and oxygen, sulfur, selenium, and tellurium are removed.
  • oxygen plasma may be used for replacement with a group VI element.
  • a layered substance is epitaxially grown on the semiconductor layer in which nitrogen atoms have been replaced with the above-mentioned group VI element to form a layered substance layer. It is possible to grow a layered material bonded by van der Waals force on a semiconductor layer of a nitride semiconductor in which nitrogen on the outermost surface is replaced with a group VI element of oxygen, sulfur, selenium or tellurium. Become.
  • the layered material is a two-dimensional unit layer obtained by laminating one or more layers.
  • the unit layers are bonded by interatomic bonds such as covalent bonds and ionic bonds, and unit layers adjacent in the stacking direction are bonded by van der Waals force.
  • the layered material layered structure manufactured by the above-described manufacturing method is formed on a semiconductor layer 101 made of a nitride semiconductor and having a main surface of a group V polar surface, and a semiconductor layer 101. And a layered material layer 102.
  • the outermost surface of the semiconductor layer 101 is composed of any of a group VI element or a group III element of oxygen, sulfur, selenium, or tellurium. It is formed by being combined by the Waals force.
  • Embodiment 2 Next, a method for manufacturing a layered material laminated structure according to Embodiment 2 of the present invention will be described with reference to FIG.
  • a semiconductor layer composed of a nitride semiconductor and having a main surface having a V-group polar face is formed.
  • the semiconductor layer for example, using a sapphire substrate, the surface is nitrided, and a nitride semiconductor such as GaN or AlN is epitaxially grown on the surface of the nitrided sapphire substrate by a well-known metal organic chemical vapor deposition method.
  • a semiconductor layer having a main surface having a group V polar surface can be obtained.
  • the oxygen atoms on the main surface of the sapphire substrate are replaced with nitrogen to form AlN, and the main surface is made to have a group V polarity (N polarity).
  • the first step S101 is the same as in the first embodiment.
  • a surface layer made of one molecular layer of InN is formed on the semiconductor layer in the first step S101 '.
  • the surface layer is formed in contact with the semiconductor layer.
  • the surface layer has a main surface formed as a group V polar surface.
  • a single-molecule layer of InN is epitaxially grown on the semiconductor layer by, for example, metalorganic vapor phase epitaxy or plasma-assisted molecular beam epitaxy to form a surface layer on the semiconductor layer.
  • a surface layer composed of one molecular layer of InN can be formed by forming a few molecular layers of an InN layer by a known metal organic chemical vapor deposition method and decomposing the layer by heating the InN layer.
  • the nitrogen atoms in the surface layer are replaced with any of Group VI elements of oxygen, sulfur, selenium, and tellurium.
  • any of Group VI elements of oxygen, sulfur, selenium, and tellurium for example, by heating to 500 ° C., a nitrogen atom in the surface layer is desorbed, and any of oxygen, sulfur, selenium, and tellurium is removed. It can be replaced by any of the Group VI elements.
  • oxygen plasma may be used for replacement with a group VI element.
  • Non-Patent Document 3 InN easily releases nitrogen from its surface, and its surface is roughened by heating (see Non-Patent Document 3).
  • Non-Patent Document 3 although this is an example of a group III polar surface, when InN of only one molecular layer is formed, nitrogen is easily desorbed by heating, but the evaporation temperature of In is increased. Until In does not desorb.
  • a processing temperature suitable for GaN at a processing temperature suitable for GaN, a hetero-stacked structure of different kinds of nitride semiconductors is formed while including an In layer without impairing flatness.
  • a layered material is epitaxially grown on the semiconductor layer (surface layer) in which nitrogen atoms have been substituted with the above-mentioned group VI element to form a layered material layer.
  • the surface layer in which nitrogen atoms are substituted with the above-described group VI element is a nitride semiconductor layer in which nitrogen on the outermost surface is substituted with any one of group VI elements of oxygen, sulfur, selenium, and tellurium. It becomes possible to grow a crystal of a layered material joined by Van der Waals force.
  • the layered material laminated structure manufactured by the above-described manufacturing method is formed in contact with the semiconductor layer 101 made of a nitride semiconductor and having a main surface having a V-group polarity plane. It has a single molecular layer surface layer 103 and a layered material layer 102 formed on the surface layer 103.
  • the surface layer 103 is composed of indium and any one of Group VI elements of oxygen, sulfur, selenium, and tellurium, and the layered material layer 102 is formed on the surface layer 103 by bonding with van der Waals force. ing.
  • the layered material stacked structure is formed in contact with the semiconductor layer 101 formed over the sapphire substrate 111 and the semiconductor layer 101 as illustrated in FIG. It has a surface layer 103 and a layered material layer 102 formed on the surface layer 103.
  • the layered material laminated structure may be a heterostructure in which a layered material layer 104 made of a different type of layered material is joined and laminated by van der Waals force on the layered material layer 102 as shown in FIG.
  • a dissimilar material layer including at least one of a semiconductor layer and a metal layer is stacked on the layered substance layer, as shown in FIG.
  • a heterogeneous material layer 105 made of a semiconductor crystal or a metal crystal may be formed over the layered material layer 102.
  • the heterogeneous material layer 105 may be inferior in crystallinity as compared with a case where the heterogeneous material layer 105 is formed by epitaxial growth using a three-dimensional crystal as a substrate.
  • the layers of the layered material layer 102 are bonded by Van der Waals force, the different material layer 105 can be mechanically separated from the sapphire substrate 111 in the layered material layer 102.
  • the layered material layered structure in the above-described embodiment can be applied to, for example, an active element such as a transistor.
  • the semiconductor layer is composed of a first semiconductor layer made of a nitride semiconductor having conductivity, and a second semiconductor layer made of non-doped AlN, GaN, h-BN, or the like formed thereon.
  • a layered material layer is formed.
  • a back-gate field-effect transistor including the first semiconductor layer as a back gate, the second semiconductor layer as a gate insulating layer, and the layered material layer as a channel layer can be provided.
  • the semiconductor layer is composed of a p-type semiconductor layer made of a p-type nitride semiconductor and an n-type semiconductor layer made of an n-type nitride semiconductor formed thereon, and the p-type and n-type layered layers are formed thereon.
  • a heterostructure When a heterostructure is formed using a material layer, it can operate as a tandem solar cell or a photodiode. In this structure, light absorbed by the layered material layer passes through the nitride semiconductor, so that light can be captured from the side of the nitride semiconductor layer.
  • the photodiode having the above-described configuration has an advantage that the absorption wavelength can be changed by changing the material of the layered substance, and the diode can be made of a nitride that can withstand a high voltage. In addition, by coating the growth surface side, it becomes possible to seal the layered material portion. By forming a chalcopyrite semiconductor layer on the layered material layer, it is possible to operate as a tandem solar cell.
  • a nitrogen atom on the outermost surface of a nitride semiconductor layer having a main surface having a group V polar surface is replaced with a group VI element selected from oxygen, sulfur, selenium, and tellurium.
  • the layered material can be more easily formed on the nitride semiconductor.

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Abstract

まず、第1工程S101で、窒化物半導体から構成されて主表面をV族極性面とした半導体層を形成する。次に、第2工程S102で、半導体層の表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換する。次に、第3工程S103で、窒素原子を上記のVI族元素で置換した半導体層の上に、層状物質をエピタキシャル成長させて層状物質層を形成する。

Description

層状物質積層構造およびその作製方法
 本発明は、窒化物半導体の上に層状物質が積層された層状物質積層構造およびその作製方法に関する。
 閃亜鉛構造をもつIII-V族化合物半導体の(111)面上に、遷移金属ダイカルコゲナイド層状物質を配向させて結晶成長させる技術が提案されている(非特許文献1参照)。この技術では、上記化合物半導体の表面におけるAs、Sb、PといったV族元素を、VI族元素であるS,Se,Teで置換し、基板表面を化学的に不活性とさせることで、この置換された表面上に、ファンデルワールス力で接合した遷移金属ダイカルコゲナイド層状物質を結晶成長させている。
 遷移金属ダイカルコゲナイドをはじめとする層状物質の中で半導体となる物質の多くは、バンドギャップが2.5eV以下の範囲に分布しており、基板となるIII-V族化合物半導体とバンドギャップのオーバーラップが大きい。このため、発光デバイス・電子デバイスを作製する際、基板とのバンドアライメントの影響をうけ、本来の特性を発揮することが難しい。
 これに対し、窒化物半導体を用いれば、上述したバンドギャップの問題を解消することが可能となる。ここで、六方晶構造をもつ、窒化物半導体の窒素面である(000-1)面は、結晶成長が困難であり、利用されることが少ない。近年、流量変調エピタキシー法を用い(特許文献1参照)、結晶成長時に表面でのV族とIII族の比を変調させ、非常に平坦な表面の窒化物半導体の窒素面を得ることを可能とした技術が提案されている(非特許文献2参照)。
特開昭61-275195号公報
A. Koma, "Van der Waals epitaxy for highly lattice-mismatched systems", Journal of Crystal Growth, vol. 201/202, pp. 236-241, 1999. C. H. Lin et al., "N-face GaNd0001T films with hillock-free smooth surfaces grown by group-III-source flow-rate modulation epitaxy", Japanese Journal of Applied Physics, vol. 55, 04EJ01, 2016. A. Yoshikawa et al., "Proposal and achievement of novel structure InN/GaN multiple quantum wells consisting of 1 ML and fractional monolayer InN wells inserted in GaN matrix", Applied Physics Letters, vol. 90, 073101, 207.
 ところで、GaNやAlNの窒素面上のV族元素である窒素は、3本のバックボンドでIII族と共有結合しており、窒素とガリウムまたは窒素とアルミニウムの結合が極めて強固である。このため、閃亜鉛構造を取るGaAsやInP基板におけるヒ素やリンと違い、窒素を脱離させることは極めて難しいとされ、VI族元素に置換することが難しいものと考えられる。
 窒化物半導体は、層状物質との間でバンドギャップのオーバーラップを小さくすることができるが、上述したように、窒化物半導体の上には、層状物質を形成することが困難であるという問題がある。
 本発明は、以上のような問題点を解消するためになされたものであり、窒化物半導体の上に層状物質が形成できるようにすることを目的とする。
 本発明に係る層状物質積層構造の作製方法は、窒化物半導体から構成されて主表面をV族極性面とした半導体層を形成する第1工程と、半導体層の表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換する第2工程と、表面の窒素原子をVI族元素で置換した半導体層の表面の上に、層状物質をエピタキシャル成長させて層状物質層を形成する第3工程とを備える。
 上記層状物質積層構造の作製方法において、第1工程では、半導体層を形成するとともに半導体層の表面に1分子層のInNからなる表面層を、主表面をV族極性面として形成し、第2工程では、半導体層の表面の窒素原子として表面層の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換するとよい。
 上記層状物質積層構造の作製方法において、第2工程では、加熱により半導体層の表面の窒素原子をVI族元素に置換する。
 上記層状物質積層構造の作製方法において、層状物質層の上に、半導体の層および金属の層の少なくとも1つから構成された異種材料層を積層する第4工程を備えるようにしてもよい。
 本発明に係る層状物質積層構造は、窒化物半導体から構成されて主表面をV族極性面とした半導体層と、半導体層の上に形成された層状物質からなる層状物質層とを備え、半導体層の表面は、窒素の代わりに酸素、硫黄、セレン、テルルのいずれかのVI族元素が結合し、層状物質層は、半導体層の表面の上にファンデルワールス力により結合して形成されている。
 上記層状物質積層構造において、半導体層の表面には、酸素、硫黄、セレン、テルルのいずれかのVI族元素とInとから構成された表面層が形成されているようにするとよい。
 上記層状物質積層構造において、層状物質層の上に形成され、半導体の層および金属の層の少なくとも1つから構成された異種材料層を備えるようにしてもよい。
 以上説明したように、本発明によれば、主表面をV族極性面とした窒化物半導体の半導体層の最表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換したので、窒化物半導体の上により容易に層状物質が形成できるという優れた効果が得られる。
図1は、本発明の実施の形態1における層状物質積層構造の作製方法を説明するためのフローチャートである。 図2は、本発明の実施の形態1における層状物質積層構造の構成を示す断面図である。 図3は、本発明の実施の形態2における層状物質積層構造の作製方法を説明するためのフローチャートである。 図4は、本発明の実施の形態2における層状物質積層構造の構成を示す断面図である。 図5は、本発明の実施の形態における他の層状物質積層構造の構成を示す断面図である。 図6は、本発明の実施の形態における他の層状物質積層構造の構成を示す断面図である。 図7は、本発明の実施の形態における他の層状物質積層構造の構成を示す断面図である。
 以下、本発明の実施の形態おける層状物質積層構造の作製方法について説明する。
[実施の形態1]
 はじめに、本発明の実施の形態1における層状物質積層構造の作製方法について図1を参照して説明する。
 まず、第1工程S101で、窒化物半導体から構成されて主表面をV族極性面とした半導体層を形成する。半導体層は、例えば、サファイア基板を用い、この表面を窒化処理し、窒化処理したサファイア基板の表面に、よく知られた有機金属気相成長法によりGaNやAlNなどの窒化物半導体をエピタキシャル成長させれば、主表面をV族極性面とした半導体層が得られる。窒化処理により、サファイア基板の主表面の酸素原子を窒素で置き換えることでAlNとし、主表面をV族極性(N極性)とする。
 例えば、サファイア基板を所定の有機金属気相エピタキシー装置または分子線エピタキシー装置の成長炉内に搬入し、成長炉内にアンモニアガスを供給し、サファイア基板を所定温度に加熱すれば、サファイア基板の主表面を窒化することができる。引き続き、主表面をV族極性としたサファイア基板の上に、GaNをc軸に沿って結晶成長すれば、主表面をV族極性面としてGaNからなる半導体層が得られる。
 次に、第2工程S102で、半導体層の表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換する。例えば、酸素、硫黄、セレン、テルルのいずれかのVI族元素のガス雰囲気下で、例えば、1000℃に加熱することで、半導体層の表面の窒素原子を離脱させ、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換することができる。なお、VI族元素で置換においては、酸素プラズマを用いてもよい。
 次に、第3工程S103で、窒素原子を上記のVI族元素で置換した半導体層の上に、層状物質をエピタキシャル成長させて層状物質層を形成する。最表面の窒素を酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換した窒化物半導体による半導体層の上には、ファンデルワールス力で接合した層状物質を結晶成長することが可能となる。
 なお、層状物質は、2次元的な単位層が、1層または複数層積層したものである。単位層は、共有結合やイオン結合などの原子間結合により結合しており、積層方向に隣り合う単位層の間は、ファンデルワールス力により結合している。
 上述した製造方法により作製される層状物質積層構造は、図2に示すように、窒化物半導体から構成されて主表面をV族極性面とした半導体層101と、半導体層101の上に形成された層状物質層102とを備えるものとなる。なお、半導体層101の最表面は、酸素、硫黄、セレン、テルルのいずれかのVI族元素とIII族元素とから構成され、層状物質層102は、半導体層101の最表面の上にファンデルワールス力により結合して形成されている。
[実施の形態2]
 次に、本発明の実施の形態2における層状物質積層構造の作製方法について図3を参照して説明する。
 まず、第1工程S101で、窒化物半導体から構成されて主表面をV族極性面とした半導体層を形成する。半導体層は、例えば、サファイア基板を用い、この表面を窒化処理し、窒化処理したサファイア基板の表面に、よく知られた有機金属気相成長法によりGaNやAlNなどの窒化物半導体をエピタキシャル成長させれば、主表面をV族極性面とした半導体層が得られる。窒化処理により、サファイア基板の主表面の酸素原子を窒素で置き換えることでAlNとし、主表面をV族極性(N極性)とする。
 第1工程S101は、前述した実施の形態1と同様である。実施の形態2では、第1’工程S101’で、半導体層の上に、1分子層のInNからなる表面層を形成する。表面層は、半導体層の上に接して形成する。また、表面層は、主表面をV族極性面として形成する。
 半導体層の上に、例えば、有機金属気相エピタキシー法またはプラズマアシスト分子線エピタキシー法により、InNを1分子層エピタキシャル成長することで、半導体層の上に表面層を形成する。また、公知の有機金属気相成長法により、数分子層のInN層を形成し、このInN層を加熱することで、分解すれば、1分子層のInNからなる表面層が形成できる。
 次に、第2工程S102で、表面層の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換する。例えば、酸素、硫黄、セレン、テルルのいずれかのVI族元素のガス雰囲気下で、例えば、500℃に加熱することで、表面層の窒素原子を離脱させ、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換することができる。なお、VI族元素で置換においては、酸素プラズマを用いてもよい。
 InNは、表面より窒素が容易に離脱しやすく、加熱により表面が荒れてしまう(非特許文献3参照)。ただし、非特許文献3に示されているように、III族極性面の例ではあるが、1分子層のみのInNを形成した場合、加熱により窒素は容易に脱離するものの、Inの蒸発温度までInは脱離しない。これにより、非特許文献3の技術では、GaNに適した処理温度において、平坦性を損なうことなくIn層を含みつつ、異種の窒化物半導体のヘテロ積層構造を形成している。このように、半導体層の上に、1分子層のInNからなる表面層を形成しておくことで、V族極性面とした半導体層の表面において、より低温で窒素を上述したVI族元素で置換することが可能となる。
 ここで、窒化インジウムによる表面層がない状態では、半導体層の主表面の窒素原子を離脱させ、VI族元素で置換するためには、1000℃以上の加熱が必要となるが、表面が荒れてしまう場合が発生し、平坦な表面が得られる条件の範囲が非常に狭い。これに対し、1分子層のInNからなる表面層を設けることで、より低い温度で、表面の窒素原子をVI族元素で置換することが可能となり、表面荒れの発生が抑制でき、平坦な表面がより容易に得られるようになる。なお、半導体層をInNから構成する場合、表面層は必要ない。
 次に、第3工程S103で、窒素原子を上記のVI族元素で置換した半導体層(表面層)の上に、層状物質をエピタキシャル成長させて層状物質層を形成する。窒素原子を上記のVI族元素で置換した表面層は、最表面の窒素を酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換した窒化物半導体の層であり、この上には、ファンデルワールス力で接合した層状物質を結晶成長することが可能となる。
 上述した製造方法により作製される層状物質積層構造は、図4に示すように、窒化物半導体から構成されて主表面をV族極性面とした半導体層101と、半導体層101に接して形成された1分子層の表面層103と、表面層103の上に形成された層状物質層102とを備えるものとなる。なお、表面層103は、酸素、硫黄、セレン、テルルのいずれかのVI族元素とインジウムとから構成され、層状物質層102は、表面層103の上にファンデルワールス力により結合して形成されている。
 なお、半導体層をサファイア基板の上に形成した場合、層状物質積層構造は、図5に示すように、サファイア基板111の上に形成された半導体層101と、半導体層101に接して形成された表面層103と、表面層103の上に形成された層状物質層102とを備えるものとなる。
 また、層状物質積層構造は、図6に示すように、層状物質層102の上に異種の層状物質からなる層状物質層104をファンデルワールス力で接合して積層したヘテロ構造としても良い。
 また、前述した第3工程の後の第4工程で、層状物質層の上に、半導体の層および金属の層の少なくとも1つから構成された異種材料層を積層することで、図7に示すように、層状物質層102の上に、半導体結晶もしくは金属結晶からなる異種材料層105を形成しても良い。この異種材料層105は、3次元結晶を基板としてエピタキシャル成長によって形成する場合より、結晶性に劣る可能性がある。しかし、層状物質層102の層間がファンデルワールス力で結合しているため、層状物質層102においてサファイア基板111から、異種材料層105を機械的に剥離させることが可能となる。
 上述した実施の形態における層状物質積層構造は、例えば、トランジスタなどの能動素子に適用可能である。例えば、半導体層を、導電性を備える窒化物半導体からなる第1半導体層と、この上に形成されたノンドープAlN、GaN、h-BNなどからなる第2半導体層とから構成し、この上に層状物質層を形成する。この構成において、第1半導体層をバックゲートとし、第2半導体層をゲート絶縁層とし、層状物質層をチャネル層としたバックゲート型電界効果トランジスタとすることができる。
 半導体層を、p型の窒化物半導体からなるp型半導体層と、この上に形成したn型の窒化物半導体からなるn型半導体層とから構成し、この上にp型及びn型の層状物質層によるヘテロ構造を形成すれば、タンデム型の太陽電池もしくはフォトダイオードとして動作することが可能である。この構成においては、層状物質層で吸収される光は窒化物半導体を透過するため、光を窒化物半導体の層の側から取り込むことが可能である。上述した構成のフォトダイオードにおいては、吸収波長は、層状物質の材料を変えることで可変とし、ダイオードとしては高電圧まで耐えることができる窒化物によって構成できるという利点がある。また、成長表面側をコーティングすることで層状物質部分を密封することが可能となる。層状物質層の上にカルコパイライト型半導体層を形成することでもタンデム型太陽電池として動作させることが可能である。
 以上に説明したように、本発明によれば、主表面をV族極性面とした窒化物半導体の半導体層の最表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換したので、窒化物半導体の上により容易に層状物質が形成できるようになる。
 なお、本発明は以上に説明した実施の形態に限定されるものではなく、本発明の技術的思想内で、当分野において通常の知識を有する者により、多くの変形および組み合わせが実施可能であることは明白である。
 101…半導体層、102…層状物質層、103…表面層、104…層状物質層、105…異種材料層。

Claims (7)

  1.  窒化物半導体から構成されて主表面をV族極性面とした半導体層を形成する第1工程と、
     前記半導体層の表面の窒素原子を、酸素、硫黄、セレン、テルルのいずれかのVI族元素で置換する第2工程と、
     表面の窒素原子を前記VI族元素で置換した前記半導体層の表面の上に、層状物質をエピタキシャル成長させて層状物質層を形成する第3工程と
     を備えることを特徴とする層状物質積層構造の作製方法。
  2.  請求項1記載の層状物質積層構造の作製方法において、
     前記第1工程では、前記半導体層を形成するとともに前記半導体層の表面に1分子層のInNからなる表面層を、主表面をV族極性面として形成し、
     前記第2工程では、前記半導体層の表面の窒素原子として前記表面層の窒素原子を、前記VI族元素で置換する
     ことを特徴とする層状物質積層構造の作製方法。
  3.  請求項1または2記載の層状物質積層構造の作製方法において、
     前記第2工程では、加熱により前記半導体層の表面の窒素原子を前記VI族元素に置換することを特徴とする層状物質積層構造の作製方法。
  4.  請求項1~3のいずれか1項に記載の層状物質積層構造の作製方法において、
     前記層状物質層の上に、半導体の層および金属の層の少なくとも1つから構成された異種材料層を積層する第4工程を備えることを特徴とする層状物質積層構造の作製方法。
  5.  窒化物半導体から構成されて主表面をV族極性面とした半導体層と、
     前記半導体層の上に形成された層状物質からなる層状物質層と
     を備え、
     前記半導体層の表面は、窒素の代わりに酸素、硫黄、セレン、テルルのいずれかのVI族元素が結合し、
     前記層状物質層は、前記半導体層の表面の上にファンデルワールス力により結合して形成されている
     ことを特徴とする層状物質積層構造。
  6.  請求項5記載の層状物質積層構造において、
     前記半導体層の表面には、前記VI族元素とInとから構成された表面層が形成されていることを特徴とする層状物質積層構造。
  7.  請求項5または6記載の層状物質積層構造において、
     前記層状物質層の上に形成され、半導体の層および金属の層の少なくとも1つから構成された異種材料層を備えることを特徴とする層状物質積層構造。
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Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10112439A (ja) * 1996-10-04 1998-04-28 Sony Corp n型窒化物系III−V族化合物半導体の成長方法
JPH11204888A (ja) * 1998-01-13 1999-07-30 Ricoh Co Ltd 半導体発光素子および半導体単結晶基板の作製方法
JPH11243253A (ja) * 1998-02-25 1999-09-07 Sony Corp 窒化物系iii−v族化合物半導体の成長方法、半導体装置の製造方法、窒化物系iii−v族化合物半導体成長用基板および窒化物系iii−v族化合物半導体成長用基板の製造方法
JP2005303250A (ja) * 2004-03-18 2005-10-27 Matsushita Electric Ind Co Ltd 半導体装置及びその製造方法
JP2005322840A (ja) * 2004-05-11 2005-11-17 Hitachi Cable Ltd 窒化物半導体、窒化物半導体ウェハ及びその製造方法
JP2006213586A (ja) * 2005-02-07 2006-08-17 Tokyo Institute Of Technology 窒化アルミニウム単結晶積層基板
JP2009221056A (ja) * 2008-03-17 2009-10-01 Sharp Corp 結晶成長方法、結晶成長装置、および半導体デバイス
JP2014075527A (ja) * 2012-10-05 2014-04-24 Nippon Telegr & Teleph Corp <Ntt> 半導体素子構造およびその作製法
WO2015029434A1 (ja) * 2013-08-30 2015-03-05 独立行政法人科学技術振興機構 半導体素子

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3470054B2 (ja) * 1998-12-28 2003-11-25 シャープ株式会社 窒化物系iii−v族化合物半導体装置
JP3639789B2 (ja) * 2001-01-31 2005-04-20 シャープ株式会社 窒化物系半導体発光素子
US20080111144A1 (en) * 2006-11-15 2008-05-15 The Regents Of The University Of California LIGHT EMITTING DIODE AND LASER DIODE USING N-FACE GaN, InN, AND AlN AND THEIR ALLOYS

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10112439A (ja) * 1996-10-04 1998-04-28 Sony Corp n型窒化物系III−V族化合物半導体の成長方法
JPH11204888A (ja) * 1998-01-13 1999-07-30 Ricoh Co Ltd 半導体発光素子および半導体単結晶基板の作製方法
JPH11243253A (ja) * 1998-02-25 1999-09-07 Sony Corp 窒化物系iii−v族化合物半導体の成長方法、半導体装置の製造方法、窒化物系iii−v族化合物半導体成長用基板および窒化物系iii−v族化合物半導体成長用基板の製造方法
JP2005303250A (ja) * 2004-03-18 2005-10-27 Matsushita Electric Ind Co Ltd 半導体装置及びその製造方法
JP2005322840A (ja) * 2004-05-11 2005-11-17 Hitachi Cable Ltd 窒化物半導体、窒化物半導体ウェハ及びその製造方法
JP2006213586A (ja) * 2005-02-07 2006-08-17 Tokyo Institute Of Technology 窒化アルミニウム単結晶積層基板
JP2009221056A (ja) * 2008-03-17 2009-10-01 Sharp Corp 結晶成長方法、結晶成長装置、および半導体デバイス
JP2014075527A (ja) * 2012-10-05 2014-04-24 Nippon Telegr & Teleph Corp <Ntt> 半導体素子構造およびその作製法
WO2015029434A1 (ja) * 2013-08-30 2015-03-05 独立行政法人科学技術振興機構 半導体素子

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
A. YOSHIKAWA ET AL.: "Proposal and achievement of novel structure InN/GaN multiple quantum wells consisting of 1 ML and fractional monolayer InN wells inserted in GaN matrix", APPLIED PHYSICS LETTERS, vol. 90, 12 February 2007 (2007-02-12), pages 073101 - 1 - 073101-3, XP012096063 *
M. JAMIL ET AL.: "MOVPE and photoluminescence of narrow band gap(0.77 eV)InN on GaN/sapphire by pulsed growth mode", PHYSICA STATUS SOLIDI, vol. 205, no. 12, 3 September 2008 (2008-09-03), pages 2886 - 2891, XP055239934, DOI: 10.1002/pssa.200824136 *

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