WO2015133288A1 - Ｆｅｃフレーム処理装置およびｆｅｃフレーム処理方法 - Google Patents

Ｆｅｃフレーム処理装置およびｆｅｃフレーム処理方法 Download PDF

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聡一朗 亀谷
和夫 久保
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三菱電機株式会社
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    • H04L1/0078—Avoidance of errors by organising the transmitted data in a format specifically designed to deal with errors, e.g. location

Definitions

  • the present invention relates to an FEC (forward error correction) frame processing apparatus and an FEC frame processing method for performing error correction in an optical communication system.
  • FEC forward error correction
  • OTN Optical Transport Network
  • ITU-T ITU-T G. 709
  • ODU Optical channel Data Unit
  • OTU Optical channel Transport Unit
  • WDM Widelength Division Multiplex
  • ODUflex Optical channel Data Unit flexible
  • the payload area of the OTN frame is configured in a time-sharing manner with a plurality of ODTU (Optical-channel Data Tributary Unit) tributary slots, and the number of ODTU tributary slots is assigned according to the speed of the signal to be transferred (for example, Non-Patent Document 1).
  • ODTU Optical-channel Data Tributary Unit
  • Patent Document 1 a variable parity area for storing an error correction code is set in the payload area, and a redundant area for error correction is provided for a transmission path penalty or necessary while avoiding an increase in transmission speed. A method for changing and expanding according to the capacity of user traffic is shown.
  • Patent Document 1 discloses a method for setting a variable parity area in units of ODTU tributary slots in a payload area in order to construct an FEC frame having excellent affinity with an OTN frame as a transmission frame. ing.
  • Patent Document 1 there is no description regarding an error correction encoding and decoding circuit configuration method.
  • a method including different error correction circuits depending on the redundancy can be considered.
  • OTU4 80 ODTU tributary slots are set, and in a configuration including an error correction circuit for each configuration of the redundant area, the circuit scale becomes very large, so that the implementation is not realistic.
  • the present invention has been made to solve the above-described problems, and includes an FEC frame processing device that accommodates client signals in units of ODTUs that make up the payload portion of an OTN signal, and that makes the parity variable in units of ODTUs.
  • An object of the FEC frame processing method is to provide an error correction circuit having a plurality of different redundant area sizes with a single error correction circuit.
  • the FEC frame processing apparatus accommodates client signals in the ODTU unit constituting the payload portion of the OTN signal, and accommodates client signals in the FEC frame processing apparatus in which the parity is variable in ODTU tributary slot units.
  • a frame configuration control unit that determines the frame configuration by notifying the number of ODTU tributary slots, and based on the frame configuration determined by the frame configuration control unit, the number of columns of the encoding matrix is N times the OTN frame length
  • an encoding unit configured with 1 / N times (where N is an integer equal to or greater than 1) and capable of increasing / decreasing the number of rows of an encoding matrix in units of ODTU tributary slots, and a frame configuration control unit Based on the frame configuration determined by, the number of columns of the check matrix is set to the OTN frame length.
  • a decoding unit that can increase or decrease the number of rows of the parity check matrix in units of ODTU tributary slots, and includes error correction encoding / The decoding
  • the FEC frame processing method provides variable parity redundancy in an FEC frame processing apparatus that accommodates client signals in ODTU units constituting the payload portion of an OTN signal and makes the parity variable in ODTU tributary slot units.
  • This is an FEC frame processing method that realizes error correction encoding / decoding processing on a small circuit scale corresponding to each degree, and determines the frame configuration by notifying the number of ODTU tributary slots for accommodating client signals.
  • the number of columns of the encoding matrix is N times or 1 / N times the OTN frame length (where N is an integer of 1 or more) And the number of rows of the encoding matrix, in units of ODTU tributary slots
  • the number of columns of the check matrix is configured to be N times or 1 / N times the OTN frame length, and the row of the check matrix
  • a decoding step capable of increasing / decreasing the number in units of ODTU tributary slots.
  • an ODTU unit constituting a payload portion of an OTN signal is provided by variably setting a size of an encoding matrix and a check matrix based on a notification of a reception form of a client signal that determines a frame configuration.
  • the client signal is accommodated and the parity is variable in units of ODTU, it is possible to provide an error correction circuit having a plurality of different redundancy area sizes with a single error correction circuit. .
  • Embodiment 1 of this invention It is a block diagram which shows the FEC frame processing apparatus in Embodiment 1 of this invention.
  • Embodiment 1 of this invention it is a figure which shows the structure of the OTU4V frame to which the variable parity area
  • FIG. FIG. 1 is a configuration diagram showing an FEC frame processing apparatus according to Embodiment 1 of the present invention.
  • the FEC frame processing apparatus in FIG. 1 includes a frame configuration control unit 100, a frame storage unit 110, an encoding unit 120, an optical transmission processing unit 130, an optical reception processing unit 150, a decoding unit 160, and a signal extraction unit 170. ing.
  • the frame accommodating unit 110, the encoding unit 120, and the optical transmission processing unit 130 correspond to a part that functions as a transmission end, and the optical reception processing unit 150, the decoding unit 160, and the signal extraction unit 170 function as a reception end. It corresponds to the part to do.
  • the frame accommodating unit 110 receives a client signal 11 from a user to be transferred as an optical signal. Furthermore, the frame accommodating unit 110 generates an OTU4V frame signal 12 in which a variable parity area is set in the payload area in units of ODTU tributary slots, and outputs the generated OTU4V frame signal 12 to the encoding unit 120.
  • the encoding unit 120 generates parity information for error correction from the information area of the OTU4V signal 12. Further, the encoding unit 120 inserts the generated parity information in the parity area set by the frame accommodation unit 110 and outputs the parity information to the optical transmission processing unit 130 as the error correction codeword 13.
  • the optical transmission processing unit 130 converts the electrical signal input as the error correction codeword 13 into an optical signal 14 for transmission and outputs it to the optical transmission line.
  • the optical reception processing unit 150 receives the optical signal 15 from the optical transmission path. Further, the optical reception processing unit 150 converts the received optical signal 15 into an electrical signal 16 and outputs the electrical signal 16 to the decoding unit 160.
  • the decoding unit 160 performs error correction processing on the input electrical signal 16 and outputs the decoded OTU4V signal 17 to the signal extraction unit 170.
  • the signal extraction unit 170 extracts the client signal 18 from the input OTU4V signal 17 and outputs it to the user side device.
  • FIG. 2 is a diagram showing a configuration of an OTU4V frame in which a variable parity area is set in Embodiment 1 of the present invention.
  • the OTU4V frame includes an Overhead area, a payload area, a Fixed Staff area, and a fixed parity area.
  • the payload area is composed of all 80 tributary slots (TS (1), TS (2),..., TS (80)), and a variable value M (where M is 1 or more, 79 For the following integer), TS (1) to TS (M) are used for accommodating the client signal 11, and TS (M + 1) to TS80 are used as variable parity areas.
  • the encoding unit 120 obtains parity using Overhead, Fixed Staff, and TS (1) to TS (M) as information areas. Furthermore, the encoding unit 120 inserts parity information into the variable parity area and the fixed parity area from TS (M + 1) to TS (80).
  • the frame configuration control unit 100 notifies the frame accommodation unit 110, the encoding unit 120, the decoding unit 160, and the signal extraction unit 170 of the accommodation form of the client signal 11 that determines the OTU4V frame configuration.
  • the variable value M can be shared as the same OTU4V frame configuration among the respective components, and the signal processing can be matched.
  • FIG. 3 is a diagram showing an encoding matrix of the encoding unit 120 according to Embodiment 1 of the present invention.
  • FIG. 4 is a diagram showing a parity check matrix of decoding section 160 in Embodiment 1 of the present invention.
  • the code word arithmetic circuit (not shown) in the encoding unit 120 and the code word arithmetic circuit (not shown) in the decoding unit 160 have the number of rows for the basic encoding matrix or check matrix.
  • the frame accommodation unit 110 receives the client signal 11 and accommodates the client signal 11 in the ODTU tributary slot notified from the frame configuration control unit 100.
  • the ODTU tributary slots from TS (1) to TS (M) accommodating the client signal 11 are time-division multiplexed together with TS (M + 1) to TS (80) into which no data is inserted in the frame accommodating unit 110. Is done.
  • time-division multiplexed data is provided with an Overhead, Fixed Stuff area, and a fixed parity area into which no data is inserted in the frame accommodating unit 110, and is formed as an OTU4V frame signal 12 at an OTU4V clock rate. And output to the encoding unit 120.
  • the encoding unit 120 Based on the frame configuration information notified from the frame configuration control unit 100, the encoding unit 120 encodes Overhead, Fixed Stuff, and TS (1) to TS (M) of the input OTU4V frame signal 12. Parity is calculated using the quantization matrix.
  • the encoding matrix of the encoding unit 120 is such that the number of columns is the code length, N times or 1 / N times the frame length (where N is an integer equal to or greater than 1), and the number of rows in the codeword
  • N an integer equal to or greater than 1
  • M the total length of the sizes of Overhead, Fixed Staff, and TS (1) to TS (M), which are information lengths in FIG.
  • the parity bits obtained by the calculation are inserted into the bit positions of the fixed parity area in the OTU4V frame and the variable parity area from TS (M + 1) to TS (80).
  • the codeword arithmetic circuit in the encoding unit 120 is configured so that the number of rows of the encoding matrix is variable according to the unit of the data size of the ODTU TS (that is, the value of M). To do. As a result, it is possible to calculate parity with the same code length according to the number of ODTU TSs to be assigned as parity calculation targets controlled by the frame configuration control unit 100.
  • the decoding unit 160 performs error correction decoding processing on the OTU4V signal 16 received by the optical reception processing unit 150 and converted into an electrical signal.
  • the parity check matrix of the decoding unit 160 has the number of columns as N or 1 / N times the frame length as the code length, and the number of rows as the size of the fixed parity area as the parity length in the codeword and TS. The sum of the sizes of (M + 1) to TS (80) is taken.
  • the codeword arithmetic circuit in the decoding unit 160 is configured so that the number of rows of the check matrix is variable according to the unit of the data size of the ODTU TS (that is, a value of 80-M). To do. As a result, it is possible to perform decoding processing with the same code length according to the number of ODTU TSs to be allocated as variable parity areas, which is controlled by the frame configuration control unit 100.
  • the signal extraction unit 170 extracts each ODTU signal and extracts the client signal 18 from the ODTU signal. Further, the signal extraction unit 170 transfers the extracted client signal 18 to the user device.
  • an FEC frame processing apparatus that accommodates client signals in units of ODTUs that make up the payload portion of an OTN signal and makes the parity variable in units of ODTUs has the following characteristics:
  • a frame processing configuration is provided.
  • a frame configuration control unit for notifying the accommodation form of a client signal for determining a frame configuration and adopting the same frame configuration between the constituent units on the encoding side and the decoding side, Prepare.
  • the error correction coding unit the code length is configured to be N times or 1 / N times the OTN frame length, and the number of rows of the coding matrix is set in units of ODTU TS with respect to the basic coding matrix. It has a configuration that can be increased or decreased.
  • the error correction decoding unit has a configuration capable of increasing or decreasing the number of rows of the check matrix in units of ODTU TS with respect to the basic check matrix.

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Abstract

　ＦＥＣフレーム処理装置において、クライアント信号を収容するためのＯＤＴＵトリビュタリスロット数を通知することでフレーム構成を決定するフレーム構成制御部と、フレーム構成に基づいて、符号化行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍（ただし、Ｎは、１以上の整数）で構成し、符号化行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な符号化部と、フレーム構成に基づいて、検査行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、検査行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な復号部とを備える。

Description

ＦＥＣフレーム処理装置およびＦＥＣフレーム処理方法
　本発明は、光通信システムの誤り訂正を行うＦＥＣ（ｆｏｒｗａｒｄ　ｅｒｒｏｒ　ｃｏｒｒｅｃｔｉｏｎ：前方誤り訂正）フレーム処理装置およびＦＥＣフレーム処理方法に関するものである。
　大容量のデータを伝送するために、ＯＴＮ（Ｏｐｔｉｃａｌ　Ｔｒａｎｓｐｏｒｔ　Ｎｅｔｗｏｒｋ）がＩＴＵ－Ｔ　Ｇ．７０９で標準化されている。Ｇ．７０９では、現在、１Ｇｂ／ｓから１００Ｇｂ／ｓまでの伝送速度に対応したＯＤＵ（Ｏｐｔｉｃａｌ　ｃｈａｎｎｅｌ　Ｄａｔａ　Ｕｎｉｔ）やＯＴＵ（Ｏｐｔｉｃａｌ　ｃｈａｎｎｅｌ　Ｔｒａｎｓｐｏｒｔ　Ｕｎｉｔ）が標準化されている。そして、それらをＷＤＭ（Ｗａｖｅｌｅｎｇｔｈ　Ｄｉｖｉｓｉｏｎ　Ｍｕｌｔｉｐｌｅｘ）で多重化転送することで、その波長数倍の伝送容量の光通信システムを構築できる。
　また、従来のＯＤＵに加え、ユーザの通信容量に応じた低速から高速までの信号を収容できるＯＤＵｆｌｅｘ（Ｏｐｔｉｃａｌ　ｃｈａｎｎｅｌ　Ｄａｔａ　Ｕｎｉｔ　ｆｌｅｘｉｂｌｅ）も標準化されている。ＯＴＮフレームのペイロード領域は、複数のＯＤＴＵ（Ｏｐｔｉｃａｌ－ｃｈａｎｎｅｌ　Ｄａｔａ　Ｔｒｉｂｕｔａｒｙ　Ｕｎｉｔ）トリビュタリスロットで時分割構成されており、転送を行う信号の速度に応じて、ＯＤＴＵトリビュタリスロット数を割り当てている（例えば、非特許文献１参照）。
　他方、特許文献１では、ペイロード領域内に、誤り訂正符号を格納する可変パリティ領域を設定し、伝送速度の上昇を回避しつつ、誤り訂正のための冗長領域を、伝送路のペナルティや必要なユーザトラヒックの容量に応じて、変更かつ拡大するための方法が示されている。
　さらに、この特許文献１には、伝送フレームであるＯＴＮフレームとの親和性に優れたＦＥＣフレームを構成するために、ペイロード領域内にＯＤＴＵトリビュタリスロット単位で可変パリティ領域を設定する方法が示されている。
国際公開第Ｏ２０１３／０８４３４１号パンフレット 特開２０１１－１０９２２８号公報
ＩＴＵ－Ｔ　Ｒｅｃｃｏｍｅｎｄａｔｉｏｎ　Ｇ．７０９
　しかしながら、従来技術には、以下のような課題がある。
　特許文献１においては、誤り訂正の符号化および復号回路の構成方法に関して記載されていない。誤り訂正のための冗長領域の変更が可能な誤り回路を構成する場合には、冗長度に応じて異なる誤り訂正回路を具備する方法が考えられる。しかしながら、ＯＴＵ４では、８０のＯＤＴＵトリビュタリスロットが設定されており、冗長領域の構成毎に誤り訂正回路を具備する構成では、回路規模が非常に大きくなるため、実装が現実的ではなくなる。
　本発明は、上記のような問題点を解決するためになされたもので、ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵ単位でパリティを可変とするＦＥＣフレーム処理装置およびＦＥＣフレーム処理方法において、単一の誤り訂正回路で複数の異なる冗長領域のサイズの誤り訂正回路を提供することを目的とする。
　本発明に係るＦＥＣフレーム処理装置は、ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵトリビュタリスロット単位でパリティを可変とするＦＥＣフレーム処理装置において、クライアント信号を収容するためのＯＤＴＵトリビュタリスロット数を通知することでフレーム構成を決定するフレーム構成制御部と、フレーム構成制御部により決定されたフレーム構成に基づいて、符号化行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍（ただし、Ｎは、１以上の整数）で構成し、符号化行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な符号化部と、フレーム構成制御部により決定されたフレーム構成に基づいて、検査行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、検査行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な復号部とを備え、可変パリティの冗長度に対応した、誤り訂正符号化／復号化処理を小回路規模で実現するものである。
　また、本発明に係るＦＥＣフレーム処理方法は、ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵトリビュタリスロット単位でパリティを可変とするＦＥＣフレーム処理装置において、可変パリティの冗長度に対応した、誤り訂正符号化／復号化処理を小回路規模で実現するＦＥＣフレーム処理方法であって、クライアント信号を収容するためのＯＤＴＵトリビュタリスロット数を通知することでフレーム構成を決定するフレーム構成制御ステップと、フレーム構成制御ステップにより決定されたフレーム構成に基づいて、符号化行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍（ただし、Ｎは、１以上の整数）で構成し、符号化行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な符号ステップと、フレーム構成制御ステップにより決定されたフレーム構成に基づいて、検査行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、検査行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な復号ステップとを有するものである。
　本発明によれば、フレーム構成を決定するクライアント信号の収容形態の通知に基づいて、符号化行列および検査行列のサイズを可変設定する構成を備えることにより、ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵ単位でパリティを可変とするＦＥＣフレーム処理装置およびＦＥＣフレーム処理方法において、単一の誤り訂正回路で複数の異なる冗長領域のサイズの誤り訂正回路を提供することができる。
本発明の実施の形態１におけるＦＥＣフレーム処理装置を示す構成図である。 本発明の実施の形態１において、可変パリティ領域を設定されたＯＴＵ４Ｖフレームの構成を示す図である。 本発明の実施の形態１における符号化部の符号化行列を示す図である。 本発明の実施の形態１における復号部の検査行列を示す図である。
　以下、本発明のＦＥＣフレーム処理装置およびＦＥＣフレーム処理方法の好適な実施の形態につき図面を用いて説明する。なお、以下では、説明の便宜上、ＯＴＵ４Ｖフレームを例として説明を行うが、本特許は、ＯＴＵ４Ｖフレーム以外にも適用可能である。
　実施の形態１．
　図１は、本発明の実施の形態１におけるＦＥＣフレーム処理装置を示す構成図である。図１におけるＦＥＣフレーム処理装置は、フレーム構成制御部１００、フレーム収容部１１０、符号化部１２０、光送信処理部１３０、光受信処理部１５０、復号部１６０、信号抽出部１７０を含んで構成されている。
　ここで、フレーム収容部１１０、符号化部１２０、光送信処理部１３０は、送信端として機能する部分に相当し、光受信処理部１５０、復号部１６０、信号抽出部１７０は、受信端として機能する部分に相当する。
　図１において、本装置が光信号の送信端として機能する際には、フレーム収容部１１０は、光信号として転送すべきユーザからのクライアント信号１１を受信する。さらに、フレーム収容部１１０は、ＯＤＴＵトリビュタリスロット単位で、ペイロード領域中に可変パリティ領域を設定したＯＴＵ４Ｖフレーム信号１２を生成し、符号化部１２０へと出力する。
　符号化部１２０は、ＯＴＵ４Ｖ信号１２の情報領域から、誤り訂正のためのパリティ情報を生成する。さらに、符号化部１２０は、フレーム収容部１１０にて設定されたパリティ領域に、生成したパリティ情報を挿入し、誤り訂正符号語１３として光送信処理部１３０へと出力する。
　光送信処理部１３０は、誤り訂正符号語１３として入力された電気信号を、伝送を行うための光信号１４へと変換し、光伝送路へと出力する。
　一方、本装置が光信号の受信端として機能する際には、光受信処理部１５０は、光伝送路からの光信号１５を受信する。さらに、光受信処理部１５０は、受信した光信号１５を電気信号１６へと変換し、復号部１６０へと出力する。
　復号部１６０は、入力した電気信号１６に対して誤り訂正処理を行い、復号されたＯＴＵ４Ｖ信号１７を信号抽出部１７０へと出力する。
　信号抽出部１７０は、入力したＯＴＵ４Ｖ信号１７からクライアント信号１８の抽出を行い、ユーザ側の装置へ出力する。
　図２は、本発明の実施の形態１において、可変パリティ領域を設定されたＯＴＵ４Ｖフレームの構成を示す図である。ＯＴＵ４Ｖフレームは、Ｏｖｅｒｈｅａｄ領域、ペイロード領域、Ｆｉｘｅｄ　Ｓｔｕｆｆ領域、および固定のパリティ領域で構成される。ペイロード領域は、全８０のトリビュタリスロット（ＴＳ（１）、ＴＳ（２）、・・・、ＴＳ（８０））で構成されており、可変の値Ｍ（ただし、Ｍは、１以上、７９以下の整数）に対して、ＴＳ（１）からＴＳ（Ｍ）までを、クライアント信号１１の収容に使用し、ＴＳ（Ｍ＋１）からＴＳ８０までを可変パリティ領域として使用する。
　誤り訂正符号処理において、符号化部１２０は、Ｏｖｅｒｈｅａｄ、Ｆｉｘｅｄ　Ｓｔｕｆｆ、およびＴＳ（１）からＴＳ（Ｍ）までを、情報領域として、パリティを求める。さらに、符号化部１２０は、ＴＳ（Ｍ＋１）からＴＳ（８０）までの可変パリティ領域と固定パリティ領域に対して、パリティ情報を挿入する。
　フレーム構成制御部１００は、ＯＴＵ４Ｖフレーム構成を決定するクライアント信号１１の収容形態を、フレーム収容部１１０、符号化部１２０、復号部１６０、信号抽出部１７０に対して通知する。これにより、各構成部間で、同一のＯＴＵ４Ｖフレーム構成として可変の値Ｍを共有し、信号処理の整合をとることが可能となる。
　図３は、本発明の実施の形態１における符号化部１２０の符号化行列を示す図である。また、図４は、本発明の実施の形態１における復号部１６０の検査行列を示す図である。なお、符号化部１２０内の符号語演算回路（図示せず）、および復号部１６０内の符号語演算回路（図示せず）は、基本となる符号化行列あるいは検査行列に対して、行数を追加あるいは削減して変更を加えることが可能な構成を有する回路であり、たとえば、特許文献２記載の回路方式によって実現することが可能である。
　次に、符号化の動作について、詳細に説明する。送信端において、フレーム収容部１１０は、クライアント信号１１を受信し、フレーム構成制御部１００より通知されたＯＤＴＵトリビュタリスロットに対して、クライアント信号１１の収容を行う。クライアント信号１１を収容したＴＳ（１）からＴＳ（Ｍ）までのＯＤＴＵトリビュタリスロットは、フレーム収容部１１０において、データを挿入されていないＴＳ（Ｍ＋１）からＴＳ（８０）と併せて時分割多重される。
　さらに、時分割多重されたデータは、フレーム収容部１１０において、Ｏｖｅｒｈｅａｄ、Ｆｉｘｅｄ　Ｓｔｕｆｆ領域、およびデータを挿入されていない固定パリティ領域が付与され、ＯＴＵ４Ｖフレーム信号１２として成形され、ＯＴＵ４Ｖのクロック速度にて、符号化部１２０へと出力される。
　符号化部１２０は、フレーム構成制御部１００より通知されたフレーム構成情報に基づいて、入力されたＯＴＵ４Ｖフレーム信号１２のＯｖｅｒｈｅａｄ、Ｆｉｘｅｄ　Ｓｔｕｆｆ、およびＴＳ（１）からＴＳ（Ｍ）に対して、符号化行列を用いて、パリティの算出を行う。
　符号化部１２０の符号化行列は、その列数を符号長である、フレーム長のＮ倍もしくは１／Ｎ倍とし（ただし、Ｎは、１以上の整数）、その行数を、符号語中における情報長であるＯｖｅｒｈｅａｄ、Ｆｉｘｅｄ　Ｓｔｕｆｆ、およびＴＳ（１）からＴＳ（Ｍ）のサイズを総計した値にとる。演算によって得られたパリティビットは、ＯＴＵ４Ｖフレーム中の固定のパリティ領域、およびＴＳ（Ｍ＋１）からＴＳ（８０）の可変のパリティ領域のビット位置に挿入される。
　ここで、本発明では、符号化行列の行数を、ＯＤＴＵ　ＴＳのデータサイズの単位（すなわち、Ｍの値）に応じて可変にするように、符号化部１２０内の符号語演算回路を構成する。この結果、フレーム構成制御部１００により制御される、パリティ演算の対象として割り当てるＯＤＴＵ　ＴＳの数に応じて、同一の符号長でのパリティを演算することが可能となる。
　次に、復号の動作について説明する。受信端において、光受信処理部１５０にて受信され、電気信号へと変換されたＯＴＵ４Ｖ信号１６に対し、復号部１６０は、誤り訂正の復号処理を行う。復号部１６０の検査行列は、その列数を、符号長である、フレーム長のＮ倍もしくは１／Ｎ倍とし、その行数を、符号語中におけるパリティ長である固定パリティ領域のサイズとＴＳ（Ｍ＋１）からＴＳ（８０）のサイズを総計した値にとる。
　ここで、本発明では、検査行列の行数を、ＯＤＴＵ　ＴＳのデータサイズの単位（すなわち、８０－Ｍの値）に応じて可変にするように、復号部１６０内の符号語演算回路を構成する。この結果、フレーム構成制御部１００により制御される、可変パリティ領域として割り当てるＯＤＴＵ　ＴＳの数に応じて、同一の符号長で復号処理を行うことが可能となる。
　復号部１６０により復号処理されたＯＴＵ４Ｖ信号１７に対し、信号抽出部１７０は、各ＯＤＴＵ信号の抽出と、ＯＤＴＵ信号からのクライアント信号１８の抽出を行う。さらに、信号抽出部１７０は、抽出したクライアント信号１８を、ユーザ側の装置へと転送する。
　以上のように、実施の形態１によれば、ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵ単位でパリティを可変とするＦＥＣフレーム処理装置において、以下の特徴を有するＦＥＣフレーム処理構成を備えている。
（１）フレーム構成を決定するクライアント信号の収容形態を通知し、符号化側および復号側の各構成部間で、同一のフレーム構成を採用することによる信号処理の整合を図るフレーム構成制御部を備える。
（２）誤り訂正符号化部として、符号長をＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、基本となる符号化行列に対して、ＯＤＴＵ　ＴＳ単位で、符号化行列の行数を増減可能な構成を備える。
（３）誤り訂正復号部として、基本となる検査行列に対して、ＯＤＴＵ　ＴＳ単位で、検査行列の行数を増減可能な構成を備える。
　このような構成を備えることで、冗長度ごとに複数の誤り訂正回路を用いることなく、同一の符号長でのパリティ演算、および同一の符号長での復号処理を実現できる。この結果、可変パリティの冗長度に対応した、誤り訂正符号化／復号化回路を、小回路規模で実現することが可能となる。

Claims (3)

  1. 　ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵトリビュタリスロット単位でパリティを可変とするＦＥＣフレーム処理装置において、
    　クライアント信号を収容するためのＯＤＴＵトリビュタリスロット数を通知することでフレーム構成を決定するフレーム構成制御部と、
    　前記フレーム構成制御部により決定されたフレーム構成に基づいて、符号化行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍（ただし、Ｎは、１以上の整数）で構成し、前記符号化行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な符号化部と、
    　前記フレーム構成制御部により決定されたフレーム構成に基づいて、検査行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、前記検査行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な復号部と
    　を備え、可変パリティの冗長度に対応した、誤り訂正符号化／復号化処理を小回路規模で実現する
    　ＦＥＣフレーム処理装置。
  2. 　請求項１に記載のＦＥＣフレーム処理装置において、
    　前記フレーム構成制御部は、ＦＥＣフレームとしてＯＴＵ４Ｖフレームを採用した場合に、ペイロード領域を構成する全８０のトリビュタリスロットＴＳ（１）～ＴＳ（８０）のうち、ＴＳ（１）からＴＳ（Ｍ）まで（ただし、Ｍは１以上７９以下の整数）を、クライアント信号の収容に使用し、ＴＳ（Ｍ＋１）からＴＳ（８０）までを可変パリティ領域として使用するように規定して前記符号化部および前記復号部に通知することで、フレーム構成を決定する
    　ＦＥＣフレーム処理装置。
  3. 　ＯＴＮ信号のペイロード部分を構成するＯＤＴＵ単位でクライアント信号収容を行い、ＯＤＴＵトリビュタリスロット単位でパリティを可変とするＦＥＣフレーム処理装置において、可変パリティの冗長度に対応した、誤り訂正符号化／復号化処理を小回路規模で実現するＦＥＣフレーム処理方法であって、
    　クライアント信号を収容するためのＯＤＴＵトリビュタリスロット数を通知することでフレーム構成を決定するフレーム構成制御ステップと、
    　前記フレーム構成制御ステップにより決定されたフレーム構成に基づいて、符号化行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍（ただし、Ｎは、１以上の整数）で構成し、前記符号化行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な符号ステップと、
    　前記フレーム構成制御ステップにより決定されたフレーム構成に基づいて、検査行列の列数を、ＯＴＮフレーム長のＮ倍もしくは１／Ｎ倍で構成し、前記検査行列の行数を、ＯＤＴＵのトリビュタリスロット単位で増減させることが可能な復号ステップと
    　を有するＦＥＣフレーム処理方法。
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