WO2013132569A1 - 半導体装置 - Google Patents

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Definitions

  • the present invention relates to a semiconductor device including therein a semiconductor element and an electronic component disposed in the vicinity of the semiconductor element.
  • an electronic component such as a resistor for adjusting the balance of input signals input to each semiconductor element is provided in the vicinity of the semiconductor element.
  • the electronic component is joined (connected) to the electrode pattern formed on the substrate via solder (see, for example, Patent Document 1).
  • the present invention has been made to solve these problems, and an object of the present invention is to provide a semiconductor device capable of improving the life of a solder joint portion of an electronic component.
  • a semiconductor device includes a substrate, an electrode pattern formed on the substrate, and an electronic component connected to the electrode pattern via solder, A portion connected to the electronic component via the solder is formed in a concave shape.
  • a substrate an electrode pattern formed on the substrate, and an electronic component connected to the electrode pattern via solder, the electrode pattern being connected to the electronic component via solder
  • the electrode pattern being connected to the electronic component via solder
  • FIG. 1 is a diagram showing a configuration of a semiconductor device according to a first embodiment. It is a figure which shows the structure of the semiconductor device by a base technology.
  • FIG. 2 is a diagram showing a configuration of a semiconductor device according to the prerequisite technology.
  • FIG. 2 shows the configuration of the resistor 4 (electronic component) provided in the semiconductor device.
  • the resistor 4 is disposed in the vicinity of a semiconductor element (not shown) that is also provided inside the semiconductor device.
  • an upper pattern 2 is formed on the ceramic 1, and a lower pattern 3 is formed on the opposite side of the ceramic 1 from the upper pattern 2.
  • the upper pattern 2 and the lower pattern 3 are electrode patterns made of a conductor formed on the ceramic 1.
  • the resistor 4 is disposed so as to straddle the upper pattern 2.
  • the electrode portion of the resistor 4 is joined (connected) via the upper pattern 2 and the solder 5.
  • the surface of the upper pattern 2 has a flat shape with no steps.
  • solder joints of the resistors 4 are also required to have improved reliability (lifetime improvement) at high temperatures.
  • the solder joint portion of the resistor 4 provided inside the semiconductor device according to the premise technique as shown in FIG. 2 is not provided with a measure for improving the life, and the solder joint portion when the semiconductor element operates at a high temperature. Therefore, there is a possibility that a problem such as peeling of the solder 5 occurs.
  • the present invention has been made to solve the above problems, and will be described in detail below.
  • FIG. 1 is a diagram showing a configuration of a semiconductor device according to an embodiment of the present invention.
  • FIG. 1 shows the configuration of the resistor 4 (electronic component) provided in the semiconductor device.
  • the resistor 4 is disposed in the vicinity of a semiconductor element (not shown) that is also provided inside the semiconductor device.
  • the semiconductor element may be SiC, for example. Since SiC operates at a high temperature, it is particularly effective in the present invention to use SiC as a semiconductor element.
  • an upper pattern 2 is formed on a ceramic 1 serving as a substrate, and a lower pattern 3 is formed on the opposite side of the upper pattern 2 on the ceramic 1.
  • the upper pattern 2 and the lower pattern 3 are electrode patterns made of a conductor formed on the ceramic 1.
  • the semiconductor element is disposed on the ceramic 1 or the upper pattern 2 and in the vicinity of the resistor 4.
  • the resistor 4 is disposed so as to straddle the upper pattern 2.
  • the electrode portion of the resistor 4 is joined (connected) via the upper pattern 2 and the solder 5.
  • a concave stepped portion 6 is formed on the surface of the upper pattern 2.
  • the resistor 4 is disposed on the stepped shape portion 6 and joined to the upper pattern 2 via the solder 5. At this time, the solder 5 is formed so as to cover the bottom surface and the side surface of the stepped shape portion 6.
  • the semiconductor device according to the present embodiment is joined (connected) to the ceramic 1 (substrate), the upper pattern 2 (electrode pattern) formed on the ceramic 1, and the solder 5 on the upper pattern 2.
  • a resistor 4 (electronic component) is provided, and the upper pattern 2 is formed in a concave shape at a portion connected via the resistor 4 and the solder 5 (stepped shape portion 6).
  • the amount of the solder 5 is increased as compared with the conventional case, and the area where the solder 5 is joined to the resistor 4 and the upper pattern 2 is increased. Therefore, the bonding strength of the solder 5 can be increased as compared with the conventional case.
  • the joint strength of the solder 5 can be increased by forming the stepped shape portion 6 on the upper pattern 2. Therefore, even if the resistor 4 (electronic component) is disposed in the vicinity of the semiconductor element, the life of the solder joint portion of the resistor 4 can be improved.
  • it is particularly effective to apply a semiconductor element such as SiC that operates at a high temperature to the present invention, and the reliability of the entire semiconductor device including the semiconductor element can be improved.
  • the resistor 4 is used as an example of the electronic component.
  • the electronic device is not limited to the resistor 4 and may be another electronic component.

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Abstract

　本発明は、電子部品のはんだ接合部の寿命を向上させることが可能な半導体装置を提供することを目的とする。本発明による半導体装置は、セラミック１と、セラミック１上に形成された上パターン２と、上パターン２上にはんだ５を介して接続された抵抗器４とを備え、上パターン２は、抵抗器４とはんだ５を介して接続される箇所が、凹形状に形成されることを特徴とする。

Description

半導体装置
　本発明は、半導体素子と、当該半導体素子の近傍に配置された電子部品とを内部に備える半導体装置に関する。
　半導体装置の内部では、半導体素子の近傍に、当該半導体素子ごとに入力される入力信号のバランスを調整する抵抗器などの電子部品が備えられている。当該電子部品は、基板上に形成された電極パターン上にはんだを介して接合（接続）されている（例えば、特許文献１参照）。
特開２００７－２３７２１２号公報
　近年、半導体素子の高温動作化が進み、当該半導体素子の周辺（近傍）で用いられている材料も高温下における信頼性の向上が要求されている。また、電子部品のはんだ接合部に関しても、従来よりも高温下における信頼性の向上が要求されている。電子部品のはんだ接合部の信頼性を向上させるためには、はんだ接合部を半導体素子の高温動作に耐え得るように形成して寿命を向上させる必要がある。しかし、従来では、電子部品のはんだ接合部の寿命を向上させるための対策がなされていなかった。
　本発明は、これらの問題を解決するためになされたものであり、電子部品のはんだ接合部の寿命を向上させることが可能な半導体装置を提供することを目的とする。
　上記の課題を解決するために、本発明による半導体装置は、基板と、基板上に形成された電極パターンと、電極パターン上にはんだを介して接続された電子部品とを備え、電極パターンは、電子部品とはんだを介して接続される箇所が、凹形状に形成されることを特徴とする。
　本発明によると、基板と、基板上に形成された電極パターンと、電極パターン上にはんだを介して接続された電子部品とを備え、電極パターンは、電子部品とはんだを介して接続される箇所が、凹形状に形成されることを特徴とするため、電子部品のはんだ接合部の寿命を向上させることが可能となる。
本実施の形態１による半導体装置の構成を示す図である。 前提技術による半導体装置の構成を示す図である。
　本発明の実施の形態について、図面に基づいて以下に説明する。
　＜前提技術＞
　まず、本発明の前提となる技術（前提技術）について説明する。
　図２は、前提技術による半導体装置の構成を示す図である。
　図２では、半導体装置の内部に備えられた抵抗器４（電子部品）の構成について示している。抵抗器４は、同じく半導体装置の内部に備えられた半導体素子（図示せず）の近傍に配置されている。
　図２に示すように、セラミック１上には上パターン２が形成されており、セラミック１上の上パターン２とは反対側には下パターン３が形成されている。上パターン２および下パターン３は、セラミック１上に形成された導体からなる電極パターンを示している。
　抵抗器４は、上パターン２間を跨ぐように配置されている。また、抵抗器４の電極部は、上パターン２とはんだ５を介して接合（接続）されている。
　また、上パターン２の表面は、段差がなく平坦な形状となっている。
　上述のように、近年、半導体素子の高温動作化に伴い、抵抗器４（電子部品）のはんだ接合部も高温下における信頼性の向上（寿命の向上）が要求されている。しかし、図２に示すような前提技術による半導体装置の内部に備えられた抵抗器４のはんだ接合部は、寿命を向上させるための対策がなされておらず、半導体素子が高温動作するとはんだ接合部からはんだ５が剥離するなどの不具合が生じる可能性があった。
　本発明は、上記の問題を解決するためになされたものであり、以下に詳細に説明する。
　＜実施の形態＞
　図１は、本発明の実施の形態による半導体装置の構成を示す図である。
　図１では、半導体装置の内部に備えられた抵抗器４（電子部品）の構成について示している。抵抗器４は、同じく半導体装置の内部に備えられた半導体素子（図示せず）の近傍に配置されている。なお、半導体素子は、例えばＳｉＣであってもよい。ＳｉＣは高温動作するため、半導体素子としてＳｉＣを用いることは本発明において特に有効である。
　図１に示すように、基板となるセラミック１上には上パターン２が形成されており、セラミック１上の上パターン２とは反対側には下パターン３が形成されている。上パターン２および下パターン３は、セラミック１上に形成された導体からなる電極パターンを示している。また、半導体素子は、セラミック１または上パターン２の上であって、抵抗器４の近傍に配置されている。
　抵抗器４は、上パターン２間を跨ぐように配置されている。また、抵抗器４の電極部は、上パターン２とはんだ５を介して接合（接続）されている。
　上パターン２の表面には、凹形状の段付き形状部６が形成されている。抵抗器４は、段付き形状部６上に配置され、はんだ５を介して上パターン２と接合されている。このとき、はんだ５は、段付き形状部６の底面および側面を覆うように形成されている。
　すなわち、本実施の形態による半導体装置は、セラミック１（基板）と、セラミック１上に形成された上パターン２（電極パターン）と、上パターン２上にはんだ５を介して接合（接続）された抵抗器４（電子部品）とを備え、上パターン２は、抵抗器４とはんだ５を介して接続される箇所が、凹形状に形成されている（段付き形状部６）。
　上記のように構成することによって、従来と比較して、はんだ５の量が多くなり、また、抵抗器４および上パターン２に対してはんだ５が接合する面積が大きくなる。従って、従来よりもはんだ５の接合強度を増大させることができる。
　以上のことから、本実施の形態によれば、上パターン２上に段付き形状部６を形成することによって、はんだ５の接合強度を増大させることができる。従って、半導体素子の近傍に抵抗器４（電子部品）を配置しても、当該抵抗器４のはんだ接合部の寿命を向上させることが可能となる。また、ＳｉＣなど高温動作する半導体素子を本発明に適用させることは特に有効であり、当該半導体素子を備える半導体装置全体の信頼性を向上させることができる。
　なお、本実施の形態では、電子部品の一例として抵抗器４を用いて説明したが、抵抗器４に限らず他の電子部品であってもよい。
　なお、本発明は、その発明の範囲内において、実施の形態を適宜、変形、省略することが可能である。
　１　セラミック、２　上パターン、３　下パターン、４　抵抗器、５　はんだ、６　段付き形状部。

Claims (4)

  1. 　基板と、
    　前記基板上に形成された電極パターンと、
    　前記電極パターン上にはんだを介して接続された電子部品と、
    を備え、
    　前記電極パターンは、前記電子部品と前記はんだを介して接続される箇所が、凹形状に形成されることを特徴とする、半導体装置。
  2. 　前記電子部品は、抵抗器であることを特徴とする、請求項１に記載の半導体装置。
  3. 　前記電子部品は、前記基板または前記電極パターン上に配置された半導体素子の近傍に設けられることを特徴とする、請求項１に記載の半導体装置。
  4. 　前記半導体素子は、ＳｉＣにより形成されることを特徴とする、請求項３に記載の半導体装置。
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