WO2012050122A1 - Ｓｏｉ基板 - Google Patents

Ｓｏｉ基板 Download PDF

Info

Publication number
WO2012050122A1
WO2012050122A1 PCT/JP2011/073412 JP2011073412W WO2012050122A1 WO 2012050122 A1 WO2012050122 A1 WO 2012050122A1 JP 2011073412 W JP2011073412 W JP 2011073412W WO 2012050122 A1 WO2012050122 A1 WO 2012050122A1
Authority
WO
WIPO (PCT)
Prior art keywords
film
soi substrate
carbon film
substrate
silicon
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Ceased
Application number
PCT/JP2011/073412
Other languages
English (en)
French (fr)
Inventor
貴壽 山田
雅考 長谷川
正統 石原
津川　和夫
金　載浩
古賀　義紀
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
National Institute of Advanced Industrial Science and Technology AIST
Original Assignee
National Institute of Advanced Industrial Science and Technology AIST
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by National Institute of Advanced Industrial Science and Technology AIST filed Critical National Institute of Advanced Industrial Science and Technology AIST
Priority to DE112011103476T priority Critical patent/DE112011103476T5/de
Priority to JP2012538690A priority patent/JP5665202B2/ja
Publication of WO2012050122A1 publication Critical patent/WO2012050122A1/ja
Anticipated expiration legal-status Critical
Ceased legal-status Critical Current

Links

Images

Classifications

    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P90/00—Preparation of wafers not covered by a single main group of this subclass, e.g. wafer reinforcement
    • H10P90/19—Preparing inhomogeneous wafers
    • H10P90/1904—Preparing vertically inhomogeneous wafers
    • H10P90/1906—Preparing SOI wafers
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D30/00—Field-effect transistors [FET]
    • H10D30/60—Insulated-gate field-effect transistors [IGFET]
    • H10D30/67—Thin-film transistors [TFT]
    • H10D30/6758—Thin-film transistors [TFT] characterised by the insulating substrates
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/24—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials using chemical vapour deposition [CVD]
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/29—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
    • H10P14/2901—Materials
    • H10P14/2902—Materials being Group IVA materials
    • H10P14/2905—Silicon, silicon germanium or germanium
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/29—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
    • H10P14/2901—Materials
    • H10P14/2922—Materials being non-crystalline insulating materials, e.g. glass or polymers
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3202—Materials thereof
    • H10P14/3204—Materials thereof being Group IVA semiconducting materials
    • H10P14/3206—Carbon, e.g. diamond-like carbon
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3202—Materials thereof
    • H10P14/3238—Materials thereof being insulating materials
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3242—Structure
    • H10P14/3244—Layer structure
    • H10P14/3248—Layer structure consisting of two layers
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3242—Structure
    • H10P14/3256—Microstructure
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/34—Deposited materials, e.g. layers
    • H10P14/3402—Deposited materials, e.g. layers characterised by the chemical composition
    • H10P14/3404—Deposited materials, e.g. layers characterised by the chemical composition being Group IVA materials
    • H10P14/3406—Carbon, e.g. diamond-like carbon
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/36—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by treatments done before the formation of the materials
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/60—Formation of materials, e.g. in the shape of layers or pillars of insulating materials
    • H10P14/63—Formation of materials, e.g. in the shape of layers or pillars of insulating materials characterised by the formation processes
    • H10P14/6326—Deposition processes
    • H10P14/6328—Deposition from the gas or vapour phase
    • H10P14/6334—Deposition from the gas or vapour phase using decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H10P14/6338—Deposition from the gas or vapour phase using decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition the reactions being activated by other means than plasma or thermal, e.g. photo-CVD
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/60—Formation of materials, e.g. in the shape of layers or pillars of insulating materials
    • H10P14/69—Inorganic materials
    • H10P14/6902—Inorganic materials composed of carbon, e.g. alpha-C, diamond or hydrogen doped carbon
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W10/00—Isolation regions in semiconductor bodies between components of integrated devices
    • H10W10/10—Isolation regions comprising dielectric materials
    • H10W10/181—Semiconductor-on-insulator [SOI] isolation regions, e.g. buried oxide regions of SOI wafers

Definitions

  • the present invention relates to a silicon-on-insulator (SOI) substrate for use in a power semiconductor device or the like, and more particularly to an SOI substrate having high insulation and high thermal conductivity.
  • SOI silicon-on-insulator
  • the power consumption of the CPU of the computer has been reduced.
  • the insulating property of a silicon oxide film (SiO 2 ) layer used as an insulating layer (hereinafter referred to as “I layer”) of an existing SOI substrate is low, low power consumption for power converters and car electronics and It cannot be used as a low-loss power semiconductor device substrate.
  • Non-Patent Document 1 Non-Patent Document 2
  • MPCVD microwave plasma vapor deposition
  • Patent Document 1 and Patent Document 2 disclose a technique for forming a uniform carbon film in an area of about 30 cm in diameter by surface wave plasma vapor deposition.
  • a field effect transistor intended for an integrated circuit (LSI) application has been prototyped on an SOI substrate created using this method, and its operation has been confirmed (Non-patent Document 3).
  • HFCVD hot filament vapor deposition
  • tungsten (W) or tantalum (Ta) used as a filament during synthesis is mixed into the silicon substrate.
  • the device characteristics may be affected, such as by forming defects at the silicon / diamond interface.
  • a film thickness of 100 ⁇ m or more is required, so cracking or breakage due to thermal stress is a problem due to thick film formation.
  • the carbon film formed by the surface wave plasma vapor deposition method has excellent characteristics such as high thermal conductivity and high insulation, and a power semiconductor device is formed on an SOI substrate using the carbon film as an I layer.
  • a rare metal-free device having no cooling mechanism is realized. Since the carbon film synthesized by the surface wave plasma vapor deposition method is as thin as several hundred nm, the thermal conductivity is several tens W / mK. However, it is not sufficient and is difficult to apply to power semiconductor devices.
  • the present invention has been made in view of the above circumstances, and solves the conventional problem in a SOI substrate using a carbon-based material for the I layer and free of rare metal and having no cooling mechanism. It is an object of the present invention to provide an SOI substrate with high thermal conductivity and high insulation that can be applied to an SOI substrate for devices.
  • the inventors of the present invention have made a hybrid structure of a carbon film and a microcrystalline diamond film as the I layer, whereby an SOI using a carbon film as a conventional I layer. It has been found that an SOI substrate having high thermal conductivity and high insulation can be obtained by simultaneously solving both the problem of the substrate and the problem of diamond synthesis in the HFCVD method.
  • the present invention has been completed based on these findings, and is as follows.
  • An SOI substrate wherein the insulating layer of the SOI substrate has a hybrid structure of a carbon film and a microcrystalline diamond film.
  • the hybrid structure is composed of carbon film / microcrystalline diamond film / carbon film.
  • the microcrystalline diamond film is a film formed by a hot filament vapor deposition method.
  • an SOI substrate having high thermal conductivity and high insulation which is a problem of a conventional SOI substrate, can be obtained, and can be used as a power semiconductor device substrate.
  • FIG. 5 shows current-electric field characteristics of an SOI substrate obtained in Example 1.
  • FIG. 11 shows current-electric field characteristics of an SOI substrate obtained in Example 2.
  • silicone of the SOI substrate obtained by the comparative example 1 The figure which shows the electric current electric field characteristic of the SOI substrate obtained by the comparative example 1
  • the SOI substrate of the present invention is characterized in that the I layer has a hybrid structure composed of a carbon film and a microcrystalline diamond film.
  • 1 to 4 schematically show some embodiments of an SOI substrate of the present invention, in which 1 is a silicon substrate, 2 is a carbon film, and 3 is a microcrystalline diamond film. Reference numerals 4 denote silicon oxide films, respectively. That is, FIG. 1 shows an SOI substrate in which the I layer is composed of the carbon film 2 and the microcrystalline diamond film 3.
  • FIG. 2 shows the SOI substrate shown in FIG. 1 between the silicon substrate 1 and the carbon film 2. 1 having a silicon oxide film 4 is shown.
  • 3 shows an SOI substrate in which the I layer is composed of the carbon film 2, the microcrystalline diamond film 3, and the carbon film 2.
  • FIG. 4 shows the silicon substrate 1 and the carbon film in the SOI substrate shown in FIG. A film having a silicon oxide film 4 between 2 is shown.
  • a carbon film is formed on a silicon substrate having a diameter of 30 cm or more by using the surface wave plasma vapor deposition method in order to adapt to the manufacturing process of an existing silicon semiconductor device.
  • a homogeneous microcrystalline diamond film having a diameter of 30 cm or more on a formed substrate hereinafter, also referred to as “carbon film / silicon substrate”
  • high thermal conductivity is achieved.
  • W tungsten
  • Ta tantalum
  • the film can prevent a defect from being formed in silicon as a device manufacturing layer, and can reduce a leakage current.
  • the microcrystalline diamond film has a thick film structure of 100 ⁇ m or more in order to increase the breakdown voltage.
  • a microcrystalline diamond film is formed by hot filament vapor deposition on a carbon film having a high thermal conductivity and high withstand voltage function formed by surface wave plasma vapor deposition.
  • the carbon film As a film having a function of preventing the filament material from being mixed into silicon and having a high pressure resistance and high thermal conductivity, the carbon film has a flat surface and also has a high pressure resistance and high thermal conductivity function. Although it is the most suitable film, in addition to the carbon film, a silicon oxide film, an aluminum nitride film, a silicon nitride film, or the like can also be used as having the same function.
  • one of the methods for manufacturing an SOI substrate of the present invention is to form a carbon film having a flat surface at an atomic level and a function of preventing entry into silicon, high pressure resistance, and high thermal conductivity on a silicon substrate.
  • This is a method comprising a step of forming a film and a step of forming a microcrystalline diamond on the carbon film / silicon substrate obtained in the previous step by a hot filament vapor phase growth method. (See FIG. 1).
  • the method for forming the silicon oxide film can be selected from the formation by a thermal oxidation method, a known film formation method such as a vapor phase growth method and a sputtering method.
  • a carbon film having a flat surface at the atomic level and a function of high pressure resistance and high thermal conductivity after the above-described microcrystalline diamond film forming step is used.
  • an SOI substrate having a hybrid structure (carbon film / microcrystalline diamond film / carbon film) of a carbon film and a microcrystalline diamond film having a high withstand voltage and high thermal conductivity can be produced (FIGS. 3 and 4). reference).
  • a homogeneous microcrystalline diamond film with a diameter of 30 cm or more is laminated on the silicon / carbon film substrate with a diameter of 30 cm or more. It is also possible by the method.
  • a mechanical polishing method is used to flatten the diamond surface. When this mechanical polishing is used on the carbon film surface of the silicon / carbon film substrate, defects and strains are generated in the silicon substrate for manufacturing the device. For this reason, it is necessary to form a carbon film formed on the silicon substrate by a surface wave plasma vapor deposition method that can form a flat surface at the atomic level in a self-organized manner.
  • the microcrystalline diamond film requires an area of 30 cm or more in diameter
  • synthesis by a hot filament vapor phase growth method can be used.
  • the interface side of the microcrystalline diamond film with the substrate can be used as a bonding surface.
  • an SOI substrate having a hybrid structure of carbon film / microcrystalline diamond film by the bonding method described above will be specifically described.
  • a carbon film having a flat surface at an atomic level is formed on a silicon substrate by surface wave plasma vapor deposition to produce a carbon film / silicon substrate.
  • a microcrystalline diamond film is formed on another silicon substrate by hot filament vapor deposition, and the silicon substrate is removed to form atoms formed at the interface between silicon and microcrystalline diamond. A level microcrystalline diamond surface is obtained.
  • the obtained flat surface at the atomic level is bonded to the carbon film surface of the carbon film / silicon substrate.
  • the carbon film surface and the microcrystalline diamond surface can be cleaned using an ion beam or plasma, and the carbon film surface and the microcrystalline diamond surface can be bonded together by a vacuum pressure bonding method.
  • yet another method for manufacturing an SOI substrate according to the present invention includes (1) a step of first forming a carbon film having a flat surface at an atomic level on a silicon substrate by surface wave plasma vapor deposition.
  • a method comprising a step of bonding a flat surface at an atomic level to the surface of the carbon film, and the method has a hybrid structure of a carbon film / microcrystalline diamond film having a high breakdown voltage and high thermal conductivity.
  • An SOI substrate can be created.
  • a carbon film / silicon substrate is bonded to a silicon substrate and a carbon substrate by bonding a microcrystalline diamond film formed by a hot filament vapor deposition method or a hot filament vapor deposition method.
  • An SOI substrate for power semiconductors having no heat active defects and impurities and having excellent heat dissipation characteristics is produced at the interface of the film.
  • the SOI substrate of the present invention has a hybrid structure of a carbon film and a microcrystalline diamond film.
  • the hybrid structure of the carbon film and the microcrystalline diamond film is a diamond thin film formed by CVD, such as tungsten or tantalum. Therefore, it is possible to combine with power semiconductor devices (silicon carbide, gallium nitride, aluminum gallium nitride) other than silicon semiconductor.
  • power semiconductor devices silicon carbide, gallium nitride, aluminum gallium nitride
  • a hybrid structure of a carbon film and a microcrystalline diamond film can be directly formed on a semiconductor material such as silicon carbide or gallium nitride. As in the case of, it can be realized by a bonding technique used in a semiconductor process.
  • ⁇ Electrical insulation> As a sample used for evaluation of electrical insulation, a sample in which an electrode having a diameter of 30 ⁇ m was formed on a microcrystalline diamond film of an SOI substrate of the present invention was used. The silicon of the SOI substrate was placed in a copper sample holder using a conductive silver paste. The measurement was performed by measuring current-voltage characteristics in a vacuum of 5 ⁇ 10 ⁇ 7 Torr. The value obtained by dividing the applied voltage by the total thickness of the microcrystalline diamond film and the carbon film was defined as the electric field, and the electric insulation was evaluated using the current-electric field characteristics. The larger the electric field where current is observed, the higher the electrical insulation.
  • the thermal conductivity was measured by a thermoreflectance method.
  • the silicon substrate of the SOI substrate was removed with a mixed solution of hydrofluoric acid and nitric acid to produce a self-stereoscopic structure of a microcrystalline diamond film / carbon film.
  • a molybdenum thin film having a thickness of 100 nm was formed on the microcrystalline diamond surface and the carbon film surface by sputtering.
  • the thermal conductivity in the direction perpendicular to the laminating direction and the laminating direction (in-plane direction) of the laminate was evaluated.
  • Example 1 A 4-inch diameter wafer-like silicon substrate was used as the substrate. In order to increase the nucleation density of the carbon particles and form a uniform film, a pretreatment (nanocrystal diamond particle adhesion treatment) was performed on the substrate before the film formation.
  • a colloidal solution (product name: Nanoamand, manufactured by Nano Carbon Laboratory Co., Ltd.) in which nanocrystal diamond particles having an average particle size of 5 nm are dispersed in pure water, or nanocrystal diamond particles having an average particle size of 30 nm or 40 nm (Tomei) Diamond Co., Ltd., product names MD30 and MD40) dispersed in pure water, or cluster diamond particles or graphite cluster diamond particles (Tokyo Diamond Tool Co., Ltd., product names CD and GCD, respectively), or Adamantane or a derivative thereof or a derivative thereof (each made by Idemitsu Kosan Co., Ltd.) solution was used, and the substrate was immersed in an ultrasonic cleaner.
  • nanoamand manufactured by Nano Carbon Laboratory Co., Ltd.
  • the substrate is immersed in ethanol for ultrasonic cleaning and dried, or these solutions are uniformly applied on the substrate by spin coating and dried.
  • the uniformity of this pretreatment affects the uniformity of the carbon film after film formation.
  • the number of diamond particles adhering on the substrate was 10 10 to 10 11 per cm 2 .
  • the source gas a mixed gas of CH 4 , CO 2 and H 2 was used, and the concentrations of CH 4 and CO 2 were each 1 mol%.
  • the gas pressure in the reaction vessel is 1.0 to 1.2 ⁇ 10 2 Pa (1.0 to 1.2 mbar), which is lower than the pressure (10 3 to 10 4 Pa) usually used for CVD synthesis of diamond, and a total of 20 A large area and uniform plasma was generated in a region wider than the substrate area by applying a microwave of ⁇ 24 kW.
  • the substrate temperature during film formation can be maintained at 450 ° C. or less by adjusting the distance between the substrate and the antenna by closely contacting the Mo sample stage and the cooling stage.
  • Film formation was performed for 6 hours under the above film formation conditions. A uniform and transparent carbon film was formed on the glass substrate after film formation. The film thickness was 200 nm.
  • a microcrystalline diamond film was formed on the surface of the carbon film by a hot filament vapor deposition method.
  • a hot filament vapor phase growth apparatus a large-area HFCVD apparatus (Sp3 Model 650) was used. Tungsten (W) was used as the filament, and the film was formed for 6 hours at a filament temperature of 2000 ° C. and a substrate temperature of 800 ° C. The film thickness was about 10 ⁇ m.
  • the SOI substrate obtained in Example 1 has the structure shown in FIG.
  • FIG. 5 shows the evaluation results of impurities in the silicon of the SOI substrate obtained in Example 1. Tungsten was not observed in the carbon film and the silicon substrate, and it was found that the carbon film has a role to prevent tungsten from being mixed during the formation of the microcrystalline diamond film.
  • Example 1 the current-electric field characteristics of the SOI substrate obtained in Example 1 are shown in FIG. Assuming that the electric field at which the current rapidly increases is the threshold electric field, the threshold electric field was 85 V / ⁇ m. This value is almost the same as the dielectric breakdown electric field (1 MV / cm) of single crystal diamond.
  • the thermal conductivity of the SOI substrate obtained in Example 1 was 250 W / mK in the stacking direction and 110 W / mK in the direction perpendicular to the stacking direction. This value is almost the same as the reported value of microcrystalline diamond, which is one digit higher than the previously reported carbon film.
  • Example 2 An SOI substrate was fabricated in the same manner as in Example 1 except that a silicon substrate on which a silicon oxide film (SiO 2 film) (thickness 20 nm) was formed was used. The structure of the SOI substrate obtained in Example 2 is shown in FIG.
  • FIG. 7 shows the result of evaluating impurities in the silicon of the SOI substrate obtained in Example 2. Tungsten was not observed in the carbon film, silicon oxide film (SiO 2 film), or silicon substrate, and it was found that the carbon film has a role of preventing the entry of tungsten during the formation of the microcrystalline diamond film.
  • Example 2 the current-electric field characteristics of the SOI substrate obtained in Example 2 are shown in FIG. Assuming that the electric field at which the current rapidly increases is the threshold electric field, the threshold electric field was 92 V / ⁇ m. This value is almost the same as the dielectric breakdown electric field (1 MV / cm) of single crystal diamond.
  • An excellent SOI substrate for power semiconductor devices can be manufactured.
  • FIG. 9 shows the results of impurity evaluation in silicon of the SOI substrate obtained in Comparative Example 1. Tungsten was observed at the interface between the microcrystalline diamond film and the silicon substrate, and was detected in the silicon substrate to a depth of 0.5 ⁇ m from the interface.
  • FIG. 10 shows the current-electric field characteristics of the SOI substrate obtained in Comparative Example 1. Assuming that the electric field at which the current rapidly increases is the threshold electric field, the threshold electric field was 40 V / ⁇ m. This value was half of the dielectric breakdown electric field (100 V / ⁇ m) of single crystal diamond.
  • the electric field where the leakage current of the SOI substrate of Example 1 is observed is that the SOI substrate having a hybrid structure of a carbon film and a microcrystalline diamond hybrid film as an I layer is Comparative Example 1. Compared with SOI using only the microcrystalline diamond film as an insulating layer, the electric field in which leakage current was observed increased twice. Therefore, it can be seen that an SOI substrate having a hybrid structure of a carbon film and a microcrystalline diamond film as an I layer can ensure insulation with a thickness half that of a microcrystalline diamond film alone. .
  • Example 3 In Example 1 and Example 2, by forming a similar 200 nm carbon film on the microcrystalline diamond film, the electric field at which leakage current was observed was doubled. That is, it can be seen that by forming the structures of FIGS. 3 and 4, an SOI substrate having a leakage electric field of about 120 V / ⁇ m and about 130 V / ⁇ m can be manufactured. Further, the thermal conductivity was improved by 8 times in the film forming direction of the value of the carbon film and 3 times in the direction perpendicular to the film forming direction (in-plane direction).
  • the SOI substrate having a hybrid structure of a carbon film and a microcrystalline diamond film or a film having a hybrid structure of a carbon film and a microcrystalline diamond film according to the present invention has a high insulating property and a high thermal conductivity. This is a very important technology because it can be used for all power semiconductor devices such as electric vehicles, hybrid vehicles, and inverters for motor control.

Landscapes

  • Recrystallisation Techniques (AREA)
  • Chemical Vapour Deposition (AREA)

Abstract

　本発明は、従来の絶縁層（Ｉ層）として炭素膜を用いたＳＯＩ基板の問題点と、ＨＦＣＶＤ法でのダイヤモンド合成の問題点の両方を同時に解決し、レアメタルフリーで冷却機構を有しないパワー半導体デバイス用ＳＯＩ基板を提供することを目的とするものであって、該ＳＯＩ基板において、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリット構造を有するＩ層をすることにより、好ましくは、さらにシリコン基板と炭素膜の間にシリコン酸化膜（ＳｉＯ２膜）を設けたＩ層とすることにより、高耐圧かつ高熱伝導性を有する、パワー半導体デバイス用ＳＯＩ基板を提供することができる。

Description

ＳＯＩ基板
　本発明は、パワー半導体デバイスなどに利用するためのシリコン・オン・インシュレーター（ＳＯＩ）基板、特に高絶縁性及び高熱伝導性を有するＳＯＩ基板に関する。
　電力変換器やカーエレクトロニクスなどに利用される低消費電力かつ低損失なパワー半導体デバイス実現には、半導体デバイスの動作時に自己発熱が生じるために、放熱や冷却を必要とする。放熱には、銅－モリブデン(Ｃｕ－Ｍｏ)や銅－タングステン(Ｃｕ－Ｗ)等の金属材料を放熱板として、デバイスに接着して利用している。ＭｏやＷは埋蔵量に制限があり、特にＷは代替材料開発が不可欠な材料である。そのため、今後需要が高くなることが予測されるパワー半導体デバイスの放熱材として、ユビキタス元素での置き換えが期待されている。また、冷却には空冷や水冷機構を付加するため、デバイスを含むシステム自体の大型化や、空冷や水冷用に電力を導入する必要があるため、パワー半導体デバイスの低消費電力化や低損失化が実現しても、システム全体の電力損失の削減には限界ある。
　一方、シリコン・オン・インシュレーター(ＳＯＩ)構造により、コンピューターのＣＰＵの低消費電力化が進んでいる。しかし、既存ＳＯＩ基板の絶縁層（以下、「Ｉ層」という。）として用いられているシリコン酸化膜(ＳｉＯ２)層の絶縁性が低いため、電力変換器やカーエレクトロニクス用の低消費電力かつ低損失なパワー半導体デバイス用基板としては、利用できない。
　高熱伝導性かつ高絶縁性を有するマイクロ結晶ダイヤモンド薄膜をＳＯＩ基板のＩ層として用い、シリコン・オン・ダイヤモンド(ＳＯＤ)構造を形成することで、冷却機構を有しないパワー半導体デバイス用のＳＯＩ基板が提案されている（非特許文献１、非特許文献２）。しかしながら、シリコンデバイスの熱による劣化は抑制されているが、マイクロ結晶ダイヤモンド層の成膜に、マイクロ波プラズマ気相成長(ＭＰＣＶＤ)法を利用しているため、直径５ｃｍ程度の面積までしか成膜が出来ないため、Ｓｉデバイスの実用化の観点からは、量産技術には適さないという問題がある。
　これに対し、熱フィラメント気相成長(ＨＦＣＶＤ)法により、直径３０ｃｍ以上の大面積にマイクロ結晶ダイヤモンド薄膜を成膜することが可能である。
　一方、表面波プラズマ気相成長法により、直径３０ｃｍ程度の面積に均一な炭素膜を形成する技術が、特許文献1および特許文献２に開示されている。この方法を用いて作成したＳＯＩ基板上に、集積回路（ＬＳＩ）用途を目的とした電界効果トランジスタが試作され、動作が確認されている（非特許文献３）。
国際公開第２００５／１０３３２６号 国際公開第２００７／００４６４７号
C. Gu, Z. Jin, X. Lu, G. Zou, C. Wang, J.Lu, D. Yao, X. Su and Z. Xu, Diam. Relat. Mater. 7 (1998) 753-755. A. Aleksov, X. Li, N. Govindaraju, J.M.Gobien, S. D. Wolter, J. T. Prater and Z. Sitar, Diam. Relat. Mater. 1482005) 308. J. P. Mazellier, J. Widiez, F. Andrieu, M. Lions, S. Saada, M.Hasegawa, K. Tsugawa,L. Brevard, J. Dechamp, M. Rabarot, V. Delaye, S.Cristoloveanu, L.Clavelier, S. Deleonibus, P. Bergonzo, and O. Faynot: "First demonstration of heat dissipationimprovement in CMOS technology using Silicon-On-Diamond (SOD) substrates", 2009 IEEE Int. SOI Conf., 2009, pp.141-142.
　しかしながら、前述の熱フィラメント気相成長(ＨＦＣＶＤ)法により成膜したマイクロ結晶ダイヤモンド膜をＳＯＩ基板のＩ層とした場合、合成時にフィラメントとして用いるタングステン(Ｗ)やタンタル(Ｔａ)がシリコン基板へ混入したり、シリコン／ダイヤモンド界面に欠陥を形成したり等、デバイス特性に影響があることが懸念される。さらに、高絶縁性かつ高熱伝導性が必要なパワーデバイス用途のためには、１００μｍ以上の膜厚が必要なため、厚膜形成に起因したに熱応力による亀裂や破損が課題である。
　一方、前述の表面波プラズマ気相成長法により形成された炭素膜は高熱伝導性かつ高絶縁性という優れた特性を有するもの、該炭素膜をＩ層として用いたＳＯＩ基板上にパワー半導体デバイスを作製することで、レアメタルフリーで冷却機構を有しないデバイス実現する場合、表面波プラズマ気相成長法で合成した炭素膜の膜厚が数１００ｎｍと薄いために熱伝導度が数１０Ｗ／ｍＫであって充分なものとはいえず、パワー半導体デバイスへの応用は難しいという課題がある。
　本発明は、以上のような事情に鑑みてなされたものであって、Ｉ層に炭素系材料を用いた、レアメタルフリーで冷却機構を有しないＳＯＩ基板における従来の課題を解決して、パワー半導体デバイス用ＳＯＩ基板への応用が可能な、高熱伝導性かつ高絶縁性なＳＯＩ基板を提供することを目的とするものである。
　本発明者らは、上記目的を達成すべく、鋭意検討を重ねた結果、Ｉ層として、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリット構造とすることにより、従来のＩ層として炭素膜を用いたＳＯＩ基板の問題点と、ＨＦＣＶＤ法でのダイヤモンド合成の問題点の両方を同時に解決して、高熱伝導および高絶縁性を有するＳＯＩ基板が得られることが判明した。
　本発明は、これらの知見に基づいて完成するに至ったものであり、以下のとおりのものである。
［１］ＳＯＩ基板の絶縁層が、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリット構造を有することを特徴とするＳＯＩ基板。
［２］前記ハイブリット構造が、炭素膜／マイクロ結晶ダイヤモンド膜で構成されていることを特徴とする前記［１］のＳＯＩ基板。
［３］前記ハイブリット構造が、炭素膜／マイクロ結晶ダイヤモンド膜／炭素膜で構成されていることを特徴とする前記［１］のＳＯＩ基板。
［４］前記炭素膜が、表面波プラズマ気相成長法で形成された膜であることを特徴とする前記［１］～［３］のいずれかのＳＯＩ基板。
［５］前記マイクロ結晶ダイヤモンド膜が、熱フィラメント気相成長法で形成された膜であることを特徴とする前記［１］～［４］のいずれかのＳＯＩ基板。
［６］前記炭素膜上に、熱フィラメント気相成長法によりマイクロ結晶ダイヤモンド膜が形成されていることを特徴とする前記［１］～［５］のいずれかのＳＯＩ基板。
［７］前記炭素膜上に、熱フィラメント気相成長法で形成されたマイクロ結晶ダイヤモンド膜を張り合わせることにより形成されたことを特徴とする前記［５］のＳＯＩ基板。
［８］シリコン基板と炭素膜の界面にシリコン酸化膜を有することを特徴とする前記［１］～［７］のいずれかのＳＯＩ基板。
　本発明によれば、従来のＳＯＩ基板の課題である、高熱伝導性かつ高絶縁性を有したＳＯＩ基板を得ることができ、パワー半導体デバイス用基板として用いることが可能となる。
本発明のＳＯＩ基板の実施形態の１つを模式的に示す図 本発明のＳＯＩ基板の他の実施形態を模式的に示す図 本発明のＳＯＩ基板の別の実施形態を模式的に示す図 本発明のＳＯＩ基板の更に別の実施形態を模式的に示す図 実施例１で得られたＳＯＩ基板のシリコン中の不純物の評価結果を示す図 実施例１で得られたＳＯＩ基板の電流－電界特性を示す図 実施例２で得られたＳＯＩ基板のシリコン中の不純物の評価結果を示す図 実施例２で得られたＳＯＩ基板の電流－電界特性を示す図 比較例１で得られたＳＯＩ基板のシリコン中の不純物の評価結果を示す図 比較例１で得られたＳＯＩ基板の電流－電界特性を示す図
　本願発明のＳＯＩ基板は、Ｉ層が、炭素膜とマイクロ結晶ダイヤモンド膜からなるハイブリット構造を有することを特徴とするものである。
　図１～図４は、本発明のＳＯＩ基板の実施形態の幾つかを模式的に示すものであって、図中、１は、シリコン基板、２は、炭素膜、３は、マイクロ結晶ダイヤモンド膜、４は、シリコン酸化膜、をそれぞれ示している。
　すなわち、図１は、Ｉ層が、炭素膜２及びマイクロ結晶ダイヤモンド膜３からなるＳＯＩ基板を示しており、図２は、図１に示すＳＯＩ基板において、シリコン基板１と炭素膜２の間に、シリコン酸化膜４を有するものを示している。また、図３は、Ｉ層が、炭素膜２、マイクロ結晶ダイヤモンド膜３及び炭素膜２からなるＳＯＩ基板を示しており、図４は、図３に示すＳＯＩ基板において、シリコン基板１と炭素膜２の間に、シリコン酸化膜４を有するものを示している。
　パワー半導体デバイス用ＳＯＩ基板開発において、既存シリコン半導体デバイスの製造工程に適応させるためには、直径３０ｃｍ以上のシリコン基板上に均質の炭素膜を気相成長法で形成することが必要である。一般的に大面積なダイヤモンド合成に利用されている熱フィラメント気相成長法では、ダイヤモンド成長前に基板表面への傷つけ処理を施す必要があり、デバイスを作製するシリコンに欠陥が生じてしまい、デバイス動作が困難である。そのため、パワー半導体デバイス用ＳＯＩ基板の炭素膜層の形成には、シリコン基板と炭素膜の界面に欠陥を形成しない、表面波プラズマ気相成長法を用いる必要がある。表面波プラズマ気相成長法による炭素膜の製造方法や表面波プラズマ気相成長装置は、既に特許文献１に開示されている。
　そして、パワー半導体デバイス用ＳＯＩ基板開発において、既存シリコン半導体デバイスの製造工程に適応させるためには、前記の表面波プラズマ気相成長法を用いて、直径３０ｃｍ以上のシリコン基板上に炭素膜が形成された基板（以下、「炭素膜／シリコン基板」ということもある。）上に、直径３０ｃｍ以上の均質のマイクロ結晶ダイヤモンド膜を、熱フィラメント気相成長法で形成することで、高熱伝導性を得ることが可能となる。この場合、熱フィラメント気相成長装置のフィラメントであるタングステン(Ｗ)やタンタル（Ｔａ）のシリコン基板への混入や拡散を防ぐことが必要であるが、本発明においては、シリコン基板には前記炭素膜が形成されているため、該炭素膜が、デバイス作製層であるシリコンへの欠陥形成等を防ぎ、リーク電流の低減が可能となる。
　また、熱フィラメント気相成長装置のフィラメントであるタングステン(Ｗ)やタンタル（Ｔａ）がダイヤモンド中に取り込まれるため、高耐圧化のためには、マイクロ結晶ダイヤモンド膜を１００μｍ以上の厚膜構造とする必要があるが、本発明では、表面波プラズマ気相成長法により形成した高熱伝導性かつ高耐圧の機能を有する炭素膜上に、熱フィラメント気相成長法でマイクロ結晶ダイヤモンド膜を形成することにより、ＳＯＩ基板の薄膜化を可能とした、高熱伝導性かつ高耐圧の機能を有する炭素膜とマイクロ結晶ダイヤモンドハイブリット膜のハイブリッド構造を有するＳＯＩ基板が作成できる。
　フィラメント材料のシリコンへの混入防止および高耐圧性および高熱伝導性の機能を有する膜として、前記炭素膜は、平坦な表面を形成し、且つ高耐圧性および高熱伝導性の機能をも有しており、最もふさわしい膜であるが、炭素膜以外に、シリコン酸化膜、窒化アルミニウム膜、窒化シリコン膜なども同様に機能を有するものとして用いることができる。
　したがって、本発明のＳＯＩ基板の作製方法の１つは、シリコン基板に、原子レベルで平坦な表面を有し、かつシリコンへの混入防止、高耐圧性および高熱伝導性の機能を有する炭素膜を成膜する工程と、次に、熱フィラメント気相成長法で、前工程で得られた前記の炭素膜／シリコン基板上にマイクロ結晶ダイヤモンドを成膜する工程とからなる方法である。（図１参照）。
　該方法において、デバイス作製層であるシリコンへの欠陥導入をより完全に防ぐには、シリコン基板の表面にシリコン酸化膜を形成した後に、原子レベルで平坦な表面を有しかつシリコンへの混入防止、高耐圧性および高熱伝導性の機能を有する炭素膜を形成することが好ましい（図２、図４参照）。該シリコン酸化膜の形成方法は、熱酸化法による形成や、気相成長法やスパッタリング法等の既知の成膜方法から選択することができる。
　また、絶縁性のさらなる向上には、前記したマイクロ結晶ダイヤモンド成膜の工程の後に、原子レベルで平坦な表面を有しかつ高耐圧性および高熱伝導性の機能を有する炭素膜をマイクロ結晶ダイヤモンド表面上に成膜することで、高耐圧かつ高熱伝導性の炭素膜とマイクロ結晶ダイヤモンド膜のハイブリット構造（炭素膜／マイクロ結晶ダイヤモンド膜／炭素膜）を有するＳＯＩ基板が作成できる（図３、図４参照）。
　パワー半導体デバイス用ＳＯＩ基板開発において、既存シリコン半導体デバイスの製造工程に適応させるためには、前記の直径３０ｃｍ以上のシリコン／炭素膜基板上に、直径３０ｃｍ以上の均質のマイクロ結晶ダイヤモンド膜を張り合わせる方法によっても可能である。
　炭素膜とマイクロ結晶ダイヤモンド膜を張り合わせるためには、両膜の張り合わせ面が、原子レベルで平坦であることが必要条件である。一般的に、ダイヤモンド表面の平坦化には、機械的な研磨方法が用いられている。
　この機械的研磨を、シリコン／炭素膜基板の炭素膜表面に用いた場合、デバイスを作製するシリコン基板に欠陥やひずみが生じてしまう。このため、原子レベルで平坦な表面が自己組織化的に形成できる表面波プラズマ気相成長法により成膜された炭素膜を、シリコン基板上に形成する必要がある。
　一方、マイクロ結晶ダイヤモンド膜は、直径３０ｃｍ以上の面積が必要なため、熱フィラメント気相成長法での合成を用いることができる。この時、原子レベルで平坦な基板表面にマイクロ結晶ダイヤモンドを合成し、基板を除去することで、該マイクロ結晶ダイヤモンド膜の基板との界面側を張り合わせ面として利用することができる。このような方法で、高耐圧かつ高熱伝導性の炭素膜／マイクロ結晶ダイヤモンド膜のハイブリット構造を有するＳＯＩ基板が作成できる。
　以下、上記の張り合わせ法による、炭素膜／マイクロ結晶ダイヤモンド膜のハイブリット構造を有するＳＯＩ基板の作成について、具体的に記載する。
（１）まずシリコン基板に表面波プラズマ気相成長法で、原子レベルで平坦な表面を有する炭素膜を成膜し、炭素膜／シリコン基板を製造する。
（２）次に、熱フィラメント気相成長法で、別のシリコン基板上にマイクロ結晶ダイヤモンド膜を成膜し、シリコン基板を除去することで、シリコンとマイクロ結晶ダイヤモンドの界面に形成された、原子レベルで平坦なマイクロ結晶ダイヤモンド表面を得る。
（３）次いで、得られた原子レベルで平坦な表面を、前記炭素膜／シリコン基板の炭素膜表面に張り合わせる。張り合わせには、イオンビームやプラズマを用いて該炭素膜表面およびマイクロ結晶ダイヤモンド表面洗浄を行い、真空加圧貼付け方式で、炭素膜表面とマイクロ結晶ダイヤモンド表面とを張り合わせることができる。
　また、マイクロ結晶ダイヤモンド膜は直径３０ｃｍ以上の面積が必要なため、熱フィラメント気相成長法での合成を用いることができるが、この時、原子レベルで平坦な基板表面形成には、機械的研磨を用いることができる。
　したがって、本発明のＳＯＩ基板の作製方法のさらにもう１つは、（１）まずシリコン基板に表面波プラズマ気相成長法で、原子レベルで平坦な表面を有する炭素膜を成膜する工程と、（２）熱フィラメント気相成長法で、シリコン基板上にマイクロ結晶ダイヤモンド膜を成膜し、機械的研磨方法で、マイクロ結晶ダイヤモンド表面を原子レベルでの平坦化とシリコンの除去を行う工程と、（３）の原子レベルで平坦な表面を、前記炭素膜表面に張り合わせる工程とからなる方法であり、該方法により、高耐圧かつ高熱伝導性の炭素膜／マイクロ結晶ダイヤモンド膜のハイブリット構造を有するＳＯＩ基板が作成できる。
　以上のとおり、本発明においては、炭素膜／シリコン基板に、熱フィラメント気相成長法により、或いは、熱フィラメント気相成長法で形成されたマイクロ結晶ダイヤモンド膜を張り合わせることにより、シリコン基板と炭素膜の界面には電気的活性な欠陥や不純物がなく、放熱特性の優れたパワー半導体用ＳＯＩ基板が作製される。
　また、本発明のＳＯＩ基板は、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造を有するものであるが、この炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造は、タングステン、タンタル等の、ＣＶＤ法でダイヤモンド薄膜の形成が可能な全ての金属上に作成可能であるため、シリコン半導体以外のパワー半導体デバイス（シリコンカーバイト、窒化ガリウム、アルミニウム窒化ガリウム）と組み合わせることも可能である。シリコン半導体以外のパワー半導体デバイスとの組み合わせは、シリコンカーバイト、窒化ガリウムなどの半導体材料上に直接、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造を形成することも可能であるが、前記のシリコン基板の場合と同様に、半導体プロセスで利用される張り合わせ技術で実現できる。
　以下、本発明を実施例等によりさらに具体的に説明するが、本発明はこれらの実施例等によっては何ら限定されるものではない。
　なお、実施例における炭素膜の製造方法は、特許文献１および特許文献２で開示されている方法を用いた。
　まず、実施例に用いや評価方法を記載する。
　《不純物評価》
　本発明のＳＯＩ基板のシリコン基板中のタングステンの評価は、二次イオン質量分析法により行った。測定は、一次イオンにＯ２ ＋を用い、加速電圧を３ｋＶとした。測定時の真空度は３×１０－９Torrである。
　《電気絶縁性》
　電気絶縁性の評価に用いた試料として、本発明のＳＯＩ基板のマイクロ結晶ダイヤモンド膜上に直径３０μｍの電極を形成したものを用いた。ＳＯＩ基板のシリコンは導電性の銀ペーストを用いて銅製の試料ホルダーに設置した。測定は、５×１０－７Torrの真空中で、電流－電圧特性を測定した。印加電圧をマイクロ結晶ダイヤモンドの膜厚と炭素膜の膜厚の合計膜厚で割った値を電界とし、電流－電界特性を用いて、電気絶縁性を評価した。電流が観測される電界が大きい程電気絶縁性が高いことを意味する。
　《熱伝導度》
　熱伝導度の測定は、サーモリフレクタンス法で評価した。試料は、ＳＯＩ基板のシリコン基板をフッ酸と硝酸の混合液で除去し、マイクロ結晶ダイヤモンド膜／炭素膜の自立体構造を作製した。このマイクロ結晶ダイヤモンド／炭素膜自立体構造マイクロ結晶ダイヤモンド面と炭素膜面にスパッタリング法で厚さ１００ｎｍのモリブデン薄膜を形成した。
　熱伝導度は、積層体の積層方向および積層方向に対して垂直方向（面内方向）の熱伝導度を評価した。
　（実施例１）
　基板として４インチ径のウェハ状のシリコン基板を用いた。炭素粒子の核形成密度を高め均一な成膜とするために、成膜前の基板に前処理（ナノクリスタルダイヤモンド粒子付着処理）を行った。
　この前処理には平均粒径５ｎｍのナノクリスタルダイヤモンド粒子を純水中に分散させたコロイド溶液（有限会社ナノ炭素研究所製　製品名ナノアマンド）または平均粒径３０ｎｍ又は４０ｎｍのナノクリスタルダイヤモンド粒子（トーメイダイヤ株式会社製　製品名各々MD30およびMD40）を純水中に分散させた溶液、あるいはクラスターダイヤモンド粒子またはグラファイトクラスターダイヤモンド粒子（東京ダイヤモンド工具製作所製　製品名各々ＣＤおよびＧＣＤ）を分散させたエタノール、あるいはアダマンタンまたはその誘導体あるいはそれらの誘導体（各々出光興産株式会社製）溶液を用い，これに基板を浸して超音波洗浄器にかけた。
　その後、基板をエタノール中に浸して超音波洗浄を行い、乾燥させるか、またはこれらの溶液をスピンコートによって基板上に均一に塗布し、乾燥させる。この前処理の均一性が成膜後の炭素膜の均一性に影響する。この場合、基板上に付着するダイヤモンド粒子は、１ｃｍ２当たり、１０１０～１０１１個であった。
　原料ガスは、ＣＨ４、ＣＯ２及びＨ２の混合ガスを用い、ＣＨ４及びＣＯ２の濃度をそれぞれ１モル％とした。反応容器内ガス圧力は、通常ダイヤモンドのＣＶＤ合成で用いられる圧力（１０３～１０４Ｐａ）より低い１.０～１.２×１０２Ｐａ（１.０～１.２ｍｂａｒ）とし、トータル２０～２４ｋＷのマイクロ波を投入して基板面積より広い領域に大面積かつ均一なプラズマを発生させた。その際、Ｍｏ試料台と冷却ステージを密着させ、基板とアンテナの距離を調節することによって、成膜中の基板温度を４５０℃以下に保つことが可能となった。
　以上の成膜条件の下、６時間成膜を行った。成膜後のガラス基板上には、均一かつ透明な炭素膜が形成された。この膜の膜厚は、２００ｎｍであった。
　次に、熱フィラメント気相成長法により、前記の炭素膜表面上に、マイクロ結晶ダイヤモンド膜（ＭＣＤ）を成膜した。熱フィラメント気相成長装置は、大面積ＨＦＣＶＤ装置（sp3社製 Model 650）を用いた。フィラメントにはタングステン（Ｗ）を用い、フィラメント温度２０００℃、基板温度８００℃で、６時間の成膜をおこなった。この膜の膜厚は、約１０μｍであった。実施例１で得られたＳＯＩ基板は図１の構造を有する。
　図５に、実施例１で得られたＳＯＩ基板のシリコン中の不純物の評価結果を示す。タングステンは、炭素膜、シリコン基板中には観測されず、炭素膜が、マイクロ結晶ダイヤモンド膜の成膜中のタングステンの混入を防ぐ役割を持つことがわかった。
　次に、実施例１で得られたＳＯＩ基板の電流－電界特性を図６に示す。電流が急激に増加する電界を閾電界と仮定すると、閾電界は、８５Ｖ／μｍであった。この値は、単結晶ダイヤモンドの絶縁破壊電界（１ＭＶ／ｃｍ）とほぼ同じである。
　実施例１で得られたＳＯＩ基板の熱伝導度は、積層方向は２５０Ｗ／ｍＫ、積層方向と垂直方向では１１０Ｗ／ｍＫであった。この値は、マイクロ結晶ダイヤモンドの報告値とほぼ同様であり、既に報告されている炭素膜より１桁高い値である。
　以上の結果、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造を形成することで、半導体デバイス作製層であるシリコンへの不純物の混入を防ぐことが可能となったことがわかる。さらに、絶縁性および熱伝導度が向上することがわかった。したがって、本発明の炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造をＩ層（絶縁層）とするＳＯＩ基板を用いることにより、電気絶縁性、放熱性の優れたパワー半導体デバイス用ＳＯＩ基板が作製できる。
　（実施例２）
　基板として、シリコン酸化膜（ＳｉＯ２膜）（厚さ２０ｎｍ）を形成したシリコン基板を用いた以外は、実施例１と同様にしてＳＯＩ基板を作製した。実施例２で得られたＳＯＩ基板の構造を図２に示す。
　実施例２で得られたＳＯＩ基板のシリコン中の不純物評価の結果を図７に示す。タングステンは、炭素膜、シリコン酸化膜（ＳｉＯ２膜）、シリコン基板中には観測されず、炭素膜がマイクロ結晶ダイヤモンド膜の成膜中のタングステンの混入を防ぐ役割を持つことがわかった。
　次に、実施例２で得られたＳＯＩ基板の電流－電界特性を図８に示す。電流が急激に増加する電界を閾電界と仮定すると、閾電界は、９２Ｖ／μｍであった。この値は、単結晶ダイヤモンドの絶縁破壊電界（１ＭＶ／ｃｍ）とほぼ同じである。
　したがって、本発明の炭素膜とマイクロ結晶ダイヤモンドハイブリット膜のハイブリッド構造をＩ層（絶縁層）としたシリコン酸化膜付きシリコン基板を用いて作製したＳＯＩ基板を用いることにより、電気絶縁性、放熱性の優れたパワー半導体デバイス用ＳＯＩ基板が作製できる。
　（比較例１）
　マイクロ結晶ダイヤモンドのみをＩ層（絶縁層）としたＳＯＩ基板を作製した。基板には、シリコン基板を用いた。
　マイクロ結晶ダイヤモンド膜の成膜の前処理として、ダイヤモンド粒子でシリコン基板に傷付け処理をおこなった。熱フィラメント気相成長装置は、大面積ＨＦＣＶＤ装置（sp3社製 Model 650）を用いた。フィラメントにはタングステン（Ｗ）を用い、フィラメント温度２０００℃、基板温度８００℃で、６時間の成膜をおこなった。この膜の膜厚は、約１０μｍであった。
　比較例１で得られたＳＯＩ基板のシリコン中の不純物評価の結果を図９に示す。タングステンは、マイクロ結晶ダイヤモンド膜とシリコン基板の界面に観測され、シリコン基板中にも界面から０.５μｍの深さまで検出された。
　比較例１で得られたＳＯＩ基板の電流－電界特性を図１０に示す。電流が急激に増加する電界を閾電界と仮定すると、閾電界は、４０Ｖ／μｍであった。この値は、単結晶ダイヤモンドの絶縁破壊電界（１００Ｖ／μｍ）の２分の１であった。
　実施例１と比較例１を比べると、実施例１のＳＯＩ基板のリーク電流が観測される電界は、炭素膜とマイクロ結晶ダイヤモンドハイブリット膜のハイブリッド構造をＩ層とするＳＯＩ基板は、比較例１のマイクロ結晶ダイヤモンド膜のみを絶縁層とするＳＯＩに比べて、リーク電流が観測された電界が２倍増加した。したがって、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造をＩ層とするＳＯＩ基板は、マイクロ結晶ダイヤモンド膜のみの場合の２分の１の厚さで絶縁性を確保することが可能であることがわかる。
　(実施例３)
　実施例１及び実施例２において、マイクロ結晶ダイヤモンド膜に、さらに同様の２００ｎｍの炭素膜を形成することで、リーク電流が観測される電界が２倍となった。つまり、図３および図４の構造を形成することで、リーク電界が約１２０Ｖ／μｍおよび約１３０Ｖ／μｍのＳＯＩ基板が作製できることがわかる。また、熱伝導性は、炭素膜の値の成膜方向は８倍、成膜方向と垂直方向（面内方向）は３倍と改善された。
　本発明の、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造を有するＳＯＩ基板、或いは炭素膜とマイクロ結晶ダイヤモンド膜のハイブリッド構造を有する膜は、高絶縁性かつ高熱伝導性を有し、半導体デバイス作製層であるシリコンへの不純物混入や欠陥導入がないことから、電気自動車やハイブリッド自動車、モーター制御用インバーターなど、あらゆるパワー半導体デバイスへの利用が可能であり、非常に重要な技術である。
　１：シリコン基板
　２：炭素膜
　３：マイクロ結晶ダイヤモンド膜
　４：シリコン酸化膜

Claims (8)

  1. 　ＳＯＩ基板の絶縁層が、炭素膜とマイクロ結晶ダイヤモンド膜のハイブリット構造を有することを特徴とするＳＯＩ基板。
  2. 　前記ハイブリット構造が、炭素膜／マイクロ結晶ダイヤモンド膜で構成されていることを特徴とする請求項１に記載のＳＯＩ基板。
  3. 　前記ハイブリット構造が、炭素膜／マイクロ結晶ダイヤモンド膜／炭素膜で構成されていることを特徴とする請求項１に記載のＳＯＩ基板。
  4. 　前記炭素膜が、表面波プラズマ気相成長法で形成された膜であることを特徴とする請求項１～３のいずれか１項に記載のＳＯＩ基板。
  5. 　前記マイクロ結晶ダイヤモンド膜層が、熱フィラメント気相成長法で形成された膜であることを特徴とする請求項１～４のいずれか１項に記載のＳＯＩ基板。
  6. 　前記炭素膜上に、熱フィラメント気相成長法によりマイクロ結晶ダイヤモンド膜が形成されていることを特徴とする請求項１～５のいずれか１項に記載のＳＯＩ基板。
  7. 　前記炭素膜上に、熱フィラメント気相成長法で形成されたマイクロ結晶ダイヤモンド膜を張り合わせることにより形成されたことを特徴とする請求項５に記載のＳＯＩ基板。
  8. 　シリコン基板と炭素膜の界面にシリコン酸化膜を有することを特徴とする請求項１～７のいずれか１項に記載のＳＯＩ基板。
PCT/JP2011/073412 2010-10-14 2011-10-12 Ｓｏｉ基板 Ceased WO2012050122A1 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
DE112011103476T DE112011103476T5 (de) 2010-10-14 2011-10-12 SOI-Substrat
JP2012538690A JP5665202B2 (ja) 2010-10-14 2011-10-12 Ｓｏｉ基板

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2010231041 2010-10-14
JP2010-231041 2010-10-14

Publications (1)

Publication Number Publication Date
WO2012050122A1 true WO2012050122A1 (ja) 2012-04-19

Family

ID=45938349

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2011/073412 Ceased WO2012050122A1 (ja) 2010-10-14 2011-10-12 Ｓｏｉ基板

Country Status (3)

Country Link
JP (1) JP5665202B2 (ja)
DE (1) DE112011103476T5 (ja)
WO (1) WO2012050122A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2020250815A1 (ja) * 2019-06-14 2020-12-17

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63150926A (ja) * 1986-12-15 1988-06-23 Ricoh Co Ltd ダイヤモンド状炭素膜の製膜法
JP2006228963A (ja) * 2005-02-17 2006-08-31 Kobe Steel Ltd 半導体ウエハの製造方法
WO2008057055A1 (en) * 2006-11-10 2008-05-15 Agency For Science, Technology And Research A micromechanical structure and a method of fabricating a micromechanical structure
JP2010202911A (ja) * 2009-03-02 2010-09-16 Mitsubishi Materials Corp 炭素膜、炭素膜の製造方法及びｃｍｐパッドコンディショナー

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4538587B2 (ja) * 2004-04-19 2010-09-08 独立行政法人産業技術総合研究所 積層体及びその製造方法並びに該積層体を備えた光デバイス、光学ガラス、腕時計、電子回路基板、研磨用工具
WO2007004647A1 (ja) 2005-07-04 2007-01-11 National Institute Of Advanced Industrial Science And Technology 炭素膜
JP2011241463A (ja) * 2010-05-20 2011-12-01 Toyota Motor Corp 硬質炭素膜層を備えた層構造体およびその層構造を表面に備えたバルブリフター

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63150926A (ja) * 1986-12-15 1988-06-23 Ricoh Co Ltd ダイヤモンド状炭素膜の製膜法
JP2006228963A (ja) * 2005-02-17 2006-08-31 Kobe Steel Ltd 半導体ウエハの製造方法
WO2008057055A1 (en) * 2006-11-10 2008-05-15 Agency For Science, Technology And Research A micromechanical structure and a method of fabricating a micromechanical structure
JP2010202911A (ja) * 2009-03-02 2010-09-16 Mitsubishi Materials Corp 炭素膜、炭素膜の製造方法及びｃｍｐパッドコンディショナー

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2020250815A1 (ja) * 2019-06-14 2020-12-17
WO2020250815A1 (ja) * 2019-06-14 2020-12-17 Tdk株式会社 電子部品内蔵基板及びこれを用いた回路モジュール
JP7439833B2 (ja) 2019-06-14 2024-02-28 Tdk株式会社 電子部品内蔵基板及びこれを用いた回路モジュール
US12243841B2 (en) 2019-06-14 2025-03-04 Tdk Corporation Electronic component embedded substrate and circuit module using the same

Also Published As

Publication number Publication date
JPWO2012050122A1 (ja) 2014-02-24
JP5665202B2 (ja) 2015-02-04
DE112011103476T5 (de) 2013-08-01

Similar Documents

Publication Publication Date Title
CN113690298A (zh) 半导体复合衬底、半导体器件及制备方法
CN109722641B (zh) 金刚石/石墨烯复合导热膜及其制备方法和散热系统
US11139427B2 (en) Bonded body and elastic wave element
JP2018049868A (ja) 半導体積層構造体および半導体デバイス
WO2013002212A1 (ja) 複合基板およびその製造方法
JP2000331899A (ja) Ｓｏｉウェーハの製造方法およびｓｏｉウェーハ
JP2020105038A (ja) 半導体基板、半導体基板の製造方法およびそれを用いた半導体装置
TW202015334A (zh) 接合體及彈性波元件
CN104319447A (zh) 一种基于石墨烯的多层共面波导传输线及其制备方法
JP2024147519A (ja) 低い抵抗率の多結晶ベース基板又はウエハ
JP2011529632A (ja) 真性ダイアモンド層及びドープダイアモンド層で被覆されたセミコンダクター・オン・インシュレータ基板
JP5665202B2 (ja) Ｓｏｉ基板
WO2024103727A1 (zh) 碳化硅外延片及其制备方法和应用
KR20170093601A (ko) 그래핀 코팅 방열부재의 제조방법과 이에 의하여 제조된 방열부재
CN113594110B (zh) 一种半导体器件及其制备方法
KR20170056390A (ko) 밴드갭을 갖는 그래핀 박막 제조방법 및 이에 의해 제조된 그래핀 박막을 포함하는 박막 트랜지스터
CN101872718B (zh) 石墨烯晶片的制备方法
CN107785304A (zh) 以氮化物薄膜为绝缘埋层的soi材料及其制备方法
JP2025065001A (ja) 高抵抗率多結晶シリコンカーバイド（ＳｉＣ）基板、及びその製造方法
Serikawa et al. High-mobility poly-Si thin film transistors fabricated on stainless-steel foils by low-temperature processes using sputter-depositions
US7148079B1 (en) Diamond like carbon silicon on insulator substrates and methods of fabrication thereof
CN118737992A (zh) 导热复合组件及其制备方法和应用
CN116314274A (zh) 一种具有p沟道的GaN基HEMT器件的制备方法
CN105977197A (zh) 基于非晶化与尺度效应的SiN埋绝缘层上晶圆级单轴应变SiGe的制作方法
TWI743932B (zh) 半導體基板及其製造方法

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 11832557

Country of ref document: EP

Kind code of ref document: A1

WWE Wipo information: entry into national phase

Ref document number: 1120111034768

Country of ref document: DE

Ref document number: 112011103476

Country of ref document: DE

ENP Entry into the national phase

Ref document number: 2012538690

Country of ref document: JP

Kind code of ref document: A

122 Ep: pct application non-entry in european phase

Ref document number: 11832557

Country of ref document: EP

Kind code of ref document: A1