WO2005004223A1 - 半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置および低誘電率絶縁膜形成装置 - Google Patents

半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置および低誘電率絶縁膜形成装置 Download PDF

Info

Publication number
WO2005004223A1
WO2005004223A1 PCT/JP2004/009330 JP2004009330W WO2005004223A1 WO 2005004223 A1 WO2005004223 A1 WO 2005004223A1 JP 2004009330 W JP2004009330 W JP 2004009330W WO 2005004223 A1 WO2005004223 A1 WO 2005004223A1
Authority
WO
WIPO (PCT)
Prior art keywords
dielectric constant
insulating film
low
semiconductor device
low dielectric
Prior art date
Application number
PCT/JP2004/009330
Other languages
English (en)
French (fr)
Inventor
Shinji Ide
Masaru Sasaki
Satohiko Hoshino
Original Assignee
Tokyo Electron Limited
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tokyo Electron Limited filed Critical Tokyo Electron Limited
Publication of WO2005004223A1 publication Critical patent/WO2005004223A1/ja
Priority to US11/322,318 priority Critical patent/US20060154492A1/en

Links

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • H01L21/02137—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC the material comprising alkyl silsesquioxane, e.g. MSQ
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02203—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being porous
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02225—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02282—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process liquid deposition, e.g. spin-coating, sol-gel techniques, spray coating
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02296—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02337—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour
    • H01L21/0234—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour treatment by exposure to a plasma
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/312—Organic layers, e.g. photoresist
    • H01L21/3121—Layers comprising organo-silicon compounds
    • H01L21/3122—Layers comprising organo-silicon compounds layers comprising polysiloxane compounds
    • H01L21/3124—Layers comprising organo-silicon compounds layers comprising polysiloxane compounds layers comprising hydrogen silsesquioxane
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02225—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/02274—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition in the presence of a plasma [PECVD]

Definitions

  • the present invention relates to a method for forming a low dielectric constant insulating film of a semiconductor device, a semiconductor device using the method, and an apparatus for forming a low dielectric constant insulating film.
  • the present invention relates to a method and an apparatus for curing a low dielectric constant coating film used as an insulating film while maintaining a low dielectric constant.
  • an insulating film having a lower dielectric constant than silicon oxide (Si (2) is used.
  • Such a low dielectric constant insulating film is formed on a wafer by, for example, an SOD (Spin-on-Dielectric) system. That is, in the SOD system, an insulating film is formed by applying a liquid polymer-forming material on a wafer and performing a curing process (curing) such as a heating process. At the stage when the coating film is formed by the SOD system, the dielectric constant is low and remains constant.
  • the insulating film is subjected to thermosetting while maintaining its low dielectric constant. This thermal curing process combines the molecules of the insulating film into a polymer to increase the strength due to the chemical bonding force, and avoids exfoliation of the films during chemical mechanical polishing (CMP). I have.
  • Japanese Patent Application Laid-Open No. 8-236520 describes a method for curing an insulating film by generating plasma in a parallel plate plasma reactor.
  • Patent Document 1 JP-A-8-236520 (Paragraph No. 0024, FIG. 2)
  • the defects that generate leakage current such as -OH and CH3 in the S ⁇ G film are reduced by curing the insulating film at a temperature of 200 to 450 ° C for 60 minutes. ing.
  • CH is indispensable to maintain a low dielectric constant.
  • a main object of the present invention is to provide a method for forming an insulating film of a semiconductor device which can be cured in a short time while maintaining a low dielectric constant in the insulating film of the semiconductor device, and a method formed by such a method.
  • An object of the present invention is to provide a semiconductor device having an insulating film and an apparatus for forming a low dielectric constant insulating film.
  • a substrate on which a coating film is formed is placed in a vacuum vessel, and the coating film is formed with a high density at a low electron temperature by microwave excitation.
  • the coating film can be cured in a short time while maintaining a low dielectric constant.
  • the step of performing the curing treatment preferably includes curing the coating film for a treatment time of preferably 5 minutes or less. As a result, the number of processed sheets per time can be increased, so that the throughput in the semiconductor processing step can be increased.
  • the step of curing preferably includes generating a plasma at a low electron temperature of 0.5-1.5 eV and an electron density of 10 11 -10 13 electrons / cm 3 .
  • the step of curing preferably includes causing an intermolecular dehydration condensation reaction between a hydroxyl group in a molecule constituting the coating film and a hydroxyl group in another molecule.
  • a semiconductor device includes a substrate, and an insulating film having a low dielectric constant applied on the substrate and cured by high-density plasma processing at a low electron temperature.
  • the molecular structure of the insulating film cured by high-density plasma treatment includes, for example, those having a Si— ⁇ —Si bond.
  • the low dielectric constant insulating film forming apparatus of the present invention is characterized in that a substrate on which a coating film is formed is placed in a vacuum vessel and high-density plasma processing is performed at a low electron temperature by microwave excitation. Curing means for curing the coating film while maintaining a low dielectric constant.
  • the curing means for example, a low electron temperature of 0.5 to 1.5 eV and 10 11 to 10 13 / cm
  • a substrate on which a low dielectric constant coating film is formed is placed in a vacuum vessel, and high-density plasma processing is performed at a low electron temperature by microwave excitation, so that a low dielectric constant is achieved.
  • the coating film can be cured in a short time while maintaining it, and the coating film can be adhered to the underlying substrate.
  • the number of processed sheets per hour can be increased, and the throughput in the semiconductor processing step can be increased.
  • the low electron temperature of 0. 5-1. 5 eV and 10 "- 10 13 / cm 3 of plastics in the electron density By generating the energy, the energy of the electrons attracted to the coating film can be reduced, so that the damage caused when the electrons collide with the coating film can be reduced.
  • FIG. 1 is a sectional view of a plasma substrate processing apparatus used for forming a low dielectric constant insulating film of the present invention.
  • FIG. 2 is a partially cutaway perspective view of the slot plate shown in FIG. 1.
  • FIG. 3 is a cross-sectional view of an insulating film showing a process of forming a low dielectric constant insulating film according to one embodiment of the present invention.
  • FIG. 4 is a diagram showing molecular structures of an insulating film before a curing process and an insulating film cured by a plasma substrate processing apparatus.
  • FIG. 5 is a diagram showing the relationship between the embodiment of the present invention and a conventional curing time by electron beam and dielectric constant.
  • FIG. 6 is a diagram showing a relationship between an embodiment of the present invention and a conventional curing time by an electron beam and an elastic modulus.
  • FIG. 7 is a table showing a comparison between another embodiment according to the present invention and a specific experimental result of a curing process using a conventional furnace and an electron beam. Explanation of symbols
  • FIG. 1 is a sectional view of a plasma substrate processing apparatus used for forming an insulating film of the present invention
  • FIG. 2 is a partially cutaway perspective view of the slot plate shown in FIG.
  • the plasma substrate processing apparatus 10 includes a processing vessel 11 provided with a substrate holder 12 for holding a silicon wafer W as a substrate to be processed.
  • the gas in the processing chamber 11 is exhausted from the exhaust ports 11A and 11B via an exhaust pump (not shown).
  • the substrate holder 12 has a heater function of heating the silicon wafer W.
  • the slot plate 14 includes a circular conductor plate 141 made of, for example, a disk-shaped thin copper plate, and the circular conductor plate 141 has a large number of slits 142 formed therein. These slits 142 form a uniform electric field distribution in the space inside the processing chamber 11.
  • a dielectric plate 15 made of quartz, alumina, aluminum nitride, or the like is arranged.
  • This dielectric plate 15 is sometimes called a slow wave plate or a wavelength shortening plate. By reducing the microwave propagation speed, the wavelength is shortened to reduce the propagation efficiency of the microwave radiated from the slot plate 14.
  • a cooling plate 16 is arranged above (outside) the dielectric plate 15. Inside the cooling plate 16, a refrigerant passage 16a through which the refrigerant flows is provided inside the cooling plate 16, a refrigerant passage 16a through which the refrigerant flows is provided.
  • a coaxial waveguide 18 for introducing microwaves is provided at the center of the upper end of the processing vessel 11, and gas is introduced to the inner wall of the processing vessel 11. Gas nozzle 22 is provided.
  • a coolant channel 24 is formed outside the inner wall of the processing vessel 11 so as to surround the entire vessel.
  • the plasma processing apparatus 10 shown in FIG. 1 is used to perform the plasma processing described below to cure the insulating film in a short time while maintaining a low dielectric constant.
  • FIG. 3 is a cross-sectional view of an insulating film showing a process of forming an insulating film according to an embodiment of the present invention
  • FIG. 4 shows a plasma process performed by a plasma substrate processing apparatus 10 with the insulating film before curing.
  • FIG. 3 is a diagram illustrating a molecular structure of an insulating film.
  • the substrate 1 shown in FIG. 3 (a) is prepared and, for example, by a well-known S ⁇ D system,
  • a low dielectric constant insulating film material is applied on the substrate 1 to form a coating film 2.
  • the applied insulating material is a low dielectric constant insulating film having a dielectric constant of, for example, 2.4 or less, such as porous MSQ (MethylSilsesqueoxane).
  • porous MSQ MetalSilsesqueoxane
  • one molecule of this porous membrane MSQ was terminated with a hydroxyl group bonded to Si in ⁇ _Si_ ⁇ , and the other molecule was bonded to Si in O—Si—O. It also includes a structure terminated by a hydroxyl group, in which one molecule is separated from the other molecule.
  • the substrate 1 on which the coating film 2 is formed is transported into the processing space of the plasma substrate processing apparatus 10 shown in FIG. 1 by a transport device (not shown). Then, argon (Ar), hydrogen (H2), helium (He) alone, or a mixed gas of a combination thereof is introduced into the processing space of the plasma substrate processing apparatus 10, and the coaxial waveguide 18 is also filled with 2. by supplying a microwave of 45 GHz, at a temperature of 250 ° C-400 ° about C into the processing space, 0. 5 1.
  • the above low electron temperature was previously measured under the same conditions using a Langmuir probe in the space between the source gas gas nozzle 22 and the silicon wafer W.
  • the electron temperature was also confirmed by Langmuir probe measurements.
  • FIG. 5 shows the relationship between the embodiment of the present invention and the conventional curing time with an electron beam and the dielectric constant
  • FIG. 6 shows the embodiment of the present invention and the conventional curing time with an electron beam.
  • the circles indicate the results of the hardening process using the conventional electron beam
  • the triangles indicate the plasma processing using the plasma substrate processing apparatus 10. The results of the embodiment will be described.
  • the dielectric constant when using an electron beam, is about 2.25 when the processing time is 120 seconds, and the dielectric constant is 2.3 when the processing time is further increased to 360 seconds. It is getting higher to the extent.
  • the dielectric constant is approximately 2.2 when the plasma processing time is 60 seconds, and the dielectric constant changes little when the plasma processing time is 300 seconds. Just over 2.2. Even when the plasma processing time is between 60 seconds and 300 seconds, the dielectric constant is maintained at about 2.2.
  • the dielectric constant can be reduced by performing the plasma processing using the plasma substrate processing apparatus 10 as compared with the curing processing using the electron beam.
  • the permittivity tends to increase as the curing time increases, whereas when the plasma substrate processing apparatus 10 is used, the dielectric constant is almost the same even when the plasma processing time is long. It can be seen that the same dielectric constant can be maintained.
  • the elastic modulus when the electron beam is used, when the curing time is set to 120 seconds, the elastic modulus becomes about 6 GPa, When the processing time was set to 300 seconds, the elastic modulus increased to about 8 GPa. In contrast, when the plasma substrate processing apparatus 10 is used, the elastic modulus becomes about 6.5 GPa when the plasma processing time is 60 seconds, and the elastic modulus is about 8.5 when the plasma processing time is 360 seconds. It has risen to 2GPa. When the plasma treatment time is set between 60 seconds and 300 seconds, the elastic modulus is between 6.5 GPa and 8.2 GPa. Thus, the elastic modulus In addition, when the electron beam is used and when the plasma substrate processing apparatus 10 is used, the longer the processing time, the higher the elastic modulus tends to be.
  • Fig. 7 is a table showing a comparison between specific experimental results of a curing process according to another embodiment using the plasma substrate processing apparatus 10 and a conventional curing process using a furnace and an electron beam. is there. Note that Fig. 7 (a) uses the MSQ1 film, while Figs. 7 (b) and (c) use the MSQ2 film.
  • the film had a dielectric constant of 2.24 and an elastic modulus of 5.
  • the hardness was 9 GPa and the hardness was 0.52 GPa.
  • the residual ratio of methyl groups could not be confirmed.
  • the film quality was 221 dielectric constant, 7.6 GPa elastic modulus, and 0 GPa hardness. 7GPa, methyl residual rate was 0.026. As a result, the dielectric constant can be reduced in the presence of the methyl group.
  • the temperature was set to 350 ° C and the processing time was set by the electron beam.
  • the film had a dielectric constant of 2.31, an elastic modulus of 8.2 GPa, and a hardness of 0.75 GPa. At this time, the residual ratio of methyl groups could not be confirmed.
  • the dielectric constant of the film was 2.21
  • the elastic modulus was 8.6GPa
  • the hardness was 0.8GPa.
  • the dielectric constant shows a substantially similar value regardless of the conventional hardening process using an electron beam or the plasma process using the plasma substrate processing apparatus 10. It can be seen that the treatment with 10 can increase the elastic modulus and hardness while leaving the methyl group.
  • the use of the plasma substrate processing apparatus 10 using microwaves can make the atmosphere of a low electron temperature, so that damage to the insulating film can be reduced.
  • the electron temperature is high, the sheath bias voltage is high, and the energy when the electrons in the plasma are attracted to the insulating film is large, so that when the electrons collide with the insulating film, the insulating film is damaged.
  • the electron temperature is low, the energy when electrons are attracted to the insulating film is small, so that damage to the insulating film when electrons collide with the insulating film can be reduced, and the residual ratio of methyl groups can be reduced.
  • the dielectric constant can be reduced without lowering.
  • the curing time can be set to 5 minutes or less, and more preferably to 1 to 2 minutes, 20 to 30 wafers can be processed per hour, taking the transfer time of wafer 3 into consideration. Throughput in the process can be improved.
  • the present invention is useful for forming an insulating film having a low dielectric constant in a process of manufacturing various semiconductor devices.

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Plasma & Fusion (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Formation Of Insulating Films (AREA)

Abstract

　半導体装置の絶縁膜において低誘電率を維持しながら短時間で硬化させることを目的とする。 　基板上に多孔質ＭＳＱからなる塗布膜を形成し，真空容器内に多孔質ＭＳＱが形成された基板を載置して，プラズマ基板処理装置を用いてマイクロ波励起によって低電子温度で高密度プラズマ処理することにより，多孔質ＭＳＱを構成するある分子中の水酸基と，別の分子の水酸基による分子間脱水縮合反応を起こさせて分子間を結合させ，低誘電率を維持しながら硬化させた絶縁膜を生成する。

Description

明 細 書
半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置 および低誘電率絶縁膜形成装置
技術分野
[0001] この発明は半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置 および低誘電率絶縁膜形成装置に関し，特に，マイクロ波を用いてプラズマを発生し ,半導体装置の層間絶縁膜として用いられる低誘電率の塗布膜を，低誘電率を維持 しながら硬化させる方法および装置に関する。
背景技術
[0002] 半導体集積回路の高集積化に伴い，金属配線同士の間の寄生容量である配線間 容量の増加に起因する配線遅延時間の増大が半導体集積回路の高性能化の妨げ となっている。配線遅延時間は金属配線の抵抗と配線容量との積に比例する。配線 遅延時間を低減するには金属配線の抵抗を小さくするために従来のアルミニウム (A 1)に代えて導電率の高レ、銅（Cu)が用いられてレ、る。
[0003] 一方，配線容量を小さくするためには，金属配線同士の間に形成される層間絶縁膜 の誘電率 (k)を小さくすることが考えられ，誘電率の低い層間絶縁膜として，従来の 酸化シリコン（Si〇2)よりも誘電率の低い絶縁膜が使用される。このような低誘電率絶 縁膜は，たとえば SOD (Spin-on-Dielectric)システムによりウェハ上に形成される 。すなわち， SODシステムではウェハ上に液状の高分子形成材料を塗布し，加熱処 理などの硬化処理（キュア）を施して絶縁膜が形成される。 SODシステムによって塗 布膜を形成した段階では誘電率は低レ、値を保ってレ、る。
[0004] しかし，絶縁膜を形成したままでは機械強度が弱くし力も下地の基板との密着性も弱 いため，その低い誘電率を保った状態で絶縁膜に対して熱硬化処理が行われる。こ の熱硬化処理により絶縁膜の分子同士を結合してポリマー化して化学的結合力によ り強度を高め，化学機械研磨（CMP： ChemicalMechanicalPolising)処理時に膜 相互が剥離してしまうのを避けている。
[0005] 従来は，炉を用いて例えば 30— 60分間加熱処理することにより，絶縁膜に対して 硬化処理が行われているが，この方法では処理に要する時間が長いばかりでなく所 定の機械的な硬さが得られず，長時間加熱すると誘電率が上がってしまうおそれが ある。
[0006] その他の硬化処理方法として電子ビームを使用する方法もあるが，この方法では 2 一 6分間の時間で硬化処理できるものの硬さが不十分であり，さらに誘電率を小さく しながら短時間で絶縁膜を硬化させる方法が望まれている。
[0007] さらに，特開平 8-236520号公報には，平行板プラズマ反応炉でプラズマ生成す ることにより絶縁膜を硬化させる方法について記載されている。
特許文献 1 :特開平 8 - 236520号公報 (段落番号 0024，図 2)
発明の開示
発明が解決しょうとする課題
[0008] 上記特開平 8 - 236520号公報記載の平行板プラズマ反応炉でプラズマ生成する ことにより絶縁膜を硬化させる方法においては，残留物などが生成されないように S〇 G膜を硬化させることを第 1の目的としている。また上記方法は後続するマスク工程後 に感光膜を除去するとき，水分が生成されて電流電圧の特性が低下するのを防ぐこ とを第 2の目的としている。
[0009] 上記方法では， 200°C— 450°Cの温度で 60分間絶縁膜を硬化処理することにより , S〇G膜内の— OHおよび一 CH3などの漏洩電流を発生させる欠陥を減少させてい る。し力 ながら，低誘電率を維持するためには CHが必須であり， SOG膜を 60分
3
間もプラズマ雰囲気にさらすと CH3が消失して誘電率が高くなつてしまうという問題 力 sある。
[0010] それゆえ，本発明の主たる目的は，半導体装置の絶縁膜において低誘電率を維持 しながら短時間で硬化させることができる半導体装置の絶縁膜形成方法，そのような 方法で形成された絶縁膜を有する半導体装置，および低誘電率絶縁膜形成装置を 提供することである。
課題を解決するための手段
[0011] この発明の半導体装置の低誘電率絶縁膜形成方法は，真空容器内に塗布膜が形 成された基板を載置して，マイクロ波励起によって低電子温度で塗布膜を高密度プ ラズマ処理することにより，低誘電率を維持しながら硬化処理する工程を備える。 これにより，低誘電率を維持しながら短時間で塗布膜を硬化させることができる。
[0012] 硬化処理する工程は，好ましくは 5分以下の処理時間で塗布膜を硬化処理すること を含む。これにより，時間あたりの処理枚数を増加できるので，半導体処理工程にお けるスループットを上げることができる。
[0013] 硬化処理する工程は，好ましくは 0. 5- 1. 5eVの低電子温度および 1011— 1013 個/ cm3の電子密度でプラズマを生成することを含む。このように低電子温度で塗布 膜を硬化処理することにより，電子の塗布膜に吸引されるエネルギを小さくできるの で，電子が塗布膜に衝突したときに与えるダメージを軽減できる。
[0014] 硬化処理する工程は，好ましくは塗布膜を構成するある分子中の水酸基と，別の分 子の水酸基による分子間脱水縮合反応を起こさせることを含む。
[0015] この発明の半導体装置は，基板と，基板上に塗布され，低電子温度の高密度ブラ ズマ処理で硬化された低誘電率を有する絶縁膜とを備える。
[0016] 高密度プラズマ処理によって硬化した絶縁膜の分子構造としては，例えば， Si—〇 -Si結合を有するものが挙げられる。
[0017] さらに，この発明の低誘電率絶縁膜形成装置は，真空容器内に塗布膜が形成され た基板を載置して，マイクロ波励起によって低電子温度で高密度プラズマ処理するこ とにより，低誘電率を維持しながら塗布膜を硬化処理する硬化手段を備える。
[0018] 硬化手段としては，例えば 0. 5—1. 5eVの低電子温度および 1011— 1013個/ cm
3の電子密度でプラズマを生成するものが挙げられる。
発明の効果
[0019] この発明によれば，真空容器内に低誘電率の塗布膜が形成された基板を載置して， マイクロ波励起によって低電子温度で高密度プラズマ処理することにより，低誘電率 を維持しながら短時間で塗布膜を硬化させることができ，しかも下地の基板に対して も塗布 S莫を密着させることができる。
また， 5分以下の処理時間で硬化処理することにより，時間あたりの処理枚数を増 加できるので半導体処理工程におけるスループットを上げることができる。
さらに， 0. 5— 1. 5eVの低電子温度および 10"— 1013個/ cm3の電子密度でプラ ズマを生成することにより，電子の塗布膜に吸引されるエネルギを小さくできるので電 子が塗布膜に衝突したときに与えるダメージを軽減できる。
図面の簡単な説明
[0020] [図 1]この発明の低誘電率絶縁膜を形成するために使用されるプラズマ基板処理装 置の断面図である。
[図 2]図 1に示したスロット板の一部破断斜視図である。
[図 3]この発明の一実施形態の低誘電率絶縁膜を形成する処理過程を示す絶縁膜 の断面図である。
[図 4]硬化処理前の絶縁膜とプラズマ基板処理装置で硬化した絶縁膜の分子構造を 示す図である。
[図 5]この発明の一実施形態と従来の電子ビームによる硬化処理時間と誘電率との 関係を示す図である。
[図 6]この発明の一実施形態と従来の電子ビームによる硬化処理時間と弾性率との 関係を示す図である。
[図 7]この発明によるの他の実施形態と，従来の炉および電子ビームを用いた硬化処 理の具体的な実験結果を対比して示した表である。 符号の説明
[0021] 1 基板
2 塗布膜
3 硬化処理した絶縁膜
10 プラズマ基板処理装置
11 処理容器
11A, 11B 排気ポート
12 基板保持台
13, 15 誘電体板
14 スロット板
16 冷却プレート
16a 冷媒路 18 同軸導波管
22 ガスノズノレ
24 冷媒流路
141 円形導体板
142 スロット
W 半導体ウェハ
発明を実施するための最良の形態
[0022] 以下，この発明の実施の形態を図面に基づき説明する。図 1は，この発明の絶縁膜 を形成するために使用されるプラズマ基板処理装置の断面図であり，図 2は図 1に示 したスロット板の一部破断斜視図である。
[0023] プラズマ基板処理装置 10は，被処理基板としてのシリコンウェハ Wを保持する基板 保持台 12が設けられた処理容器 11を含む。処理容器 11内の気体 (ガス）は，排気 ポート 11Aおよび 11Bから，図示しない排気ポンプを介して排気される。基板保持台 12はシリコンウェハ Wを加熱するヒータ機能を有している。
[0024] 処理容器 11の装置上方（上側）には，基板保持台 12上のシリコンウェハ Wに対応 して開口部が設けられている。この開口部は，石英や酸化アルミニウムからなる誘電 体板 13により塞がれている。誘電体板 13の上部（外側）には，図 2に示すようなアン テナとして機能するスロット板 14が配置されている。スロット板 14は，図 2に示したよう に，例えば円板状の薄板銅板からなる円形導体板 141を含み， 円形導体板 141に は多数のスリット 142が形成されている。これらのスリット 142により処理容器 11内の 空間に対して均一な電界分布が形成される。
[0025] スロット板 14のさらに上部（外側）には，石英，アルミナ，窒化アルミニウムなどから なる誘電体板 15が配置されている。この誘電体板 15は，遅波板または波長短縮板と 呼ばれることがあり，マイクロ波の伝播速度を低下させることにより，波長を短くしてス ロット板 14から放射されるマイクロ波の伝播効率を向上させる。誘電体板 15の上部（ 外側）には，冷却プレート 16が配置されている。冷却プレート 16の内部には，冷媒が 流れる冷媒路 16aが設けられている。また，処理容器 11の上端中央には，マイクロ波 を導入する同軸導波管 18が設けられており，処理容器 11の内壁には，ガスを導入 するためのガスノズル 22が設けられている。同様に，処理容器 11の内壁外側には， 容器全体を囲むように冷媒流路 24が形成されてレ、る。
[0026] この発明は図 1に示したプラズマ基板処理装置 10を用いて，以下に説明するブラ ズマ処理を行うことにより，低誘電率を維持しながら短時間で絶縁膜を硬化させる。
[0027] 図 3はこの発明の一実施形態の絶縁膜を形成する処理過程を示す絶縁膜の断面 図であり，図 4は硬化処理前の絶縁膜とプラズマ基板処理装置 10でプラズマ処理し た絶縁膜の分子構造を示す図である。
[0028] まず，図 3 (a)に示す基板 1が準備され，例えば公知の S〇Dシステムによって，図 3
(b)に示すように基板 1上に低誘電率の絶縁膜材料が塗布されて，塗布膜 2が形成 される。ここで，塗布される絶縁材料は例えば多孔質 MSQ (MethylSilsesqueoxan e)などの誘電率が例えば 2. 4以下の低誘電率絶縁膜である。この多孔質膜 MSQは 図 4 (a)に示すように一方の分子が〇_Si_〇の Siに結合された水酸基で終端され， 他方の分子が O— Si— Oの Siに結合された水酸基で終端され，一方の分子と他方の 分子とが切り離された構造も含んでいる。
[0029] 次に，塗布膜 2が形成された基板 1が，図示しない搬送装置により図 1に示したブラ ズマ基板処理装置 10の処理空間内に搬送される。そして，プラズマ基板処理装置 1 0の処理空間内にアルゴン (Ar) ,水素（H2) ,ヘリウム（He)単体，またはこれらの組 合わせによる混合ガスを導入するとともに，同軸導波管 18に 2. 45GHzのマイクロ波 を供給して，処理空間内に 250°C— 400°C程度の温度で， 0. 5- 1. 5eVの低電子 温度，および 10"— 1013個/ cm3の電子密度でプラズマを生成する。この高密度プ ラズマにより，例えば処理時間が 5分以下，より好ましくは 1一 2分間で塗布膜 2を硬 化させるためのプラズマ処理が行われ，塗布膜 2は図 3 (c)に示すように硬化処理さ れた絶縁膜 3となる。
[0030] なお，上述の低電子温度については，予め同条件で原料ガスのガスノズノレ 22から シリコンウェハ Wの間の空間について，ラングミュアプローブにより測定した。また，電 子温度もラングミュアプローブ測定により確認した。
[0031] このプラズマ処理によって図 4 (a)および図 4 (b)に示すように隣接する一方と他方 の分子同士が結合される。すなわち，図 4 (a)に示す一方の水酸基の水素が切り離さ れ，他方の分子の水酸基と Siとの結合が切り離される。そして，切り離された水素と水 酸基とが結合して水となり，この水が飛ばされて分子間脱水縮合反応が行われる。こ のような分子間脱水縮合反応により，図 4 (b)に示すように Si— Ο-Si結合が生じる。こ のような Si— O—Si結合により，絶縁膜 3が硬化する。
[0032] 図 5はこの発明の一実施形態と従来の電子ビームによる硬化処理時間と誘電率と の関係を示し，図 6はこの発明の一実施形態と従来の電子ビームによる硬化処理時 間と弾性率との関係を示す図であり，これらの図において丸印は従来の電子ビーム を用レ、た硬化処理結果を示し，三角印はプラズマ基板処理装置 10を用レ、てプラズ マ処理した実施形態の結果を示してレ、る。
[0033] 図 5に示すように電子ビームによる場合には，処理時間を 120秒間にすると誘電率 は 2. 25程度であり，さらに処理時間を長くして 360秒間にすると誘電率は 2. 3程度 まで高くなつている。これに対して，この実施形態ではプラズマ基板処理装置 10を用 いて，プラズマ処理時間を 60秒間にすると誘電率はほぼ 2. 2であり，プラズマ処理 時間を 300秒間にすると誘電率はあまり変化せずわずかに 2. 2の値を上回っている に過ぎない。プラズマ処理時間を 60秒間から 300秒間のそれぞれの間にした場合に も誘電率はほぼ 2. 2の値が維持されている。
[0034] すなわち，図 5から，電子ビームを用いた硬化処理に比べて，プラズマ基板処理装 置 10を用いてプラズマ処理した方が誘電率を低くできる。また，電子ビームを用いた 場合は硬化処理時間が長くなるにつれて誘電率が上昇する傾向があるのに対して， プラズマ基板処理装置 10を用いた場合にはプラズマ処理時間が長くなつてもほぼ同 じ誘電率を維持できることがわかる。
[0035] 一方，図 6に示す弾性率と処理時間との関係から明らかなように，電子ビームを用 いた場合には，硬化処理時間を 120秒間にすると弾性率は約 6GPaになり，硬化処 理時間を 300秒間にすると弾性率は約 8GPaに上昇した。これに対して，プラズマ基 板処理装置 10を用いた場合には，プラズマ処理時間を 60秒間にすると弾性率が約 6. 5GPaになり，プラズマ処理時間を 360秒間にすると弾性率は約 8. 2GPaに上昇 している。プラズマ処理時間を 60秒間から 300秒間の間のそれぞれの時間にすると ,弾性率は 6. 5GPa力 8. 2GPaの間の値になっている。このように，弾性率に関し ては電子ビームを用いた場合と，プラズマ基板処理装置 10を用いた場合は，ともに 処理時間が長くなれば弾性率も高くなる傾向を示してレ、る。
[0036] したがって，図 5および図 6に示した結果から，電子ビームを用いた硬化処理では 処理時間が長くなれば弾性率を高めることができても誘電率も高くなつてしまうことが 認められる。これに対して，プラズマ基板処理装置 10を用いたプラズマ処理では，処 理時間が長くなれば弾性率を高めることができ，しかも同じ誘電率を維持できることが わ力る。
[0037] 図 7はプラズマ基板処理装置 10を用いた他の実施形態による硬化処理と，炉およ び電子ビームを用いた従来の硬化処理の具体的な実験結果を対比して示した表で ある。なお，図 7 (a)は MSQ1膜を用いているのに対して，図 7 (b)および（c)は MSQ 2膜を使用している。
[0038] 図 7 (a)に示すように炉によって温度を 420°Cおよび処理時間を 60分間にして硬化 処理した結果，膜質は誘電率が 2. 16,弾性率が 5. 4GPa,硬度が 0. 5GPa,メチ ル残存率（Si— Me/SiO)が 0. 025となった。これに対して，プラズマ基板処理装置 10によって温度を 350°Cおよび処理時間を 1分間にしてプラズマ処理した結果，膜 質は誘電率が 2. 39,弾性率が 6. 9GPa,硬度が 0. 6GPa,メチル残存率が 0. 011 となった。
[0039] この結果から，従来の炉による硬化処理に比べて，プラズマ基板処理装置 10でプ ラズマ処理した実施形態の方が，極めて短時間で硬化処理でき，膜質も誘電率は多 少高くなるが，弾性率や硬度をより高くできることが明らかである。
[0040] また，図 7 (b)に示すように電子ビームによって温度を 350°Cおよび処理時間を 2分 間にして硬化処理した結果，膜質は誘電率が 2. 24,弾性率が 5. 9GPa,硬度が 0. 52GPaとなった。このとき，メチル基の残存率は確認できなかった。これに対して，プ ラズマ基板処理装置 10によって温度を 350°Cで処理時間を 1分間にしてプラズマ処 理した結果，膜質は誘電率が 2. 21,弾性率が 7. 6GPa,硬度が 0. 7GPa,メチル 残存率が 0. 026となった。これにより，メチル基を存在させた状態で誘電率を下げら れることがゎカゝる。
[0041] さらに，図 7 (c)に示すように，電子ビームによって温度を 350°Cおよび処理時間を 6分間にして硬化処理した結果，膜質は誘電率が 2. 31 ,弾性率が 8. 2GPa,硬度 が 0. 75GPaとなった。このとき，メチル基の残存率は確認できなかった。これに対し て，プラズマ基板処理装置 10によって温度を 350°Cおよび処理時間を 5分間にして プラズマ処理した結果，膜質は誘電率が 2. 21,弾性率が 8. 6GPa,硬度が 0. 8GP a，メチノレ残存率力 SO. 021となった。
[0042] この結果から，従来の電子ビームによって硬化処理しても，プラズマ基板処理装置 10でプラズマ処理しても誘電率はほぼ似た値を示してレ、る力 S,プラズマ基板処理装 置 10による処理の方が，メチル基を残存させながら弾性率および硬度を高くできるこ とがわかる。
[0043] また，この実施形態では，マイクロ波を用いたプラズマ基板処理装置 10を使用する ことにより低電子温度雰囲気にすることができるので，絶縁膜に対するダメージを少 なくできる。すなわち，電子温度が高ければシースバイアス電圧が高くなるのでブラ ズマ中の電子が絶縁膜に吸引されるときのエネルギが大きくなるため，電子が絶縁膜 に衝突したとき絶縁膜にダメージを与えてしまう。これに対して，電子温度が低けれ ば電子の絶縁膜に吸引されるときのエネルギが小さくなるので，電子が絶縁膜に衝 突したときの絶縁膜に対するダメージを小さくでき，メチル基の残存率が低下すること なく誘電率を小さくできる。
[0044] また，硬化処理時間を 5分以下，より好ましくは 1一 2分に設定できるので，ウェハ 3 の搬送時間を考慮しても 1時間あたり 20— 30枚のウェハを処理でき，半導体処理工 程におけるスループットを向上できる。
[0045] 図面を参照してこの発明の一実施形態を説明したが，本発明は，図示した実施形 態に限定されるものではない。本発明と同一の範囲内において，または均等の範囲 内において，図示した実施形態に対して種々の変更を加えることが可能である。 産業上の利用可能性
[0046] 本発明は，各種の半導体装置の製造過程において，低誘電率の絶縁膜を形成す るのに有用である。

Claims

請求の範囲
[1] 半導体装置に低誘電率の絶縁膜を形成する，半導体装置の低誘電率絶縁膜形成 方法であって，
真空容器内に塗布膜が形成された基板を載置して，マイクロ波励起によって低電子 温度で高密度プラズマ処理することにより，低誘電率を維持しながら前記塗布膜を硬 化処理する工程を有する。
[2] 請求項 1に記載の半導体装置の低誘電率絶縁膜形成方法にぉレ、て，
前記硬化処理する工程は， 5分以下の処理時間で前記塗布膜を硬化処理することを 含む。
[3] 請求項 1に記載の半導体装置の低誘電率絶縁膜形成方法にぉレ、て，
前記硬化処理する工程は， 0. 5- 1. 5eVの低電子温度，および 1011— 1013個/ c m3の電子密度でプラズマを生成することを含む。
[4] 請求項 1に記載の半導体装置の低誘電率絶縁膜形成方法において，前記硬化処理 する工程は，該塗布膜を構成するある分子中の水酸基と，別の分子における水酸基 による分子間脱水縮合反応を起こさせることを含む。
[5] 絶縁膜を有する半導体装置であって，
基板と， 当該基板上に塗布され，低電子温度の高密度プラズマ処理で硬化された低 誘電率の絶縁膜とを有する。
[6] 請求項 5に記載の半導体装置において，
前記高密度プラズマ処理によって硬化した前記絶縁膜の分子構造は， Si - O - Si結 合を有する。
[7] 低誘電率の絶縁膜を形成する低誘電率絶縁膜形成装置であって，
真空容器内に前記塗布膜が形成された基板を載置して，マイクロ波励起によって低 電子温度で前記塗布膜を高密度プラズマ処理することにより，低誘電率を維持しな がら前記絶縁膜を硬化処理する硬化処理手段を備える。
[8] 請求項 7に記載の低誘電率絶縁膜形成装置において，
前記硬化処理手段は， 0. 5—1. 5eVの低電子温度および 10"— 1013個/ cm3の 電子密度でプラズマを生成する装置を有する。
PCT/JP2004/009330 2003-07-02 2004-07-01 半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置および低誘電率絶縁膜形成装置 WO2005004223A1 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
US11/322,318 US20060154492A1 (en) 2003-07-02 2006-01-03 Forming method of low dielectric constant insulating film of semiconductor device, semiconductor device, and low dielectric constant insulating film forming apparatus

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2003190501A JP4358563B2 (ja) 2003-07-02 2003-07-02 半導体装置の低誘電率絶縁膜形成方法
JP2003-190501 2003-07-02

Related Child Applications (1)

Application Number Title Priority Date Filing Date
US11/322,318 Continuation-In-Part US20060154492A1 (en) 2003-07-02 2006-01-03 Forming method of low dielectric constant insulating film of semiconductor device, semiconductor device, and low dielectric constant insulating film forming apparatus

Publications (1)

Publication Number Publication Date
WO2005004223A1 true WO2005004223A1 (ja) 2005-01-13

Family

ID=33562334

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2004/009330 WO2005004223A1 (ja) 2003-07-02 2004-07-01 半導体装置の低誘電率絶縁膜形成方法，その方法を用いた半導体装置および低誘電率絶縁膜形成装置

Country Status (3)

Country Link
US (1) US20060154492A1 (ja)
JP (1) JP4358563B2 (ja)
WO (1) WO2005004223A1 (ja)

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7465677B2 (en) 2005-04-28 2008-12-16 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
US7608490B2 (en) 2005-06-02 2009-10-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
US7785947B2 (en) 2005-04-28 2010-08-31 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device comprising the step of forming nitride/oxide by high-density plasma
US7838347B2 (en) 2005-08-12 2010-11-23 Semiconductor Energy Laboratory Co., Ltd. Display device and manufacturing method of display device
US8318554B2 (en) 2005-04-28 2012-11-27 Semiconductor Energy Laboratory Co., Ltd. Method of forming gate insulating film for thin film transistors using plasma oxidation
US8343816B2 (en) 2005-04-25 2013-01-01 Semiconductor Energy Laboratory Co., Ltd. Organic transistor, manufacturing method of semiconductor device and organic transistor

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006332614A (ja) * 2005-04-25 2006-12-07 Semiconductor Energy Lab Co Ltd 半導体装置、有機トランジスタ及びその作製方法
US7410839B2 (en) 2005-04-28 2008-08-12 Semiconductor Energy Laboratory Co., Ltd. Thin film transistor and manufacturing method thereof
JPWO2007080944A1 (ja) * 2006-01-13 2009-06-11 東京エレクトロン株式会社 多孔質膜の成膜方法およびコンピュータ可読記録媒体
KR20080062744A (ko) * 2006-12-29 2008-07-03 주식회사 하이닉스반도체 반도체 소자의 소자분리막 형성방법
US11508573B2 (en) 2019-12-31 2022-11-22 Micron Technology, Inc. Plasma doping of gap fill materials
KR102508464B1 (ko) * 2021-04-01 2023-03-09 주식회사 코비스테크놀로지 질량 측정 장치

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002280369A (ja) * 2001-03-19 2002-09-27 Canon Sales Co Inc シリコン基板の酸化膜形成装置及び酸化膜形成方法
JP2002329782A (ja) * 2001-05-01 2002-11-15 Tokyo Ohka Kogyo Co Ltd 被膜の処理方法およびこの方法を用いた半導体素子の製造方法
JP2003068850A (ja) * 2001-08-29 2003-03-07 Tokyo Electron Ltd 半導体装置およびその製造方法

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6861356B2 (en) * 1997-11-05 2005-03-01 Tokyo Electron Limited Method of forming a barrier film and method of forming wiring structure and electrodes of semiconductor device having a barrier film
US6576300B1 (en) * 2000-03-20 2003-06-10 Dow Corning Corporation High modulus, low dielectric constant coatings
US6759098B2 (en) * 2000-03-20 2004-07-06 Axcelis Technologies, Inc. Plasma curing of MSQ-based porous low-k film materials
CN100585814C (zh) * 2001-01-25 2010-01-27 东京毅力科创株式会社 等离子体处理方法
US6838300B2 (en) * 2003-02-04 2005-01-04 Texas Instruments Incorporated Chemical treatment of low-k dielectric films

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002280369A (ja) * 2001-03-19 2002-09-27 Canon Sales Co Inc シリコン基板の酸化膜形成装置及び酸化膜形成方法
JP2002329782A (ja) * 2001-05-01 2002-11-15 Tokyo Ohka Kogyo Co Ltd 被膜の処理方法およびこの方法を用いた半導体素子の製造方法
JP2003068850A (ja) * 2001-08-29 2003-03-07 Tokyo Electron Ltd 半導体装置およびその製造方法

Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8343816B2 (en) 2005-04-25 2013-01-01 Semiconductor Energy Laboratory Co., Ltd. Organic transistor, manufacturing method of semiconductor device and organic transistor
US8785259B2 (en) 2005-04-25 2014-07-22 Semiconductor Energy Laboratory Co., Ltd. Organic transistor, manufacturing method of semiconductor device and organic transistor
US7465677B2 (en) 2005-04-28 2008-12-16 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
US7718547B2 (en) 2005-04-28 2010-05-18 Semiconductor Energy Laboratory Co., Ltd Semiconductor device and method for manufacturing the same
US7785947B2 (en) 2005-04-28 2010-08-31 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device comprising the step of forming nitride/oxide by high-density plasma
US8318554B2 (en) 2005-04-28 2012-11-27 Semiconductor Energy Laboratory Co., Ltd. Method of forming gate insulating film for thin film transistors using plasma oxidation
US7608490B2 (en) 2005-06-02 2009-10-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
US7838347B2 (en) 2005-08-12 2010-11-23 Semiconductor Energy Laboratory Co., Ltd. Display device and manufacturing method of display device
US8674366B2 (en) 2005-08-12 2014-03-18 Semiconductor Energy Laboratory Co., Ltd. Display device and manufacturing method of display device

Also Published As

Publication number Publication date
US20060154492A1 (en) 2006-07-13
JP2005026468A (ja) 2005-01-27
JP4358563B2 (ja) 2009-11-04

Similar Documents

Publication Publication Date Title
JP4435666B2 (ja) プラズマ処理方法、成膜方法
KR100933374B1 (ko) 다공질 막의 성막 방법 및 컴퓨터 판독가능한 기록 매체
JP4256763B2 (ja) プラズマ処理方法及びプラズマ処理装置
US20060154492A1 (en) Forming method of low dielectric constant insulating film of semiconductor device, semiconductor device, and low dielectric constant insulating film forming apparatus
KR20100017957A (ko) 반도체 장치의 제조 방법, 반도체 장치, 반도체 제조 장치 및 기억 매체
US20100132613A1 (en) Fabrication of low dielectric constant insulating film
JP2004134560A (ja) シリコンカーバイド膜の製造方法
KR20120025543A (ko) 성막 방법, 전 처리 장치 및 처리 시스템
JP4209253B2 (ja) フッ素添加カーボン膜の形成方法
US20020173138A1 (en) Method for manufacturing a semiconductor device
WO2004017396A1 (ja) 半導体基体上の絶縁膜を形成する方法
JP2005260060A (ja) レジスト除去装置及びレジスト除去方法、並びにそれを用いて製造した半導体装置
KR20090006769A (ko) 다공질 막의 성막 방법 및 컴퓨터 판독가능한 기록 매체
US7569497B2 (en) Method and apparatus for forming insulating layer
JP5935227B2 (ja) 半導体装置の製造方法及び半導体装置
JP7005367B2 (ja) ボロン系膜の成膜方法および成膜装置
JP4267994B2 (ja) 半導体装置の低誘電率絶縁膜形成方法および低誘電率絶縁膜形成制御方法
JP2002299337A (ja) 半導体装置の製造方法および半導体装置
TWI322465B (ja)
JP4580235B2 (ja) 絶縁膜の形成方法
TW200834731A (en) Plasma oxidizing method
JP7049894B2 (ja) ボロン系膜の成膜方法および成膜装置
JP2005175085A (ja) 半導体装置の低誘電率絶縁膜形成方法、半導体装置および低誘電率絶縁膜形成装置
US20030143847A1 (en) Method of forming low dielectric constant insulating layer and method of manufacturing semiconductor device
KR100733440B1 (ko) 불소 첨가 카본막의 형성 방법

Legal Events

Date Code Title Description
AK Designated states

Kind code of ref document: A1

Designated state(s): AE AG AL AM AT AU AZ BA BB BG BR BW BY BZ CA CH CN CO CR CU CZ DE DK DM DZ EC EE EG ES FI GB GD GE GH GM HR HU ID IL IN IS KE KG KP KR KZ LC LK LR LS LT LU LV MA MD MG MK MN MW MX MZ NA NI NO NZ OM PG PH PL PT RO RU SC SD SE SG SK SL SY TJ TM TN TR TT TZ UA UG US UZ VC VN YU ZA ZM ZW

AL Designated countries for regional patents

Kind code of ref document: A1

Designated state(s): GM KE LS MW MZ NA SD SL SZ TZ UG ZM ZW AM AZ BY KG KZ MD RU TJ TM AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IT LU MC NL PL PT RO SE SI SK TR BF BJ CF CG CI CM GA GN GQ GW ML MR NE SN TD TG

121 Ep: the epo has been informed by wipo that ep was designated in this application
WWE Wipo information: entry into national phase

Ref document number: 11322318

Country of ref document: US

WWP Wipo information: published in national office

Ref document number: 11322318

Country of ref document: US

122 Ep: pct application non-entry in european phase