TWI818792B - 光電二極體結構及其製造方法 - Google Patents
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Abstract
本發明提供一種光電二極體結構之製造方法,該方法包括以下步驟:提供一基材;執行磊晶製程以於基材上形成第一半導體層;執行主動區圖形化蝕刻製程以於第一半導體層上形成凹陷部;執行第一塗佈製程以於第一半導體層上形成第一抗反射層;以及執行離子佈值製程以穿過第一抗反射層並於凹陷部內形成第二半導體層。
Description
本發明係關於一種光電二極體結構之製造方法,尤指一種可維持高線性度之光電二極體結構之製造方法。
光電二極體用於接收外來光線,並輸出相應之類比電訊號或者執行電路中不同狀態之切換。目前光電二極體廣泛應用在有光學測量需求之產品上,例如許多智慧型穿戴裝置會使用光電二極體來執行相應脈博或/及血氧量測等功能。
習知光電二極體在製造過程中,會先形成所需之N型及P型半導體層,再於該些半導體層表面上塗佈抗反射層。由於各抗反射層所使用之材料及厚度並不相同,部分抗反射層之製程可能需要在高溫環境下執行,以利於形成相應之抗反射層。然而,該些半導體層受到製程之高溫影響可能產生材質變化,容易出現線性度下降等問題,進而影響光電二極體之感測效能。
因此,如何設計出能改善前述問題之光電二極體結構之製造方法,實為一個值得研究之課題。
本發明之目的在於提供一種可維持高線性度之光電二極體結構之製造方法。
為達上述目的,本發明之光電二極體結構之製造方法包括以下步驟:提供一基材;執行磊晶製程以於基材上形成第一半導體層;執行主動區圖形化蝕刻製程以於第一半導體層上形成凹陷部;執行第一塗佈製程以於第一半導體層上形成第一抗反射層;以及執行離子佈值製程以穿過第一抗反射層並於凹陷部內形成第二半導體層。
在本發明之一實施例中,第一塗佈製程為高溫LPCVD製程。
在本發明之一實施例中,第一塗佈製程之製程溫度不低於800℃。
在本發明之一實施例中,第一抗反射層之厚度介於20至30nm之間。
在本發明之一實施例中,第一抗反射層係以LPCVD製程。
在本發明之一實施例中,更包括以下步驟:執行第二塗佈製程以於第一抗反射層上形成第二抗反射層;執行第一金屬化製程以形成電性連接基材之第一電極;以及執行第二金屬化製程以形成電性連接第二半導體層之第二電極。
在本發明之一實施例中,第二塗佈製程為PVD製程,且第二塗佈製程之製程溫度低於第一塗佈製程之製程溫度。
在本發明之一實施例中,第二塗佈製程之製程溫度不高於200℃。
在本發明之一實施例中,第二抗反射層之厚度介於100至150nm之間。
在本發明之一實施例中,第一半導體層為N型半導體層,第二半導體層為P型半導體層,第一電極為負極,且第二電極為正極。
本發明還包括一種使用前述製造方法製程之光電二極體結構。
據此,藉由將形成第一反射層之高溫塗佈製程執行於形成第二半導體層之前,可避免製程之高溫影響已成型之第二半導體層,減少第二半導體層之線性度下降之可能性,進而維持本發明之光電二極體結構之原有感測效能。
1:光電二極體結構
10:基材
20:第一半導體層
21:凹陷部
30:第一抗反射層
40:第二半導體層
50:第二抗反射層
60:第一電極
70:第二電極
S1~S8:步驟
圖1為本發明之光電二極體結構之製造方法之流程圖。
圖2A為本發明之光電二極體結構於形成第二半導體層前之結構示意圖。
圖2B為本發明之光電二極體結構於形成第二半導體層後之結構示意圖。
圖3為本發明之光電二極體結構之製造方法之另一流程圖。
圖4為本發明之光電二極體結構之整體示意圖。
由於各種態樣與實施例僅為例示性且非限制性,故在閱讀本說明書後,具有通常知識者在不偏離本發明之範疇下,亦可能有其他態樣與實施例。根據下述之詳細說明與申請專利範圍,將可使該等實施例之特徵及優點更加彰顯。
於本文中,係使用「一」或「一個」來描述本文所述的元件和組件。此舉只是為了方便說明,並且對本發明之範疇提供一般性的意義。因此,除
非很明顯地另指他意,否則此種描述應理解為包括一個或至少一個,且單數也同時包括複數。
於本文中,用語「第一」或「第二」等類似序數詞主要是用以區分或指涉相同或類似的元件或結構,且不必然隱含此等元件或結構在空間或時間上的順序。應了解的是,在某些情形或組態下,序數詞可以交換使用而不影響本創作之實施。
於本文中,用語「包括」、「具有」或其他任何類似用語意欲涵蓋非排他性之包括物。舉例而言,含有複數要件的元件或結構不僅限於本文所列出之此等要件而已,而是可以包括未明確列出但卻是該元件或結構通常固有之其他要件。
本發明之光電二極體結構可應用於智慧型穿戴裝置。智慧型穿戴裝置會使用光電二極體作為光學感測器以量測脈膊或/及血氧濃度等身體參數,為了保持訊號感測之穩定性以及後續運算處理之精準度,因此光電二極體需要維持高線性度。前述線性度是指所接收之光源強度與光電二極體本身產生之光電流之比值為常數,當比值越小代表線性度越高,在此先行說明。
以下請一併參考圖1至圖2B,其中圖1為本發明之光電二極體結構之製造方法之流程圖,圖2A為本發明之光電二極體結構於形成第二半導體層前之結構示意圖,圖2B為本發明之光電二極體結構於形成第二半導體層後之結構示意圖。如圖1至圖2B所示,本發明之光電二極體結構之製造方法包括以下步驟:
步驟S1:提供一基材。
首先,本發明藉由提供一基材10以作為本發明之光電二極體結構1之基礎結構件。基材10可利用半導體材料製程,例如高摻雜之N型半導體(即N+半導體),但前述半導體材料之選用會依設計需求不同而改變。
步驟S2:執行磊晶製程以於該基材上形成第一半導體層。
於前述步驟S1提供基材10之後,接著本發明可針對基材10之一側之表面執行磊晶(epitaxy,簡稱EPI)製程,以於基材10上形成第一半導體層20。第一半導體層20可利用低摻雜之N型半導體(即N-半導體)製程,但前述半導體材料之選用會依設計需求不同而改變。
一般而言,在第一半導體層20形成後,會針對第一半導體層20之裸露側之表面執行初始氧化製程,以於該表面形成氧化層作為絕緣層使用,在本發明之光電二極體結構之製造方法中亦可於第一半導體層20形成後執行相同製程,但本發明不以此為限。
步驟S3:執行主動區圖形化蝕刻製程以於第一半導體層上形成凹陷部。
於前述步驟S2形成第一半導體層20後,接著本發明可針對第一半導體層20之裸露側之表面執行主動區圖形化蝕刻製程,例如採用微影製程(photolithography)於第一半導體層20上形成必要之主動區幾何圖形結構。在本發明中,第一半導體層20藉由執行主動區圖形化蝕刻製程後至少可形成凹陷部21,用以供設置後述之第二半導體層40(請參閱圖2B)。
步驟S4:執行第一塗佈製程以於第一半導體層上形成第一抗反射層。
於前述步驟S3後,接著本發明可針對第一半導體層20之裸露側之表面執行第一塗佈製程,以於第一半導體層20上形成第一抗反射層30。第一抗反射層30可完全覆蓋第一半導體層20之凹陷部21。在本發明中,第一塗佈製程採用低壓化學氣相沉積(Low-pressure chemical vapor deposition,簡稱LPCVD)製程,且前述LPCVD製程係於高溫環境下執行。第一塗佈製程之製程溫度不低於800℃,例如在本發明之一實施例中,第一塗佈製程之製程溫度約為800℃,但本發明不以此為限。此外,在本發明之一實施例中,第一抗反射層主要係以需經由高溫成形之氮化矽製程,且藉由第一塗佈製程所形成之第一抗反射層30之厚度介於20至30nm之間。例如在本發明之一實施例中,第一抗反射層30之厚度約為25nm,但第一抗反射層30之厚度可隨著選用材料不同或設計需求不同而改變。
步驟S5:執行離子佈值製程以穿過第一抗反射層並於凹陷部內形成第二半導體層。
於前述步驟S4形成第一抗反射層30後,本發明可針對第一半導體層20之凹陷部21之所在位置執行離子佈值製程,以於該凹陷部21內形成第二半導體層40。因離子佈值製程具有較高功率,可將形成第二半導體層40之材料穿過第一抗反射層30而抵達凹陷部21,進而於凹陷部21內形成第二半導體層40。
由此可知,第二半導體層40因形成於需經高溫處理之第一抗反射層30後,使得第二半導體層40不會受到第一塗佈製程之高溫影響,以確保第二半導體層40本身之材料特性,進而維持本發明之光電二極體結構可提供之高線性度。
以下請一併參考圖3及圖4,其中圖3為本發明之光電二極體結構之製造方法之另一流程圖,圖4為本發明之光電二極體結構之整體示意圖。如圖3及圖4所示,本發明之光電二極體結構之製造方法還包括以下步驟:
步驟S6:執行第二塗佈製程以於第一抗反射層上形成第二抗反射層。
於前述步驟S5形成第二半導體層40後,接著本發明可針對第一抗反射層30之裸露側之表面執行第二塗佈製程,以於第一抗反射層30上形成第二抗反射層50。在本發明中,第二塗佈製程採用物理氣相沈積(physical vapor deposition,簡稱PVD)製程,且前述PVD製程之製程溫度低於第一塗佈製程之製程溫度,其中第二塗佈製程之製程溫度為不影響第二半導體層40本身之材料特性之溫度。第二塗佈製程之製程溫度不高於200℃,例如在本發明之一實施例中,第二塗佈製程之製程溫度約為200℃,但本發明不以此為限。此外,在本發明之一實施例中,第二抗反射層50主要係以PVD製程。據此,即使第二塗佈製程執行於第二半導體層40形成後,第二半導體層40也不會受到第二塗佈製程之製程溫度影響而改變本身之材料特性。
一般而言,在第二抗反射層50形成後,可視設計需求不同選擇執行其他單一或複數塗佈製程,以於第二抗反射層50之裸露側表面進一步形成更多層之抗反射層,且該些抗反射層之使用材料及製程也不同於前述第一塗佈製程及第二塗佈製程;但該些抗反射層之製程溫度同樣為不影響第二半導體層40本身之材料特性之溫度。
步驟S7:執行第一金屬化製程以形成電性連接基材之第一電極。
於前述步驟S6形成第二抗反射層50後,接著本發明可針對基材10之另一裸露側表面執行第一金屬化製程,以於基材10之另一側形成第一電極60。也就是說,在結構上,第一電極60會形成於基材10之下方。在本發明中,第一電極60為負極,但本發明不以此為限。
步驟S8:執行第二金屬化製程以形成電性連接第二半導體層之第二電極。
於前述步驟S7形成第二半導體層40後,本發明可針對第二抗反射層50之裸露側表面執行第二金屬化製程,以於第二抗反射層50上形成第二電極70。在結構之實際製作上,會先於第二半導體層40上方之適當位置,針對已形成第一抗反射層30及第二抗反射層50產生穿孔,再藉由執行第二金屬化製程來形成第二電極70,使得第二電極70電性連接第二半導體層40。在本發明中,第一電極60為正極,但本發明不以此為限。
本發明還包括一種使用如前所述之製造方法製程之光電二極體結構1。本發明之光電二極體結構1之結構特徵如圖2或圖4所示,且各細部結構之形成方式已於前述說明中揭露,在此不多加贅述。
以上實施方式本質上僅為輔助說明,且並不欲用以限制申請標的之實施例或該等實施例的應用或用途。此外,儘管已於前述實施方式中提出至少一例示性實施例,但應瞭解本發明仍可存在大量的變化。同樣應瞭解的是,本文所述之實施例並不欲用以透過任何方式限制所請求之申請標的之範圍、用途或組態。相反的,前述實施方式將可提供本領域具有通常知識者一種簡便的指引以實施所述之一或多種實施例。再者,可對元件之功能與排列進行各種變化而不脫
離申請專利範圍所界定的範疇,且申請專利範圍包含已知的均等物及在本專利申請案提出申請時的所有可預見均等物。
S1~S5:步驟
Claims (11)
- 一種光電二極體結構之製造方法,該方法包括以下步驟:提供一基材;執行一磊晶製程以於該基材上形成一第一半導體層;執行一主動區圖形化蝕刻製程以於該第一半導體層上形成一凹陷部;執行一第一塗佈製程以於該第一半導體層上形成一第一抗反射層;執行一離子佈值製程以穿過該第一抗反射層並於該凹陷部內形成一第二半導體層;執行一第二塗佈製程以於該第一抗反射層上形成一第二抗反射層;執行一第一金屬化製程以形成電性連接該基材之一第一電極;以及執行一第二金屬化製程以形成電性連接該第二半導體層之一第二電極。
- 如請求項1所述之製造方法,其中該第一塗佈製程為一高溫LPCVD製程。
- 如請求項2所述之製造方法,其中該第一塗佈製程之製程溫度不低於800℃。
- 如請求項1所述之製造方法,其中該第一抗反射層之厚度介於20至30nm之間。
- 如請求項1所述之製造方法,其中該第一抗反射層係以LPCVD製程。
- 如請求項1所述之製造方法,其中該第二塗佈製程為一PVD製程,且該第二塗佈製程之製程溫度低於該第一塗佈製程之製程溫度。
- 如請求項6所述之製造方法,其中該第二塗佈製程之製程溫度不高於200℃。
- 如請求項1所述之製造方法,其中該第二抗反射層之厚度介於100至150nm之間。
- 如請求項1所述之製造方法,其中該第二抗反射層係以PVD製程。
- 如請求項1所述之製造方法,其中該第一半導體層為N型半導體層,該第二半導體層為P型半導體層,該第一電極為負極,且該第二電極為正極。
- 一種使用請求項1至10中任一項所述之製造方法製程之光電二極體結構。
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