TWI770633B - 顯示裝置 - Google Patents

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Abstract

一種顯示裝置包含複數第一畫素、複數第二畫素、複數第一多工器、複數第二多工器、複數第一走線、複數第二走線及積體電路。複數第一多工器用以控制複數第一畫素。複數第二多工器用以控制複數第二畫素。複數第一走線耦接複數第一多工器之每一者。複數第二走線耦接複數第二多工器之每一者。積體電路包含至少二第一極性引腳及至少二第二極性引腳。至少二第一極性引腳相鄰。至少二第二極性引腳相鄰。至少二第一極性引腳與至少二第二極性引腳交錯排列。至少二第一極性引腳耦接複數第一走線。至少二第二極性引腳耦接複數第二走線。

Description

顯示裝置
本案涉及一種電子裝置。詳細而言，本案涉及一種顯示裝置。
近年來，由於下窄邊框的需求，許多顯示器逐漸採用COF(Chip On Film)技術，此設計壓縮下窄邊框中的扇出區的高度，再者，扇出區之功耗佔據全部面板之功相當大的比例。因此，上述技術尚存諸多缺陷，而有待本領域從業人員研發出其餘適合的顯示面板結構。
本案的一面向涉及一種顯示裝置。顯示裝置包含複數個第一畫素、複數個第二畫素、複數個第一多工器、複數個第二多工器、複數個第一走線、複數個第二走線及積體電路。複數個第一畫素及複數個第二畫素交錯排列。複數個第一多工器用以控制複數個第一畫素，並包含至少三第一開關。至少三第一開關其中一者控制複數個第二畫素。複數個第二多工器用以控制複數個第二畫 素，並包含至少三第二開關。至少三第二開關其中一者控制複數個第一畫素。複數個第一多工器之每一者與複數個第二多工器之每一者交錯排列。複數個第一走線耦接複數個第一多工器之每一者。複數個第二走線耦接複數個第二多工器之每一者。積體電路包含至少二第一極性引腳及至少二第二極性引腳。至少二第一極性引腳相鄰。至少二第二極性引腳相鄰。至少二第一極性引腳與至少二第二極性引腳交錯排列。至少二第一極性引腳耦接複數個第一走線。至少二第二極性引腳耦接複數個第二走線。第一極性引腳的極性與第二極性引腳的極性相反。
100,100A,100B:顯示裝置
110:基板
120:軟板
130:積體電路
D:顯示區
A1:週邊區
A2:封裝扇出區
A11:接合區
A12:扇出區
A13:多工器區
A14:資料線區
S1,S11~S12:第一極性引腳
S2,S21~S22:第二極性引腳
T1,T11~T12:第一走線
T2,T21~T22:第二走線
M11~M12:第一多工器
M21~M22:第二多工器
P11~P12:第一畫素
A121:扇出區之前段
A122:扇出區之中段
A123:扇出區之後段
F1~F2:導電層
D1:交叉點
D1’:對應投影點
O:放大區域
P21~P22:第二畫素
R1~R2:第一子畫素
G1~G2:第二子畫素
B1~B2:第三子畫素
Z1~Z6:開關
L1~L2:資料線
S1A,S11~S13A:第一極性引腳
S2A,S21~S23A:第二極性引腳
T1A,T11~T13A:第一走線
T2A,T21~T23A:第二走線
M11A~M13A:第一多工器
M21A~M23A:第二多工器
P11A~P13A:第一畫素
P21A~P23A:第二畫素
Z1A~Z6A:開關
S1B,S11B~S12B:第一極性引腳
S2B,S21B~S22B:第二極性引腳
T1B,T11B~T12B:第一走線
T2B,T21B~T22B:第二走線
M11B:第一多工器
M21B~M22B:第二多工器
P11B~P14B:第一畫素
P21B~P24B:第二畫素
Z1B~Z12B:開關
參照後續段落中的實施方式以及下列圖式，當可更佳地理解本案的內容：第1圖為根據本案一些實施例繪示的顯示裝置之部分結構圖；第2圖為根據本案一些實施例繪示的顯示裝置之部分結構放大圖；第3圖為根據本案一些實施例繪示的顯示裝置之扇出區之透視圖；第4圖為根據本案一些實施例繪示的顯示裝置之部分結構放大圖；以及第5圖為根據本案一些實施例繪示的顯示裝置之部分結構 放大圖。
以下將以圖式及詳細敘述清楚說明本案之精神，任何所屬技術領域中具有通常知識者在瞭解本案之實施例後，當可由本案所教示之技術，加以改變及修飾，其並不脫離本案之精神與範圍。
本文之用語只為描述特定實施例，而無意為本案之限制。單數形式如“一”、“這”、“此”、“本”以及“該”，如本文所用，同樣也包含複數形式。
關於本文中所使用之『包含』、『包括』、『具有』、『含有』等等，均為開放性的用語，即意指包含但不限於。
關於本文中所使用之用詞(terms)，除有特別註明外，通常具有每個用詞使用在此領域中、在本案之內容中與特殊內容中的平常意義。某些用以描述本案之用詞將於下或在此說明書的別處討論，以提供本領域技術人員在有關本案之描述上額外的引導。
第1圖為根據本案一些實施例繪示的顯示裝置之部分結構圖。在一些實施例中，如第1圖所示，顯示裝置100包含面板110、多工器區A13、軟板120及積體電路130。多工器區A13內的多工器位於面板110上。積體電路130位於軟板120上。
此外，如第1圖所示，面板110包含顯示區D 及週邊區A1。顯示區D位於面板110之第一側。週邊區A1位於面板110之第二側。第一側相對於第二側。雖然第一側及第二側於圖中繪示為上側及下側，但於實作上，第一側及第二側不以上側及下側為限。
在一些實施例中，顯示區D包含複數個第一畫素(圖中未示)及複數個第二畫素(圖中未示)，為了更佳地本案顯示裝置之結構，其詳細結構將於下面段落中解釋之。
在一些實施例中，多工器區A13位於週邊區A1中。在一些實施例中，軟板120包含封裝扇出區A2。
在一些實施例中，積體電路130透過薄膜覆晶封裝(Chip on film,COF)技術貼合於軟板120，部分重疊接合形成接合區A11。在一些實施例中，接合區A11位於週邊區A1中。
第2圖為根據本案一些實施例繪示的顯示裝置之部分結構放大圖。在一些實施例中，第2圖為對應第1圖中週邊區A1之放大圖。在一些實施例中，週邊區A1包含接合區A11、扇出區A12、多工器區A13及資料線區A14。
在一些實施例中，請參閱第2圖，顯示裝置100包含複數個第一畫素(如第一畫素P11及第一畫素P12)、複數個第二畫素(如第二畫素P21及第二畫素P22)、複數個第一多工器(如第一多工器M11及第一多工器M12)、複數個第二多工器(如第二多工器M21及第二多 工器M22)、複數個第一走線T1、複數個第二走線T2。複數個第一畫素及複數個第二畫素交錯排列。其中每個畫素可包含三個子畫素用以分別顯示紅綠藍等顏色，而每個子畫素分別連接至對應之資料線。須說明的是，圖式中複數個第一畫素及複數個第二畫素代表相鄰不同行的多工器控制的畫素。
在一些實施例中，資料線區A14為資料線離開多工器區A13及進入第1圖之顯示區D前之窄小區域。資料線用以耦接畫素及多工器。亦即，每一多工器用以連接引腳，以接收來自積體電路130的訊號，並連接於對應之資料線以及對應之子畫素。
此外，請參閱第2圖，多工器區A13包含複數個第一多工器(如第一多工器M11及第一多工器M12)及複數個第二多工器(如第二多工器M21及第二多工器M22)。複數個第一多工器用以控制複數個第一畫素(如第一畫素P11及第一畫素P12)，並包含至少三第一開關(如開關Z1、Z2及Z3)。至少三第一開關其中一者(如開關Z2)控制複數個第二畫素(如第二畫素P21)。複數個第二多工器用以控制複數個第二畫素，並包含至少三第二開關(如開關Z4、Z5及Z6)。至少三第二開關其中一者(如開關Z5)控制複數個第一畫素(如第一畫素P11)。每一個第一多工器與每一個第二多工器交錯排列。
再者，扇出區A12包含複數個第一走線T1及 複數個第二走線T2。複數個第一走線T1耦接複數個第一多工器之每一者(如第一多工器M11及第一多工器M12)。複數個第二走線T2耦接複數個第二多工器之每一者(如第二多工器M21及第二多工器M22)。
另外，接合區A11包含至少二第一極性引腳S1及至少二第二極性引腳S2。至少二第一極性引腳S1相鄰。至少二第二極性引腳S2相鄰。至少二第一極性引腳S1與至少二第二極性引腳S2交錯排列。至少二第一極性引腳S1耦接複數個第一走線T1。至少二第二極性引腳S2耦接複數個第二走線T2。舉例而言，第一極性引腳S11及第一極性引腳S12相鄰。第二極性引腳S21及第二極性引腳S22相鄰。第一極性引腳的極性與第二極性引腳的極性相反。
在一些實施例中，為使本案之顯示裝置之扇出區之剖面疊構易於理解，請一併參閱第2圖及第3圖，第3圖為根據本案一些實施例繪示的顯示裝置100之扇出區A12之透視圖。第3圖之扇出區A12之透視圖對應至第2圖之扇出區A12之放大區域O。扇出區A12中複數個第一走線T1及複數個第二走線T2由下至上包含前段A121、中段A122及後段A123變化結構，但不以此敘述順序為限。
在一些實施例中，耦接至少二第一極性引腳的複數個第一走線之每一者相鄰，耦接至少二第二極性引腳的複數個第二走線之每一者相鄰。須說明的是，此為扇 出區前段變化。舉例而言，請參閱第2圖，第一極性引腳S11耦接第一走線T11。第一極性引腳S12耦接第一走線T12。第一走線T11及第一走線T12相鄰。同理，第二極性引腳S21耦接第二走線T21。第二極性引腳S22耦接第二走線T22。第二走線T21及第二走線T22相鄰。須說明的是，第一走線T1及第二走線T2於剛出接合區A11及扇出區A12之前段A121為相鄰。
在一些實施例中，請參閱第2圖及第3圖，扇出區A12的剖面疊構包含第一導電層F1及第二導電層F2。第二導電層F2位於第一導電層F1上層且彼此電性絕緣。複數個第一走線中相鄰的第一走線T11及第一走線T12分別配置於第一導電層F1及第二導電層F2，並於垂直投影方向上重疊。複數個第二走線中相鄰的第二走線T21及第二走線T22分別配置於第一導電層F1及第二導電層F2，並於垂直投影方向上重疊。須說明的是，扇出區A12為多層金屬所組成，複數個第一走線T1分別配置於不同層，複數個第二走線T2亦分別配置於不同層。再者，此為扇出區中段A122變化，且若扇出區位於XY平面，此第一導電層F1及第二導電層F2為Z方向延伸。舉例而言，第一走線T11配置於第一導電層F1，第一走線T12配置於第二導電層F2，第一走線T11及第一走線T12於垂直投影方向上重疊。同理，第二走線T21及第二走線T22配置於不同導電層，並於垂直投影 方向上重疊。
在一些實施例中，複數個第一走線與複數個第二走線不耦接，並於垂直投影方向上形成至少一交叉點。須說明的是，此為扇出區後段變化。舉例而言，請參閱第2圖及第3圖，第一走線T11及第二走線T21位於第一導電層F1，第一走線T12及第二走線T22位於第二導電層F2。第一走線及第二走線於實作上並不耦接。第一走線T12及第二走線T2於垂直投影方向上形成至少一交叉點D1(交叉點D1對應投影點D1’)。須說明的是，此為複數個第一走線T1及複數個第二走線T2將離開扇出區並耦接至多工器區A13之扇出區A12之後段A123變化。須說明的是，走線之長度及形狀、扇出區A12之前段A121、中段A122及後段A123之長度、第一導電層F1及第二導電層F2之間的距離不以圖式之實施例為限。
在一些實施例中，第一多工器中至少三第一開關包含第一端、第二端及控制端。至少三第一開關之第二端均並聯，並透過複數個第一走線其中一者耦接至至少二第一極性引腳其中一者。第二多工器中至少三第二開關包含第一端及第二端及控制端。至少三第二開關之第二端均並聯，並透過複數個第二走線其中一者耦接至至少二第二極性引腳其中一者。舉例而言，請以元件上方起算為第一端，第一多工器M11中三個第一開關(如圖式中Z1、Z2及Z3)均包含第一端、第二端及控制端。 三個第一開關之第二端並聯，並透過第一走線T11耦接第一極性引腳S11。第一多工器M12中三個第一開關之第二端並聯，並透過第一走線T12耦接第一極性引腳S12。
同理，第二多工器M12中三個第二開關(如圖式中Z4、Z5及Z6)均包含第一端、第二端及控制端。三個第二開關之第二端並聯，並透過第二走線T21耦接第二極性引腳S21。第二多工器M22中三個第二開關之第二端並聯，並透過第二走線T22耦接第二極性引腳S22。
此外，第一開關Z1及第二開關Z4之控制端接收第一子畫素R1的控制訊號。第一開關Z2及第二開關Z5之控制端接收第二子畫素G1的控制訊號。第一開關Z3及第二開關Z6之控制端接收第三子畫素B1的控制訊號。
在一些實施例中，至少三第一開關其中一者之第一端透過第一資料線耦接至複數個第二畫素其中一者。至少三第二開關其中一者之第一端透過第二資料線耦接至複數個第一畫素其中一者。舉例而言，請參閱第2圖，上述控制端接受第二子畫素G1的第一開關Z2及第二開關Z5，第一開關Z2之第一端耦接第一資料線L1以控制第二畫素P21，第二開關Z5之第一端耦接第二資料線L2以控制第一畫素P11。在一些實施例中，第一資料線與第二資料線於垂直投影方向上形成至少一交叉點。 舉例而言，第一資料線L1與第二資料線L2於資料線區A14中交叉。此外，第一資料線L1與第二資料線L2位於不同層，並於垂直投影方向上形成至少一交叉點。也就是說，第一資料線L1用以傳輸第一極性資料，且第二資料線L2用以傳輸第二極性資料。
第4圖為根據本案一些實施例繪示的顯示裝置100A之部分結構放大圖。在一些實施例中，第4圖相較於第2圖，改變接合區A11中第一極性引腳S1A之配對數量及第二極性引腳S2A之配對數量。
在一些實施例中，至少三第一極性引腳以及至少三第二極性引腳。至少三第一極性引腳相鄰。至少三第二極性引腳相鄰。至少三第一極性引腳與至少三第二極性引腳交錯排列。至少三第一極性引腳耦接複數個第一走線，該至少三第二極性引腳耦接複數個第二走線。舉例而言，請參閱第4圖，第一極性引腳S11A、第一極性引腳S12A及第一極性引腳S13A相鄰。第二極性引腳S21A、第二極性引腳S22A及第二極性引腳S23A相鄰。三個第一極性引腳S1A與三個第二極性引腳S2A交錯排列。
此外，第一極性引腳S11A耦接第一走線T11A至第一多工器M11A。第一極性引腳S12A耦接第一走線T12A至第一多工器M12A。第一極性引腳S13A耦接第一走線T13A至第一多工器M13A。
同理，第二極性引腳S21A耦接第二走線T21A 至第二多工器M21A。第二極性引腳S22A耦接第二走線T22A至第二多工器M22A。第二極性引腳S23A耦接第二走線T23A至第二多工器M23A。
在一些實施例中，扇出區更包含第三導電層。第三導電層位於第二導電層之上。複數個第一走線中相鄰的三條第一走線分別配置於第一導電層、第二導電層及第三導電層，並於垂直投影方向上重疊。複數個第二走線中相鄰的三條第二走線分別配置於第一導電層、第二導電層及第三導電層，並於垂直投影方向上重疊。舉例而言，相鄰的第一走線T11A、第一走線T12A及第一走線T13A均位於不同層，並於垂直投影方向上重疊。相鄰的第二走線T21A、第二走線T22A及第二走線T23A均位於不同層，並於垂直投影方向上重疊。
在一些實施例中，複數個第一走線中相鄰的三條第一走線與複數個第二走線中相鄰的三條第二走線均不耦接。舉例而言，第一走線T11A及第二走線T21A位於第一導電層。第一走線T12A及第二走線T22A位於第二導電層。第一走線T13A及第二走線T23A位於第三導電層。第一走線T1A與第二走線T2A均不耦接。
第5圖為根據本案一些實施例繪示的顯示裝置100B之部分結構放大圖。在一些實施例中，第5圖相較於第2圖，改變多工器區A13中第一多工器M11B及第二工器M21B內部開關數量及多工器控制的第一畫素(如第一畫素P11B及P12B)及第二畫素(如第二畫素 P12B及P22B)。複數個第一畫素中的兩個第一畫素(如第一畫素P11B及P12B)及複數個第二畫素中的兩個第二畫素(如第二畫素P12B及P22B)依序排列為第一順序的第一畫素P11B、第二順序的第二畫素P12B、第三順序的第一畫素P12B及第四順序的第二畫素P22B。
在一些實施例中，請參閱第5圖，第一多工器M11B包含六個開關，由上至下分別為開關Z1B、Z2B、Z3B、Z4B、Z5B及Z6B。六開關均包含第一端、第二端及控制端。請以元件上方起算為第一端，開關Z1B、Z2B、Z3B、Z4B、Z5B及Z6B之第二端並聯。
此外，第二多工器M21B包含六個開關，由上至下分別為開關Z7B、Z8B、Z9B、Z10B、Z11B及Z12B。六開關均包含第一端、第二端及控制端。開關Z7B、Z8B、Z9B、Z10B、Z11B及Z12B之第二端並聯。
在一些實施例中，開關Z1B及開關Z7B之控之端接收第一子畫素R1的控制訊號。開關Z2B及開關Z8B之控制端接收第二子畫素G1的控制訊號。開關Z3B及開關Z9B之控之端接收第三子畫素B1的控制訊號。
此外，開關Z4B及開關Z10B之控之端接收第一子畫素R2的控制訊號。開關Z5B及開關Z11B之控之端接收第二子畫素G2的控制訊號。開關Z6B及開關 Z12B之控之端接收第三子畫素B2的控制訊號。
在一些實施例中，六開關其中一者控制第三順序的第一畫素。六開關其中一者控制第二順序的第二畫素。六開關其中二者第四順序的第二畫素。六開關其中一者控制該第一順序的第一畫素，六開關其中二者控制第三順序的第一畫素，六開關其中二者控制第二順序的第二畫素，六開關其中一者控制第四順序的第二畫素。舉例而言，第一多工器M11B中的開關Z1B及Z3B控制第一順序的第一畫素P11B。開關Z5B控制第二順序的第二畫素P21B。然而，開關Z2B控制第三順序的第一畫素P12B。開關Z4B及Z6B控制第四順序的第二畫素P22B。
此外，第二多工器M21B中的開關Z7B及Z9B控制第三順序的第一畫素P12B。開關Z11B控制第四順序的第二畫素P22B。然而，開關Z8B控制第一順序的第一畫素P11B。開關Z10B及Z12B控制第二順序的第二畫素P21B。
在一些實施例中，第1圖中週邊區A1可為上述第2圖實施例、上述第4圖實施例及上述第5圖之實施例至少其中一者的排列組合。
在一些實施例中，上述第2圖實施例之兩兩極性引腳排列設計可使扇出區A12之功耗相較現有技術減少約一半功耗。
在一些實施例中，上述第4圖實施例之三三極 性引腳排列設計可使扇出區A12之功耗相較現有技術減少約三分之二的功耗及縮減扇出區A12的空間高度。須說明的是，若扇出區A12位於XY平面，此處空間高度意指Z方向。
在一些實施例中，上述第5圖實施例之多工器設計可使扇出區A12之功耗相較現有技術減少約四分之三的功耗，實質上，此設計等同於改變扇出區A12的空間高度。須說明的是，若扇出區A12位於XY平面，此處空間高度意指Z方向。
依據前述實施例，本案提供一種顯示裝置，藉以改善顯示裝置中扇出區之功耗，除有效利用電能外，還可降低扇出區所佔空間以做其他電路設計。
雖然本案以詳細之實施例揭露如上，然而本案並不排除其他可行之實施態樣。因此，本案之保護範圍當視後附之申請專利範圍所界定者為準，而非受於前述實施例之限制。
對本領域技術人員而言，在不脫離本案之精神和範圍內，當可對本案作各種之更動與潤飾。基於前述實施例，所有對本案所作的更動與潤飾，亦涵蓋於本案之保護範圍內。
100:顯示裝置
A1:週邊區
A11:接合區
A12:扇出區
A13:多工器區
A14:資料線區
S1,S11~S12:第一極性引腳
S2,S21~S22:第二極性引腳
T1,T11~T12:第一走線
T2,T21~T22:第二走線
M11~M12:第一多工器
M21~M22:第二多工器
P11~P12:第一畫素
P21~P22:第二畫素
R1:第一子畫素
G1:第二子畫素
B1:第三子畫素
Z1~Z6:開關
L1~L2:資料線

Claims (8)

  1. 一種顯示裝置，包含：複數個第一畫素；複數個第二畫素，其中該些第一畫素及該些第二畫素交錯排列；複數個第一多工器，用以控制該些第一畫素，並包含至少三第一開關，該至少三第一開關其中一者控制該些第二畫素；複數個第二多工器，用以控制該些第二畫素，並包含至少三第二開關，該至少三第二開關其中一者控制該些第一畫素，其中該些第一多工器之每一者與該些第二多工器之每一者交錯排列；複數個第一走線，耦接該些第一多工器之每一者；複數個第二走線，耦接該些第二多工器之每一者；以及一積體電路，包含：至少二第一極性引腳，其中該至少二第一極性引腳相鄰；以及至少二第二極性引腳，其中該至少二第二極性引腳相鄰，其中該至少二第一極性引腳與該至少二第二極性引腳交錯排列，該至少二第一極性引腳耦接該些第一走線，該至少二第二極性引腳耦接該些第二走線，其中該至少二第一極性引腳的極性與該至少二第二極性引腳的極性相反，其中耦接該至少二第一極性引腳的該些第一走線之每一者相鄰，耦接該至少二第二極 性引腳的該些第二走線之每一者相鄰，其中該顯示裝置包含一扇出區，該扇出區包含一第一導電層及一第二導電層，該第二導電層位於該第一導電層之上；其中該些第一走線中相鄰的第一走線分別配置於該第一導電層及該第二導電層，並於垂直投影方向上重疊；其中該些第二走線中相鄰的第二走線分別配置於該第一導電層及該第二導電層，並於垂直投影方向上重疊。
  2. 如請求項1所述之顯示裝置，其中該些第一走線與該些第二走線不耦接，並於垂直投影方向上形成至少一交叉點。
  3. 如請求項2所述之顯示裝置，其中該積體電路更包含：至少三第一極性引腳，其中該至少三第一極性引腳相鄰；以及至少三第二極性引腳，其中該至少三第二極性引腳相鄰，其中該至少三第一極性引腳與該至少三第二極性引腳交錯排列，該至少三第一極性引腳耦接該些第一走線，該至少三第二極性引腳耦接該些第二走線。
  4. 如請求項3所述之顯示裝置，其中該扇出區更包含一第三導電層，該第三導電層位於該第二導電層之 上；其中該些第一走線中相鄰的三條第一走線分別配置於該第一導電層、該第二導電層及該第三導電層，並於垂直投影方向上重疊；其中該些第二走線中相鄰的三條第二走線分別配置於該第一導電層、該第二導電層及該第三導電層，並於垂直投影方向上重疊。
  5. 如請求項4所述之顯示裝置，其中該些第一走線中相鄰的三條第一走線與該些第二走線中相鄰的三條第二走線均不耦接。
  6. 如請求項1所述之顯示裝置，其中該至少三第一開關包含一第一端、一第二端及一控制端，其中該至少三第一開關之該第二端均並聯，並透過該些第一走線其中一者耦接至該至少二第一極性引腳其中一者；其中該至少三第二開關包含一第一端、一第二端及一控制端，其中該至少三第二開關之該第二端均並聯，並透過該些第二走線其中一者耦接至該至少二第二極性引腳其中一者。
  7. 如請求項6所述之顯示裝置，其中該至少三第一開關其中一者之該第一端透過一第一資料線耦接至該些第二畫素其中一者； 其中該至少三第二開關其中一者之該第一端透過一第二資料線耦接至該些第一畫素其中一者；其中該第一資料線與該第二資料線於垂直投影方向上形成至少一交叉點。
  8. 如請求項1所述之顯示裝置，其中該些第一畫素中的兩個第一畫素與該些第二畫素中的兩個第二畫素依序排列為一第一順序的第一畫素、一第二順序的第二畫素、一第三順序的第一畫素及一第四順序的第二畫素；其中該些第一多工器包含六開關，其中該六開關其中二者控制該第一順序的第一畫素，該六開關其中一者控制該第三順序的第一畫素，該六開關其中一者控制該第二順序的第二畫素，該六開關其中二者該第四順序的第二畫素；其中該些第二多工器包含六開關，其中該六開關其中一者控制該第一順序的第一畫素，該六開關其中二者控制該第三順序的第一畫素，該六開關其中二者控制該第二順序的第二畫素，該六開關其中一者控制該第四順序的第二畫素。
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