CN113393800A - 显示装置 - Google Patents

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Abstract

一种显示装置包含多个第一像素、多个第二像素、多个第一多工器、多个第二多工器、多个第一走线、多个第二走线及集成电路。多个第一多工器用以控制多个第一像素。多个第二多工器用以控制多个第二像素。多个第一走线耦接多个第一多工器的每一者。多个第二走线耦接多个第二多工器的每一者。集成电路包含至少二第一极性引脚及至少二第二极性引脚。至少二第一极性引脚相邻。至少二第二极性引脚相邻。至少二第一极性引脚与至少二第二极性引脚交错排列。至少二第一极性引脚耦接多个第一走线。至少二第二极性引脚耦接多个第二走线。

Description

显示装置
技术领域
本公开涉及一种电子装置。详细而言，本公开涉及一种显示装置。
背景技术
近年来，由于下窄边框的需求，许多显示器逐渐采用COF(Chip On Film)技术，此设计压缩下窄边框中的扇出区的高度，再者，扇出区的功耗占据全部面板的功相当大的比例。因此，上述技术尚存诸多缺陷，而有待本领域从业人员研发出其余适合的显示面板结构。
发明内容
本公开的一面向涉及一种显示装置。显示装置包含多个第一像素、多个第二像素、多个第一多工器、多个第二多工器、多个第一走线、多个第二走线及集成电路。多个第一像素及多个第二像素交错排列。多个第一多工器用以控制多个第一像素，并包含至少三第一开关。至少三第一开关其中一者控制多个第二像素。多个第二多工器用以控制多个第二像素，并包含至少三第二开关。至少三第二开关其中一者控制多个第一像素。多个第一多工器的每一者与多个第二多工器的每一者交错排列。多个第一走线耦接多个第一多工器的每一者。多个第二走线耦接多个第二多工器的每一者。集成电路包含至少二第一极性引脚及至少二第二极性引脚。至少二第一极性引脚相邻。至少二第二极性引脚相邻。至少二第一极性引脚与至少二第二极性引脚交错排列。至少二第一极性引脚耦接多个第一走线。至少二第二极性引脚耦接多个第二走线。第一极性引脚的极性与第二极性引脚的极性相反。
附图说明
参照后续段落中的实施方式以及下列附图，当可更佳地理解本公开的内容：
图1为根据本公开一些实施例示出的显示装置的部分结构图；
图2为根据本公开一些实施例示出的显示装置的部分结构放大图；
图3为根据本公开一些实施例示出的显示装置的扇出区的剖视图；
图4为根据本公开一些实施例示出的显示装置的部分结构放大图；以及
图5为根据本公开一些实施例示出的显示装置的部分结构放大图。
附图标记说明：
100,100A,100B：显示装置
110：基板
120：软板
130：集成电路
D：显示区
A1：周边区
A2：封装扇出区
A11：接合区
A12：扇出区
A13：多工器区
A14：数据线区
S1,S11～S12：第一极性引脚
S2,S21～S22：第二极性引脚
T1,T11～T12：第一走线
T2,T21～T22：第二走线
M11～M12：第一多工器
M21～M22：第二多工器
P11～P12：第一像素
A121：扇出区的前段
A122：扇出区的中段
A123：扇出区的后段
F1～F2：导电层
D1：交叉点
D1’：对应投影点
P21～P22：第二像素
R1～R2：第一子像素
G1～G2：第二子像素
B1～B2：第三子像素
Z1～Z6：开关
L1～L2：数据线
S1A,S11～S13A：第一极性引脚
S2A,S21～S23A：第二极性引脚
T1A,T11～T13A：第一走线
T2A,T21～T23A：第二走线
M11A～M13A：第一多工器
M21A～M23A：第二多工器
P11A～P13A：第一像素
P21A～P23A：第二像素
Z1A～Z6A：开关
S1B,S11B～S12B：第一极性引脚
S2B,S21B～S22B：第二极性引脚
T1B,T11B～T12B：第一走线
T2B,T21B～T22B：第二走线
M11B：第一多工器
M21B～M22B第二多工器
P11B～P14B：第一像素
P21B～P24B：第二像素
Z1B～Z12B：开关
具体实施方式
以下将以附图及详细叙述清楚说明本公开的构思，任何所属技术领域中技术人员在了解本公开的实施例后，当可由本公开所启示的技术，加以改变及修饰，其并不脱离本公开的构思与范围。
本文的用语只为描述特定实施例，而无意为本公开的限制。单数形式如“一”、“这”、“此”、“本”以及“该”，如本文所用，同样也包含多个形式。
关于本文中所使用的“包含”、“包括”、“具有”、“含有”等等，均为开放性的用语，即意指包含但不限于。
关于本文中所使用的用词(terms)，除有特别注明外，通常具有每个用词使用在此领域中、在本公开的内容中与特殊内容中的平常意义。某些用以描述本公开的用词将于下或在此说明书的别处讨论，以提供本领域技术人员在有关本公开的描述上额外的引导。
图1为根据本公开一些实施例示出的显示装置的部分结构图。在一些实施例中，如图1所示，显示装置100包含面板110、多工器区A13、软板120及集成电路130。多工器区A13内的多工器位于面板110上。集成电路130位于软板120上。
此外，如图1所示，面板110包含显示区D及周边区A1。显示区D位于面板110的第一侧。周边区A1位于面板110的第二侧。第一侧相对于第二侧。虽然第一侧及第二侧于图中示出为上侧及下侧，但于实作上，第一侧及第二侧不以上侧及下侧为限。
在一些实施例中，显示区D包含多个第一像素(图中未示)及多个第二像素(图中未示)，为了更佳地本公开显示装置的结构，其详细结构将于下面段落中对其进行解释。
在一些实施例中，多工器区A13位于周边区A1中。在一些实施例中，软板120包含封装扇出区A2。
在一些实施例中，集成电路130通过薄膜覆晶封装(Chip on film,COF)技术贴合于软板120，部分重叠接合形成接合区A11。在一些实施例中，接合区A11位于周边区A1中。
图2为根据本公开一些实施例示出的显示装置的部分结构放大图。在一些实施例中，图2为对应图1中周边区A1的放大图。在一些实施例中，周边区A1包含接合区A11、扇出区A12、多工器区A13及数据线区A14。
在一些实施例中，请参阅图2，显示装置100包含多个第一像素(如第一像素P11及第一像素P12)、多个第二像素(如第二像素P21及第二像素P22)、多个第一多工器(如第一多工器M11及第一多工器M12)、多个第二多工器(如第二多工器M21及第二多工器M22)、多个第一走线T1、多个第二走线T2。多个第一像素及多个第二像素交错排列。其中每个像素可包含三个子像素用以分别显示红绿蓝等颜色，而每个子像素分别连接至对应的数据线。须说明的是，附图中多个第一像素及多个第二像素代表相邻不同行的多工器控制的像素。
在一些实施例中，数据线区A14为数据线离开多工器区A13及进入图1的显示区D前的窄小区域。数据线用以耦接像素及多工器。亦即，每一多工器用以连接引脚，以接收来自集成电路130的信号，并连接于对应的数据线以及对应的子像素。
此外，请参阅图2，多工器区A13包含多个第一多工器(如第一多工器M11及第一多工器M12)及多个第二多工器(如第二多工器M21及第二多工器M22)。多个第一多工器用以控制多个第一像素(如第一像素P11及第一像素P12)，并包含至少三第一开关(如开关Z1、Z2及Z3)。至少三第一开关其中一者(如开关Z2)控制多个第二像素(如第二像素P21)。多个第二多工器用以控制多个第二像素，并包含至少三第二开关(如开关Z4、Z5及Z6)。至少三第二开关其中一者(如开关Z5)控制多个第一像素(如第一像素P11)。每一个第一多工器与每一个第二多工器交错排列。
再者，扇出区A12包含多个第一走线T1及多个第二走线T2。多个第一走线T1耦接多个第一多工器的每一者(如第一多工器M11及第一多工器M12)。多个第二走线T2耦接多个第二多工器的每一者(如第二多工器M21及第二多工器M22)。
另外，接合区A11包含至少二第一极性引脚S1及至少二第二极性引脚S2。至少二第一极性引脚S1相邻。至少二第二极性引脚S2相邻。至少二第一极性引脚S1与至少二第二极性引脚S2交错排列。至少二第一极性引脚S1耦接多个第一走线T1。至少二第二极性引脚S2耦接多个第二走线T2。举例而言，第一极性引脚S11及第一极性引脚S12相邻。第二极性引脚S21及第二极性引脚S22相邻。第一极性引脚的极性与第二极性引脚的极性相反。
在一些实施例中，为使本公开的显示装置的扇出区的剖面叠构易于理解，请一并参阅图2及图3，图3为根据本公开一些实施例示出的显示装置100的扇出区A12的剖视图。图3的扇出区A12的剖视图对应至图2的扇出区A12。扇出区A12中多个第一走线T1及多个第二走线T2由下至上包含前段A121、中段A122及后段A123变化结构，但不以此叙述顺序为限。
在一些实施例中，耦接至少二第一极性引脚的多个第一走线的每一者相邻，耦接至少二第二极性引脚的多个第二走线的每一者相邻。须说明的是，此为扇出区前段变化。举例而言，请参阅图2，第一极性引脚S11耦接第一走线T11。第一极性引脚S12耦接第一走线T12。第一走线T11及第一走线T12相邻。同理，第二极性引脚S21耦接第二走线T21。第二极性引脚S22耦接第二走线T22。第二走线T21及第二走线T22相邻。须说明的是，第一走线T1及第二走线T2于刚出接合区A11及扇出区A12的前段A121为相邻。
在一些实施例中，请参阅图2及图3，扇出区的剖面叠构包含第一导电层F1及第二导电层F2。第二导电层F2位于第一导电层F1上层且彼此电性绝缘。多个第一走线中相邻的第一走线T11及第二走线T22分别配置于第一导电层F1及第二导电层F2，并于垂直投影方向上重叠。多个第二走线中相邻的第二走线T21及第二走线T22分别配置于第一导电层F1及第二导电层F2，并于垂直投影方向上重叠。须说明的是，扇出区A12为多层金属所组成，多个第一走线T1分别配置于不同层，多个第二走线T2亦分别配置于不同层。再者，此为扇出区中段A122变化，且若扇出区位于XY平面，此第一导电层F1及第二导电层F2为Z方向延伸。举例而言，第一走线T11配置于第一导电层F1，第一走线T12配置于第二导电层F2，第一走线T11及第一走线T12于垂直投影方向上重叠。同理，第二走线T21及第二走线T22配置于不同导电层，并于垂直投影方向上重叠。
在一些实施例中，多个第一走线与多个第二走线不耦接，并于垂直投影方向上形成至少一交叉点。须说明的是，此为扇出区后段变化。举例而言，请参阅图2及图3，第一走线T11及第二走线T21位于第一导电层F1，第一走线T12及第二走线T22位于第二导电层F2。第一走线及第二走线于实作上并不耦接。第一走线T12及第二走线T2于垂直投影方向上形成至少一交叉点D1(交叉点D1对应投影点D1’)。须说明的是，此为多个第一走线T1及多个第二走线T2将离开扇出区并耦接至多工器区A13的扇出区A12的后段A123变化。须说明的是，走线的长度及形状、扇出区A12的前段A121、中段A122及后段A123的长度、第一导电层F1及第二导电层F2之间的距离不以附图的实施例为限。
在一些实施例中，第一多工器中至少三第一开关包含第一端、第二端及控制端。至少三第一开关的第二端均并联，并通过多个第一走线其中一者耦接至至少二第一极性引脚其中一者。第二多工器中至少三第二开关包含第一端及第二端及控制端。至少三第二开关的第二端均并联，并通过多个第二走线其中一者耦接至至少二第二极性引脚其中一者。举例而言，请以元件上方起算为第一端，第一多工器M11中三个第一开关(如附图中Z1、Z2及Z3)均包含第一端、第二端及控制端。三个第一开关的第二端并联，并通过第一走线T11耦接第一极性引脚S11。第一多工器M12中三个第一开关的第二端并联，并通过第一走线T12耦接第一极性引脚S12。
同理，第二多工器M12中三个第二开关(如附图中Z4、Z5及Z6)均包含第一端、第二端及控制端。三个第二开关的第二端并联，并通过第二走线T21耦接第二极性引脚S21。第二多工器M22中三个第二开关的第二端并联，并通过第二走线T22耦接第二极性引脚S22。
此外，第一开关Z1及第二开关Z4的控制端接收第一子像素R1的控制信号。第一开关Z2及第二开关Z5的控制端接收第二子像素G1的控制信号。第一开关Z3及第二开关Z6的控制端接收第三子像素B1的控制信号。
在一些实施例中，至少三第一开关其中一者的第一端通过第一数据线耦接至多个第二像素其中一者。至少三第二开关其中一者的第一端通过第二数据线耦接至多个第一像素其中一者。举例而言，请参阅图2，上述控制端接受第二子像素G1的第一开关Z2及第二开关Z5，第一开关Z2的第一端耦接第一数据线L1以控制第二像素P21，第二开关Z5的第一端耦接第二数据线L2以控制第一像素P11。在一些实施例中，第一数据线与第二数据线于垂直投影方向上形成至少一交叉点。举例而言，第一数据线L1与第二数据线L2于数据线区A14中交叉。此外，第一数据线L1与第二数据线L2位于不同层，并于垂直投影方向上形成至少一交叉点。也就是说，第一数据线L1用以传输第一极性数据，且第二数据线L2用以传输第二极性数据。
图4为根据本公开一些实施例示出的显示装置的部分结构放大图。在一些实施例中，图4相较于图2，改变接合区A11中第一极性引脚S1A的配对数量及第二极性引脚S2A的配对数量。
在一些实施例中，至少三第一极性引脚以及至少三第二极性引脚。至少三第一极性引脚相邻。至少三第二极性引脚相邻。至少三第一极性引脚与至少三第二极性引脚交错排列。至少三第一极性引脚耦接多个第一走线，该至少三第二极性引脚耦接多个第二走线。举例而言，请参阅图4，第一极性引脚S11A、第一极性引脚S12A及第一极性引脚S13A相邻。第二极性引脚S21A、第二极性引脚S22A及第二极性引脚S23A相邻。三个第一极性引脚S1A与三个第二极性引脚S2A交错排列。
此外，第一极性引脚S11A耦接第一走线T11A至第一多工器M11A。第一极性引脚S12A耦接第一走线T12A至第一多工器M12A。第一极性引脚S13A耦接第一走线T13A至第一多工器M13A。
同理，第二极性引脚S21A耦接第二走线T21A至第二多工器M21A。第二极性引脚S22A耦接第二走线T22A至第二多工器M22A。第二极性引脚S23A耦接第二走线T23A至第二多工器M23A。
在一些实施例中，扇出区还包含第三导电层。第三导电层位于第二导电层之上。多个第一走线中相邻的三条第一走线分别配置于第一导电层、第二导电层及第三导电层，并于垂直投影方向上重叠。多个第二走线中相邻的三条第二走线分别配置于第一导电层、第二导电层及第三导电层，并于垂直投影方向上重叠。举例而言，相邻的第一走线T11A、第一走线T12A及第一走线T13A均位于不同层，并于垂直投影方向上重叠。相邻的第二走线T21A、第二走线T22A及第二走线T23A均位于不同层，并于垂直投影方向上重叠。
在一些实施例中，多个第一走线中相邻的三条第一走线与多个第二走线中相邻的三条第二走线均不耦接。举例而言，第一走线T11A及第二走线T21A位于第一导电层。第一走线T12A及第二走线T22A位于第二导电层。第一走线T13A及第二走线T23A位于第三导电层。第一走线T1A与第二走线T2A均不耦接。
图5为根据本公开一些实施例示出的显示装置的部分结构放大图。在一些实施例中，图5相较于图2，改变多工器区A13中第一多工器M11B及第二工器M21B内部开关数量及多工器控制的第一像素(如第一像素P11B及P12B)及第二像素(如第二像素P12B及P22B)。多个第一像素中的两个第一像素(如第一像素P11B及P12B)及多个第二像素中的两个第二像素(如第二像素P12B及P22B)按序排列为第一顺序的第一像素P11B、第二顺序的第二像素P12B、第三顺序的第一像素P12B及第四顺序的第二像素P22B。
在一些实施例中，请参阅图5，第一多工器M11B包含六个开关，由上至下分别为开关Z1B、Z2B、Z3B、Z4B、Z5B及Z6B。六开关均包含第一端、第二端及控制端。请以元件上方起算为第一端，开关Z1B、Z2B、Z3B、Z4B、Z5B及Z6B的第二端并联。
此外，第二多工器M21B包含六个开关，由上至下分别为开关Z7B、Z8B、Z9B、Z10B、Z11B及Z12B。六开关均包含第一端、第二端及控制端。开关Z7B、Z8B、Z9B、Z10B、Z11B及Z12B的第二端并联。
在一些实施例中，开关Z1B及开关Z7B的控制端接收第一子像素R1的控制信号。开关Z2B及开关Z8B的控制端接收第二子像素G1的控制信号。开关Z3B及开关Z9B的控制端接收第三子像素B1的控制信号。
此外，开关Z4B及开关Z10B的控制端接收第一子像素R2的控制信号。开关Z5B及开关Z11B的控制端接收第二子像素G2的控制信号。开关Z6B及开关Z12B的控制端接收第三子像素B2的控制信号。
在一些实施例中，六开关其中一者控制第三顺序的第一像素。六开关其中一者控制第二顺序的第二像素。六开关其中二者第四顺序的第二像素。六开关其中一者控制该第一顺序的第一像素，六开关其中二者控制第三顺序的第一像素，六开关其中二者控制第二顺序的第二像素，六开关其中一者控制第四顺序的第二像素。举例而言，第一多工器M11B中的开关Z1B及Z3B控制第一顺序的第一像素P11B。开关Z5B控制第二顺序的第二像素P21B。然而，开关Z2B控制第三顺序的第一像素P12B。开关Z4B及Z6B控制第四顺序的第二像素P22B。
此外，第二多工器M21B中的开关Z7B及Z9B控制第三顺序的第一像素P12B。开关Z11B控制第四顺序的第二像素P22B。然而，开关Z8B控制第一顺序的第一像素P11B。开关Z10B及Z12B控制第二顺序的第二像素P21B。
在一些实施例中，图1中周边区A1可为上述图2实施例、上述图4实施例及上述图5的实施例至少其中一者的排列组合。
在一些实施例中，上述图2实施例的两两极性引脚排列设计可使扇出区A12的功耗相较现有技术减少约一半功耗。
在一些实施例中，上述图4实施例的三三极性引脚排列设计可使扇出区A12的功耗相较现有技术减少约三分之二的功耗及缩减扇出区A12的空间高度。须说明的是，若扇出区A12位于XY平面，此处空间高度意指Z方向。
在一些实施例中，上述图5实施例的多工器设计可使扇出区A12的功耗相较现有技术减少约四分之三的功耗，实质上，此设计等同于改变扇出区A12的空间高度。须说明的是，若扇出区A12位于XY平面，此处空间高度意指Z方向。
依据前述实施例，本公开提供一种显示装置，借此改善显示装置中扇出区的功耗，除有效利用电能外，还可降低扇出区所占空间以做其他电路设计。
虽然本公开以详细的实施例公开如上，然而本公开并不排除其他可行的实施方式。因此，本公开的保护范围当视权利要求所界定者为准，而非受于前述实施例的限制。
对本领域技术人员而言，在不脱离本公开的构思和范围内，当可对本公开作各种的变动与润饰。基于前述实施例，所有对本公开所作的变动与润饰，亦涵盖于本公开的保护范围内。

Claims (10)

1.一种显示装置，包含：
多个第一像素；
多个第二像素，其中该些第一像素及该些第二像素交错排列；
多个第一多工器，用以控制该些第一像素，并包含至少三第一开关，该至少三第一开关其中一者控制该些第二像素；
多个第二多工器，用以控制该些第二像素，并包含至少三第二开关，该至少三第二开关其中一者控制该些第一像素，其中该些第一多工器的每一者与该些第二多工器的每一者交错排列；
多个第一走线，耦接该些第一多工器的每一者；
多个第二走线，耦接该些第二多工器的每一者；以及
一集成电路，包含：
至少二第一极性引脚，其中该至少二第一极性引脚相邻；以及
至少二第二极性引脚，其中该至少二第二极性引脚相邻，其中该至少二第一极性引脚与该至少二第二极性引脚交错排列，该至少二第一极性引脚耦接该些第一走线，该至少二第二极性引脚耦接该些第二走线，其中该第一极性引脚的极性与该第二极性引脚的极性相反。
2.如权利要求1所述的显示装置，其中耦接该至少二第一极性引脚的该些第一走线的每一者相邻，耦接该至少二第二极性引脚的该些第二走线的每一者相邻。
3.如权利要求2所述的显示装置，其中该显示装置包含一扇出区，该扇出区包含一第一导电层及一第二导电层，该第二导电层位于该第一导电层之上；
其中该些第一走线中相邻的第一走线分别配置于该第一导电层及该第二导电层，并于垂直投影方向上重叠；
其中该些第二走线中相邻的第二走线分别配置于该第一导电层及该第二导电层，并于垂直投影方向上重叠。
4.如权利要求3所述的显示装置，其中该些第一走线与该些第二走线不耦接，并于垂直投影方向上形成至少一交叉点。
5.如权利要求4所述的显示装置，其中该集成电路还包含：
至少三第一极性引脚，其中该至少三第一极性引脚相邻；以及
至少三第二极性引脚，其中该至少三第二极性引脚相邻，其中该至少三第一极性引脚与该至少三第二极性引脚交错排列，该至少三第一极性引脚耦接该些第一走线，该至少三第二极性引脚耦接该些第二走线。
6.如权利要求5所述的显示装置，其中该扇出区还包含一第三导电层，该第三导电层位于该第二导电层之上；
其中该些第一走线中相邻的三条第一走线分别配置于该第一导电层、该第二导电层及该第三导电层，并于垂直投影方向上重叠；
其中该些第二走线中相邻的三条第二走线分别配置于该第一导电层、该第二导电层及该第三导电层，并于垂直投影方向上重叠。
7.如权利要求6所述的显示装置，其中该些第一走线中相邻的三条第一走线与该些第二走线中相邻的三条第二走线均不耦接。
8.如权利要求1所述的显示装置，其中该至少三第一开关包含一第一端、一第二端及一控制端，其中该至少三第一开关的该第二端均并联，并通过该些第一走线其中一者耦接至该至少二第一极性引脚其中一者；
其中该至少三第二开关包含一第一端、一第二端及一控制端，其中该至少三第二开关的该第二端均并联，并通过该些第二走线其中一者耦接至该至少二第二极性引脚其中一者。
9.如权利要求8所述的显示装置，其中该至少三第一开关其中一者的该第一端通过一第一数据线耦接至该些第二像素其中一者；
其中该至少三第二开关其中一者的该第一端通过一第二数据线耦接至该些第一像素其中一者；
其中该第一数据线与该第二数据线于垂直投影方向上形成至少一交叉点。
10.如权利要求1所述的显示装置，其中该些第一像素中的两个第一像素与该些第二像素中的两个第二像素按序排列为一第一顺序的第一像素、一第二顺序的第二像素、一第三顺序的第一像素及一第四顺序的第二像素；
其中该些第一多工器包含六开关，其中该六开关其中二者控制该第一顺序的第一像素，该六开关其中一者控制该第三顺序的第一像素，该六开关其中一者控制该第二顺序的第二像素，该六开关其中二者该第四顺序的第二像素；
其中该些第二多工器包含六开关，其中该六开关其中一者控制该第一顺序的第一像素，该六开关其中二者控制该第三顺序的第一像素，该六开关其中二者控制该第二顺序的第二像素，该六开关其中一者控制该第四顺序的第二像素。
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