TWI721107B - 化合物半導體基板、膠片膜及化合物半導體基板之製造方法 - Google Patents

化合物半導體基板、膠片膜及化合物半導體基板之製造方法 Download PDF

Info

Publication number
TWI721107B
TWI721107B TW106105348A TW106105348A TWI721107B TW I721107 B TWI721107 B TW I721107B TW 106105348 A TW106105348 A TW 106105348A TW 106105348 A TW106105348 A TW 106105348A TW I721107 B TWI721107 B TW I721107B
Authority
TW
Taiwan
Prior art keywords
substrate
film
sic film
compound semiconductor
sic
Prior art date
Application number
TW106105348A
Other languages
English (en)
Other versions
TW201739948A (zh
Inventor
奥秀彦
秀一郎
Original Assignee
日商愛沃特股份有限公司
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Priority claimed from JP2016113656A external-priority patent/JP6753703B2/ja
Priority claimed from JP2017008115A external-priority patent/JP6825923B2/ja
Application filed by 日商愛沃特股份有限公司 filed Critical 日商愛沃特股份有限公司
Publication of TW201739948A publication Critical patent/TW201739948A/zh
Application granted granted Critical
Publication of TWI721107B publication Critical patent/TWI721107B/zh

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02167—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon carbide not containing oxygen, e.g. SiC, SiC:H or silicon carbonitrides
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02436—Intermediate layers between substrates and deposited layers
    • H01L21/02439—Materials
    • H01L21/02441—Group 14 semiconducting materials
    • H01L21/02447—Silicon carbide
    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B29/00—Single crystals or homogeneous polycrystalline material with defined structure characterised by the material or by their shape
    • C30B29/10—Inorganic compounds or compositions
    • C30B29/36—Carbides
    • C—CHEMISTRY; METALLURGY
    • C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/04—Coating on selected surface areas, e.g. using masks
    • C—CHEMISTRY; METALLURGY
    • C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/22—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the deposition of inorganic material, other than metallic material
    • C23C16/30—Deposition of compounds, mixtures or solid solutions, e.g. borides, carbides, nitrides
    • C23C16/32—Carbides
    • C23C16/325—Silicon carbide
    • C—CHEMISTRY; METALLURGY
    • C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/56—After-treatment
    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B25/00—Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
    • C30B25/02—Epitaxial-layer growth
    • C30B25/04—Pattern deposit, e.g. by using masks
    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B25/00—Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
    • C30B25/02—Epitaxial-layer growth
    • C30B25/18—Epitaxial-layer growth characterised by the substrate
    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B29/00—Single crystals or homogeneous polycrystalline material with defined structure characterised by the material or by their shape
    • C30B29/10—Inorganic compounds or compositions
    • C30B29/40—AIIIBV compounds wherein A is B, Al, Ga, In or Tl and B is N, P, As, Sb or Bi
    • C30B29/403—AIII-nitrides
    • C30B29/406—Gallium nitride
    • G—PHYSICS
    • G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F1/00—Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
    • G03F1/62—Pellicles, e.g. pellicle assemblies, e.g. having membrane on support frame; Preparation thereof
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02002—Preparing wafers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02109—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02164—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon oxide, e.g. SiO2
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02107—Forming insulating materials on a substrate
    • H01L21/02296—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02299—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer pre-treatment
    • H01L21/02307—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer pre-treatment treatment by exposure to a liquid
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02367—Substrates
    • H01L21/0237—Materials
    • H01L21/02373—Group 14 semiconducting materials
    • H01L21/02381—Silicon, silicon germanium, germanium
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02436—Intermediate layers between substrates and deposited layers
    • H01L21/02439—Materials
    • H01L21/02455—Group 13/15 materials
    • H01L21/02458—Nitrides
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02436—Intermediate layers between substrates and deposited layers
    • H01L21/02439—Materials
    • H01L21/02488—Insulating materials
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02518—Deposited layers
    • H01L21/02521—Materials
    • H01L21/02524—Group 14 semiconducting materials
    • H01L21/02529—Silicon carbide
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02518—Deposited layers
    • H01L21/02521—Materials
    • H01L21/02538—Group 13/15 materials
    • H01L21/0254—Nitrides
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02612—Formation types
    • H01L21/02617—Deposition types
    • H01L21/0262—Reduction or decomposition of gaseous compounds, e.g. CVD
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02656—Special treatments
    • H01L21/02658—Pretreatments
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/30604—Chemical etching
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
    • H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
    • H01L21/82—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components
    • H01L21/8213—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components the substrate being a semiconductor, using SiC technology
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0657—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table
    • H01L29/1606—Graphene
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table
    • H01L29/1608—Silicon carbide
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02518—Deposited layers
    • H01L21/02521—Materials
    • H01L21/02524—Group 14 semiconducting materials
    • H01L21/02527—Carbon, e.g. diamond-like carbon
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/2003—Nitride compounds
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76—Unipolar devices, e.g. field effect transistors
    • H01L29/772—Field effect transistors
    • H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
    • H01L29/7786—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with direct single heterostructure, i.e. with wide bandgap layer formed on top of active layer, e.g. direct single heterostructure MIS-like HEMT

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • General Physics & Mathematics (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • Materials Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • General Chemical & Material Sciences (AREA)
  • Inorganic Chemistry (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Ceramic Engineering (AREA)
  • Mechanical Engineering (AREA)
  • Weting (AREA)

Abstract

本發明係一種化合物半導體基板，膠片膜，及化合物半導體基板之製造方法，其中，提供可謀求SiC膜之薄膜化的化合物半導體基板，膠片膜，及化合物半導體基板之製造方法。化合物半導體基板之製造方法係具備：形成SiC膜於Si基板的表面側之工程，和經由濕蝕刻而使SiC膜之背面的至少一部分露出之工程。在使SiC膜之背面的至少一部分露出之工程中，對於使用於濕蝕刻之藥液而言，至少相對性地移動Si基板及SiC膜。

Description

化合物半導體基板、膠片膜及化合物半導體基板之製造方法
本發明係有關化合物半導體基板，膠片膜，及化合物半導體基板之製造方法，而更特定而言係有關具備SiC(碳化矽)膜之化合物半導體基板，膠片膜，及化合物半導體基板之製造方法。
SiC係比較於Si(矽)，對於耐熱性及耐電壓性優越，作為電子裝置而使用之情況的電力損失為小。因此，SiC係作為新世代之半導體材料，例如，對於高性能．省電力之換流器機器，家庭電化製品用功率模組，或電動汽車用功率半導體元件等之利用則進展著。
另外，SiC係比較於Si，因具有高楊氏模數，在高溫的高降伏強度，及高的化學安定性之故，而檢討有作為MEMS(MicroElectro Mechanical Systems)而利用SiC之情況。更且，SiC係具有高光透過率之故，亦加以檢討有利用此等性質之其他的用途。
具備SiC膜之化合物半導體基板係通常，於 Si基板上形成SiC膜之後，經由蝕刻Si基板的一部分或全部而加以形成。對於在蝕刻Si基板時，形成SiC膜之Si基板則被浸漬於藥液中。形成具備SiC膜之化合物半導體基板的技術係例如，揭示於下述專利文獻1~3等。
對於下述專利文獻1係加以揭示有：於Si基板的表面上，形成約1μm厚度之SiC膜，再由以任意的面積而除去SiC膜之任一方的面者，形成基板開口部，將SiC膜作為光罩而通過基板開口部，蝕刻Si基板之技術。對於在蝕刻Si基板時，加以使用氟酸與硝酸之混合液。
對於下述專利文獻2係揭示有：製造含有SiC膜之X線光罩之技術。在此技術中，於Si晶圓上，形成2μm厚度之SiC膜，再於SiC膜上形成保護膜及X線吸收膜，於Si晶圓的下面，將耐蝕刻物質塗佈成環狀，使用氫氧化鈉水溶液而除去Si晶圓的中央部。
對於下述專利文獻3係揭示有：於包含補強部之Si基板之一方的之面，形成3C-SiC層，以混合氟化氫酸或硝酸等之蝕刻液而溶解Si基板之技術。
〔先前技術文獻〕 〔專利文獻〕
專利文獻1：日本特開平09-310170號公報
專利文獻2：日本特開平07-118854號公報
專利文獻3：日本特開2015-202990號公報
在具備SiC膜之化合物半導體基板中，對於SiC膜係要求薄膜化。例如，對於利用SiC膜之MEMS的情況，係從高感度化的觀點，加以要求SiC膜之薄膜化。另外，對於利用SiC膜之膠片的情況，係從更提升光透過性等之觀點，加以要求SiC膜之薄膜化。
但在以往的技術中，無法形成具備加以薄膜化之SiC膜的化合物半導體基板者。當作為欲薄膜化SiC膜時(例如，當作為呈10μm以下之厚度時)，與SiC膜為厚之情況做比較，機械強度變低之故，而在Si基板之蝕刻中，引起斷裂產生於SiC膜，以及自Si基板，SiC膜則剝離之現象。
本發明係為了解決上述課題之構成，其目的為提供：可謀求SiC膜之薄膜化的化合物半導體基板，膠片膜，及化合物半導體基板之製造方法。
依照本發明之一狀況的化合物半導體基板係具備：具有環狀的平面形狀之Si基板，和具有加以形成於Si基板之一方的主面側之20nm以上10μm以下厚度之SiC膜，而SiC膜係未加以形成於Si基板之另一方的主面。
在上述化合物半導體基板中，理想係對於SiC 膜之表面而言以在垂直的平面切開之剖面而視的情況，Si基板之寬度係隨著自SiC膜離開而減少。
在上述化合物半導體基板中，理想係更具備：加以形成於SiC膜之一方的主面，與SiC不同的膜。
在上述化合物半導體基板中，理想係與SiC不同的膜係由石墨烯，石墨，或GaN(氮化鎵)所成。
在上述化合物半導體基板中，理想係SiC膜係加以形成於Si基板之一方的主面。
在上述化合物半導體基板中，理想係更具備：加以形成於Si基板之一方的主面之Si氧化膜，而SiC膜係加以形成於Si氧化膜之一方的主面側。
依照本發明之其他狀況之膠片膜係使用上述之化合物半導體基板者。
依照本發明之又其他狀況之化合物半導體基板之製造方法係具備：形成SiC膜於Si基板之一方的主面側之工程，和經由濕蝕刻而使SiC膜之Si基板側的主面之至少一部分露出之工程；在使SiC膜之Si基板側的主面之至少一部分露出之工程中，對於使用於濕蝕刻之藥液而言，至少相對性地移動Si基板及SiC膜。
在上述製造方法中，理想係在使SiC膜之Si基板側的主面之至少一部分露出之工程中，至少將Si基板及SiC膜，對於SiC膜之一方的主面而言，移動於平行之平面內的方向。
在上述製造方法中，理想係在使SiC膜之Si 基板側的主面之至少一部分露出之工程中，在至少使Si基板及SiC膜旋轉的狀態，將使用於濕蝕刻之藥液，注入至Si基板之另一方的主面。
在上述製造方法中，理想係更具備：形成將Si作為底面之凹部於Si基板之另一方的主面之中央部的工程；在使SiC膜之Si基板側的主面之至少一部分露出之工程中，使SiC膜露出於凹部的底面。
在上述製造方法中，理想係在形成凹部於Si基板之另一方的主面之中央部之工程之後，進行形成SiC膜之工程。
在上述製造方法中，理想係在形成SiC膜之工程之後，進行形成凹部於Si基板之另一方的主面之中央部之工程。
在上述製造方法中，理想係在形成凹部於Si基板之另一方的主面之中央部之工程中，將形成於Si基板之另一方的主面之氧化膜或氮化膜所成之光罩層，作為光罩，經由濕蝕刻而除去Si基板之另一方的主面之中央部。
在上述製造方法中，理想係在形成SiC膜之工程中，於Si基板之一方的主面側及側面，以及Si基板之另一方的主面之外周部，形成SiC膜，在使SiC膜之Si基板側的主面之至少一部分露出之工程中，將形成於Si基板之另一方的主面之外周部的SiC膜作為光罩，除去Si基板之另一方的主面。
在上述製造方法中，理想係在使SiC膜之Si基板側的主面之至少一部分露出之工程中，作為使用於濕蝕刻的藥液，使用含有氟酸及硝酸的混酸。
在上述製造方法中，理想係在使SiC膜之Si基板側的主面之至少一部分露出之工程之後，更具備：於與SiC膜之Si基板相反側的主面形成GaN膜之工程。
在上述製造方法中，理想係更具備：使SiC膜之一部分變化為石墨烯膜或石墨膜之工程。
在上述製造方法中，理想係更具備：於與SiC膜之Si基板相反側的主面形成石墨烯膜或石墨膜之工程。
在上述製造方法中，理想係在形成SiC膜之工程中，於Si基板之一方的主面，形成SiC膜。
在上述製造方法中，理想係更具備：於Si基板之一方的主面，形成Si氧化膜之工程；在形成SiC膜之工程中，於Si氧化膜之一方的主面側，形成SiC膜。
如根據本發明，可提供可謀求SiC膜之薄膜化的化合物半導體基板，膠片膜，及化合物半導體基板之製造方法者。
1，1a，1b，1c，1d，1e，1f‧‧‧化合物半導體基板
2‧‧‧中間體
11‧‧‧Si基板
11a‧‧‧Si基板的表面
11b‧‧‧Si基板的背面
11c‧‧‧Si基板的側面
12，18，19‧‧‧SiC膜
12a‧‧‧SiC膜的表面
12b‧‧‧SiC膜的背面
12c‧‧‧SiC膜的側面
12d‧‧‧SiC膜的一部分
13‧‧‧凹部
14‧‧‧光罩層
15‧‧‧光阻膜
16‧‧‧Si氧化膜
16a‧‧‧Si氧化膜的表面
16b‧‧‧Si氧化膜的側面
17‧‧‧Si膜
17a‧‧‧Si膜的表面
21‧‧‧AlN膜
21a‧‧‧AlN膜的表面
22‧‧‧GaN膜
22a‧‧‧GaN膜的表面
25‧‧‧石墨烯膜
25a‧‧‧石墨烯膜的表面
31‧‧‧保持部
31a‧‧‧保持部的外周部
31b‧‧‧保持部的突出部
100‧‧‧膠片膜
CS‧‧‧反應容器
HP‧‧‧固定台
MA‧‧‧藥液
MK‧‧‧光罩
PF‧‧‧膠片框
PL‧‧‧對於SiC膜的表面而言為平行的平面
PN‧‧‧圖案
RG1‧‧‧Si基板的背面之中央部
RG2‧‧‧Si基板的凹部之底面
RG3‧‧‧Si基板的背面之外周部
RG4‧‧‧Si基板的背面之所露出的中央部
SP‧‧‧在保持部之外周部與複數之突出部之間的空間
圖1係顯示在本發明之第1實施形態的化合物半導體基板1之構成的剖面圖。
圖2係在本發明之第1實施形態中，顯示對於SiC膜12之表面12a而言，自垂直方向而視情況之化合物半導體基板1之構成的平面圖。
圖3係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的第1工程之剖面圖。
圖4係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的第2工程之剖面圖。
圖5係顯示圖4所示之工程之變形例之第1工程的剖面圖。
圖6係顯示圖4所示之工程之變形例之第2工程的剖面圖。
圖7係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的第3工程之剖面圖。
圖8係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的第4工程之剖面圖。
圖9係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的第5工程之剖面圖。
圖10係模式性地顯示在本發明之第1實施形態的Si之濕蝕刻的第1方法的圖。
圖11係模式性地顯示在本發明之第1實施形態的Si之濕蝕刻的第2方法的圖。
圖12係模式性地顯示在本發明之第1實施形態的Si 之濕蝕刻的第3方法的圖。
圖13係在圖1所示之化合物半導體基板1之A部擴大圖。
圖14係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的變形例之第1工程之剖面圖。
圖15係顯示在本發明之第1實施形態的化合物半導體基板1之製造方法的變形例之第2工程之剖面圖。
圖16係顯示在本發明之第2實施形態的化合物半導體基板1之構成的剖面圖。
圖17係顯示在本發明之第2實施形態的化合物半導體基板1之製造方法的第1工程之剖面圖。
圖18係顯示在本發明之第2實施形態的化合物半導體基板1之製造方法的第2工程之剖面圖。
圖19係在本發明之第2實施形態中，顯示在CVD裝置內保持Si基板11之方法的一例之平面圖。
圖20係顯示在本發明之第3實施形態的化合物半導體基板1a之構成的剖面圖。
圖21係在本發明之第3實施形態中，說明AlN膜21及GaN膜22之成膜條件的一例的圖表。
圖22係顯示在本發明之第4實施形態的化合物半導體基板1b之構成的剖面圖。
圖23係顯示在本發明之第4實施形態的化合物半導體基板1b之製造方法的第1工程之剖面圖。
圖24係顯示在本發明之第4實施形態的化合物半導 體基板1b之製造方法的第2工程之剖面圖。
圖25係顯示在本發明之第5實施形態的化合物半導體基板1c之構成的剖面圖。
圖26係顯示在本發明之第5實施形態的化合物半導體基板1c之製造方法的第1工程之剖面圖。
圖27係顯示在本發明之第5實施形態的化合物半導體基板1c之製造方法的第2工程之剖面圖。
圖28係顯示在本發明之第5實施形態的化合物半導體基板1c之製造方法的第3工程之剖面圖。
圖29係顯示在本發明之第5實施形態的化合物半導體基板1c之製造方法的第4工程之剖面圖。
圖30係顯示在本發明之第5實施形態的化合物半導體基板1c之製造方法的第5工程之剖面圖。
圖31係顯示在本發明之第6實施形態的化合物半導體基板1d之構成的剖面圖。
圖32係顯示在本發明之第6實施形態的化合物半導體基板1d之製造方法的第1工程之剖面圖。
圖33係顯示在本發明之第6實施形態的化合物半導體基板1d之製造方法的第2工程之剖面圖。
圖34係顯示在本發明之第7實施形態的化合物半導體基板1e之構成的剖面圖。
圖35係顯示在本發明之第8實施形態的化合物半導體基板1f之構成的剖面圖。
圖36係顯示在本發明之第8實施形態的化合物半導 體基板1f之製造方法的第1工程之剖面圖。
圖37係顯示在本發明之第8實施形態的化合物半導體基板1f之製造方法的第2工程之剖面圖。
圖38係顯示在本發明之第9實施形態的化合物半導體基板1，1c，或1d之使用方法的剖面圖。
圖39係在本發明之一實施例中，攝影本發明例之旋轉蝕刻中之Si基板的背面之照片。
圖40係在本發明之一實施例中，攝影比較例之濕蝕刻中之Si基板的背面之照片。
以下，依據圖面而說明本發明之實施形態。
〔第1實施形態〕
圖1係顯示在本發明之第1實施形態的化合物半導體基板1之構成的剖面圖。然而，圖1係對於SiC膜12之表面12a而言，在垂直的平面切開情況之剖面圖。
參照圖1，在本實施形態之化合物半導體基板1係具備：Si基板11，和SiC膜12。
Si基板11係具有環狀的平面形狀。Si基板11係包含表面11a，和背面11b，和側面11c。對於Si基板11之表面11a係露出有(111)面。對於Si基板11之表面11a係露出有(100)面或(110)面亦可。
SiC膜12係加以形成於Si基板11之表面11a(Si基板之一方的主面之一例)。SiC膜12係包含表面12a，和背面12b，和側面12c。SiC膜12之背面12b係露出於環狀的Si基板11之內側的凹部13。SiC膜12係未加以形成於Si基板11之背面11b(Si基板之另一方之主面的一例)，而Si基板11之背面11b係露出著。
SiC膜12係具有20nm以上10μm以下之厚度w。厚度w係理想為1μm以下，而更理想為500nm以下。SiC膜12係由單結晶3C-SiC、多結晶3C-SiC、或非晶形SiC等所成。特別是，SiC膜12則為加以磊晶成長於Si基板11之表面之情況，一般而言，SiC膜12係由3C-SiC所成。
圖2係在本發明之第1實施形態中，顯示對於SiC膜12之表面12a而言，自垂直方向而視情況之化合物半導體基板1之構成的平面圖。在圖2中，在顯示Si基板11之形狀的目的，Si基板11係以點線加以顯示，但實際上無法直接看到Si基板11。
參照圖2，各Si基板11、SiC膜12、及凹部13係具有任意的平面形狀。SiC膜12係經由環狀的Si基板11而加以支持其外周端部。經由此，經由Si基板11而加以補強SiC膜12之機械強度。各Si基板11、SiC膜12、及凹部13係如圖2(a)所示地，具有圓的平面形狀亦可，而如圖2(b)所示地，具有矩形之平面形狀亦可。在圖2(b)中，Si基板11係具有四角環狀的平面形 狀。更且，如圖2(c)所示地，各Si基板11及SiC膜12係具有圓的平面形狀，而凹部13係具有矩形之平面形狀亦可。凹部13之尺寸係為任意，而因應化合物半導體基板1所要求之機械強度等而加以決定亦可。
接著，對於本實施形態之化合物半導體基板1之製造方法，使用圖3~圖9加以說明。
參照圖3，例如準備圓板狀之(未加以形成有凹部13)Si基板11。
參照圖4，接著，除去Si基板11之背面11b的中央部RG1的Si。中央部RG1的Si之除去係經由機械性地研削Si基板11之中央部RG1的Si而加以進行亦可。另外，中央部RG1的Si之除去係於除了在Si基板11之背面11b的中央部RG1之範圍，形成光阻膜，再經由將所形成之光阻膜作為光罩而蝕刻中央部RG1的Si而加以進行亦可。
另外，對於提高對於使用於Si之濕蝕刻的藥液而言之光罩的耐性情況，中央部RG1的Si之除去係經由以下的方法而加以進行亦可。
參照圖5，於Si基板11之背面11b全面，形成由矽氧化膜或矽氮化膜所成之光罩層14。接著，於光罩層14上，形成圖案化成必要之形狀的光阻膜15。
參照圖6，接著，將光阻膜15作為光罩，經由濕蝕刻而圖案化光罩層14。經由此，僅殘留光罩層14之外周部。光罩層14則由矽氧化膜所成之情況，作為光 罩層14之濕蝕刻的藥液係加以使用氟酸溶液等。光罩層14則由矽氮化膜所成之情況，作為光罩層14之濕蝕刻的藥液係加以使用磷酸溶液等。接著，將所圖案化之光罩層14作為光罩，使用混酸等之藥液，經由濕蝕刻而除去中央部RG1的Si。之後，除去光阻膜15及光罩層14。然而，光阻膜15係於Si之濕蝕刻之前加以除去亦可。
然而，在圖3所示的工程中，經由準備預先加以形成光罩層14於Si基板11之背面11b的基板之時，省略形成圖5所示之光罩層14的工程亦可。另外，作為光罩層14係加以使用矽氧化膜及矽氧化膜以外的氧化膜或氮化膜亦可。
參照圖7，加以除去中央部RG1的Si之結果，對於Si基板11之背面11b係加以形成有凹部13。在圖7中，凹部13係具有未貫通Si基板11之程度的深度，而凹部13之底面係經由Si而加以構成。經由凹部13之存在，Si基板11之中央部的厚度(圖7中縱方向之長度)係成為較Si基板11之外周部的厚度為薄。
參照圖8，在形成凹部13之後，於Si基板11之表面11a形成SiC膜12。SiC膜12係例如，於由碳化Si基板11之表面11a者所得到之SiC膜所成之基材層上，使用MBE(Molecular Beam Epitaxy)法、或CVD(Chemical Vapor Deposition)法等而加以成膜。另外，SiC膜12係僅經由碳化Si基板11之表面11a而加以形成亦可。更且，SiC膜12係使用MBE法或CVD法等而加 以成膜於Si基板11之表面11a亦可。然而，對於上述之SiC膜12之形成時，亦於Si基板11之側面11c加以形成SiC膜12亦可。
參照圖9，接著，經由濕蝕刻而除去Si基板11之凹部13的底面RG2。底面RG2係構成Si基板之背面11b之一部分。加以除去底面RG2之Si的結果，對於凹部13之底面係露出有SiC膜12之背面12b。另外，對於在此濕蝕刻時，係與底面RG2的Si同時，亦加以除去Si基板11之背面11b之外周部RG3的Si。由採用濕蝕刻者，在除去Si基板時，可抑制對於SiC膜12帶來的損傷。經由以上的工程，圖1所示之化合物半導體基板1則完成。
底面RG2的Si之濕蝕刻係對於使用於濕蝕刻之藥液而言，經由相對性地移動Si基板11及SiC膜12之時而加以進行。對於移動Si基板11及SiC膜12之情況，係包含未改變Si基板11及SiC膜12之位置而使Si基板11及SiC膜12旋轉者，和改變Si基板11及SiC膜12之位置(換言之，使Si基板11及SiC膜12移動)者，和改變Si基板11及SiC膜12之同時，使Si基板11及SiC膜12旋轉者等。作為使用於Si之濕蝕刻的藥液，係使用例如含有氟酸及硝酸的混酸，或氫氧化鈉(KOH)水溶液等。
作為Si之濕蝕刻的藥液，而使用氫氧化鈉水溶液等之鹼性溶液的情況，有著通過以低密度而存在於 SiC膜12中之針孔而亦加以蝕刻至SiC膜12為止之情況。對於抑制加以蝕刻SiC膜12之情況，而為了將SiC膜12的品質作為良好，係作為Si之濕蝕刻的藥液而使用上述之混酸者為佳。
在Si之濕蝕刻時，移動Si基板11及SiC膜12之方向係為任意。但對於為了迴避在移動Si基板11及SiC膜12之間，經由從藥液受到的壓力而SiC膜12產生破損之事態，係如以下之第1~第3方法，對於SiC膜12之表面12a而言為平行之平面(圖10~圖12中之平面PL)內的方向，移動Si基板11及SiC膜12者為佳。
圖10~圖12係模式性地顯示在本發明之第1實施形態的Si之濕蝕刻的第1~第3方法的圖。然而，在圖10~圖12之說明中，將Si之濕蝕刻之前的構造，記述為中間體2。在本實施形態中，歷經圖8的工程之後之構造則相當於中間體2，而在後述之第2實施形態中，歷經圖17的工程之後之構造則相當於中間體2。
參照圖10，第1方法係經由旋轉蝕刻而除去Si之方法。在第1方法中，Si基板11之背面11b則呈朝上地，將中間體2固定於固定台HP。並且，如以箭頭AR1所示地，將延伸存在於與背面11b正交之方向的旋轉軸作為中心，使固定台HP旋轉。由如此作為，在未改變中間體2之位置而使中間體2旋轉之狀態，將使用於濕蝕刻的藥液MA(蝕刻液)注入至Si基板11之背面11b。固定台HP之旋轉數係例如加以設定為500~1500rpm程 度。
參照圖11，在第2方法中，在立起複數之中間體2之狀態而固定於固定台HP。並且，於加以充填於反應容器CS內部之藥液MA，浸漬複數之中間體2，在對於SiC膜12之表面12a而言為平行之平面PL內，如以箭頭AR2所示地，改變中間體2之位置的同時，使中間體2及固定台HP旋轉。
參照圖12，在第3方法中，Si基板11之背面11b則呈朝上地，將中間體2固定於固定台HP。並且，於加以充填於反應容器CS內部之藥液MA，浸漬中間體2，在對於SiC膜12之表面12a而言為平行之平面PL內，如以箭頭AR3所示地，使中間體2及固定台HP，在直線上往返移動。
圖13係在圖1所示之化合物半導體基板1之A部擴大圖。然而，在圖13中，較實際的構成強調顯示Si基板11之寬度的變化量。
參照圖13，含有氟酸及硝酸的混酸係具有等向性地蝕刻Si之作用。因此，對於作為藥液而使用含有氟酸及硝酸的混酸進行Si之濕蝕刻的情況，作為其痕跡，Si基板11之寬度d(圖13中橫方向之長度)係隨著自SiC膜12離開(自SiC膜12朝向Si基板11之背面11b)而減少。
然而，作為本實施形態之製造方法的變形例，如圖14所示地，於Si基板11之表面11a形成SiC 膜12之後，如圖15所示，除去Si基板11之背面11b的中央部RG1之Si而形成凹部13，之後經由濕蝕刻而除去後凹部13之底部RG2亦可。
如根據本實施形態，在Si基板11之濕蝕刻時，對於濕蝕刻的藥液而言，經由相對性地移動Si基板11及SiC膜12之時，可抑制在Si基板11之濕蝕刻中產生有斷裂於SiC膜12，以及自Si基板11剝離有SiC膜12之事態，而可謀求在化合物半導體基板1之SiC膜12的薄膜化者。
本申請發明者們係發現在Si基板11之濕蝕刻中(對於Si基板11的藥液之浸漬中)產生有斷裂於SiC膜12，以及自Si基板11剝離有SiC膜12之原因係因於Si基板11之反應面(與在Si基板11之背面11b之藥液反應之部分的面)，局部性反應後之藥液則滯留，經由此，Si之蝕刻速度則成為不均一，而粗糙產生於Si基板11之反應面之故。另外，本申請發明者係對於作為濕蝕刻之藥液而使用混酸的情況，係發現經由藥液與Si之反應而產生大的泡則局部性滯留於Si基板11之反應面，而此泡則局部性地妨礙與Si基板11之反應面之藥液的反應，而粗糙產生於Si基板11之反應面。
對於SiC膜12為比較厚之情況(例如，厚度則較10μm為大之情況)，係SiC膜12本身的機械強度為高之故，Si基板11之反應面的粗糙係對於SiC膜12而言未帶來那麼不良影響。但對於SiC膜12為比較薄之情 況(例如，厚度則10μm以下之情況，具體而言係為薄膜(厚度為數μm程度)之情況或極薄膜(厚度為100nm等級以下)之情況，Si基板11之反應面的粗糙係對於SiC膜12而言帶來不良影響。即，經由Si基板11之反應面的粗糙而加上不均一的應力於SiC膜12，招致在Si蝕刻中產生斷裂於SiC膜12，以及SiC膜12則自Si基板11剝離之事態。
因此，在本實施形態中，在Si基板11之濕蝕刻時，對於濕蝕刻之藥液而言，經由相對性移動Si基板11及SiC膜12之時，可抑制反應後之藥液或泡局部性地滯留於Si基板11之反應面，而抑制Si基板11之反應面的粗糙者。其結果，可抑制不均一的應力加上於SiC膜12，而謀求SiC膜12之薄膜化者。
特別是，對於作為Si之濕蝕刻的方法，而採用經由旋轉蝕刻而除去Si之方法(圖10所示之第1方法)的情況，在濕蝕刻中，SiC膜12加以暴露於藥液之情況係僅露出有SiC膜12之背面12b於凹部13之底部之間。另外，在濕蝕刻中，SiC膜12的表面12a係未加以暴露於藥液者。因此，可將經由藥液之SiC膜12的損傷控制在最小限度者。
另外，經由作為Si之濕蝕刻的藥液而使用混酸之時，可抑制經由藥液之SiC膜12的損傷者。其結果，可提升SiC膜12的產率，可以大面積而形成SiC膜。
〔第2實施形態〕
圖16係顯示在本發明之第2實施形態的化合物半導體基板1之構成的剖面圖。然而，圖16係對於SiC膜12之表面12a而言，在垂直的平面切開情況之剖面圖。
參照圖16，在本實施形態之化合物半導體基板1中，SiC膜12係加以形成於Si基板11的表面11a、側面11c、及背面11b的外周部。Si基板11的表面11a、側面11c、及背面11b的外周部係經由連續之SiC膜12而被完全地被覆。對於凹部13的底部係露出有SiC膜12之背面12b。SiC膜12之厚度係在背面11b之外周部的端部中減少。加以形成於Si基板的表面11a之SiC膜12的部分係具有20nm以上10μm以下之厚度w。厚度w係理想為1μm以下，而更理想為500nm以下。
接著，對於本實施形態之化合物半導體基板1之製造方法，使用圖17及圖18加以說明。
參照圖17，對於圖3所示之Si基板11而言，使用CVD法而形成SiC膜12。對於在形成SiC膜12時，加以供給至Si基板11之表面11a的原料氣體之一部分則亦成繞入於Si基板11之側面11c及背面11b地，保持Si基板11。經由此，原料氣體的化學反應則亦在Si基板11的表面11a、側面11c、及背面11b之外周部引起，而於Si基板11的表面11a、側面11c、及背面11b之外 周部，加以形成連續之SiC膜12。其結果，得到在本實施形態之中間體2。
參照圖18，接著，將加以形成於Si基板11之背面11b的外周部之SiC膜12作為光罩，經由濕蝕刻而除去Si基板11之背面11b之所露出的中央部RG4。加以除去中央部RG4之Si的結果，對於Si基板11之背面11b係加以形成凹部13。對於凹部13的底面係露出有SiC膜12之背面12b。然而，對於在此濕蝕刻時，未加以除去在Si基板11之背面11b中，由SiC膜12所被覆之外周部的Si。經由以上的工程，圖16所示之化合物半導體基板1則完成。
在圖17所示之工程(使用CVD法而形成SiC膜12之工程)中，在CVD裝置內，Si基板11係由以下的方法而加以保持者為佳。
圖19係在本發明之第2實施形態中，顯示在CVD裝置內保持Si基板11之方法的一例之平面圖。
參照圖19，CVD裝置係包含為了保持Si基板11之保持部31。保持部31係含有：環狀的外周部31a，和以等間隔而加以設置於外周部31a之內周側端部的複數(在此係3個)之突出部31b。各複數之突出部31b係為直線狀，朝向於外周部31a之中心而突出。Si基板11係表面11a則呈朝上方地加以載置於各複數之突出部31b的前端上。反應氣體係在Si基板11的表面11a上，加以流動於以箭頭AR4所示之方向。反應氣體的一 部分係通過外周部31a與複數之突出部31b之間的空間SP而繞入至Si基板11之側面11c及背面11b。其結果，於Si基板11的表面11a、側面11c、及背面11b的外周部，加以形成連續之SiC膜12。
然而，上述以外之化合物半導體基板1的構成及製造方法係與在第1實施形態之化合物半導體基板的構成及製造方法同樣。隨之，不重覆此等之說明。
如根據本實施形態，可得到與第1實施形態同樣的效果。加上因可將繞入至Si基板11之背面11b而加以形成之SiC膜12作為光罩，而濕蝕刻Si基板11之故，成為無須以形成SiC膜12之工程與另外工程，形成凹部於Si基板11，以及以光微影法而形成圖案。其結果，可以簡易的方法而製造化合物半導體基板1，進而可在短期間及低成本而製造化合物半導體基板1者。
〔第3實施形態〕
圖20係顯示在本發明之第3實施形態的化合物半導體基板1a之構成的剖面圖。然而，圖20係對於GaN膜22之表面22a而言，在垂直的平面切開情況之剖面圖。
參照圖20，在本實施形態之化合物半導體基板1a係具備：AlN膜21，和GaN膜22。
AlN膜21係加以形成於SiC膜12之表面12a(SiC膜之一方的主面之一例)。AlN膜21係為了改善 SiC膜12與GaN膜22之潤濕性的緩衝層。AlN膜21係例如，具有5nm以上15nm以下之厚度，而理想係具有5nm以上9nm以下之厚度，更理想係具有7nm以上9nm以下之厚度。
GaN膜22係加以形成於AlN膜21的表面21a。GaN膜22係理想具有1500nm以上3000nm以下之厚度，而更理想為具有1500nm以上2500nm以下之厚度。GaN膜22係具有p型或n型之導電型亦可，而於GaN膜22之至少一部分，加以摻雜C或Fe亦可。
然而，上述以外之化合物半導體基板1a的構成係因與圖1及圖2所示之第1實施形態的化合物半導體基板1之構成同樣之故，對於同一構件係附上同一符號，而未重複其說明。
接著，對於本實施形態之化合物半導體基板1a之製造方法加以說明。
首先，使用與在第1實施形態之製造方法同樣的製造方法，得到圖1所示之化合物半導體基板1。作為一例，化合物半導體基板1係包含：外徑100mm、內徑80mm之環狀的Si基板11，和加以形成於Si基板11上之160nm厚度之SiC膜12。
接著，於SiC膜12之表面12a，藉由極薄的AlN膜21而形成GaN膜22。在此，對於使用MOCVD(Metal OrganicChemical Vapor Deposition)法，而於SiC膜12之表面12a，依序使AlN膜21及GaN膜22異 質磊晶成長之情況，加以說明。
圖21係在本發明之第3實施形態中，說明AlN膜21及GaN膜22之成膜條件的一例的圖表。
參照圖21，AlN膜21係在使用TMA(三甲基鋁：Al(CH3)3)之清洗之後，例如，以1000~1300℃(在圖21中係1200℃)程度之溫度，例如以1~60分程度的時間加以形成。作為Al之原料氣體係例如，加以使用TMA，而作為N的原料氣體係例如，加以使用氨(NH3)。
GaN膜22係在AlN膜21之形成後，例如以900~1200℃(在圖21中係1080℃)程度之溫度，例如以5~200分程度的時間而加以形成。作為Ga之原料氣體係例如，加以使用TMG(三甲基鎵：Ga(CH3)3)，而作為N的原料氣體係例如，加以使用氨。經由以上的工程，得到圖20所示之化合物半導體基板1a。
在化合物半導體基板1a中，於GaN膜22之形成後(化合物半導體基板1a之完成後)，使用氟硝酸等而完全地加以除去Si基板11亦可。另外，因應必要，而於AlN膜21與GaN膜22之間，加以設置傾斜層(例如，Al的組成比則自AlN膜21朝向於GaN膜22而徐緩漸少之AlGaN膜)亦可。另外，於GaN膜22中，加以設置中間層(例如，Al膜或AlGaN膜所成)亦可。
一般而言，對於直接形成GaN膜於Si基板上之情況，係經由Si與GaN之間的物性(晶格常數及熱膨 脹係數)之不同，而產生有大的彎曲或斷裂。為了迴避如此之事態，在以往中，於Si基板與GaN膜之間加以形成複雜且厚的緩衝膜。
如根據本實施形態，加以除去SiC膜12之下側的一部分的Si之故，Si與GaN之間的物性之不同則對於GaN帶來之不良影響係變小。另外，SiC與GaN之間的物性的差係比較於Si與GaN之間的物性的差為小，而SiC的厚度係較Si的厚度為小。因此，基材之SiC膜12則對於GaN膜22帶來之不良影響為小。其結果，僅由設置簡易之緩衝層(AlN膜21)，可得到錯位少，且彎曲．斷裂亦為少之高品質之GaN膜22。
另外，經由將GaN膜22加厚成膜至數百μm之等級之時，得到GaN之自立基板亦可。對於此情況，含於GaN膜22之缺陷係變為非常少。對於將GaN膜22加厚成膜至數百μm之等級之情況，係經由使用成長速度快之H-VPE(Hydride Vapor Phase Epitaxy)法之時，縮短GaN膜22之成長時間亦可。另外，加以組合MOCVD法與H-VPE法亦可。
另外，對於在功率裝置或高頻率裝置等之用途而使用化合物半導體基板1a之情況，係在化合物半導體基板1a之完成後，於GaN膜22的表面22a，加以形成HEMT(High Electron Mobility Transistor)層等之裝置層(具體而言，裝置層係包含AlGaN阻障層、AlN間隔層、及GaN蓋層等)亦可。
對於在功率裝置或高頻率裝置等之用途而使用化合物半導體基板1a之情況，係加以除去SiC膜12之下側的一部分之Si之故，對於熱傳導率高之絕緣性陶瓷(AlN等)所成之散熱板而言，可直接貼上SiC膜12者。其結果，可提升熱的散發性，而成為可實現處理高功率之裝置者。
更且，在LED(Light EmittingDiode)等之發光裝置之用途而使用化合物半導體基板1a之情況，係在化合物半導體基板1a之完成後，於GaN膜22的表面22a，加以設置含有InGaN層與GaN層之反覆構造等之MQW層(量子阱層)，或p型GaN層(Mg摻雜GaN層)等之裝置層亦可。
在發光裝置之用途而使用化合物半導體基板1a之情況，係加以除去SiC膜12之下側的一部分之Si之故，而可迴避經由Si之可視光的吸收者。其結果，可自SiC膜12的背面取出光，而成為可實現高亮度發光裝置者。
〔第4實施形態〕
圖22係顯示在本發明之第4實施形態的化合物半導體基板1b之構成的剖面圖。然而，圖22係對於石墨烯膜25之表面25a而言，在垂直的平面切開情況之剖面圖。
參照圖22，在本實施形態之化合物半導體基板1b係更具備：石墨烯膜25。
石墨烯膜25係加以形成於SiC膜12之表面12a(SiC膜之一方的主面之一例)。石墨烯膜25係亦可由單層之石墨烯膜所成，而由加以層積之多層的石墨烯膜(也就是，石墨膜)所成亦可。石墨烯膜25係例如具有0.3nm以上1μm以下之厚度。
然而，上述以外之化合物半導體基板1b的構成係因與圖1及圖2所示之第1實施形態的化合物半導體基板1之構成同樣之故，對於同一構件係附上同一符號，而未重複其說明。
接著，對於本實施形態之化合物半導體基板1b之製造方法加以說明。
首先，使用與在第1實施形態之製造方法同樣的製造方法，得到圖8所示之構造。作為一例，圖8所示之構造係包含：外徑100mm、內徑80mm之外緣的Si基板11，和加以形成於Si基板11上之50nm厚度之SiC膜12。
參照圖23，接著，將圖8所示之構造，設置於加熱爐等之容器內，例如以H2環境，對於化合物半導體基板1而言，以1200℃的溫度進行1小時的熱處理(退火)。經由此，加以分解構成接近於在SiC膜12之表面12a的部分12d(以點線圍繞之部分)之Si原子與C原子之結合，而Si原子則產生脫離。其結果，僅SiC膜 12之上側的部分12d之SiC則變化為石墨烯膜25。
取代使SiC膜12之一部分變化為石墨烯膜25，而由以下的方法，層積石墨烯膜25於SiC膜12之表面12a而形成亦可。具體而言，將分散石墨烯的溶媒，以旋塗法或噴塗等之方法而塗佈於SiC膜12之表面12a。對於使用旋塗法之方法的情況，圖8所示之構造則SiC膜的表面12a則呈朝上方地加以固定於固定台HP(圖10)，加以旋轉固定台HP。作為使石墨烯分散的溶媒，係例如可使用MEK(丁酮)(高分子系界面活性劑)[GF9MEK-DS](INCUBATION ALLIANCE公司製)等之石墨烯．粉末分散液者。在塗佈分散石墨烯之溶媒之後，例如以400℃進行20分鐘熱處理。經由此，溶媒產生蒸發，而加以燒固之石墨烯膜25則層積於SiC膜12上而加以形成。在此方法中，SiC膜12係未被石墨烯化。
參照圖24，接著，經由濕蝕刻而除去Si基板11之凹部13的底面RG2、及Si基板11之背面11b的外周部RG3之Si。其結果，對於凹部13的底面係露出有SiC膜12之背面12b。經由以上的工程，得到圖22所示之化合物半導體基板1b。
作為本實施形態之代替的製造方法，在除去Si基板11之凹部13的底面RG2之後，使SiC膜12之一部分變化為石墨烯膜25亦可。對於此情況，自SiC膜12之表面12a及背面12b之雙方，Si原子則產生脫離之故，石墨烯膜25係加以形成於SiC膜12之表面12a及背面 12b之雙方。另外，在除去Si基板11之凹部13的底面RG2之後，於SiC膜12之表面12a，形成(層積)石墨烯膜25亦可。
然而，在化合物半導體基板1b中，於石墨烯膜25之形成後(化合物半導體基板1b之完成後)，使用氟硝酸等而完全地加以除去Si基板11亦可。
如根據本實施形態，經由將第1實施形態之化合物半導體基板1之薄的SiC膜12作為原料之時，可得到薄的石墨烯膜25。石墨烯係對於機械強度或熱特性優越之故，對於將化合物半導體基板1b作為膠片膜而使用之情況等，石墨烯膜25係達成保護SiC膜12之作用。特別是，石墨烯係具有負的熱膨脹係數。因此，對於將化合物半導體基板1b作為膠片膜而使用之情況，係即使經由EUV照射而膠片膜的溫度產生上升，亦可迴避產生彎曲於膠片膜之事態者。
〔第5實施形態〕
圖25係顯示在本發明之第5實施形態的化合物半導體基板1c之構成的剖面圖。然而，圖25係對於SiC膜12之表面12a而言，在垂直的平面切開情況之剖面圖。
參照圖25，在本實施形態之化合物半導體基板1c係在更具備Si氧化膜16的點中，與第1實施形態之化合物半導體基板1不同。Si氧化膜16係加以形成於 Si基板11之表面11a，具有與Si基板11同樣的平面形狀。SiC膜12係加以形成於Si氧化膜16之表面16a(Si基板11的表面11a側)。
Si氧化膜16係由PSG(Phosphorus SilicateGlass)、BPSG(Boron Phosphorus Silicate Glass)、或SiO2等所成，例如具有100nm以上2000nm以下之厚度。
接著，對於本實施形態之化合物半導體基板1c之製造方法，使用圖26~圖30加以說明。
參照圖26，例如準備圓板狀之(未加以形成有凹部13)SOI(Silicon on Insulator)基板。SOI基板係包含：Si基板11，和加以形成於Si基板11之表面11a的SiO2所成之Si氧化膜16，和加以形成於Si氧化膜16之表面16a的Si膜17。在之後的碳化工程中，為了未使Si膜17殘存而形成SiC膜18，Si膜17係具有4nm以上10nm以下之厚度者為佳。
Si膜17之厚度則呈成為上述範圍地，Si膜17係加以薄膜化亦可。Si膜17之薄膜化係經由例如以氧化環境而加熱處理SOI基板而氧化Si膜17之表面17a，接著，由以濕蝕刻而除去形成於Si膜17之表面17a的氧化物者而加以進行亦可。
參照圖27，因應必要，自Si膜17之表面17a，對於Si氧化膜16而言，導入P(磷)，或B(硼)及P的離子亦可。經由此，Si氧化膜16之組成係自未含 有B或P之SiO2、變換成PSG或BPSG。然而，省略上述的離子之導入，由未含有B或P之SiO2而形成Si氧化膜16亦可。
形成PSG所成之Si氧化膜16之情況，P離子之導入量係1×1015個/cm2以上5×1018個/cm2以下，而Si氧化膜16中的P原子之摻雜量係5原子%以上7原子%以下者為佳。經由此，抑制Si氧化膜16之吸濕性的增加之同時，可充分使Si氧化膜16軟化者。另外，P離子之導入時的基板溫度係200℃以上550℃以下者為佳。經由此，可抑制Si膜17之結晶性的降低者。更且，P離子之加速能量係5keV以上30keV以下者為佳。經由此，可維持之後所形成之SiC膜18之結晶性及適當地膜厚者。
參照圖28，接著，經由在碳化氫氣體環境中，加熱Si膜17之時，碳化Si膜17。其結果，Si膜17係變化為SiC膜18。環境中的溫度係900℃~1405℃者為佳。碳化氫氣體係丙烷氣體，更且作為載氣而加以使用氫氣者為佳。丙烷氣體的流量係例如10sccm，而氫氣的流量係例如1000sccm。
對於在Si膜17之碳化後加以冷卻基板時，因SiC膜18與Si基板11之收縮率的差引起之拉伸應力則產生於SiC膜18內。但，經由使比較柔軟之材料的Si氧化膜16介入存在之時，可緩和SiC膜18內部之拉伸應力。
然而，未加以完全地碳化Si膜17，而其一部 分則加以殘留於與Si氧化膜16之界面附近亦可。此情況，經由介入存在於Si氧化膜16與SiC膜18之間的Si膜17之時，可提升Si氧化膜16與SiC膜18之界面的平坦性者。無關於是否加以完全地碳化Si膜17，而SiC膜18係加以形成於Si氧化膜16之表面16a側。
參照圖29，接著，將SiC膜18作為基材膜，經由磊晶成長而形成SiC膜19。經由此，得到SiC膜18及19所成之SiC膜12。
SiC膜19之磊晶成長係例如，經由將甲矽烷系氣體所成之原料氣體，以約1.0sccm程度之流量進行供給之同時，將形成有SiC膜18之基板加熱至900℃以上1405℃以下的溫度而加以進行。
對於在SiC膜19之磊晶成長後加以冷卻基板時，因SiC膜12與Si基板11之收縮率的差引起之拉伸應力則產生於SiC膜12內。但，經由使比較柔軟之材料的Si氧化膜16介入存在之時，可緩和SiC膜12內部之拉伸應力。
然而，未進行SiC膜19之磊晶成長，而僅經由Si膜17之碳化而加以形成SiC膜12亦可。
參照圖30，接著，以與第1實施形態同樣的方法，除去Si基板11之背面11b的中央部RG1之Si而形成凹部13。對於在凹部13之形成時，加以完全地除去中央部RG1的Si，以到達至Si氧化膜16之深度，加以形成凹部13亦可。經由此而得到中間體2。
之後，以與第1實施形態同樣的方法，經由濕蝕刻而除去凹部13的底部RG2之Si基板11及Si氧化膜16(對於凹部13的底部RG2之Si基板11則在凹部13之形成時，加以完全地除去情況、凹部13的底部RG2之Si酸化膜16)，及Si基板11之背面11b的外周部RG3之Si，而使SiC膜12之背面12b露出。一般而言，使用於Si之濕蝕刻的藥液(混酸等)係具有溶解Si氧化膜之性質之故，而Si氧化膜16係可以與第1實施形態之Si之濕蝕刻同樣的方法而除去者。經由以上的工程，得到圖25所示之化合物半導體基板1c。
然而，上述以外之化合物半導體基板1c的構成及製造方法係與在第1實施形態之化合物半導體基板1的構成及製造方法同樣。隨之，對於同一之構件係附上同一符號，而不重覆此等之說明。
如根據本實施形態，可得到與第1實施形態同樣的效果。加上，經由使Si氧化膜16介入存在於Si基板11與SiC膜12之間之時，可緩和SiC膜12內部之拉伸應力。其結果，可抑制製造時之SiC膜12的破損，而提升SiC膜12之製造產率。
然而，作為本實施形態之變形例，與第1實施形態之圖4~圖8所示之方法同樣地，在除去Si基板11之背面11b的中央部RG1之Si而形成凹部13之後，形成SiC膜12亦可。
另外，取代使用SOI基板，而經由於Si基板 11的表面11a形成Si氧化膜16，再於Si氧化膜16之表面16a形成SiC膜12之時，加以做成圖29之構造亦可。此情況，SiC膜12係使用MBE法或CVD法等而加以成膜於Si氧化膜16之表面16a亦可。
〔第6實施形態〕
圖31係顯示在本發明之第6實施形態的化合物半導體基板1d之構成的剖面圖。然而，圖31係對於SiC膜12之表面12a而言，在垂直的平面切開情況之剖面圖。
參照圖31，在本實施形態之化合物半導體基板1d係在更具備Si氧化膜16的點中，與第2實施形態之化合物半導體基板1不同。Si氧化膜16係加以形成於Si基板11之表面11a，具有與Si基板11同樣的平面形狀。SiC膜12係加以形成於Si氧化膜16之表面16a(Si基板11的表面11a側)。SiC膜12係加以形成於Si氧化膜16之表面16a及側面16b，和Si基板11的側面11c及背面11b之外周部。Si氧化膜16之表面16a及側面16b、及Si基板11的側面11c及背面11b之外周部係經由連續之SiC膜12而被完全地被覆。對於Si基板11的中央部及Si酸化膜16的中央部係加以形成有凹部13，對於凹部13的底部係露出有SiC膜12之背面12b。
Si氧化膜16係由PSG、BPSG、或SiO2等所成，例如具有100nm以上2000nm以下之厚度。
接著，對於本實施形態之化合物半導體基板1d之製造方法，使用圖32及圖33加以說明。
參照圖32，使用與第5實施形態之製造方法同樣之製造方法，得到圖28所示之構造(形成SiC膜18之構造)。接著，將SiC膜18作為基材膜而使SiC磊晶成長，形成SiC膜19。經由此，於Si氧化膜16的表面16a，加以形成SiC膜18及19所成之SiC膜12。
在形成SiC膜19時，與第2實施形態之情況同樣地，加以供給至Si基板11的表面11a之原料氣體的一部分則亦呈繞入至Si氧化膜16的側面16b，和Si基板11的側面11c，和Si基板11的背面11b地，保持Si基板11。經由此，原料氣體之化學反應則在SiC膜18的表面引起之同時，亦在Si氧化膜16的側面16b，和Si基板11的側面11c及背面11b之外周部引起，而於Si氧化膜16的表面16a及側面16b，和Si基板11的側面11c及背面11b之外周部，加以形成連續之SiC膜19。其結果，得到在本實施形態之中間體2。
參照圖33，接著，以與第2實施形態同樣的方法，將形成於Si基板11的背面11b之外周部的SiC膜12作為光罩，自Si基板11的背面11b所露出之部分，經由濕蝕刻而除去Si基板11及Si酸化膜16的中央部RG4。加以除去中央部RG4之Si及Si氧化膜的結果，對於Si基板之背面11b係加以形成凹部13。對於凹部13的底面係露出有SiC膜12之背面12b。然而，對於此濕蝕 刻時，係平面而視，由SiC膜12所被覆之部分的Si基板11及SiC膜12的外周部係未被除去。經由以上的工程，圖31所示之化合物半導體基板1則完成。
然而，上述以外之化合物半導體基板1d的構成及製造方法係與在第2實施形態之化合物半導體基板1的構成及製造方法同樣。隨之，對於同一之構件係附上同一符號，而不重覆此等之說明。
如根據本實施形態，可得到與第2實施形態同樣的效果。加上，經由使Si氧化膜16介入存在於Si基板11與SiC膜12之間之時，可緩和SiC膜12內部之拉伸應力。其結果，可抑制製造時之SiC膜12的破損，而提升SiC膜12之製造產率。
〔第7實施形態〕
圖34係顯示在本發明之第7實施形態的化合物半導體基板1e之構成的剖面圖。然而，圖34係對於GaN膜22之表面22a而言，在垂直的平面切開情況之剖面圖。
參照圖34，在本實施形態之化合物半導體基板1e係在更具備Si氧化膜16的點中，與第3實施形態之化合物半導體基板1a不同。Si氧化膜16係加以形成於Si基板11之表面11a，具有與Si基板11同樣的平面形狀。SiC膜12係加以形成於Si氧化膜16之表面16a(Si基板11的表面11a側)。
Si氧化膜16係由PSG、BPSG、或SiO2等所成，例如具有100nm以上2000nm以下之厚度。
接著，對於本實施形態之化合物半導體基板1e之製造方法加以說明。
首先，使用與在第5實施形態之製造方法同樣的製造方法，得到圖25所示之化合物半導體基板1c。接著，使用與在第3實施形態之製造方法同樣的製造方法，將AlN膜21及GaN膜22，依此順序而層積於SiC膜12的表面12a加以形成。經由以上的工程，得到化合物半導體基板1e。
然而，上述以外之化合物半導體基板1e的構成及製造方法係與在第3實施形態之化合物半導體基板1a的構成及製造方法同樣。隨之，對於同一之構件係附上同一符號，而不重覆此等之說明。
如根據本實施形態，可得到與第3實施形態同樣的效果。加上，經由使Si氧化膜16介入存在於Si基板11與SiC膜12之間之時，可緩和SiC膜12內部之拉伸應力。其結果，可抑制製造時之SiC膜12的破損，而提升SiC膜12之製造產率。
〔第8實施形態〕
圖35係顯示在本發明之第8實施形態的化合物半導體基板1f之構成的剖面圖。然而，圖35係對於石墨烯膜25之表面25a而言，在垂直的平面切開情況之剖 面圖。
參照圖35，在本實施形態之化合物半導體基板1f係在更具備Si氧化膜16的點中，與第4實施形態之化合物半導體基板1b不同。Si氧化膜16係加以形成於Si基板11之表面11a，具有與Si基板11同樣的平面形狀。SiC膜12係加以形成於Si氧化膜16之表面16a(Si基板11的表面11a側)。
Si氧化膜16係由PSG、BPSG、或SiO2等所成，例如具有100nm以上2000nm以下之厚度。
接著，對於本實施形態之化合物半導體基板1f之製造方法，使用圖36及圖37加以說明。
參照圖36，首先，使用與在第5實施形態之製造方法同樣的製造方法，生成圖29所示之構造，除去Si基板11之背面11b的中央部RG1之Si而形成凹部13。
接著，使用與第4實施形態同樣的方法，使SiC膜12之上側的部分12d的SiC，變換成石墨烯膜25。經由此而得到中間體2。
然而，取代使SiC膜12之一部分變化為石墨烯膜25，而由以旋塗法或噴塗等之方法，將使石墨烯分散的溶媒塗佈於SiC膜12的表面12a，進行熱處理者，將石墨烯膜25形成於SiC膜12上亦可。
參照圖37，接著，以與第4實施形態同樣的方法，經由濕蝕刻而除去凹部13的底部RG2之Si及 SiC，和Si基板11的背面11b的外周部RG3之Si，使SiC膜12的背面12b露出。經由以上的工程，得到圖35所示之化合物半導體基板1f。
然而，上述以外之化合物半導體基板1f的構成及製造方法係與在第4實施形態之化合物半導體基板1b的構成及製造方法同樣。隨之，對於同一之構件係附上同一符號，而不重覆此等之說明。
如根據本實施形態，可得到與第4實施形態同樣的效果。加上，經由使Si氧化膜16介入存在於Si基板11與SiC膜12之間之時，可緩和SiC膜12內部之拉伸應力。其結果，可抑制製造時之SiC膜12的破損，而提升SiC膜12之製造產率。
〔第9實施形態〕
圖38係顯示在本發明之第9實施形態的化合物半導體基板1，1c，或1d之使用方法的一例之剖面圖。
參照圖38，在本實施形態中，第1，第2，第5，或第6實施形態之化合物半導體基板1、1c、或1d則作為被覆光罩MK之膠片膜100而加以使用。對於光罩MK的表面，係加以設置有為了將曝光光進行遮光的圖案PN，和為了支持膠片膜100之膠片框PF。膠片膜100係在將光罩MK側作為Si基板11，而將與光罩MK側相反側作為SiC膜12之狀態，對於膠片框PF而言，經由接著 等而加以固定。化合物半導體基板1係因應必要，配合光罩MK或膠片框PF之形狀而加以加工亦可。
然而，亦可將第4或第8實施形態之化合物半導體基板1b或1f作為膠片膜100而使用。此情況，膠片膜100係在將光罩MK側作為Si基板11，而將與光罩MK相反側作為石墨烯膜25之狀態，對於膠片框PF而言，經由接著等而加以固定。
膠片膜100係為了防止曝光時附著於光罩MK之異物則經由在曝光對象物(半導體基板等)上連結焦點之曝光干擾之構成。曝光光係如由箭頭AR5所示地，透過膠片膜100而進入至光罩MK表面。通過圖案PN之間隙之一部分的曝光光係在光罩MK的表面進行反射，透過膠片膜100。之後，曝光光係加以照射於塗佈在曝光對象物表面之光阻膜(無圖示)。
作為曝光光係可使用任意之波長的構成者，但對於為了實現高解像度之光微影技術，係作為曝光光，加以使用具有數10nm~數nm之波長的EUV(Extreme Ultra-Violet)光者為佳。SiC或石墨烯係比較於Si而為化學性安定，而對於EUV光而言具有高透過率及高耐光性之故，作為曝光光而使用EUV光之情況的膠片膜為最佳。特別是如第1或第2實施形態之化合物半導體基板1，經由將含有20nm以上10μm以下非常薄的SiC膜12之化合物半導體基板1，作為膠片膜100而使用之時，可更一層實現高透過率者。
〔實施例〕
本申請發明者係以以下說明之本發明例1及2，以及比較例之各方法而嘗試化合物半導體基板之製造。
本發明例1：準備具有4英吋直徑及525μm厚度，表面則以(100)面加以構成之Si基板。接著在以圖19所示之方法而保持Si基板之狀態，使用CVD法，於Si基板的表面，形成160nm之厚度的SiC膜。SiC膜係由3C-SiC單結晶所成，表面則以(100)面加以構成。另外，於Si基板的側面，和自Si基板的背面之外周端部1cm以內的範圍，亦加以形成SiC膜。
接著，經由旋轉蝕刻而除去Si基板之一部分。具體而言，以1000rpm的速度而旋轉Si基板，注入藥液。作為藥液，使用日本三菱化學股份有限公司製之「Si-E」的混酸。然而，以此旋轉蝕刻的條件，事前進行虛擬之Si基板的蝕刻時，得到25μm/min之蝕刻速度。在旋轉蝕刻中觀察Si基板時，如圖39所示，加以抑制泡的成長及滯留，而可看見非常平滑的反應面。Si之蝕刻係加以推測為均一地進行者。
進行21分鐘上述之旋轉蝕刻之後，取代藥液而將純水注入至Si基板，清洗Si基板。Si基板之清洗係進行1分鐘。經由此，得到化合物半導體基板。
觀察所得到之化合物半導體基板時，對於Si 基板的表面、側面、及背面的外周部係加以形成環狀的SiC膜。在Si基板的背面中，自具有環狀之SiC膜之內側的約8cm直徑之圓狀的凹部內係完全地加以除去Si，而對於凹部之底部係露出有自立之SiC膜。使用X線進行觀察時，加以確認到SiC膜為單結晶者。其結果，加以得到具備自立(以SiC單獨加以構成)之大面積的SiC膜之化合物半導體基板。
本發明例2：將SiC膜之厚度，並非160nm而作成50nm的點以外，係由和本發明例1同樣的製造方法而製作化合物半導體基板。
觀察所得到之化合物半導體基板時，對於Si基板的表面、側面、及背面的外周部係加以形成環狀的SiC膜。在Si基板的背面中，自具有環狀之SiC膜之內側的約8cm直徑之圓狀的凹部內係完全地加以除去Si，而對於凹部之底部係露出有自立之SiC膜。使用X線進行觀察時，加以確認到SiC膜為單結晶者。其結果，加以得到具備自立(以SiC單獨加以構成)之大面積的SiC膜之化合物半導體基板。
比較例：以與本發明例同樣的方法，準備Si基板，而於Si基板的表面形成SiC膜。接著，經由於充填於容器內之藥液，浸漬Si基板及SiC膜之時，經由濕蝕刻而除去Si基板的一部分。作為藥液係使用與本發明例之情況同樣的構成。在濕蝕刻中觀察Si基板時，如圖40所示，可看到在Si基板之反應面的泡的成長及滯留。 Si之蝕刻則加以推測為不均一地進行者。
進行5分鐘對於上述藥液之浸漬之後，自藥液取出Si基板及SiC膜，接著以純水進行10分鐘洗淨。經由此，得到化合物半導體基板。
觀察所得到之化合物半導體基板時，對於Si基板的表面、側面、及背面的外周部係加以形成環狀的SiC膜。在Si基板的背面中，對於環狀之SiC膜的內側的凹部內係部分地殘存有Si。另外，對於凹部內係有SiC膜產生破損處。自立之SiC膜係僅在最大直徑為2mm程度的範圍而加以得到。
〔其他〕
在上述之實施形態中，對於經由濕蝕刻而加以除去凹部13的底面之Si之情況而顯示過，但在本發明中，經由濕蝕刻而加以除去的部分係如為Si基板之另一方的主面之至少一部分即可，而所除去的部分之位置，尺寸，及形狀係為任意。
在上述之實施形態中，對於形成GaN膜22或石墨烯膜25於SiC膜12的表面之情況而顯示過，但於SiC膜的表面形成其他的膜之情況，其膜係如為與SiC不同的膜即可。
上述之實施形態係可相互做組合者。例如，經由組合第2實施形態與第3實施形態之時，對於經由連續之SiC膜12而完全地加以被覆Si基板11的表面11a、 側面11c、及背面11b之外周部的化合物半導體基板1而言，加以形成GaN膜22亦可。
另外，經由組合第2實施形態與第4實施形態之時，對於經由連續之SiC膜12而完全地加以被覆Si基板11的表面11a、側面11c、及背面11b之外周部的化合物半導體基板1而言，加以形成石墨烯膜25亦可。對於此情況，在圖17所示之工程之後，SiC膜12之一部分則加以變化為石墨烯膜25(或加以層積石墨烯膜25於SiC膜12的表面12a)，之後加以實施圖18所示之工程。
另外，加以組合圖14及圖15所示之第1實施形態的製造方法之變形例與第4實施形態亦可。對於此情況，在圖14所示之工程之後，SiC膜12之一部分則加以變化為石墨烯膜25(或加以層積石墨烯膜25於SiC膜12的表面12a)，之後加以實施圖15所示之工程。
上述之實施形態及實施例係應認為例示在所有的點，並非限制性的構成。本發明之範圍係並非上述之說明，而經由申請專利範圍所示，特意包含有與申請專利範圍均等意思及在範圍內之所有的變更者。
1‧‧‧化合物半導體基板
11‧‧‧Si基板
11a‧‧‧Si基板的表面
11b‧‧‧Si基板的背面
11c‧‧‧Si基板的側面
12‧‧‧SiC膜
12a‧‧‧SiC膜的表面
12b‧‧‧SiC膜的背面
12c‧‧‧SiC膜的側面
13‧‧‧凹部
w‧‧‧厚度

Claims (21)

  1. 一種化合物半導體基板，其特徵為具備：環狀的具有平面形狀之Si基板，和加以形成於前述Si基板之一方的主面側之具有20nm以上50nm以下厚度之SiC膜；前述SiC膜係未加以形成於前述Si基板之另一方的主面。
  2. 如申請專利範圍第1項記載之化合物半導體基板，其中，在對於前述SiC膜之表面而言以垂直的平面切開之剖面而視的情況，前述Si基板之寬度係隨著自前述SiC膜離開而減少。
  3. 如申請專利範圍第1項記載之化合物半導體基板，其中，更具備加以形成於前述SiC膜之一方的主面，與SiC不同的膜。
  4. 如申請專利範圍第3項記載之化合物半導體基板，其中，與前述SiC不同的膜係由石墨烯，石墨，或GaN所成。
  5. 如申請專利範圍第1項記載之化合物半導體基板，其中，前述SiC膜係加以形成於前述Si基板之前述一方的主面。
  6. 如申請專利範圍第1項記載之化合物半導體基板，其中，更具備加以形成於前述Si基板之前述一方的主面之Si氧化膜；前述SiC膜係加以形成於前述Si氧化膜之一方的主面側。
  7. 一種膠片膜，其特徵為使用如申請專利範圍第1 項記載之化合物半導體基板。
  8. 一種化合物半導體基板之製造方法，其特徵為具備：形成SiC膜於Si基板之一方的主面側之工程，和經由濕蝕刻而使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程；在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，對於使用於前述濕蝕刻之藥液而言，至少相對性地移動前述Si基板及前述SiC膜。
  9. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，至少將前述Si基板及前述SiC膜，對於前述SiC膜之一方的主面而言，移動於平行之平面內的方向。
  10. 如申請專利範圍第9項記載之化合物半導體基板之製造方法，其中，在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，在至少使前述Si基板及前述SiC膜旋轉之狀態，將使用於前述濕蝕刻之藥液，注入至前述Si基板之前記另一方的主面。
  11. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，更具備形成將Si作為底面之凹部於前述Si基板之前述另一方的主面之中央部的工程；在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，於前述凹部的底面，使前述SiC膜露出。
  12. 如申請專利範圍第11項記載之化合物半導體基 板之製造方法，其中，在形成前述凹部於前述Si基板之前述另一方的主面之中央部之工程之後，進行形成前述SiC膜之工程。
  13. 如申請專利範圍第11項記載之化合物半導體基板之製造方法，其中，在形成前述SiC膜之工程之後，進行形成前述凹部於前述Si基板之前述另一方的主面之中央部之工程。
  14. 如申請專利範圍第11項記載之化合物半導體基板之製造方法，其中，在形成前述凹部於前述Si基板之前述另一方的主面之中央部之工程中，將加以形成於前述Si基板之前述另一方的主面之氧化膜或氮化膜所成之光罩層，作為光罩，經由濕蝕刻而除去前述Si基板之前述另一方的主面之中央部。
  15. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，在形成前述SiC膜之工程中，於前述Si基板之前述一方的主面側及側面，以及前述Si基板之前述另一方的主面之外周部，形成前述SiC膜，在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，將加以形成於前述Si基板之前述另一方的主面之前述外周部之前記SiC膜作為光罩，除去前述Si基板之前述另一方的主面。
  16. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程中，作為使用於前述濕蝕刻 之藥液而使用含有氟酸及硝酸的混酸。
  17. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，在使前述SiC膜之前述Si基板側的主面之至少一部分露出之工程之後，更具備形成GaN膜於前述SiC膜之與前述Si基板相反側的主面之工程。
  18. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，更具備使前述SiC膜之一部分變化為石墨烯膜或石墨膜之工程。
  19. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，更具備層積石墨烯膜或石墨膜而形成於前述SiC膜之與前述Si基板相反側的主面之工程。
  20. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，在形成前述SiC膜之工程中，於前述Si基板之前述一方的主面，形成前述SiC膜。
  21. 如申請專利範圍第8項記載之化合物半導體基板之製造方法，其中，更具備形成Si氧化膜於前述Si基板之前述一方的主面之工程；在形成前述SiC膜之工程中，於前述Si氧化膜之一方的主面側，形成前述SiC膜。
TW106105348A 2016-02-19 2017-02-17 化合物半導體基板、膠片膜及化合物半導體基板之製造方法 TWI721107B (zh)

Applications Claiming Priority (6)

Application Number Priority Date Filing Date Title
JP2016-030235 2016-02-19
JP2016030235 2016-02-19
JP2016-113656 2016-06-07
JP2016113656A JP6753703B2 (ja) 2016-02-19 2016-06-07 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法
JP2017-008115 2017-01-20
JP2017008115A JP6825923B2 (ja) 2017-01-20 2017-01-20 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法

Publications (2)

Publication Number Publication Date
TW201739948A TW201739948A (zh) 2017-11-16
TWI721107B true TWI721107B (zh) 2021-03-11

Family

ID=61022581

Family Applications (1)

Application Number Title Priority Date Filing Date
TW106105348A TWI721107B (zh) 2016-02-19 2017-02-17 化合物半導體基板、膠片膜及化合物半導體基板之製造方法

Country Status (4)

Country Link
US (1) US20200152455A1 (zh)
EP (1) EP3418424A4 (zh)
SG (1) SG11202001426UA (zh)
TW (1) TWI721107B (zh)

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2017141835A1 (ja) * 2016-02-19 2017-08-24 エア・ウォーター株式会社 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法
JP7248410B2 (ja) * 2018-11-01 2023-03-29 エア・ウォーター株式会社 化合物半導体装置、化合物半導体基板、および化合物半導体装置の製造方法
NL2025186B1 (en) * 2019-04-12 2021-02-23 Asml Netherlands Bv Pellicle for euv lithography

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09310170A (ja) * 1996-05-21 1997-12-02 Hoya Corp 炭化珪素薄膜構造体およびその作製方法
US6180292B1 (en) * 1999-06-18 2001-01-30 International Business Machines Corporation Structure and manufacture of X-ray mask pellicle with washer-shaped member
JP2015202990A (ja) * 2014-04-15 2015-11-16 エア・ウォーター株式会社 化合物半導体基板の製造方法
TW201600924A (zh) * 2014-05-27 2016-01-01 三井化學股份有限公司 防塵薄膜組件安裝裝置

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4735877A (en) * 1985-10-07 1988-04-05 Canon Kabushiki Kaisha Lithographic mask structure and lithographic process
US5809103A (en) * 1996-12-20 1998-09-15 Massachusetts Institute Of Technology X-ray lithography masking
JP4011687B2 (ja) * 1997-10-01 2007-11-21 キヤノン株式会社 マスク構造体、該マスク構造体を用いた露光装置、該マスク構造体を用いた半導体デバイス製造方法
JP2000299266A (ja) * 1999-04-12 2000-10-24 Canon Inc Ｘ線マスク、およびｘ線マスク作製方法
US6593035B1 (en) * 2001-01-26 2003-07-15 Advanced Micro Devices, Inc. Pellicle for use in small wavelength lithography and a method for making such a pellicle using polymer films
KR101707763B1 (ko) * 2013-05-24 2017-02-16 미쯔이가가꾸가부시끼가이샤 펠리클 및 이것을 포함하는 ｅｕｖ 노광 장치
WO2017024048A1 (en) * 2015-08-03 2017-02-09 UHV Technologies, Inc. X-ray window
US9864270B2 (en) * 2016-01-15 2018-01-09 Taiwan Semiconductor Manufacturing Company Ltd. Pellicle and method for manufacturing the same
WO2017141835A1 (ja) * 2016-02-19 2017-08-24 エア・ウォーター株式会社 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法
JP6753705B2 (ja) * 2016-06-10 2020-09-09 エア・ウォーター株式会社 基板の製造方法
JP6944768B2 (ja) * 2016-08-29 2021-10-06 エア・ウォーター株式会社 ペリクルの製造方法
US10162258B2 (en) * 2016-12-15 2018-12-25 Taiwan Semiconductor Manufacturing Co., Ltd. Pellicle fabrication methods and structures thereof
JP6787851B2 (ja) * 2017-08-08 2020-11-18 エア・ウォーター株式会社 ペリクルおよびペリクルの製造方法
WO2019142556A1 (ja) * 2018-01-17 2019-07-25 Ｓｐｐテクノロジーズ株式会社 ワイドギャップ半導体基板、ワイドギャップ半導体基板の製造装置、およびワイドギャップ半導体基板の製造方法

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09310170A (ja) * 1996-05-21 1997-12-02 Hoya Corp 炭化珪素薄膜構造体およびその作製方法
US6180292B1 (en) * 1999-06-18 2001-01-30 International Business Machines Corporation Structure and manufacture of X-ray mask pellicle with washer-shaped member
JP2015202990A (ja) * 2014-04-15 2015-11-16 エア・ウォーター株式会社 化合物半導体基板の製造方法
TW201600924A (zh) * 2014-05-27 2016-01-01 三井化學股份有限公司 防塵薄膜組件安裝裝置

Also Published As

Publication number Publication date
EP3418424A4 (en) 2019-03-27
SG11202001426UA (en) 2020-03-30
EP3418424A1 (en) 2018-12-26
KR20180118681A (ko) 2018-10-31
US20200152455A1 (en) 2020-05-14
TW201739948A (zh) 2017-11-16

Similar Documents

Publication Publication Date Title
US11626283B2 (en) Compound semiconductor substrate, a pellicle film, and a method for manufacturing a compound semiconductor substrate
JP6753703B2 (ja) 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法
CN107170668B (zh) 一种自支撑氮化镓制备方法
JP4597259B2 (ja) Ｉｉｉ族窒化物半導体成長用基板、ｉｉｉ族窒化物半導体エピタキシャル基板、ｉｉｉ族窒化物半導体素子およびｉｉｉ族窒化物半導体自立基板、ならびに、これらの製造方法
JP6602976B2 (ja) 半導体基板本体及びその上の機能層を分離する方法
JP2009038344A (ja) 格子整合基板上への窒化物系光電子／電子デバイス構造体の形成
CN111540684A (zh) 一种金刚石基异质集成氮化镓薄膜与晶体管的微电子器件及其制备方法
JP2007266472A (ja) 窒化物半導体ウエハないし窒化物半導体装置及びその製造方法
JP2015503215A (ja) 炭化ケイ素エピタキシャル成長法
JP2007326771A (ja) 形成方法および化合物半導体ウェハ
KR101878754B1 (ko) 대면적 갈륨 나이트라이드 기판 제조방법
TWI721107B (zh) 化合物半導體基板、膠片膜及化合物半導體基板之製造方法
US10600645B2 (en) Manufacturing method of gallium nitride substrate
JP2015018960A (ja) 半導体装置の製造方法
TW201413783A (zh) 碳化矽紋層
JP6825923B2 (ja) 化合物半導体基板、ペリクル膜、および化合物半導体基板の製造方法
JP2009117583A (ja) 窒化物半導体素子の製造方法、窒化物半導体結晶成長基板、結晶成長基板保持基板及び接着材
WO2012029216A1 (ja) 化合物半導体の製造方法
KR102715222B1 (ko) 화합물 반도체 기판, 펠리클막, 및 화합물 반도체 기판의 제조 방법
JP2011193010A (ja) 半導体ウェハ及び高周波電子デバイス用半導体ウェハ
KR101178504B1 (ko) 기판 제조 방법
WO2023119916A1 (ja) 窒化物半導体基板および窒化物半導体基板の製造方法
JP2010278470A (ja) Ｉｉｉ族窒化物半導体成長用基板、ｉｉｉ族窒化物半導体エピタキシャル基板、ｉｉｉ族窒化物半導体素子およびｉｉｉ族窒化物半導体自立基板、ならびに、これらの製造方法
JP5225133B2 (ja) ＧａＮ系化合物半導体の成長方法及び成長層付き基板
CN113707770A (zh) 一种硅衬底GaN的加工工艺