TWI707320B - 顯示裝置 - Google Patents

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Abstract

一種顯示裝置包括基板及設置於基板上的多個畫素。每一畫素包括多個子畫素。基板具有中間區及周邊區，其中周邊區位於基板的邊緣與中間區之間。多個畫素包括設置於中間區的多個標準畫素及設置於周邊區的多個周邊畫素。一個標準畫素的一個子畫素與一個周邊畫素的一個子畫素用以顯示同一種顏色，且所述標準畫素之所述子畫素的第二電晶體至其接墊的距離不等於所述周邊畫素的所述子畫素的第二電晶體至其接墊的距離。

Description

顯示裝置
本發明是有關於一種電子裝置，且特別是有關於一種顯示裝置。
發光二極體顯示面板包括主動元件基板及被轉置於主動元件基板上的多個發光二極體元件。繼承發光二極體的特性，發光二極體顯示面板具有省電、高效率、高亮度及反應時間快等優點。此外，相較於有機發光二極體顯示面板，發光二極體顯示面板還具有色彩易調校、發光壽命長、無影像烙印等優勢。因此，發光二極體顯示面板被視為下一世代的顯示技術。然而，由於發光二極體顯示面板的周邊設有不具顯示功能的電路，因此不易實現窄邊框、甚至無邊框的發光二極體顯示面板。
本發明提供一種顯示裝置，具有窄邊框、甚至無邊框。
本發明的顯示裝置，包括基板以及設置於基板上的多個畫素。基板具有中間區及周邊區，其中周邊區位於基板的邊緣與中間區之間。每一畫素包括多個子畫素。每一子畫素包括畫素驅動電路、接墊及發光二極體元件。畫素驅動電路包括第一電晶體及第二電晶體，其中第一電晶體具有第一端、第二端及控制端，第二電晶體具有第一端、第二端及控制端，且第一電晶體的第二端電性連接至第二電晶體的控制端。接墊電性連接至第二電晶體的第二端。發光二極體元件電性連接至接墊。多個畫素包括設置於中間區的多個標準畫素及設置於周邊區的多個周邊畫素。每一標準畫素之每一子畫素的第二電晶體與接墊具有距離A1。每一周邊畫素之每一子畫素的第二電晶體與接墊具有距離A2。一個標準畫素的一個子畫素與一個周邊畫素的一個子畫素用以顯示同一種顏色，且所述標準畫素的所述子畫素的距離A1不等於所述周邊畫素的所述子畫素的距離A2。
在本發明的一實施例中，上述的周邊畫素之子畫素的距離A2大於標準畫素之子畫素的距離A1。
在本發明的一實施例中，上述的周邊畫素的子畫素的距離A2小於標準畫素之子畫素的距離A1。
在本發明的一實施例中，上述的每一畫素的多個子畫素包括用以顯示第一顏色的第一子畫素；多個周邊畫素包括第一周邊畫素及第二周邊畫素，第一周邊畫素較第二周邊畫素靠近基板的邊緣，且第一周邊畫素之第一子畫素的距離A2大於第二周邊畫素之第一子畫素的該距離A2。
在本發明的一實施例中，上述的每一畫素的多個子畫素更包括用以顯示第二顏色的第二子畫素；第一周邊畫素的第二子畫素的距離A2大於第二周邊畫素的第二子畫素的距離A2。
在本發明的一實施例中，上述的每一畫素的多個子畫素更包括用以顯示第三顏色的第三子畫素；第一周邊畫素的第三子畫素的距離A2小於第二周邊畫素的第三子畫素的距離A2。
在本發明的一實施例中，上述的標準畫素之多個子畫素的多個畫素驅動電路與多個接墊的相對位置和周邊畫素之多個子畫素的多個畫素驅動電路與多個接墊的相對位置不同。
在本發明的一實施例中，上述的每一畫素的多個子畫素包括第一子畫素及第二子畫素，第一子畫素及第二子畫素分別用以顯示第一顏色及第二顏色；第一擬線段通過標準畫素之多個子畫素的多個接墊，而標準畫素之第一子畫素及第二子畫素的多個畫素驅動電路分別設置於第一擬線段的相對兩側；第二擬線段通過周邊畫素之多個子畫素的多個接墊，而周邊畫素之第一子畫素及第二子畫素的多個畫素驅動電路設置於第二擬線段的同一側。
在本發明的一實施例中，上述的每一子畫素更包括資料線、掃描線及電源線，第一電晶體的第一端電性連接至資料線，第一電晶體的控制端電性連接至掃描線，且第二電晶體的第一端電性連接至電源線；標準畫素更包括一非畫素驅動電路，標準畫素的非畫素驅動電路電性連接至標準畫素之子畫素的資料線、掃描線、電源線、畫素驅動電路、接墊及發光二極體元件的至少一者；周邊畫素更包括一非畫素驅動電路，周邊畫素的非畫素驅動電路電性連接至周邊畫素之子畫素的資料線、掃描線、電源線、畫素驅動電路、接墊及發光二極體元件的至少一者；標準畫素之非畫素驅動電路與標準畫素之接墊的相對位置和周邊畫素之非畫素驅動電路與周邊畫素之接墊的相對位置不同。
在本發明的一實施例中，上述的每一畫素的多個子畫素包括用以顯示第一顏色的第一子畫素；多個標準畫素的多個第一子畫素的多個接墊在一方向上以第一間距排列，多個周邊畫素的多個第一子畫素的多個接墊在所述方向上以一第二間距排列，且第一間距實質上等於第二間距。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
現將詳細地參考本發明的示範性實施例，示範性實施例的實例說明於附圖中。只要有可能，相同元件符號在圖式和描述中用來表示相同或相似部分。
應當理解，當諸如層、膜、區域或基板的元件被稱為在另一元件“上”或“連接到”另一元件時，其可以直接在另一元件上或與另一元件連接，或者中間元件可以也存在。相反，當元件被稱為“直接在另一元件上”或“直接連接到”另一元件時，不存在中間元件。如本文所使用的，“連接”可以指物理及/或電性連接。再者，“電性連接”或“耦合”係可為二元件間存在其它元件。
本文使用的“約”、“近似”、或“實質上”包括所述值和在本領域普通技術人員確定的特定值的可接受的偏差範圍內的平均值，考慮到所討論的測量和與測量相關的誤差的特定數量（即，測量系統的限制）。例如，“約”可以表示在所述值的一個或多個標準偏差內，或±30％、±20％、±10％、±5％內。再者，本文使用的“約”、“近似”或“實質上”可依光學性質、蝕刻性質或其它性質，來選擇較可接受的偏差範圍或標準偏差，而可不用一個標準偏差適用全部性質。
除非另有定義，本文使用的所有術語（包括技術和科學術語）具有與本發明所屬領域的普通技術人員通常理解的相同的含義。將進一步理解的是，諸如在通常使用的字典中定義的那些術語應當被解釋為具有與它們在相關技術和本發明的上下文中的含義一致的含義，並且將不被解釋為理想化的或過度正式的意義，除非本文中明確地這樣定義。
圖1為本發明一實施例之顯示裝置10的上視示意圖。圖1繪出基板110而省略顯示裝置10的其它構件。
圖2為本發明一實施例之顯示裝置10的局部的放大示意圖。圖2對應圖1的區域R。圖2繪出多個接墊121、122、多個發光二極體元件LED及基板110的側邊接墊區116而省略顯示裝置10的其它構件。
圖3為圖2之標準畫素PX1的放大示意圖。圖4為圖3之標準畫素PX1的放大示意圖。圖3繪出畫素驅動電路PC的第二電晶體T2而省略畫素驅動電路PC的其它構件。
圖5為圖2之角落畫素PX2c的放大示意圖。圖6為圖5之角落畫素PX2c的放大示意圖。圖5繪出畫素驅動電路PC的第二電晶體T2而省略畫素驅動電路PC的其它構件。
圖7為圖2之邊緣畫素PX2e-1、邊緣畫素PX2e-2、邊緣畫素PX2e-4及邊緣畫素PX2e-5的放大示意圖。圖7繪出畫素驅動電路PC的第二電晶體T2而省略畫素驅動電路PC的其它構件。
圖8為圖2的邊緣畫素PX2e-3、邊緣畫素PX2e-4、邊緣畫素PX2e-6及邊緣畫素PX2e-7的放大示意圖。圖8繪出畫素驅動電路PC的第二電晶體T2而省略畫素驅動電路PC的其它構件。
請參照圖1及圖2，顯示裝置10包括基板110。基板110主要是用來承載顯示裝置10的元件。舉例而言，在本實施例中，基板110的材質可以是玻璃、石英、有機聚合物、或是不透光/反射材料（例如：晶圓、陶瓷、或其它可適用的材料）、或是其它可適用的材料。
基板110具有一中間區112及一周邊區114。周邊區114位於基板110的至少一邊緣110a與中間區112之間。舉例而言，在本實施例中，周邊區114可位於基板110的所有邊緣110a與中間區112之間，而周邊區114可以是環繞中間區112的一個環形區域，但本發明不以此為限。
須說明的是，圖中繪出尚未從其母板中切割出的基板110，從母板中切割出之基板110的邊緣110a大致上如圖中標號110a所指的虛線。
顯示裝置10包括多個畫素PX，設置於基板110上。同一畫素PX的多個發光二極體元件LED構成一個發光二極體元件組GLED。多個畫素PX的多個發光二極體元件組GLED陣列排列於基板110上。其發光二極體元件組GLED位於中間區112（以空白圖案表示）的畫素PX稱為標準畫素PX1。其發光二極體元件組GLED位於周邊區114（以斜線圖案及斑點圖案表示）的畫素PX稱為周邊畫素PX2。
在本實施例中，多個周邊畫素PX2包括角落畫素PX2c及多個邊緣畫素PX2e-1～PX2e-7，每一角落畫素PX2c設置於基板110之兩邊緣110a的交接處旁（即設置在角落處，角落處以斜線圖案表示）。多個邊緣畫素PX2e-1～PX2e-7設置在基板110的邊緣110a旁且非角落的區域（以斑點圖案表示）。
在本實施例中，對應於基板110之相鄰兩邊緣110a的多個周邊畫素PX2（例如：角落畫素PX2c及邊緣畫素PX2e-1～PX2e-7）大致上可排成兩行及兩列。然而，本發明不限於此，對應於基板110之相鄰兩邊緣110a的多個周邊畫素PX2所排成的行數及列數可視實際需求做適當的變化；舉例而言，在另一實施例中，對應於基板110之相鄰兩邊緣110a的多個周邊畫素PX2所排成的行數及列數也可是三行及三列。
此外，在本實施例中，在最靠近基板110之一邊緣110a的一排周邊畫素PX2（例如：角落畫素PX2c、邊緣畫素PX2e-1及邊緣畫素PX2e-2）與基板110的邊緣110a之間可設有側邊接墊區116；基板110具有正面（即圖1的紙面）、相對於正面的背面以及連接於正面與背面之間的側壁，其中發光二極體元件LED設置於基板110的正面；基板110之正面的側邊接墊區116上可設有側邊接墊（side pad；未繪示），側邊接墊電性連接至位於基板110之側壁的導線（未繪示），位於基板110之正面的資料線DL、掃描線GL、電源線PL、共通線CL或其它構件可透過側邊接墊及位於基板110之側壁的導線電性連接至位於基板110的背面的扇出走線（未繪示）及/或晶片（未繪示）。
請參照圖4，每一畫素PX包括多個子畫素SPX。在本實施例中，每一子畫素SPX包括一資料線DL、一掃描線GL、一電源線PL、一共通線CL、一畫素驅動電路PC、一接墊121及一發光二極體元件LED。每一子畫素SPX的畫素驅動電路PC包括一第一電晶體T1、一第二電晶體T2及一電容C。第一電晶體T1的第一端T1a電性連接至資料線DL。第一電晶體T1的控制端T1c電性連接至掃描線GL。第一電晶體T1的第二端T1b電性連接至第二電晶體T2的控制端T2c。第二電晶體T2的第一端T2a電性連接至條電源線PL。電容C電性連接於第一電晶體T1的第二端T1b及第二電晶體T2的第一端T2a。第二電晶體T2的第二端T2b電性連接至接墊121。發光二極體元件LED的第一電極（未繪示）電性連接至接墊121。發光二極體元件LED的第二電極（未繪示）電性連接至對應的一條共通線CL。舉例而言，在本實施例中，每一子畫素SPX可選擇性地包括與接墊121隔開的另一接墊122，而每一子畫素SPX的發光二極體元件LED的第二電極可透過接墊122電性連接至共通線CL，但本發明不以此為限。
在本實施例中，每一子畫素SPX的發光二極體元件LED是從一生長基板（未繪示）上被轉置到包括基板110、資料線DL、掃描線GL、電源線PL、共通線CL、畫素驅動電路PC及接墊121的主動元件基板上，進而形成顯示裝置10。舉例而言，在本實施例中，發光二極體元件LED可先形成在藍寶石基板上，之後再被轉置到主動元件基板的接墊121上，而發光二極體元件LED可以是無機發光二極體元件，例如但不限於：微發光二極體（Micro LED）次毫米發光二極體（mini LED）或其它尺寸的無機發光二極體。
在本實施例中，每一畫素PX可包括第一子畫素SPX1、第二子畫素SPX2及第三子畫素SPX3。第一子畫素SPX1的發光二極體元件LED1、第二子畫素SPX2的發光二極體元件LED2及第三子畫素SPX3的發光二極體元件LED3分別用以發出第一色光、第二色光及第三色光，以使第一子畫素SPX1、第二子畫素SPX2及第三子畫素SPX3能分別顯示第一顏色、第二顏色及第三顏色。舉例而言，在本實施例中，第一顏色、第二顏色及第三顏色可分別是紅色、綠色及藍色，但本發明不以此為限。
請參照圖1、圖2及圖5，在本實施例中，多個標準畫素PX1之多個子畫素SPX的多個畫素驅動電路PC與其多個接墊121的相對位置實質上可相同；為了實現窄邊框甚至無邊框的顯示裝置10，可將周邊畫素PX2之多個子畫素SPX的多個畫素驅動電路PC往基板110的內部設置，而使周邊畫素PX2的發光二極體元件LED儘可能得靠近基板110的邊緣110a。因此，如圖3及圖5所示，標準畫素PX1之多個畫素驅動電路PC與其多個接墊121的相對位置和周邊畫素PX2之多個畫素驅動電路PC與其多個接墊121的相對位置會不同。
請參照圖3、圖4、圖5及圖6，舉例而言，在本實施例中，一條第一擬線段L1（繪於圖3）通過一個標準畫素PX1之多個子畫素SPX的多個接墊121，標準畫素PX1之第一子畫素SPX1的畫素驅動電路PC1及標準畫素PX1之第二子畫素SPX2的畫素驅動電路PC2分別設置於第一擬線段L1的相對兩側；一第二擬線段L2（繪於圖5）通過一個周邊畫素PX2之多個子畫素SPX的多個接墊121，而周邊畫素PX2之第一子畫素SPX1及第二子畫素SPX2的多個畫素驅動電路PC1、PC2設置於第二擬線段L2的同一側。
請參照圖1、圖2、圖3、圖5、圖7及圖8，以最靠近基板110角落的多個周邊畫素PX2（例如：一個角落畫素PX2c和多個邊緣畫素PX2e-1、PX2e-2、PX2e-3、PX2e-4、PX2e-5、PX2e-6、PX2e-7）及最靠近周邊區114的一個標準畫素PX1為例，標準畫素PX1（繪於圖3）之第一子畫素SPX1及第三子畫素SPX3的多個畫素驅動電路PC1、PC3設置在第一擬線段L1的第一側（例如：上側），標準畫素PX1之第二子畫素SPX2的畫素驅動電路PC2設置在第一擬線段L1的第二側（例如：下側）；角落畫素PX2c（繪於圖5）之第三子畫素SPX3的畫素驅動電路PC3設置於第二擬線段L2上，且角落畫素PX2c之第一子畫素SPX1及第二子畫素SPX2的多個畫素驅動電路PC1、PC2設置於第二擬線段L2的同一側（例如：下側）；邊緣畫素PX2e-1（繪於圖7）之第一子畫素SPX1、第二子畫素SPX2及第三子畫素SPX3的多個畫素驅動電路PC1、PC2、PC3設置於第二擬線段L2的同一側（例如：下側）；邊緣畫素PX2e-2（繪於圖7）之第一子畫素SPX1、第二子畫素SPX2及第三子畫素SPX3的多個畫素驅動電路PC1、PC2、PC3設置於第二擬線段L2的同一側（例如：下側）；邊緣畫素PX2e-3（繪於圖8）之第三子畫素SPX3的畫素驅動電路PC3設置於第二擬線段L2上，且邊緣畫素PX2e-3之第一子畫素SPX1及第二子畫素SPX2的多個畫素驅動電路PC1、PC2設置於第二擬線段L2的同一側（例如：下側）；邊緣畫素PX2e-4（繪於圖8）之第三子畫素SPX3的畫素驅動電路PC3設置於第二擬線段L2上，且邊緣畫素PX2e-4之第一子畫素SPX1及第二子畫素SPX2的多個畫素驅動電路PC1、PC2設置於第二擬線段L2的同一側（例如：下側）；邊緣畫素PX2e-5（繪於圖7）之第一子畫素SPX1的畫素驅動電路PC1設置在第二擬線段L2的第一側（例如：上側），邊緣畫素PX2e-5之第二子畫素SPX2及第三子畫素SPX3的多個畫素驅動電路PC2、PC3設置在第二擬線段L2的第二側（例如：下側）；邊緣畫素PX2e-6（繪於圖8）之第一子畫素SPX1的畫素驅動電路PC1設置在第二擬線段L2的第一側（例如：上側），邊緣畫素PX2e-6之第二子畫素SPX2的畫素驅動電路PC2設置在第二擬線段L2的第二側（例如：下側），且邊緣畫素PX2e-6之第三子畫素SPX3的畫素驅動電路PC3設置在第二擬線段L2上；邊緣畫素PX2e-7（繪於圖8）之第一子畫素SPX1的畫素驅動電路PC1設置在第二擬線段L2的第一側（例如：上側），且邊緣畫素PX2e-7之第二子畫素SPX2及第三子畫素SPX3的多個畫素驅動電路PC2、PC3設置在第二擬線段L2的第二側（例如：下側）。
請參照圖3，每一標準畫素PX1之每一子畫素SPX的第二電晶體T2與接墊121具有一距離A1。具體而言，在本實施例中，每一標準畫素PX1之每一子畫素SPX的距離A1可指其第二電晶體T2的半導體圖案（未繪示）的幾何中心至其接墊121之幾何中心的距離。請參照圖5，每一周邊畫素PX2之每一子畫素SPX的第二電晶體T2與接墊121具有一距離A2。具體而言，在本實施例中，每一周邊畫素PX2之每一子畫素SPX的距離A2可指其第二電晶體T2的半導體圖案（未繪示）的幾何中心至其接墊121之幾何中心的距離。
值得注意的是，標準畫素PX1的一個子畫素SPX與周邊畫素PX2的一個子畫素SPX用以顯示同一種顏色，且所述標準畫素PX1的所述一個子畫素SPX的距離A1不等於所述周邊畫素PX2的所述子畫素SPX的距離A2。
請參照圖3及圖5，以角落畫素PX2c及標準畫素PX1為例，角落畫素PX2c之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2與其接墊121的距離A21（標示於圖5）可大於標準畫素PX1之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2與其接墊121的距離A11（標示於圖3）。
請參照圖3及圖7，以標準畫素PX1及邊緣畫素PX2e-5為例，邊緣畫素PX2e-5之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2與其接墊121的距離A21（標示於圖7）可略小於標準畫素PX1之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2與標準畫素PX1之第一子畫素SPX1的接墊121的距離A11（標示於圖3）。
在本實施例中，靠近基板110之邊緣110a的一周邊畫素PX2的第一子畫素SPX1的第二電晶體T2與其接墊121的距離A2比較遠離基板110之邊緣110a的另一周邊畫素PX2的第一子畫素SPX1的第二電晶體T2與其接墊121的距離A2來得大。請參照圖5及圖7，舉例而言，角落畫素PX2c較邊緣畫素PX2e-1靠近基板110的邊緣110a，且角落畫素PX2c之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2至其接墊121的距離A21大於邊緣畫素PX2e-1之第一子畫素SPX1的畫素驅動電路PC1的第二電晶體T2至其接墊121的距離A21。
在本實施例中，靠近基板110之邊緣110a的一周邊畫素PX2的第二子畫素SPX2的第二電晶體T2與其接墊121的距離A2比遠離基板110之邊緣110a的另一周邊畫素PX2的第二子畫素SPX2的第二電晶體T2與其接墊121的距離A2來得大。請參照圖5及圖7，舉例而言，角落畫素PX2c較邊緣畫素PX2e-1靠近基板110的邊緣110a，且角落畫素PX2c之第二子畫素SPX2的畫素驅動電路PC2的第二電晶體T2至其接墊121的距離A22大於邊緣畫素PX2e-1之第二子畫素SPX2的畫素驅動電路PC2的第二電晶體T2至其接墊121的距離A22。
在本實施例中，靠近基板110之邊緣110a的一周邊畫素PX2的第三子畫素SPX3的第二電晶體T2至其接墊121的距離A2可比遠離基板110之邊緣110a的另一周邊畫素PX2的第三子畫素SPX3的第二電晶體T2至其接墊121的距離A2來得小。請參照圖5及圖7，舉例而言，角落畫素PX2c較邊緣畫素PX2e-1靠近基板110的邊緣110a，且角落畫素PX2c之第三子畫素SPX3的畫素驅動電路PC3的第二電晶體T2至其接墊121的距離A23可小於邊緣畫素PX2e-1之第三子畫素SPX3的畫素驅動電路PC3的第二電晶體T2至其接墊121的距離A23。
此外，在本實施例中，標準畫素PX1之多個畫素驅動電路PC與多個接墊121的相對位置和周邊畫素PX2之多個畫素驅動電路PC與多個接墊121的相對位置不同，但所有畫素PX之多個第一子畫素SPX1的多個接墊121在方向x上均以相同的間距排列，且所有畫素PX之多個第一子畫素SPX1的多個接墊121在方向y上也均以相同的間距排列，其中方向x與方向y交錯。也就是說，多個標準畫素PX1的多個第一子畫素SPX1的多個接墊121在方向x上以一第一間距p1（標示於圖1）排列，多個周邊畫素PX2的多個第一子畫素SPX1的多個接墊121在方向x上以一第二間距p2（標示於圖1及圖2）排列，且第一間距p1等於第二間距p2；多個標準畫素PX1的多個第一子畫素SPX1的多個接墊121在方向y上以一第三間距p3（標示於圖1）排列，多個周邊畫素PX2的多個第一子畫素SPX1的多個接墊121在方向y上以一第四間距p4（標示於圖1及圖2）排列，且第三間距p3等於第四間距p4。
下述實施例沿用前述實施例的元件標號與部分內容，其中採用相同的標號來表示相同或近似的元件，並且省略了相同技術內容的說明。關於省略部分的說明可參考前述實施例，下述實施例不再重述。
圖9為本發明另一實施例之顯示裝置10A的標準畫素PX1的放大示意圖。
圖10為本發明另一實施例之顯示裝置10A的周邊畫素PX2的放大示意圖。
請參照圖9及圖10，本實施例的顯示裝置10A與前述的顯示裝置10類似，兩者的差異在於：在本實施例中，一標準畫素PX1還可包括至少一非畫素驅動電路NPC，一周邊畫素PX2還可包括至少一非畫素驅動電路NPC，且標準畫素PX1之非畫素驅動電路NPC與接墊121的相對位置和周邊畫素PX2之非畫素驅動電路NPC與接墊121的相對位置不同。
在本實施例中，標準畫素PX1的至少一非畫素驅動電路NPC可包括第一非畫素驅動電路NPC1及第二非畫素驅動電路NPC2；標準畫素PX1的第一非畫素驅動電路NPC1可電性連接至標準畫素PX1之多個子畫素SPX所共用的同一條資料線DL，而標準畫素PX1的第一非畫素驅動電路NPC1例如是一多工器（multiplexer；MUX）；標準畫素PX1的第二非畫素驅動電路NPC2可電性連接至標準畫素PX1之多個子畫素SPX的掃描線GL，而標準畫素PX1的第二非畫素驅動電路NPC2例如是整合型閘極驅動電路（gate driver-on-array；GOA）；周邊畫素PX2的至少一非畫素驅動電路NPC可包括第一非畫素驅動電路NPC1及第二非畫素驅動電路NPC2；周邊畫素PX2的第一非畫素驅動電路NPC1可電性連接至周邊畫素PX2之多個子畫素SPX所共用的同一條資料線DL，而周邊畫素PX2的第一非畫素驅動電路NPC1例如是一多工器（multiplexer；MUX）；周邊畫素PX2的第二非畫素驅動電路NPC2可電性連接至周邊畫素PX2之多個子畫素SPX的掃描線GL，而周邊畫素PX2的第二非畫素驅動電路NPC2例如是整合型閘極驅動電路（gate driver-on-array；GOA）。
特別是，在本實施例中，標準畫素PX1之第一非畫素驅動電路NPC1與接墊121的相對位置和周邊畫素PX2之第一非畫素驅動電路NPC1與接墊121的相對位置不同，且標準畫素PX1之第二非畫素驅動電路NPC2與接墊121的相對位置和周邊畫素PX2之第二非畫素驅動電路NPC2與接墊121的相對位置不同。舉例而言，標準畫素PX1之第一非畫素驅動電路NPC1可設置在接墊121的左下方，而周邊畫素PX2之第一非畫素驅動電路NPC1可設置在接墊121的右下方；標準畫素PX1之第二非畫素驅動電路NPC2可設置在接墊121的右下方，而周邊畫素PX2之第二非畫素驅動電路NPC2可在接墊121的右側。
在本實施例中，非畫素驅動電路NPC以多工器（multiplexer；MUX）及整合型閘極驅動電路（gate driver-on-array；GOA）示例。然而，本發明不限於此，根據其它實施例，非畫素驅動電路NPC可包括靜電防護（ESD）線路、測試（TEST）電路或其組合。
綜上所述，本發明一實施例的顯示裝置包括基板及設置於基板上的多個畫素。每一畫素包括多個子畫素。基板具有中間區及周邊區，其中周邊區位於基板的邊緣與中間區之間。多個畫素包括設置於中間區的多個標準畫素及設置於周邊區的多個周邊畫素。一個標準畫素的一個子畫素與一個周邊畫素的一個子畫素用以顯示同一種顏色，且所述標準畫素之所述子畫素的第二電晶體至其接墊的距離不等於所述周邊畫素的所述子畫素的第二電晶體至其接墊的距離。藉此，能實現具有窄邊框、甚至無邊框的顯示裝置。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
10、10A:顯示裝置 110:基板 110a:邊緣 112:中間區 114:周邊區 116:側邊接墊區 121、122:接墊 A1、A11、A2、A21、A22、A23:距離 C:電容 CL:共通線 DL:資料線 GL:掃描線 GLED:發光二極體元件組 LED、LED1、LED2、LED3:發光二極體元件 L1:第一擬線段 L2:第二擬線段 NPC:非畫素驅動電路 NPC1:第一非畫素驅動電路 NPC2:第二非畫素驅動電路 PL:電源線 PX:畫素 PX1:標準畫素 PX2:周邊畫素 PX2c:角落畫素 PX2e-1、PX2e-2、PX2e-3、PX2e-4、PX2e-5、PX2e-6、PX2e-7:邊緣畫素 PC、PC1、PC2、PC3:畫素驅動電路 p1:第一間距 p2:第二間距 p3:第三間距 p4:第四間距 R:區域 SPX:子畫素 SPX1:第一子畫素 SPX2:第二子畫素 SPX3:第三子畫素 T1:第一電晶體 T1a、T2a:第一端 T1b、T2b:第二端 T1c、T2c:控制端 T2:第二電晶體 x、y:方向
圖1為本發明一實施例之顯示裝置10的上視示意圖。 圖2為本發明一實施例之顯示裝置10的局部的放大示意圖。 圖3為圖2之標準畫素PX1的放大示意圖。 圖4為圖3之標準畫素PX1的放大示意圖。 圖5為圖2之角落畫素PX2c的放大示意圖。 圖6為圖5之角落畫素PX2c的放大示意圖。 圖7為圖2之邊緣畫素PX2e-1、邊緣畫素PX2e-2、邊緣畫素PX2e-4及邊緣畫素PX2e-5的放大示意圖。 圖8為圖2的邊緣畫素PX2e-3、邊緣畫素PX2e-4、邊緣畫素PX2e-6及邊緣畫素PX2e-7的放大示意圖。 圖9為本發明另一實施例之顯示裝置10A的標準畫素PX1的放大示意圖。 圖10為本發明另一實施例之顯示裝置10A的周邊畫素PX2的放大示意圖。
10:顯示裝置
110a:邊緣
116:側邊接墊區
121、122:接墊
GLED:發光二極體元件組
LED:發光二極體元件
PX:畫素
PX1:標準畫素
PX2:周邊畫素
PX2c:角落畫素
PX2e-1、PX2e-2、PX2e-3、PX2e-4、PX2e-5、PX2e-6、PX2e-7:邊緣畫素
p2:第二間距
p4:第四間距
x、y:方向

Claims (10)

  1. 一種顯示裝置，包括：一基板，具有一中間區及一周邊區，其中該周邊區位於該基板的一邊緣與該中間區之間；以及多個畫素，設置於該基板上，其中每一該畫素包括多個子畫素，且每一該子畫素包括：一畫素驅動電路，包括一第一電晶體及一第二電晶體，其中該第一電晶體具有一第一端、一第二端及一控制端，該第二電晶體具有一第一端、一第二端及一控制端，且該第一電晶體的該第二端電性連接至該第二電晶體的該控制端；一接墊，電性連接至該第二電晶體的該第二端；以及一發光二極體元件，電性連接至該接墊；該些畫素包括設置於該中間區的多個標準畫素及設置於該周邊區的多個周邊畫素，每一該標準畫素之每一該子畫素的該第二電晶體與該接墊具有一距離A1，每一該周邊畫素之每一該子畫素的該第二電晶體與該接墊具有一距離A2；一該標準畫素的一該子畫素與一該周邊畫素的一該子畫素用以顯示同一種顏色，且該標準畫素的該子畫素的該距離A1不等於該周邊畫素的該子畫素的該距離A2。
  2. 如申請專利範圍第1項所述的顯示裝置，其中該周邊畫素之該子畫素的該距離A2大於該標準畫素之該子畫素的該距離A1。
  3. 如申請專利範圍第1項所述的顯示裝置，其中該周邊畫素的該子畫素的該距離A2小於該標準畫素之該子畫素的該距離A1。
  4. 如申請專利範圍第1項所述的顯示裝置，其中每一該畫素的該些子畫素包括用以顯示一第一顏色的一第一子畫素；該些周邊畫素包括一第一周邊畫素及一第二周邊畫素，該第一周邊畫素較該第二周邊畫素靠近該基板的該邊緣，且該第一周邊畫素之該第一子畫素的該距離A2大於該第二周邊畫素之該第一子畫素的該距離A2。
  5. 如申請專利範圍第4項所述的顯示裝置，其中每一該畫素的該些子畫素更包括用以顯示一第二顏色的一第二子畫素；該第一周邊畫素的該第二子畫素的該距離A2大於該第二周邊畫素的該第二子畫素的該距離A2。
  6. 如申請專利範圍第4項所述的顯示裝置，其中每一該畫素的該些子畫素更包括用以顯示一第三顏色的一第三子畫素；該第一周邊畫素的該第三子畫素的該距離A2小於該第二周邊畫素的該第三子畫素的該距離A2。
  7. 如申請專利範圍第1項所述的顯示裝置，其中該標準畫素之該些子畫素的多個畫素驅動電路與多個接墊的相對位置和該周邊畫素之該些子畫素的多個畫素驅動電路與多個接墊的相對位置不同。
  8. 如申請專利範圍第1項所述的顯示裝置，其中每一該畫素的該些子畫素包括一第一子畫素及一第二子畫素，該第一子畫素及該第二子畫素分別用以顯示一第一顏色及一第二顏色；一第一擬線段通過該標準畫素之該些子畫素的多個接墊，而該標準畫素之該第一子畫素及該第二子畫素的多個畫素驅動電路分別設置於該第一擬線段的相對兩側；一第二擬線段通過該周邊畫素之該些子畫素的多個接墊，而該周邊畫素之該第一子畫素及該第二子畫素的多個畫素驅動電路設置於該第二擬線段的同一側。
  9. 如申請專利範圍第1項所述的顯示裝置，其中每一該子畫素更包括一資料線、一掃描線及一電源線，該第一電晶體的該第一端電性連接至該資料線，該第一電晶體的該控制端電性連接至該掃描線，且該第二電晶體的該第一端電性連接至該電源線；該標準畫素更包括一非畫素驅動電路，該標準畫素的該非畫素驅動電路電性連接至該標準畫素之該子畫素的該資料線或該掃描線；該周邊畫素更包括一非畫素驅動電路，該周邊畫素的該非畫素驅動電路電性連接至該周邊畫素之該子畫素的該資料線或該掃描線；該標準畫素之該非畫素驅動電路與該標準畫素之該接墊的相對位置和該周邊畫素之該非畫素驅動電路與該周邊畫素之該接墊的相對位置不同。
  10. 如申請專利範圍第1項所述的顯示裝置，其中每一該畫素的該些子畫素包括用以顯示一第一顏色的一第一子畫素；該些標準畫素的多個第一子畫素的多個接墊在一方向上以一第一間 距排列，該些周邊畫素的多個第一子畫素的多個接墊在該方向上以一第二間距排列，且該第一間距實質上等於該第二間距。
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