TWI542017B - 場效電晶體及其製作方法 - Google Patents

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Description

場效電晶體及其製作方法
此揭露內容是有關於積體電路的製造，且特別是有關於具有接觸窗蝕刻停止層的場效電晶體。
隨著技術節點(technology nodes)的微縮，在一些積體電路(IC)的設計中，需要以金屬閘極取代典型的多晶矽閘極，以改善具縮小之特徵尺寸的元件效能。有一種形成金屬閘極結構的製程被稱為「閘極後置」(gate last)製程，其中，最終閘極結構是「最後」製作的，這可以減少後續製程(包括在閘極形成後必須要進行的高溫處理)的數量。此外，隨著電晶體尺寸的下降，閘極氧化物的厚度也必須減少，以在閘極長度縮減的情況下維持效能。為了抑制閘極漏電流問題，亦使用高介電常數(high-k)的閘極介電層，其可容許較大的實體厚度，而仍保持如使用於較大技術節點中之較薄層閘極氧化物所提供的相同有效厚度。
然而，要實施前述特徵和製程於互補式金屬氧化物半導體(CMOS)的製造中，仍有許多挑戰存在。當閘 極長度和元件間距縮短時，這些問題益加嚴重。例如：源極/汲極區可能會因接觸窗的未對準而與金屬閘極產生短路。
根據一實施方式，一種場效電晶體包括：基材；配置在基材上的源極區和汲極區；位於基材上的閘極結構，包括側壁和頂表面，其中閘極結構夾置於源極區和汲極區之間；接觸窗蝕刻停止層(CESL)，位於閘極結構的至少一部分頂表面上；層間介電層，位於CESL上；閘極接觸窗，延伸穿過層間介電層；源極接觸窗和汲極接觸窗，延伸穿過層間介電層，其中介於源極接觸窗的邊緣和CESL的第一對應邊緣的第一距離約1nm至約10nm。
根據另一實施方式，一種場效電晶體包括：基材，其具有表面；配置在基材中的源極區和汲極區；位於基材上的閘極結構，包括側壁和頂表面，其中閘極結構夾置於源極區和汲極區之間；一對間隙壁，鄰接閘極結構的側壁；第一接觸窗蝕刻停止層(CESL)，位於此對間隙壁上並沿著基材的表面延伸；第二CESL，位於閘極結構的至少一部分頂表面上；層間介電層，位於第一CESL和第二CESL上；閘極接觸窗，延伸穿過層間介電層；以及源極接觸窗和汲極接觸窗，延伸穿過層間介電層和第一CESL，其中介於源極接觸窗的邊緣和第二CESL的對應邊緣間的距離約1nm到約10nm。
根據另一實施方式，一種場效電晶體的製作方 法包括：提供閘極結構於基材上，其包括側壁和頂表面；形成鄰接閘極結構的側壁的一對間隙壁；在基材中閘極結構的兩側形成源極/汲極(S/D)區；在此對間隙壁和閘極結構的頂表面上沈積第一接觸窗蝕刻停止層(CESL)；在第一CESL上沈積第一層間介電層(ILD)；對第一ILD層和第一CESL進行化學機械研磨以暴露出閘極結構；在第一CESL和閘極結構上沈積第二CESL；圖案化第二CESL以移除位於一部分S/D區上的部分第二CESL；在第一ILD層和第二CESL上沈積第二ILD層；以及形成閘極接觸窗、源極接觸窗和汲極接觸窗，其延伸穿過第二ILD層，其中介於源極接觸窗的邊緣和第二CESL的對應邊緣的距離約1nm到約10nm。
100‧‧‧方法
102、104、108、110、112、114、116、118、120‧‧‧步驟
200‧‧‧場效電晶體(FET)
202‧‧‧基材
202s‧‧‧表面
204‧‧‧主動區
206‧‧‧絕緣區
208‧‧‧輕摻雜源極和汲極(LDD)區域
210‧‧‧源極和汲極(S/D)區域
212‧‧‧閘極介電層
214‧‧‧假閘極層
216‧‧‧金屬閘極層
220‧‧‧閘極結構
220s‧‧‧側壁
220t、226t‧‧‧頂表面
222‧‧‧間隙壁
224‧‧‧第一接觸窗蝕刻停止層(CESL)
226‧‧‧第一層間介電層(ILD)
230‧‧‧矽化物區
234‧‧‧第二接觸窗蝕刻停止層(CESL)
234a、234b、240a、240b‧‧‧邊緣
238、238g、238s、238d‧‧‧接觸窗孔
240g‧‧‧閘極接觸窗
240s‧‧‧源極接觸窗
240d‧‧‧汲極接觸窗
242‧‧‧金屬層
250‧‧‧感光層
t1、t2‧‧‧厚度
W1、W2、W3‧‧‧寬度
S1、S2‧‧‧第一距離
透過以下實施方式和閱讀隨附圖式，將可對本揭露內容進行最佳理解。需強調的是，如同業界的標準作法，各個特徵未必按比例繪示，且該些特徵僅供示意之用。事實上，為了進行清楚的討論，圖式中各特徵的尺寸可能經過任意縮放。
圖1是根據本揭露的各種態樣來說明包括有接觸窗蝕刻停止層之場效電晶體的製作方法的流程圖。
圖2A至圖2J繪示根據本揭露的各種態樣在各種製作階段之場效電晶體的接觸窗蝕刻停止層的剖面示意圖。
應理解的是，以下揭露內容提供了許多不同的實施方式或實施例，使發明的各種特徵得以實現。下文描述了成份和安排方式的各種實例是為了簡化本揭露內容。這些內容當然僅是例示而已，其意不在構成限制。例如，在下文中敘述第一特徵形成在第二特徵上或上方，可能包括第一和第二特徵直接接觸的實施方式，也可能包括其他特徵形成於第一和第二特徵之間的實施方式，此時第一和第二特徵就可能沒有直接接觸。為了簡化和清楚起見，各個特徵可能被任意繪示成不同尺寸。此外，本揭露內容是以「閘極後置」金屬閘極結構來提供實例說明，但本技術領域中具有通常知識者可理解，本揭露內容對其他結構也同樣適用及/或亦可使用其他材料。
圖1是根據本揭露之各種態樣繪示的流程圖，其說明了用來製作包括有接觸窗蝕刻停止層224、234(如圖2C至圖2J所示)的場效電晶體200的方法100。圖2A-圖2J係根據本揭露之各種態樣繪示場效電晶體200的接觸窗蝕刻停止層224、234在各種製作階段的剖面示意圖。如本揭露所使用，場效電晶體200是指鰭式場效電晶體(FinFET)200。FinFET 200是指任何以鰭結構為基礎的多閘極電晶體。在一些實施方式中，場效電晶體200的用語是指平面式的金屬氧化物半導體場效電晶體(MOSFET)。其他電晶體結構和類似結構亦在本揭露的考慮範圍之內，例如：環繞式閘極場效電晶體(Gate-All-Around；GAA)或穿遂式 場效電晶體(TFET)。場效電晶體200可內含於微處理器、記憶體單元及/或積體電路(IC)之中。
可使用CMOS處理技術來進一步處理圖1的場效電晶體。因此，應理解的是，在圖1的方法100進行的前、中、後，都可施予額外的製程，而一些其他製程在此僅可能被簡要地描述。此外，為了更易於理解本揭露的概念，圖1至圖2J已被簡化。例如，雖然圖式繪示的是場效電晶體200的接觸窗蝕刻停止層224、234，但應理解的是，場效電晶體200可以是更包括有各種其他元件(如電阻器、電容器、電感器、保險絲等)的IC的一部分。
請參照圖1和圖2A，方法100始於步驟102，其提供了在基材202上方的閘極結構220，閘極結構220包括側壁220s和頂表面220t。在至少一實施方式中，基材202可包括矽基材。在一些其他的實施方式中，基材202可由其他適當的元素型半導體(例如鑽石或鍺)、適當的化合物型半導體(例如砷化鎵、碳化矽、砷化銦或磷化銦)或適當的合金型半導體(碳化矽鍺、磷化鎵砷或磷化鎵銦)所製成。基材202可更包括其他特徵，例如各種摻雜區、內埋區及/或磊晶層。此外，基材202可以是半導體覆絕緣體，例如絕緣層覆矽(SOI)或藍寶石覆矽。在一些其他的實施方式中，基材202可包括經摻雜的磊晶層、梯度化的半導體層及/或可更包括疊在不同類型的另一半導體層上的半導體層，例如矽層覆蓋在矽鍺層上。在其他例子中，化合物半導體基材202可包括多層矽結構，或者矽基材可包括多層的化合物半 導體結構。基材202包括有表面202s。
在一些實施方式中，基材202可更包括主動區204和絕緣區206。取決於設計上的需求，主動區204可包括本技術領域所知的各種摻雜狀態。在一些實施方式中，主動區可受p型或n型摻質摻雜。例如，主動區204可被例如是硼或BF2的p型所摻質、例如是磷或砷的n型摻質及/或其組合所摻雜。主動區204可被設計為用於N型金屬氧化物半導體場效電晶體(稱為NMOSFET)，或者也可以被設計為用於P型金屬氧化物半導體場效電晶體(稱為PMOSFET)。
在一些實施方式中，絕緣區206可被形成在基材202上，以隔離各種主動區204。絕緣區206可利用例如矽局部氧化(LOCOS)或淺溝渠絕緣(STI)等絕緣技術來定義出並電性絕緣主動區204。在至少一實施方式中，絕緣區206包括一STI。絕緣區206可包含氧化矽、氮化矽、氮氧化矽、氟摻雜的矽酸鹽玻璃(FSG)、低介電常數材料、其他適當的材料及/或其組合。可透過任何適當的製程來形成絕緣區206(在本實施方式中為STI)。如一例子所述，STI的形成可包括：以習知的光學微影製程萊圖案化半導體基材202、在基材202中蝕刻出溝渠(例如：透過乾式蝕刻、濕式蝕刻及/或電漿蝕刻製程)、以及以介電材料填滿溝渠(例如使用化學氣相沈積製程)。在一些實施方式中，已填滿的溝渠可具有多層結構，例如：填充有氮化矽或氧化矽的熱氧化物襯墊層。
接著，閘極介電層212被形成在基材202上。在 一些實施方式中，閘極介電層212可包括氧化矽、氮氧化矽或高介電常數材料。高介電常數材料的定義是其介電常數大於SiO2之介電常數的介電材料。高介電常數材料包括金屬氧化物。在一些實施方式中，金屬氧化物是選自由以下金屬的氧化物所組成的族群：Li、Be、Mg、Ca、Sr、Sc、Y、Zr、Hf、Al、La、Ce、Pr、Nd、Sm、Eu、Gd、Tb、Dy、Ho、Er、Tm、Yb、Lu或其混合物。可透過熱氧化法、化學氣相沈積法(CVD)、原子層沈積法(ALD)來生成閘極介電層212的，且閘極介電層212的厚度可小於2nm。
在一些實施方式中，閘極介電層212可更包括介面層(未繪示)，以最小化閘極介電層212和基材202之間的應力。介面層可由透過熱氧化法生成的氧化矽或氮氧化矽所形成。例如：介面層可透過快速熱氧化法(RTO)或在含氧環境下進行的退火製程來生成。
接著，假閘極(dummy gate electrode)層214可被形成在閘極介電層212上。在一些實施方式中，假閘極層214可包括單層或多層結構。在本實施方式中，假閘極層214可包括多晶矽。再者，假閘極層214可以是具有均一或梯度化摻雜的摻雜多晶矽。假閘極層214可具有任意的適當厚度。在本實施方式中，假閘極層214的厚度在約30nm到約60nm之間。在一些實施方式中，可以使用低壓化學氣相沈積法(LPCVD)來形成假閘極層214。在至少一實施方式中，LPCVD製程可以在溫度為約580℃至650℃、壓力約為200mTorr到1Torr的LPCVD爐中進行，並使用矽 烷(SiH4)、二矽烷(Si2H6)、三矽烷(Si3H8)或二氯矽烷(SiH2Cl2)做為矽源氣體。
接著，在一些實施方式中，硬罩幕層(未繪示)可被形成在假閘極層214上，以保護假閘極層214。硬罩幕層可包括氮化矽。可透過例如CVD製程或LPCVD製程來沈積硬罩幕層。硬罩幕層的厚度可為約100Å到400Å。在沈積硬罩幕層之後，使用感光層(未繪示)來圖案化硬罩幕層。接著，使用反應性離子蝕刻(RIE)或高密度電漿(HDP)製程，透過硬罩幕層來圖案化閘極結構220，並暴露出基材202的一部分，藉以使閘極結構220包括有側壁220s和頂表面220t。
如圖2A所示，在一些實施方式中，在閘極結構220形成之後，可在主動區204中產生輕摻雜源極和汲極(LDD)區域208。這是透過硼或磷的離子植入來完成，其能量約5到100KeV，劑量約介於1E11到1E14原子/cm2之間。
請參照圖1和圖2B，方法100繼續進行至步驟104，其形成了鄰接閘極結構220之側壁220s的一對間隙壁222。此對間隙壁222可由氧化矽、氮化矽、氮氧化矽、碳化矽、氟摻雜的矽酸鹽玻璃(FSG)、低介電常數材料及/或其組合所形成。此對間隙壁222可具有多層結構，例如包括一或多層襯墊層。襯墊層可包括像是氧化矽、氮化矽及/或其他適當材料的介電材料。此對間隙壁222的形成方法可以包括沈積適當的介電材料以及對所沈積的材料進行異向 性蝕刻以形成此對間隙壁222。此對間隙壁222中的一者的寬度可以在約6nm到35nm的範圍之內。
請參照圖1和2C，方法100的下一步是步驟106，其形成了位於基材202中且間隔開來配置在閘極結構220的兩側的源極/汲極(S/D)區域210(與閘極結構底下的基材202區域相鄰接)。在一些實施方式中，為使接觸的電阻夠低，需要在主動區中形成多個重摻雜的S/D區210。這是透過硼或磷的離子植入來完成，其能量約5到150KeV，劑量約介於1E15到1E16原子/cm2之間。
在一些實施方式中，可以選擇性地透過自對準矽化物(salicide)製程在S/D區210上形成矽化物區230。
例如，過自對準矽化物製程可包括兩個步驟。首先，可以透過濺鍍把金屬材料沈積在基材表面202s上，其製程溫度介於500℃到900℃之間，使金屬材料和下方的矽產生反應而形成矽化物區230。接著，未反應的金屬材料可以藉由蝕刻移去。矽化物區230可包括選自矽化鈦、矽化鈷、矽化鎳、矽化鉑、矽化鉺或矽化鈀的材料。矽化物區230的厚度在約30到50nm的範圍內。在一些實施方式中，如果基材202含有Ge，可以選擇性地透過自對準鍺化物製程在S/D區210上形成鍺化物區230。在一些實施方式中，鍺化物區230可包括NiGe、PtGe、TiGe2、CoGe2或PdGe。
在圖1中，方法100的下一步是步驟108，其透過沈積一層位在此對間隙壁222和閘極結構220的頂表面220t上，且沿著基材202的表面202s延伸的第一接觸窗蝕刻 停止層(Contact Etch Stop Layer；CESL)224來製造圖2C的結構。第一CESL 224可包括(但不限於)氮化矽或碳摻雜的氮化矽。第一CESL 224可具有任意的適當厚度。在一些實施方式中，第一CESL 224的厚度在約180埃到約220埃的範圍之間。
在一些實施方式中，第一CESL 224可以使用CVD、高密度電漿化學氣相沈積(HDPCVD)、亞常壓化學氣相沈積(SACVD)、分子層沈積(MLD)、濺鍍或任何適當方法來沈積。例如，在一些實施方式中，MLD製程通常在低於10mTorr的壓力下進行，且其溫度範圍從約350℃到約500℃。在至少一實施方式中，透過使矽源化合物和氮源反應，讓氮化矽沈積在此對間隙壁222和閘極結構220的頂表面220t上。矽源化合物提供了沈積氮化矽所需的矽，其可以是矽烷(SiH4)或四乙氧基矽烷(TEOS)。氮源提供了沈積氮化矽所需的氮，其可以是氨(NH3)或氮氣(N2)。在其他實施方式中，透過使碳源化合物、矽源化合物和氮源反應，在此對間隙壁222和閘極結構220的頂表面220t上沈積碳摻雜的氮化矽。碳源化合物可以是有機化合物，如烴類化合物，例如乙烷(C2H6)。
在圖1中，方法100的下一步是步驟110，其進一步在第一CESL 224上沈積第一層間介電層(ILD)226以製作圖2C的結構。第一ILD層226可包括介電材料。所述介電材料可包括氧化矽、氮化矽、氮氧化矽、磷矽酸鹽玻璃(PSG)、硼磷矽酸鹽玻璃(BPSG)、旋塗玻璃(SOG)、 氟化矽玻璃(FSG)、碳摻雜的氧化矽(例如SiCOH)、BLACK DIAMOND®(應用材料公司，加州聖塔克拉拉；Applied Materials,Santa Clara,California)、乾凝膠(Xerogel)、氣凝膠(Aerogel)、非晶氟化碳、聚對二甲苯(Parylene)、BCB(bis-benzocyclobutenes，聯苯並環丁烯)、Flare(聚芳香烴醚膜)、SILK®(道氏化學公司，密西根州密得蘭；Dow Chemical,Midland,Michigan)、聚醯亞胺及/或其組合。應該理解的是，第一ILD層226可以包括一種或多種介電材料及/或一層或多層介電層。在一些實施方式中，可以透過CVD、HDPCVD、SACVD、旋塗、濺鍍或其他適當方法在第一CESL 224上沈積第一ILD層226。在本實施方式中，第一ILD層226的厚度約3000到4500Å。
在圖1中，方法100的下一步是步驟112，其透過對第一ILD層226和第一CESL 224進行化學機械研磨(CMP)以暴露出閘極結構220的頂表面220t來製作圖2D的結構。在閘極後置製程中，可以移去假閘極層214，以便金屬閘極層216得以形成在假閘極層214的空間。因此，使用CMP製程將第一ILD層226平面化，直到到達或暴露出假閘極層214的頂表面220t。CMP製程可具有高選擇性，使得假閘極層214、此對間隙壁222、第一CESL 224和第一ILD層226的表面實質上為平面。因此，第一ILD層226的頂表面226t和閘極結構220的頂表面220t共平面。CMP製程也可具有低凹陷(dishing)及/或腐蝕效應。在一些其他 的實施方式中，可執行CMP製程以暴露硬罩幕層，接著利用蝕刻製程(例如濕式蝕刻浸潤)以移除硬罩幕層，從而暴露出假閘極層214的頂表面220t。
在CMP製程以後，執行閘極置換製程。假閘極層214可從被介電質環繞的閘極結構220中移除，所述介電質包括此對間隙壁222、第一CESL 224以及第一ILD層226。可以透過任何本文描述的適當製程來移除假閘極層214以在閘極結構220中形成溝渠。在一些實施方式中，可以使用濕式蝕刻及/或乾式蝕刻製程來移除假閘極層214。在至少一實施方式中，針對假性多晶矽閘極層214的濕式蝕刻製程包括將目標暴露於含氫氧化物(例如氫氧化銨)、去離子水及/或其他適當蝕刻劑的溶液中。
當假閘極層214被移除時，此造成了溝渠(未繪示)的形成。可形成金屬層以填充溝渠。此金屬層可包括任何適於形成金屬閘極層216或其部份(包括阻障、功函數層、襯墊層、介面層、種晶層、黏著層、阻障層等)的金屬材料。在一些實施方式中，所述金屬材料可包括在PMOSFET中運作得宜的適當金屬，如TiN、WN、TaN、或Ru。在一些其他實施方式中，所述金屬層可包括在NMOSFET中運作得宜的適當金屬，如Ti、Ag、Al、TiAl、TiAlN、TiAlC、TiAlCN、TaC、TaCN、TaSiN、Mn或Zr。對此金屬層進行另一道CMP製程，以形成場效電晶體200的金屬閘極層216。為了簡單和清楚說明起見，下文將金屬閘極層216和閘極介電層212結合且也將其稱為閘極結 構220。因此，如圖2A與圖2D所示，此閘極結構220形成於基材202之表面202s上。
在一些實施方式中，需要保護金屬閘極結構220在接觸窗蝕刻期間不受破壞。在圖1中，方法100的下一步是步驟114，其透過在第一CESL 224、第一ILD層226和閘極結構220上沈積第二接觸窗蝕刻停止層(CESL)234來製作圖2E的結構。第二CESL 234會在接觸窗蝕刻期間保護閘極結構220。在一些實施方式中，第二CESL 234可包括介電材料，如氮化矽或碳摻雜的氮化矽。在一些實施方式中，第二CESL 234可包括導電材料，如Ti、TiN、TiC、TiCN、Ta、TaN、TaC、TaCN、W、WN、WC、WCN、TiAl、TiAlN、TiAlC或TiAlCN。
第二CESL 234可以具有任意的適當厚度。在本實施方式中，第二CESL 234具有在約190埃到約250埃範圍內的厚度t2。在至少一實施方式中，第一CESL 224的厚度t1小於第二CESL 234的厚度t2。在一些實施方式中，第二CESL 234的厚度t2對第一CESL 224的厚度t1的比值介於1.05到1.15。在一些其他的實施方式中，如果可以接受損失一些金屬閘極層216，那麼第一CESL 224的厚度t1可以大於第二CESL 234的厚度t2，藉此降低電容值。
在一些實施方式中，第二接觸窗蝕刻停止層234可以使用CVD、HDPCVD、SACVD、分子層沈積(MLD)、濺鍍、物理氣相沈積(PVD)、電鍍或其他適當方法來沈積。例如，在至少一實施方式中，通常在低於10mTorr的壓力下以及在約350℃到約550℃的溫度範圍 內進行MLD製程。在一些實施方式中，透過使矽源化合物和氮源進行反應，在ILD層226和閘極結構220的頂表面220t上沈積氮化矽。矽源化合物提供沈積氮化矽所需的矽，其可以是矽烷(SiH4)或四乙氧基矽烷(TEOS)。氮源提供沈積氮化矽所需的氮，其可以是氨(NH3)或氮氣(N2)。在一些其他的實施方式中，透過使碳源化合物、矽源化合物和氮源進行反應，在ILD層226和閘極結構220的頂表面220t上沈積碳摻雜的氮化矽。碳源化合物可以是有機化合物，如烴類化合物，例如乙烷(C2H6)。
在本實施方式中，第一和第二CESL 224、234包括相同的材料。在一些其他的實施方式中，第一和第二CESL 224、234包括不同的材料。例如，在一些實施方式中，第一CESL 224是氮化矽，第二CESL 234是碳摻雜的氮化矽，或者兩者相反。在一些實施方式中，第一CESL 224是氮化矽，第二CESL是TiN。
接著，圖案化感光層250形成在第二接觸窗蝕刻停止層234上。舉例而言，圖案化感光層250可以使用如旋塗、光學微影製程(包括曝光、烘烤以及顯影製程)、蝕刻(包括灰化和剝除製程)及/或其他製程來形成。圖案化感光層250對特定的曝光光束敏感，如KrF、ArF、EUV或電子束。在至少一種實例當中，圖案化感光層包括高分子、猝滅劑(quencher)、發色團(chromophore)溶劑及/或化學放大劑(chemical amplifier，CA)。在本實施方式中，圖案化感光層250暴露出第二CESL 234未覆蓋閘極結構220的那一部分，以在S/D區210製作接觸窗。圖案化感光層250的寬度W1大於或等於閘極結構220的寬度W2。
在圖1中，方法100的下一步是步驟116，其透 過圖案化第二CESL 234以移除第二CESL 234位於S/D區210上方的部份來製作圖2F的結構，此時第二CESL 234仍維持於閘極結構220的至少一部分頂表面220t的上方。在一些實施方式中，第二CESL 234的圖案化是在感光層250的存在下藉由乾式蝕刻製程來進行，將會暴露出一部分的ILD層226，使得第二CESL 234的寬度W3大於或等於閘極結構220的寬度W2。乾式蝕刻製程可具有高選擇性，藉此，乾式蝕刻製程可停止於ILD層226。例如，乾式蝕刻製程可在電源功率約150W到約220W，壓力約10mTorr到約45mTorr下的條件進行，並使用CH2F2和Ar作為蝕刻氣體。
在本實施方式中，第二CESL 234包括在閘極結構220的頂表面220t上延伸的一部分。第二CESL 234在一些實施方式中更包括在第一CESL 224的頂表面224t上延伸的一部分。第二CESL 234在一些實施方式中更包括在ILD層226的頂表面226t上延伸的一部分，因此如圖2F所示，第二CESL 234經圖案化後，ILD層226與第二CESL 234之至少一部分接觸。在一些例子中，如圖2A與圖2F所示，第二CESL 234係沿著平行基材202之表面202s的一方向橫向延伸。
在圖1中，方法100的下一步是步驟118，其透過在第一ILD層226和第二CESL 234上沈積第二層間介電層(ILD)236來製作圖2G的結構。在本實施方式中，第二ILD層236可包括介電材料。介電材料可包括氧化矽、氮化矽、氮氧化矽、磷矽酸鹽玻璃(PSG)、硼磷矽酸鹽玻璃(BPSG)、旋塗玻璃(SOG)、氟化矽玻璃(FSG)、碳摻雜的氧化矽(例如SiCOH)、BLACK DIAMOND®(應 用材料公司，加州聖塔克拉拉；Applied Materials,Santa Clara,California)、乾凝膠(Xerogel)、氣凝膠(Aerogel)、非晶氟化碳、聚對二甲苯(Parylene)、BCB(bis-benzocyclobutenes，聯苯並環丁烯)、Flare(聚芳香烴醚膜)、SILK®(道氏化學公司，密西根州密得蘭；Dow Chemical,Midland,Michigan)、聚醯亞胺及/或其組合。應該理解的是，第二ILD層236可以包括一種或多種介電材料及/或一層或多層介電層。在一些實施方式中，可以透過CVD、HDP CVD、SACVD、旋塗、濺鍍或其他適當方法在第一ILD層226和第二接觸窗蝕刻停止層234上沈積第二ILD層236至適當厚度。在本實施方式中，第二ILD層236的厚度約3000到4500Å。
請參照圖2H到2J和圖1的步驟120，針對場效電晶體200的後續CMOS製程步驟可包括形成閘極接觸窗240g、源極接觸窗240s和汲極接觸窗240d，這些接觸窗延伸穿過第一ILD層226、第二ILD層236、第一CESL 224以及第二CESL 234，為閘極結構220及/或S/D區210提供電性接觸。在一些實施方式中，介於源極接觸窗240s的邊緣240b以及第二CESL 234的第一對應邊緣234a之間的第一距離S1是約1nm到約10nm，即第二CESL 234之接近源極接觸窗240s的第一對應邊緣234a與源極接觸窗240s在沿著平行於基材202之表面202s之一方向上相隔第一距離S1。在一些實施方式中，介於汲極接觸窗240d的邊緣240b以及第二CESL 234的第二對應邊緣234b之間的第二距離S2是約1nm到約10nm(呈現於圖2J之中)，即第二CESL 234之接近汲極接觸窗240d的第二對應邊緣234b與汲極接 觸窗240d在沿著平行於基材202之表面202s之一方向上相隔第二距離S2。在一些實施方式中，第一距離S1實質上等於第二距離S2。在一些實施方式中，第一距離S1異於第二距離S2。在一些實施方式中，第一距離S1對第二距離S2的比值介於約0.5到約1.5。
請參照圖2H和2I，接觸窗孔238(其包括238g、238s和238d)可以透過任何適當的製程來形成。作為其中一例，接觸窗孔238的形成可以包括以光學微影製程圖案化第二ILD層236、蝕刻暴露出來的第二ILD層236(例如使用乾式蝕刻、濕式蝕刻及/或電漿蝕刻製程)以移除第二ILD層236位於S/D區210上和閘極結構220上的部份，暴露出第一CESL 224和第二CESL 234的一部分(呈現於圖2H)。
在一些實施方式中，需要避免源極/汲極區210因接觸窗未對準而電性接觸到金屬閘極結構220。因此，第二CESL 234的邊緣234a和邊緣234b不能只延伸至金屬閘極220的邊緣。在一些實施方式中，有需要為源極/汲極接觸窗的形成提供充分的空間。因此，第二CESL 234的邊緣234a、234b不能延伸到蓋住S/D區210。在一些實施方式中，介於第二ILD層236的邊緣236a和CESL 234的第一對應邊緣234a間的第一距離(相當於第一距離S1)約1nm到約10nm。在一些實施方式中，介於第二ILD層236的邊緣236b和CESL 234的第二對應邊緣234b間的第二距離(相當於第二距離S2)約1nm到約10nm。
參照圖2I，移除第一CESL 224和第二CESL 234暴露出來的部份，以露出閘極結構220和矽化物區 230。在本實施方式中，使用乾式蝕刻製程同時移除第一CESL 224和第二CESL 234。乾式蝕刻製程可具有高選擇性，使得乾式蝕刻製程可中止於閘極結構220和矽化物區230。例如：乾式蝕刻製程可在電源功率為約150到約220W，壓力約10到為約45mTorr下的條件進行，並使用CH2F2和Ar為蝕刻氣體。因此，由於在金屬閘極結構220上導入第二CESL 234，在接觸窗蝕刻過程期間，可減少對金屬閘極結構220的不必要蝕刻。因此，此處所揭露的製作場效電晶體200之CESL 224、234的方法可以製作出金屬閘極結構220，而不會有由接觸窗蝕刻所造成的凹陷，從而提昇元件效能。
請參照圖2J，在接觸窗孔238形成之後，透過在接觸窗孔238中填充金屬層242來製作圖2J的結構。在一些實施方式中，金屬層242包括TiN、TaN、Ta、Ti、Hf、Zr、Ni、W、Co、Cu或Al。在一些實施方式中，金屬層242可以透過CVD、PVD、電鍍、ALD或其他適當技術形成。在一些實施方式中，金屬層242可包括疊層結構(laminate)。所述疊層結構可更包括阻障金屬層、襯墊金屬層或潤濕金屬層(wetting metal layer)。再者，金屬層242的厚度取決於接觸窗孔238的深度。因此，沈積金屬層242直到接觸窗孔238實質被填滿或過量填充為止。
接著，在填充接觸窗孔238後，進行另一道CMP製程以平面化金屬層242。因為CMP要移除金屬層242位於接觸窗孔238以外的部份，CMP製程可以在達到第二ILD層 236以後結束，從而提供實質上平面化的表面。在一些實施方式中，閘極接觸窗240g延伸穿過第二CESL 234和第二ILD層236。在一些實施方式中，源極接觸窗240s和汲極接觸窗240d延伸穿過第一CESL 224、第一ILD層226和第二ILD層236。
接著，在一些實施方式中，在場效電晶體200形成以後，進行後續製程(包括內連線製程)以完成IC的製作。
根據一實施方式，一種場效電晶體包括：基材；配置在基材上的源極區和汲極區；位於基材上的閘極結構，包括側壁和頂表面，其中閘極結構夾置於源極區和汲極區之間；接觸窗蝕刻停止層(CESL)，位於閘極結構的至少一部分頂表面上；層間介電層，位於CESL上；閘極接觸窗，延伸穿過層間介電層；源極接觸窗和汲極接觸窗，延伸穿過層間介電層，其中介於源極接觸窗的邊緣和CESL的第一對應邊緣的第一距離約1nm至約10nm。
根據另一實施方式，一種場效電晶體包括：基材，其具有表面；配置在基材中的源極區和汲極區；位於基材上的閘極結構，包括側壁和頂表面，其中閘極結構夾置於源極區和汲極區之間；一對間隙壁，鄰接閘極結構的側壁；第一接觸窗蝕刻停止層(CESL)，位於此對間隙壁上並沿著基材的表面延伸；第二CESL，位於閘極結構的至少一部分頂表面上；層間介電層，位於第一CESL和第二CESL上；閘極接觸窗，延伸穿過層間介電層；以及源極接觸窗和汲極 接觸窗，延伸穿過層間介電層和第一CESL，其中介於源極接觸窗的邊緣和第二CESL的對應邊緣間的距離約1nm到約10nm。
根據另一實施方式，一種場效電晶體的製作方法包括：提供閘極結構於基材上，其包括側壁和頂表面；形成鄰接閘極結構的側壁的一對間隙壁；在基材中閘極結構的兩側形成源極/汲極(S/D)區；在此對間隙壁和閘極結構的頂表面上沈積第一接觸窗蝕刻停止層(CESL)；在第一CESL上沈積第一層間介電層(ILD)；對第一ILD層和第一CESL進行化學機械研磨以暴露出閘極結構；在第一CESL和閘極結構上沈積第二CESL；圖案化第二CESL以移除位於一部分S/D區上的部分第二CESL；在第一ILD層和第二CESL上沈積第二ILD層；以及形成閘極接觸窗、源極接觸窗和汲極接觸窗，其延伸穿過第二ILD層，其中介於源極接觸窗的邊緣和第二CESL的對應邊緣的距離約1nm到約10nm。
雖然已舉實例並在較佳實施方式的脈絡下描述本發明，應理解的是，本發明並不限於本文揭露的實施方式。相反地，本發明應涵蓋對本技術領域中具有通常知識者而言顯而易見的各種修改和相似安排。因此，隨附請求項的範圍應依其最廣的解釋視之，以涵蓋所有該等修改和相似安排。
100‧‧‧方法
102、104、106、108、110、112、114、116、118、120‧‧‧步驟

Claims (10)

  1. 一種場效電晶體，包括：一基材，具有一表面；一源極區和一汲極區，配置在該基材中；一閘極結構，位於該基材上，該閘極結構包括有複數個側壁和一頂表面，其中該閘極結構係夾置於該源極區和該汲極區之間；一接觸窗蝕刻停止層(Contact Etch Stop Layer；CESL)，位於該閘極結構的該頂表面的至少一部分上，且該CESL沿著平行於該基材之該表面之一方向橫向延伸；一第一層間介電層，位於該CESL下，該第一層間介電層與該CESL之至少一部分接觸；一第二層間介電層，位於該CESL上；一閘極接觸窗，延伸穿過該第二層間介電層與該CESL；以及一源極接觸窗和一汲極接觸窗，其延伸穿過該第一層間介電層與該第二層間介電層，其中該CESL之接近該源極接觸窗之一第一邊緣與該源極接觸窗在沿著平行於該基材之該表面之一方向上相隔一第一距離，且該CESL之接近該汲極接觸窗之一第二邊緣與該汲極接觸窗在沿著平行於該基材之該表面之一方向上相隔一第二距離。
  2. 如申請專利範圍第1項所述的場效電晶體，其中該第一距離為1nm到10nm，且該第二距離為1nm到10nm。
  3. 如申請專利範圍第2項所述的場效電晶體，其中該第一距離對該第二距離的一比值係介於0.5和1.5之間。
  4. 如申請專利範圍第1項所述的場效電晶體，其中該第一距離異於該第二距離。
  5. 如申請專利範圍第4項所述的場效電晶體，其中該CESL的寬度大於或等於該閘極結構的寬度。
  6. 一種場效電晶體，包括：一基材，具有一表面；一源極區和一汲極區，配置在該基材中；一閘極結構，位於該基材上，該閘極結構包括有複數個側壁和一頂表面，其中該閘極結構係夾置於該源極區和該汲極區之間；一對間隙壁，鄰近於該閘極結構的該些側壁；一第一接觸窗蝕刻停止層(CESL)，位於該對間隙壁上且沿著該基材的該表面延伸；一第二CESL，位於該閘極結構的該頂表面的至少一部分上，該第二CESL沿著平行於該基材之該表面之一方向橫向延伸；一層間介電層，位於該第一CESL和該第二CESL上；一閘極接觸窗，延伸穿過該層間介電層與該第二CESL：以及一源極接觸窗和一汲極接觸窗，延伸穿過該層間介電層和該第一CESL，其中該第二CESL接近該源極接觸窗的一邊緣與該源極接觸窗在沿著平行於該基材之該表面之 一方向上相隔一距離。
  7. 如申請專利範圍第6項所述的場效電晶體，其中該第二CESL更包括在該第一CESL的一頂表面上延伸的一部分。
  8. 如申請專利範圍第6項所述的場效電晶體，其中該第二CESL之一寬度大於或等於該閘極結構之一寬度。
  9. 如申請專利範圍第6項所述的場效電晶體，其中該第二CESL的厚度對該第一CESL的厚度的一比值是從1.05到1.15。
  10. 一種場效電晶體的製作方法，包括：提供一閘極結構於一基材之一表面上，該閘極結構包括側壁和頂表面；形成鄰近於該閘極結構之該些側壁的一對間隙壁；形成源極/汲極(S/D)區於該閘極結構之側面上的該基材中；沈積一第一接觸窗蝕刻停止層(CESL)於該對間隙壁和該閘極結構的該頂表面上；沈積一第一層間介電層(ILD)於該第一CESL上；對該第一ILD層和該第一CESL進行一化學機械研磨，以暴露出該閘極結構；沈積一第二CESL於該第一CESL、該閘極結構和該第一ILD層上；圖案化該第二CESL，以移除位於部份該S/D區上的該第二CESL的一部分，其中圖案化該第二CESL後，該 第一ILD層與該第二CESL之至少一部分接觸，且該第二CESL沿著平行於該基材之該表面之一方向橫向延伸；沈積一第二ILD層於該第一ILD層和該第二CESL上；以及形成延伸穿過該第二ILD層之一閘極接觸窗、以及穿過該第二ILD層與該第一ILD層之一源極接觸窗和一汲極接觸窗，其中該第二CESL之接近該源極接觸窗之一第一邊緣與該源極接觸窗在沿著平行於該基材之該表面之一方向上相隔一第一距離，且該第二CESL之接近該汲極接觸窗之一第二邊緣與該汲極接觸窗在沿著平行於該基材之該表面之一方向上相隔一第二距離。
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