TWI454960B - 密碼清除電路 - Google Patents

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Description

密碼清除電路
本發明涉及一種密碼清除電路。
為了保證電腦的安全，用戶通常會對電腦的BIOS及CMOS設置密碼以防止未授權用戶更改電腦的資訊。過一段時間之後，如進行電腦的BIOS升級，而此時用戶卻忘記了當時設置的密碼，如此則需拆開機箱以對主機板上的BIOS及CMOS進行手動清除密碼。習知的手動清除BIOS及CMOS密碼是透過跳線的方式。該BIOS及CMOS跳線均包括一底座及一鍵帽，該底座包括三個引腳，其中第一引腳接地、第二引腳懸空、第三引腳連接於相應的晶片上。正常情況下，該鍵帽插接於第二及第三引腳上，當需清除BIOS或CMOS的密碼時，即將鍵帽安裝在第一及第二引腳上即可。然而，為了清除BIOS或CMOS密碼，主機板上需設置兩個跳線，如此對於原本就空間緊張的主機板來說或多或少的增加了電路板的大小，進而增加的主機板的成本。
鑒於以上內容，有必要提供一種可降低主機板成本的密碼清除電路。
一種密碼清除電路，用於清除位於一主機板上的一BIOS晶片及CMOS晶片內所設置的密碼，該密碼清除電路包括：
一跳線，包括一底座及一鍵帽，該底座包括第一、第二、第三及第四引腳；該第一引腳懸空，第三引腳接地，第二引腳與該BIOS晶片相連，第四引腳與該CMOS晶片相連；以及
一電源電路，連接於該底座的第二及第四引腳上，還連接於BIOS晶片及CMOS晶片以為該BIOS晶片及CMOS晶片提供工作電壓；
當需清除該BIOS晶片的密碼時，將該鍵帽插接至該第二及第三引腳之間；當需清除該CMOS晶片的密碼時，將該鍵帽插接至該第三及第四引腳之間。
上述密碼清除電路用於將該跳線同時連接於該BIOS晶片及CMOS晶片的密碼清除引腳，如此使得當需清除該BIOS晶片內的密碼時，只需將該鍵帽插接至該底座的第二及第三引腳之間；當需清除該CMOS晶片內的密碼時，則只需將該鍵帽插接至該底座的第三及第四引腳之間，如此避免了使用兩個不同的跳線來分別清除該BIOS晶片或CMOS晶片的密碼所帶來的主機板空間的浪費，從而有效地降低了主機板的成本。
請參考圖1，本發明密碼清除電路用於清除位於一主機板上的一BIOS晶片10或一CMOS晶片20內所設置的密碼，該密碼清除電路的較佳實施方式包括一跳線30、一電源電路40及一濾波電路50。
該跳線30包括一底座300及一鍵帽302，該底座300包括第一至第四引腳1-4，該底座300的第一至第四引腳1-4等間距的按順序排成一排，且每兩相鄰引腳間的距離相等。該鍵帽302可以插接至任意兩相鄰的引腳之間。該第一引腳1懸空，第三引腳3接地，第二引腳2與該BIOS晶片10相連，第四引腳4與該CMOS晶片20相連。
該電源電路40包括一電源3.3V_SB、一電池400、一肖特基二極體D1及一電阻R1。該電源3.3V_SB連接於該肖特基二極體D1的第一陽極A1，還透過該電阻R1與該第二引腳2相連。該電池400的負極接地，正極連接與該肖特基二極體D1的第二陽極A2相連。當該主機板接入外部電源（如電腦系統工作）時，該BIOS晶片10及CMOS晶片20均由該電源3.3V_SB提供工作電壓，以保存存儲於該BIOS晶片10及CMOS晶片20內的密碼；當外部電源沒有接入該主機板（如電腦系統停止工作）時，該電池400則透過該肖特基二極體D1及電阻R2為該CMOS晶片20進行供電，以使得該CMOS晶片20在外部電源不接入的情況下仍可以保存其內設置的密碼。
該濾波電路50包括一電阻R2及一電容C1，該電阻R2的一端連接於該肖特基二極體D1的陰極B，另一端連接於該底座300的第四引腳4以及CMOS晶片20，還透過該電容C1接地。
當需保持該BIOS晶片10及CMOS晶片20內存儲的密碼時，該鍵帽302用於插接至該底座300的第一引腳1及第二引腳2之間。此時，該電源電路40為該BIOS晶片10及CMOS晶片20提供工作電壓。如此使得該BIOS晶片10及CMOS晶片20內的密碼不會丟失。
當需要清除該BIOS晶片10內的密碼時，則需將該鍵帽302插接至該底座300的第二引腳2及第三引腳3之間，如此使得該第二引腳2變為低電平，從而使得存儲於該BIOS晶片10內的密碼清除；當需要清除該CMOS晶片20內的密碼時，則需將該鍵帽302插接至該底座300的第三引腳3及第四引腳4之間，如此使得該第四引腳4變為低電平，從而使得存儲於該CMOS晶片20內的密碼清除。
上述密碼清除電路用於該跳線30來同時連接於該BIOS晶片10及CMOS晶片20的密碼清除引腳，如此使得當需清除該BIOS晶片10內的密碼時，只需將該鍵帽插接至該底座300的第二引腳2及第三引腳3之間；當需清除該CMOS晶片20內的密碼時，則只需將該鍵帽302插接至該底座300的第三引腳3及第四引腳4之間，如此避免了使用兩個不同的跳線來分別清除該BIOS晶片10或CMOS晶片20的密碼所帶來的主機板空間的浪費，從而有效地降低了主機板的成本。
綜上所述，本發明確已符合發明專利的要件，爰依法提出專利申請。惟，以上該者僅為本發明的較佳實施方式，本發明的範圍並不以上述實施方式為限，舉凡熟悉本案技藝的人士援依本發明的精神所作的等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
10．．．BIOS晶片
20．．．CMOS晶片
30．．．跳線
300．．．底座
302．．．鍵帽
40．．．電源電路
3.3V_SB．．．電源
400．．．電池
R1、R2．．．電阻
C1．．．電容
50．．．濾波電路
D1．．．肖特基二極體
圖1是本發明密碼清除電路的較佳實施方式的電路圖。
10．．．BIOS晶片
20．．．CMOS晶片
30．．．跳線
300．．．底座
302．．．鍵帽
40．．．電源電路
3.3V_SB．．．電源
400．．．電池
R1、R2．．．電阻
C1．．．電容
50．．．濾波電路
D1．．．肖特基二極體

Claims (6)

  1. 一種密碼清除電路，用於清除位於一主機板上的一BIOS晶片及CMOS晶片內所設置的密碼，該密碼清除電路包括：
    一跳線，包括一底座及一鍵帽，該底座包括第一、第二、第三及第四引腳；該第一引腳懸空，第三引腳接地，第二引腳與該BIOS晶片相連，第四引腳與該CMOS晶片相連；以及
    一電源電路，連接於該底座的第二及第四引腳上，還連接於BIOS晶片及CMOS晶片以為該BIOS晶片及CMOS晶片提供工作電壓；
    當需清除該BIOS晶片的密碼時，將該鍵帽插接至該第二及第三引腳之間；當需清除該CMOS晶片的密碼時，將該鍵帽插接至該第三及第四引腳之間。
  2. 如申請專利範圍第1項所述之密碼清除電路，還包括一濾波電路，該濾波電路包括一第一電阻及一電容，該第一電阻的一端與該電源電路相連，另一端透過該電容接地，還連接於該CMOS晶片，還連接於該底座的第四引腳。
  3. 如申請專利範圍第1項所述之密碼清除電路，其中該電源電路包括一電池、一電源、一肖特基二極體；該電源連接於該肖特基二極體的第一陽極，還連接於該底座的第二引腳；該電池的負極接地，正極連接於該肖特基二極體的第二陽極；該肖特基二極體的陰極連接於該底座的第四引腳。
  4. 如申請專利範圍第3項所述之密碼清除電路，其中該電源電路還包括一第二電阻，該肖特基二極體的第一陽極透過該第二電阻連接於該底座的第二引腳上。
  5. 如申請專利範圍第1項所述之密碼清除電路，其中該底座的第一、第二、第三及第四引腳等間距的按順序排成一排。
  6. 如申請專利範圍第1項所述之密碼清除電路，其中該底座的第一、第二、第三及第四引腳按順序每兩相鄰引腳間的距離相等。
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