TWI408477B - 畫素陣列以及聚合物穩定配向液晶顯示面板 - Google Patents

畫素陣列以及聚合物穩定配向液晶顯示面板 Download PDF

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Description

畫素陣列以及聚合物穩定配向液晶顯示面板
本發明是有關於一種畫素陣列，且特別是有關於一種具有良好顯示品質的畫素陣列。
隨著液晶顯示器不斷地朝向大尺寸的顯示規格發展，為了克服大尺寸顯示下的視角問題，液晶顯示面板的廣視角技術也必須不停地進步與突破。其中，多域垂直配向式(Multi-domain Vertical Alignment，MVA)液晶顯示面板以及聚合物穩定配向(Polymer stabilized alignment，PSA)液晶顯示面板即為現行常見的廣視角技術。為了改善液晶顯示面板中的色偏問題(color washout)，已有進階型多域垂直配向式(Advanced-MVA)液晶顯示面板被提出，其主要是將各個子畫素區分為主顯示區域(main display region)以及子顯示區域(sub-display region)，並透過適當的電路設計以及驅動方法，使同一個子畫素中的主顯示區域以及子顯示區域分別具有不同跨壓，以改善色偏問題。在現有技術中，將各個子畫素區分為主顯示區域以及子顯示區域之設計概念已被應用於聚合物穩定配向液晶顯示面板中。
圖1為一種畫素陣列的等效電路圖，而圖2為圖1中單一子畫素的示意圖。請參照圖1與圖2，畫素陣列100包括多個子畫素P1，且各個子畫素P1包括一第一薄膜電晶體TFT1、一第二薄膜電晶體TFT2、一第三薄膜電晶體 TFT3、與第一薄膜電晶體TFT1電性連接的第一畫素電極ITO1以及與第二薄膜電晶體TFT2電性連接的第二畫素電極ITO2。第一畫素電極ITO1會與一共通線COM1耦合而形成一第一儲存電容Cs1，且第一畫素電極ITO1會與對向基板(如彩色濾光基板)上之一共通電極(未標示)耦合而形成一第一液晶電容CLC1。類似地，第二畫素電極ITO2會與一共通線COM2耦合而形成一第二儲存電容Cs2，且第二畫素電極ITO2會與對向基板(如彩色濾光基板)上之共通電極(未標示)耦合而形成一第二液晶電容CLC2。
從圖1與圖2可知，在與掃描線SL(n-1)電性連接的子畫素P1中，第一薄膜電晶體TFT1以及第二薄膜電晶體TFT2的閘極G1、G2會與掃描線SL(n-1)電性連接，而第三薄膜電晶體TFT3的閘極G3會與下一條掃描線SL(n)電性連接。此外，第三薄膜電晶體TFT3的源極S3與第二畫素電極ITO2電性連接，而第三薄膜電晶體TFT3的汲極D3與第一畫素電極ITO1耦合成第一電容Ccs-a，且第三薄膜電晶體TFT3的汲極D3與第一畫素電極ITO1下方之共通線COM1耦合成第二電容Ccs-b。當施加一高電壓(Vgh)於掃描線SL(n-1)時，影像資料可透過資料線DL(m-1)、DL(m)寫入與掃描線SL(n-1)連接的子畫素中，此時，第一畫素電極ITO1與第二畫素電極ITO2的電壓是相同的。接著，當施加一高電壓於掃描線SL(n)時，第一電容Ccs-a與第二電容Ccs-b會使第一畫素電極ITO1的電壓與第二畫素電極ITO2的電壓不同。
由於第二薄膜電晶體TFT2的汲極D2會跨過第一畫素電極ITO1而與第二畫素電極ITO2連接，因此第二薄膜電晶體TFT2的汲極D2與第一畫素電極ITO1之間便產生一寄生電容Cx1。此外，由於第三薄膜電晶體TFT3的汲極D3會跨過第二畫素電極ITO2，因此第三薄膜電晶體TFT3的汲極D3與第二畫素電極ITO2之間便產生一寄生電容Cx2。寄生電容Cx1、Cx2會使第一畫素電極ITO1與第二畫素電極ITO2的電壓差異拉開幅度減小，導致色偏問題無法有效地改善。承上述，如何避免子畫素P1中寄生電容Cx1、Cx2對於顯示品質的影響，實有其必要性。
本發明提供一種畫素陣列、聚合物穩定配向液晶顯示面板(PSA-LCD panel)以及光電裝置，其具有良好的顯示品質。
本發明提供一種畫素陣列，其包括多條掃描線、多條資料線以及多個子畫素。資料線與掃描線交錯以定義出多個子畫素區域。子畫素配置於子畫素區域內，各個子畫素分別與其中一條掃描線以及其中一條資料線電性連接，且排列於第n列中的各個子畫素包括一第一開關、一第二開關、一第一畫素電極、一第二畫素電極以及一第三開關。第一開關以及第二開關與第n條掃描線以及第m條資料線電性連接，且第二開關具有一訊號輸出端。第一畫素電極與第一開關電性連接。第二畫素電極與第二開關之訊號輸出端電性連接，其中第一畫素電極具有至少一位於訊號輸 出端上方之第一開口。第三開關與第(n+1)條掃描線以及第二畫素電極電性連接，第三開關具有一電性浮置端，且第二畫素電極具有至少一位於電性浮置端上方之第二開口。
在本發明一實施例中，前述之子畫素排列成多列，且排列於第n列的子畫素係與第n條掃描線以及第(n+1)條掃描線電性連接。
在本發明一實施例中，排列於第n列的子畫素中的第一畫素電極與第二畫素電極係位於第n條掃描線與第(n+1)條掃描線之間。
在本發明一實施例中，排列於第n列中的各個第一開關為一第一薄膜電晶體，而第一薄膜電晶體具有一與第n條掃描線電性連接之第一閘極、一與其中一條資料線電性連接之第一源極以及一與第一畫素電極電性連接之第一汲極。
在本發明一實施例中，排列於第n列中的各個第二開關為一第二薄膜電晶體，而第二薄膜電晶體具有一與第n條掃描線電性連接之第二閘極、一與其中一條資料線電性連接之第二源極以及前述之訊號輸出端。
在本發明一實施例中，排列於第n列中的各個第三開關為一第三薄膜電晶體，而第三薄膜電晶體具有一與第(n+1)條掃描線電性連接之第三閘極、一與第二畫素電極電性連接之第三源極以及前述之電性浮置端。
在本發明一實施例中，前述之電性浮置端係延伸至第一畫素電極下方。
在本發明一實施例中，前述之畫素陣列可進一步包括 多條彼此電性連接之共通線，分佈於各個第一畫素電極以及各個第二畫素電極下方。
在本發明一實施例中，前述之各個共通線分別沿著列方向延伸，而分佈於第一畫素電極下方的部分共通線具有至少一個位於第一開口下方的第一分支，且分佈於第二畫素電極下方的部分共通線具有至少一個位於第二開口下方的第二分支。
在本發明一實施例中，前述之第二分支位於電性浮置端下方。
在本發明一實施例中，前述之各子畫素中的電性浮置端與第二分支部分重疊，以耦合成一電容。
在本發明一實施例中，前述之各子畫素中的電性浮置端與第一畫素電極部分重疊，以耦合成一第一電容，而各子畫素中的電性浮置端與第二分支部分重疊，以耦合成一第二電容。
在本發明一實施例中，前述之各子畫素中的第一電容與第二電容不彼此堆疊。
在本發明一實施例中，前述之各個第一畫素電極包括一第一電極部、一第二電極部以及一第一連接部。第一連接部位於第一電極部與第二電極部之間，以使第一電極部與第二電極部被二分別位於第一連接部兩側之第一條狀開口所分隔，其中第一電極部透過第一連接部與第二電極部連接。
在本發明一實施例中，前述之第一條狀開口的面積總和為A1，而第一畫素電極與訊號輸出端的重疊面積總和為 A2，且開口比率A1/(A1+A2)大體上大於91%。
在本發明一實施例中，前述之各個第二畫素電極包括一第三電極部、一第四電極部以及一第二連接部，第二連接部位於第三電極部與第四電極部之間，以使第三電極部與第四電極部被二分別位於第二連接部兩側之第二條狀開口所分隔，其中第三電極部透過第二連接部與第四電極部連接。
在本發明一實施例中，前述之第二條狀開口的面積總和為A3，而第二畫素電極與電性浮置端的重疊面積總和為A4，且開口比率A3/(A3+A4)大體上大於93%。
在本發明一實施例中，前述之各個第一畫素電極包括一第一電極部、一第二電極部以及多個第一連接部，第一連接部位於第一電極部與第二電極部之間，以使第一電極部與第二電極部被至少一位於第一連接部之間的第一條狀開口所分隔，其中第一電極部透過第一連接部與第二電極部連接。
在本發明一實施例中，前述之第一條狀開口的面積為A1，而第一畫素電極與訊號輸出端的重疊面積總和為A2，且開口比率A1/(A1+A2)大體上大於91%。
在本發明一實施例中，前述之各個第二畫素電極包括一第三電極部、一第四電極部以及多個第二連接部，第二連接部位於第三電極部與第四電極部之間，以使第三電極部與第四電極部被至少一位於第二連接部之間的第二條狀開口所分隔，其中第三電極部透過第二連接部與第四電極部連接。
在本發明一實施例中，前述之第二條狀開口的面積為A3，而第二畫素電極與電性浮置端的重疊面積總和為A4，且開口比率A3/(A3+A4)大於93%。
本發明另提供一種聚合物穩定配向液晶顯示面板(PSA-LCD panel)，其包括一第一基板、一第二基板、二聚合物穩定配向層以及一液晶層。第一基板具有前述之畫素陣列，第二基板配置於第一基板上方，而二聚合物穩定配向層分別配置於第一基板與第二基板上。液晶層配置於聚合物穩定配向層之間。
本發明又提供一種光電裝置，其包括前述之畫素陣列或聚合物穩定配向液晶顯示面板。
基於上述，由於本發明在子畫素中的訊號輸出端以及電性浮置端上方採用開口設計，因此第一畫素電極與訊號輸出端之間的寄生電容以及第二畫素電極與電性浮置端之間的寄生電容可以被有效地降低。
為讓本發明之上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
【第一實施例】
圖3為本發明第一實施例之畫素陣列的示意圖，而圖4為本發明第一實施例之畫素陣列的佈局(layout)示意圖。請參照圖3與圖4，本實施例之畫素陣列200包括多條掃描線SL(圖3與圖4中僅繪示出掃描線SL(n)、SL(n+1)、SL(n+2))、多條資料線DL(圖3與圖4中僅繪示出資料 線DL(m)、DL(m+1))以及多個子畫素P2。前述之資料線DL與掃描線SL彼此交錯，以定義出多個子畫素區域R，且各個子畫素P2分別配置於子畫素區域R內。值得注意的是，圖3與圖4中僅繪示出部分的子畫素P2，而成陣列排列之子畫素P2的數量可依據所需顯示之影像解析度而作適當的變化。
各個子畫素P2分別與其中一條掃描線SL以及其中一條資料線DL電性連接。在本實施例中，子畫素P2係排列成多列，且排列於第n列的子畫素P2係與第n條掃描線SL(n)以及第(n+1)條掃描線SL(n+1)電性連接。詳言之，排列於第n列中的各個子畫素P2包括一第一開關TFT1、一第二開關TFT2、一第一畫素電極ITO1、一第二畫素電極ITO2以及一第三開關TFT3。第一開關TFT1以及第二開關TFT2與第n條掃描線SL(n)以及第m條資料線DL(m)電性連接，且第二開關TFT2具有一訊號輸出端D2’。第一畫素電極ITO1與第一開關TFT1電性連接。第二畫素電極ITO2與第二開關TFT2之訊號輸出端D2’電性連接，其中第一畫素電極ITO1具有至少一位於訊號輸出端D2’上方之第一開口AP1。在本實施例中，排列於第n列的子畫素P2中的第一畫素電極ITO1與第二畫素電極ITO2例如係位於第n條掃描線SL(n)與第(n+1)條掃描線SL(n+1)之間。此外，第三開關TFT3與第(n+1)條掃描線SL(n+1)以及第二畫素電極ITO2電性連接，而第三開關TFT3具有一電性浮置端D3’，且第二畫素電極ITO2具有至少一位於電性浮置端D3’上方之第二開口AP2。
從圖3與圖4可知，排列於第n列中的各個第一開關TFT1為一第一薄膜電晶體，而第一薄膜電晶體具有一第一閘極G1、一第一源極S1以及一第一汲極D1。第一閘極G1與第n條掃描線SL(n)電性連接，第一源極S1與其中一條資料線DL電性連接，而第一汲極D1則與第一畫素電極ITO1電性連接。此外，排列於第n列中的各個第二開關TFT2為一第二薄膜電晶體，而第二薄膜電晶體具有一第二閘極G2、第二源極S2以及前述之第二汲極D2。第二閘極G2與第n條掃描線SL(n)電性連接，而第二源極S2與其中一條資料線DL電性連接。值得注意的是，第二薄膜電晶體之第二汲極D2即為前述之訊號輸出端D2’。排列於第n列中的各個第三開關TFT3為一第三薄膜電晶體，而第三薄膜電晶體具有一第三閘極G3、第三源極S3以及第三汲極D3。第三閘極G3與第(n+1)條掃描線SL(n+1)電性連接，而第三源極S3與第二畫素電極ITO2電性連接。值得注意的是，第三薄膜電晶體的第三汲極D3即為前述之電性浮置端D3’。
如圖4所示，各個第一畫素電極ITO1包括一第一電極部E1、一第二電極部E2以及多個第一連接部C1，第一連接部C1位於第一電極部E1與第二電極部E2之間，以使第一電極部E1與第二電極部E2被至少一位於第一連接部C1之間的第一條狀開口AP1所分隔，其中第一電極部E1透過第一連接部C1與第二電極部E2連接。此外，各個第二畫素電極ITO2包括一第三電極部E3、一第四電極部E4以及多個第二連接部C2，第二連接部C2位於第三 電極部E3與第四電極部E4之間，以使第三電極部E3與第四電極部E4被至少一位於第二連接部C2之間的第二條狀開口AP2所分隔，其中第三電極部E3透過第二連接部C2與第四電極部E4連接。承上述，本實施例不限定第一連接部C1與第二連接部C2的數量以及形狀。
在本實施例中，第一汲極D1係與第一電極部E1電性連接，訊號輸出端D2’係延伸於第一電極部E1與第二電極部E2之間，並與第三電極部E3電性連接。此外，第三源極S3係與第四電極部E4電性連接，而電性浮置端D3’係延伸於第三電極部E3與第四電極部E4之間，且電性浮置端D3’的末端係延伸至第一畫素電極ITO1的第二電極部E2之下方。換言之，電性浮置端D3’與第一畫素電極ITO1會部分重疊，以耦合成一第一電容Ccs-a。
舉例而言，前述之第一條狀開口AP1的面積為A1，而第一畫素電極ITO1與訊號輸出端D2’的重疊面積總和為A2，且開口比率A1/(A1+A2)例如係大於91%。此外，前述之第二條狀開口AP2的面積為A3，而第二畫素電極ITO與電性浮置端D3’的重疊面積總和為A4，且開口比率A3/(A3+A4)例如係大於93%。
由於第一畫素電極ITO1具有第一開口AP1的設計，因此第一畫素電極ITO1與訊號輸出端D2’的重疊面積總和可因第一開口AP1而大幅下降，進而降低第一畫素電極ITO1與訊號輸出端D2’之間的寄生電容Cx1。此外，由於第二畫素電極ITO2具有第二開口AP2的設計，因此第二畫素電極ITO2與電性浮置端D3’的重疊面積總和可因第 二開口AP2而大幅下降，進而降低第二畫素電極ITO2與電性浮置端D3’之間的寄生電容Cx2。當寄生電容Cx1、Cx2被降低時，第一畫素電極ITO1與第二畫素電極ITO2的電壓差異拉開幅度便會增加，因此可以有效地解決色偏問題。
從圖4可以清楚得知，本實施例之畫素陣列200可進一步包括多條彼此電性連接之共通線COM，這些共通線COM係分佈於各個第一畫素電極ITO1以及各個第二畫素電極ITO2下方。詳言之，各條共通線COM分別沿著列方向延伸，而分佈於第一畫素電極ITO1下方的部分共通線COM具有至少一個位於第一開口AP1下方的第一分支BR1，且分佈於第二畫素電極ITO下方的部分共通線COM具有至少一個位於第二開口AP2下方的第二分支BR2。值得注意的是，第二分支BR2係位於電性浮置端D3’下方。換言之，電性浮置端D3’與第二分支BR2會部分重疊，以耦合成一第二電容Ccs-b。。
值得注意的是，第一電容Ccs-a位於第一畫素電極ITO下方，而第二電容Ccs-b則位於第二畫素電極ITO2下方，換言之，每個子畫素P2中的第一電容Ccs-a與第二電容Ccs-b不會彼此堆疊。如圖4所示，第二電容Ccs-b係位於第二畫素電極ITO2的中央區域上，此中央區域為領域交界處(domain boundary)。由於領域交界處為液晶導線不正確的暗域，因此，位於第二畫素電極ITO2的中央區域之第二電容Ccs-b並不會大幅影響開口率。此外，由於第一電容Ccs-a所佔據的面積通常小於第二電容Ccs-b所佔據 的面積，因此第一電容Ccs-a所導致的開口率損失有限。相較於習知將第一電容Ccs-a與第二電容Ccs-b相互堆疊之設計，本實施例可降低第二電容Ccs-b對於開口率所造成的損失。
在其他可行的實施例中，設計者可根據設計需求而省略電性浮置端D3’與第一畫素電極ITO1所耦合而成的第一電容Ccs-a。如圖3’與圖4’所示，電性浮置端D3’僅延伸於第二畫素電極ITO2下方，但並未延伸於第一畫素電極ITO1下方。
【第二實施例】
圖5為本發明第二實施例之畫素陣列的示意圖，圖6為本發明第二實施例之畫素陣列的佈局示意圖，而圖6A為沿著圖6中的剖面I-I’之剖面示意圖。請參照圖5與圖6，本實施例之畫素陣列200’與第一實施例之畫素陣列200類似，惟二者主要差異之處在於第一畫素電極ITO1與第二畫素電極ITO2的圖案。
從圖5與圖6可知，本實施例之各個第一畫素電極ITO1包括一第一電極部E1、一第二電極部E2以及一第一連接部C1。第一連接部C1位於第一電極部E1與第二電極部E2之間，以使第一電極部E1與第二電極部E2被二分別位於第一連接部C1兩側之第一條狀開口AP1所分隔，其中第一電極部C1透過第一連接部E1與第二電極部E2連接。此外，各個第二畫素電極ITO2包括一第三電極部E3、一第四電極部E4以及一第二連接部C2，第二連接 部C2位於第三電極部E3與第四電極部E4之間，以使第三電極部E3與第四電極部E4被二分別位於第二連接部C2兩側之第二條狀開口AP2所分隔，其中第三電極部E3透過第二連接部C2與第四電極部E4連接。
舉例而言，前述之第一條狀開口AP1的面積總和為A1，而第一畫素電極ITO1與訊號輸出端D2’的重疊面積總和為A2，且開口比率A1/(A1+A2)例如係大於91%。此外，前述之第二條狀開口AP2的面積總和為A3，而第二畫素電極ITO2與電性浮置端D3’的重疊面積總和為A4，且開口比率A3/(A3+A4)例如係大於93%。
在圖5與圖6的畫素陣列200’中，第一畫素電極ITO1與訊號輸出端D2’之間的寄生電容Cx1以及第二畫素電極ITO2與電性浮置端D3’之間的寄生電容Cx2(繪示於圖6A)同樣可以被有效地降低，所以色偏問題可以獲得解決。
在其他可行的實施例中，設計者可根據設計需求而省略電性浮置端D3’與第一畫素電極ITO1所耦合而成的第一電容Ccs-a。如圖5’與圖6’所示，電性浮置端D3’僅延伸於第二畫素電極ITO2下方，但並未延伸於第一畫素電極ITO1下方。
【第三實施例】
圖7為本發明之聚合物穩定配向液晶顯示面板的示意圖。請參照圖7，本實施例之聚合物穩定配向液晶顯示面板300包括一第一基板310、一第二基板320、二聚合物穩 定配向層330、340以及一液晶層350。第一基板310具有前述第一實施例或第二實施例中之畫素陣列(200或200’)，第二基板320配置於第一基板310上方，而二聚合物穩定配向層330、340分別配置於第一基板310與第二基板320上。此外，液晶層350配置於二聚合物穩定配向層330、340之間。值得注意的是，液晶層350在製作上係採用包含有能夠被能量源聚合之單體的液晶材料，當能量源(如紫外光)被施加於液晶層350時，這些能夠被能量源聚合之單體會分別聚合於第一基板310與第二基板320之表面上，以形成二聚合物穩定配向膜330、340。
圖8為本發明之光電裝置的示意圖。請參照圖8，本實施例亦提出一種光電裝置400，其包括前述第一實施例或第二實施例中之畫素陣列(200或200’)或是圖7中的聚合物穩定配向液晶顯示面板300。而光電裝置之類型包括可攜式產品(如手機、攝影機、照相機、筆記型電腦、遊戲機、手錶、音樂播放器、電子信件收發器、地圖導航器、數位相片、或類似之產品)、影音產品(如影音放映器或類似之產品)、螢幕、電視、看板、投影機內之面板等。
100、200、200’‧‧‧畫素陣列
P1、P2‧‧‧子畫素
SL、SL(n)、SL(n+1)、SL(n+2)‧‧‧掃描線
DL、DL(m)、DL(m+1)‧‧‧資料線
R‧‧‧子畫素區域
TFT1、TFT2、TFT3‧‧‧開關元件
G1、G2、G3‧‧‧閘極
S1、S2、S3‧‧‧源極
D1、D2、D3‧‧‧汲極
D2’‧‧‧訊號輸出端
D3’‧‧‧電性浮置端
AP1‧‧‧第一開口
AP2‧‧‧第二開口
Ccs-a‧‧‧第一電容
Ccs-b‧‧‧第二電容
Cs1、Cs2‧‧‧儲存電容
Cx1、Cx2‧‧‧寄生電容
CLC1、CLC2‧‧‧液晶電容
ITO1‧‧‧第一畫素電極
E1‧‧‧第一電極部
E2‧‧‧第二電極部
C1‧‧‧第一連接部
ITO2‧‧‧第二畫素電極
E3‧‧‧第三電極部
E4‧‧‧第四電極部
C2‧‧‧第二連接部
COM、COM1、COM2‧‧‧共通線
300‧‧‧聚合物穩定配向液晶顯示面板
310‧‧‧第一基板
320‧‧‧第二基板
330、340‧‧‧聚合物穩定配向層
350‧‧‧液晶層
400‧‧‧光電裝置
圖1為一種畫素陣列的等效電路圖。
圖2為圖1中單一子畫素的示意圖。
圖3為本發明第一實施例之畫素陣列的示意圖。
圖3’為本發明第一實施例之另一種畫素陣列的示意 圖。
圖4為本發明第一實施例之畫素陣列的佈局示意圖。
圖4’為本發明第一實施例之另一種畫素陣列的佈局示意圖。
圖5為本發明第二實施例之畫素陣列的示意圖。
圖5’為本發明第二實施例之另一種畫素陣列的示意圖。
圖6為本發明第二實施例之畫素陣列的佈局示意圖。
圖6’為本發明第二實施例之另一種畫素陣列的佈局示意圖。
圖6A為沿著圖6中的剖面I-I’之剖面示意圖。
圖7為本發明之聚合物穩定配向液晶顯示面板的示意圖。
圖8為本發明之光電裝置的示意圖。
200‧‧‧畫素陣列
P2‧‧‧子畫素
SL、SL(n)、SL(n+1)~SL(n+2)‧‧‧掃描線
DL、DL(m)、DL(m+1)‧‧‧資料線
R‧‧‧子畫素區域
TFT1、TFT2、TFT3‧‧‧開關元件
G1、G2、G3‧‧‧閘極
S1、S2、S3‧‧‧源極
D1、D2、D3‧‧‧汲極
D2’‧‧‧訊號輸出端
D3’‧‧‧電性浮置端
AP1‧‧‧第一開口
AP2‧‧‧第二開口
Ccs-a‧‧‧第一電容
Ccs-b‧‧‧第二電容
Cx1、Cx2‧‧‧寄生電容
ITO1‧‧‧第一畫素電極
ITO2‧‧‧第二畫素電極
COM‧‧‧共通線

Claims (22)

  1. 一種畫素陣列，包括：多條掃描線；多條資料線，與該些掃描線交錯以定義出多個子畫素區域；多個子畫素，配置於該些子畫素區域內，各該子畫素分別與其中一條掃描線以及其中一條資料線電性連接，其中排列於第n列中的各該子畫素包括：一第一開關；一第二開關，該第一開關以及該第二開關與第n條掃描線以及第m條資料線電性連接，且該第二開關具有一訊號輸出端；一第一畫素電極，與該第一開關電性連接；一第二畫素電極，與該第二開關之該訊號輸出端電性連接，其中該第一畫素電極具有至少一位於該訊號輸出端上方之第一開口；以及一第三開關，與第(n+1)條掃描線以及該第二畫素電極電性連接，其中該第三開關具有一電性浮置端，且該第二畫素電極具有至少一位於該電性浮置端上方之第二開口。
  2. 如申請專利範圍第1項所述之畫素陣列，其中該些子畫素排列成多列，且排列於第n列的子畫素係與第n條掃描線以及第(n+1)條掃描線電性連接。
  3. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n列的子畫素中的該第一畫素電極與該第二畫素電極 係位於第n條掃描線與第(n+1)條掃描線之間。
  4. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n列中的各該第一開關為一第一薄膜電晶體，而該第一薄膜電晶體具有一與第n條掃描線電性連接之第一閘極、一與其中一條資料線電性連接之第一源極以及一與該第一畫素電極電性連接之第一汲極。
  5. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n列中的各該第二開關為一第二薄膜電晶體，而該第二薄膜電晶體具有一與第n條掃描線電性連接之第二閘極、一與其中一條資料線電性連接之第二源極以及該訊號輸出端。
  6. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n列中的各該第三開關為一第三薄膜電晶體，而該第三薄膜電晶體具有一與第(n+1)條掃描線電性連接之第三閘極、一與該第二畫素電極電性連接之第三源極以及該電性浮置端。
  7. 如申請專利範圍第1項所述之畫素陣列，其中該電性浮置端係延伸至該第一畫素電極下方。
  8. 如申請專利範圍第1項所述之畫素陣列，更包括多條彼此電性連接之共通線，分佈於各該第一畫素電極以及各該第二畫素電極下方。
  9. 如申請專利範圍第8項所述之畫素陣列，其中各該共通線分別沿著列方向延伸，分佈於該些第一畫素電極下方的部分共通線具有至少一個位於該些第一開口下方的第一分支，而分佈於該些第二畫素電極下方的部分共通線具 有至少一個位於該些第二開口下方的第二分支。
  10. 如申請專利範圍第9項所述之畫素陣列，其中該第二分支位於該些電性浮置端下方。
  11. 如申請專利範圍第10項所述之畫素陣列，其中各該子畫素中的該電性浮置端與該第二分支部分重疊，以耦合成一電容。
  12. 如申請專利範圍第10項所述之畫素陣列，其中各該子畫素中的該電性浮置端與該第一畫素電極部分重疊，以耦合成一第一電容，而各該子畫素中的該電性浮置端與該第二分支部分重疊，以耦合成一第二電容。
  13. 如申請專利範圍第12項所述之畫素陣列，其中各該子畫素中的該第一電容與該第二電容不彼此堆疊。
  14. 如申請專利範圍第1項所述之畫素陣列，其中各該第一畫素電極包括：一第一電極部；一第二電極部；以及一第一連接部，位於該第一電極部與該第二電極部之間，以使該第一電極部與該第二電極部被二分別位於該第一連接部兩側之第一條狀開口所分隔，其中該第一電極部透過該第一連接部與該第二電極部連接。
  15. 如申請專利範圍第14項所述之畫素陣列，其中該些第一條狀開口的面積總和為A1，而該第一畫素電極與該訊號輸出端的重疊面積總和為A2，且開口比率A1/(A1+A2)大體上大於91%。
  16. 如申請專利範圍第1項所述之畫素陣列，其中各該第二畫素電極包括：一第三電極部；一第四電極部；以及一第二連接部，位於該第三電極部與該第四電極部之間，以使該第三電極部與該第四電極部被二分別位於該第二連接部兩側之第二條狀開口所分隔，其中該第三電極部透過該第二連接部與該第四電極部連接。
  17. 如申請專利範圍第16項所述之畫素陣列，其中該些第二條狀開口的面積總和為A3，而該第二畫素電極與該電性浮置端的重疊面積總和為A4，且開口比率A3/(A3+A4)大體上大於93%。
  18. 如申請專利範圍第1項所述之畫素陣列，其中各該第一畫素電極包括：一第一電極部；一第二電極部；以及多個第一連接部，位於該第一電極部與該第二電極部之間，以使該第一電極部與該第二電極部被至少一位於該些第一連接部之間的第一條狀開口所分隔，其中該些第一電極部透過該第一連接部與該第二電極部連接。
  19. 如申請專利範圍第18項所述之畫素陣列，其中該第一條狀開口的面積為A1，而該第一畫素電極與該訊號輸出端的重疊面積總和為A2，且開口比率A1/(A1+A2)大體上大於91%。
  20. 如申請專利範圍第1項所述之畫素陣列，其中各該 第二畫素電極包括：一第三電極部；一第四電極部；以及多個第二連接部，位於該第三電極部與該第四電極部之間，以使該第三電極部與該第四電極部被至少一位於該些第二連接部之間的第二條狀開口所分隔，其中該第三電極部透過該第二連接部與該第四電極部連接。
  21. 如申請專利範圍第20項所述之畫素陣列，其中該些第二條狀開口的面積為A3，而該第二畫素電極與該電性浮置端的重疊面積總和為A4，且開口比率A3/(A3+A4)大體上大於93%。
  22. 一種聚合物穩定配向液晶顯示面板，包括：一第一基板，具有如申請專利範圍第1項所述之畫素陣列；一第二基板，配置於該第一基板上方；二聚合物穩定配向層，分別配置於該第一基板與該第二基板上；以及一液晶層，配置於該些聚合物穩定配向層之間。
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