TWI407222B - 畫素陣列、聚合物穩定配向液晶顯示面板以及畫素陣列的驅動方法 - Google Patents

畫素陣列、聚合物穩定配向液晶顯示面板以及畫素陣列的驅動方法 Download PDF

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Description

畫素陣列、聚合物穩定配向液晶顯示面板以及畫素陣 列的驅動方法
本發明是有關於一種畫素陣列，且特別是有關於一種具有良好顯示品質的畫素陣列。
隨著液晶顯示器不斷地朝向大尺寸的顯示規格發展，為了克服大尺寸顯示下的視角問題，液晶顯示面板的廣視角技術也必須不停地進步與突破。其中，多域垂直配向式(Multi-domain Vertical Alignment，MVA)液晶顯示面板以及聚合物穩定配向(Polymer stabilized alignment，PSA)液晶顯示面板即為現行常見的廣視角技術。為了改善液晶顯示面板中的色偏問題(color washout)，已有進階型多域垂直配向式(Advanced-MVA)液晶顯示面板被提出，其主要是將各個子畫素區分為主顯示區域(main display region)以及子顯示區域(sub-display region)，並透過適當的電路設計以及驅動方法，使同一個子畫素中的主顯示區域以及子顯示區域分別具有不同跨壓，以改善色偏問題。在現有技術中，將各個子畫素區分為主顯示區域以及子顯示區域之設計概念已被應用於聚合物穩定配向液晶顯示面板中。
圖1為一種畫素陣列的等效電路圖，而圖2為圖1中單一子畫素的示意圖。請參照圖1與圖2，畫素陣列100包括多個子畫素P1，且各個子畫素P1包括一第一薄膜電晶體TFT1、一第二薄膜電晶體TFT2、一第三薄膜電晶體 TFT3、與第一薄膜電晶體TFT1電性連接的第一畫素電極ITO1以及與第二薄膜電晶體TFT2電性連接的第二畫素電極ITO2。第一畫素電極ITO1會與一共通線COM1耦合而形成一第一儲存電容Cs1，且第一畫素電極ITO1會與對向基板(如彩色濾光基板)上之一共通電極(未標示)耦合而形成一第一液晶電容CLC1。類似地，第二畫素電極ITO2會與一共通線COM2耦合而形成一第二儲存電容Cs2，且第二畫素電極ITO2會與對向基板(如彩色濾光基板)上之共通電極(未標示)耦合而形成一第二液晶電容CLC2。
從圖1與圖2可知，在與掃描線SL(n-1)電性連接的子畫素P1中，第一薄膜電晶體TFT1以及第二薄膜電晶體TFT2的閘極G1、G2會與掃描線SL(n-1)電性連接，而第三薄膜電晶體TFT3的閘極G3會與下一條掃描線SL(n)電性連接。此外，第三薄膜電晶體TFT3的源極S3與第二畫素電極ITO2電性連接，而第三薄膜電晶體TFT3的汲極D3與第一畫素電極ITO1耦合成第一電容Ccs-a，且第三薄膜電晶體TFT3的汲極D3與第一畫素電極ITO1下方之共通線COM1耦合成第二電容Ccs-b。當施加一高電壓(Vgh)於掃描線SL(n-1)時，影像資料可透過資料線DL(m-1)、DL(m)寫入與掃描線SL(n-1)連接的子畫素中，此時，第一畫素電極ITO1與第二畫素電極ITO2的電壓是相同的。接著，當施加一高電壓於掃描線SL(n)時，第一電容Ccs-a與第二電容Ccs-b會使第一畫素電極ITO1的電壓與第二畫素電極ITO2的電壓不同。
由於第二薄膜電晶體TFT2的汲極D2會跨過第一畫素電極ITO1而與第二畫素電極ITO2連接，因此第二薄膜電晶體TFT2的汲極D2與第一畫素電極ITO1之間便產生一寄生電容Cx1。此外，由於第三薄膜電晶體TFT3的汲極D3會跨過第二畫素電極ITO2，因此第三薄膜電晶體TFT3的汲極D3與第二畫素電極ITO2之間便產生一寄生電容Cx2。寄生電容Cx1、Cx2會使第一畫素電極ITO1與第二畫素電極ITO2的電壓差異拉開幅度減小，導致色偏問題無法有效地改善。承上述，如何避免子畫素P1中寄生電容Cx1、Cx2對於顯示品質的影響，實有其必要性。
本發明提供一種畫素陣列、聚合物穩定配向液晶顯示面板(PSA-LCD panel)以及畫素陣列的驅動方法，其具有良好的顯示品質。
本發明提供一種畫素陣列，其包括多條掃描線、多條資料線以及多個子畫素。資料線與掃描線交錯以定義出多個子畫素區域。子畫素配置於子畫素區域內，各個子畫素分別與相鄰二條掃描線以及資料線之其中一條電性連接。排列於第n 列中的各個子畫素包括一第一開關、一第一畫素電極、一第二開關、一第三開關以及一第二畫素電極。第一畫素電極與第一開關電性連接。第一開關以及第二開關與第n 條掃描線以及第m 條資料線電性連接，且第二開關具有一第一訊號輸出端。第三開關與第(n +i) 條掃描線電性連接，其中第三開關具有一與第一訊號輸出端電性連接 之訊號輸入端以及一第二訊號輸出端，且i 為正整數。第二畫素電極與第二訊號輸出端電性連接。第一訊號輸出端與第一畫素電極以及第二畫素電極電性絕緣。第一訊號輸出端延伸至第二畫素電極下方，以與第二畫素電極形成耦合電容。
本發明另提供一種聚合物穩定配向液晶顯示面板(PSA-LCD panel)，其包括一第一基板、一第二基板、二聚合物穩定配向層以及一液晶層。第一基板具有前述之畫素陣列，第二基板配置於第一基板上方，二聚合物穩定配向層分別配置於第一基板與第二基板上。液晶層配置於聚合物穩定配向層之間。
本發明又提供一種畫素陣列的驅動方法，適於驅動前述之畫素陣列。畫素陣列的驅動方法包括以下步驟。依序開啟前述之掃描線，並透過前述之資料線將影像資料記錄於各個子畫素中。當第n 條掃描線被施加一開啟電壓以開啟第一開關與第二開關時，排列於第n 列的各個子畫素中的第一畫素電極以及第一訊號輸出端與對應之資料線導通，且第二畫素電極的電壓受到第一訊號輸出端耦合而改變。當(n +i) 條掃描線被施加一開啟電壓以開啟第三開關時，排列於第n 列的各個子畫素中的第二畫素電極與第一訊號輸出端導通。
基於上述，由於本發明之第二開關的第一訊號輸出端與與第三開關電性連接，其中第三開關與第二畫素電極電性連接，且第一訊號輸出端與第二畫素電極會形成耦合電容，因此第一畫素電極與第二畫素電極的電壓差距可因電 容耦合效應而被有效地拉開。
為讓本發明之上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
 【第一實施例】
圖3為本發明第一實施例之畫素陣列的示意圖，而圖4A為本發明第一實施例之畫素陣列的佈局(layout)示意圖。請參照圖3與圖4A，本實施例之畫素陣列200a包括多條掃描線SL(圖3與圖4A中僅繪示出掃描線SL(n )、SL(n +1 )、SL(n +i -1 )、SL(n +i ))、多條資料線DL(圖3與圖4A中僅繪示出資料線DL(m )、DL(m +1 ))以及多個子畫素P2。前述之資料線DL與掃描線SL彼此交錯，以定義出多個子畫素區域R，且各個子畫素P2分別配置於子畫素區域R內。值得注意的是，圖3與圖4A中僅繪示出部分的子畫素P2，而成陣列排列之子畫素P2的數量可依據所需顯示之影像解析度而作適當的變化。
各個子畫素P2分別與相鄰二條掃描線SL以及資料線DL之其中一條電性連接。在本實施例中，子畫素P2係排列成多列，且排列於第n 列的子畫素P2係與第n 條掃描線SL(n )、第(n +1) 條掃描線SL(n +1 )以及資料線DL(m)電性連接。詳言之，排列於第n 列中的各個子畫素P2包括一第一開關TFT1、一第一畫素電極ITO1、一第二開關TFT2、一第三開關TFT3以及一第二畫素電極ITO2。第一 開關TFT1以及第二開關TFT2與第n 條掃描線SL(n)以及第m 條資料線DL(m )電性連接，且第二開關TFT2具有一第一訊號輸出端D2’。第三開關TFT3與第(n +i) 條掃描線SL(n +i) 電性連接，其中第三開關TFT3具有一與第一訊號輸出端D2’電性連接之訊號輸入端D3’以及一第二訊號輸出端S3’，且i 為正整數。在本實施例中，i =1，亦即，第三開關TFT3與第(n +1) 條掃描線SL(n +1 )電性連接。
第二畫素電極ITO2與第二訊號輸出端S3’電性連接。第一訊號輸出端D2’延伸至第二畫素電極ITO2下方，以與第二畫素電極ITO2形成耦合電容Cx3。另外，本實施例之第一訊號輸出端D2’更延伸至第一畫素電極ITO1下方，以與第一畫素電極ITO1形成一寄生電容Cx4。除此之外，在本實施例中，排列於第n 列的子畫素P2係與第n 條掃描線SL(n )以及第(n +1) 條掃描線SL(n +1 )電性連接。另外，排列於第n 列的子畫素P2中的第一畫素電極ITO1與第二畫素電極ITO2例如係位於第n 條掃描線SL(n )與第(n +1) 條掃描線SL(n +1 )之間。
從圖3與圖4A可知，排列於第n 列中的各個第一開關TFT1為一第一薄膜電晶體，而第一薄膜電晶體具有一第一閘極G1、一第一源極S1以及一第一汲極D1。第一閘極G1與第n 條掃描線SL(n )電性連接，第一源極S1與資料線DL之其中一條電性連接，而第一汲極D1則與第一畫素電極ITO1電性連接。
此外，排列於第n 列中的各個第二開關TFT2為一第二薄膜電晶體，而第二薄膜電晶體具有一第二閘極G2、第 二源極S2以及前述之第一訊號輸出端D2’。第二閘極G2與第n 條掃描線SL(n )電性連接，而第二源極S2與前述資料線DL之其中一條電性連接。值得注意的是，第二薄膜電晶體之第二汲極D2即為前述之第一訊號輸出端D2’。
排列於第n 列中的各個第三開關TFT3為一第三薄膜電晶體，而第三薄膜電晶體具有一第三閘極G3、訊號輸入端D3’以及第二訊號輸出端S3’。第三閘極G3與第(n +1 )條掃描線SL(n +1 )電性連接，而第三源極S3與第二畫素電極ITO2電性連接。值得注意的是，第三薄膜電晶體的訊號輸入端D3’即為第三汲極D3，而第二訊號輸出端S3’即為第三源極S3。
從圖4A可以清楚得知，本實施例之畫素陣列200a可進一步包括多條彼此電性連接之共通線COM，這些共通線COM係分佈於各個第一畫素電極ITO1以及各個第二畫素電極ITO2下方。詳言之，各條共通線COM分別沿著列方向延伸。
圖5為第一畫素電極、第二畫素電極與第一訊號輸出端的電壓變化示意圖。請同時參照圖4A與圖5，當於時間t(n )施加一開啟電壓(Vgh)於掃描線SL(n )時，影像資料由資料線DL(m )透過第一開關TFT1寫入與掃描線SL(n )連接的子畫素中，此時，第一畫素電極ITO1的電壓會上升。另一方面，影像資料亦會由資料線DL(m )透過第二開關TFT2寫入第一訊號輸出端D2’內，此時，第一訊號輸出端D2’的電壓與第一畫素電極ITO1的電壓實質上相同。除此之外，由於第一訊號輸出端D2’延伸至第二畫素電極ITO2 下方，與第二畫素電極ITO2形成耦合電容Cx3，故第二畫素電極ITO2的電壓會因耦合效應而被同步提升。而當停止施加開啟電壓(Vgh)於掃描線SL(n )時，第一畫素電極ITO1、第二畫素電極ITO2與第一訊號輸出端D2’的電壓會因饋通效應(feed through)而略為下降。
接著，當於時間t(n +1 )施加開啟電壓(Vgh)於掃描線SL(n +1 )時，第一畫素電極ITO1、第二畫素電極ITO2與第一訊號輸出端D2’的電壓會因開啟電壓的施加而再度被提升。另一方面，第三開關TFT3會被開啟，而使得第一訊號輸出端D2’與第二畫素電極ITO2處於導通狀態。在電荷重新分配的情況下，第一訊號輸出端D2’的電壓會逐漸下降，而第二畫素電極ITO2的電壓會逐漸上升，直到第一訊號輸出端D2’的實質上電壓等於第二畫素電極ITO2的電壓為止。最後，如圖5所示，當停止施加開啟電壓於掃描線SL(n +1 )時，第一畫素電極ITO1與第二畫素電極ITO2會因饋通效應而略為下降，且二者電壓不相同。
由上述可知，藉由耦合電容Cx3的耦合效應，第二畫素電極ITO2的電壓可被同步提升，但仍小於第一畫素電極ITO1的電壓。換言之，第一畫素電極ITO1的電壓與第二畫素電極ITO2所呈現的電壓不同，而可以改善色偏問題。
從另一個角度觀看，本發明之實施例亦提供一種驅動畫素陣列的方法，其包括以下步驟。依序開啟掃描線SL，並透過資料線DL將影像資料記錄於各個子畫素P2中。當 第n 條掃描線SL(n )被施加開啟電壓以開啟第一開關TFT1與第二開關TFT2時，排列於第n 列的各個子畫素P2中的第一畫素電極ITO1以及第一訊號輸出端D2’與對應之資料線DL(m )導通，且第二畫素電極ITO2的電壓受到第一訊號輸出端D2’耦合而改變。當(n +i) 條掃描線SL(n +i )被施加開啟電壓以開啟第三開關TFT3時，排列於第n 列的各個子畫素中的第二畫素電極ITO2與第一訊號輸出端D2’導通，其中i 為正整數且本實施例之i =1。另外，在本實施例中，當(n +i) 條掃描線被施加開啟電壓以開啟第三開關TFT3時，第二畫素電極ITO2的電壓上升，而第一訊號輸出端D2’的電壓下降。
圖4B為本發明另一實施例之畫素陣列的佈局示意圖。本實施例之畫素陣列200b與圖4A之畫素陣列200a類似，惟二者主要差異之處在於：位於第一訊號輸出端D2’上方的第一畫素電極ITO1具有一開口AP，以有效減少圖4A中第一訊號輸出端D2’與第一畫素電極ITO1所形成的寄生電容Cx4。亦即，本實施例是藉由將第一訊號輸出端D2’上方所對應的第一畫素電極ITO1挖空或第一訊號輸出端D2’與第一畫素電極ITO1之間介電層墊厚以減少寄生電容Cx4。
圖4C為本發明另一實施例之畫素陣列的佈局示意圖。本實施例之畫素陣列200c與圖4A之畫素陣列200a類似，惟二者主要差異之處在於：第一訊號輸出端D2’與訊號輸入端D3’之間具有一分支BR。分支BR使得部分的第一訊號輸出端D2’與第二畫素電極ITO2下方之共通線 COM會耦合成第一電容Ccs-c。
【第二實施例】
圖6為本發明第二實施例之畫素陣列的示意圖，而圖7A為本發明第二實施例之畫素陣列的佈局示意圖。請參照圖6與圖7A，本實施例之畫素陣列200’與圖4C之畫素陣列200c類似，惟二者主要差異之處在於：畫素陣列200’進一步包括至少一耦合導體210(圖7A僅示意地繪示2個)。耦合導體210與第一畫素電極ITO1電性連接，其中耦合導體210延伸至第二畫素電極ITO2下方，以與第二畫素電極ITO2形成寄生電容Cx5。
從圖7A可知，本實施例之該耦合導體係沿著第二畫素電極ITO2的邊緣延伸。在圖6與圖7A的畫素陣列200’中，耦合電容Cx3為改善色偏問題的主要電容，而耦合導體210與第二畫素電極ITO2的寄生電容Cx5可有效降低第一訊號輸出端D2’與第一畫素電極ITO1之間的寄生電容Cx4，故第一畫素電極ITO1的電壓與第二畫素電極ITO2的電壓更可以被有效地拉開，而具有良好的顯示品質。
圖7B為本發明另一實施例之畫素陣列的佈局示意圖。本實施例之畫素陣列200”與圖畫素陣列200’類似，惟二者主要差異之處在於：耦合導體210與第二畫素電極ITO2電性連接，其中耦合導體210延伸至第一畫素電極ITO1下方，以與第一畫素電極ITO1形成寄生電容Cx5。
在另外的實施例中，可以與圖7A與圖7B所表示的實施例類似，惟二者主要差異之處在於：位於第一訊號輸 出端D2’上方的第一畫素電極ITO1具有一開口AP，以有效減少圖7A與圖7B中第一訊號輸出端D2’與第一畫素電極ITO1所形成的寄生電容Cx4。
【第三實施例】
圖8為本發明之聚合物穩定配向液晶顯示面板的示意圖。請參照圖8，本實施例之聚合物穩定配向液晶顯示面板300包括一第一基板310、一第二基板320、二聚合物穩定配向層330a、330b以及一液晶層340。第一基板310具有前述第一實施例或第二實施例中之畫素陣列(200或200’)，第二基板320配置於第一基板310上方，而二聚合物穩定配向層330a、330b分別配置於第一基板310與第二基板320上。此外，液晶層340配置於二聚合物穩定配向層330a、330b之間。值得注意的是，液晶層340在製作上係採用包含有能夠被能量源聚合之單體的液晶材料，當能量源(如紫外光)被施加於液晶層340時，這些能夠被能量源聚合之單體會分別聚合於第一基板310與第二基板320之表面上，以形成二聚合物穩定配向層330a、330b。
基於上述，由於本發明之第二開關的第一訊號輸出端與第三開關電性連接，其中第三開關與第二畫素電極電性連接，且第一訊號輸出端與第二畫素電極會形成耦合電容，因此第一畫素電極與第二畫素電極的電壓差距可因電容耦合效應而被有效地拉開，進而使本發明之畫素陣列能夠提供較佳的影像品質。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離 本發明之精神和範圍內，當可作些許之更動與潤飾，故本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100、200a、200b、200c、200’、200”‧‧‧畫素陣列
210‧‧‧耦合導體
P1、P2‧‧‧子畫素
SL、SL(n )、SL(n +1 )、SL(n +i -1 )、SL(n +i )‧‧‧掃描線
DL、DL(m )、DL(m +1 )‧‧‧資料線
R‧‧‧子畫素區域
TFT1、TFT2、TFT3‧‧‧開關元件
G1、G2、G3‧‧‧閘極
S1、S2、S3‧‧‧源極
D1、D2、D3‧‧‧汲極
D2’‧‧‧第一訊號輸出端
D3’‧‧‧訊號輸入端
S3’‧‧‧第二訊號輸出端
Ccs-a、Ccs-c‧‧‧第一電容
Ccs-b‧‧‧第二電容
Cx1、Cx2、Cx4、Cx5‧‧‧寄生電容
Cx3‧‧‧耦合電容
Cs1、Cs2‧‧‧儲存電容
CLC1、CLC2‧‧‧液晶電容
ITO1‧‧‧第一畫素電極
ITO2‧‧‧第二畫素電極
COM、COM1、COM2‧‧‧共通線
300‧‧‧聚合物穩定配向液晶顯示面板
310‧‧‧第一基板
320‧‧‧第二基板
330a、330b‧‧‧聚合物穩定配向層
340‧‧‧液晶層
400‧‧‧光電裝置
AP‧‧‧開口
BR‧‧‧分支
圖1為一種畫素陣列的等效電路圖。
圖2為圖1中單一子畫素的示意圖。
圖3為本發明第一實施例之畫素陣列的示意圖。
圖4A為本發明第一實施例之畫素陣列的佈局示意圖。
圖4B為本發明另一實施例之畫素陣列的佈局示意圖。
圖4C為本發明另一實施例之畫素陣列的佈局示意圖。
圖5為第一畫素電極、第二畫素電極與第一訊號輸出端的電壓變化示意圖。
圖6為本發明第二實施例之畫素陣列的佈局示意圖。
圖7A為本發明第二實施例之畫素陣列的佈局示意圖。
圖7B為本發明另一實施例之畫素陣列的佈局示意圖。
圖8為本發明之聚合物穩定配向液晶顯示面板的示意圖。
200a‧‧‧畫素陣列
P2‧‧‧子畫素
SL、SL(n)、SL(n+1)、SL(n +i -1 )、SL(n +i )‧‧‧掃描線
DL、DL(m)、DL(m+1)‧‧‧資料線
R‧‧‧子畫素區域
TFT1、TFT2、TFT3‧‧‧開關元件
G1、G2、G3‧‧‧閘極
S1、S2、S3‧‧‧源極
D1、D2、D3‧‧‧汲極
Cx3、Cx4‧‧‧耦合電容
Cs1、Cs2‧‧‧儲存電容
CLC1、CLC2‧‧‧液晶電容
ITO1‧‧‧第一畫素電極
ITO2‧‧‧第二畫素電極

Claims (14)

  1. 一種畫素陣列，包括：多條掃描線；多條資料線，與該些掃描線交錯以定義出多個子畫素區域；多個子畫素，配置於該些子畫素區域內，各該子畫素分別與相鄰二條掃描線以及該些資料線之其中一條電性連接，其中排列於第n 列中的各該子畫素包括：一第一開關；一第一畫素電極，與該第一開關電性連接；一第二開關，該第一開關以及該第二開關與第n 條掃描線以及第m 條資料線電性連接，且該第二開關具有一第一訊號輸出端，其中n 、m 為正整數；一第三開關，與第(n +i) 條掃描線電性連接，其中該第三開關具有一與該第一訊號輸出端電性連接之訊號輸入端以及一第二訊號輸出端，且i 為正整數；以及一第二畫素電極，與該第二訊號輸出端電性連接，其中該第一訊號輸出端與該第一畫素電極以及該第二畫素電極電性絕緣，而該第一訊號輸出端延伸至該第二畫素電極下方，以與該第二畫素電極形成一耦合電容。
  2. 如申請專利範圍第1項所述之畫素陣列，其中該些子畫素排列成多列，且排列於第n 列的子畫素係與第n 條掃描線以及第(n +1) 條掃描線電性連接。
  3. 如申請專利範圍第1項所述之畫素陣列，其中排列 於第n 列的子畫素中的該第一畫素電極與該第二畫素電極係位於第n 條掃描線與第(n +1) 條掃描線之間。
  4. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n 列中的各該第一開關為一第一薄膜電晶體，而該第一薄膜電晶體具有一與第n 條掃描線電性連接之第一閘極、一與該些資料線之其中一條電性連接之第一源極以及一與該第一畫素電極電性連接之第一汲極。
  5. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n 列中的各該第二開關為一第二薄膜電晶體，而該第二薄膜電晶體具有一與第n 條掃描線電性連接之第二閘極、一與該些資料線之其中一條電性連接之第二源極以及該第一訊號輸出端。
  6. 如申請專利範圍第1項所述之畫素陣列，其中排列於第n 列中的各該第三開關為一第三薄膜電晶體，而該第三薄膜電晶體具有一與第(n +1 )條掃描線電性連接之第三閘極、該訊號輸入端以及該第二訊號輸出端。
  7. 如申請專利範圍第1項所述之畫素陣列，其中該第一訊號輸出端更延伸至該第一畫素電極下方，以與該第一畫素電極形成一第一寄生電容。
  8. 如申請專利範圍第7項所述之畫素陣列，更包括至少一耦合導體，與該第一畫素電極電性連接，其中該耦合導體延伸至該第二畫素電極下方，以與該第二畫素電極形成一第二寄生電容。
  9. 如申請專利範圍第8項所述之畫素陣列，其中該耦合導體係沿著該第二畫素電極的邊緣延伸。
  10. 如申請專利範圍第7項所述之畫素陣列，更包括至 少一耦合導體，與該第二畫素電極電性連接，其中該耦合導體延伸至該第一畫素電極下方，以與該第一畫素電極形成一第二寄生電容。
  11. 如申請專利範圍第10項所述之畫素陣列，其中該耦合導體係沿著該第一畫素電極的邊緣延伸。
  12. 一種聚合物穩定配向液晶顯示面板，包括：一第一基板，具有申請專利範圍第1項所述之畫素陣列；一第二基板，配置於該第一基板上方；二聚合物穩定配向層，分別配置於該第一基板與該第二基板上；以及一液晶層，配置於該些聚合物穩定配向層之間。
  13. 一種畫素陣列的驅動方法，適於驅動申請專利範圍第1項所述之畫素陣列，該畫素陣列的驅動方法包括：依序開啟該些掃描線，並透過該些資料線將影像資料記錄於各該子畫素中；當第n 條掃描線被施加一開啟電壓以開啟該第一開關與該第二開關時，排列於第n 列的各該子畫素中的該些第一畫素電極以及該些第一訊號輸出端與對應之資料線導通，且該第二畫素電極的電壓受到該第一訊號輸出端耦合而改變；當(n +i) 條掃描線被施加一開啟電壓以開啟該第三開關時，排列於第n 列的各該子畫素中的該些第二畫素電極與該第一訊號輸出端導通。
  14. 如申請專利範圍第13項所述之畫素陣列的驅動方法，當(n +i) 條掃描線被施加一開啟電壓以開啟該第三開關時，該第二畫素電極的電壓上升，而該第一訊號輸出端的電壓下降。
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