TWI390885B - 正交分頻多工之時變週期性延遲分集 - Google Patents

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Description

正交分頻多工之時變週期性延遲分集
本文獻通常係關於無線通信，且尤其係關於多天線系統中之訊號傳輸。
在無線通信系統中，來自傳輸器之射頻(RF)調變訊號可經由諸多傳播路徑到達接收器。傳播路徑之特徵通常由於諸多諸如衰落及多路之因素而隨時間變化。為提供抵抗有害路徑影響之分集並改良效能，可使用多個傳輸天線及接收天線。多輸入多輸出(MIMO)通信系統使用多個(NT )傳輸天線及多個(NR )接收天線來用於資料傳輸。可將由NT 個傳輸天線及NR 個接收天線所形成之MIMO通道分解為NS 個獨立通道，其中NS min{NT ,NR }。NS 個獨立通道之每一者亦可稱作MIMO通道之空間子通道(或傳輸通道)且對應於一維度。
若傳輸天線與接收天線之間的傳播路徑係線性獨立的(意即，一路徑上之傳輸不形成為其它路徑上之傳輸的線性組合，其對於至少一範圍而言通常為真實情況)，則當天線數目增加時準確地接收資料傳輸的可能性增加。通常，當傳輸天線及接收天線之數目增加時，分集增加且效能改良。
為進一步改良通道之分集，可利用傳輸分集技術。已研究了許多傳輸分集技術。該種技術之一為傳輸延遲分集。在傳輸延遲分集中，傳輸器利用兩個傳輸相同訊號之天線，其中第二天線傳輸藉由第一天線傳輸之經延遲之複本。藉由如此作，第二天線藉由建立可收集於接收器處之第二組獨立多路元件來建立分集。若藉由第一傳輸器產生之多路衰落，則藉由第二傳輸器產生之多路可不衰落，後者情況下接收器處將維持可接受之訊雜比(SNR)。因為在接收器處僅估算複合TX0＋TX1通道，所以此技術易於實施。傳輸延遲分集之最大缺點為，其增加了通道之有效延遲分佈，且當藉由第二天線引入之多路落至第一天線之多路並與第一天線之多路破壞性地相互作用時，傳輸延遲分集可較差地執行，藉此降低了分集之整體水平。
為處理標準延遲分集問題，已開發額外的延遲分集技術。該種技術之一稱作週期性延遲分集。週期性延遲分集為將ni 個符號每一者之樣本以作為部分該符號進行傳輸之次序來移動的延遲。除符號之有效部分以外之彼等樣本係在該符號之開端部分中傳輸。在該技術中，為每一固定延遲或次序之樣本預先申請一字首以用於自特定天線傳輸作為部分符號之樣本。然而，週期性延遲容許更長之延遲，其將另外限於保護間隔時段之部分以避免符號間干擾。
週期性延遲分集機制可在通道中採用頻率選擇性且因此可為平通道提供分集益處。然而，當通道不在自身之時間選擇中且其不具有自身之時間選擇時，該機制不提供任何時間分集。舉例而言，若兩個傳輸天線在慢衰落或靜態通道中，則循環移動△m 可為如此以使例如H1 ( n ) 及H2 ( n ) 之兩個通道一直破壞性地(或建設性地)相加。
因此，需要提供最小化經利用以提供分集之通道的破壞性或建設性相加之機率的延遲分集機制。
在一態樣中，一種用於提供傳輸分集之方法包括在一第一延遲週期之後向第一天線提供一第一符號，在不同於該第一延遲週期之一第二延遲週期之後向該第一天線提供一第二符號，且在不同於該第一延遲週期及該第二延遲週期之一第三延遲週期之後向該第一天線提供一第三符號。
在另一態樣中，一傳輸器包括至少兩個天線、一調變器及一延遲電路，該延遲電路將自調變器至天線之符號輸出延遲一隨時間變化之延遲週期。
在一額外態樣中，無線傳輸器包括至少兩個天線及一儲存各包括複數個樣本之複數個符號之記憶體，其中該記憶體在一第一延遲之後向該等至少兩個天線之一天線輸出一第一符號之複數個樣本且在一第二延遲之後向該天線輸出複數個符號之一第二符號。該第一延遲與該第二延遲不同。
在另一態樣中，一傳輸器包括至少三個天線、一調變器、一耦接至該調變器與該等至少兩個天線之一者之間的第一延遲電路，該第一延遲電路將自該調變器至該天線之符號輸出延遲一隨時間變化之延遲週期，及一耦接至該調變器與該等至少兩個天線之另一者之間的第二延遲電路，該第二延遲電路將自該調變器至該另一天線之符號輸出延遲另一隨時間變化之延遲週期。該另一延遲週期與該延遲週期不同。
在另一態樣中，一種用於在多通道通信系統中提供傳輸分集的方法包括對將於第一天線上傳輸之一第一符號應用一第一相移且對將於第二天線上傳輸之該第一符號應用一不同於該第一相移之第二相移。
在另一態樣中，一傳輸器包括至少兩個天線、一調變器及一對由該調變器至該天線之符號輸出應用一隨時間變化之相移的相移電路。
以下結合附加圖式所陳述之詳細描述意欲作為例示性實施例之描述且不欲代表僅為其中可實施本發明之實施例。貫穿此描述所使用之術語"例示性"意味"用作一實例、實體或說明"，且應不必將其解釋為較佳的或優於其它實施例的。詳細描述包含為提供對本發明之徹底瞭解的特定細節。然而，熟習此項技術者將顯見，可在無此等特定細節的情況下實踐本發明。在某些情況下，為避免本發明之概念模糊不清，以方塊圖形式展示熟知之結構及設備。
多通道通信系統包含多輸入多輸出(MIMO)通信系統、正交分頻多工(OFDM)通信系統、使用OFDM之MIMO系統(意即，MIMO－OFDM系統)，及其它類型之傳輸。為清晰起見，特定為MIMO系統描述各種態樣及實施例。
MIMO系統使用多個(NT )傳輸天線及多個(NR )接收天線來用於資料傳輸。可將由NT 個傳輸及NR 個接收天線所形成之MIMO通道分解為NS 個獨立通道，其中NS min{NT ,NR }。NS 個獨立通道之每一者亦可稱作MIMO通道之空間子通道(或傳輸通道)。空間子通道之數目係藉由MIMO通道之本征模型的數目決定，該本征模型之數目又取決於描述NT 個傳輸天線與NR 個接收天線之間的響應之通道響應矩陣H。通道響應矩陣H之元素係由獨立高斯隨機變數{h i,j }組成，其中i＝1,2,...NR ，及j＝1,2,...NT ，其中hi , j 為第j個傳輸天線與第i個接收天線之間的耦合(意即，複合增益)。為簡明起見，假定通道響應矩陣H為滿秩(意即，NS ＝NT NR )且可自NT 個傳輸天線之每一者傳輸一獨立資料流。
圖1為MIMO系統100中之傳輸器系統110及接收器系統150之一實施例的方塊圖。在傳輸器系統110處，將諸多資料流之訊務資料自資料源112提供至傳輸(TX)資料處理器114。在一實施例中，每一資料流在各自的傳輸天線上傳輸。TX資料處理器114基於一經選擇而用於一資料流之特定編碼機制而使每一資料流之訊務資料格式化、編碼及交錯以提供經編碼資料。
可使用(例如)劃時多工(TDM)或劃碼多工(CDM)將每一資料流之編碼資料與導頻資料一起進行多路傳輸。導頻資料通常為由以已知方式(即使可能)處理的已知資料模式且可在接收器系統處用以估算通道響應。隨後，基於經選擇以用於一資料流之特定調變機制(例如，BPSK、QSPK、M－PSK、或M－QAM)來調變(意即，符號映射)每一資料流之經多路傳輸之導頻資料及經編碼資料以提供調變符號。可藉由處理器130提供之控制來判定每一資料流之資料速率、編碼及調變。
隨後將所有資料流之調變符號提供至可進一步處理該等調變符號(例如，用於OFDM)之TX MIMO處理器120。TX MIMO處理器120隨後將NT 個調變符號流提供至NT 個傳輸器(TMTR)122a至122t。每一傳輸器122接收並處理各自的符號流以提供一或多個類比訊號，且進一步調節(例如，放大、過濾及增頻轉換)該等類比訊號以提供適用於在MIMO通道上傳輸之調變訊號。隨後分別自NT 個天線124a至124t傳輸來自傳輸器122a至122t之NT 個調變訊號。
在接收器系統150處，經傳輸之調變訊號藉由NR 個天線152a至152r接收，且自每一天線152所接收之訊號提供至各自的接收器(RCVR)154。每一接收器154調節(例如，過濾、放大及降頻轉換)各自經接收之訊號、數位化經調節之訊號以提供樣本，且進一步處理該等樣本以提供對應的"經接收"之符號流。
隨後，RX MIMO/資料處理器160基於特定接收器處理技術接收並處理來自NR 個接收器154之NR 個經接收之符號流，以提供NT 個"經偵測"之符號流。以下進一步詳細描述RX MIMO/資料處理器160進行之處理。每一經偵測之符號流包含係為作為對應資料流所傳輸之調變符號之估算的符號。RX MIMO/資料處理器160隨後解調變、解交錯並解碼每一經偵測之符號流，來恢復資料流之訊務資料。RX MIMO/資料處理器160進行之處理與在傳輸器系統110處由TX MIMO處理器120及TX資料處理器114所執行之處理互補。
RX MIMO處理器160可(例如)基於與訊務資料一起進行多路傳輸的導頻，推導出NT 個傳輸天線與NR 個接收天線之間的通道響應估算。通道響應估算可用於在接收器處執行空間或空間/時間處理。RX MIMO處理器160可進一步估算經偵測之符號流之訊雜干擾比(SNR)及可能其它的通道特徵，且將此等數值提供至處理器170。RX MIMO/資料處理器160或處理器170可進一步推導出用於系統之"運算性"SNR的估算，該估算指示通信鏈路之狀況。處理器170隨後提供通道狀態資訊(CSI)，其可包括關於通信鏈路及/或所接收之資料流之各種類型的資訊。舉例而言，CSI可僅包括運算性SNR。該CSI隨後藉由TX資料處理器178處理、藉由調變器180調變、藉由傳輸器154a至154r調節並被傳輸回傳輸器系統110。
在傳輸器系統110處，來自接收器系統150之調變訊號藉由天線124接收、藉由接收器122調節、藉由解調變器140解調變並藉由RX資料處理器142處理，以恢復藉由接收器系統報告之CSI。隨後將所報告之CSI提供至處理器130並將其用於(1)判定將資料流之資料速率及編碼及調變機制，及(2)產生用於TX資料處理器114及TX MIMO處理器120之各種控制。
處理器130及170指示在與其耦接之包含適當之傳輸及接收資料處理器的傳輸器及接收器系統處之操作。記憶體132及172分別為處理器130及170所使用之程式碼及資料提供儲存區。
用於OFDM MIMO系統之模型可表達為：y ＝Hx ＋n , Eq(1)其中y 為所接收之向量，意即， y ＝[y 1 y2 ...] T ，其中{y i }為在第i個接收之天線上接收之項且i {1,...N R }；x 為所傳輸之向量，意即，x ＝[x1 x2 ...]T ，其中{x j }為自第j個傳輸天線所傳輸之項且j{1,...N T }；H 為MIMO通道之通道響應矩陣；n 為加性白高斯雜訊(AWGN)，其具有一平均向量0 及一協方差矩陣△ n ＝σ2 I ，其中0 為一零向量，I 為單位矩陣，該矩陣沿對角線為1且其它各地方皆為0，且σ2 為雜訊變化量；且[.]T 表示[.]之轉置。
由於在傳播環境中散射，自NT 個傳輸天線所傳輸之NT 個符號流在接收器處彼此干擾。詳言之，自一傳輸天線所傳輸之給定符號流可藉由所有NR 個接收天線以不同振幅及相位來接收。每一經接收之訊號隨後可包含NT 個經傳輸符號流每一者之成分。NR 個經接收之訊號將共同地包含所有NT 個經傳輸之符號流。然而，此等NT 個符號流係分散於NR 個經接收之訊號中。
在接收器處，各種處理技術可用於處理NR 個經接收之訊號以偵測NT 個經傳輸之符號流。可將此等接收器處理技術分組成兩個主要類別：空間及空間時間接收器處理技術(其亦稱作均衡技術)，及"連續歸零/均衡及干擾取消"接收器處理技術(其亦稱作"連續干擾取消"或"連續取消"接收器處理技術)。
圖2為傳輸器單元200之一部分的方塊圖，該部分可為傳輸器系統之傳輸器部分的一實施例，例如，諸如圖1中之傳輸器系統110。在一實施例中，獨立資料速率及編碼及調變機制可用於NT 個在NT 個傳輸天線每一者上所傳輸之資料流(意即，基於每一天線獨立編碼及調變)。可基於由處理器130所提供之控制來判定每一傳輸天線之特定資料速率及編碼及調變機制，且資料速率可由如上所述來判定。
在一實施例中，傳輸器單元200包含一傳輸資料處理器202，該傳輸資料處理器202根據獨立編碼及調變機制而接收、編碼及調變每一資料流以提供經調變符號及傳輸MIMO。傳輸資料處理器202及傳輸資料處理器204分別為圖1之傳輸資料處理器114及傳輸MIMO處理器120之一實施例。
如圖2所示，在一實施例中，傳輸資料處理器202包含解多工器210、NT 個編碼器212a至212t，及NT 個通道交錯器214a至214t(意即，用於每一傳輸天線之一組解多工器、編碼器及通道交錯器)。解多工器210為NT 個傳輸天線將資料(意即，資訊位元)解多工成NT 個資料流以用於資料傳輸。NT 個資料流可與藉由速率控制功能性所判定之不同資料速率相關聯，在一實施例中該速率控制功能性可藉由處理器130或170(圖1)提供。將每一資料流提供至各自的編碼器212a至212t。
每一編碼器212a至212t接收各自的資料流且基於經選擇而用於彼資料流之特定編碼機制而編碼各自的資料流以提供經編碼位元。在一實施例中，可使用該編碼以增加資料傳輸的可靠性。在一實施例中，該編碼機制可包含循環冗餘校檢(CRC)編碼、卷積編碼、渦輪編碼、區塊編碼或其類似物的任何組合。隨後將來自編碼器212a至212t每一者之經編碼位元提供至各自的通道交錯器214a至214t，該等通道交錯器214a至214t基於特定交錯機制而交錯經編碼位元。該交錯對經編碼位元提供時間分集、允許基於用於資料流之傳輸通道之平均SNR來傳輸資料、抗擊衰落，且進一步移除用以形成每一調變符號之經編碼位元之間的相關性。
將來自每一通道交錯器214a至214t之經編碼及經交錯之位元提供至傳輸MIMO處理器204之各自的符號映射區塊222a至222t，各符號映射區塊映射此等位元以形成調變符號。
藉由處理器130所提供之調變控制來判定由每一符號映射區塊222a至222t實施之特定調變機制。每一符號映射區塊222a至222t將qj 個經編碼及經交錯之位元之集合分組以形成非二進位符號，且對應於所選擇之調變機制(例如，QPSK、M－PSK、M－QAM或一些其它的調變機制)進一步將每一非二進位符號映射至訊號群中之一特定點。每一經映射之訊號點對應於一有關Mj 的調變符號，其中Mj 對應於經選擇以用於第j個傳輸天線之特定調變機制且Mj ＝2q q 。對符號映射區塊222a至222t隨後提供NT 個調變符號流。
在圖2中所說明之特定實施例中，傳輸MIMO處理器204亦包含一調變器224及逆快速傅立葉變換(IFFT)區塊226a至226t，以及符號映射區塊222a至222t。調變器224調變樣本以形成用於適當子頻帶及傳輸天線上之NT 個流之調變符號。此外，調變器224以經禁止之功率水平提供NT 個符號流之每一者。在一實施例中，調變器224可根據藉由處理器(例如，處理器130或170)控制之跳躍序列來調變符號。在該實施例中，對於每一符號組或每一符號區塊、訊框或傳輸循環之部分訊框而言，調變NT 個符號流之頻率可變化。
每一IFFT區塊226a至226t自調變器224接收各自的調變符號流。每一IFFT區塊226a至226t將NF 個調變符號之集合分組以形成對應之調變符號向量，並使用逆快速傅立葉變換將每一調變符號向量轉換成其時域表示(其稱作OFDM符號)。可設計IFFT區塊226a至226t以在任何數目之頻率子通道(例如，8、16、32、...、NF )上執行該逆變換。
將藉由IFFT區塊226a至226t產生之調變符號向量之每一時域表示提供至相關聯之循環字首產生器228a至228t。循環字首產生器228a至228t將具有固定數目之樣本的字首預先申請至組成一OFDM符號的NS 個樣本以形成一對應之傳輸符號，其中該等固定數目之樣本通常為該OFDM符號末端之若干樣本。字首經設計以改良抵抗諸如由頻率選擇性衰落引起之通道分散之有害路徑影響的效能。循環字首產生器228a至228t隨後將一傳輸符號流提供至相關聯之延遲元件230a至230t－1。
每一延遲元件230a至230t－1對自循環字首產生器228a至228t輸出之每一符號提供一延遲。在一實施例中，藉由每一延遲元件230a至230t－1提供之延遲隨時間變化。在一實施例中，此延遲係該種延遲：其在藉由循環字首產生器輸出之連續符號之間或將自傳輸器單元200連續傳輸之連續符號之間變化。在其它實施例中，該延遲可在具有二個、三個、四個或更多符號之組之間變化，其中組中之每一符號具有相同的延遲。在額外的實施例中，一訊框或叢發週期中之所有符號將具有相同的延遲，其中每一訊框或叢發週期對於每一符號具有不同於之前或之後的訊框或叢發週期的延遲。
同樣，在圖2所描繪之實施例中，藉由每一延遲元件230a至230t－1所提供之延遲與藉由任一其它的延遲元件所提供之延遲不同。另外，儘管圖2描繪循環字首產生器228a未耦接至一延遲元件，但其它實施例可將延遲元件提供至每一循環字首產生器228a至228t之輸出端。
將藉由延遲元件230a至230t－1輸出之符號提供至相關聯之傳輸器232a至232t，其導致根據延遲元件230a至230t－1提供之延遲藉由天線232a至232t來傳輸符號。
如上所述，在一實施例中，每一延遲元件230a至230t－1提供之時變延遲△m 隨時間變化。在一實施例中，根據Eq.2之延遲，自天線m將第i個OFDM符號傳輸為經傳輸符號：
在此情況下所得之總通道可描述為： 其中Hm (i,n)係用於自第m個傳輸天線至接收天線之通道脈衝響應的通道n離散傅立葉變換(DFT)係數。
此時變延遲之使用可將用以改良效能之頻率選擇性與時間選擇性皆引進通道。舉例而言，藉由使用不同子載波及不同OFDM符號上之傳輸符號之時變延遲，可同時提供時間選擇性與頻率選擇性兩者。此外，在向多使用者傳輸的情況中，由於每一使用者之接收器將具有不同於任一其它使用者之接收器之通道狀況，因此可使用藉由改變符號之延遲而提供之通道時間變化以向多個使用者之每一者提供分集增益。
在一實施例中，延遲△ m (i )可能隨時間以線性方式變化，其中每一連續符號或連續符號之組延遲n*β個樣本，其中β為一常數且n自0、1、...、N－1變化，其中N為一訊框、叢發週期或符號流中之符號數目。在另一實施例中，該延遲△ m (i )可為基於偽隨機序列之關於一鄰近通道(意即，NT 個天線之一天線)的之前及/或之後符號之隨機延遲。在一額外的實施例中，該延遲可隨f(x)變化，其中f為諸如正弦、餘弦或其它時變函數的函數，且x自0、1、...、N－1變化或為其一些倍數，其中N為一訊框、叢發週期或符號流中符號之數目。在每一先前實施例中，延遲亦可基於回饋資訊而變化，在該情況下，接收器發送回描述總通道狀況之通道品質指標且△ m (i )經變化以改良總品質。
參看圖3，其說明應用於自相同天線傳輸之符號的時變延遲之一實施例。符號S1 、S2 、S3 及S4 經產生以分別在連續時槽T1 、T2 、T3 及T4 期間傳輸。每一符號S1 、S2 、S3 及S4 包括九個樣本NS 1 、NS 2 、NS 3 、NS 4 、NS 5 、NS 6 、NS 7 、NS 8 、NS 9 ，及一兩個樣本之循環字首NC 1 與NC 2 ，其分別為樣本NS 8 及NS 9 。應注意，對於每一符號每一樣本之內容可能不同。應注意，樣本NS 1 、NS 2 、NS 3 、NS 4 、NS 5 、NS 6 、NS 7 、NS 8 、NS 9 將經組合來以NS 1 、NS 2 、NS 3 、NS 4 、NS 5 、NS 6 、NS 7 、NS 8 、NS 9 之次序形成符號S1 。
例如延遲元件230a之延遲元件隨後對自相同天線傳輸之符號S1 、S2 、S3 及S4 提供延遲。在圖3所描繪之實施例中，符號S1 之延遲為一樣本週期t1 。在符號S1 之後將於相同天線上立即傳輸之下一符號S2 延遲兩個樣本週期t1 及t2 。在符號S2 之後將於相同天線上立即傳輸之下一符號S3 延遲三個樣本週期t1 、t2 及t3 。在符號S3 之後將於相同天線上立即傳輸之下一符號S4 延遲四個樣本週期t1 、t2 、t3 及t4 。若將在相同天線上傳輸額外的符號，則下一連續符號將以具有五個樣本週期t1 、t2 、t3 、t4 及t5 之延遲來傳輸。以此方式，線性時變延遲可應用於自一天線的傳輸，其可為或可不為MIMO系統之一部分。
應注意，延遲週期之線性變化無需為連續一樣本週期的，而亦可為連續兩個或兩個以上之樣本週期的，例如，第一符號S1 可延遲三個樣本週期，第二符號S2 延遲六個樣本週期，第三符號S3 延遲九個樣本週期，且第四符號S4 延遲十二個樣本週期。同樣，該線性變化無需在每一連續符號(若無符號組)之間變化，例如，符號S1 及S2 各延遲一樣本週期，且符號S3 及S4 各延遲兩個或兩個以上之樣本週期。
參看圖4，其說明應用於在多個天線上傳輸之符號的時變延遲之一實施例。將自天線A1 、A2 、A3 及A4 傳輸相同符號S1 。符號S1 包括九個樣本NS 1 、NS 2 、NS 3 、NS 4 、NS 5 、NS 6 、NS 7 、NS 8 、NS 9 ，及一兩個樣本之循環字首NC 1 與NC 2 ，其分別為樣本NS 8 及NS 9 。自第一天線A1 ，符號S1 不延遲任一樣本週期。自第二天線A2 ，符號S1 延遲一樣本週期t1 。自第三天線A3 ，符號S1 延遲兩個樣本週期t1 及t2 。自第四天線A4 ，符號S1 延遲三個樣本週期t1 、t2 及t3 。同樣，除藉由天線A1 、A2 、A3 及A4 提供之空間分集之外可在MIMO系統中提供時間及頻率分集。
所提供來用於圖4中所描繪之機制的時間分集及其變化提供了一相同符號之相同樣本碰撞之可能性的減少，從而最小化破壞性或建設性通道相加之機率。
應注意，於相同天線上傳輸之相同符號間之延遲變化無需為線性的或甚至與其它天線上之延遲相關，只要符號將大體上同時傳輸，則其應在每一天線上延遲一不同的量。
應注意，所利用之次序無需對應於天線之數目且可變化而用於更小的組或可在大於天線數目之範圍內變化。
此外，如結合圖2所論述，該延遲可為隨機的且可基於諸如正弦、餘弦、或其它函數之函數。在一些實施例中，該延遲週期係限於一符號中之若干樣本，其中可在固定或隨機數目之符號之後重複該延遲週期。同樣，應注意符號間之延遲可為樣本週期之部分且不限於為多個完整的樣本週期。在一實施例中，可藉由使用傳輸器單元200之一或多個時脈之時脈週期之部分來實施部分延遲。
參看圖5，其說明提供時變延遲分集之傳輸器單元之另一實施例的方塊圖。傳輸器單元500大體上與傳輸器單元200相同。此外，縮放調整電路554a至554t－1各耦接至延遲元件530a至530t－1之一輸出端。縮放調整電路554a至554t－1對藉由每一延遲元件530a至530t－1所提供之延遲提供一固定之純量移位。舉例而言，對每一延遲應用一固定移位，以使(例如)若應用一0.5之恆定移位，則一樣本週期延遲將為0.5個樣本週期，兩個樣本週期延遲將為一樣本週期，且五個樣本週期延遲將為二點五個樣本週期。在一實施例中，每一縮放調整電路554a至554t－1提供不同於任一其它縮放調整電路之移位。在一實施例中，對縮放調整電路554a至554t－1提供一線性級數，即縮放調整電路554a提供小於554b之移位，554b之移位小於554c之移位，等等。
應注意，雖然圖5描繪循環字首產生器228a未耦接至延遲元件，但其它實施例可將延遲元件提供至每一循環字首產生器228a至228t之輸出端。同樣，雖然圖5描繪循環字首產生器228a未耦接至一縮放調整電路，但其它實施例可不管延遲電路是否耦接至該循環字首產生器，而將縮放調整電路提供至每一循環字首產生器228a至228t之輸出端。
參看圖6，其說明能利用時變延遲分集之接收器單元之一實施例的方塊圖。分別藉由天線602a至602r接收，及藉由接收器604a至604r處理經傳輸之訊號，以提供NR 個樣本流，隨後將該等NR 個樣本流提供至一RX處理器606。
在解調變器608內，循環字首移除元件612a至612r及快速傅立葉變換(FFT)區塊614a至614r提供NR 個符號流。循環字首移除元件612a至612r將每一傳輸符號中所包含之循環字首移除以提供對應的經恢復之OFDM符號。
FFT區塊614a至614r隨後使用快速傅立葉變換來變換符號流之每一經恢復之符號以提供用於每一傳輸符號週期的NF 個頻率子通道之NF 個經恢復之調變符號的向量。FFT區塊614a至614r將NR 個經接收之符號流提供至空間處理器620。
空間處理器620對NR 個經接收之符號流執行空間或空間時間處理以提供NT 個經偵測之符號流，其為NT 個經傳輸之符號流的估算。空間處理器620可建構線性ZF均衡器、通道相關矩陣求逆(CCMI)均衡器、最小均方誤差(MMSE)均衡器、MMSE線性均衡器(MMSE－LE)、判定回饋均衡器(DFE)或一些其它均衡器，在美國專利申請案序列號第09/993,087號、09/854,235號、09/826,481號及09/956,444號中描述及描繪了該等均衡器，其中每一案之全文以引用的方式倂入本文中。
如結合圖2及圖5所論述，空間處理器620可補償傳輸器之延遲元件及/或縮放調整電路所提供之時變延遲。在一實施例中，可藉由具有延遲機制(例如，線性、根據偽隨機序列之隨機或已知為接收器單元600之先驗的函數)而提供此補償。例如，可藉由具有由所有傳輸器利用之相同機制或藉由提供關於用作傳輸器與接收器單元600之間通信的初始化部分之機制的資訊來提供此認知。
多工器/解多工器622隨後多工/解多工傳輸經偵測之符號，且將ND 個資料流之ND 個聚集的經偵測符號流提供至ND 個符號解映射元件624a至624r。每一符號解映射元件624a至624r隨後根據與用於資料流之調變機制互補之解調變機制解調變經偵測之符號。隨後將來自ND 個符號解映射元件624a至624r之ND 個經解調變之資料流提供至RX資料處理器610。
在RX資料處理器610內，藉由通道解交錯器632a至632r以與在傳輸器系統處用於資料流之執行方式互補之方式來解交錯每一經解調變之資料流，且進一步藉由解碼器634a至634r以與在傳輸器系統處之執行方式互補之方式來解碼該等經解交錯之資料。舉例而言，若分別在傳輸器單元執行渦輪編碼或卷積編碼，則渦輪解碼器或Viterbi解碼器可用於解碼器634a至634r。來自每一解碼器634a至634r之經解碼資料流代表經傳輸資料流之估算。解碼器634a至634r亦可提供每一經接收之封包的狀態(例如，指示其是否被正確地接收或錯誤地接收)。解碼器634a至634r可進一步儲存未正確解碼之封包的經解調變之資料，從而此資料可與來自隨後的遞增傳輸之資料組合並被解碼。
在圖6展示之一實施例中，通道估算器640估算通道響應及雜訊變化量且將此等估算提供至處理器650。可基於導頻之經偵測符號而估算通道響應及雜訊變化量。
可設計處理器650以執行各種關於速率選擇的函數。舉例而言，處理器650可基於通道估算及諸如調變機制之其它參數而判定可用於每一資料流之最大資料速率。
參看圖7，其說明延遲元件之一實施例的方塊圖。處理器700經由匯流排702與記憶體704耦接。將記憶體704用以儲存經提供以用於傳輸之調變符號的時域表示之樣本。將每一符號之樣本儲存於處理器700所知的記憶體位置中。處理器700隨後可利用符號之連續組或訊框或叢發週期的任何所要之時變延遲來指示記憶體704輸出每一符號之樣本。
如結合圖3及4所述，對於每一符號而言，延遲可在每一符號之間變化，對於將連續傳輸之符號組而言，延遲可在不同訊框或叢發週期中之符號之間變化。記憶體之使用允許將任何預定或適當之機制用以提供符號延遲並因此提供可基於通道狀況以及預定機制(例如，線性變化)而變化之時間分集。
參看圖8，其說明用於提供時變延遲分集之方法的一實施例之流程圖。提供代表一或多個進行了逆快速傅立葉變換之後的經調變符號之樣本，區塊800。隨後將循環字首預先申請至每一經調變之符號，區塊802。字首大小可隨需要而變化且在一實施例中可為三十二個或多於三十二個樣本。
隨後將包含循環字首之樣本儲存於記憶體中，區塊804，在一實施例中，該記憶體可為一緩衝器。在一實施例中，根據在預先申請循環字首之後提供經調變符號樣本之次序而將每一經調變符號之樣本儲存於記憶體中。在其它實施例中，可以任何所要之次序儲存每一經調變符號之樣本。根據第一延遲N移除將傳輸之一符號之第一符號，區塊806。隨後根據不同於該第一延遲之第二延遲移除將傳輸之下一符號，區塊808。第二延遲及稍後符號之額外延遲可延遲N＋β，其中β可為自N的線性增加或減少、自N的隨機變化或為某些函數值。
隨後作一關於需延遲之符號是否已傳輸或將另外對其加以利用的判定，區塊810。若未經傳輸，則根據相同的時間變化量將額外延遲提供至來自記憶體或緩衝器之另外的符號輸出，區塊808。若已傳輸，則隨後該處理終止，且如結合區塊800至804所論述的提供額外之符號，區塊812。
參看圖9，其說明提供時變延遲分集之傳輸器單元的另一實施例之方塊圖。傳輸器單元900大體上與傳輸器單元200相同。然而，並非利用耦接至IFFT區塊226a至226t之輸出端的延遲元件230a至230t－1，而將相移電路930a至930t－1耦接至IFFT區塊926a至926t輸入端之前，其中該等相移電路接收調變器924之輸出。相移電路930a至930t－1對每一符號之樣本提供一時變相移。舉例而言，相移電路930a可對第一符號之樣本提供相移Φ1 且對藉由調變器輸出之下一或稍後符號之樣本提供相移Φ1 。隨後符號之樣本可具有不同或相同量之相移。此相移可在藉由IFFT區塊926a至926t進行IFFT應用之後在時域中作為延遲來操作。
每一相移電路930a至930t可提供與任一其它的相移電路930a至930t不同之相移，以便自多個天線傳輸之一相同符號之延遲每一天線皆不同。該變化量可為或可不為關於任何其它天線所應用之相移的函數。
在一實施例中，藉由每一相移電路930a至930t提供之相移為如此以使相移在藉由調變器輸出之連續符號之間變化。在其它實施例中，該相移可在具有二個、三個、四個或更多符號之組之間變化，其中組中每一符號具有一相同的相移。在額外的實施例中，一訊框或叢發週期中之所有符號將具有相同的相移，其中每一訊框或叢發週期對於每一符號具有不同於之前或之後訊框或叢發週期的相移。
應注意，雖然圖9描繪相移電路未耦接至循環字首產生器928a，但其它實施例可將相移電路提供至每一循環字首產生器928a至928t之輸出端。
在一些實施例中，調變器及相移電路可包括一處理器。
參看圖10，其說明用於提供時變延遲分集之方法的一實施例之流程圖。藉由調變器輸出之第一符號之樣本進行第一相移Φ1 ，區塊1000。隨後，第二符號之樣本進行不同於Φ1 之相移Φ2 ，區塊1002。隨後作一額外符號是否已進行了相移之判定，區塊1004。若沒有，則隨後對藉由調變器輸出之下一符號之樣本應用可同於或不同於Φ1 或Φ2 之相移，區塊1006。隨後重複此處理直至無額外符號需相移。
若無額外符號需相移，則符號進行IFFT，區塊1008，預先申請循環字首，區塊1010，及將符號儲存至記憶體(在一實施例中可為一緩衝器)中，區塊1012。在一實施例中，根據在預先申請循環字首之後提供經調變符號樣本之次序而將每一經調變符號之樣本儲存於記憶體中。在其它實施例中，每一經調變符號之樣本可以任何所需的次序來進行儲存。
在一些實施例中，相移在連續符號、符號組或訊框之間可相差一相位，該相位等於一恆定角度與對應於符號流中之符號位置之變化數目或其它序數相乘之積。該恆定角度可為固定的或可根據其它時間常數而變化。同樣，應用於欲用於不同天線之符號的恆定角度可不同。
在其它實施例中，相移可根據關於任何其它符號之隨機相位而變化。此可藉由使用偽隨機碼來提供以產生相移。
應注意，雖然圖10說明等待執行IFFT及循環字首之預先申請直到對訊框或叢發週期之所有符號應用相移，但每一符號可在對訊框或叢發週期之每一符號完成相移之前個別地或成組地進行IFFT及循環字首之預先申請。
應注意，傳輸器200及500可接收並處理個別調變符號流(對於無OFDM之MIMO)或傳輸符號流(對於具有OFDM之MIMO)以產生經調變之訊號，隨後將自相關聯之天線傳輸該經調變之訊號。亦可實施用於傳輸器單元之其它設計且其在本發明之範疇內。
在以下美國專利申請案中進一步詳細描述用於具有OFDM及無OFDM之MIMO系統的編碼及調變：2001年11月6日申請之題為"Multiple－Access Multiple－Input Multiple－Output(MIMO)Communication System"之美國專利申請案序列號第09/993,087號；2001年5月11日申請之題為"Method and Apparatus for Processing Data in a Multiple－Input Multiple－Output (MIMO)Communication System Utilizing Channel State Information"之美國專利申請案序列號第09/854,235號；分別於2001年3月23日及2001年9月18日申請之題皆為"Method and Apparatus for Utilizing Channel State Information in a Wireless Communication System"之美國專利申請案序列號第09/826,481號及09/956,449號；2001年2月1日申請之題為"Coding Scheme for a Wireless Communication System"之美國專利申請案序列號第09/776,075號；及2000年3月30日申請之題為"High Efficiency,High Performance Communications System Employing Multi－Carrier Modulation"之美國專利申請案序列號第09/532,492號。
此等申請案皆讓渡給本申請案之受讓人且以引用的方式倂入本文中。序列號第09/776,075號申請案描述一可藉由以相同的基礎碼(例如，卷積碼或渦輪碼)來編碼資料及調整穿孔以達到所要的速率而達成不同速率之編碼機制。亦可使用其它編碼及調變機制，且此係在本發明之範疇內的。
熟習此項技術者應瞭解，可將結合本文所揭示之實施例而描述的各種說明性邏輯區塊、模組、電路及演算法實施成電子硬體、電腦軟體或兩者之組合。為清楚地說明硬體與軟體之此可交換性，上文已根據功能性大體描述了各種說明性組件、區塊、模組、電路及演算法。將此功能性實施為硬體或軟體取決於施加於整個系統之特殊應用及設計限制。雖然熟習此項技術者可以不同方式對每一特殊應用實施所描述之功能性，但不應將此實施決策視作為導致偏離本發明之範疇的。
結合本文所揭示之實施例而描述的各種說明性邏輯區塊、處理器、模組及電路可由一通用處理器、一數位訊號處理器(DSP)、電路、一特殊應用積體電路(ASIC)、一現場可程式化閘極陣列(FPGA)或其它可程式化邏輯設備、離散閘或電晶體邏輯、離散硬體組件或其經設計以執行本文所述功能之任何組合來建構或執行。通用處理器可為一微處理器，但在一替代例中，該處理器可為任何習知的處理器、微處理器或狀態機。處理器亦可建構為設備之組合，例如，一DSP與一微處理器之組合、複數個微處理器、結合一DSP核心之一或多個微處理器、多個邏輯元件、多個電路，或任何其它的該組態。
可將結合本文所揭示之實施例而描述的方法或演算法直接包含在硬體中、藉由處理器執行之軟體模組中或兩者之組合中。軟體模組可駐於RAM記憶體、快閃記憶體、ROM記憶體、EPROM記憶體、EEPROM記憶體、暫存器、硬碟、抽取式磁碟、CD－ROM或此項技術中已知之任何其它形式的儲存媒體中。例示性儲存媒體可耦接至處理器，使得該處理器可自該儲存媒體讀取資訊並可將資訊寫入該儲存媒體。在替代例中，儲存媒體可與處理器成一體式。處理器及儲存媒體可駐於ASIC中。ASIC可駐於使用者終端機中。在替代例中，處理器及儲存媒體可作為離散組件而駐於使用者終端機中。
已揭示之實施例之先前描述經提供以使任何熟習此項技術者能夠製造或使用本發明。對此等實施例之各種修改對於熟習此項技術者而言變得顯而易見，且可在不偏離本發明之精神或範疇的情況下將本文所界定之通用原則應用於其它實施例中。因此，並非意欲將本發明限制於本文所示之實施例，而是使其符合與本文所揭示之原則及新穎特徵相一致之最廣闊的範疇。
100．．．MIMO系統
110．．．傳輸器系統
112．．．資料源
114．．．TX資料處理器
120．．．TX MIMO處理器
122a至122t．．．傳輸器/接收器
124a至124t．．．天線
130．．．處理器
132．．．記憶體
140．．．解調變器
142．．．RX資料處理器
144．．．資料接收器
150．．．接收器系統
152a至152r．．．天線
154a至154r．．．接收器傳輸器
160．．．RX MIMO/資料處理器
170．．．處理器
172．．．記憶體
178．．．TX資料處理器
180．．．調變器
200．．．傳輸器單元
202．．．傳輸資料處理器
204．．．傳輸資料處理器
210．．．解多工器
21a至212t．．．編碼器
214a至214t．．．通道交錯器
222a至222t．．．符號映射元件
224．．．調變器
226a至226t．．．逆快速傅立葉變換(IFFT)區塊
228a至228t．．．循環字首產生器
230a至230t－1．．．延遲元件
232a至232t．．．傳輸器
500．．．傳輸器單元
502．．．傳輸資料處理器
504．．．傳輸資料處理器
510．．．解多工器
512a至512t．．．編碼器
514a至514t．．．通道交錯器
522a至522t．．．符號映射元件
524．．．調變器
526a至526t．．．逆快速傅立葉變換(IFFT)區塊
528a至528t．．．循環字首產生器
530a至530t－1．．．延遲元件
532a至532t．．．傳輸器
534a至534t．．．天線
554a至554t－1．．．縮放調整電路
602a至602r．．．天線
604a至604t．．．接收器
606．．．RX處理器
608．．．解調變器
610．．．RX資料處理器
612a至612r．．．循環字首移除元件
614a至614r．．．快速傅立葉變換(FFT)區塊
620．．．空間處理器
622．．．多工器/解多工器
624a至624r．．．符號解映射元件
632a至632r．．．通道解交錯器
634a至634r．．．解碼器
640．．．通道估算器
650．．．處理器
700．．．處理器
702．．．匯流排
704．．．記憶體
900．．．傳輸器單元
924．．．調變器
930a至930t－1．．．相移電路
926a至926t．．．逆快速傅立葉變換(IFFT)區塊
928a至928t．．．循環字首產生器
圖1說明MIMO系統中之傳輸器系統及接收器系統之一實施例的方塊圖；圖2說明提供時變延遲分集之傳輸器單元之一實施例的方塊圖；圖3說明應用於自相同天線傳輸之符號的時變延遲之一實施例；圖4說明應用於在多個天線上傳輸之符號的時變延遲之一實施例；圖5說明提供時變延遲分集之傳輸器單元之另一實施例的方塊圖；圖6說明能利用時變延遲分集之接收器單元之一實施例的方塊圖；圖7說明延遲元件之一實施例的方塊圖；圖8說明用於提供時變分集之方法的一實施例之流程圖；圖9說明提供時變延遲分集之傳輸器單元之另一實施例的方塊圖；及圖10說明用於提供時變分集之方法的另一實施例之流程圖。
500．．．傳輸器單元
502．．．傳輸資料處理器
504．．．傳輸資料處理器
510．．．解多工器
512a至512t．．．編碼器
514a至514t．．．通道交錯器
522a至522t．．．符號映射元件
524．．．調變器
526a至526t．．．逆快速傅立葉轉換(IFFT)區塊
528a至528t．．．循環字首產生器
530a至530t－1．．．延遲元件
532a至532t．．．傳輸器
534a至534t．．．天線
554a至554t－1．．．縮放調整電路

Claims (26)

  1. 一種無線傳輸器，其包括：至少三個天線；及耦接至該至少三個天線之一記憶體，該記憶體儲存複數個符號，每一符號各自包括複數個樣本，其中在一第一延遲週期之後，該複數個符號之一第一符號之該複數個樣本被提供至該至少三個天線之一個天線，且在一第二延遲週期之後，該複數個符號之一第二符號之該複數個樣本被提供至該至少三個天線之該一個天線，其中該第一延遲週期與該第二延遲週期不同，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期；及其中在一第三延遲週期之後，該第一符號之該複數個樣本被提供至該至少三個天線之另一天線，且在一第四延遲週期之後，該第二符號之該複數個樣本被提供至該至少三個天線之該另一天線，其中該第一延遲週期、該第二延遲週期、該第三延遲週期及該第四延遲週期彼此均不相同，其中該第二延遲週期變化來自該第一延遲週期之n*β個樣本且該第四延遲週期變化來自該第三延遲週期之n*(β+k)個樣本，其中n係一符號流中之一符號之一位置且β及k為常數，且其中即便一通道不具有自身之時間選擇時亦提供時間分集。
  2. 如請求項1之無線傳輸器，其中該記憶體包括一緩衝 器。
  3. 如請求項1之無線傳輸器，其進一步包括與該記憶體耦接之一循環字首產生器，在將該複數個符號儲存於記憶體中之前，該循環字首產生器對該複數個符號之每一者添加該循環字首。
  4. 如請求項1之無線傳輸器，其中該等延遲週期根據基於描述通道狀況之通道品質指標回饋而調整之經定義之該時變函數而變化。
  5. 如請求項1之無線傳輸器，其中該等延遲週期根據不基於描述通道狀況之通道品質指標回饋而調整之經定義之該時變函數而變化。
  6. 一種用於在一多通道通信系統中提供傳輸分集之方法，其包括：對一第一天線提供包括第一複數個樣本之一第一符號；在一第一延遲週期之後，對一第二天線提供該第一符號；對該第一天線提供包括第二複數個樣本之一第二符號；在不同於該第一延遲週期之一第二延遲週期之後，對該第二天線提供該第二符號；對該第一天線提供包括第三複數個樣本之一第三符號；在不同於該第一延遲週期及該第二延遲週期之一第三 延遲週期之後，對該第二天線提供該第三符號，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期，其中經定義之該時變函數係sin(x)，其中x在0至N-1之間變化且其中N係一訊框、叢發週期或符號流中之符號數目，且其中即便一通道不具有自身之時間選擇時亦提供時間分集；根據不同的載波頻率調變該第一符號、第二符號及第三符號；及對該第一延遲週期、第二延遲週期及第三週期提供一純量移位。
  7. 如請求項6之方法，其中根據經定義之該時變函數而延遲的該等符號及未經延遲之該等符號係接收自一單一調變器。
  8. 如請求項7之方法，其中根據以下方程式自天線m傳輸第i個符號： 其中s()係一移位函數，k係一時域指標，△m 係一時變延遲，N係一訊框、叢發週期或符號流中之符號數目，n係一訊框、叢發週期或符號流中之一指標，且Xn 係一第n個未移位之符號。
  9. 如請求項6之方法，其中該等延遲週期根據基於描述通 道狀況之通道品質指標回饋而調整之經定義之該時變函數而變化。
  10. 如請求項6之方法，其中該等延遲週期根據不基於描述通道狀況之通道品質指標回饋而調整之經定義之該時變函數而變化。
  11. 如請求項6之方法，其中該第一符號、第二符號及第三符號為一相同符號流之連續符號。
  12. 如請求項6之方法，其中在該第一符號之後立即傳輸之該第二符號之後立即傳輸該第三符號。
  13. 如請求項6之方法，其中該第一符號、第二符號及第三符號為一相同符號流之非連續符號。
  14. 如請求項13之方法，其中該第一符號與該第二符號係由數個符號分離且該第二符號與該第三符號係由該數個符號分離。
  15. 如請求項6之方法，其中該第一符號、第二符號及第三符號各於不同訊框中傳輸。
  16. 一種用於一無線傳輸器之方法，該方法包括：以一記憶體儲存複數個符號，每一符號包括複數個樣本；在一第一延遲週期之後，對至少三個天線之一個天線提供該複數個符號之一第一符號之該複數個樣本；在一第二延遲週期之後，對該一個天線提供該複數個符號之一第二符號之該複數個樣本，其中該第一延遲週期與該第二延遲週期不同，該等符號之每一者包括一或 多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期；在一第三延遲週期之後，對該至少三個天線之另一天線提供該第一符號之該複數個樣本；及在一第四延遲週期之後，對該另一天線提供該第二符號之該複數個樣本，其中該第一延遲週期、該第二延遲週期、該第三延遲週期及該第四延遲週期彼此均不相同，其中該第二延遲週期變化來自該第一延遲週期之n*β個樣本且該第四延遲週期變化來自該第三延遲週期之n*(β+k)個樣本，其中n係一符號流中之一符號之一位置且β及k為常數，且其中即便一通道不具有自身之時間選擇時亦提供時間分集。
  17. 一種用於一無線傳輸器之裝置，該裝置包括：用於儲存複數個符號的構件，每一符號包括複數個樣本；用於在一第一延遲週期之後，對至少三個天線之一個天線提供該複數個符號之一第一符號之該複數個樣本的構件；用於在一第二延遲週期之後，對該一個天線提供該複數個符號之一第二符號之該複數個樣本的構件，其中該第一延遲週期與該第二延遲週期不同，該等符號之每一者包括一或多個樣本之一循環字首，且其中基於一訊 框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期；用於在一第三延遲週期之後，對該至少三個天線之另一天線提供該第一符號之該複數個樣本的構件；及用於在一第四延遲週期之後，對該另一天線提供該第二符號之該複數個樣本的構件，其中該第一延遲週期、該第二延遲週期、該第三延遲週期及該第四延遲週期彼此均不相同，其中該第二延遲週期變化來自該第一延遲週期之n*β個樣本且該第四延遲週期變化來自該第三延遲週期之n*(β+k)個樣本，其中n係一符號流中之一符號之一位置且β及k為常數，且其中即便一通道不具有自身之時間選擇時亦提供時間分集。
  18. 一種電腦程式產品，其包括：一處理器可讀記憶體，其上具有若干個指令，該等指令經一無線傳輸器中之一處理器執行以進行以下步驟：存取複數個符號，每一符號包括複數個樣本；在一第一延遲週期之後，啟始對至少三個天線之一個天線提供該複數個符號之一第一符號之該複數個樣本；在一第二延遲週期之後，啟始對該一個天線提供該複數個符號之一第二符號之該複數個樣本，其中該第一延遲週期與該第二延遲週期不同，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變 函數而變化之該等延遲週期；在一第三延遲週期之後，啟始對該至少三個天線之另一天線提供該第一符號之該複數個樣本；及在一第四延遲週期之後，啟始對該另一天線提供該第二符號之該複數個樣本，其中該第一延遲週期、該第二延遲週期、該第三延遲週期及該第四延遲週期彼此均不相同，其中該第二延遲週期變化來自該第一延遲週期之n*β個樣本且該第四延遲週期變化來自該第三延遲週期之n*(β+k)個樣本，其中n係一符號流中之一符號之一位置且β及k為常數，且其中即便一通道不具有自身之時間選擇時亦提供時間分集。
  19. 一種用於一多通道通信系統之裝置，該裝置包括：複數個天線，其包括至少一第一天線及一第二天線；一調變器；及一延遲電路，其耦接於該調變器及該複數個天線之間，該延遲電路用以：對該第一天線提供包括第一複數個樣本之一第一符號；在一第一延遲週期之後，對該第二天線提供該第一符號；對該第一天線提供包括第二複數個樣本之一第二符號；在不同於該第一延遲週期之一第二延遲週期之後， 對該第二天線提供該第二符號；對該第一天線提供包括第三複數個樣本之一第三符號；在不同於該第一延遲週期及該第二延遲週期之一第三延遲週期之後，對該第二天線提供該第三符號，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期，其中經定義之該時變函數係sin(x)，其中x在0至N-1之間變化且其中N係一訊框、叢發週期或符號流中之符號數目，且其中即便一通道不具有自身之時間選擇時亦提供時間分集，且其中根據不同的載波頻率調變該第一符號、第二符號及第三符號，且對該第一延遲週期、第二延遲週期及第三週期提供一純量移位。
  20. 如請求項19之裝置，其中該第一符號、第二符號及第三符號為一相同符號流之連續符號。
  21. 如請求項19之裝置，其中在該第一符號之後立即傳輸之該第二符號之後立即傳輸該第三符號。
  22. 如請求項19之裝置，其中該第一符號、第二符號及第三符號為一相同符號流之非連續符號。
  23. 如請求項19之裝置，其中該第一符號與該第二符號係由數個符號分離且該第二符號與該第三符號係由該數個符號分離。
  24. 如請求項19之裝置，其中該第一符號、第二符號及第三符號各於不同訊框中傳輸。
  25. 一種用於一多通道通信系統之裝置，該裝置包括：用於對一第一天線提供包括第一複數個樣本之一第一符號的構件；用於在一第一延遲週期之後，對一第二天線提供該第一符號的構件；用於對該第一天線提供包括第二複數個樣本之一第二符號的構件；用於在不同於該第一延遲週期之一第二延遲週期之後，對該第二天線提供該第二符號的構件；用於對該第一天線提供包括第三複數個樣本之一第三符號的構件；用於在不同於該第一延遲週期及該第二延遲週期之一第三延遲週期之後，對該第二天線提供該第三符號的構件，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期，其中經定義之該時變函數係sin(x)，其中x在0至N-1之間變化且其中N係一訊框、叢發週期或符號流中之符號數目，且其中即便一通道不具有自身之時間選擇時亦提供時間分集，且其中根據不同的載波頻率調變該第一符號、第二符號及第三符號，且對該第一延遲週期、第 二延遲週期及第三週期提供一純量移位。
  26. 一種電腦程式產品，其包括：一處理器可讀記憶體，其上具有若干個指令，該等指令經用於一多通道通信系統之設備中之一處理器執行以進行以下步驟：啟使對一第一天線提供包括第一複數個樣本之一第一符號；在一第一延遲週期之後，啟始對一第二天線提供該第一符號；啟使對該第一天線提供包括第二複數個樣本之一第二符號；在不同於該第一延遲週期之一第二延遲週期之後，啟始對該第二天線提供該第二符號；啟使對該第一天線提供包括第三複數個樣本之一第三符號；及在不同於該第一延遲週期及該第二延遲週期之一第三延遲週期之後，啟始對該第二天線提供該第三符號，該等符號之每一者包括一或多個樣本之一循環字首，其中基於一訊框、叢發週期或符號流中之一符號數目而限制根據經定義之一時變函數而變化之該等延遲週期，其中經定義之該時變函數係sin(x)，其中x在0至N-1之間變化且其中N係一訊框、叢發週期或符號流中之符號數目，且其中即便一通道不具有自身之時間 選擇時亦提供時間分集，且其中根據不同的載波頻率調變該第一符號、第二符號及第三符號，且對該第一延遲週期、第二延遲週期及第三週期提供一純量移位。
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