TW202201553A - 半導體結構及其製造方法 - Google Patents

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黃麟淯
游力蓁
莊正吉
程冠倫
王志豪
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Abstract

方法包含提供結構，結構具有基底、在基底上的第一介電層、在第一介電層上且連接第一源極/汲極部件和的第二源極/汲極部件的一或多個半導體通道層，以及與一或多個半導體通道層嚙合的閘極結構；自結構的背側蝕刻基底以形成暴露出第一源極/汲極部件的第一溝槽和暴露出第二源極/汲極部件的第二溝槽；在第一溝槽內形成源極/汲極接觸件；蝕刻至少一部分的第一介電層，使得源極/汲極接觸件的一部分自結構的背側的第一介電層突出；以及在源極/汲極接觸件上沉積密封層，其中密封層覆蓋閘極結構與密封層之間的氣隙。

Description

半導體結構及其製造方法
本發明是有關於一種半導體結構及其製造方法，特別是有關於具有氣隙(air gap)的半導體結構及其製造方法。
半導體積體電路(integrated circuit，IC)產業已歷經了指數式成長。積體電路材料及設計之技術的進步造成積體電路世代的產生，每一世代的電路比前一世代更小且更複雜。在積體電路的發展過程中，通常增加了功能密度(即每晶片面積中互連的裝置數量)，而降低了幾何尺寸(即使用製程所能創造的最小組件(或線))。這種微縮化製程一般可藉由增加生產效率及降低相關成本以提供許多利益。這樣的微縮化製程亦增加了製造和生產積體電路的複雜度。
近來，為了藉由增加閘極-通道耦合(gate-channel coupling)、降低關閉狀態(off-state)的電流，以及減少短通道效應(short-channel effect，SCE)以改善閘極控制，已導入多閘極裝置。鰭式場效電晶體(fin field-effect transistor，FinFET)是其中一種已導入的多閘極裝置。鰭式場效電晶體因自基底延伸並形成於基底上的似鰭結構而得名，且似鰭結構是用以形成場效電晶體通道。另一個在某種程度上解決與鰭式場效電晶體有關之效能挑戰的多閘極裝置為全繞式閘極(gate-all-around，GAA)電晶體。全繞式閘極電晶體因其閘極結構能延伸環繞通道區，對通道提供四側的連接而得名。全繞式閘極電晶體可與傳統互補式金屬氧化物半導體(complementary metal-oxide-semiconductor，CMOS)製程相容，且它們的結構允許它們在維持閘極控制和減少短通道效應的同時進行極度地縮放。
傳統上以堆疊方式構成多閘極裝置(例如鰭式場效電晶體和全繞式閘極裝置)，具有在最低水平處的電晶體和在電晶體上的互連(導孔和佈線)以提供對電晶體的連接性。電源軌(power rail)(例如電壓源和接地面的金屬線)亦在電晶體上且可為互連的一部分。隨著積體電路持續地縮小，電源軌亦持續地縮小。這無法避免地導致橫跨電源軌之壓降的增加，以及積體電路之電力消耗的增加。因此，雖然現存之半導體製造的方法已逐漸合乎它們的預期目標，但它們仍未在各方面皆令人滿意。感興趣的領域之一是如何在積體電路的背側形成降低電阻和降低耦合電容值之電源軌和導孔。
在一示範的樣態中，本揭露提供方法。方法包含提供具有前側和背側的結構，結構包含基底、在基底上的第一介電層、在第一介電層上且連接第一源極/汲極(S/D)部件和一第二源極/汲極部件的一或多個半導體通道層，以及與前述一或多個半導體通道層嚙合的閘極結構，其中基底在結構的背側，且閘極結構在結構的前側；自結構的背側蝕刻基底以形成暴露出第一源極/汲極部件的第一溝槽和暴露出第二源極/汲極部件的第二溝槽；在第一溝槽內形成源極/汲極接觸件；蝕刻至少一部分的第一介電層，使得源極/汲極接觸件的一部分自結構的背側的第一介電層突出；以及在源極/汲極接觸件上沉積密封層，其中密封層覆蓋閘極結構與密封層之間的氣隙。
在另一示範的樣態中，本揭露提供方法。方法包含提供具有前側和背側的結構，結構包含基底、在基底上的半導體鰭、在半導體鰭上的第一源極/汲極(S/D)部件和第二源極/汲極部件、在半導體鰭上的介電蓋層、在介電蓋層上且連接第一和第二源極/汲極部件的一或多個半導體通道層，以及與前述一或多個半導體通道層嚙合的閘極結構，其中基底在結構的背側，且閘極結構在結構的前側；自結構的背側薄化結構直至暴露出半導體鰭；自結構的背側蝕刻半導體鰭以形成暴露出第一源極/汲極部件的第一溝槽和暴露出第二源極/汲極部件的第二溝槽；在第二溝槽內沉積介電層；在第一溝槽內形成源極/汲極接觸件；自結構的背側凹陷介電蓋層，藉此暴露出源極/汲極接觸件的側壁；在源極/汲極接觸件的側壁上形成介電襯層；在源極/汲極接觸件上沉積密封層，使得氣隙夾設於閘極結構與密封層之間；以及在密封層上形成金屬佈線層，其中金屬佈線層電性耦接至源極/汲極接觸件。
在又一示範的樣態中，本揭露提供半導體結構。半導體結構包含第一和第二源極/汲極部件(S/D)；連接第一和該第二源極/汲極部件的一或多個通道半導體層；與前述一或多個通道半導體層嚙合的閘極結構，其中第一和第二源極/汲極部件、前述一或多個通道半導體層和該閘極結構在半導體結構的前側；在半導體結構的背側的金屬佈線層；以及在金屬佈線層與閘極結構之間的密封層，其中密封層藉由密封層與閘極結構之間的氣隙與閘極結構隔開。
以下揭露提供了許多不同的實施例或範例，用於實施提供之主題的不同部件。組件和配置的具體範例描述如下，以簡化本揭露的說明。當然，這些僅僅是範例，並非用以限定本發明的實施例。舉例而言，以下敘述中提及第一部件形成於第二部件上或上方，可能包含第一與第二部件直接接觸的實施例，亦可能包含額外的部件形成於第一與第二部件之間，使得第一與第二部件不直接接觸的實施例。此外，本揭露在各種範例中可能重複參考數字及/或字母，此重複是為了簡化和清楚，並非在討論的各種實施例及/或組態之間指定其關係。
再者，在此可使用空間相對用詞，例如「在……下方」、「在……下」、「下方的」、「在……上」、「上方的」及類似的用詞以助於描述圖中所示之其中一個元件或部件相對於另一(些)元件或部件之間的關係。這些空間相對用詞是用以涵蓋圖式所描繪的方位以外，使用中或操作中之裝置的不同方位。裝置可能被轉向其他方位(旋轉90度或其他方位)，且可與其相應地解釋在此使用之空間相對描述。再者，除非另有說明，否則根據在此揭露之具體技術及本技術領域中具有通常知識者的理解，當用「約」、「大約」及相似的用詞描述一個數字或一個數字範圍時，所述用詞涵蓋在所述數字之某些變化(像是+/- 10%或其他變化)內的數字。舉例而言，用詞「約5 nm」可涵蓋自4.5 nm至5.5 nm、4.0 nm至5.0 nm等的尺寸範圍。
本案總體上與半導體結構及製造過程相關，特別是與具有背側金屬佈線層(例如電源軌)和背側氣隙的半導體裝置相關。積體電路的電源軌需要進一步的改良以提供所需的效能提升以及電力消耗的降低。本揭露的目的包含在含有電晶體(例如全繞式閘極(GAA)電晶體及/或鰭式場效電晶體)之結構的背面(或背側)上提供電源軌(或電源佈線)，且在結構的前面(前側)上提供互連結構(互連結構亦可包含電源軌)。這增加了在結構中可用於與源極/汲極接觸件和導孔直接連接之金屬路徑(metal track)的數量。相較於現存無背側電源軌的結構，它還為集積度較大的裝置增加閘極密度。背側電源軌可具有比結構前側上的第一層金屬(M0)路徑更寬的尺寸，有助於降低電源軌電阻。本揭露亦提供介於閘極堆疊與背側電源軌之間的背側氣隙。在沒有背側氣隙的情況下，可使用底部自對準蓋(bottom self-aligned capping，B-SAC)層以提供閘極堆疊與背側電源軌之間的隔離。底部自對準蓋層通常需要介電常數相對較高的介電材料，以在導孔背側蝕刻期間提供蝕刻選擇性。然而，高介電常數的底部自對準蓋層會增加閘極堆疊與背側電源軌之間的耦合電容值。藉由包含氣隙能降低耦合電容值，這有助於使積體電路運作更快。再者，藉由包含氣隙，閘極堆疊與背側電源軌之間無漏電流路徑，因此增加積體電路的時間相依介電崩潰(time-dependent dielectric breakdown，TDDB)效能。
根據一些實施例，以下搭配所附圖式描述本揭露的結構和製造方法的細節，圖式顯示製造全繞式閘極裝置的製程。全繞式閘極裝置指具有垂直堆疊和水平定向(horizontally-oriented)之多通道電晶體的裝置，多通道電晶體像是奈米線(nanowire)電晶體和奈米片(nanosheet)電晶體。由於全繞式閘極裝置具有更好的閘極控制能力、更低的漏電流以及與鰭式場效電晶體裝置佈局完全的相容性，因此全繞式閘極裝置有望將互補式金屬氧化物半導體帶往藍圖的下一階段。為了簡化的目的，本揭露使用全繞式閘極裝置作為範例。本技術領域中具有通常知識者應可理解他們可使用本揭露為基礎來設計或修改其他製程及結構(例如鰭式場效電晶體)，以達到相同的目的及/或達到與在此介紹的實施例相同之優點。
第1A-1D圖為根據本揭露各種實施例之半導體裝置的製造方法100的流程圖。本揭露預期有額外的製程。可在方法100的前、中、後提供額外的操作，且可移除、取代或刪除方法100之額外實施例中的一些敘述的操作。
根據一些實施例，以下結合第2A圖至第30E圖描述方法100，第2A圖至第30E圖顯示根據方法100之製程中各步驟的半導體裝置(或裝置)200的各種俯視和剖面示意圖。一些實施例中，裝置200為積體電路晶片的一部分、系統單晶片(system on chip，SoC)或前述之組合的部分，包含各種被動和主動微電子裝置，像是電阻器、電容器、電感器、二極體、P型場效電晶體(p-type field effect transistor，PFET)、N型場效電晶體(n-type field effect transistor，NFET)、鰭式場效電晶體、奈米片場效電晶體、奈米線場效電晶體、其他類型的多閘極場效電晶體、金屬―氧化物―半導體場效電晶體(metal-oxide semiconductor field effect transistor，MOSFET)、互補式金屬―氧化物―半導體(complementary metal-oxide semiconductor，CMOS)電晶體、雙極性接面電晶體(bipolar junction transistor，BJT)、橫向擴散金屬氧化物半導體(laterally diffused MOS，LDMOS)電晶體、高電壓電晶體、高頻電晶體、記憶體裝置、其他合適的組件或前述之組合。為了清楚說明以更好地理解本揭露的發明概念，將第2A至30E圖簡化。可以在裝置200內加入額外的部件，且可在裝置200的其他實施例中取代、修改或刪除下方一些敘述的部件。
在操作102中，方法100(第1A圖)提供具有基底201和建立在基底201前側上的電晶體的裝置200。第2A圖顯示裝置200的俯視圖，且第2B、2C、2D和2E圖顯示分別沿第2A圖中線B-B、線C-C、線D-D和線E-E之部分的裝置200的剖面示意圖。特別地，線B-B沿半導體鰭204的長度方向(“X”方向)切割，線C-C沿閘極堆疊240的長度方向(“Y”方向)切割，線D-D切入電晶體的源極區且平行於閘極堆疊240，而線E-E切入電晶體的汲極區且平行於閘極堆疊240。以相似的方式配置第3A至30A圖中的線B-B、線C-C、線D-D和線E-E。注意在各個實施例中，線D-D可改為切入電晶體的汲極區，且線E-E可改為切入電晶體的源極區。在本揭露中，源極和汲極可互換地使用。
參見第2A-2E圖，半導體裝置200包含在其背側的基底201和建立在基底201之前表面上的各種元件。這些元件包含在基底201上的隔離結構230、自基底201延伸且相鄰於隔離結構230的半導體鰭(或鰭)204、在鰭204上的兩個源極/汲極(source/drain，S/D)部件260、懸掛在鰭204上並連接兩個源極/汲極部件260的一或多個半導體通道層(或通道層)215、在兩個源極/汲極部件260之間且包覆圍繞每個通道層215的閘極堆疊240，以及設置在鰭204與通道層215之間和在鰭204與閘極堆疊240之間的底部自對準蓋(bottom self-aligned capping，B-SAC)層203。裝置200更包含在源極/汲極部件260與閘極堆疊240之間的內間隔物255、在最頂端之通道層215上且在閘極堆疊240之側壁上的(外)閘極間隔物247、在磊晶源極/汲極部件260與隔離結構230上且相鄰於閘極間隔物247的接觸蝕刻停止層(contact etch stop layer，CESL)269、在接觸蝕刻停止層269上的層間介電(inter-layer dielectric，ILD)層270。在閘極堆疊240上，半導體裝置200更包含自對準蓋(self-aligned capping，SAC)層352。在磊晶源極/汲極部件260上，半導體裝置200更包含矽化物部件273、源極/汲極接觸件275、介電源極/汲極蓋層356和源極/汲極接觸導孔358。在所述的實施例中，在源極部件260上設置源極/汲極蓋層356，且在汲極部件260上設置源極/汲極接觸導孔358。在替代的實施例中，在汲極部件260上設置源極/汲極蓋層356，且在源極部件260上設置源極/汲極接觸導孔358。一些實施例中，在源極和汲極部件260兩者上設置源極/汲極蓋層356。一些實施例中，在源極和汲極部件260兩者上設置源極/汲極接觸導孔358。
參見第3A和3B圖，半導體裝置200更包含具有嵌入介電層之佈線和導孔的一或多個互連層(以「277」表示)。前述的一或多個互連層連接各個電晶體的閘極、源極和汲極電極，以及裝置200中的其他電路，以形成部分或整體的積體電路。裝置200可更包含建立在半導體裝置200之前側上的鈍化層、黏著層及/或其他層。這些層和一或多個互連層一起用元件符號「277」來表示。注意在第3B圖中將半導體裝置200上下翻轉。以下進一步描述半導體裝置200的各個元件。
在一實施例中，基底201為塊材(bulk)矽基底(即包含塊材單晶矽)。基底201在各種實施例中可包含其他半導體材料，例如鍺、碳化矽、砷化鎵、磷化鎵、磷化銦、砷化銦、銻化銦、SiGe、GaAsP、AlInAs、AlGaAs、GaInAs、GaInP、GaInAsP或前述之組合。在替代的實施例中，基底201為絕緣體上覆半導體基底，像是絕緣體上覆矽(silicon-on-insulator，SOI)基底、絕緣體上覆矽鍺(silicon germanium-on-insulator，SGOI)基底或絕緣體上覆鍺(germanium-on-insulator，GOI)基底。
在實施例中，鰭204可包含矽、矽鍺、鍺或其他合適的半導體，且可經N型或P型摻質的摻雜。可藉由任何合適的方法將鰭204圖案化。舉例而言，可使用一或多個光學微影製程(包含雙重圖案化或多重圖案化製程)對鰭204進行圖案化。一般而言，雙重圖案化或多重圖案化製程結合光學微影和自對準製程，允許形成具有間距小於使用單一、直接地光學微影製程可獲得的間距的圖案。舉例而言，在一實施例中，在基底上形成犧牲層，並使用光學微影製程將犧牲層圖案化。使用自對準製程在圖案化的犧牲層旁形成間隔物。然後移除犧牲層，並使用剩餘的間隔物或心軸(mandrel)作為將鰭204圖案化的遮罩元件。舉例而言，遮罩元件可用於在基底201內或上的半導體層內蝕刻出凹陷，留下基底201上的鰭204。蝕刻製程可包含乾式蝕刻、濕式蝕刻、反應式離子蝕刻(reactive ion etching，RIE)及/或其他合適的製程。舉例而言，乾式蝕刻製程可實施含氧氣體、含氟氣體(例如CF4 、SF6 、CH2 F2 、CHF3 及/或C2 F6 )、含氯氣體(例如Cl2 、CHCl3 、CCl4 及/或BCl3 )、含溴氣體(例如HBr及/或CHBr3 )、含碘氣體、其他合適的氣體及/或電漿，及/或前述之組合。舉例而言，濕式蝕刻製程可包括在稀釋氫氟酸(diluted hydrofluoric acid，DHF)；氫氧化鉀(potassium hydroxide，KOH)溶液；氨(ammonia)；含有氫氟酸(hydrofluoric acid，HF)、硝酸(nitric acid，HNO3 )及/或醋酸(acetic acid，CH3 COOH)的溶液；或其他合適的濕式蝕刻溶液中進行蝕刻。形成鰭204的方法的許多其他實施例皆合適。
隔離結構230可包含氧化矽、氮化矽、氮氧化矽、其他合適的隔離材料(例如包含矽、氧、氮、碳或其他合適的隔離成分)或前述之組合。隔離結構230能包含不同的結構，像是淺溝槽隔離(shallow trench isolation，STI)部件及/或深溝槽隔離(deep trench isolation，DTI)部件。在一實施例中，隔離結構230的形成可藉由以絕緣材料填充鰭204之間的溝槽(例如使用化學氣相沉積製程或旋塗式玻璃(spin-on glass)製程)，實施化學機械研磨(chemical mechanical polishing，CMP)製程以移除過量的絕緣材料及/或將絕緣材料層的頂面平坦化，以及回蝕刻絕緣材料層以形成隔離結構230。一些實施例中，隔離結構230包含多個介電層，像是設置在熱氧化襯層上的氮化矽層。
源極/汲極部件260包含磊晶成長的半導體材料，像是磊晶成長的矽、鍺或矽鍺。可藉由任何磊晶製程，包含化學氣相沉積(chemical vapor deposition，CVD)技術(例如氣相磊晶(vapor phase epitaxy，VPE)及/或超高真空(ultra-high vacuum)化學氣相沉積)、分子束磊晶、其他合適的磊晶成長製程或前述之組合以形成源極/汲極部件260。源極/汲極部件260可經N型摻質及/或P型摻質的摻雜。一些實施例中，針對N型電晶體，源極/汲極部件260包含矽並可摻雜碳、磷、砷、其他N型摻質或前述之組合(舉例而言，形成Si:C磊晶源極/汲極部件、Si:P磊晶源極/汲極部件或Si:C:P磊晶源極/汲極部件)。一些實施例中，針對P型電晶體，源極/汲極部件260包含矽鍺或鍺，並可摻雜硼、其他P型摻質或前述之組合(舉例而言，形成Si:Ge:B磊晶源極/汲極部件)。源極/汲極部件260可包含具有不同程度之摻雜密度的多個磊晶半導體層。一些實施例中，實施退火製程(例如快速熱退火(rapid thermal annealing，RTA)及/或雷射退火)以活化源極/汲極部件260中的摻質。
在實施例中，通道層215包含適合作為電晶體通道的半導體材料，像是矽、矽鍺或其他一或多個半導體材料。通道層215的形狀在各種實施例中可為棒狀、條狀、片狀或其他形狀。在一實施例中，通道層215最初為半導體層堆疊的一部分，半導體堆疊包含逐層交互堆疊的通道層215和其他犧牲半導體層。犧牲半導體層和通道層215包含不同的材料成分(例如不同的半導體材料、不同的組成原子百分比及/或不同的組成重量百分比)以產生蝕刻選擇性。在形成閘極堆疊240的閘極替換製程期間，選擇性地移除犧牲半導體層，留下懸掛在鰭204上的通道層215。
一些實施例中，內間隔物255包含介電材料，介電材料包含矽、氧、碳、氮、其他合適的材料或前述之組合(舉例而言，氧化矽、氮化矽、氮氧化矽、碳化矽或碳氮氧化矽)。一些實施例中，內間隔物255包含低介電常數的介電材料，像是在此提到的那些。可藉由沉積和蝕刻製程以形成內間隔物255。舉例而言，在蝕刻源極/汲極溝槽之後，並在自源極/汲極溝槽磊晶成長源極/汲極部件260之前，可使用蝕刻製程將相鄰通道層215之間的犧牲半導體層凹陷，以在相鄰的通道層215之間垂直地形成空隙。然後，(例如使用化學氣相沉積或原子層沉積)沉積一或多個介電材料以填充空隙。實施另一蝕刻製程以移除空隙外的介電材料，藉此形成內間隔物255。
一些實施例中，底部自對準蓋層203可包含一或多種La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi和其他合適的一或多種材料。一些實施例中，底部自對準蓋層203可包含低介電常數的介電材料，像是包含Si、O、N和C的介電材料。低介電常數的介電材料的範例包含氟矽酸鹽玻璃(FSG)、摻碳氧化矽、黑鑽石(Black Diamond®)(應用材料公司(Applied Materials of Santa Clara，California))、乾凝膠(Xerogel)、氣凝膠(Aerogel)、非晶形氟化碳、聚對二甲苯(Parylene)、雙-苯環丁烯(BCB)、多孔高分子材料SiLK(陶氏化學(Dow Chemical，Midland，Michigan)、聚亞醯胺(polyimide)或前述之組合。可使用化學氣相沉積、原子層沉積、物理氣相沉積或氧化以沉積底部自對準蓋層203。在一實施例中，一開始先在鰭204上沉積底部自對準蓋層203，並使用將鰭204圖案化的相同製程對底部自對準蓋層203進行圖案化。在另一實施例中，一開始先在鰭204上沉積犧牲半導體層(例如SiGe)，並使用將鰭204圖案化的相同製程對犧牲半導體層進行圖案化。在形成閘極堆疊240的閘極替換製程期間移除犧牲層，並以底部自對準蓋層203取代犧牲層。如以下進一步的詳細說明，底部自對準蓋層203為夾設於閘極堆疊240與後續製程形成之背側金屬佈線層(和密封層)之間的氣隙保留空間。一些實施例中，底部自對準蓋層203可具有在約1 nm至約20 nm之範圍內的厚度d1。一些實施例中，若底部自對準蓋層203太薄(像是低於1 nm)，則隨後形成的氣隙可能無法在閘極堆疊240與背側金屬佈線層之間提供足夠的隔離。一些實施例中，若底部自對準蓋層203太厚(像是大於20 nm)，則隨後形成的背側源極/汲極接觸件和導孔將會較長並具有較高的電阻，這會降低電路速度。一些實施例中，底部自對準蓋層203在兩相鄰源極/汲極部件260之間的部分具有在約3 nm至約30 nm之範圍內的長度d4(沿著“x”方向測量)。長度d4亦是兩相鄰源極/汲極部件260之間的側向距離。如以下進一步的詳細說明，長度d4定義隨後形成之氣隙的開口。以便於隨後密封氣隙的覆蓋製程為原則來設定長度d4的範圍。若長度d4大於約30 nm，開口對於密封氣隙的覆蓋製程將會太大。若長度d4小於約3 nm，閘極堆疊240中各部件的尺寸可能會太接近臨界尺寸(critical dimension，CD)並產生較差的製程容許範圍(process window)。
在所述的實施例中，閘極堆疊240包含閘極介電層349和閘極電極層350。閘極介電層349可包含高介電常數的介電材料，像是HfO2 、HfSiO、HfSiO4 、HfSiON、HfLaO、HfTaO、HfTiO、HfZrO、HfAlOx 、ZrO、ZrO2 、ZrSiO2 、AlO、AlSiO、Al2 O3 、TiO、TiO2 、LaO、LaSiO、Ta2 O3 、Ta2 O5 、Y2 O3 、SrTiO3 、BaZrO、BaTiO3 (BTO)、(Ba,Sr)TiO3 (BST)、Si3 N4 、二氧化鉿-氧化鋁(HfO2 -Al2 O3 )合金、其他合適之高介電常數的介電材料或前述之組合。高介電常數的介電材料一般指具有高介電常數(例如大於氧化矽的介電常數(k ≈ 3.9))的介電材料。可藉由化學氧化、熱氧化、原子層沉積(ALD)、化學氣相沉積(CVD)及/或其他合適的方法以形成閘極介電層349。一些實施例中，閘極堆疊240更包含在閘極介電層349與通道層215之間的界面層。界面層可包含二氧化矽、氮氧化矽或其他合適的材料。一些實施例中，閘極電極層350包含N型或P型功函數層和金屬填充層。舉例而言，N型功函數層可包括具有足夠低的有效功函數的金屬，像是鈦、鋁、碳化鉭、碳氮化鉭、氮化鉭矽或前述之組合。舉例而言，P型功函數層可包括具有足夠高的有效功函數的金屬，像是氮化鈦、氮化鉭、釕、鉬、鎢、鉑或前述之組合。舉例而言，金屬填充層可包含鋁、鎢、鈷、銅及/或其他合適的材料。可藉由化學氣相沉積、物理氣相沉積、電鍍及/或其他合適的製程以形成閘極電極層350。由於閘極堆疊240包含高介電常數的介電層和一或多個金屬層，亦可稱為高介電常數的金屬閘極。
在一實施例中，閘極間隔物247包含介電材料，像是包含矽、氧、碳、氮、其他合適的材料或前述之組合(例如氧化矽、氮化矽、氮氧化矽(SiON)、碳化矽、碳氮化矽(SiCN)、碳氧化矽(SiOC)、碳氮氧化矽(SiOCN))的介電材料。在實施例中，閘極間隔物247可包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi或其他合適的一或多種材料。舉例而言，可在(隨後由高介電常數之金屬閘極240取代的)虛設閘極堆疊上沉積包含矽和氮的介電層，像是氮化矽層，且隨後將其蝕刻(例如非等向性蝕刻)以形成閘極間隔物247。一些實施例中，閘極間隔物247包含多層結構，像是包含氮化矽的第一介電層和包含氧化矽的第二介電層。一些實施例中，形成與閘極堆疊240相鄰之多於一組的間隔物，像是密封間隔物、補償間隔物、犧牲間隔物、虛設間隔物及/或主間隔物。在實施例中，閘極間隔物247可例如具有約1 nm至約40 nm的厚度。
一些實施例中，自對準蓋層352包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi或其他合適的一或多種材料。自對準蓋層352保護閘極堆疊240，使閘極堆疊240未受到用於蝕刻源極/汲極接觸孔洞的蝕刻和化學機械研磨製程。自對準蓋層352的形成可藉由將閘極堆疊240凹陷以及可選地將閘極間隔物247凹陷，在凹陷的閘極堆疊240上以及可選地在凹陷的閘極間隔物247上沉積一或多個介電材料，並對前述的一或多個介電材料實施化學機械研磨製程。自對準蓋層352可具有例如在約3 nm至約30 nm之範圍內的厚度。
在實施例中，接觸蝕刻停止層269可包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi或其他合適的一或多種材料，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積或其他合適的方法以形成接觸蝕刻停止層269。層間介電層270可包括四乙氧基矽烷(tetraethylorthosilicate，TEOS)氧化物、未經摻雜的矽酸鹽玻璃、或經摻雜的氧化矽，像是硼磷矽酸鹽玻璃(borophosphosilicate glass，BPSG)、摻氟矽玻璃(fluoride-doped silica glass，FSG)、磷矽酸鹽玻璃(phosphosilicate glass，PSG)、摻硼矽玻璃(boron doped silicon glass，BSG)、低介電常數的介電材料、其他合適的介電材料或前述之組合。可藉由電漿輔助化學氣相沉積(plasma enhanced CVD，PE-CVD)、流動式化學氣相沉積(flowable CVD，F-CVD)或其他合適的方法以形成層間介電層270。
一些實施例中，矽化物部件273可包含矽化鈦(TiSi)、矽化鎳(NiSi)、矽化鎢(WSi)、鎳鉑矽化物(NiPtSi)、鎳鉑鍺矽化物(NiPtGeSi)、鎳鍺矽化物(NiGeSi)、矽化鐿(YbSi)、矽化鉑(PtSi)、矽化銥(IrSi)、矽化鉺(ErSi)、矽化鈷(CoSi)或其他合適的化合物。
在一實施例中，源極/汲極接觸件275可包含導電阻障層和在導電阻障層上的金屬填充層。導電阻障層可包含鈦(Ti)、鉭(Ta)、鎢(W)、鈷(Co)、釕(Ru)或導電的氮化物，像是氮化鈦(TiN)、氮化鋁鈦(TiAlN)、氮化鎢(WN)、氮化鉭(TaN)或前述之組合，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積及/或其他合適的製程形成。金屬填充層可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、鎳(Ni)、銅(Cu)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。一些實施例中，省略源極/汲極接觸件275中的導電阻障層。
一些實施例中，源極/汲極蓋層356包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi或其他合適的一或多種材料。源極/汲極蓋層356保護源極/汲極接觸件275，使源極/汲極接觸件275未受到蝕刻和化學機械研磨製程，並將源極/汲極接觸件275與形成在其上方的互連結構隔離。源極/汲極蓋層356可具有約3 nm至約30 nm之範圍內的厚度。一些實施例中，自對準蓋層352和源極/汲極蓋層356包含不同的材料以產生蝕刻選擇性，例如在形成源極/汲極蓋層356的期間。
在一實施例中，源極/汲極接觸導孔358可包含導電阻障層和在導電阻障層上的金屬填充層。導電阻障層可包含鈦(Ti)、鉭(Ta)、鎢(W)、鈷(Co)、釕(Ru)或導電的氮化物，像是氮化鈦(TiN)、氮化鋁鈦(TiAlN)、氮化鎢(WN)、氮化鉭(TaN)或前述之組合，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積及/或其他合適的製程形成。金屬填充層可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、鎳(Ni)、銅(Cu)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。一些實施例中，省略源極/汲極接觸導孔358中的導電阻障層。
在操作104中，如第3B圖所示，方法100(第1A圖)上下翻轉裝置200並使裝置200的前側附著至載具370。這樣可從裝置200的背側接觸到裝置以對裝置200做進一步的處理。操作104可使用任何合適的附著製程，像是直接接合、混合接合、使用黏著劑或其他接合方法。操作104可進一步包含對準、退火及/或其他製程。一些實施例中，載具370可為矽晶圓。在第2A-30E圖中，“z”方向是從裝置200的背側指向裝置200的前側，而“-z”方向則是從裝置200的前側指向裝置200的背側。
在操作106中，方法100(第1A圖)自裝置200的背側薄化裝置200直到裝置200的背側暴露出鰭204和隔離結構230。根據一實施例，結果形成的結構如第4A-4E圖所示。為了簡化，第4C、4D和4E圖省略在第4B圖中已顯示的一些部件，特別是互連層277和載具370。薄化製程可包含機械研磨製程及/或化學薄化製程。在機械研磨製程期間可先從基底201移除大量的基底材料。之後，化學薄化製程可對基底201的背側施加蝕刻化學品以進一步薄化基底201。
在操作108中，方法100(第1A圖)選擇性地蝕刻鰭204以在閘極堆疊240和源極/汲極部件260的背側上形成溝槽272。溝槽272自背側暴露出源極/汲極部件260的表面。根據一實施例，結果形成的結構如第5A-5E圖所示。在本實施例中，操作108施加經調整以對鰭204中的半導體材料(例如矽)的材料有選擇性，且不(或極少地)蝕刻閘極堆疊240、隔離結構230和底部自對準蓋層203的蝕刻製程。在本實施例中，蝕刻製程亦蝕刻源極/汲極部件260，將其凹陷至與通道層215最底端的表面相同的水平處或低於通道層215最底端的表面。在進一步的一些實施例中，如第5D和5E圖所示，凹陷的源極/汲極部件260維持高於隔離結構230與接觸蝕刻停止層269之間的界面。一些替代的實施例中，操作108可進一步將源極/汲極部件260凹陷至低於隔離結構230與接觸蝕刻停止層269之間的界面(未繪示)。操作108可施加多於一個蝕刻製程。舉例而言，可施加第一蝕刻製程選擇性地移除鰭，然後施加第二蝕刻製程選擇性地將源極/汲極部件260凹陷至預期的水平，其中第一和第二蝕刻製程使用不同的蝕刻參數，像是使用不同的蝕刻劑。前述的一或多個蝕刻製程可為乾式蝕刻、濕式蝕刻、反應式離子蝕刻或其他蝕刻方法。底部自對準蓋層203保護閘極堆疊240，使閘極堆疊240未受到前述之一或多個蝕刻製程的蝕刻。
在操作110中，方法100(第1A圖)沉積具有一或多個介電材料的介電層276以填充溝槽272。一些實施例中，介電層276可包含一或多種La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi和其他合適的一或多種材料，且可藉由電漿輔助化學氣相沉積、流動式化學氣相沉積或其他合適的方法形成。再者，在本實施例中，介電層276和底部自對準蓋層203可包含不同的材料，使得藉由化學機械研磨製程將介電層276平坦化時，底部自對準蓋層203可作為化學機械研磨的停止層。
在操作112中，方法100(第1A圖)在裝置200的背側上形成蝕刻遮罩360。蝕刻遮罩360在源極/汲極部件260的背側上用於連接至背側接觸件和背側金屬佈線層的地方提供開口362。根據一實施例，結果形成的結構如第7A-7E圖所示。在顯示的實施例中，在源極部件260的背側上提供開口362，而蝕刻遮罩360覆蓋閘極堆疊240和汲極部件260的背側。在各種實施例中，可僅在汲極部件的背側上、僅在源極部件的背側上或在源極和汲極部件兩者的背側上提供開口362。蝕刻遮罩360包含與介電層276的材料不同的材料，以在背側接觸孔洞的蝕刻期間產生蝕刻選擇性。舉例而言，蝕刻遮罩360包含阻劑材料(因此可稱為圖案化的阻劑層及/或圖案化的光阻層)。一些實施例中，蝕刻遮罩360具有多層結構，例如設置在抗反射塗(anti-reflective coating，ARC)層及/或包括氮化矽或氧化矽之硬遮罩層上的阻劑層。本揭露預期涵蓋用作蝕刻遮罩360的其他材料，只要在蝕刻介電層276的期間產生蝕刻選擇性即可。一些實施例中，操作112使用微影製程，包含在裝置200的背側上形成阻劑層(例如藉由旋轉塗布)，實施曝光前烘烤(pre-exposure baking)製程，使用遮罩實施曝光製程，實施曝光後烘烤(post-exposure baking)製程，以及實施顯影製程。在曝光製程中，將阻劑層對輻射能量曝光(例如紫外(UV)光、深紫外(DUV)光或極紫外(EUV)光)，其中遮罩根據其遮罩圖案及/或遮罩類型(例如二元(binary)遮罩、相偏移(phase shift)遮罩或極紫外光遮罩)阻擋、傳送及/或反射輻射至阻劑層，以將對應於遮罩圖案的影像投射至阻劑層上。由於阻劑層對輻射能量敏感，阻劑層曝光的部分會產生化學變化，且阻劑層曝光(或未曝光)的部分在顯影製程期間根據阻劑層的特性和顯影製程中使用的顯影溶液的特性進行溶解。在顯影之後，圖案化的阻劑層(例如蝕刻遮罩360)包含與遮罩相應的阻劑圖案。或者，藉由其他方法，像是無遮罩微影、電子束寫入(e-beam writing)、離子束寫入(ion-beam writing)或前述之製程實施或取代曝光製程。
在操作114中，方法100(第1A圖)經由蝕刻遮罩360蝕刻介電層276以形成源極/汲極接觸孔洞278。隨後移除蝕刻遮罩360，例如藉由阻劑剝除(stripping)製程或其他合適的製程。根據一實施例，結果形成的結構如第8A-8E圖所示。源極/汲極接觸孔洞278暴露出源極部件260。在顯示的實施例中，蝕刻製程亦蝕刻源極部件260，以將其凹陷至與隔離結構230和接觸蝕刻停止層269之間的界面相同的水平處或低於隔離結構230與接觸蝕刻停止層269之間的界面。這是為了對源極部件260進行隨後形成矽化物的準備。結果，如第8D和8E圖所示，源極部件260可低於汲極部件260。一些實施例中，操作114可施加多於一個蝕刻製程。舉例而言，可施加第一蝕刻製程選擇性地移除介電層276，然後施加第二蝕刻製程選擇性地將源極部件260凹陷至預期的水平，其中第一和第二蝕刻製程使用不同的蝕刻參數，像是使用不同的蝕刻劑。在一實施例中，第一蝕刻製程包含調整以選擇性蝕刻介電層276，且不(或極少地)蝕刻隔離結構230、底部自對準蓋層203、內間隔物255和源極部件260的乾式(電漿)蝕刻製程。在替代的實施例中，第一蝕刻製程可使用其他類型的蝕刻(像是濕式蝕刻或反應式離子蝕刻)，只要能實現如上所討論的層之間的蝕刻選擇性。由於第一蝕刻製程沒有蝕刻或極少地蝕刻隔離結構230、底部自對準蓋層203和內間隔物255，接觸孔洞在y-z平面和x-z平面自對準於源極部件260，藉此改善製程的裕度。第二蝕刻製程可為乾式蝕刻、濕式蝕刻、反應式離子蝕刻或其他合適的蝕刻方法，以選擇性地將源極部件260凹陷至預期的水平。
在操作116中，方法100(第1A圖)在源極/汲極接觸孔洞278內形成矽化物部件280和源極/汲極接觸件282。結果形成的結構如第9A-9E圖所示。在一實施例中，操作116首先在溝槽272內沉積一或多個金屬，對裝置200實施退火製程在前述之一或多個金屬與源極部件260之間產生反應以形成矽化物部件280，以及移除前述之一或多個金屬之未反應的部分，留下溝槽272內的矽化物部件280。前述之一或多個金屬可包含鈦(Ti)、鉭(Ta)、鎢(W)、鎳(Ni)、鉑(Pt)、鐿(Yb)、銥(Ir)、鉺(Er)、鈷(Co)或前述之組合(例如兩個或更多個金屬的合金)，且可使用化學氣相沉積、物理氣相沉積、原子層沉積或其他合適的方法以進行沉積。矽化物部件280可包含矽化鈦(TiSi)、矽化鎳(NiSi)、矽化鎢(WSi)、鎳鉑矽化物(NiPtSi)、鎳鉑鍺矽化物(NiPtGeSi)、鎳鍺矽化物(NiGeSi)、矽化鐿(YbSi)、矽化鉑(PtSi)、矽化銥(IrSi)、矽化鉺(ErSi)、矽化鈷(CoSi)、前述之組合或其他合適的化合物。在一實施例中，操作116然後在矽化物部件280上沉積源極/汲極接觸件282。源極/汲極接觸件282可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、銅(Cu)、鎳(Ni)、鈦(Ti)、鉭(Ta)、氮化鈦(TiN)、氮化鉭(TaN)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。
在操作118中，方法100(第1A圖)對介電層276和隔離結構230實施化學機械研磨製程，以自底部自對準蓋層203的表面移除過量的介電材料。根據一實施例，結果形成的結構如第9A-9E圖所示。由於介電層276和隔離結構230包含與底部自對準蓋層203不同的材料，底部自對準蓋層203可在藉由化學機械研磨製程將裝置200平坦化時作為化學機械研磨的停止層。在操作118之後，介電層276的一部分留在溝槽272內的汲極部件260上作為源極/汲極蓋層。介電層276的此部分亦以源極/汲極蓋層276來表示。化學機械研磨製程亦移除源極/汲極接觸件282內過量的金屬材料，使得源極/汲極接觸件282、源極/汲極蓋層276和底部自對準蓋層203的表面在相同水平。因此，底部自對準蓋層203的厚度d1亦定義為源極/汲極接觸件282自閘極堆疊240突出的距離。如上所討論的，一些實施例中，厚度d1在約1 nm至約20 nm的範圍內。
在操作130中，方法100(第1B圖)選擇性地蝕刻底部自對準蓋層203以將底部自對準蓋層203凹陷至低於源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的表面。根據一實施例，結果形成的結構如第10A-10E圖所示。在本實施例中，操作130施加經調整以對底部自對準蓋層203的介電材料具有選擇性，且不(或極少地)蝕刻源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的蝕刻製程。蝕刻製程可為電漿乾式蝕刻、化學乾式蝕刻、灰化製程、濕式蝕刻或其他合適的蝕刻方法。舉例而言，電漿乾式蝕刻可使用對介電材料的傳統乾式蝕刻劑，像是混合H2 或O2 的C4 F6 ，化學乾式蝕刻製程可使用一或多個化學品，像是H2 ，灰化製程可使用氧或氫的灰化，而濕式蝕刻製程可施加熱的SPM溶液(硫酸和過氧化氫的混合物)，例如在高於100 °C的溫度。操作130的結果使得源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230部分的側壁自底部自對準蓋層203突出距離d2。藉由調整蝕刻製程的持續時間可以控制距離d2。一些實施例中，距離d2在約2 nm至約20 nm的範圍內。如以下將進一步詳細說明的，距離d2定義後續製程中在源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230突出的側壁上形成的介電襯層的垂直長度。源極/汲極接觸件282與源極/汲極蓋層276之間的側向距離大致等於在約3 nm至約30 nm之範圍的長度d4。
在操作132中，方法100(第1B圖)在裝置200的背側上沉積介電襯層304。根據一實施例，結果形成的結構如第11A-11E圖所示。在顯示的實施例中，順應性地(conformally)沉積介電襯層304以使介電襯層304沿著底部自對準蓋層203、隔離結構230、源極/汲極接觸件282和源極/汲極蓋層276的各個表面具有大抵上均勻的厚度。在各種實施例中，介電襯層304可包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在各種實施例中，可使用原子層沉積、化學氣相沉積或其他合適的方法以沉積介電襯層304，且介電襯層304可具有約0.5 nm至約10 nm的厚度(例如沿著“x”方向在源極/汲極接觸件282的側壁上測量)。
在操作134中，方法100(第1B圖)實施蝕刻製程以穿透和移除大部分的介電襯層304的水平部分。前述的蝕刻製程亦稱為穿透(breakthrough，BT)蝕刻製程。結果形成的結構如第12A-12E圖所示。一些實施例中，穿透蝕刻製程可包含非等向性乾式蝕刻製程或類似的蝕刻製程。一些由氧化合物形成介電襯層304的實施例中，穿透蝕刻製程為具有包含CHF3 、Ar、CF4 、N2 、O2 、CH2 F2 、SF3 、類似物或前述組合之蝕刻製程氣體的反應式離子蝕刻(reactive ion etch，RIE)製程。實施反應式離子蝕刻製程的蝕刻時間可在約2秒與約20秒之間，壓力可在約2 mTorr與約30 mTorr之間，溫度可在約10 °C與約100 °C之間，射頻(radio frequency，RF)功率可在約100 W與約1500 W之間，且電壓偏壓可在約10 V與約800 V之間。在顯示的實施例中，操作134的結果使得部分的介電襯層304保留在源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的側壁上。介電襯層304的垂直長度大致等於距離d2，在約2 nm至約10 nm的範圍內。如以下將進一步詳細說明的，介電襯層304在後續密封氣隙的覆蓋製程期間作為累積密封層之沉積介電材料的著陸(landing)墊。在一些實施例中若介電襯層304的長度小於2 nm，則介電襯層304可能無法提供足夠的著陸面積以足夠累積為了密封氣隙所需的介電材料。在一些實施例中若介電襯層304的長度大於10 nm，可能使密封層沉積的介電材料深入氣隙內，降低氣隙的體積。
在操作136中，方法100(第1B圖)在蝕刻製程中移除底部自對準蓋層203。根據一實施例，結果形成的結構如第13A-13E圖所示。在顯示的實施例中，底部自對準蓋層203的移除暴露出閘極堆疊240，並在介電襯層304與閘極堆疊240之間形成空隙333。空隙333存在於介電襯層304的正下方並在閘極堆疊240上，且暴露出源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230部分的側壁。在各種實施例中，介電襯層304與閘極堆疊240之間的垂直距離d3在約0.5 nm至約10 nm的範圍內。在一實施例中，蝕刻製程可包含電漿乾式蝕刻、化學乾式蝕刻、灰化蝕刻、濕式蝕刻或其他合適的蝕刻方法。舉例而言，電漿乾式蝕刻可使用對介電材料的傳統乾式蝕刻劑，像是混合H2 或O2 的C4 F6 ，化學乾式蝕刻製程可使用一或多個化學品，像是H2 ，灰化製程可使用氧或氫的灰化，而濕式蝕刻製程可施加熱的SPM溶液(硫酸和過氧化氫的混合物)，例如在高於100 °C的溫度。
在操作138中，方法100(第1B圖)在裝置200的背側上沉積密封層312，並覆蓋垂直地位於閘極堆疊240與密封層312之間的氣隙314。根據一實施例，結果形成的結構如第14A-14E圖所示。密封層312的沉積亦稱為覆蓋製程。如在此所使用的，用詞「氣隙」是用於描述由環繞之實質部件定義的孔洞，孔洞可包含空氣、氮氣、環境氣體、在先前或目前的製程中使用的氣態化學品或前述之組合。調整裝置200的結構和密封層312的形成以有效地封閉水平地位於源極/汲極接觸件282與源極/汲極蓋層276之間的空間，結果形成氣隙314。特別地，突出的源極/汲極接觸件282和源極/汲極蓋層276作為支撐形成於其上之密封層312的支柱。如以上所討論的，將源極/汲極接觸件282與源極/汲極蓋層276之間的距離d4設定在促進覆蓋製程的範圍內。介電襯層304進一步窄化源極/汲極接觸件282與源極/汲極蓋層276之間的空間的上部分內的開口。再者，介電襯層304提供為了累積沉積的介電材料的著陸墊。一些實施例中，介電襯層304具有比源極/汲極接觸件282的金屬表面更容易累積介電材料的親水特性。一些實施例中，由於介電襯層304和沉積的介電材料相似的材料成分(例如兩者皆具有氧化物)之間的共價鍵，沉積的介電材料較容易累積在介電襯層304上。一些實施例中，密封層312的沉積材料包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在進一步的實施例中，密封層312和介電襯層304可具有相同的介電材料成分。一些替代的實施例中，密封層312和介電襯層304可具有不同的介電材料成分。
可藉由化學氣相沉積、物理氣相沉積、電漿輔助化學氣相沉積、塗布製程或其他合適的製程以沉積密封層312。在一實施例中，藉由電漿輔助化學氣相沉積來沉積密封層312，沉積的介電材料較容易在窄開口的頂部上合併。調整電漿輔助化學氣相沉積的參數(例如壓力、溫度和氣體黏滯性)，使得沉積介電材料的空隙填充行為在不填滿源極/汲極接觸件282與源極/汲極蓋層276之間的空間的情況下維持氣隙。在本實施例中，電漿輔助化學氣相沉積採用低於約0.75 torr的壓力和高於約75 °C的溫度設定。因此，可在介電襯層304之間的上部分沉積密封層312的介電材料，以包圍源極/汲極接觸件282與源極/汲極蓋層276之間的空間，且沒有大量沉積在前述之空間的下部分。因此，可在密封層312的介電材料下和閘極堆疊240上形成相應的氣隙314，且氣隙314具有在約0.5 nm至約10 nm之範圍內的垂直厚度。一些實施例中，若氣隙314太薄(例如小於0.5 nm)，可能無法在閘極堆疊240與後續形成之背側金屬佈線層之間提供足夠的隔離。一些實施例中，若氣隙314太厚(例如大於10 nm)，則背側源極/汲極接觸件和導孔需要足夠長以容納氣隙厚度，其電阻將變高，可能導致電路速度的降低。源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的側壁暴露在氣隙314中。垂直地位於介電襯層304與閘極堆疊240之間的空隙333亦變成氣隙314的一部分。在沉積密封層312的介電材料期間使用的一或多種氣體或任何其他可擴散進入氣隙314內的氣體種類可能存在於氣隙314中。密封層312自氣隙314朝源極/汲極接觸件282和源極/汲極蓋層276的頂面側向延伸。密封層312亦覆蓋介電襯層304之側壁的一部分和頂面。
在操作140中，方法100(第1B圖)對密封層312實施化學機械研磨製程以自源極/汲極接觸件282的表面移除過量的介電材料。根據一實施例，結果形成的結構如第15A-15E圖所示。由於密封層312包含與源極/汲極接觸件282不同的材料，使得源極/汲極接觸件282在藉由化學機械研磨製程對裝置200進行平坦化時可作為化學機械研磨的停止層。在操作140之後，密封層312仍覆蓋氣隙314，並暴露出源極/汲極接觸件282和源極/汲極蓋層276的頂面。在操作140之後，剩餘的密封層312介於相對的介電襯層304之間。一些實施例中，在操作140之後，剩餘的密封層312具有在約0.5 nm至約10 nm之範圍內的厚度。
在操作142中，方法100(第1B圖)在裝置200的背側上形成金屬佈線層，例如背側電源軌284。根據一實施例，結果形成的結構如第16A-16E圖所示。如第16B和16D圖所示，背側源極/汲極接觸件282電性連接至背側電源軌284。在一實施例中，可使用單鑲嵌(damascene)製程、雙鑲嵌(dual-damascene)製程、金屬圖案化製程或其他合適的製程以形成背側電源軌284。背側電源軌284可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、銅(Cu)、鎳(Ni)、鈦(Ti)、鉭(Ta)、氮化鈦(TiN)、氮化鉭(TaN)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。儘管未顯示於第16A-16E圖中，背側電源軌284是嵌入一或多個介電層內。具有背側電源軌284能有利地增加裝置200中可用於直接連接源極/汲極接觸件和導孔的金屬路徑數。與沒有背側電源軌284的其他結構相比亦為更大的裝置整合度增加閘極密度。背側電源軌284亦具有比裝置200前側上的第一層金屬(M0)路徑更寬的尺寸，有助於降低背側電源軌的電阻。在一實施例中，背側電源軌284可具有在約5 nm至約40 nm之範圍內的厚度d5。
在操作144中，方法100(第1B圖)實施裝置200之進一步的製程。舉例而言，可在裝置200的背側上形成一或多個互連層，在裝置200的背側上形成鈍化層，實施其他的產線後段(BEOL)製程，以及移除載具370。
現在參見第1C圖，第1C圖顯示方法100的替代實施例。在方法100的替代實施例中，在操作118(第1A圖)實施化學機械研磨製程暴露出源極/汲極接觸件282、源極/汲極蓋層276和底部自對準蓋層203的表面之後，方法100可選擇在繼續進行操作130之前先進行操作120(第1C圖)。以下結合第17A-24E圖描述方法100的替代實施例，其中說明形成第9A-9E圖所示的結構之後的製程操作。方法100之替代實施例的一些樣態與以上描述過的相同，並且將在以下進行簡要地討論。
在操作120中，方法100(第1C圖)在蝕刻製程中自汲極部件260上移除源極/汲極蓋層276。根據一實施例，結果形成的結構如第17A-17E圖所示。移除源極/汲極蓋層276之後重新出現汲極部件260上的溝槽272，暴露出汲極部件260的表面和內間隔物255的側壁。在顯示的實施例中，蝕刻製程亦蝕刻汲極部件260，將汲極部件260凹陷至與隔離結構230和接觸蝕刻停止層269之間的界面相同的水平處或低於隔離結構230與接觸蝕刻停止層269之間的界面，以擴大溝槽272。如以下將進一步詳細說明的，溝槽272將成為氣隙的一部分並增加氣隙的體積，這有助於進一步降低裝置200中不同部件之間的耦合電容值。一些實施例中，操作120可施加多於一個蝕刻製程。舉例而言，可施加第一蝕刻製程選擇性地移除源極/汲極蓋層276，然後施加第二蝕刻製程選擇性地將汲極部件260凹陷至預期的水平，其中第一和第二蝕刻製程使用不同的蝕刻參數，像是使用不同的蝕刻劑。在一實施例中，第一蝕刻製程包含經調整以選擇性蝕刻源極/汲極蓋層276，且不(或極少地)蝕刻隔離結構230、底部自對準蓋層203、內間隔物255和汲極部件260的乾式(電漿)蝕刻製程。在替代的實施例中，第一蝕刻製程可使用其他類型的蝕刻(像是濕式蝕刻或反應式離子蝕刻)，只要能實現如上所討論的層之間的蝕刻選擇性。由於第一蝕刻製程沒有蝕刻或極少地蝕刻隔離結構230、底部自對準蓋層203和內間隔物255，溝槽272在y-z平面和x-z平面自對準於汲極部件260，藉此改善製程的裕度。第二蝕刻製程可為乾式蝕刻、濕式蝕刻、反應式離子蝕刻或其他合適的蝕刻方法，以選擇性地將汲極部件260凹陷至預期的水平。
在操作120之後，方法100(第1C圖)接續進行操作130，選擇性地蝕刻底部自對準蓋層203，以將底部自對準蓋層203凹陷至低於源極/汲極接觸件282和隔離結構230的表面。根據一實施例，結果形成的結構如第18A-18E圖所示。在本實施例中，操作130施加經調整以對底部自對準蓋層203的介電材料具有選擇性，且不(或極少地)蝕刻源極/汲極接觸件282、內間隔物255、汲極部件260和隔離結構230的蝕刻製程。蝕刻製程可為電漿乾式蝕刻、化學乾式蝕刻、灰化製程、濕式蝕刻或其他合適的蝕刻方法。操作130的結果使得源極/汲極接觸件282和隔離結構230部分的側壁自底部自對準蓋層203突出距離d2。藉由調整蝕刻製程的持續時間可以控制距離d2。一些實施例中，距離d2在約2 nm至約20 nm的範圍內。
在操作132中，方法100(第1C圖)在裝置200的背側上沉積介電襯層304。根據一實施例，結果形成的結構如第19A-19E圖所示。在顯示的實施例中，順應性地沉積介電襯層304以使介電襯層304沿著底部自對準蓋層203、隔離結構230、源極/汲極接觸件282和溝槽272(包含內間隔物255的側壁和汲極部件260的頂面)的各個表面具有大抵上均勻的厚度。在各種實施例中，介電襯層304可包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在各種實施例中，可使用原子層沉積、化學氣相沉積或其他合適的方法以沉積介電襯層304，且介電襯層304可具有約0.5 nm至約10 nm的厚度(例如沿著“x”方向在源極/汲極接觸件282的側壁上測量)。
在操作134中，方法100(第1C圖)實施穿透蝕刻製程以穿透並移除大部分的介電襯層304的水平部分。結果形成的結構如第20A-20E圖所示。一些實施例中，穿透蝕刻製程可包含非等向性乾式蝕刻製程或類似的蝕刻製程。一些由氧化合物形成介電襯層304的實施例中，穿透蝕刻製程為具有包含CHF3 、Ar、CF4 、N2 、O2 、CH2 F2 、SF3 、類似物或前述組合之蝕刻製程氣體的反應式離子蝕刻(RIE)製程。在顯示的實施例中，操作134的結果使得部分的介電襯層304保留在源極/汲極接觸件282、溝槽272和隔離結構230的側壁上。介電襯層304在溝槽272之側壁上的部分接觸汲極部件260。
在操作136中，方法100(第1C圖)在蝕刻製程中移除底部自對準蓋層203。根據一實施例，結果形成的結構如第21A-21E圖所示。在顯示的實施例中，底部自對準蓋層203的移除暴露出閘極堆疊240，並在源極/汲極接觸件282之側壁上的介電襯層304與閘極堆疊240之間形成空隙333。空隙333存在於源極/汲極接觸件282之側壁上的介電襯層304正下方並在閘極堆疊240上。在各種實施例中，在源極/汲極接觸件282之側壁上的介電襯層304與閘極堆疊240之間的垂直距離d3在約0.5 nm至約10 nm的範圍內。此外，由於移除底部自對準蓋層203的緣故，溝槽272之側壁上的介電襯層304自閘極堆疊240突出。突出的距離約略等於d3。換言之，源極/汲極接觸件282側壁上的介電襯層304的末端與溝槽272側壁上的介電襯層304的末端在相同的水平。如第21E圖所示，在y-z平面中，介電襯層304仍維持覆蓋溝槽272的側壁並與隔離結構230的頂面在相同水平。在一實施例中，蝕刻製程可包含電漿乾式蝕刻、化學乾式蝕刻、灰化蝕刻、濕式蝕刻或其他合適的蝕刻方法。
在操作138中，方法100(第1C圖)在裝置200的背側上沉積密封層312，並覆蓋垂直地位於閘極堆疊240與密封層312之間的氣隙314。根據一實施例，結果形成的結構如第22A-22E圖所示。調整裝置200的結構和密封層312的形成以有效地封閉水平地位於相鄰(或鄰近)的源極/汲極接觸件282之間的空間，結果形成氣隙314。特別地，突出的鄰近源極/汲極接觸件282(其中一個顯示於第22B圖中)作為支撐形成於其上之密封層312的支柱。將兩個鄰近的源極/汲極接觸件282之間的距離設定在促進覆蓋製程的範圍內。介電襯層304進一步窄化兩個鄰近源極/汲極接觸件282之間的空間的上部分內的開口。再者，介電襯層304提供為了累積沉積的介電材料的著陸墊。一些實施例中，介電襯層304具有比源極/汲極接觸件282的金屬表面更容易累積介電材料的親水特性。一些實施例中，由於介電襯層304和沉積的介電材料相似的材料成分(例如兩者皆具有氧化物)之間的共價鍵，沉積的介電材料較容易累積在介電襯層304上。一些實施例中，密封層312的沉積材料包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在進一步的實施例中，密封層312和介電襯層304可具有相同的介電材料成分。
可藉由化學氣相沉積、物理氣相沉積、電漿輔助化學氣相沉積、塗布製程或其他合適的製程以沉積密封層312。在一實施例中，藉由電漿輔助化學氣相沉積來沉積密封層312，沉積的介電材料較容易在窄開口的頂部上合併。調整電漿輔助化學氣相沉積的參數(例如壓力、溫度和氣體黏滯性)，使得沉積介電材料的空隙填充行為在不填滿兩個鄰近源極/汲極接觸件282之間的空間的情況下維持氣隙。源極/汲極接觸件282、隔離結構230和介電襯層304的側壁暴露在氣隙314中。溝槽272成為氣隙314的一部分，擴大氣隙314的體積。一些實施例中，溝槽272之側壁上的介電襯層304與密封層312分隔一段距離d6，距離d6在約0.5 nm至約10 nm的範圍內。距離d6允許溝槽272與兩個鄰近的氣隙314流體連通，藉此形成橫跨於兩個鄰近源極/汲極接觸件282之間的較大的氣隙。在沉積密封層312的介電材料期間使用的一或多種氣體或任何其他可擴散進入氣隙314內的氣體種類可能存在於氣隙314中。密封層312亦覆蓋設置在源極/汲極接觸件282側壁上的介電襯層304之側壁的一部分和頂面。
在操作140中，方法100(第1C圖)對密封層312實施化學機械研磨製程以自源極/汲極接觸件282的表面移除過量的介電材料。根據一實施例，結果形成的結構如第23A-23E圖所示。由於密封層312包含與源極/汲極接觸件282不同的材料，使得源極/汲極接觸件282在藉由化學機械研磨製程對裝置200進行平坦化時可作為化學機械研磨的停止層。在操作140之後，密封層312仍覆蓋氣隙314，並暴露出源極/汲極接觸件282的背側表面。在操作140之後，剩餘的密封層312介於兩個相鄰源極/汲極接觸件282側壁上的相對的介電襯層304之間。一些實施例中，在操作140之後，剩餘的密封層312具有在約0.5 nm至約10 nm之範圍內的厚度。
在操作142中，方法100(第1C圖)在裝置200的背側上形成金屬佈線層，例如背側電源軌284。根據一實施例，結果形成的結構如第24A-24E圖所示。如第24B和24D圖所示，背側源極/汲極接觸件282電性連接至背側電源軌284。在一實施例中，可使用單鑲嵌製程、雙鑲嵌製程、金屬圖案化製程或其他合適的製程以形成背側電源軌284。背側電源軌284可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、銅(Cu)、鎳(Ni)、鈦(Ti)、鉭(Ta)、氮化鈦(TiN)、氮化鉭(TaN)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。在一實施例中，背側電源軌284可具有在約5 nm至約40 nm之範圍內的厚度d5。
在操作144中，方法100(第1C圖)實施裝置200之進一步的製程。舉例而言，可在裝置200的背側上形成一或多個互連層，在裝置200的背側上形成鈍化層，實施其他的產線後段製程，以及移除載具370。
現在參見第1D圖，第1D圖顯示方法100的另一替代實施例。在方法100的第二替代實施例中，在操作118(第1A圖)實施化學機械研磨製程暴露出源極/汲極接觸件282、源極/汲極蓋層276和底部自對準蓋層203的表面之後，方法100可選擇跳過操作130，在繼續往下進行操作132之前先進行操作131(第1D圖)。以下結合第25A-30E圖描述方法100的第二替代實施例，其中說明形成第9A-9E圖所示的結構之後的製程操作。方法100之第二替代實施例的一些樣態與以上描述過的相同，並且將在以下進行簡要地討論。
在操作131中，方法100(第1D圖)在蝕刻製程中移除底部自對準蓋層203。根據一實施例，結果形成的結構如第25A-25E圖所示。在顯示的實施例中，移除底部自對準蓋層203暴露出閘極堆疊240的頂面以及源極/汲極接觸件282和源極/汲極蓋層276的側壁。在一實施例中，蝕刻製程可包含電漿乾式蝕刻、化學乾式蝕刻、灰化蝕刻、濕式蝕刻或其他合適的蝕刻方法。
在操作131之後，方法100(第1D圖)接續進行在裝置200的背側上沉積介電襯層304的操作132。根據一實施例，結果形成的結構如第26A-26E圖所示。在顯示的實施例中，順應性地沉積介電襯層304以使介電襯層304沿著閘極堆疊240的頂面以及隔離結構230、源極/汲極接觸件282和源極/汲極蓋層276的頂面和側壁表面的各個表面具有大抵上均勻的厚度。在各種實施例中，介電襯層304可包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在各種實施例中，可使用原子層沉積、化學氣相沉積或其他合適的方法以沉積介電襯層304，且介電襯層304可具有約0.5 nm至約10 nm的厚度(例如沿著“x”方向在源極/汲極接觸件282的側壁上測量)。
在操作134中，方法100(第1D圖)實施穿透蝕刻製程以穿透並移除大部分的介電襯層304的水平部分。結果形成的結構如第27A-27E圖所示。一些實施例中，穿透蝕刻製程可包含非等向性乾式蝕刻製程或類似的蝕刻製程。一些由氧化合物形成介電襯層304的實施例中，穿透蝕刻製程為具有包含CHF3 、Ar、CF4 、N2 、O2 、CH2 F2 、SF3 、類似物或前述組合之蝕刻製程氣體的反應式離子蝕刻(RIE)製程。在顯示的實施例中，操作134的結果使得部分的介電襯層304保留在源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的側壁上，自閘極堆疊240的背側表面(特別是從內間隔物255)朝源極/汲極接觸件282、源極/汲極蓋層276和隔離結構230的頂面延伸。一些實施例中，介電襯層304的垂直長度在約2 nm至約10 nm的範圍內。
在操作138中，方法100(第1D圖)在裝置200的背側上沉積密封層312，並覆蓋垂直地位於閘極堆疊240與密封層312之間的氣隙314。根據一實施例，結果形成的結構如第28A-28E圖所示。調整裝置200的結構和密封層312的形成以有效地封閉水平地位於源極/汲極接觸件282與源極/汲極蓋層276之間的空間，結果形成氣隙314。特別地，突出的源極/汲極接觸件282和源極/汲極蓋層276作為支撐形成於其上之密封層312的支柱。如以上所討論的，將源極/汲極接觸件282與源極/汲極蓋層276之間的距離d4設定在促進覆蓋製程的範圍內。介電襯層304進一步窄化源極/汲極接觸件282與源極/汲極蓋層276之間的空間的上部分內的開口。再者，介電襯層304提供為了累積沉積的介電材料的著陸墊。一些實施例中，介電襯層304具有比源極/汲極接觸件282的金屬表面更容易累積介電材料的親水特性。一些實施例中，由於介電襯層304和沉積的介電材料相似的材料成分(例如兩者皆具有氧化物)之間的共價鍵，沉積的介電材料較容易累積在介電襯層304上。一些實施例中，密封層312的沉積材料包含La2 O3 、Al2 O3 、SiOCN、SiOC、SiCN、SiO2 、SiC、ZnO、ZrN、Zr2 Al3 O9 、TiO2 、TaO2 、ZrO2 、HfO2 、Si3 N4 、Y2 O3 、AlON、TaCN、ZrSi、前述之組合或其他合適的一或多種材料。在進一步的實施例中，密封層312和介電襯層304可具有相同的介電材料成分。一些替代的實施例中，密封層312和介電襯層304可具有不同的介電材料成分。
可藉由化學氣相沉積、物理氣相沉積、電漿輔助化學氣相沉積、塗布製程或其他合適的製程以沉積密封層312。在一實施例中，藉由電漿輔助化學氣相沉積來沉積密封層312，沉積的介電材料較容易在窄開口的頂部上合併。調整電漿輔助化學氣相沉積的參數(例如壓力、溫度和氣體黏滯性)，使得沉積介電材料的空隙填充行為在不填滿源極/汲極接觸件282與源極/汲極蓋層276之間的空間的情況下維持氣隙。因此，可在介電襯層304之間的上部分沉積密封層312的介電材料，以包圍源極/汲極接觸件282與源極/汲極蓋層276之間的空間，且沒有大量沉積在前述之空間的下部分。因此，可在密封層312的介電材料下和閘極堆疊240上形成相應的氣隙314，且氣隙314由從閘極堆疊240延伸至密封層312內的介電襯層304的側壁所環繞。在沉積密封層312的介電材料期間使用的一或多種氣體或任何其他可擴散進入氣隙314內的氣體種類可能存在於氣隙314中。密封層312自氣隙314朝源極/汲極接觸件282和源極/汲極蓋層276的頂面側向延伸。密封層312亦覆蓋介電襯層304之側壁的一部分和頂面。
在操作140中，方法100(第1C圖)對密封層312實施化學機械研磨製程以自源極/汲極接觸件282的表面移除過量的介電材料。根據一實施例，結果形成的結構如第29A-29E圖所示。由於密封層312包含與源極/汲極接觸件282不同的材料，使得源極/汲極接觸件282在藉由化學機械研磨製程對裝置200進行平坦化時可作為化學機械研磨的停止層。在操作140之後，密封層312仍覆蓋氣隙314，並暴露出源極/汲極接觸件282和源極/汲極蓋層276的頂面。在操作140之後，剩餘的密封層312介於相對的介電襯層304之間。一些實施例中，在操作140之後，剩餘的密封層312具有在約0.5 nm至約10 nm之範圍內的厚度。
在操作142中，方法100(第1D圖)在裝置200的背側上形成金屬佈線層，例如背側電源軌284。根據一實施例，結果形成的結構如第30A-30E圖所示。如第30B和30D圖所示，背側源極/汲極接觸件282電性連接至背側電源軌284。在一實施例中，可使用單鑲嵌製程、雙鑲嵌製程、金屬圖案化製程或其他合適的製程以形成背側電源軌284。背側電源軌284可包含鎢(W)、鈷(Co)、鉬(Mo)、釕(Ru)、銅(Cu)、鎳(Ni)、鈦(Ti)、鉭(Ta)、氮化鈦(TiN)、氮化鉭(TaN)或其他金屬，且可藉由化學氣相沉積、物理氣相沉積、原子層沉積、電鍍或其他合適的製程形成。在一實施例中，背側電源軌284可具有在約5 nm至約40 nm之範圍內的厚度d5。
在操作144中，方法100(第1D圖)實施裝置200之進一步的製程。舉例而言，可在裝置200的背側上形成一或多個互連層，在裝置200的背側上形成鈍化層，實施其他的產線後段製程，以及移除載具370。
雖然無意要限制本發明的實施例，但本揭露的實施例提供一或多個以下的優勢。舉例而言，本揭露的實施例在閘極堆疊與背側佈線層之間形成夾設的氣隙。這能有利地降低裝置的耦合電容值，有助於使電路運作更快。此外，本揭露的實施例使閘極堆疊與背側佈線層之間漏電流路徑的風險最小化。再者，本揭露的實施例形成背側佈線層，例如背側電源軌，以增加積體電路中可用的金屬路徑數，並為更大的裝置整合度增加閘極密度。本揭露的實施例可以容易地整合至現有的半導體生產製程中。
在一示範的樣態中，本揭露提供方法。方法包含提供具有前側和背側的結構，結構包含基底、在基底上的第一介電層、在第一介電層上且連接第一源極/汲極(S/D)部件和一第二源極/汲極部件的一或多個半導體通道層，以及與前述一或多個半導體通道層嚙合的閘極結構，其中基底在結構的背側，且閘極結構在結構的前側；自結構的背側蝕刻基底以形成暴露出第一源極/汲極部件的第一溝槽和暴露出第二源極/汲極部件的第二溝槽；在第一溝槽內形成源極/汲極接觸件；蝕刻至少一部分的第一介電層，使得源極/汲極接觸件的一部分自結構的背側的第一介電層突出；以及在源極/汲極接觸件上沉積密封層，其中密封層覆蓋閘極結構與密封層之間的氣隙。一些實施例中，方法更包含在源極/汲極接觸件的前述部分的側壁上形成介電襯層，其中密封層接觸件介電襯層。一些實施例中，蝕刻至少一部分的第一介電層包含在形成介電襯層之前，完全移除第一介電層。一些實施例中，形成介電襯層包含在結構的背側上順應性地沉積介電襯層；以及非等向性地蝕刻介電襯層，藉此自源極/汲極接觸件的頂面移除介電襯層。一些實施例中，方法更包含在第一溝槽內形成源極/汲極接觸件之前，沉積第二介電層以填充第二溝槽。一些實施例中，方法更包含在第一溝槽內形成源極/汲極接觸件之後，蝕刻第二介電層以暴露出第二源極/汲極部件。一些實施例中，方法更包含薄化密封層，藉此暴露出源極/汲極接觸件；以及在結構的背側形成金屬佈線層，其中金屬佈線層接觸源極/汲極接觸件。一些實施例中，沉積密封層包含電漿輔助化學氣相沉積(PE-CVD)製程。一些實施例中，氣隙自閘極結構的表面垂直延伸至密封層的表面的距離在約0.5 nm至約10 nm的範圍內。
在另一示範的樣態中，本揭露提供方法。方法包含提供具有前側和背側的結構，結構包含基底、在基底上的半導體鰭、在半導體鰭上的第一源極/汲極(S/D)部件和第二源極/汲極部件、在半導體鰭上的介電蓋層、在介電蓋層上且連接第一和第二源極/汲極部件的一或多個半導體通道層，以及與前述一或多個半導體通道層嚙合的閘極結構，其中基底在結構的背側，且閘極結構在結構的前側；自結構的背側薄化結構直至暴露出半導體鰭；自結構的背側蝕刻半導體鰭以形成暴露出第一源極/汲極部件的第一溝槽和暴露出第二源極/汲極部件的第二溝槽；在第二溝槽內沉積介電層；在第一溝槽內形成源極/汲極接觸件；自結構的背側凹陷介電蓋層，藉此暴露出源極/汲極接觸件的側壁；在源極/汲極接觸件的側壁上形成介電襯層；在源極/汲極接觸件上沉積密封層，使得氣隙夾設於閘極結構與密封層之間；以及在密封層上形成金屬佈線層，其中金屬佈線層電性耦接至源極/汲極接觸件。一些實施例中，在形成介電襯層之前，凹陷介電蓋層暴露出閘極結構的表面。一些實施例中，方法更包含在形成介電襯層之後，移除介電蓋層，藉此在介電襯層與閘極結構之間形成空隙。一些實施例中，凹陷介電蓋層亦暴露出介電層的側壁，且其中形成介電襯層包含在介電層的側壁上形成介電襯層。一些實施例中，方法更包含在形成介電襯層之前，蝕刻介電層以暴露出第二源極/汲極部件的表面和介電蓋層的側壁，其中形成介電襯層包含在介電蓋層的側壁上形成介電襯層。一些實施例中，氣隙自第二源極/汲極部件的表面垂直延伸至密封層的表面。一些實施例中，方法更包含在形成金屬佈線層之前，薄化密封層以暴露出源極/汲極接觸件。
在又一示範的樣態中，本揭露提供半導體結構。半導體結構包含第一和第二源極/汲極部件(S/D)；連接第一和該第二源極/汲極部件的一或多個通道半導體層；與前述一或多個通道半導體層嚙合的閘極結構，其中第一和第二源極/汲極部件、前述一或多個通道半導體層和該閘極結構在半導體結構的前側；在半導體結構的背側的金屬佈線層；以及在金屬佈線層與閘極結構之間的密封層，其中密封層藉由密封層與閘極結構之間的氣隙與閘極結構隔開。一些實施例中，半導體結構更包含電性耦接至第一源極/汲極部件的源極/汲極接觸件；以及在源極/汲極接觸件的側壁上的介電襯層，其中介電襯層接觸件該密封層。一些實施例中，介電襯層藉由氣隙與閘極結構隔開。一些實施例中，半導體結構更包含自第二源極/汲極部件的表面朝密封層延伸的介電襯層，其中介電襯層藉由氣隙與密封層隔開。
前述內文概述了許多實施例或範例的部件，以使本技術領域中具有通常知識者可以更佳地了解本揭露的各種樣態。本技術領域中具有通常知識者應可理解他們可使用本揭露為基礎來設計或修改其他製程及結構，以達到相同的目的及/或達到與在此介紹的實施例相同之優點。本技術領域中具有通常知識者亦應了解這些相等的結構並未背離本揭露的精神與範圍。在不背離本揭露的精神與範圍之前提下，可對本揭露進行各種改變、置換或修改。
100:方法 102:操作 104:操作 106:操作 108:操作 110:操作 112:操作 114:操作 116:操作 118:操作 120:操作 130:操作 131:操作 132:操作 134:操作 136:操作 138:操作 140:操作 142:操作 144:操作 200:裝置 201:基底 203:底部自對準蓋層 204:鰭 215:通道層 230:隔離結構 240:閘極堆疊 247:閘極間隔物 255:內間隔物 260:部件 269:接觸蝕刻停止層 270:層間介電層 272:溝槽 273:矽化物部件 275:源極/汲極接觸件 276:介電層 277: 互連層 278:源極/汲極接觸孔洞 280:矽化物部件 282:源極/汲極接觸件 284:背側電源軌 304:介電襯層 312:密封層 314:氣隙 333:空隙 349:閘極介電層 350:閘極電極層 352:自對準蓋層 356:源極/汲極蓋層 358:源極/汲極接觸導孔 360:蝕刻遮罩 362:開口 370:載具 d1:厚度 d2:距離 d3:距離 d4:長度 d5:厚度 d6:距離
藉由以下的詳述配合所附圖式可更加理解本揭露的內容。要強調的是，根據工業上的標準做法，各個部件(feature)並未按照比例繪製，且僅用於顯示目的。事實上，為了能清楚地討論，可能任意地放大或縮小各個部件的尺寸。 第1A、1B、1C和1D圖是根據本揭露的各種樣態，顯示具有背側金屬佈線層和背側氣隙之半導體裝置形成方法各實施例的流程圖。 第2A、3A、4A、5A、6A、7A、8A、9A、10A、11A、12A、13A、14A、15A、16A、17A、18A、19A、20A、21A、22A、23A、24A、25A、26A、27A、28A、29A和30A圖是根據一些實施例，顯示半導體裝置的一部分的俯視圖。 第2B、3B、4B、5B、6B、7B、8B、9B、10B、11B、12B、13B、14B、15B、16B、17B、18B、19B、20B、21B、22B、23B、24B、25B、26B、27B、28B、29B和30B圖是根據一些實施例，顯示分別沿著第2A、3A、4A、5A、6A、7A、8A、9A、10A、11A、12A、13A、14A、15A、16A、17A、18A、19A、20A、21A、22A、23A、24A、25A、26A、27A、28A、29A和30A圖中線B-B之半導體裝置的一部分的剖面示意圖。 第2C、4C、5C、6C、7C、8C、9C、10C、11C、12C、13C、14C、15C、16C、17C、18C、19C、20C、21C、22C、23C、24C、25C、26C、27C、28C、29C和30C圖是根據一些實施例，顯示分別沿著第2A、4A、5A、6A、7A、8A、9A、10A、11A、12A、13A、14A、15A、16A、17A、18A、19A、20A、21A、22A、23A、24A、25A、26A、27A、28A、29A和30A圖中線C-C之半導體裝置的一部分的剖面示意圖。 第2D、4D、5D、6D、7D、8D、9D、10D、11D、12D、13D、14D、15D、16D、17D、18D、19D、20D、21D、22D、23D、24D、25D、26D、27D、28D、29D和30D圖是根據一些實施例，顯示分別沿著第2A、4A、5A、6A、7A、8A、9A、10A、11A、12A、13A、14A、15A、16A、17A、18A、19A、20A、21A、22A、23A、24A、25A、26A、27A、28A、29A和30A圖中線D-D之半導體裝置的一部分的剖面示意圖。 第2E、4E、5E、6E、7E、8E、9E、10E、11E、12E、13E、14E、15E、16E、17E、18E、19E、20E、21E、22E、23E、24E、25E、26E、27E、28E、29E和30E圖是根據一些實施例，顯示分別沿著第2A、4A、5A、6A、7A、8A、9A、10A、11A、12A、13A、14A、15A、16A、17A、18A、19A、20A、21A、22A、23A、24A、25A、26A、27A、28A、29A和30A圖中線E-E之半導體裝置的一部分的剖面示意圖。
無
215:通道層
230:隔離結構
240:閘極堆疊
247:閘極間隔物
284:背側電源軌
304:介電襯層
312:密封層
314:氣隙
349:閘極介電層
350:閘極電極層
352:自對準蓋層

Claims (20)

  1. 一種半導體結構的製造方法，包括： 提供具有一前側和一背側的一結構，該結構包含一基底、在該基底上的一第一介電層、在該第一介電層上且連接一第一源極/汲極(S/D)部件和一第二源極/汲極部件的一或多個半導體通道層，以及與該一或多個半導體通道層嚙合的一閘極結構，其中該基底在該結構的該背側，且該閘極結構在該結構的該前側； 自該結構的該背側蝕刻該基底以形成暴露出該第一源極/汲極部件的一第一溝槽和暴露出該第二源極/汲極部件的一第二溝槽； 在該第一溝槽內形成一源極/汲極接觸件； 蝕刻至少一部分的該第一介電層，使得該源極/汲極接觸件的一部分自該結構的該背側的該第一介電層突出；以及 在該源極/汲極接觸件上沉積一密封層，其中該密封層覆蓋該閘極結構與該密封層之間的一氣隙。
  2. 如請求項1之半導體結構的製造方法，更包括： 在該源極/汲極接觸件的該部分的側壁上形成一介電襯層，其中該密封層接觸該介電襯層。
  3. 如請求項2之半導體結構的製造方法，其中蝕刻至少該部分的該第一介電層包含在形成該介電襯層之前，完全移除該第一介電層。
  4. 如請求項2之半導體結構的製造方法，其中形成該介電襯層包含： 在該結構的該背側上順應性地沉積該介電襯層；以及 非等向性地蝕刻該介電襯層，藉此自該源極/汲極接觸件的一頂面移除該介電襯層。
  5. 如請求項1之半導體結構的製造方法，更包括： 在該第一溝槽內形成該源極/汲極接觸件之前，沉積一第二介電層以填充該第二溝槽。
  6. 如請求項5之半導體結構的製造方法，更包括： 在該第一溝槽內形成該源極/汲極接觸件之後，蝕刻該第二介電層以暴露出該第二源極/汲極部件。
  7. 如請求項1之半導體結構的製造方法，更包括： 薄化該密封層，藉此暴露出該源極/汲極接觸件；以及 在該結構的該背側形成一金屬佈線層，其中該金屬佈線層接觸該源極/汲極接觸件。
  8. 如請求項1之半導體結構的製造方法，其中沉積該密封層包含一電漿輔助化學氣相沉積(PE-CVD)製程。
  9. 如請求項1之半導體結構的製造方法，其中該氣隙自該閘極結構的一表面垂直延伸至該密封層的一表面的一距離在約0.5 nm至約10 nm的範圍內。
  10. 一種半導體結構的製造方法，包括： 提供具有一前側和一背側的一結構，該結構包含一基底、在該基底上的一半導體鰭、在該半導體鰭上的一第一源極/汲極(S/D)部件和一第二源極/汲極部件、在該半導體鰭上的一介電蓋層、在該介電蓋層上且連接該第一源極/汲極部件和該第二源極/汲極部件的一或多個半導體通道層，以及與該一或多個半導體通道層嚙合的一閘極結構，其中該基底在該結構的該背側，且該閘極結構在該結構的該前側； 自該結構的該背側薄化該結構直至暴露出該半導體鰭； 自該結構的該背側蝕刻該半導體鰭以形成暴露出該第一源極/汲極部件的一第一溝槽和暴露出該第二源極/汲極部件的一第二溝槽； 在該第二溝槽內沉積一介電層； 在該第一溝槽內形成一源極/汲極接觸件； 自該結構的該背側凹陷該介電蓋層，藉此暴露出該源極/汲極接觸件的複數個側壁； 在該源極/汲極接觸件的該些側壁上形成一介電襯層； 在該源極/汲極接觸件上沉積一密封層，使得一氣隙夾設於該閘極結構與該密封層之間；以及 在該密封層上形成一金屬佈線層，其中該金屬佈線層電性耦接至該源極/汲極接觸件。
  11. 如請求項10之半導體結構的製造方法，其中在形成該介電襯層之前，凹陷該介電蓋層暴露出該閘極結構的一表面。
  12. 如請求項10之半導體結構的製造方法，更包括： 在形成該介電襯層之後，移除該介電蓋層，藉此在該介電襯層與該閘極結構之間形成一空隙。
  13. 如請求項10之半導體結構的製造方法，其中凹陷該介電蓋層亦暴露出該介電層的複數個側壁，且其中形成該介電襯層包含在該介電層的該些側壁上形成該介電襯層。
  14. 如請求項10之半導體結構的製造方法，更包括： 在形成該介電襯層之前，蝕刻該介電層以暴露出該第二源極/汲極部件的一表面和該介電蓋層的複數個側壁， 其中形成該介電襯層包含在該介電蓋層的該些側壁上形成該介電襯層。
  15. 如請求項14之半導體結構的製造方法，其中該氣隙自該第二源極/汲極部件的該表面垂直延伸至該密封層的一表面。
  16. 如請求項10之半導體結構的製造方法，更包括： 在形成該金屬佈線層之前，薄化該密封層以暴露出該源極/汲極接觸件。
  17. 一種半導體結構，包括： 一第一源極/汲極(S/D)部件和一第二源極/汲極部件； 一或多個通道半導體層，連接該第一源極/汲極部件和該第二源極/汲極部件； 一閘極結構，與該一或多個通道半導體層嚙合，其中該第一源極/汲極部件和該第二源極/汲極部件、該一或多個通道半導體層和該閘極結構在該半導體結構的一前側； 一金屬佈線層，在該半導體結構的一背側；以及 一密封層，在該金屬佈線層與該閘極結構之間，其中該密封層藉由該密封層與該閘極結構之間的一氣隙與該閘極結構隔開。
  18. 如請求項17之半導體結構，更包括： 一源極/汲極接觸件，電性耦接至該第一源極/汲極部件；以及 一介電襯層，在該源極/汲極接觸件的側壁上，其中該介電襯層接觸該密封層。
  19. 如請求項18之半導體結構，其中該介電襯層藉由該氣隙與該閘極結構隔開。
  20. 如請求項17之半導體結構，更包括： 一介電襯層，自該第二源極/汲極部件的一表面朝該密封層延伸，其中該介電襯層藉由該氣隙與該密封層隔開。
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